CN112542997B - 一种基于pc104堆栈的电路系统 - Google Patents

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Abstract

本发明公开一种基于PC104堆栈的电路系统包括：射频电路和数字基带电路；射频电路包括：射频上变频组件和射频下变频组件；数字基带电路包括：相互连接的可编程只读存储器和模/数转换器，可编程只读存储器内部存储有现场可编程门阵列，现场可编程门阵列的输入端与模/数转换器的输出端连接，模/数转换器的输入端通过同轴接插件与射频下变频组件连接，可编程只读存储器的输出端通过同轴接插件与射频上变频组件连接，现场可编程门阵列用于对接收到的信号进行处理，并将处理后的信号发送至射频上变频组件。本发明可以集成卫星测控和卫星数传的双重任务，不仅具备良好的星地测距精度，数据传输速率高。

Description

一种基于PC104堆栈的电路系统
技术领域
本发明涉及微小卫星通信技术领域，具体涉及一种基于PC104堆栈的电路系统。
背景技术
随着信息技术的发展，微小卫星通信设备小型化、集成化、数字化设计已成为一种必要趋势。微小卫星因其研制周期短，成本低，适用于执行紧急特定任务、新技术快速验证以及民商用航天。随着卫星星座概念的不断提出，卫星组网技术的发展，微小卫星将呈现产业化发展趋势。但同时相比传统卫星，微小卫星对体积、功耗、重量、成本、频率资源等方面的要求较为严苛。
传统卫星的基本架构，一般由测控应答机完成卫星上行遥控接收解调和下行遥测调制发射的功能，由数传发射机完成载荷数据的处理和下传，其中测控应答机和数传发射机都是以相对独立的单机形式进行设计，每台单机重量至少几千克，功耗至少几十瓦，同时传统卫星均采用宇航级器件，研制成本高，研制周期长。由于中低轨道、低成本测控通信微小卫星的资源有限，无论从体积、重量还是功耗、可靠性、研制周期、研制成本等方面，较传统导航卫星都有了较大的限制.
数字基带电路是测控应答机的关键组成模块，其功能包括上行测控信号的中频数字化处理、解扩解调、下行遥测编码、扩频调制等功能。数字基带电路同时也是数传发射机中的关键组成模块，将卫星的有效载荷数据进行组侦、加扰、编码、滤波之后输出至地面。传统卫星架构中测控应答机、数传发射机系统中所设计的数字基带电路，为提高基带信号处理能力、增加基带系统可靠性，大都采用FPGA+DSP或处理FPGA+监控FPGA的硬件设计思路，硬件设计的复杂程度较高，电路尺寸和功耗均超出微小卫星的使用需求，而且电路模块生产周期长、调试难度较大、元器件成本非常高。
因此，亟需提供一种基于PC104堆栈的电路系统，能够保证卫星中所使用的测控系统、数传系统具有集成度高、体积小、重量轻、功耗低、可靠性高等特点。
发明内容
为解决现有技术中存在的问题，本发明提供一种基于PC104堆栈的电路系统，包括：射频电路和数字基带电路；所述射频电路和所述数字基带电路通过同轴接插件连接，所述射频电路作为栈底，所述数字基带电路作为栈顶；
所述射频电路包括：射频上变频组件和射频下变频组件，所述射频上变频组件用于下行基带信号的调制、放大，所述射频下变频组件用于对卫星上行接收信号的下变频、AGC控制和基带信号放大输出；
所述数字基带电路包括：相互连接的可编程只读存储器和模/数转换器，所述可编程只读存储器内部存储有现场可编程门阵列，所述现场可编程门阵列的输入端与所述模/数转换器的输出端连接，所述模/数转换器的输入端通过所述同轴接插件与所述射频下变频组件连接，所述可编程只读存储器的输出端通过所述同轴接插件与所述射频上变频组件连接，所述现场可编程门阵列用于对接收到的信号进行处理，并将处理后的信号发送至射频上变频组件。
进一步地、所述射频电路和所述数字基带电路还通过板间互联连接器连接，所述现场可编程门阵列通过所述板间互联连接器与所述射频电路连接，用于检测所述射频上变频组件的功率遥测参数、检测所述射频下变频组件的AGC遥测参数及向所述射频上变频组件发送开关指令。
进一步地、所述射频电路还包括：时钟电路，所述时钟电路的一端与所述射频上变频组件连接，所述时钟电路的另一端通过所述同轴接插件与所述数字基带电路连接，用于同步所述射频电路和所述数字基带电路的时钟参数。
进一步地、还包括：微处理器；
所述数字基带电路还包括：接口转换组件，所述接口转换组件的一端连接所述可编程只读存储器，所述接口转换组件的另一端连接所述微处理器。
进一步地、还包括：能源资控载荷，所述接口转换组件与所述能源资控载荷连接，所述能源资控载荷用于控制所述射频电路和所述数字基带电路的开启或关闭。
进一步地、还包括：载荷设备，所述接口转换组件与所述载荷设备连接，所述载荷设备用于向所述数字基带电路发送图像数据。
进一步地、所述数字基带电路还包括：看门狗组件，所述看门狗组件与所述现场可编程门阵列连接，用于监测所述现场可编程门阵列的运行状态。
进一步地、所述数字基带电路还包括：电压转换组件，所述电压转换组件的一端与外接能源连接，所述电压转换组件的另一端与所述数字基带电路的供电侧连接，用于为所述数字基带电路和所述射频电路供电。
进一步地、所述数字基带电路还包括：数据存储组件，所述数据存储组件与所述现场可编程门阵列连接，用于存储所述载荷设备发送的图像数据。
进一步地、所述同轴接插件为同轴电缆。
本发明提出一种基于PC104堆栈的电路系统的实施具有以下有益效果：本发明提供的一种基于PC104堆栈的电路系统可以根据微小卫星的特点和需求基于PC104堆栈的电路系统集成卫星测控和卫星数传的双重任务，不仅具备良好的星地测距精度，数据传输速率高。本发明提供基于PC104堆栈的电路系统工作在X频段，仅用两块PC104标准的互联单板，集成了卫星遥控遥测和数传的功能，取代了原本一般卫星中测控应答机、遥控遥测单元、数传等多台独立单机的设计思路，系统重量、功耗等都降低了一个数量级以上。同时采用军温级器件加严考核后按照I级降额使用，降低研制成本的同时保证产品的可靠性。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它附图。
图1本发明实施例提供的一种数字基带板的结构图；
图2本发明实施例提供的一种射频板和数字基带板连接的结构图；
图3本发明实施例提供的一种基于PC104堆栈的电路系统结构示意图。
具体实施方式
下面详细描述本发明的实施例，所述实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，旨在用于解释本发明，而不能理解为对本发明的限制。
在本发明的描述中，需要理解的是，术语“上”、“下”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本发明和简化描述，而不是指示或暗示所指的装置或者元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本发明的限制。在本发明的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
需要说明的是，当一个元件被认为是“连接”另一个元件时，它可以是电路连接，也可是通信连接。为了便于理解本说明书实施例所述的技术方案及其产生的技术效果，本说明书实施例首先对于相关专业名词进行解释：
现场可编程门阵列：FPGA(Field－Programmable Gate Array)；
可编程只读存储器：PROM(Programmable Read-Only Memory)；
模/数转换器或者模拟/数字转换器：ADC(Analog-to-Digital Converter)是指将连续变量的模拟信号转换为离散的数字信号的器件。
除非另有定义，本文所使用的所有的技术和科学术语与属于本申请的技术领域的技术人员通常理解的含义相同。本文中在本申请的说明书中所使用的术语只是为了描述具体的实施方式的目的，不是旨在于限制本申请。
图1本发明实施例提供的一种数字基带板的结构图；图2本发明实施例提供的一种射频板和数字基带板连接的结构图；如图1-2所示，本说明书实施例提供的数字基带电路可以设置在图1所示的数字基带板上，该数字基带板可以设置有多个元器件及插针和插座便于堆栈的连接。射频电路可以设置在射频板上。射频板和数字基带板可以通过同轴接插件和板间互联连接器连接。
图3本发明实施例提供的一种基于PC104堆栈的电路系统结构示意图如图3所示，本发明提供一种基于PC104堆栈的电路系统，包括：射频电路和数字基带电路；所述射频电路和所述数字基带电路通过同轴接插件连接，所述射频电路作为栈底，所述数字基带电路作为栈顶；
所述射频电路包括：射频上变频组件和射频下变频组件，所述射频上变频组件用于下行基带信号的调制、放大，所述射频下变频组件用于对卫星上行接收信号的下变频、AGC控制和基带信号放大输出；
所述数字基带电路包括：相互连接的可编程只读存储器和模/数转换器，所述可编程只读存储器内部存储有现场可编程门阵列，所述现场可编程门阵列的输入端与所述模/数转换器的输出端连接，所述模/数转换器的输入端通过所述同轴接插件与所述射频下变频组件连接，所述可编程只读存储器的输出端通过所述同轴接插件与所述射频上变频组件连接，所述现场可编程门阵列用于对接收到的信号进行处理，并将处理后的信号发送至射频上变频组件。
在具体的实施过程中，数字基带电路作为基于PC104堆栈的电路系统中的关键组成模块，其具体功能包括：
a、电源处理功能，将提供的一次电源进行限流、消浪涌、EMI滤波后通过DC/DC进行二次电源转换，为射频电路和数字基带电路供电；
b、完成上行测控功能，将射频电路中射频下变频组件输出的中频信号进行AD采样、解扩、解调，并将解扩解调后的遥控信号进行处理，输出上行遥控数据至微处理器(卫星星务计算机)，产生直接指令输出至卫星其他分系统执行；
c、集成测控应答机下位机功能，采集系统自身的模拟遥测量，转换为数字状态遥测量，通过RS422总线送至微处理器(卫星星务计算机)，同时通过RS422总线接收来自微处理器(卫星星务计算机)的间接数据指令，经处理后产生间接指令送卫星其他分系统执行；
d、完成载荷数据接收、存储功能，通过高速LVDS接口接收载荷设备送出的大容量图像数据，存储于数据存储组件中，需要时由FPGA读出数据存储组件中的载荷数据并进行数据处理和下发；
e、完成下行遥测、数传功能，将卫星的下行遥测数据和有效载荷数据进行组帧、加扰、编码、滤波之后输出至射频上变频组件，通过对地天线发送至地面站，引导地面站捕获卫星，同时将卫星遥测信息(功率遥测、AGC遥测、电源遥测及稳定遥测)、有效载荷数据(图像数据)下传至地面。
考虑到集成化、小型化、高可靠等设计要求，本发明提供基于PC104堆栈的电路系统必须在保证各项基本指标的前提下，从性能、体积、重量、功耗、可靠性这几个方面得到突破，并且在宽温度范围(-25℃～+60℃)条件下仍然能够正常工作。设计重点考虑以下三个部分：
1、数字基带信号处理电路中的核心信号处理芯片选用Xilinx公司的SRAM型Artix-7系列FPGA。Artix-7系列芯片具有低功耗、高性能、逻辑资源丰富等特点，芯片逻辑资源满足测控数传一体化通信体制下基带信号处理的逻辑运算要求。考虑到SRAM型FPGA容易受到空间单粒子辐射的影响，通过采用三模冗余、动态刷新、局部加固等措施来提高FPGA芯片抗SEU(空间单粒子翻转)能力，确保空间复杂电磁环境下数字基带处理芯片的正常工作。
2、为了达到集成化、小型化、低成本的设计目标，在基于PC104堆栈的电路系统设计中，选用了小封装的电阻、电容、电感，选用较常规卫星使用的宇航级元器件低一个质量等级的军用元器件，元器件功能、性能和可靠性满足卫星寿命要求，并且降低数字基带电路的设计成本；而体积方面，则在满足电磁兼容的前提下对结构进行了紧凑设计，将所有功能模块集成在一块标准PC104印制板上，最大限度减小测控数传一体机的尺寸和重量。
模/数转换器(模数转换ADC电路)对下变频通道变频增益控制器输出的70MHz中频信号进行带通采样后送至处理芯片FPGA，ADC选用ADI公司的12位、80MSPS模数转换器，无失真动态范围达83dB，是面向雷达中频接收机、相控阵接收机、GPS抗干扰接收机等应用的一款高速AD转换模块，采用1.8V模拟电源供电，数字输出驱动器采用独立的电源供电，可适应1.8V至3.3V逻辑。ADC芯片功耗较低，80MSPS采样率时单通道功耗71mW，输入模拟信号最高700MHz带宽。
需要说明的是，同轴接插件可以为同轴电缆。射频上变频组件和射频下变频组件可以是相互连接的。
现场可编程门阵列(FPGA，Field－Programmable Gate Array)处理FPGA芯片选用Xilinx公司的SRAM型Artix-7系列FPGA，型号规格为XC7A100T-2FGG484I。Artix-7系列芯片具有低功耗、高性能、逻辑资源丰富等特点，通过对全部的FPGA资源进行仿真分析，测控体制下FPGA的逻辑资源使用50％左右，数传体制下FPGA的逻辑资源使用30％左右，测控数传一体化体制下基带信号处理所占FPGA的逻辑资源约80％，该处理FPGA芯片的逻辑资源能满足测控数传一体化体制下基带信号处理的逻辑运算要求。处理FPGA将AD采样后的信号锁频锁相、位同步、帧同步后输出上行遥控或数据至卫星星务计算机，产生直接指令输出至卫星其他分系统执行。处理FPGA芯片将载荷数据和下行遥测数据进行组侦、加扰、编码之后输出至测控数传一体化射频上变频模块，完成基带处理电路下行遥测、数传功能。同时Artix-7系列FPGA内部集成模数转换模块(XADC)，用于采集基于PC104堆栈的电路系统自身的模拟遥测量，如发射功率遥测、AGC遥测、电压遥测和温度遥测等，转换为数字状态遥测量，通过RS422总线送至卫星星务计算机。同时FPGA芯片通过RS422总线接收来自卫星星务计算机的间接指令，送至卫星的其他分系统单元。
数字基带FPGA软件存储在PROM中，该设计选用两片程序存储芯片，单片芯片包含16M比特存储空间，空间单粒子锁定指标高于120MeV，总剂量指标高于50kRad(Si)，保证了卫星在轨器件测控数传一体化数字基带处理FPGA程序的可靠性。程序存储PROM为一次烧写芯片，程序固化后无法修改，故程序调试阶段选用可重复擦写Flash芯片(XCF32P)，程序调试完成后进行软件固化落焊工作，程序调试过程中通过基带模块对外调试接插件接Xilinx仿真器实现程序实时调试。
在上述实施例基础上，本说明书一个实施例中，所述射频电路和所述数字基带电路还通过板间互联连接器连接，所述现场可编程门阵列通过所述板间互联连接器与所述射频电路连接，用于检测所述射频上变频组件的功率遥测参数、检测所述射频下变频组件的AGC遥测参数及向所述射频上变频组件发送开关指令。
在具体的实施过程中，开关指令、功率遥测、AGC遥测均可以通过板间互联连接器与射频电路连接。射频下变频组件与ADC的连接、射频上变频组件与FPGA的连接及时钟电路与数字基带电路的连接均可以通过同轴接插件连接。
在上述实施例基础上，本说明书一个实施例中，所述射频电路还包括：时钟电路，所述时钟电路的一端与所述射频上变频组件连接，所述时钟电路的另一端通过所述同轴接插件与所述数字基带电路连接，用于同步所述射频电路和所述数字基带电路的时钟参数。
在具体的实施过程中，由于数字基带电路中的基准时钟信号对信号处理起着至关重要的作用，时钟信号的质量决定测控系统的主要功能和性能。基于PC104堆栈的电路系统基准时钟由射频电路中的时钟电路提供，基准时钟信号经功分器分路之后，一路送射频模块供接收、发射通道使用，另一路时钟信号经同轴接插件后送数字基带FPGA使用，实现数字基带电路与射频电路基准时钟同源的效果。
在上述实施例基础上，本说明书一个实施例中，还包括：微处理器；
所述数字基带电路还包括：接口转换组件，所述接口转换组件的一端连接所述可编程只读存储器，所述接口转换组件的另一端连接所述微处理器。
在具体的实施过程中，数字基带电路对外接口统一由FPGA扩展，对外接口留有RS422收发接口、开路集电极(OC)指令输出接口、高速LVDS输入、输出接口等，低速信号通过标准PC104板间互联接插件进行传输，高速信号通过带屏蔽网的超高速接插件实现高速信号传输，数字基带电路与射频电路间通过SMP同轴插件实现高速模拟信号的板间传输。
在上述实施例基础上，本说明书一个实施例中，还包括：能源资控载荷，所述接口转换组件与所述能源资控载荷连接，所述能源资控载荷用于控制所述射频电路和所述数字基带电路的开启或关闭。
在上述实施例基础上，本说明书一个实施例中，还包括：载荷设备，所述接口转换组件与所述载荷设备连接，所述载荷设备用于向所述数字基带电路发送图像数据。
在具体的实施过程中，数字基带下行数据输出采用FPGA直接调制方案设计，基带模块输出I、Q两路调制信号至射频通道，输出接口为LVDS差分接口连接至载荷设备。
在上述实施例基础上，本说明书一个实施例中，所述数字基带电路还包括：看门狗组件，所述看门狗组件与所述现场可编程门阵列连接，用于监测所述现场可编程门阵列的运行状态。
在具体的实施过程中，为了达到高可靠的设计目标，通过看门狗组件(MAX706)监控FPGA运行状态，当程序运行异常后看门狗组件及时对应答机基带信号处理单元进行复位、程序重新加载操作。FPGA作为设备的核心器件，在其配置完成后按照硬件方式工作，为确保FPGA的程序配置文件不受空间单粒子影响，FPGA的程序配置器件选用PROM芯片，其耐辐射能力强、对单粒子锁定免疫，在空间环境中不可能发生单粒子锁定现象，从而确保数字基带电路核心配置程序的高可靠性。
看门狗组件采用MAXIM公司的MAX706芯片，当系统正常运行时，FPGA程序周期性喂狗，若程序运行异常，看门狗喂狗信号中断，看门狗芯片规定时间内检测无喂狗信号输入时，输出基带复位脉冲信号，使系统复位，FPGA程序重新加载。在满足系统可靠性的前提下，看门狗复位电路设计能最大限度的降低系统设计的复杂度，确保数字基带软件功能运行正常。同时看门狗组件每次上电后都会对数字基带电路实现一次完成完整的复位过程，进一步提高了数字基带电路的可靠性。
在上述实施例基础上，本说明书一个实施例中，所述数字基带电路还包括：电压转换组件，所述电压转换组件的一端与外接能源连接，所述电压转换组件的另一端与所述数字基带电路的供电侧连接，用于为所述数字基带电路和所述射频电路供电。
在具体的实施过程中，电压转换组件通过互联连接器从卫星能源板引入一次电源母线电压，经过限流、消浪涌、EMI滤波器后，通过开关电源DC/DC转换为基带板FPGA、ADC、数据存储模块、看门狗复位模块、接口模块等提供所需电压；通过线性电源LDO进行电源转换为射频电路各模块提供所需电压。
在上述实施例基础上，本说明书一个实施例中，所述数字基带电路还包括：数据存储组件，所述数据存储组件与所述现场可编程门阵列连接，用于存储所述载荷设备发送的图像数据。
在具体的实施过程中，数字基带电路通过高速LVDS接口，完成对卫星载荷数据的读取和存储，设计使用数据存储组件进行载荷数据的大容量存储，其中，数据存储组件可以是eMMC(嵌入式多媒体控制器)芯片。eMMC芯片内部集成了Flash Controller(闪存控制器)，包括了协议、擦写均衡、坏块管理、ECC(错误检查和纠正)、电源管理、时钟管理、数据存取等功能。相比于直接使用NAND Flash，eMMC屏蔽了NAND Flash的物理特性，可以减少FPGA控制软件的复杂度，省去对NAND Flash进行特殊的处理。eMMC芯片存储容量64GB，容量大小满足卫星载荷数据存储的要求。
本发明提供的基于PC104堆栈的电路系统，生产加工时无需手工飞线、工艺流程简单、研制周期短；采用高度集成化的单板式设计，降低了体积功耗重量；集成了卫星遥控遥测和数传等多种功能，功能全同时提高了频率资源的利用率；采用军温级器件加严考核后按照I级降额使用，降低研制成本的同时保证产品的可靠性。
采用PC104标准板卡式堆叠设计，对单板上的敏感电路采用局部屏蔽腔隔离设计，确保微小卫星力学要求的同时也保证了微小卫星较高的EMC指标。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。此外，本领域人员可以将本说明书中描述的不同实施例或示例进行接合和组合。
尽管上面已经示出和描述了本发明的实施例，可以理解的是，上述实施例是示例性的，不能理解为对本发明的限制，本领域的普通技术人员在本发明的范围内可以对上述实施例进行变化、修改和变型。

Claims (10)

1.一种基于PC104堆栈的电路系统，其特征在于，所述系统工作在X频段，所述系统包括：射频电路和数字基带电路；所述射频电路和所述数字基带电路通过同轴接插件连接，所述射频电路作为栈底，所述数字基带电路作为栈顶；
所述射频电路包括：射频上变频组件和射频下变频组件；所述射频上变频组件用于下行基带信号的调制、放大；所述射频下变频组件用于对卫星上行接收信号的下变频、AGC控制和基带信号放大输出；
所述数字基带电路包括：相互连接的可编程只读存储器和模/数转换器，所述可编程只读存储器内部存储有现场可编程门阵列，所述现场可编程门阵列的输入端与所述模/数转换器的输出端连接，所述模/数转换器的输入端通过所述同轴接插件与所述射频下变频组件连接，所述可编程只读存储器的输出端通过所述同轴接插件与所述射频上变频组件连接，所述现场可编程门阵列用于对接收到的信号进行处理，并将处理后的信号发送至射频上变频组件，所述数字基带电路还用于将卫星的下行遥测数据和有效载荷数据进行组帧、加扰、编码、滤波之后输出至射频上变频组件，通过对地天线发送至地面站，引导地面站捕获卫星，同时将卫星遥测信息、有效载荷数据下传至地面。
2.如权利要求1所述的基于PC104堆栈的电路系统，其特征在于，所述射频电路和所述数字基带电路还通过板间互联连接器连接，所述现场可编程门阵列通过所述板间互联连接器与所述射频电路连接，用于检测所述射频上变频组件的功率遥测参数、检测所述射频下变频组件的AGC遥测参数及向所述射频上变频组件发送开关指令。
3.如权利要求1所述的基于PC104堆栈的电路系统，其特征在于，所述射频电路还包括：时钟电路，所述时钟电路的一端与所述射频上变频组件连接，所述时钟电路的另一端通过所述同轴接插件与所述数字基带电路连接，用于同步所述射频电路和所述数字基带电路的时钟参数。
4.如权利要求1-3任一项所述的基于PC104堆栈的电路系统，其特征在于，还包括：微处理器；
所述数字基带电路还包括：接口转换组件，所述接口转换组件的一端连接所述可编程只读存储器，所述接口转换组件的另一端连接所述微处理器。
5.如权利要求4所述的基于PC104堆栈的电路系统，其特征在于，还包括：能源资控载荷，所述接口转换组件与所述能源资控载荷连接，所述能源资控载荷用于控制所述射频电路和所述数字基带电路的开启或关闭。
6.如权利要求4所述的基于PC104堆栈的电路系统，其特征在于，还包括：载荷设备，所述接口转换组件与所述载荷设备连接，所述载荷设备用于向所述数字基带电路发送图像数据。
7.如权利要求1-3、5或6任一项所述的基于PC104堆栈的电路系统，其特征在于，所述数字基带电路还包括：看门狗组件，所述看门狗组件与所述现场可编程门阵列连接，用于监测所述现场可编程门阵列的运行状态。
8.如权利要求1-3、5或6任一项所述的基于PC104堆栈的电路系统，其特征在于，所述数字基带电路还包括：电压转换组件，所述电压转换组件的一端与外接能源连接，所述电压转换组件的另一端与所述数字基带电路的供电侧连接，用于为所述数字基带电路和所述射频电路供电。
9.如权利要求6所述的基于PC104堆栈的电路系统，其特征在于，所述数字基带电路还包括：数据存储组件，所述数据存储组件与所述现场可编程门阵列连接，用于存储所述载荷设备发送的图像数据。
10.如权利要求1-3、5或6任一项所述的基于PC104堆栈的电路系统，其特征在于，所述同轴接插件为同轴电缆。
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