CN112153441B - 视频处理方法、装置、系统以及计算机可读介质 - Google Patents
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Abstract
本申请涉及一种视频处理方法、一种视频处理装置、一种视频处理系统以及一种计算机可读介质，所述视频处理方法例如包括：接收并响应输入的冻结指令以持续输出指定图像；在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。本申请解决了因视频处理芯片改变时序导致输出画面显示异常的问题。
Description
技术领域
本申请涉及显示技术领域，尤其涉及一种视频处理方法、一种视频处理装置、一种视频处理系统以及一种计算机可读介质。
背景技术
在现有的视频处理器架构中，如图1所示，其采用视频处理芯片配合FPGA实现视频处理功能，视频处理芯片会根据处理后图像的时序要求改变输出给FPGA的时序，在改变时序的过程中会存在视频源不稳定的状态，而且在改变完时序的过程需要稳定视频源的时间，因此在此过程中会导致后端FPGA收到错误的数据，最终导致输出的画面显示异常。
发明内容
因此，本申请实施例提出一种视频处理方法、一种视频处理装置、一种视频处理系统以及一种计算机可读介质，其可以解决因视频处理芯片改变时序导致输出画面异常的问题。
具体地，本申请实施例提出的一种视频处理方法，所述视频处理方法包括：接收并响应输入的冻结指令以持续输出指定图像；在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
在现有技术中，视频处理芯片在将处理后图像发给FPGA时图像时序也需要改变，然而在改变时序的过程中，常常因为稳定视频源需要一段时间从而导致FPGA接收到错误数据，产生输出画面异常的现象。而在本申请实施例中，通过持续输出指定图像、以及在监测到时序信息发生改变后，对输入视频帧进行计数缓存达到预设帧数后，根据更改的时序信息输出图像数据以替换指定图像，可以避免输出时序改变输出画面异常的情况，同时可以让用户实时看到输出画面改变的过程，有利于用户监测输出画面状态，提升了用户的体验感。
在本申请的一个实施例中，所述响应输入的冻结指令以持续输出指定图像的步骤包括：对响应所述冻结指令前的最后一个视频帧的图像数据进行缓存以得到所述指定图像的数据；以及持续输出所述指定图像的数据。
在本申请的一个实施例中，所述当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令的步骤：自动解除所述冻结指令。
在本申请的一个实施例中，所述响应输入的冻结指令以持续输出指定图像的步骤包括：持续输出黑色图像。
再者，本申请实施例提供的一种视频处理装置，所述视频处理装置包括：响应指令模块，用于接收并响应输入的冻结指令以持续输出指定图像；监视时序模块，用于在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；计数缓存模块，用于当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；解除指令模块，用于当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；读取输出模块，用于读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
在现有技术中，视频处理芯片在将处理后图像发给FPGA时，涉及的图像时序也需要改变，然而在改变时序的过程中，常常因为稳定视频源需要一段时间从而导致FPGA接收到错误数据，产生输出画面异常的现象。而在本申请实施例中，通过持续输出指定图像以及在监测到时序信息发生改变后，对输入视频帧进行计数缓存达到预设帧数后，根据更改的时序信息输出图像数据以替换指定图像，可以避免输出时序改变输出画面异常的情况，同时可以让用户实时看到输出画面改变的过程，有利于用户监测输出画面状态，提升了用户的体验感。
此外，本申请实施例提出的一种视频处理系统，所述视频处理系统包括：微控制器，用于发出冻结指令和输出控制指令；视频处理芯片，连接所述微控制器，用于接收并响应所述输出控制指令以调整输出的视频帧；存储器；以及可编程逻辑器件，连接所述微控制器、所述视频处理芯片和所述存储器，用于接收并响应所述冻结指令以持续输出指定图像，在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变，当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据至所述存储器，当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令，以及读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
在现有技术中，视频处理芯片在将处理后图像发给FPGA时，涉及的图像时序也需要改变，然而在改变时序的过程中，常常因为稳定视频源需要一段时间从而导致FPGA接收到错误数据，产生输出画面异常的现象。而在本申请实施例中，可编程逻辑器件通过持续输出指定图像、以及在监测到时序信息发生改变后，对输入视频帧进行计数缓存达到预设帧数后，根据更改的时序信息输出图像数据以替换指定图像，可以避免输出时序改变输出画面异常的情况，同时可以让用户实时看到输出画面改变的过程，有利于用户监测输出画面状态，提升了用户的体验感。
在本申请的一个实施例中，所述指定图像包括：响应所述冻结指令前的最后一个视频帧的图像或黑色图像。
在本申请的一个实施例中，所述预设帧数对应为所述存储器中的时序信息改变前的输入视频帧的图像数据的缓存空间全部被时序信息改变后的所述输入视频帧的图像数据所填充的图像帧数。
在本申请的一个实施例中，所述解除所述冻结指令包括：自动解除所述冻结指令。
再者，本申请实施例提出的一种计算机可读介质，所述计算机可读介质存储有计算机可读指令，所述计算机可读指令包括用于执行如上述中任一项所述的视频处理方法的指令。
由上可知，本申请实施例可以达成以下一个或多个有益效果：a)实现了视频处理芯片改变输出时序后仍然可以输出正常画面，解决了因视频处理芯片改变时序导致输出画面异常的问题；b)可以让用户实时看到输出画面改变的过程，有利于用户监测输出画面状态；c)提升了用户的体验感。
通过以下参考附图的详细说明，本申请的其它方面和特征变得明显。但是应当知道，该附图仅仅为解释的目的设计，而不是作为本申请的范围的限定。还应当知道，除非另外指出，不必要依比例绘制附图，它们仅仅力图概念地说明此处描述的结构和流程。
附图说明
此处所说明的附图用来提供对本申请的进一步理解，构成本申请的一部分，本申请的示意性实施例及其说明用于解释本申请，并不构成对本申请的不当限定。在附图中：
图1为本申请现有技术中的一种视频处理器的架构示意图；
图2为本申请第一实施例的一种视频处理方法的流程图；
图3为本申请第二实施例的一种视频处理装置的结构示意图；
图4为本申请第三实施例的一种视频处理系统的结构示意图；
图5为本申请第四实施例的一种计算机可读介质的结构示意图。
【附图标记说明】
S11-S15：视频处理方法步骤；
20：视频处理装置；201：响应指令模块；202：监视时序模块；203：计数缓存模块；204：解除指令模块；205：读取输出模块；
30：视频处理系统；301：视频处理芯片；302：可编辑逻辑器件；303：微控制器；304：存储器；
40：计算机可读介质。
具体实施方式
需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。下面将参考附图并结合实施例来说明本申请。
为了使本领域普通技术人员更好地理解本申请的技术方案，下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分的实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本申请保护的范围。
需要说明的是，本申请的说明书和权利要求书及上述附图中的术语“第一”、“第二”等是用于区别类似的对象，而不必用于描述特定的顺序或先后次序。应当理解这样使用的术语在适当情况下可以互换，以便这里描述的本申请实施例能够以除了在这里图示或描述的那些以外的顺序实施。此外，术语“包括”和“具有”以及他们的任何变形，意图在于覆盖不排他的包含，例如，包含了一系列步骤或单元的过程、方法、系统、产品或设备不必限于清楚地列出的那些步骤或单元，而是可包括没有清楚地列出的或对于这些过程、方法、产品或设备固有的其他步骤或单元。
还需要说明的是，本申请中多个实施例的划分仅是为了描述的方便，不应构成特别的限定，各种实施例中的特征在不矛盾的情况下可以相结合，相互引用。
【第一实施例】
参见图2，本申请第一实施例提出的一种视频处理方法，所述视频处理方法例如包括步骤S11至步骤S15。
步骤S11：接收并响应输入的冻结指令以持续输出指定图像；
步骤S12：在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；
步骤S13：当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；
步骤S14：当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及
步骤S15：读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
为便于理解，下面结合图1，对上述步骤S11-S15进行详细描述。
在步骤S11中，所述响应输入的冻结指令以持续输出指定图像的步骤包括：对响应所述冻结指令前的最后一个视频帧的图像数据进行缓存以得到所述指定图像的数据；以及持续输出所述指定图像的数据。或者，所述响应输入的冻结指令以持续输出指定图像的步骤包括：持续输出黑色图像。本实施例并不限制指定图像，其例如为响应冻结指令前的最后一个视频帧的图像或者为黑色图像。通过持续输出指定图像的数据或者持续输出黑色图像，可以避免现有技术中输出画面异常的情况。
在步骤S12中，提到的视频帧包括图像数据和时序信息，通过不断监测输入视频帧的时序信息是否改变，从而可以确定输入的图像数据是否改变。
在步骤S13中，当监测到输入视频帧的时序信息改变后，也即输入的图像数据发生改变，则对输入视频帧进行计数，且对输入视频帧中的图像数据进行缓存。
在步骤S14中，当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令包括：自动解除所述冻结指令。提到的解除所述冻结指令可以理解为停止持续输出指定图像的动作。提到的预设帧数为缓存时序信息改变前的输入视频帧的图像数据的缓存空间全部被时序信息改变后的所述输入视频帧的图像数据所填充的图像帧数。
在步骤S15中，读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像，具体地，因为已经解除了冻结指令，此时已经不再持续输出指定图像，根据改变后的时序信息将缓存的输入视频帧的图像数据读取并输出，可以替换指定图像。
下面，以用户进行操作改变输出窗口大小，使得视频处理芯片改变输出时序信息为例，对本实施例提供的视频处理方法进行具体地说明。其中涉及包括微控制器例如MCU、可编辑逻辑器件例如FPGA、视频处理芯片以及存储器的视频处理系统。当用户进行操作改变输出窗口大小时，视频处理系统内部进行以下流程：
1)MCU给FPGA发送冻结指令；
2)MCU给视频处理芯片发送改变输出窗口大小指令；
3)FPGA得到冻结指令后，将此时的最后一帧未改变尺寸的图像数据缓存后持续的输出该帧未改变尺寸的图像数据；
4)FPGA不断监测视频处理芯片输出视频帧的时序信息是否改变；
5)若FPGA监测到视频处理芯片输出视频帧的时序信息已经改变，即视频处理芯片已经完成了对改变输出窗口大小指令的响应，即完成了对其输出视频帧中的图像数据进行调整得到改变尺寸的图像数据，则FPGA开始对输入视频帧进行计数，并往缓存里循环写入输入视频帧中的改变尺寸的图像数据；
6)当FPGA对输入视频帧计数到3帧，则缓存里全部填充为改变尺寸的图像数据，之后FPGA解除冻结指令；
7)FPGA从缓存里读出改变尺寸的图像数据并输出，以替换最后一帧未改变尺寸的图像数据。
其中，FPGA需要做的处理为响应MCU的冻结指令以及根据监测到的视频处理芯片的时序信息自动做出解冻的动作，并读取缓存中的改变尺寸的图像数据并输出。
综上所述，本实施例提供的一种视频处理方法，实现了视频处理芯片改变输出时序后仍然可以输出正常画面，解决了因视频处理芯片改变时序导致输出画面异常的问题；可以让用户实时看到输出画面改变的过程，利于用户监测输出画面状态；提升了用户的体验感。
【第二实施例】
如图3所示，为本申请第二实施例提供的一种视频处理装置20，其包括响应指令模块201、监视时序模块202、计数缓存模块203、解除指令模块204以及读取输出模块205。
其中，响应指令模块201用于接收并响应输入的冻结指令以持续输出指定图像。监视时序模块202用于在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变。计数缓存模块203用于当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据。解除指令模块204用于当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令。读取输出模块205用于读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
本实施例上述视频处理装置20所实现的视频处理方法如前述第一实施例所述，故在此不再进行详细讲述。可选地，第二实施例中的各个模块和上述其他操作或功能分别为了实现本申请第一实施例中的方法，为了简洁，不在此赘述。
综上所述，本实施例提供的视频处理装置，实现了视频处理芯片改变输出时序后仍然可以输出正常画面，解决了因视频处理芯片改变时序导致输出画面异常的问题；可以让用户实时看到输出画面改变的过程，利于用户监测输出画面状态；提升了用户的体验感。
【第三实施例】
如图4所示，为本申请第三实施例提供的一种视频处理系统30，其包括：视频处理芯片301、可编辑逻辑器件302、微控制器303以及存储器304。
其中，微控制器303用于发出冻结指令和输出控制指令。视频处理芯片301连接微控制器303用于接收并响应所述输出控制指令以调整输出的视频帧。可编程逻辑器件302连接微控制器303、视频处理芯片301和存储器304，用于接收并响应所述冻结指令以持续输出指定图像；在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据至所述存储器；当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。存储器304用于进行缓存数据。
提到的指定图像例如为响应所述冻结指令前的最后一个视频帧的图像或黑色图像。提到的预设帧数对应为存储器304中的时序信息改变前的输入视频帧的图像数据的缓存空间全部被时序信息改变后的所述输入视频帧的图像数据所填充的图像帧数。提到的解除冻结指令例如包括自动解除冻结指令。
其中，视频处理芯片301例如为STDP8020芯片或其他类型视频处理芯片如FLI32626等替换。视频处理芯片在视频处理系统中还可以完成视频图像输入通道的选择，对输入的视频图像进行亮度、色度、饱和度、伽玛调整、肤色补偿、色彩增强等色彩处理，并实现输入的视频图像去隔行、无级缩放等视频增强处理功能和PIP、图文叠加等图像融合功能。视频处理芯片电连接可编辑逻辑器件302。经过视频处理芯片301处理后输出的图像例如以并行TTL格式或数据线较少且抗干扰能力较强的LVDS(Low Voltage DifferentialSignaling，低压差分信号)格式输出至可编辑逻辑器件302。其中，当输出图像格式为LVDS时，可编辑逻辑器件302内部需要进行相应的图像格式转换。
可编辑逻辑器件302例如为FPGA(Field Programmable Gate Array，现场可编辑门阵列)，其用于实现如第一实施例所述的视频处理方法，具体可编辑逻辑器件所采用的视频处理方法的介绍可参考第一实施例。本实施例中不再对其进行重复介绍。此外，可编辑逻辑器件302还可以实现拼接、多图层处理等功能。微控制器303例如为MCU(MicrocontrollerUnit，又称单片机)。存储器304例如为动态随机存储器或闪存。
综上所述，本实施例提供的视频处理系统，实现了视频处理芯片改变输出时序后仍然可以输出正常画面，解决了因视频处理芯片改变时序导致输出画面黑屏和花屏的问题；可以让用户实时看到输出画面改变的过程，利于用户监测输出画面状态；提升了在具有视频处理系统产品中的用户体验感。
【第四实施例】
图5所示，为本申请第四实施例提供的一种计算机可读介质，计算机可读介质40存储有计算机可读指令，所述计算机可读指令例如包括用于执行如第一实施例所述的视频处理方法的指令。举例而言，所述计算机可读指令执行如下指令：
(i)接收并响应输入的冻结指令以持续输出指定图像；
(ii)在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；
(iii)当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；
(iv)当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；
(v)读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像。
本实施例提供的计算机可读介质40其计算机可读指令执行的视频处理方法如前述第一实施例所述，故在此不再进行详细讲述。可选地，本实施例中的计算机可读介质40为了实现本申请第一实施例中的方法，为了简洁，不在此赘述。本实施例提供的计算机可读介质40的技术效果与第一实施例中视频处理方法的技术效果相同，在此不再赘述。
在本申请所提供的几个实施例中，应该理解到，所揭露的系统，装置和/或方法，可以通过其它的方式实现。例如，以上所描述的装置实施例仅仅是示意性的，例如，所述单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多路单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另一点，所显示或讨论的相互之间的耦合或直接耦合或通信连接可以是通过一些接口，装置或单元的间接耦合或通信连接，可以是电性，机械或其它的形式。
所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多路网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本实施例方案的目的。
至此，本文中应用了具体个例对本申请的视频处理方法、视频处理装置、视频处理系统和计算机可读介质的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的方法及其核心思想；同时，对于本领域的一般技术人员，依据本申请的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本申请的限制，本申请的保护范围应以所附的权利要求为准。
Claims (9)
1.一种视频处理方法，其特征在于，包括：
接收并响应输入的冻结指令以持续输出指定图像；
在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；
当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；
当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及
读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像；
其中，所述预设帧数为缓存所述输入视频帧的时序信息改变前的图像数据的缓存空间全部被所述输入视频帧的时序信息改变后的图像数据所填充的图像帧数。
2.根据权利要求1所述的视频处理方法，其特征在于，所述响应输入的冻结指令以持续输出指定图像的步骤包括：
对响应所述冻结指令前的最后一个视频帧的图像数据进行缓存以得到所述指定图像的数据；以及
持续输出所述指定图像的数据。
3.根据权利要求1所述的视频处理方法，其特征在于，所述当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令的步骤：自动解除所述冻结指令。
4.根据权利要求1所述的视频处理方法，其特征在于，所述响应输入的冻结指令以持续输出指定图像的步骤包括：持续输出黑色图像。
5.一种视频处理装置，其特征在于，包括：
响应指令模块，用于接收并响应输入的冻结指令以持续输出指定图像；
监视时序模块，用于在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；
计数缓存模块，用于当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据；
解除指令模块，用于当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；
读取输出模块，用于读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像；
其中，所述预设帧数为缓存所述输入视频帧的时序信息改变前的图像数据的缓存空间全部被所述输入视频帧的时序信息改变后的图像数据所填充的图像帧数。
6.一种视频处理系统，其特征在于，包括：
微控制器，用于发出冻结指令和输出控制指令；
视频处理芯片，连接所述微控制器，用于接收并响应所述输出控制指令以调整输出的视频帧；
存储器；以及
可编程逻辑器件，连接所述微控制器、所述视频处理芯片和所述存储器，用于：
接收并响应所述冻结指令以持续输出指定图像；
在响应所述冻结指令之后，监测输入视频帧的时序信息是否改变；
当监测到所述输入视频帧的时序信息改变后，对所述输入视频帧进行计数并缓存所述输入视频帧的图像数据至所述存储器；
当对所述输入视频帧进行计数达到预设帧数，解除所述冻结指令；以及
读取缓存的所述图像数据并根据改变后的时序信息输出所述读取的图像数据，以替换所述指定图像；
其中，所述预设帧数为缓存所述输入视频帧的时序信息改变前的图像数据的缓存空间全部被所述输入视频帧的时序信息改变后的图像数据所填充的图像帧数。
7.根据权利要求6所述的视频处理系统，其特征在于，所述指定图像包括：响应所述冻结指令前的最后一个视频帧的图像或黑色图像。
8.根据权利要求6所述的视频处理系统，其特征在于，所述解除所述冻结指令包括：自动解除所述冻结指令。
9.一种计算机可读介质，其特征在于，所述计算机可读介质存储有计算机可读指令，所述计算机可读指令被处理器执行时，实现如权利要求1至4中任一项所述的视频处理方法的指令。
Priority Applications (1)
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|---|---|---|---|
| CN201910574587.XA CN112153441B (zh) | 2019-06-28 | 2019-06-28 | 视频处理方法、装置、系统以及计算机可读介质 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| CN201910574587.XA CN112153441B (zh) | 2019-06-28 | 2019-06-28 | 视频处理方法、装置、系统以及计算机可读介质 |
Publications (2)
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|---|---|
| CN112153441A CN112153441A (zh) | 2020-12-29 |
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