CN111540332A - 时序控制电路、显示面板 - Google Patents

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Abstract

本申请公开了一种时序控制电路、显示面板。所述时序控制电路包括:一存储器;一时序控制器,所述时序控制器与所述存储器连接;以及一第一供电装置,与所述存储器连接;所述时序控制器包括一触发模块,所述触发模块与所述第一供电装置连接;当触发模块接收到一电平信号时,允许或禁止所述时序控制器调用所述存储器中的数据。本申请通过所述触发模块与所述第一供电装置连接,并且当触发模块接收到一电平信号时,允许/禁止所述时序控制器调用所述存储器中的数据,从而有效防止所述时序控制器调用数据失败的问题。

Description

时序控制电路、显示面板
技术领域
本申请涉及显示技术,尤其涉及一种时序控制电路、显示面板。
背景技术
伽马曲线(Gamma)和闪烁(flicker)程度为液晶显示面板的重要参数,但由于液晶显示面板制程有差异,固定的伽马曲线和公共电压并不能满足所有液晶显示面板。生产商往往需要对液晶显示面板进行出厂前的伽马曲线和公共电压的自动调试,使液晶显示面板接近标准的伽马曲线和最佳的flicker参数,并将参数储存到液晶显示面板驱动板的存储器中。现在液晶电视厂商为节省成本,将时序时序控制器功能集成在液晶面板系统板上,液晶显示面板所需的电源集成在液晶显示面板源极印刷电路板上。开机时,液晶显示面板系统板(SOC)可以通过数据传输线调用数据。
然而,液晶显示面板系统板供电和面板供电是各自独立的,每次供电后,液晶显示面板系统板访问Flash IC(编码型快闪记忆体)的时间不可控。液晶显示面板系统板先上电后自启动,然后即可访问Flash IC,然而此时Flash IC的供电状态未知,存在访问失效的风险。
发明内容
本申请实施例提供一种种序控制电路、显示面板,用于解决目前液晶显示面板系统板访问Flash IC可能存在失效的问题。
根据本申请的一方面,本申请实施例提供一种时序控制电路,包括:一存储器;一时序控制器,所述时序控制器与所述存储器连接;以及一第一供电装置,与所述存储器连接;所述时序控制器包括一触发模块,所述触发模块与所述第一供电装置连接;当触发模块接收到一电平信号时,允许或禁止所述时序控制器调用所述存储器中的数据。
进一步地,所述时序控制电路还包括:第二供电装置,所述第二供电装置与所述时序控制器连接。
进一步地,所述时序控制电路包括第一印刷电路板;所述第一供电装置位于第一印刷电路板上。
进一步地,所述时序控制电路包括第二印刷电路板;所述第二供电装置位于第二印刷电路板上。
进一步地,所述时序控制器与所述存储器通过串行外设接口连接。
进一步地,当所述电平信号为高电平信号时,允许所述时序控制器调用所述存储器中的数据。
进一步地,当所述电平信号为低电平信号时,禁止所述时序控制器调用所述存储器中的数据。
进一步地,所述时序控制电路还包括:一参数调整单元,与所述时序控制器连接,所述参数调整单元用于接收时序控制器所调用的数据。
进一步地,所述参数调整单元通过I2C协议总线接收所述时序控制器所调用的数据。
根据本申请的另一方面,本申请实施例提供一种显示面板,包括上述时序控制电路。
本申请的优点在于,相较于现有技术,本申请通过所述触发模块与所述第一供电装置连接,并且当触发模块接收到一电平信号时,允许或禁止所述时序控制器调用所述存储器中的数据,从而有效防止所述时序控制器调用数据失败的问题。
附图说明
下面结合附图,通过对本申请的具体实施方式详细描述,将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的一种时序控制电路结构示意图。
图2为本申请实施例提供的一种显示面板结构示意图。
图3为本申请实施例提供的一种显示装置结构示意图。
具体实施方式
下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述。显然,所描述的实施例仅仅是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
在本申请的描述中,需要理解的是,术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”、“顺时针”、“逆时针”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本申请的限制。此外,术语“第一”、“第二”仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个所述特征。在本申请的描述中,“多个”的含义是两个或两个以上,除非另有明确具体的限定。
在本申请的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接或可以相互通讯;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通或两个元件的相互作用关系。对于本领域的普通技术人员而言,可以根据具体情况理解上述术语在本申请中的具体含义。在本实施例中,所述模拟显示屏触摸单元与所述头部追踪单元连接,用于获取所述显示设备中的感应光标的移动路径。
在本申请中,除非另有明确的规定和限定,第一特征在第二特征之“上”或之“下”可以包括第一和第二特征直接接触,也可以包括第一和第二特征不是直接接触而是通过它们之间的另外的特征接触。而且,第一特征在第二特征“之上”、“上方”和“上面”包括第一特征在第二特征正上方和斜上方,或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”包括第一特征在第二特征正下方和斜下方,或仅仅表示第一特征水平高度小于第二特征。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开,下文中对特定例子的部件和设置进行描述。当然,它们仅仅为示例,并且目的不在于限制本申请。此外,本申请可以在不同例子中重复参考数字和/或参考字母,这种重复是为了简化和清楚的目的,其本身不指示所讨论各种实施方式和/或设置之间的关系。此外,本申请提供了的各种特定的工艺和材料的例子,但是本领域普通技术人员可以意识到其他工艺的应用和/或其他材料的使用。
如图1所示,为本申请实施例提供的时序控制电路结构示意图,包括:一存储器11、一时序控制器21、一第一供电装置12、一第二供电装置23、一第二印刷电路板20、一第一印刷电路板10及一参数调整单元24。
所述时序控制器21与所述存储器11连接。在本申请实施例中,所述时序控制器21和所述存储器11均设有串行外设接口(Serial Peripheral Interface,简称SPI),并且两个串行外设接口之间通过一柔性扁平电缆(Flexible Flat Cable,简称FFC)连接。
所述时序控制器21包括一触发模块22。触发模块可以为一种常规的I/O接口。所述触发模块22与所述第一供电装置12连接。当触发模块22接收到一电平信号时,允许或禁止所述时序控制器21调用所述存储器11中的数据。在本申请实施例中,当所述电平信号为高电平信号时,允许所述时序控制器21调用所述存储器11中的数据。当所述电平信号为低电平信号时,禁止所述时序控制器21调用所述存储器11中的数据。当然,在其他部分实施例中,允许或禁止所述时序控制器21调用所述存储器11中的数据的判断依据不仅限于电平信号是否为高电平信号或低电平信号,判断依据也可以是大于或小于一阈值电压。所述触发模块22与所述第一供电装置12之间相连的连接线设置在所述柔性扁平电缆中。在其他部分实施例中,所述触发模块22与所述第一供电装置12之间相连也可以通过其他方式实现。
所述第一供电装置12设置在第一印刷电路板10上,所述第一供电装置12与所述存储器11连接,用于为所述存储器提供工作电压。所述第二供电装置23设置第二印刷电路板20上,所述第二供电装置23与所述时序控制器21连接,用于为所述时序控制器21提供工作电压。所述时序控制器21与所述存储器11的供电装置分别位于不同的印刷电路板上。
所述存储器11可以为编码型快闪记忆体,但不限于此,例如带电可擦可编程只读存储器。所述存储器11的工作电压为3.3伏。
在本申请实施例中,当所述时序控制电路工作时,所述时序控制器21上电并完成自启动之后,等待所述触发模块22检测是否接受到一电平信号。此时若所述存储器11接收到第一印刷电路板10上的第一供电装置12发出的3.3伏的电压信号并执行上电启动操作的同时,第一供电装置12将该3.3伏的电压信号传送给所述触发模块22。当触发模块22检测到3.3伏的电压信号(即高电平信号)后,允许所述时序控制器21调用所述存储器11中的数据,从而有效防止时序控制器21调用数据失败的问题。进一步所述时序控制器21将所述数据并利用I2C协议总线发送给所述参数调整单元24。其中I2C协议总线包括一串行数据线(SDA)和一串行时钟线(SCL)。所述参数调整单元24根据所述数据完成系统电压、显示参数、以及闪烁效果的调整,从而使得显示面板能够正常工作。
本申请的优点在于,相较于现有技术,本申请通过所述触发模块与所述第一供电装置连接,并且当触发模块接收到一电平信号时,允许或禁止所述时序控制器调用所述存储器中的数据,从而有效防止时序控制器调用数据失败的问题。
如图2所示,为本申请实施例所提供的显示面板结构示意图,所述显示面板200包括上述任一实施例所述的时序控制电路100。
如图3所示,为本申请实施例所提供的显示装置结构示意图,所述显示装置300包括上述实施例所述的显示面板200。
该显示装置300可以为:手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
当本实施例的显示装置300采用上述实施例所述的背光模组时,其显示效果更好。
当然,本实施例的显示装置300中还可以包括其他常规结构,如电源单元、显示驱动单元等。
在上述实施例中,对各个实施例的描述都各有侧重,某个实施例中没有详述的部分,可以参见其他实施例的相关描述。
本文中应用了具体个例对本申请的原理及实施方式进行了阐述,以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想;本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分技术特征进行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (10)

1.一种时序控制电路,其特征在于,包括:
一存储器;
一时序控制器,所述时序控制器与所述存储器连接;以及
一第一供电装置,与所述存储器连接;
所述时序控制器包括一触发模块,所述触发模块与所述第一供电装置连接;
当触发模块接收到一电平信号时,允许或禁止所述时序控制器调用所述存储器中的数据。
2.根据权利要求1所述的时序控制电路,其特征在于,所述时序控制电路还包括:一第二供电装置,所述第二供电装置与所述时序控制器连接。
3.根据权利要求1所述的时序控制电路,其特征在于,所述时序控制电路包括第一印刷电路板;
所述第一供电装置设置在第一印刷电路板上。
4.根据权利要求2所述的时序控制电路,其特征在于,所述时序控制电路包括第二印刷电路板;
所述第二供电装置设置在第二印刷电路板上。
5.根据权利要求1所述的时序控制电路,其特征在于,所述时序控制器与所述存储器通过一串行外设接口连接。
6.根据权利要求1所述的时序控制电路,其特征在于,当所述电平信号为高电平信号时,允许所述时序控制器调用所述存储器中的数据。
7.根据权利要求1所述的时序控制电路,其特征在于,当所述电平信号为低电平信号时,禁止所述时序控制器调用所述存储器中的数据。
8.根据权利要求1所述的时序控制电路,其特征在于,还包括:
一参数调整单元,与所述时序控制器连接,所述参数调整单元用于接收所述时序控制器所调用的数据。
9.根据权利要求8所述的时序控制电路,其特征在于,所述参数调整单元通过I2C协议总线接收所述时序控制器所调用的数据。
10.一种显示面板,其特征在于,包括权利要求1-9任意一项所述的时序控制电路。
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