CN111183474A - 用于驱动显示面板的集成电路 - Google Patents
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Abstract
实施例提供与显示面板中的数据发送或接收有关的技术。在本实施例中,共用数据线的多个集成电路可以经由分别以1:1方式连接至这些集成电路的信号线而发送指示信号,并且根据该指示信号经由数据线发送数据。
Description
技术领域
本发明涉及用于驱动显示面板的集成电路。
背景技术
显示面板包括用于从主机接收图像数据并且主要处理该图像数据的数据处理装置。数据处理装置(也称为定时控制器)根据面板的特性来对该图像数据进行转换,并且将转换后的图像数据发送至数据驱动装置。
数据驱动装置(也称为源极驱动器或列驱动器等)将所接收到的图像数据转换成数据电压,并且使用该数据电压来驱动面板上所布置的像素。
在各种类型的显示面板中,使用有机发光二极管(OLED)的面板包括用于感测像素的特性的变化、并且根据像素的改变后的特性来补偿图像数据的步骤。这里,感测装置将与像素特性有关的感测数据发送至数据处理装置。
感测装置经常布置在与数据驱动装置的封装相同的封装中。在这样的产品中,可以认为数据驱动装置实际上将感测数据发送至数据处理装置。
如上所述,在显示面板中,在多个装置之间发送和接收诸如图像数据或感测数据等的各种类型的数据。
用于发送感测数据的感测装置或数据驱动装置可以包括多个集成电路、而不是一个集成电路。近来,存在如下的趋势:随着显示面板的分辨率更高且其面积更大,显示面板上所布置的像素的数量增加。根据这样的趋势,形成感测装置或数据驱动装置的集成电路的数量也增加。
将面板划分成多个分区,通过负责该面板的各分区的集成电路来感测各分区中的各像素,并且将多个集成电路所生成的感测数据收集在数据处理装置中并作为整个面板的感测数据来处理。这里,在两个或更多个集成电路共用数据线的情况下,允许多个集成电路无冲突地发送感测数据的方法将成为问题。
传统上,使用如下的逐位进位方法(cascade carry method):多个集成电路经由进位线与数据处理装置连接,集成电路发送感测数据并随后发送进位信号至另一集成电路,然后接收到该进位信号的集成电路发送感测数据并随后发送进位信号至另一集成电路。在该方法中,存在如下的问题:在需要再次从特定集成电路接收感测数据的情况下,整个集成电路必须再次发送感测数据。
发明内容
技术问题
在该背景下,根据一方面,本发明提供用于允许共用数据线的多个集成电路高效地发送数据的技术。
用于解决问题的方案
为此,本发明的一方面提供一种集成电路,用于感测被划分成多个分区的面板的一个分区,所述集成电路包括:感测电路,用于感测所述一个分区中所布置的像素的特性,并且生成感测数据;信号控制电路,用于将指示信号经由以一对一(1:1)方式连接的信号线发送至用于收集所述感测数据的装置;以及发送电路,用于根据所述指示信号的发送,将所述感测数据经由以一对N(1:N)方式(N是2或更大的自然数)连接的数据线发送至所述装置。
所述指示信号可以是表示所述数据线被所述集成电路占用、或者指示所述集成电路占用所述数据线的信号。
所述集成电路还可以包括:接收电路,用于从所述装置接收根据所述感测数据补偿后的图像数据;以及驱动电路,用于将所述图像数据转换成数据电压,并且经由与所述像素连接的数据电压线来发送所述数据电压。
本发明的另一方面提供一种数据处理集成电路,包括:接收电路,用于经由以1:N方式(N是2或更大的自然数)连接的感测数据线从多个数据驱动集成电路接收面板上所布置的像素的感测数据;信号控制电路,用于通过以1:1方式与所述多个数据驱动集成电路连接的多个信号线接收指示信号,并且根据所述指示信号来发送所述感测数据;补偿电路,用于根据所述感测数据来补偿图像数据;以及发送电路,用于将补偿后的图像数据经由各个图像数据线发送至所述多个数据驱动集成电路中的各数据驱动集成电路。
各所述数据驱动集成电路检查所述数据线的状态,并且在所述数据线未被识别为处于不能发送所述感测数据的特定状态的情况下,各所述数据驱动集成电路可以在特定时间点发送所述感测数据。
发明的效果
如上所述,根据本发明,共用数据线的多个集成电路可以高效地发送数据。例如,各集成电路可以定期地或不定期地发送数据并且容易地重新发送数据以补偿数据,或者仅一些集成电路可以重复地发送或重新发送数据。这提高了数据发送和接收的效率。
附图说明
图1是根据实施例的显示装置的结构图。
图2是根据实施例的面板驱动装置的结构图。
图3是根据实施例的数据处理集成电路的结构图。
图4是根据实施例的数据驱动集成电路的结构图。
图5是示出根据实施例的用于发送指示信号(indication signal)和感测数据的时间点的时序图。
图6是示出根据实施例的数据驱动集成电路中的发送感测数据的处理的流程图。
图7是示出根据实施例的在信号线和感测数据线中形成的信号的时序图。
图8是示出根据实施例的数据驱动集成电路中的重新发送感测数据的处理的流程图。
图9是示出根据实施例的数据驱动集成电路中的接收指示信号并发送感测数据的处理的流程图。
具体实施方式
以下将参考附图来详细说明本发明的一些实施例。关于各个附图的组件的附图标记,应当注意,将相同的附图标记分配给相同的组件,尽管这些组件是在不同的附图中示出的。另外,在说明本发明时,将省略可能使本发明的主题不清楚的、对与本发明有关的众所周知的结构或功能的详细说明。
另外,在描述本发明的组件时,可以使用诸如“第一”、“第二”、“A”、“B”、“(a)”或“(b)”等的术语。这些术语仅用于将相应组件与其它组件区分开,并且相应组件的性质、顺序或序列等不限于这些术语。在组件被描述为“耦合”、“组合”或“连接”至另一组件时,应当理解,该相应组件可以直接地耦合或连接至另一组件,或者该相应组件也可以经由设置在该相应组件和该另一组件之间的又一组件“耦合”、“组合”或“连接”至该另一组件。
图1是根据实施例的显示装置的结构图。
参考图1,显示装置100可以包括多个显示面板驱动装置120、130、140和显示面板150。
在显示面板150上,可以布置多个数据电压线DL、多个栅极线GL和多个像素P。
显示面板驱动装置120、130、140用于生成用于在显示面板150上显示图像的信号。数据驱动装置120、栅极驱动装置130和数据处理装置140可以对应于显示面板驱动装置120、130、140。
栅极驱动装置130(也称为栅极驱动器)可以经由栅极线GL供给诸如接通电压或断开电压等的栅极驱动信号。在接通电压的栅极驱动信号被供给至像素P时,像素P与数据电压线DL连接。在断开电压的栅极驱动信号被供给至像素P时,像素P从数据电压线DL断开。
数据驱动装置120(也称为源极驱动器)可以将数据电压Vp经由数据电压线DL供给至像素P。可以根据栅极驱动信号将数据电压Vp经由数据电压线DL供给至像素P。
数据处理装置140(也称为定时控制器)可以将控制信号供给至栅极驱动装置130和数据驱动装置120。例如,数据处理装置140可以发送使扫描开始的栅极控制信号GCS,并将图像数据IMG输出至数据驱动装置120。另外,数据处理装置140可以发送用以控制数据驱动装置120的数据控制信号DSC以将数据电压Vp供给至各像素P。
显示装置100还可以包括感测装置。感测装置可以感测面板上所布置的像素P,并将感测数据SS发送至数据处理装置140。
在硬件方面,感测装置和数据驱动装置120可以布置在一个半导体封装中。为了便于说明,在下文,数据驱动装置120将被描述为用于感测像素P并发送感测数据SS的对象。然而,应当注意,根据实施例,感测装置可以在与针对数据驱动装置120的半导体封装不同的半导体封装中实现。
数据驱动装置120可以经由感测线SL从像素P接收感测信号Sp。另外,数据驱动装置120可以将感测信号Sp转换成感测数据SS,并将该感测数据SS发送至数据处理装置140。
面板150上所布置的像素P可以具有根据时间的推移或其周围环境的改变而变化的特性。由于像素P的特性的变化也与像素P的亮度有关,因此数据驱动装置120需要根据像素P的改变后的特性来供给数据电压Vp,以维持像素P的均匀亮度。
数据处理装置140使用从数据驱动装置120接收到的感测数据来确定像素P的特性,根据像素P的特性对图像数据IMG进行补偿,然后将补偿后的图像数据IMG发送至数据驱动装置120。数据驱动装置120根据补偿后的图像数据IMG来生成数据电压Vp。如此,数据驱动装置120可以反映像素P的特性。
各装置可包括一个或多个集成电路。在显示面板的分辨率更高且其面积更大的情况下,变得一个集成电路难以服务面板的整个区域。为了对这样的情形作出反应,数据处理装置140和数据驱动装置120可以包括至少一个集成电路。特别地,数据驱动装置120可以包括两个或更多个集成电路。在下文,将说明数据驱动装置120包括两个或更多个集成电路的实施例。
图2是根据实施例的面板驱动装置的结构图。
参考图2,面板驱动装置200可以包括一个数据处理集成电路240和多个数据驱动集成电路220a、…、220b、220c、…、220d。
多个数据驱动集成电路220a、…、220b、220c、…、220d可以感测被划分成多个分区的面板的一个分区。数据处理集成电路240可以从多个数据驱动集成电路220a、…、220b、220c、…、220d收集感测数据,以确定面板上所布置的像素的特性。
多个数据驱动集成电路220a、…、220b、220c、…、220d可以经由感测数据线SDLa、SDLb与数据处理集成电路240连接。多个数据驱动集成电路220a、…、220b、220c、…、220d可以将感测数据经由感测数据线SDLa、SDLb而发送至数据处理集成电路240。
多个数据驱动集成电路220a、…、220b、220c、…、220d可以共用感测数据线SDLa、SDLb。在一个面板中,可以布置两个或更多个感测数据线SDLa、SDLb,可以将多个数据驱动集成电路220a、…、220b、220c、…、220d分组成多个组,并且在各组中可以共用感测数据线SDLa、SDLb中的各感测数据线。例如,属于第一组的多个数据驱动集成电路220a、…、220b可以共用第一感测数据线SDLa,并且属于第二组的多个数据驱动集成电路220c、…、220d可以共用第二感测数据线SDLb。数据处理集成电路240可以经由感测数据线SDLa、SDLb中的各感测数据线而单独地接收感测数据。
多个数据驱动集成电路220a、…、220b、220c、…、220d可以将感测数据经由分别以1:N方式(N是2或更大的自然数)连接的感测数据线SDLa、SDLb而发送至数据处理集成电路240。这里,为了防止要发送的数据发生冲突,多个数据驱动集成电路220a、…、220b、220c、…、220d各自可以使用时分来发送感测数据。
另一方面,多个数据驱动集成电路220a、…、220b、220c、…、220d可以将指示信号经由分别以1:1方式连接的信号线ILa、…、ILb、ILc、…、ILd而发送至数据处理集成电路240。
指示信号用于指示数据驱动集成电路220a、…、220b、220c、…、220d其中之一占用感测数据线SDLa、SDLb其中之一。数据处理集成电路240可以使用指示信号来识别数据驱动集成电路220a、…、220b、220c、…、220d其中之一以发送感测数据。
数据处理集成电路240可以将数据驱动集成电路220a、…、220b、220c、…、220d中的每一个分配给信号线ILa、…、ILb、ILc、…、ILd中的每一个。在数据处理集成电路240识别出接收指示信号所经由的信号线ILa、…、ILb、ILc、…、ILd其中之一的情况下,数据处理集成电路240可以认识到:被分配给接收指示信号所经由的信号线ILa、…、ILb、ILc、…、ILd的数据驱动集成电路220a、…、220b、220c、…、220d其中之一发送感测数据。
各个信号线ILa、…、ILb、ILc、…、ILd可以是单个线。各个数据驱动集成电路220a、…、220b、220c、…、220d可以通过改变在信号线ILa、…、ILb、ILc、…、ILd中形成的电压电平来发送指示信号。在一些实施例中,数据处理集成电路240可以通过改变在信号线ILa、…、ILb、ILc、…、ILd中形成的电压电平来发送指示信号。在一些其它实施例中,数据驱动集成电路220a、…、220b、220c、…、220d和数据处理集成电路240这两者都可以发送指示信号。
在多个数据驱动集成电路220a、…、220b、220c、…、220d与数据处理集成电路240之间,还可以布置时钟线CL。数据处理集成电路240可以经由时钟线CL发送第一时钟。数据驱动集成电路220a、…、220b、220c、…、220d各自可以发送与第一时钟同步的感测数据。多个数据驱动集成电路220a、…、220b、220c、…、220d可以共用一个时钟线CL。数据处理集成电路240可以将第一时钟经由多个数据驱动集成电路220a、…、220b、220c、…、220d共用的时钟线CL而发送至多个数据驱动集成电路220a、…、220b、220c、…、220d。
图3是根据实施例的数据处理集成电路的结构图,并且图4是根据实施例的数据驱动集成电路的结构图。
参考图3和图4,数据处理集成电路240可以包括时钟生成电路310、接收电路320、发送电路330、信号控制电路340和补偿电路350,并且数据驱动集成电路220可以包括时钟接收电路410、发送电路420、接收电路430、信号控制电路440、驱动电路450和感测电路460。
时钟生成电路310和时钟接收电路410可以经由时钟线CL彼此连接。时钟生成电路310可以经由时钟线CL发送第一时钟CLK1,并且时钟接收电路410可以经由时钟线CL接收第一时钟CLK1。
数据处理集成电路240的接收电路320可以经由感测数据线SDL接收感测数据SS。数据驱动集成电路220的发送电路420可以经由感测数据线SDL发送感测数据SS。数据驱动集成电路220的发送电路420在发送感测数据SS时可以使感测数据SS与第一时钟CLK1同步,并且数据处理集成电路240的接收电路320在接收感测数据时可以使感测数据SS与第一时钟CLK1同步。
感测数据SS可以由数据驱动集成电路220的感测电路460生成。感测电路460可以经由与像素连接的感测线SL接收感测信号Sp,并且通过对感测信号Sp的模数转换来生成感测数据SS。
数据处理集成电路240的发送电路330可以经由图像数据线IDL发送图像数据IMG。数据驱动集成电路220的接收电路430可以经由图像数据线IDL接收图像数据IMG。
通过反映像素的特性,图像数据IMG可以是补偿后的数据。数据处理集成电路240的补偿电路350可以使用所接收到的感测数据SS来确定像素的特性,并且通过反映像素的特性来补偿图像数据IMG。数据处理集成电路240的发送电路330可以将补偿后的图像数据IMG发送至数据驱动集成电路220。
可以将控制信号DCS例如以数字数据的形式经由图像数据线IDL从数据处理集成电路240的发送电路330发送至数据驱动集成电路220的接收电路430。再例如,可以将控制信号DCS以模拟信号的形式经由另一线从数据处理集成电路240的发送电路330发送至数据驱动集成电路220的接收电路430。
控制信号DCS可以包括指示帧的开始时间点的帧信号。数据驱动集成电路220可以使用帧信号来确定内部控制的时间点。例如,数据驱动集成电路220的驱动电路450可以将图像数据IMG转换成数据电压Vp,并且针对由帧信号确定的每个水平时间段经由数据电压线DL发送数据电压Vp。
数据处理集成电路240的信号控制电路340或数据驱动集成电路220的信号控制电路440可以经由信号线IL发送指示信号IC。另外,数据处理集成电路240的信号控制电路340可以通过确定接收指示信号IC所经由的信号线IL来识别数据驱动集成电路220中的发送感测数据SS的一个数据驱动集成电路220。
以这种方式,数据驱动集成电路220的发送电路420可以在由数据驱动集成电路220确定的时间点发送感测数据SS。例如,如果在特定时间点需要由数据驱动集成电路220发送感测数据SS,则可以首先由信号控制电路440经由信号线IL发送指示信号IC,并且随后可以由发送电路420发送感测数据SS。
数据驱动集成电路220的发送电路420可以每个预定周期(例如,每个帧周期)定期地发送感测数据SS。具体地,多个数据驱动集成电路220可以通过接收指示帧周期的帧信号、然后对从该帧信号起的预定时间进行计数,来确定用以发送指示信号IC的时间点。在这样定期发送感测数据SS时,分别被分配了数据驱动集成电路220的用以发送指示信号的时间点(再例如,用以发送感测数据的时间点)可以彼此不同。数据驱动集成电路220各自可以通过对与帧周期不同的时间进行计数来确定彼此不同的用以发送感测数据SS的时间点。
数据驱动集成电路220的发送电路420可以根据需要不定期地重新发送感测数据。例如,在数据驱动集成电路220的发送电路420在特定周期内的感测数据SS的发送失败的情况下,发送电路420可以在特定时间点重新发送感测数据SS。再例如,在数据处理集成电路240请求感测数据SS的重新发送的情况下,数据驱动集成电路220的发送电路420可以在特定时间点重新发送感测数据SS。
数据驱动集成电路220的发送电路420可以在发送指示信号IC的时间区间发送感测数据SS。这里,发送电路420可以在从开始发送指示信号IC的时间点起经过了第一时间段之后发送感测数据SS。
图5是示出根据实施例的用于发送指示信号和感测数据的时间点的时序图。
参考图5,数据驱动集成电路的信号控制电路可以通过将在信号线IL中形成的电压的电平从逻辑低L改变为逻辑高H来将指示信号IC发送至数据处理集成电路。在这样的示例中,在信号线IL中形成的电压的电平为逻辑高H的时间区间可被视为发送指示信号IC的时间区间。
数据驱动集成电路的发送电路可以在发送指示信号IC的时间区间T1~T3内发送感测数据SS。数据驱动集成电路的发送电路可以在从开始发送指示信号IC的时间点T1起经过了第一时间段Tw之后的特定时间点、或者在第一时间段Tw刚刚结束的时间点T2,发送感测数据SS。
第一时间段Tw可被称为待机时间。数据驱动集成电路的发送电路可以在发送指示信号IC之后在第一时间段Tw期间不发送感测数据SS的情况下待机。该第一时间段Tw是为了防止由于不同的数据驱动集成电路同时或在接近的时间点发送指示信号而导致感测数据SS的发送发生冲突。
在经由两个信号线IL接收到指示信号时,数据处理集成电路的信号控制电路可以阻塞这些指示信号中的后来发送的指示信号。在从发送指示信号IC的时间点起的第一时间段Tw中待机的数据驱动集成电路的发送电路可以在指示信号IC被数据处理集成电路的信号控制电路阻塞时不发送感测数据SS。在指示信号IC未被数据处理集成电路的信号控制电路阻塞直到经过了第一时间段Tw为止、并且维持指示信号IC的发送直到第一时间段Tw的推移结束为止的情况下,数据驱动集成电路的发送电路可以发送感测数据SS。
在数据驱动集成电路中可以包括第二时钟CLK2,并且对第二时钟CLK2的上升沿或下降沿进行计数,以检查第一时间段Tw的推移。例如,数据驱动集成电路可以通过从发送指示信号IC的时间点T1起对第二时钟CLK2的下降沿进行计数并检查计数值是否为K(K是2或更大的整数)来识别第一时间段Tw的推移。
第二时钟CLK2可以与第一时钟(参见图4中的CLK1)或从第一时钟导出的时钟相同。可以采用晶体管-晶体管逻辑(TTL)方法或小型低电压差分信号(mLVDS)方法来发送或接收第一时钟或第二时钟CLK2。在如第一时钟那样从外部接收到第二时钟CLK2时,数据驱动集成电路和数据处理集成电路可以基于同一时钟来测量时间,并且多个数据驱动集成电路可以与同一时钟同步。
数据驱动集成电路的发送电路可以在不发送感测数据的时间区间内将Hi-Z状态(高阻抗状态)输出至感测数据线SDL。例如,数据驱动集成电路的发送电路可以使在感测数据线SDL中测量的阻抗变为高阻抗。再例如,数据驱动集成电路的发送电路可以从感测数据线SDL断开而变为浮动状态。
图6是示出根据实施例的数据驱动集成电路中的发送感测数据的处理的流程图。
参考图6,数据驱动集成电路的发送电路可以在发送感测数据之前检查感测数据线是否处于Hi-Z状态(S600)。在数据驱动集成电路其中之一发送感测数据时,感测数据线不处于Hi-Z状态。因此,数据驱动集成电路的发送电路检查感测数据线的状态,并且在感测数据线被判断为处于Hi-Z状态时,可以发送或准备发送感测数据。
在感测数据线被判断为处于Hi-Z状态时,数据驱动集成电路的发送电路可以经由信号线发送指示信号(S602),并且待机第一时间段(S604)。
在指示信号的发送未被阻塞直到经过了第一时间段为止、并且维持该指示信号的发送直到第一时间段Tw的推移结束为止的情况下,数据驱动集成电路的发送电路可以发送感测数据SS(S606)。
图7是示出根据实施例的在信号线和感测数据线中形成的信号的时序图。
在共用感测数据线SDL的多个数据驱动集成电路中,第一数据驱动集成电路可以在第一时间点Ta经由第一信号线IL1发送第一指示信号IC1,并且随后经由感测数据线SDL发送第一感测数据SS1。在第一感测数据SS1的发送完成的情况下,第一数据驱动集成电路可以使感测数据线SDL处于Hi-Z状态。
第二数据驱动集成电路可以判断为感测数据线SDL处于Hi-Z状态,在第二时间点Tb经由第二信号线IL2发送第二指示信号IC2,并且随后经由感测数据线SDL发送第二感测数据SS2。在第二传感数据SS2的发送完成时,第二数据驱动集成电路可以使感测数据线SDL处于Hi-Z状态。
在上述方法中,各数据驱动集成电路可以顺次发送感测数据。作为顺序的最后一个的第N数据驱动集成电路可以检查感测数据线SDL是否处于Hi-Z状态,在第N时间点Tn经由第N信号线ILn发送第N指示信号ICn,并且随后经由感测数据线SDL发送第N感测数据SSn。在第N传感数据SSn的发送完成时,第N数据驱动集成电路可以使感测数据线SDL处于Hi-Z状态。
图8是示出根据实施例的数据驱动集成电路中的重新发送感测数据的处理的流程图。
参考图8,数据驱动集成电路可以检查是否需要重新发送感测数据(S800)。
在需要感测数据的重新发送的情况下,数据驱动集成电路可以检查感测数据线是否处于Hi-Z状态(S802)。
在感测数据线被判断为处于Hi-Z状态的情况下,数据驱动集成电路可以经由信号线发送指示信号(S804)并且待机第一时间段(S806)。
在多个数据驱动集成电路不定期地发送感测数据的情况下,一个数据驱动集成电路的感测数据的发送可能与另一数据驱动集成电路的感测数据的发送发生冲突。可以通过数据处理集成电路的控制来防止这样的冲突。
在经由两个信号线接收到指示信号时,数据处理集成电路的信号控制电路可以阻塞后来发送的指示信号。在以将信号线的电压电平改变为逻辑高H的方式发送指示信号的情况下,数据处理集成电路的信号控制电路可以通过将信号线的电压电平改变为逻辑低L来阻塞指示信号。
在待机第一时间段期间,数据驱动集成电路可以检查指示信号是否由于上述原因而未被维持(S808)。
在指示信号未被维持第一时间段的情况下(S808中为“否”),数据驱动集成电路可以在不发送感测数据的情况下结束该过程。
在指示信号被维持第一时间段的情况下(S808中为“是”),数据驱动集成电路可以将感测数据发送至数据处理集成电路。
另一方面,还可以将指示信号从数据处理集成电路发送至数据驱动集成电路。
图9是示出根据实施例的数据驱动集成电路中的接收指示信号并发送感测数据的处理的流程图。
参考图9,数据处理集成电路的信号控制电路也可以将指示信号发送至数据驱动集成电路。数据驱动集成电路的信号控制电路可以接收这样的指示信号(S900)。
随后,数据驱动集成电路可以待机第一时间段(S902)。
在待机第一时间段期间,数据驱动集成电路可以检查其内部状态(S904)。
在内部状态是难以发送感测数据的状态(例如,由于数据在转换中途因此不生成感测数据、或者在感测数据中检测到错误)的情况下(S904中为“情况2”),数据驱动集成电路可以阻塞指示信号(S908)。在这种情况下,数据处理集成电路可以通过确定指示信号的阻塞而认识到数据驱动集成电路处于不可用于发送感测数据的状态。
在内部状态中不存在不可用的情况下(S904中为“情况1”),数据驱动集成电路可以将感测数据发送至数据处理集成电路(S906)。
如上所述,根据本发明,共用数据线的多个集成电路可以高效地发送数据。例如,各个集成电路可以定期地或不定期地发送数据,可以容易地重新发送数据以补偿数据,并且仅一些集成电路可以重复地发送或重新发送数据。这提高了数据的发送和接收的效率。
由于诸如“包含”、“包括”和“具有”等的术语意味着,除非相应要素被具体描述为相反,否则可以存在这些相应要素,因此应当解释为,可以附加地包括其它要素、而不是省略这样的要素。所有的技术术语、科学术语或其它术语除非被定义成相反,否则都是以与本领域技术人员所理解的含义一致的方式使用的。如在字典中找到的共同术语应在相关的技术撰写的上下文中而不是以过于理想或不切实际的方式解释,除非本发明明确地将这些术语定义成如此。
尽管已经为了例示性目的说明了本发明的优选实施例,但本领域技术人员将理解,可以在未背离如所附权利要求书所公开的本实施例的范围和精神的情况下进行各种修改、添加和替换。因此,本发明所公开的实施例意图例示本发明的技术思想的范围,并且本发明的范围不受本实施例限制。本发明的范围应基于所附权利要求书来解释,使得在与权利要求书等同的范围内包括的所有技术思想都属于本发明。
Claims (17)
1.一种集成电路,用于感测被划分成多个分区的面板的一个分区,所述集成电路包括:
感测电路,用于感测所述一个分区中所布置的像素的特性,并且生成感测数据;
信号控制电路,用于将指示信号经由以1:1方式连接的信号线而发送至用于收集所述感测数据的装置;以及
发送电路,用于根据所述指示信号的发送,经由以1:N方式连接的数据线发送所述感测数据,其中N是2或更大的自然数。
2.根据权利要求1所述的集成电路,其中,所述信号线是单个线,以及所述信号控制电路通过改变在所述信号线中形成的电压的电平来发送所述指示信号。
3.根据权利要求1所述的集成电路,其中,在从开始发送所述指示信号的时间点起经过了第一时间段之后的发送所述指示信号的时间区间内,所述发送电路发送所述感测数据。
4.根据权利要求3所述的集成电路,其中,在所述指示信号的发送未被阻塞直到经过了所述第一时间段为止、并且维持所述指示信号的发送直到所述第一时间段的推移结束为止的情况下,所述发送电路发送所述感测数据。
5.根据权利要求1所述的集成电路,其中,所述发送电路检查所述数据线的状态,并且在所述数据线被判断为处于高阻抗状态即Hi-Z状态的情况下发送所述感测数据。
6.根据权利要求1所述的集成电路,其中,在不发送所述感测数据的时间区间内,所述发送电路将高阻抗状态即Hi-Z状态发送至所述数据线。
7.根据权利要求1所述的集成电路,还包括时钟接收电路,所述时钟接收电路用于经由时钟线从所述装置接收时钟,其中所述发送电路发送与所述时钟同步的感测数据。
8.根据权利要求1所述的集成电路,其中,所述发送电路每个周期定期地发送所述感测数据,然而,在某周期内所述感测数据的发送失败的情况下,所述发送电路在特定时间点重新发送所述感测数据。
9.根据权利要求1所述的集成电路,其中,所述指示信号表示所述数据线被所述集成电路占用、或者指示所述集成电路占用所述数据线。
10.根据权利要求1所述的集成电路,还包括:
接收电路,用于接收根据所述感测数据补偿后的图像数据;以及
驱动电路,用于将所述图像数据转换成数据电压,并且经由与所述像素连接的数据电压线来发送所述数据电压。
11.一种数据处理集成电路,包括:
接收电路,用于经由以1:N方式连接的感测数据线从多个数据驱动集成电路接收面板上所布置的像素的感测数据,其中N是2或更大的自然数;
信号控制电路,用于经由分别以1:1方式与所述多个数据驱动集成电路连接的多个信号线接收指示信号,并且根据所述指示信号来识别所述多个数据驱动集成电路中的用于发送所述感测数据的数据驱动集成电路;
补偿电路,用于根据所述感测数据来补偿图像数据;以及
发送电路,用于将补偿后的图像数据经由各个图像数据线发送至所述多个数据驱动集成电路中的各个数据驱动集成电路。
12.根据权利要求11所述的数据处理集成电路,其中,所述信号控制电路将所述指示信号反向发送至第一数据驱动集成电路,并且所述补偿电路根据反向发送的指示信号,使用从所述第一数据驱动集成电路接收到的感测数据来补偿先前接收到的感测数据。
13.根据权利要求11所述的数据处理集成电路,其中,在经由所述多个信号线中的两个信号线接收到所述指示信号的情况下,所述信号控制电路阻塞所述指示信号中的后来发送的指示信号。
14.根据权利要求11所述的数据处理集成电路,其中,所述接收电路与多个感测数据线连接,并且经由所述多个感测数据线中的各个感测数据线单独地接收所述感测数据。
15.根据权利要求11所述的数据处理集成电路,还包括时钟发送电路,所述时钟发送电路用于将时钟经由与所述多个数据驱动集成电路共同连接的时钟线而发送至所述多个数据驱动集成电路,其中,所述接收电路接收与所述时钟同步的感测数据。
16.根据权利要求11所述的数据处理集成电路,其中,所述多个数据驱动集成电路中的各个数据驱动集成电路接收表示帧周期的帧信号,并且通过对从所述帧信号起的预定时间进行计数来确定用以发送所述指示信号的时间点。
17.根据权利要求11所述的数据处理集成电路,其中,所述多个数据驱动集成电路中的各个数据驱动集成电路检查所述数据线的状态,并且在所述数据线未被识别为处于不能发送所述感测数据的特定状态的情况下,在该数据驱动集成电路所确定的时间点发送所述感测数据。
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