CN110971220A - 一种硬逻辑延时触发器 - Google Patents

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陈澎祥
李森
肖萌璐
王健
周鑫
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/28Modifications for introducing a time delay before switching

Abstract

本发明提供了一种硬逻辑延时触发器,包括电源控制模块、延时控制模块、逻辑控制模块;所述逻辑控制模块包括反馈模块,所述反馈模块入口连接逻辑控制模块,所述反馈模块出口连接电源控制模块;电源控制模块:用于给整个模块供电,平时处于休眠状态;延时控制模块:用于控制延时,并且延时可调,具体时间根据现场需求而定;逻辑控制模块:用比较器做逻辑比较功能,待延时模块电压上升到参考值,电平变化;反馈模块:用于控制电源模块,在逻辑没有实现之前保持电源供电。本发明所述的电源控制模块、延时控制模块、逻辑控制模块、反馈模块实现了硬逻辑延时控制电路,不需要单片机控制,性能稳定,没有跑飞风险。

Description

一种硬逻辑延时触发器
技术领域
本发明属于延时触发器技术领域,尤其是涉及一种硬逻辑延时触发器。
背景技术
硬件延时触发器,目前大多数产品采用单片机或者ARM用作逻辑控制。但这种逻辑芯片存在一个缺陷,就是在受到静电或者其他干扰情况下,程序可能会跑飞,导致逻辑控制失效。在一些敏感场合,比如消防门禁控制,这种稳定性尤为重要。本发明实现一种硬逻辑的延时控制电路,不需要单片机控制,性能稳定,没有跑飞风险。
发明内容
有鉴于此,本发明旨在提出一种硬逻辑延时触发器,以解决逻辑芯片在受到静电或者其他干扰情况下程序会跑飞,导致逻辑控制失效的问题。
为达到上述目的,本发明的技术方案是这样实现的:
一种硬逻辑延时触发器,包括电源控制模块、延时控制模块、逻辑控制模块;
所述电源控制模块的出口连接延时控制模块入口,所述延时控制模块出口连接逻辑控制模块入口;
所述逻辑控制模块包括反馈模块,所述反馈模块一端连接逻辑控制模块,所述反馈模块另一端连接电源控制模块;
电源控制模块:用于给整个模块供电,平时处于休眠状态;
延时控制模块:用于控制延时,并且延时可调,具体时间根据现场需求而定;
逻辑控制模块:用比较器做逻辑比较功能,待延时模块电压上升到参考值,电平变化;
反馈模块:用于控制电源模块,在逻辑没有实现之前保持电源供电。
进一步的,所述电源控制模块包括电容器C3、电阻R7、电阻R8、电容器C4、MOS芯片Q2、电容器C1、电容器C2、电阻R1,所诉电容器C3一端连接电阻R7一端,所述电容器C3另一端连接接地线,所述电阻R7另一端连接电容器C4一端,所述电阻R8一端连接电容器C4另一端,所述电阻R8一端与电容器C4的一端连接MOS芯片Q2的G口,所述电阻R7的另一端与电容器C4一端连接MOS芯片S口,所述MOS芯片的D口、D1口、D2口、D3口并联与电容器C1、电容器C2、电阻R1的一端连接,所述电容器C1、电容器C2、电阻R1的另一端串联与接地线连接。
进一步的,所述延时模块包括二极管D2、电阻R2、电容CE5、电阻R5、电阻R6,所述二极管D2阴极连接电容器C1、电容器C2、电阻R1的一端,所述二极管D2阳极连接电阻R2的一端,所述电阻R2另一端连接二极管D2阴极,所述电容CE5一端连接电阻R2的一端与二极管D2阳极,所述电容CE5的另一端连接接地线,所述电阻R6一端连接电阻R2的另一端,所述电阻R6的另一端连接电阻R5的一端,所述电容R5的另一端连接接地线。
进一步的,所述逻辑控制模块包括电阻R3、电阻R4、比较器,所述电阻R3的一端连接电阻R5一端与电阻R6另一端之间连接的线路上,所述电阻R3的另一端连接比较器的1口,所述电阻R4的一端连接电容CE5一端与电阻R2一端连接之间的线路上,所述电阻R4的另一端连接比较器的2口,所述比较器的3口连接电阻R6另一端与电阻R5另一端之间的电路上。
进一步的,所述控制模块包括INPUT、OUTPUT、二极管D1、二极管D3、电阻R10、电阻R9、三极管,所述INOUT接口连接二极管D3的阳极,所述二极管D3的阴极连接电阻R10的一端,所述电阻R10的另一端连接三极管的b极,所述三极管的c极连接电阻R8的另一端,所述三极管的e极连接接地线,所述电阻R9的一端连接在电阻R10与三极管b极之间的线路上,所述电阻R9的另一端连接接地线。
相对于现有技术,本发明所述的一种硬逻辑延时触发器具有以下优势:
本发明所述的电源控制模块、延时控制模块、逻辑控制模块、反馈模块实现了硬逻辑延时控制电路,不需要单片机控制,性能稳定,没有跑飞风险,可以用于应急开门等场景,比如紧急按键按下,开门3S。
附图说明
构成本发明的一部分的附图用来提供对本发明的进一步理解,本发明的示意性实施例及其说明用于解释本发明,并不构成对本发明的不当限定。在附图中:
图1为本发明实施例所述的一种硬逻辑延时触发器流程图;
图2为本发明实施例所述的一种硬逻辑延时触发器电路示意图。
具体实施方式
需要说明的是,在不冲突的情况下,本发明中的实施例及实施例中的特征可以相互组合。
在本发明的描述中,需要理解的是,术语“中心”、“纵向”、“横向”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本发明和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本发明的限制。此外,术语“第一”、“第二”等仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”等的特征可以明示或者隐含地包括一个或者更多个该特征。在本发明的描述中,除非另有说明,“多个”的含义是两个或两个以上。
在本发明的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以通过具体情况理解上述术语在本发明中的具体含义。
下面将参考附图并结合实施例来详细说明本发明。
如图1至图2所示,一种硬逻辑延时触发器,包括电源控制模块、延时控制模块、逻辑控制模块;
所述电源控制模块的出口连接延时控制模块入口,所述延时控制模块出口连接逻辑控制模块入口;
所述逻辑控制模块包括反馈模块,所述反馈模块一端连接逻辑控制模块,所述反馈模块另一端连接电源控制模块;
电源控制模块:用于给整个模块供电,平时处于休眠状态;
延时控制模块:用于控制延时,并且延时可调,具体时间根据现场需求而定;
逻辑控制模块:用比较器做逻辑比较功能,待延时模块电压上升到参考值,电平变化;
反馈模块:用于控制电源模块,在逻辑没有实现之前保持电源供电。
所述电源控制模块包括电容器C3、电阻R7、电阻R8、电容器C4、MOS芯片Q2、电容器C1、电容器C2、电阻R1,所诉电容器C3一端连接电阻R7一端,所述电容器C3另一端连接接地线,所述电阻R7另一端连接电容器C4一端,所述电阻R8一端连接电容器C4另一端,所述电阻R8一端与电容器C4的一端连接MOS芯片Q2的G口,所述电阻R7的另一端与电容器C4一端连接MOS芯片S口,所述MOS芯片的D口、D1口、D2口、D3口并联与电容器C1、电容器C2、电阻R1的一端连接,所述电容器C1、电容器C2、电阻R1的另一端串联与接地线连接。
所述延时模块包括二极管D2、电阻R2、电容CE5、电阻R5、电阻R6,所述二极管D2阴极连接电容器C1、电容器C2、电阻R1的一端,所述二极管D2阳极连接电阻R2的一端,所述电阻R2另一端连接二极管D2阴极,所述电容CE5一端连接电阻R2的一端与二极管D2阳极,所述电容CE5的另一端连接接地线,所述电阻R6一端连接电阻R2的另一端,所述电阻R6的另一端连接电阻R5的一端,所述电容R5的另一端连接接地线。
所述逻辑控制模块包括电阻R3、电阻R4、比较器,所述电阻R3的一端连接电阻R5一端与电阻R6另一端之间连接的线路上,所述电阻R3的另一端连接比较器的1口,所述电阻R4的一端连接电容CE5一端与电阻R2一端连接之间的线路上,所述电阻R4的另一端连接比较器的2口,所述比较器的3口连接电阻R6另一端与电阻R5另一端之间的电路上。
所述控制模块包括INPUT、OUTPUT、二极管D1、二极管D3、电阻R10、电阻R9、三极管,所述INOUT接口连接二极管D3的阳极,所述二极管D3的阴极连接电阻R10的一端,所述电阻R10的另一端连接三极管的b极,所述三极管的c极连接电阻R8的另一端,所述三极管的e极连接接地线,所述电阻R9的一端连接在电阻R10与三极管b极之间的线路上,所述电阻R9的另一端连接接地线。
具体实施例如下:
平时电路处于休眠状态,Q2断开,5V0_E无电压;
遇到紧急情况,按下应急开关,INPUT收到高电平脉冲,Q2打开,后级电路开始工作;
OUTPUT上电高电平,通过D1反馈控制,以保证Q2持续打开,避免开关松开后Q2关闭造成后级断电;
上电后CE5通过R2充电,电压持续上升,通过调节R2和CE5的阻值和感值可以实现延时控制;
当CE5电压超过U1的3管脚电压时,OUTPUT输出低电平,如果INPUT输入也是低电平,关闭Q2。CE5的能量通过D2和R1卸放。
以上所述仅为本发明的较佳实施例而已,并不用以限制本发明,凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。

Claims (5)

1.一种硬逻辑延时触发器,其特征在于:包括电源控制模块、延时控制模块、逻辑控制模块;
所述电源控制模块的出口连接延时控制模块入口,所述延时控制模块出口连接逻辑控制模块入口;
所述逻辑控制模块包括反馈模块,所述反馈模块一端连接逻辑控制模块,所述反馈模块另一端连接电源控制模块;
电源控制模块:用于给整个模块供电,平时处于休眠状态;
延时控制模块:用于控制延时,并且延时可调,具体时间根据现场需求而定;
逻辑控制模块:用比较器做逻辑比较功能,待延时模块电压上升到参考值,电平变化;
反馈模块:用于控制电源模块,在逻辑没有实现之前保持电源供电。
2.根据权利要求1所述的一种硬逻辑延时触发器,其特征在于:所述电源控制模块包括电容器C3、电阻R7、电阻R8、电容器C4、MOS芯片Q2、电容器C1、电容器C2、电阻R1,所诉电容器C3一端连接电阻R7一端,所述电容器C3另一端连接接地线,所述电阻R7另一端连接电容器C4一端,所述电阻R8一端连接电容器C4另一端,所述电阻R8一端与电容器C4的一端连接MOS芯片Q2的G口,所述电阻R7的另一端与电容器C4一端连接MOS芯片S口,所述MOS芯片的D口、D1口、D2口、D3口并联与电容器C1、电容器C2、电阻R1的一端连接,所述电容器C1、电容器C2、电阻R1的另一端串联与接地线连接。
3.根据权利要求2所述的一种硬逻辑延时触发器,其特征在于:所述延时模块包括二极管D2、电阻R2、电容CE5、电阻R5、电阻R6,所述二极管D2阴极连接电容器C1、电容器C2、电阻R1的一端,所述二极管D2阳极连接电阻R2的一端,所述电阻R2另一端连接二极管D2阴极,所述电容CE5一端连接电阻R2的一端与二极管D2阳极,所述电容CE5的另一端连接接地线,所述电阻R6一端连接电阻R2的另一端,所述电阻R6的另一端连接电阻R5的一端,所述电容R5的另一端连接接地线。
4.根据权利要求3所述的一种硬逻辑延时触发器,其特征在于:所述逻辑控制模块包括电阻R3、电阻R4、比较器,所述电阻R3的一端连接电阻R5一端与电阻R6另一端之间连接的线路上,所述电阻R3的另一端连接比较器的1口,所述电阻R4的一端连接电容CE5一端与电阻R2一端连接之间的线路上,所述电阻R4的另一端连接比较器的2口,所述比较器的3口连接电阻R6另一端与电阻R5另一端之间的电路上。
5.根据权利要求4所述的一种硬逻辑延时触发器,其特征在于:所述控制模块包括INPUT、OUTPUT、二极管D1、二极管D3、电阻R10、电阻R9、三极管,所述INOUT接口连接二极管D3的阳极,所述二极管D3的阴极连接电阻R10的一端,所述电阻R10的另一端连接三极管的b极,所述三极管的c极连接电阻R8的另一端,所述三极管的e极连接接地线,所述电阻R9的一端连接在电阻R10与三极管b极之间的线路上,所述电阻R9的另一端连接接地线。
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