CN108735174A - 像素驱动电路、像素驱动方法及显示装置 - Google Patents

像素驱动电路、像素驱动方法及显示装置 Download PDF

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Abstract

本发明提供一种像素驱动电路、像素驱动方法及显示装置。本发明的像素驱动电路包括阵列排布的多个子像素、多条数据线与扫描线、多个第一、第二调压模块，驱动时，同时对第2n‑1行子像素及第2n行子像素进行扫描，第一调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第二电容的第二端输入第一公共电压及第二公共电压，第二调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第一电容的第二端输入第三公共电压及第二公共电压，从而大大提升像素驱动电路的扫描速度，并且能够使同一子像素内的第一像素电极与第二像素电极上写入不同的电压，有效解决显示装置在大视角状态下显示画面发白的问题。

Description

像素驱动电路、像素驱动方法及显示装置
技术领域
本发明涉及液晶显示技术领域，尤其涉及一种像素驱动电路、像素驱动方法及显示装置。
背景技术
液晶显示装置(Liquid Crystal Display，LCD)是目前最广泛使用的平板显示器之一，液晶面板是液晶显示装置的核心组成部分。液晶面板通常是由一彩色滤光片基板(Color Filter Substrate，CF Substrate)、一薄膜晶体管阵列基板(Thin FilmTransistor Array Substrate，TFT Array Substrate)以及一配置于两基板间的液晶层(Liquid Crystal Layer)所构成。一般阵列基板、彩色滤光片基板上分别设置像素电极、公共电极。当电压被施加到像素电极与公共电极便会在液晶层中产生电场，该电场决定了液晶分子的取向，从而调整入射到液晶层的光的偏振，使液晶面板显示图像。
现有的液晶显示装置的像素驱动电路一般包括多个阵列排布的子像素、平行且间隔设置的多条扫描线以及竖直且间隔设置的多条数据线，每一行子像素连接一条扫描线，每一列子像素连接一条数据线，工作时，依次扫描多条扫描线，在每一条扫描线被扫描的时刻内，多条数据线向对应一行的子像素输入数据信号，从而实现对像素驱动电路的驱动。这种逐行驱动的方式，需要较长的时间才能够完成所有扫描线的扫描，扫描速度较慢，不利于使液晶显示装置向高分辨率方向发展。
随着生活水平的不断提高，大尺寸的液晶显示装置越来越受到消费者的青睐。然而，大尺寸的液晶显示装置存在大视角状态下视觉发白的问题，这是由于大视角状态下光的透过率与正视的状态下光的透过率不一致导致的，具体地，在低灰阶的情况下，大视角状态下人眼看到的光透过率比正视状态下人眼看到的光透过率高，在高灰阶的情况下，大视角状态下人眼看到的光透过率比正视状态下人眼看到的光透过率低，而人眼对低灰阶的光比较敏感，因此在大视角状态下看到的显示画面会比正视状态看到的画面发白，如何解决大视角状态下显示画面发白的问题已经成为显示装置领域的研究重点。
发明内容
本发明的目的在于提供一种像素驱动电路，避免显示装置在大视角状态下显示画面发白，并且能够提升像素驱动电路的扫描速度。
本发明的另一目的在于提供一种像素驱动方法，避免显示装置在大视角状态下显示画面发白，并且能够提升像素驱动电路的扫描速度。
本发明的另一目的还在于提供一种显示装置，避免了大视角状态下显示画面发白的问题，并且能够提升其像素驱动电路的扫描速度。
为实现上述目的，本发明首先提供一种像素驱动电路，包括阵列排布的多个子像素、多条数据线与扫描线、多个第一调压模块及多个第二调压模块；每一扫描线对应连接一行子像素；一列子像素对应连接两条数据线，且该列子像素中的奇数行子像素连接对应两条数据线中的一条，该列子像素中的偶数行子像素连接对应两条数据线中的另一条；
第2n-1行子像素及第2n行子像素为一个子像素组，其中，n等于正整数；每一第一调压模块的第一输入端接入第一公共电压，第二输入端接入第二公共电压，控制端对应与一子像素组中第2n-1行子像素对应的扫描线连接，输出端与该子像素组中的所有子像素均连接；每一第二调压模块的第一输入端接入第二公共电压，第二输入端接入第三公共电压，输出端对应与一子像素组中第2n行子像素对应的扫描线连接，输出端与该子像素组中所有子像素均连接；每一子像素均包括第一薄膜晶体管、第二薄膜晶体管、第一电容、第二电容、第一像素电极及第二像素电极；第一薄膜晶体管的栅极及源极分别电性连接所在子像素对应的扫描线及数据线，漏极电性连接第一像素电极；第二薄膜晶体管的栅极与源极分别电性连接所在子像素对应的扫描线与数据线，漏极电性连接第二像素电极；第一电容的第一端电性连接第一像素电极，第二端电性连接所在子像素对应的第二调压模块的输出端；第二电容的第一端电性连接第二像素电极，第二端电性连接所在子像素对应的第一调压模块的输出端；
第一调压模块用于受对应扫描线上的扫描信号的控制，在其输出端连接的子像素的第一薄膜晶体管导通时向其输出端连接的子像素的第二电容的第二端输入第一公共电压，在其输出端连接的子像素的第一薄膜晶体管截止时向其输出端连接的子像素的第二电容的第二端输入第二公共电压；
第二调压模块用于受对应扫描线上的扫描信号的控制，在其输出端连接的子像素的第一薄膜晶体管导通时向其输出端连接的子像素的第一电容的第二端输入第三公共电压，在其输出端连接的子像素的第一薄膜晶体管截止时向其输出端连接的子像素的第一电容的第二端输入第二公共电压；
在对所述像素电路驱动电路进行驱动时，同时向连接第2n-1行子像素的扫描线及连接第2n行子像素的扫描线输出波形相同的扫描信号；使第2n-1行子像素的第一薄膜晶体管及第二薄膜晶体管与第2n行子像素的第一薄膜晶体管及第二薄膜晶体管同时导通。
所述第一薄膜晶体管及第二薄膜晶体管均为N型薄膜晶体管或均为P型薄膜晶体管。
所述第一调压模块模块包括第三薄膜晶体管、第一反相器及第四薄膜晶体管；所述第三薄膜晶体管的栅极电性连接对应扫描线，源极接入第一公共电压，漏极电性连接对应子像素的第二电容的第二端；所述第一反相器的输入端电性连接对应扫描线，输出端电性连接第四薄膜晶体管的栅极；所述第四薄膜晶体管的源极接入第二公共电压，漏极电性连接对应子像素的第二电容的第二端；所述第一调压模块的第一输入端为第三薄膜晶体管的源级，第二输入端为第四薄膜晶体管的源级，控制端为第三薄膜晶体管的栅极，输出端为第三薄膜晶体管的漏极；
所述第二调压模块包括第五薄膜晶体管、第二反相器及第六薄膜晶体管；所述第五薄膜晶体管的栅极电性连接对应扫描线，源极接入第三公共电压，漏极电性连接对应子像素的第一电容的第二端；所述第二反相器的输入端电性连接对应扫描线，输出端电性连接第六薄膜晶体管的栅极；所述第六薄膜晶体管的源极接入第二公共电压，漏极电性连接对应子像素的第一电容的第二端；；所述第二调压模块的第一输入端为第六薄膜晶体管的源级，第二输入端为第五薄膜晶体管的源级，控制端为第五薄膜晶体管的栅极，输出端为第五薄膜晶体管的漏极。
所述第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管及第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管均为N型薄膜晶体管。
所述第一公共电压及第三公共电压中一个大于第二公共电压，另一个小于第二公共电压。
所述第一公共电压大于第二公共电压且大于第三公共电压。
在对所述像素电路驱动电路进行驱动时，向与一列子像素连接的两条数据线分别输入极性相反的数据信号电压。
本发明还提供一种像素驱动方法，应用于上述像素驱动电路，包括如下步骤：
步骤S1、同时向与第2n-1行子像素连接的扫描线及与第2n行子像素连接的扫描线输入波形相同的扫描信号；
步骤S2、扫描信号控制第2n-1行子像素及第2n行子像素中的第一薄膜晶体管及第二薄膜晶体管导通，同时控制信号控制对应的第一调压模块向第2n-1行子像素及第2n行子像素的第二电容的第二端输入第一公共电压，同时控制信号控制对应的第二调压模块向第2n-1行子像素及第2n行子像素的第一电容的第二端输入第三公共电压；
步骤S3、扫描信号控制第2n-1行子像素及第2n行子像素中的第一薄膜晶体管及第二薄膜晶体管截止，同时控制信号控制对应的第一调压模块向第2n-1行子像素及第2n行子像素的第二电容的第二端输入第二公共电压，同时控制信号控制对应的第二调压模块向第2n-1行子像素及第2n行子像素的第一电容的第二端输入第二公共电压。
本发明还提供一种显示装置，包括上述像素驱动电路。
本发明的有益效果：本发明提供的一种像素驱动电路包括阵列排布的多个子像素、多条数据线与扫描线、多个第一、第二调压模块，驱动时，同时对第2n-1行子像素及第2n行子像素进行扫描，第一调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第二电容的第二端输入第一公共电压及第二公共电压，第二调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第一电容的第二端输入第三公共电压及第二公共电压，从而大大提升像素驱动电路的扫描速度，并且能够使同一子像素内的第一像素电极与第二像素电极上写入不同的电压，有效解决显示装置在大视角状态下显示画面发白的问题。本发明提供的一种像素驱动方法能够避免显示装置在大视角状态下显示画面发白，并且能够提升像素驱动电路的扫描速度。本发明提供的一种显示装置能够避免大视角状态下显示画面发白的问题，并且能够提升扫描速度。
附图说明
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图中，
图1为本发明的像素驱动电路的结构示意图；
图2为本发明的像素驱动电路的时序图；
图3为本发明的像素驱动方法的流程图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图1及图2，本发明提供一种像素驱动电路，包括阵列排布的多个子像素10、多条数据线20(D(1)、D(2)……D(2m-1)、D(2m)……)与扫描线30(G(1)、G(2)……G(2n-1)、G(2n)……)、多个第一调压模块41及多个第二调压模块42。
每一扫描线30对应连接一行子像素10；一列子像素10对应连接两条数据线20，且该列子像素10中的奇数行子像素10连接对应两条数据线20中的一条，该列子像素10中的偶数行子像素10连接对应两条数据线20中的另一条。
第2n-1行子像素10及第2n行子像素10为一个子像素组，其中，n等于正整数。每一第一调压模块41的第一输入端接入第一公共电压Com1，第二输入端接入第二公共电压Com2，控制端对应与一子像素组中第2n-1行子像素10对应的扫描线30连接，输出端与该子像素组中的所有子像素10均连接。每一第二调压模块42的第一输入端接入第二公共电压Com2，第二输入端接入第三公共电压Com3，输出端对应与一子像素组中第2n行子像素10对应的扫描线30连接，输出端与该子像素组中所有子像素10均连接。
每一子像素10均包括第一薄膜晶体管T1、第二薄膜晶体管T2、第一电容C1、第二电容C2、第一像素电极11及第二像素电极12。第一薄膜晶体管T1的栅极及源极分别电性连接所在子像素10对应的扫描线30及数据线20，漏极电性连接第一像素电极11。第二薄膜晶体管T2的栅极与源极分别电性连接所在子像素10对应的扫描线30与数据线20，漏极电性连接第二像素电极12。第一电容C1的第一端电性连接第一像素电极11，第二端电性连接所在子像素10对应的第二调压模块42的输出端。第二电容C2的第一端电性连接第二像素电极12，第二端电性连接所在子像素10对应的第一调压模块41的输出端。第一薄膜晶体管T1、第一电容C1、第一像素电极11组成第一区域，第二薄膜晶体管T2、第二电容C2、第二像素电极12组成第二区域。
第一调压模块41用于受对应扫描线30上的扫描信号的控制，在其输出端连接的子像素10的第一薄膜晶体管T1导通时向其输出端连接的子像素10的第二电容C2的第二端输入第一公共电压Com1，在其输出端连接的子像素10的第一薄膜晶体管T1截止时向其输出端连接的子像素10的第二电容C2的第二端输入第二公共电压Com2。第二调压模块42用于受对应扫描线30上的扫描信号的控制，在其输出端连接的子像素10的第一薄膜晶体管T1导通时向其输出端连接的子像素10的第一电容C1的第二端输入第三公共电压Com3，在其输出端连接的子像素10的第一薄膜晶体管T1截止时向其输出端连接的子像素10的第一电容C1的第二端输入第二公共电压Com2。
值得注意的是，请参考图2，在对所述像素电路驱动电路进行驱动时，同时向连接第2n-1行子像素10的扫描线30及连接第2n行子像素10的扫描线30输入波形相同的扫描信号，使第2n-1行子像素10的第一薄膜晶体管T1及第二薄膜晶体管T2与第2n行子像素10的第一薄膜晶体管T1及第二薄膜晶体管T2同时导通。
具体地，所述多个第一调压模块41及多个第二调压模块42可位于子像素10阵列的同一侧，也可将多个第一调压模块41设置在子像素10阵列的一侧，将多个第二调压模块42设置在子像素10阵列的另一侧。在图1所示的实施例中，多个第一调压模块41设置在子像素10阵列的一侧，多个第二调压模块42设置在子像素10阵列的另一侧。
具体地，所述第一薄膜晶体管T1及第二薄膜晶体管T2均为N型薄膜晶体管或均为P型薄膜晶体管。在图1所示的实施例中，第一薄膜晶体管T1及第二薄膜晶体管T2均为N型薄膜晶体管。
具体地，请参阅图1，所述第一调压模块41包括第三薄膜晶体管T3、第一反相器F1及第四薄膜晶体管T4。所述第三薄膜晶体管T3的栅极电性连接对应扫描线30，源极接入第一公共电压Com1，漏极电性连接对应子像素10的第二电容C2的第二端；所述第一反相器F1的输入端电性连接对应扫描线30，输出端电性连接第四薄膜晶体管T4的栅极；所述第四薄膜晶体管T4的源极接入第二公共电压Com2，漏极电性连接对应子像素10的第二电容C2的第二端。所述第一调压模块41的第一输入端为第三薄膜晶体管T3的源级，第二输入端为第四薄膜晶体管T4的源级，控制端为第三薄膜晶体管T3的栅极，输出端为第三薄膜晶体管T3的漏极。
所述第二调压模块42包括第五薄膜晶体管T5、第二反相器F2及第六薄膜晶体管T6。所述第五薄膜晶体管T5的栅极电性连接对应扫描线30，源极接入第三公共电压Com3，漏极电性连接对应子像素10的第一电容C1的第二端。所述第二反相器F2的输入端电性连接对应扫描线30，输出端电性连接第六薄膜晶体管T6的栅极。所述第六薄膜晶体管T6的源极接入第二公共电压Com2，漏极电性连接对应子像素10的第一电容C1的第二端。所述第二调压模块42的第一输入端为第六薄膜晶体管T6的源级，第二输入端为第五薄膜晶体管T5的源级，控制端为第五薄膜晶体管T5的栅极，输出端为第五薄膜晶体管T5的漏极。
具体地，在图1所示的实施例中，第三薄膜晶体管T3、第四薄膜晶体管T4、第五薄膜晶体管T5、第六薄膜晶体管T6均为N型薄膜晶体管。
具体地，所述第一公共电压Com1及第三公共电压Com3中一个大于第二公共电压Com2，另一个小于第二公共电压Com2。
优选地，所述第一公共电压Com1大于第二公共电压Com2且大于第三公共电压Com3。
具体地，在对所述像素电路驱动电路进行驱动时，向一列子像素10连接的两条数据线20分别输入极性相反的数据信号电压。中奇数行子像素10所连接的数据线20输入的数据信号电压与向该列子像素10中偶数行子像素10所连接的数据线20输入的数据信号电压的极性相反。。
以图1及图2所示的实施例为例对本发明的像素驱动电路的工作过程进行说明：
同时向与第2n-1行子像素10连接的扫描线G(2n-1)及与第2n行子像素10连接的扫描线G(2n)输入波形相同的扫描信号，同时对第2n-1行子像素10及第2n行子像素10进行驱动。
首先，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号为高电位，将第2n-1行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2导通，同时与第2n行子像素10连接的扫描线G(2n)上的扫描信号也为高电位，将第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2导通，与第m列子像素10中奇数行子像素10连接的第2m-1条数据线D(2m-1)上的数据信号电压为正性并写入对应的子像素10的第一像素电极11、第二像素电极12、第一电容C1的第一端、第二电容C2的第一端，m为正整数，与第m列子像素10中偶数行子像素10连接的第2m条数据线D(2m)上的数据信号电压为负性并写入对应的子像素10的第一像素电极11、第二像素电极12、第一电容C1的第一端、第二电容C2的第一端，此时，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号将其对应的第一调压模块41中的第三薄膜晶体管T3导通、第四薄膜晶体管T4截止，第一公共电压Com1写入第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端，而与第2n行子像素10连接的扫描线G(2n)上的扫描信号将对应的第二调压模块42中的第五薄膜晶体管T5导通、第六薄膜晶体管T6截止，第三公共电压Com3写入第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端。
之后，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号由高电位变为低电位，将第2n-1行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2截止，同时与第2n行子像素10连接的扫描线G(2n)上的扫描信号也由高电位变为低电位，将第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2截止，此时，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号将对应的第一调压模块41中的第三薄膜晶体管T3截止、第四薄膜晶体管T4导通，第二公共电压Com2写入第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端，使第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端电压值降低，由于第二电容C2的存储作用，第2n-1行子像素10中的第二电容C2的第一端的电压也即第二像素电极12上的电压V2对应降低，第2n行子像素10中的第二电容C2的第一端的电压也即第二像素电极12上的电压V4对应降低；而与第2n行子像素10连接的扫描线G(2n)上的扫描信号将对应的第二调压模块42中的第五薄膜晶体管T5截止、第六薄膜晶体管T6导通，第二公共电压Com2写入第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端，使第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端电压值升高，由于第一电容C1的存储作用，第2n-1行子像素10中的第一电容C1的第一端的电压也即第一像素电极11上的电压V1对应升高，第2n行子像素10中的第一电容C1的第一端的电压也即第一像素电极11上的电压V3对应升高，从而使扫描结束后，第2n-1行子像素10中的第一像素电极11及第二像素电极12上的电压不同，第2n行子像素10中的第一像素电极11及第二像素电极12上的电压不同，从而在该像素驱动电路应用于显示装置中时，能够有效解决显示装置在大视角状态下显示画面发白的问题，并且第2n行子像素10与第2n-1行子像素10同时进行扫描，使像素驱动电路整体的扫描速度得到提升，有利于显示装置朝更高分辨率的方向发展。
请参阅图3，并结合图1及图2，基于同一发明构思，本发明还提供一种像素驱动方法，应用于上述像素驱动电路，包括如下步骤：
步骤S1、同时向与第2n-1行子像素10连接的扫描线30及与第2n行子像素10连接的扫描线30输入波形相同的扫描信号。
步骤S2、扫描信号控制第2n-1行子像素10及第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2导通，同时扫描信号控制对应的第一调压模块41向第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端输入第一公共电压Com1，同时扫描信号控制对应的第二调压模块42向第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端输入第三公共电压Com3。
具体地，在图1与图2所示的实施例中，所述步骤S2中，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号为高电位，将第2n-1行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2导通，同时与第2n行子像素10连接的扫描线G(2n)上的扫描信号也为高电位，将第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2导通，与第m列子像素10中奇数行子像素10连接的第2m-1条数据线D(2m-1)上的数据信号电压为正性并写入对应的子像素10的第一像素电极11、第二像素电极12、第一电容C1的第一端、第二电容C2的第一端，与第m列子像素10中偶数行子像素10连接的第2m条数据线D(2m)上的数据信号电压为负性并写入对应的子像素10的第一像素电极11、第二像素电极12、第一电容C1的第一端、第二电容C2的第一端，此时，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号将其对应的第一调压模块41中的第三薄膜晶体管T3导通、第四薄膜晶体管T4截止，第一公共电压Com1写入第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端，而与第2n行子像素10连接的扫描线G(2n)上的扫描信号将对应的第二调压模块42中的第五薄膜晶体管T5导通、第六薄膜晶体管T6截止，第三公共电压Com3写入第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端。
步骤S3、扫描信号控制第2n-1行子像素10及第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2截止，同时扫描信号控制对应的第一调压模块41向第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端输入第二公共电压Com2，同时扫描信号控制对应的第二调压模块42向第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端输入第二公共电压Com2。
具体地，在图1与图2所示的实施例中，所述步骤S3中，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号由高电位变为低电位，将第2n-1行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2截止，同时与第2n行子像素10连接的扫描线G(2n)上的扫描信号也由高电位变为低电位，将第2n行子像素10中的第一薄膜晶体管T1及第二薄膜晶体管T2截止，此时，与第2n-1行子像素10连接的扫描线G(2n-1)上的扫描信号将对应的第一调压模块41中的第三薄膜晶体管T3截止、第四薄膜晶体管T4导通，第二公共电压Com2写入第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端，使第2n-1行子像素10及第2n行子像素10的第二电容C2的第二端电压值降低，由于第二电容C2的存储作用，第2n-1行子像素10中的第二电容C2的第一端的电压也即第二像素电极12上的电压V2对应降低，第2n行子像素10中的第二电容C2的第一端的电压也即第二像素电极12上的电压V4对应降低；而与第2n行子像素10连接的扫描线G(2n)上的扫描信号将对应的第二调压模块42中的第五薄膜晶体管T5截止、第六薄膜晶体管T6导通，第二公共电压Com2写入第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端，使第2n-1行子像素10及第2n行子像素10的第一电容C1的第二端电压值升高，由于第一电容C1的存储作用，第2n-1行子像素10中的第一电容C1的第一端的电压也即第一像素电极11上的电压V1对应升高，第2n行子像素10中的第一电容C1的第一端的电压也即第一像素电极11上的电压V3对应升高，从而使扫描结束后，第2n-1行子像素10中的第一像素电极11及第二像素电极12上的电压不同，第2n行子像素10中的第一像素电极11及第二像素电极12上的电压不同，从而在该像素驱动电路应用于显示装置中时，能够有效解决显示装置在大视角状态下显示画面发白的问题，并且第2n行子像素10与第2n-1行子像素10同时进行扫描，使像素驱动电路整体的扫描速度得到提升，有利于显示装置朝更高分辨率的方向发展。
基于同一发明构思，本发明还提供一种显示装置，包括上述的像素驱动电路。在此不再对像素驱动电路的结构做重复性描述。
具体地，所述显示装置具有有效显示区及位于有效显示区外侧的外围区，阵列排布的多个子像素10均位于有效显示区内，多个第一调压模块41及多个第二调压模块42均位于外围区内。
本发明的显示装置，能够使同一子像素10内的第一像素电极11及第二像素电极12上写入不同的电压，从而有效解决了显示装置在大视角状态下显示画面发白的问题，并且第2n行子像素10与第2n-1行子像素10同时进行扫描，使像素驱动电路整体的扫描速度得到提升，有利于显示装置朝更高分辨率的方向发展。
综上所述，本发明的像素驱动电路包括阵列排布的多个子像素、多条数据线与扫描线、多个第一、第二调压模块，驱动时，同时对第2n-1行子像素及第2n行子像素进行扫描，第一调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第二电容的第二端输入第一公共电压及第二公共电压，第二调压模块在其连接的子像素的第一薄膜晶体管导通及截止时分别向其连接的子像素的第一电容的第二端输入第三公共电压及第二公共电压，从而大大提升像素驱动电路的扫描速度，并且能够使同一子像素内的第一像素电极与第二像素电极上写入不同的电压，有效解决显示装置在大视角状态下显示画面发白的问题，并且能够提升像素驱动电路的扫描速度。本发明的像素驱动方法能够避免显示装置在大视角状态下显示画面发白。本发明的显示装置能够避免大视角状态下显示画面发白的问题，并且能够提升扫描速度。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明权利要求的保护范围。

Claims (9)

1.一种像素驱动电路，其特征在于，包括阵列排布的多个子像素(10)、多条数据线(20)与扫描线(30)、多个第一调压模块(41)及多个第二调压模块(42)；每一扫描线(30)对应连接一行子像素(10)；一列子像素(10)对应连接两条数据线(20)，且该列子像素(10)中的奇数行子像素(10)连接对应两条数据线(20)中的一条，该列子像素(10)中的偶数行子像素(10)连接对应两条数据线(20)中的另一条；
第2n-1行子像素(10)及第2n行子像素(10)为一个子像素组，其中，n等于正整数；每一第一调压模块(41)的第一输入端接入第一公共电压(Com1)，第二输入端接入第二公共电压(Com2)，控制端对应与一子像素组中第2n-1行子像素(10)对应的扫描线(30)连接，输出端与该子像素组中的所有子像素(10)均连接；每一第二调压模块(42)的第一输入端接入第二公共电压(Com2)，第二输入端接入第三公共电压(Com3)，输出端对应与一子像素组中第2n行子像素(10)对应的扫描线(30)连接，输出端与该子像素组中所有子像素(10)均连接；每一子像素(10)均包括第一薄膜晶体管(T1)、第二薄膜晶体管(T2)、第一电容(C1)、第二电容(C2)、第一像素电极(11)及第二像素电极(12)；第一薄膜晶体管(T1)的栅极及源极分别电性连接所在子像素(10)对应的扫描线(30)及数据线(20)，漏极电性连接第一像素电极(11)；第二薄膜晶体管(T2)的栅极与源极分别电性连接所在子像素(10)对应的扫描线(30)与数据线(20)，漏极电性连接第二像素电极(12)；第一电容(C1)的第一端电性连接第一像素电极(11)，第二端电性连接所在子像素(10)对应的第二调压模块(42)的输出端；第二电容(C2)的第一端电性连接第二像素电极(12)，第二端电性连接所在子像素(10)对应的第一调压模块(41)的输出端；
第一调压模块(41)用于受对应扫描线(30)上的扫描信号的控制，在其输出端连接的子像素(10)的第一薄膜晶体管(T1)导通时向其输出端连接的子像素(10)的第二电容(C2)的第二端输入第一公共电压(Com1)，在其输出端连接的子像素(10)的第一薄膜晶体管(T1)截止时向其输出端连接的子像素(10)的第二电容(C2)的第二端输入第二公共电压(Com2)；
第二调压模块(42)用于受对应扫描线(30)上的扫描信号的控制，在其输出端连接的子像素(10)的第一薄膜晶体管(T1)导通时向其输出端连接的子像素(10)的第一电容(C1)的第二端输入第三公共电压(Com3)，在其输出端连接的子像素(10)的第一薄膜晶体管(T1)截止时向其输出端连接的子像素(10)的第一电容(C1)的第二端输入第二公共电压(Com2)；
在对所述像素电路驱动电路进行驱动时，同时向连接第2n-1行子像素(10)的扫描线(30)及连接第2n行子像素(10)的扫描线(30)输入波形相同的扫描信号，使第2n-1行子像素(10)的第一薄膜晶体管(T1)及第二薄膜晶体管(T2)与第2n行子像素(10)的第一薄膜晶体管(T1)及第二薄膜晶体管(T2)同时导通。
2.如权利要求1所述的像素驱动电路，其特征在于，所述第一薄膜晶体管(T1)及第二薄膜晶体管(T2)均为N型薄膜晶体管或均为P型薄膜晶体管。
3.如权利要求2所述的像素驱动电路，其特征在于，所述第一调压模块模块(41)包括第三薄膜晶体管(T3)、第一反相器(F1)及第四薄膜晶体管(T4)；所述第三薄膜晶体管(T3)的栅极电性连接对应扫描线(30)，源极接入第一公共电压(Com1)，漏极电性连接对应子像素(10)的第二电容(C2)的第二端；所述第一反相器(F1)的输入端电性连接对应扫描线(30)，输出端电性连接第四薄膜晶体管(T4)的栅极；所述第四薄膜晶体管(T4)的源极接入第二公共电压(Com2)，漏极电性连接对应子像素(10)的第二电容(C2)的第二端；所述第一调压模块(41)的第一输入端为第三薄膜晶体管(T3)的源级，第二输入端为第四薄膜晶体管(T4)的源级，控制端为第三薄膜晶体管(T3)的栅极，输出端为第三薄膜晶体管(T3)的漏极；
所述第二调压模块(42)包括第五薄膜晶体管(T5)、第二反相器(F2)及第六薄膜晶体管(T6)；所述第五薄膜晶体管(T5)的栅极电性连接对应扫描线(30)，源极接入第三公共电压(Com3)，漏极电性连接对应子像素(10)的第一电容(C1)的第二端；所述第二反相器(F2)的输入端电性连接对应扫描线(30)，输出端电性连接第六薄膜晶体管(T6)的栅极；所述第六薄膜晶体管(T6)的源极接入第二公共电压(Com2)，漏极电性连接对应子像素(10)的第一电容(C1)的第二端；所述第二调压模块(42)的第一输入端为第六薄膜晶体管(T6)的源级，第二输入端为第五薄膜晶体管(T5)的源级，控制端为第五薄膜晶体管(T5)的栅极，输出端为第五薄膜晶体管(T5)的漏极。
4.如权利要求3所述的像素驱动电路，其特征在于，所述第一薄膜晶体管(T1)、第二薄膜晶体管(T2)、第三薄膜晶体管(T3)及第四薄膜晶体管(T4)、第五薄膜晶体管(T5)、第六薄膜晶体管(T6)均为N型薄膜晶体管。
5.如权利要求1所述的像素驱动电路，其特征在于，所述第一公共电压(Com1)及第三公共电压(Com3)中一个大于第二公共电压(Com2)，另一个小于第二公共电压(Com2)。
6.如权利要求5所述的像素驱动电路，其特征在于，所述第一公共电压(Com1)大于第二公共电压(Com2)且大于第三公共电压(Com3)。
7.如权利要求1所述的像素驱动电路，在对所述像素电路驱动电路进行驱动时，向与一列子像素(10)连接的两条数据线(20)分别输入极性相反的数据信号电压。
8.一种像素驱动方法，应用于如权利要求1-7任一项所述的像素驱动电路，其特征在于，包括如下步骤：
步骤S1、同时向与第2n-1行子像素(10)连接的扫描线(30)及与第2n行子像素(10)连接的扫描线(30)输入波形相同的扫描信号；
步骤S2、扫描信号控制第2n-1行子像素(10)及第2n行子像素(10)中的第一薄膜晶体管(T1)及第二薄膜晶体管(T2)导通，同时扫描信号控制对应的第一调压模块(41)向第2n-1行子像素(10)及第2n行子像素(10)的第二电容(C2)的第二端输入第一公共电压(Com1)，同时扫描信号控制对应的第二调压模块(42)向第2n-1行子像素(10)及第2n行子像素(10)的第一电容(C1)的第二端输入第三公共电压(Com3)；
步骤S3、扫描信号控制第2n-1行子像素(10)及第2n行子像素(10)中的第一薄膜晶体管(T1)及第二薄膜晶体管(T2)截止，同时扫描信号控制对应的第一调压模块(41)向第2n-1行子像素(10)及第2n行子像素(10)的第二电容(C2)的第二端输入第二公共电压(Com2)，同时扫描信号控制对应的第二调压模块(42)向第2n-1行子像素(10)及第2n行子像素(10)的第一电容(C1)的第二端输入第二公共电压(Com2)。
9.一种显示装置，其特征在于，包括如权利要求1-7任一项所述的像素驱动电路。
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