CN107171545A - 电磁干扰抑制电路 - Google Patents
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Abstract
一种电磁干扰抑制电路包括第一输入端、第二输入端、瞬态电压抑制模块、滤波模块、防反激干扰模块、第一输出端及第二输出端。瞬态电压抑制模块及滤波模块均与第一输入端及第二输入端相连,以接收第一输入端及第二输入端输入的信号。滤波模块还通过防反激干扰模块与第一输出端及第二输出端相连。瞬态电压抑制模块用于吸收输入信号中的高压杂讯,以使滤波模块接收到的信号的电压在预设范围内。滤波模块对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过防反激干扰模块及第一输出端及第二输出端输出。防反激干扰模块用于防止外部信号的反激干扰。上述电磁干扰抑制电路滤波效果好且电磁兼容性强。
Description
【技术领域】
本发明涉及电动汽车技术领域,尤其涉及一种应用于电动汽车的电磁干扰抑制电路。
【背景技术】
目前,电动汽车正在逐渐推广并在未来将具有广阔的前景。电动汽车上有总车控制系统、电机控制系统、电池管理系统、各种主控箱以及充电机等,因此电磁环境非常复杂。由于电动汽车上各个系统及功能模块的版本不同且厂家各异,不同版本及不同厂家的产品的电磁兼容性超标后相互影响,从而使电磁干扰更加严重,进而影响了车辆运行的可靠性及安全性。
鉴于以上内容,实有必要提供一种电磁干扰抑制电路以克服以上缺陷。
【发明内容】
本发明的目的是提供一种滤波效果好且电磁兼容性强的电磁干扰抑制电路。
为了实现上述目的,本发明提供一种电磁干扰抑制电路,所述电磁干扰抑制电路包括第一输入端、第二输入端、瞬态电压抑制模块、滤波模块、防反激干扰模块、第一输出端及第二输出端,所述瞬态电压抑制模块及所述滤波模块均与所述第一输入端及所述第二输入端相连,以接收所述第一输入端及所述第二输入端输入的信号,所述滤波模块还通过所述防反激干扰模块与所述第一输出端及所述第二输出端相连,所述瞬态电压抑制模块用于吸收输入信号中的高压杂讯,以使所述滤波模块接收到的信号的电压在预设范围内,所述滤波模块对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块及所述第一输出端及所述第二输出端输出,所述防反激干扰模块用于防止外部信号的反激干扰。
进一步地,所述瞬态电压抑制模块包括第一瞬态电压抑制器及第二瞬态电压抑制器,所述第一输入端通过所述第一瞬态电压抑制器接地,所述第二输入端通过所述第二瞬态电压抑制器接地。
进一步地,所述滤波模块包括第一共模滤波单元、第一差模滤波单元、第二共模滤波单元及第二差模滤波单元,所述第一共模滤波单元、所述第一差模滤波单元、所述第二共模滤波单元均与所述第一输入端及所述第二输入端相连,以接收所述第一输入端及所述第二输入端输入的信号,并对接收到的信号进行共模滤波及差模滤波,所述第二差模滤波单元与所述第二共模滤波单元相连,以接收所述第二共模滤波单元输出的信号,并对接收到的信号进行差模滤波。
进一步地,所述第一共模滤波单元包括第一电容及第二电容,所述第一电容的第一端与所述第一输入端相连,所述第一电容的第二端接地,所述第二电容的第一端与所述第二输入端相连,所述第二电容的第二端接地。
进一步地,所述第一差模滤波单元包括第三电容,所述第三电容的第一端与所述第一输入端相连,所述第三电容的第二端与所述第二输入端相连。
进一步地,所述第二共模滤波单元包括磁芯以及绕设在所述磁芯上的第一线圈及第二线圈,所述第一线圈的第一端与所述第一输入端相连,所述第一线圈的第二端与所述第二差模滤波单元相连,所述第二线圈的第一端与所述第二输入端相连并接地,所述第二线圈的第二端与所述第二差模滤波单元相连。
进一步地,所述第二差模滤波单元包括第四电容,所述第四电容的第一端与所述第一线圈的第二端及所述防反激干扰模块相连,所述第四电容的第二端与所述第二线圈的第二端以及所述防反激干扰模块相连。
进一步地,所述防反激干扰模块包括第一电阻、第二电阻及第五至第七电容,所述第一电阻的第一端与所述第四电容的第一端及所述第一输出端相连,并通过所述第五电容接地,所述第一电阻的第二端通过所述第六电容接地,所述第二电阻的第一端与所述第四电容的第二端及所述第二输出端相连,并通过所述第七电容接地,所述第二电阻的第二端与所述第一电阻的第二端相连。
相比于现有技术,本发明通过所述瞬态电压抑制模块吸收输入信号中的高压杂讯,以使所述滤波模块接收到的信号的电压在预设范围内;并通过所述滤波模块对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块输出;还通过所述防反激干扰模块防止外部信号的反激干扰,从而使所述电磁干扰抑制电路滤波效果好且电磁兼容性强。
【附图说明】
图1为本发明的实施例提供的电磁干扰抑制电路的电路图。
【具体实施方式】
为了使本发明的目的、技术方案和有益技术效果更加清晰明白,下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
当一个元件被认为与另一个元件“相连”时,它可以是直接连接到另一个元件或者可能同时存在居中元件。除非另有定义,本文所使用的所有的技术和科学术语与属于本发明的技术领域的技术人员通常理解的含义相同。本文中在本发明的说明书中所使用的术语只是为了描述具体的实施例的目的,不是旨在于限制本发明。
请参阅图1,图1为本发明的实施例提供的电磁干扰抑制电路100的电路图。所述电磁干扰抑制电路100包括第一输入端IN1、第二输入端IN2、瞬态电压抑制模块10、滤波模块20、防反激干扰模块30、第一输出端O1及第二输出端O2。所述瞬态电压抑制模块10及所述滤波模块20均与所述第一输入端IN1及所述第二输入端IN2相连,以接收所述第一输入端IN1及所述第二输入端IN2输入的信号。所述滤波模块20还通过所述防反激干扰模块30与所述第一输出端O1及所述第二输出端O2相连。所述瞬态电压抑制模块10用于吸收输入信号中的高压杂讯,以使所述滤波模块20接收到的信号的电压在预设范围内。所述滤波模块20对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块30及所述第一输出端O1及所述第二输出端O2输出。所述防反激干扰模块30用于防止外部信号的反激干扰。
所述瞬态电压抑制模块10包括第一瞬态电压抑制器TVS1及第二瞬态电压抑制器TVS2。所述第一输入端IN1通过所述第一瞬态电压抑制器TVS1接地,所述第二输入端IN2通过所述第二瞬态电压抑制器TVS2接地。在本实施方式中,所述第一瞬态电压抑制器TVS1用于吸收所述第一输出端O1输入的信号中的高压杂讯,所述第二瞬态电压抑制器TVS2用于吸收所述第二输出端O2输入的信号中的高压杂讯,以使所述滤波模块20接收到的信号的电压在预设范围内,所述预设范围的具体数值可以根据实际情况进行相应的调整。
所述滤波模块20包括第一共模滤波单元22、第一差模滤波单元25、第二共模滤波单元26及第二差模滤波单元28。所述第一共模滤波单元22、所述第一差模滤波单元25、所述第二共模滤波单元26均与所述第一输入端IN1及所述第二输入端IN2相连,以接收所述第一输入端IN1及所述第二输入端IN2输入的信号,并对接收到的信号进行共模滤波及差模滤波。所述第二差模滤波单元28与所述第二共模滤波单元26相连,以接收所述第二共模滤波单元26输出的信号,并对接收到的信号进行差模滤波。
所述第一共模滤波单元22包括第一电容C1及第二电容C2。所述第一电容C1的第一端与所述第一输入端IN1相连,所述第一电容C1的第二端接地。所述第二电容C2的第一端与所述第二输入端IN2相连,所述第二电容C2的第二端接地。
所述第一差模滤波单元25包括第三电容C3。所述第三电容C3的第一端与所述第一输入端IN1相连,所述第三电容C3的第二端与所述第二输入端IN2相连。
所述第二共模滤波单元26包括磁芯T1以及绕设在所述磁芯T1上的第一线圈L1及第二线圈L2。所述第一线圈L1的第一端与所述第一输入端IN1相连,所述第一线圈L1的第二端与所述第二差模滤波单元28相连。所述第二线圈L2的第一端与所述第二输入端IN2相连并接地,所述第二线圈L2的第二端与所述第二差模滤波单元28相连。
所述第二差模滤波单元28包括第四电容C4。所述第四电容C4的第一端与所述第一线圈L1的第二端及所述防反激干扰模块30相连,所述第四电容C4的第二端与所述第二线圈L2的第二端以及所述防反激干扰模块30相连。
所述防反激干扰模块30包括第一电阻R1、第二电阻R2及第五至第七电容C5-C7。所述第一电阻R1的第一端与所述第四电容C4的第一端及所述第一输出端O1相连,并通过所述第五电容C5接地,所述第一电阻R1的第二端通过所述第六电容C6接地。所述第二电阻R2的第一端与所述第四电容C4的第二端及所述第二输出端O2相连,并通过所述第七电容C7接地,所述第二电阻R2的第二端与所述第一电阻R1的第二端相连。
在本实施方式中,所述第一至第七电容C1-C7均为安规电容。可以理解,所述安规电容是指电容失效后,不会导致电击,不危及人身安全。所述安规电容包括X电容及Y电容,所述第一电容C1、所述第二电容C2、所述第五电容C5及所述第七电容C7为Y电容,所述第三电容C3及所述第四电容C4为X电容。
下面将对本发明电磁干扰抑制电路100的工作原理进行说明。
工作时,所述第一瞬态电压抑制器TVS1吸收所述第一输出端O1输入的信号中的高压杂讯,所述第二瞬态电压抑制器TVS2吸收所述第二输出端O2输入的信号中的高压杂讯,以使所述滤波模块20接收到的信号的电压在预设范围内。所述滤波模块20对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块30及所述第一输出端O1及所述第二输出端O2输出。所述防反激干扰模块30防止外部信号的反激干扰,从而增强了所述电磁干扰抑制电路100的抗干扰能力。
本发明通过所述瞬态电压抑制模块10吸收输入信号中的高压杂讯,以使所述滤波模块20接收到的信号的电压在预设范围内;并通过所述滤波模块20对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块30输出;还通过所述防反激干扰模块30防止外部信号的反激干扰,从而使所述电磁干扰抑制电路100滤波效果好且电磁兼容性强。
本发明并不仅仅限于说明书和实施例中所描述,因此对于熟悉领域的人员而言可容易地实现另外的优点和修改,故在不背离权利要求及等同范围所限定的一般概念的精神和范围的情况下,本发明并不限于特定的细节、代表性的设备和这里示出与描述的图示示例。
Claims (8)
1.一种电磁干扰抑制电路,其特征在于:所述电磁干扰抑制电路包括第一输入端、第二输入端、瞬态电压抑制模块、滤波模块、防反激干扰模块、第一输出端及第二输出端,所述瞬态电压抑制模块及所述滤波模块均与所述第一输入端及所述第二输入端相连,以接收所述第一输入端及所述第二输入端输入的信号,所述滤波模块还通过所述防反激干扰模块与所述第一输出端及所述第二输出端相连,所述瞬态电压抑制模块用于吸收输入信号中的高压杂讯,以使所述滤波模块接收到的信号的电压在预设范围内,所述滤波模块对接收到的信号进行共模滤波及差模滤波,并将滤波后的信号通过所述防反激干扰模块及所述第一输出端及所述第二输出端输出,所述防反激干扰模块用于防止外部信号的反激干扰。
2.如权利要求1所述的电磁干扰抑制电路,其特征在于:所述瞬态电压抑制模块包括第一瞬态电压抑制器及第二瞬态电压抑制器,所述第一输入端通过所述第一瞬态电压抑制器接地,所述第二输入端通过所述第二瞬态电压抑制器接地。
3.如权利要求1所述的电磁干扰抑制电路,其特征在于:所述滤波模块包括第一共模滤波单元、第一差模滤波单元、第二共模滤波单元及第二差模滤波单元,所述第一共模滤波单元、所述第一差模滤波单元、所述第二共模滤波单元均与所述第一输入端及所述第二输入端相连,以接收所述第一输入端及所述第二输入端输入的信号,并对接收到的信号进行共模滤波及差模滤波,所述第二差模滤波单元与所述第二共模滤波单元相连,以接收所述第二共模滤波单元输出的信号,并对接收到的信号进行差模滤波。
4.如权利要求3所述的电磁干扰抑制电路,其特征在于:所述第一共模滤波单元包括第一电容及第二电容,所述第一电容的第一端与所述第一输入端相连,所述第一电容的第二端接地,所述第二电容的第一端与所述第二输入端相连,所述第二电容的第二端接地。
5.如权利要求3所述的电磁干扰抑制电路,其特征在于:所述第一差模滤波单元包括第三电容,所述第三电容的第一端与所述第一输入端相连,所述第三电容的第二端与所述第二输入端相连。
6.如权利要求3所述的电磁干扰抑制电路,其特征在于:所述第二共模滤波单元包括磁芯以及绕设在所述磁芯上的第一线圈及第二线圈,所述第一线圈的第一端与所述第一输入端相连,所述第一线圈的第二端与所述第二差模滤波单元相连,所述第二线圈的第一端与所述第二输入端相连并接地,所述第二线圈的第二端与所述第二差模滤波单元相连。
7.如权利要求6所述的电磁干扰抑制电路,其特征在于:所述第二差模滤波单元包括第四电容,所述第四电容的第一端与所述第一线圈的第二端及所述防反激干扰模块相连,所述第四电容的第二端与所述第二线圈的第二端以及所述防反激干扰模块相连。
8.如权利要求7所述的电磁干扰抑制电路,其特征在于:所述防反激干扰模块包括第一电阻、第二电阻及第五至第七电容,所述第一电阻的第一端与所述第四电容的第一端及所述第一输出端相连,并通过所述第五电容接地,所述第一电阻的第二端通过所述第六电容接地,所述第二电阻的第一端与所述第四电容的第二端及所述第二输出端相连,并通过所述第七电容接地,所述第二电阻的第二端与所述第一电阻的第二端相连。
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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CN107911132A (zh) * | 2017-10-30 | 2018-04-13 | 周燕红 | 一种电磁干扰消除装置 |
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2017
- 2017-06-08 CN CN201710425987.5A patent/CN107171545A/zh active Pending
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PB01 | Publication | ||
PB01 | Publication | ||
WD01 | Invention patent application deemed withdrawn after publication |
Application publication date: 20170915 |
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WD01 | Invention patent application deemed withdrawn after publication |