CN107170793B - 阵列基板及其驱动方法、显示面板及显示装置 - Google Patents

阵列基板及其驱动方法、显示面板及显示装置 Download PDF

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Abstract

本发明提供一种阵列基板，包括多组数据线和多条栅线；每组数据线包括与同一个数据信号端相连的多条数据线；在每条数据线上设置有数据选择器，用于在数据选择控制信号的控制下使所述数据线和所述数据信号端导通或关断；多条所述数据线和多条所述栅线在不同层上交叉设置限定出多行多列排列的多个子像素区域，每个子像素区域用于设置子像素；每组数据线对应的处于每一行的多个子像素被划分为至少两组，同一组的所述子像素连接同一条栅线，不同组的所述子像素连接不同栅线。本发明还提供阵列基板的驱动方法、显示面板和显示装置，本发明可以解决显示不均的问题。

Description

阵列基板及其驱动方法、显示面板及显示装置
技术领域
本发明属于显示器件加工技术领域，具体涉及一种阵列基板及其驱动方法、显示面板及显示装置。
背景技术
目前，为了通过减少数据信号端的数量来节省集成电路(IC)的成本，如图1所示，AMOLED显示面板的多条数据线(图1中为6条)与一个数据信号端Data(m)相连，并且，在每条数据线上设置有数据选择器MUX；每个MUX用于在数据控制信号MUX(n)的控制下使相应的数据线和数据信号端Data(m)的导通和关断；另外，多条数据线和多条栅线G(n)交叉设置，形成设置有子像素1的子像素区域，并且，每个子像素1与之所在的行和列的数据线和栅线相连；图2a和图2b为两种常见的子像素驱动电路的示意图，其中，晶体管P3为驱动晶体管，其他晶体管P1-P2、P4-P8为开关管，图1中的数据线与相应的图2a和图2b所示的子像素驱动电路的Data端相连，图1中的栅线G(n)与处于第n行的所有子像素的图2a和图2b所示的子像素驱动电路中的Gate端相连，图1中的复位线R(n)与处于第n行的所有子像素的图2a和图2b所示的子像素驱动电路中的Reset端相连；图1中的发光控制线EM(n)与处于第n行的所有子像素的图2a和图2b所示的子像素驱动电路中的EM端相连。
图3为图1所示的阵列基板的工作时序图，请参阅图3，在栅极电压开启时间段(T2和T3时间段内)内，MUX(1)～MUX(6)依次输入有效信号，控制6个MUX依次打开，使数据信号端依次向每条数据线加载数据信号，并读取子像素的像素驱动电路中驱动晶体管(如图2a和图2b中的晶体管P3)的阈值电压，以先进行阈值补偿后发光。
由于驱动晶体管P3的阈值电压的读取时间是晶体管P2打开时间，在该时间内，驱动晶体管P3的漏极和栅极导通，栅极和漏极的电位会变为源极减去阈值电压压降，这样，由于在晶体管P2打开时间内MUX(1)至MUX(6)是按顺序一个一个打开，但晶体管P2一直是打开状态，故MUX(1)对应读取的时间最长(为2h)，MUX(6)对应读取的时间最短为(为1/3h)，MUX(2)～MUX(5)对应读取的时间依次分别为5/3h、4/3h、1h和2/3h，由于MUX(1)和MUX(6)读取驱动晶体管的阈值电压的时间相差较大(分别为2h和1/3h)，MUX(1)有效时对应的像素驱动电路读取的阈值电压和实际的阈值电压最接近，MUX(6)有效时对应的像素驱动电路读取的阈值电压和实际的阈值电压最不接近。由于MUX(1)～MUX(3)控制的是RGB信号，因此，可通过RGB的Gamma电路调节；MUX(4)～MUX(6)同理，但是，MUX(1)～MUX(3)与MUX(4)～MUX(6)二者之间的差异无法通过Gamma电路调节，从而在显示时会造成显示不均，例如，会出现如图4所示的竖条纹现象。
发明内容
本发明旨在至少解决现有技术中存在的技术问题之一，提出了一种阵列基板及其驱动方法、显示面板及显示装置，可以解决显示不均的技术问题。
为解决上述问题之一，本发明提供了一种阵列基板，包括多组数据线和多条栅线；
每组数据线包括与同一个数据信号端相连的多条数据线；
在每条数据线上设置有数据选择器，用于在数据选择控制信号的控制下使所述数据线和所述数据信号端导通或关断；
多条所述数据线和多条所述栅线在不同层上交叉设置限定出多行多列排列的多个子像素区域，每个子像素区域用于设置子像素；
每组数据线对应的处于每一行的多个子像素被划分为至少两组，同一组的所述子像素连接同一条栅线，不同组的所述子像素连接不同栅线。
优选地，同一组数据线对应的处于每一行的多组子像素连接的不同栅线包括：与该多组子像素同行的栅线以及相邻且依次导通的栅线。
优选地，不同组数据线包括相同数量的多组子像素；并且
不同组数据线的多组子像素与栅线连接的方式相同。
优选地，同一组数据线的多组子像素中的子像素的数量相同。
优选地，在所述阵列基板上设置有与多条所述栅线一一对应的多个移位寄存单元；
多个所述移动寄存单元，用于依次向对应的所述栅线输出扫描信号；
上一级所述移位寄存单元的输出端与下一级的所述子像素的像素驱动电路的复位输入端相连。
优选地，在所述阵列基板上还设置有与多行所述子像素一一对应的多个发光控制驱动电路；
多个所述发光控制驱动电路，用于依次向对应的一行所述子像素的像素驱动电路的发光控制输入端相连。
相应地，本发明还提供一种显示面板，包括本发明提供的上述阵列基板。
相应地，本发明还提供一种显示装置，包括本发明提供的上述阵列基板。
相应地，本发明还提供一种上述阵列基板的驱动方法，包括以下步骤：
与一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，使数据线上的信号写入相应的子像素中；
与另一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，使数据线上的信号写入相应的子像素中。
本发明具有以下有益效果：
本发明中，借助每组数据线对应的多个子像素被划分为至少两组，同一组的子像素连接同一条栅线，不同组的子像素连接不同栅线，这样，可以在不同栅线依次输入有效信号时不同组的子像素的子像素驱动电路依次读取驱动晶体管的阈值电压，这相对现有技术而言，由于不同栅线各自输入有效信号时通过数据选择器控制的数据线和数据信号端依次导通的数量小于现有技术中每组数据线对应的所有子像素的数量，因此，可以改善每组数据线对应的多个子像素的子像素驱动电路读取驱动晶体管的阈值电压的最大差异，从而可以很好地解决显示不均的技术问题。
附图说明
图1为现有技术的阵列基板的结构示意图；
图2a和图2b为两种常见的子像素驱动电路的示意图；
图3为图1所示的阵列基板的工作时序图；
图4为现有技术中存在的竖条纹现象；
图5为本发明实施例提供的一种阵列基板的结构示意图；
图6为图5所示的阵列基板的工作时序图；
图7为本发明实施例提供的另一种阵列基板的结构示意图；
图8为图7所示的阵列基板的时序图。
具体实施方式
为使本领域的技术人员更好地理解本发明的技术方案，下面结合附图来对本发明提供的阵列基板及其驱动方法、显示面板及显示装置进行详细描述。
实施例1
图5为本发明实施例提供的一种阵列基板的结构示意图；请参阅图5，本发明实施例提供的阵列基板，包括多组数据线和多条栅线G(n)；每组数据线包括与同一个数据信号端相连的多条数据线，如图5所示，第一组数据线包括与数据信号端Data(1)相连的6条数据线；在每条数据线上设置有数据选择器MUX，用于在数据选择控制信号MUX(n)的控制下使数据线和数据信号端导通或关断，具体地，在导通时将数据信号端输出的数据信号提供给数据线，数据线再将数据信号提供给与之相连的子像素。
多条数据线和多条栅线在不同层上交叉设置限定出多行多列排列的多个子像素区域，每个子像素区域用于设置子像素1；每组数据线对应的处于每一行的多个子像素被划分为至少两组，同一组的子像素连接同一条栅线，不同组的子像素连接不同栅线。具体地，请参阅图5，针对与数据信号端Data(1)相连的一组数据线(6条)而言，与该组数据线对应的处于第1……n行的多个子像素均被划分为2组，第1组包括左侧的三个子像素1，第2组包括右侧的三个子像素1，针对第一行而言，第1组的三个子像素与连接同一个栅线G(1)，第2组的三个子像素连接同一个栅线G(1’)(本实施例中实际为G(2)),第1组和第2组子像素连接不同的栅线；针对其他行而言，与第1行类似，在此不再赘述。
在本实施例中，优选地，同一组数据线对应的处于每一行的多组子像素连接的不同栅线包括：与该多组子像素同行的栅线以及相邻且依次导通的栅线。具体地，请参阅图5，对于与数据信号端Data(1)相连的一组数据线，处于第1行的第1组子像素与第1行栅线G(1)，处于第1行的第2组子像素和第2行栅线G(2)相连；同样地，处于第n行的第1组子像素与第1行栅线G(n)，处于第1行的第2组子像素和第2行栅线G(n+1)(即，G(n’))相连。
可以理解的是，该优选的实施方式，可以使得阵列基板上的栅线与子像素之间的布线相对规则且简单，从而使得阵列基板的结构简单、易制备。
另外，优选地，不同组数据线包括相同数量的多组子像素；并且，不同组数据线的多组子像素连接相同的栅线。结合附图5具体说明，第1组数据线(与Data(1)相连的多个数据线)包括2组子像素，其中的一组子像素连接G(1)另一组连接G(1’)；第m组数据线(与Data(1)相连的多个数据线)包括2组子像素，其中的一组子像素连接G(1)另一组连接G(1’)。
可以理解的是，该优选的实施方式，不仅可以使得阵列基板上的栅线和子像素之间的布线更加规则且简单，而且还可以减少不同组数据线的子像素的子像素驱动电路读取的阈值电压差异，从而可以进一步地减少显示不均的技术问题。
进一步优选地，如图5所示，同一组数据线的多组子像素中的子像素的数量相同，且为3个，分别红色子像素R、绿色子像素G、和蓝色子像素B。当然，在实际应用中，也可以根据实际情况设置每组子像素所包括子像素的数量以及子像素的颜色，例如，每组子像素包括2个子像素，且为红色子像素和绿色子像素。
另外，在本实施例中，进一步地，同一组数据线的多组子像素中的子像素的颜色相同，如图5所示，均为红色子像素R、绿色子像素G、和蓝色子像素B。当然，在实际应用中，同一组数据线的多组子像素中的子像素的颜色还可以不同，在此不再详述。
下面结合图6详细描述本发明实施例提供的阵列基板是如何解决显示不均的技术问题的。请参阅图6，以一组数据线为例进行说明，在第m行栅线G(m)输入有效信号(即，低电平)时，与该栅线G(m)相连的第m行的一组子像素为左侧的三个子像素，与该三个子像素相连的三条数据线上的数据选择器MUX在三个数据选择控制信号MUX(1)～MUX(3)的控制下依次打开，以使数据信号端依次向该三条数据线加载数据信号，最终使三条数据线上的信号各自写入相应的子像素中。
在第m+1行栅线G(m+1)(即，G(m’))输入有效信号(即，低电平)时，与该栅线G(m’)相连的第m行的一组子像素为右侧的三个子像素，与该三个子像素相连的三条数据线上的数据选择器MUX在三个数据选择控制信号MUX(4)～MUX(6)的控制下依次打开，以使数据信号端依次向该三条数据线加载数据信号，最终使三条数据线上的信号各自写入相应的子像素中。
从附图6中可以看出：MUX(1)和MUX(4)有效时对应的像素驱动电路读取驱动晶体管T3的阈值电压的时间均为1h，MUX(2)～MUX(3)依次有效时对应的像素驱动电路读取驱动晶体管的阈值电压的时间依次分别为2/3h、1/3h；MUX(5)～MUX(6)依次有效时对应的像素驱动电路读取驱动晶体管的阈值电压的时间依次分别为2/3h、1/3h，这样，对于该一组数据线相连的6个子像素而言，读取的阈值电压的时间相差较大也就在2/3h(1h-1/3h)，这与现有技术的时间相差最大值在5/3h(2h-1/3h)相比，可以改善每组数据线对应的多个子像素的子像素驱动电路读取驱动晶体管的阈值电压的最大差异，从而可以很好地解决显示不均的技术问题。
综上所述：本发明实施例提供的阵列基板，借助每组数据线对应的多个子像素被划分为至少两组，同一组的子像素连接同一条栅线，不同组的子像素连接不同栅线，这样，可以在不同栅线依次输入有效信号时不同组的子像素的子像素驱动电路依次读取驱动晶体管的阈值电压，这相对现有技术而言，由于不同栅线各自输入有效信号时通过数据选择器控制的数据线和数据信号端依次导通的数量小于现有技术中每组数据线对应的所有子像素的数量，因此，可以改善每组数据线对应的多个子像素的子像素驱动电路读取驱动晶体管的阈值电压的最大差异，从而可以很好地解决显示不均的技术问题。
需要说明的是，本实施例提供的阵列基板可应用在有机发光显示面板或显示装置中。
实施例2
图7为本发明实施例提供的另一种阵列基板的结构示意图；请参阅图7，本实施例提供的阵列基板与上述实施例1提供的阵列基板相类似，在此不再赘述。
下面仅描述本实施例提供的阵列基板与上述实施例1提供的阵列基板的不同点：
在阵列基板上设置有与多条栅线一一对应的多个移位寄存单元10；多个移动寄存单元10用于依次向对应的栅线输出扫描信号；上一级移位寄存单元10的输出端与下一级的子像素的像素驱动电路的复位输入端Reset相连。借助多个移位寄存单元10设置在阵列基板上，可以提高显示面板的集成度，使得显示面板更薄型化。
进一步地，在阵列基板上还设置有与多行子像素一一对应的多个发光控制驱动电路20；多个发光控制驱动电路20用于依次向对应的一行子像素的像素驱动电路的发光控制输入端EM相连。借助多个发光控制驱动电路20设置在阵列基板上，可以进一步地提高显示面板的集成度，使得显示面板更进一步地薄型化。
图8为本发明实施例提供的阵列基板的时序图，由于本实施例提供的阵列基板中的栅线和子像素的连接方式与上述实施例1提供的阵列基板相同，因此，二者的工作时序图也相同，在此不再赘述。
实施例3
本发明实施例提供一种显示面板，包括上述实施例的阵列基板。
优选地，显示面板还包括对盒基板，对盒基板与所述阵列基板对盒设置。具体地，在阵列基板的子像素区域内设置有白色有机发光层时，在对盒基板上的与子像素区域对应的区域还设置有相应的色阻块；在阵列基板的子像素区域内设置有彩色有机发光层时，对盒基板可以为一透明基板即可。
该显示面板可以为OLED显示面板。
本发明实施例提供的显示面板，采用本发明上述实施例1或2提供的阵列基板，可以提高显示面板的显示均匀性。
实施例4
本发明实施例提供一种显示装置，包括上述实施例1或2提供的阵列基板。
所述显示装置可以为：电子纸、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
本发明实施例提供的显示装置，采用本发明上述实施例1或2提供的阵列基板，可以提高显示装置的显示均匀性。
实施例5
本发明实施例提供一种上述实施例1或2提供阵列基板的驱动方法，包括以下步骤：
与一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，最终使数据线上的信号写入相应的子像素中；
与另一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，最终使数据线上的信号写入相应的子像素中。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (6)

1.一种阵列基板，其特征在于，包括多组数据线和多条栅线；
每组数据线包括与同一个数据信号端相连的多条数据线；
在每条数据线上设置有数据选择器，用于在数据选择控制信号的控制下使所述数据线和所述数据信号端导通或关断；
多条所述数据线和多条所述栅线在不同层上交叉设置限定出多行多列排列的多个子像素区域，每个子像素区域用于设置子像素；
每组数据线对应的处于每一行的多个子像素被划分为至少两组，同一组的所述子像素连接同一条栅线，不同组的所述子像素连接不同栅线，所述两组包括第一子像素组和第二子像素组；
根据所述数据选择器的选择，所述第一子像素组或所述第二子像素组对应的所述数据线和所述数据信号端导通的数量小于所述每组数据线对应的所有子像素的数量；
同一组数据线对应的处于每一行的多组子像素连接的不同栅线，包括：与该多组子像素同行的栅线以及相邻且依次导通的栅线，不同组的栅级是依次导通的，相邻子像素行不共用Gate线；
同一组数据线的多组子像素中的子像素的数量相同；
不同组数据线包括相同数量的多组子像素；并且不同组数据线的多组子像素与栅线连接的方式相同。
2.根据权利要求1所述的阵列基板，其特征在于，在所述阵列基板上设置有与多条所述栅线一一对应的多个移位寄存单元；
多个所述移位 寄存单元，用于依次向对应的所述栅线输出扫描信号；
上一级所述移位寄存单元的输出端与下一级的所述子像素的像素驱动电路的复位输入端相连。
3.根据权利要求2所述的阵列基板，其特征在于，在所述阵列基板上还设置有与多行所述子像素一一对应的多个发光控制驱动电路；
多个所述发光控制驱动电路，用于依次向对应的一行所述子像素的像素驱动电路的发光控制输入端相连。
4.一种显示面板，其特征在于，包括权利要求1-3任意一项所述的阵列基板。
5.一种显示装置，其特征在于，包括权利要求1-3任意一项所述的阵列基板。
6.一种权利要求1-3任意一项所述的阵列基板的驱动方法，其特征在于，包括以下步骤：
与一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，使数据线上的信号写入相应的子像素中；
与另一组子像素相连的栅线输入有效信号，与该组子像素相连的多条数据线上的数据选择器依次打开，以使数据信号端依次向多条数据线加载数据信号，使数据线上的信号写入相应的子像素中。
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