CN105760323A - 一种基于fpga的网络接口控制器 - Google Patents

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潘红兵
李宇
王禛
吕飞
李晨杰
徐天伟
李丽
何书专
陈金锐
李伟
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Nanjing University
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    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/382—Information transfer, e.g. on bus using universal interface adapter
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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Abstract

本发明涉及一种基于FPGA的网络接口控制器，向接收卡发送流媒体数据，包括接口模块，包括RGMII接口，传送所述流媒体数据的回传数据，完成数据从媒体介入控制层到物理层或从物理层到媒体介入控制层的数据传递；传输模块，接收所述流媒体数据的回传数据，该模块包括发送单元和接收单元，发送单元打包所述数据和发送FIFO队列的控制信号；接收单元接收FIFO队列的所述控制信号，并解析所述数据包。有益效果：大大简化代码量，节省逻辑资源，提高数据传输效率。

Description

一种基于FPGA的网络接口控制器
技术领域
本发明涉及控制器，该控制器可完成FPGA与FPGA之间的数据传输的网络接口控制器。
背景技术
以太网技术是当今应用广泛的网络技术，千兆以太网技术继承了以往以太网技术的许多优点，同时又具有许多新的特性，例如传输介质包括光纤和铜缆，使用8B/10B的编解码方案，采用载波扩展和分组突发技术等。正是因为具有良好的继承性和许多优秀的新特性，千兆以太网已经成为目前局域网的主流解决方案。
千兆以太网利用了原以太网标准所规定的全部技术规范，其中包括CSMA/CD协议、以太网帧、全双工、流量控制以及IEEE802.3标准中所定义的管理对象。千兆以太网的关键技术是千兆以太网二层（MAC层）的交换与以太网接口的实现。随着多媒体应用的普及，千兆以太网必将成为各类以太网技术的主力军。
Xilinx提供了可参数化的10/1Gbps以太网媒体访问控制器功能LogiCORE解决方案。该核设计用来同最新的Virtex-5、Virtex-4和Virtex-IIPro平台FPGA一起工作，并可以无缝集成到Xilinx设计流程中。GEMAC核的设计符合IEEE802.3-2002规范。GEMAC核支持两个PHY端接口选项：GMII或RGMII。而本发明所用Spartan6系统资源有限，通过例化IP核占用了大部分资源，并不能完成该系统所要求实现的功能，因此需要尽量简化网络接口控制模块，以节省更多的资源用于其他功能模块的设计实现。
发明内容
本发明目的在于克服以上问题，提供一种基于FPGA的网络接口控制器，具体有以下技术方案实现：
所述基于FPGA的网络接口控制器，其特征在于向接收卡发送流媒体数据，包括
接口模块，包括RGMII接口，传送所述流媒体数据的回传数据，完成数据从媒体介入控制层到物理层或从物理层到媒体介入控制层的数据传递；
传输模块，接收所述流媒体数据的回传数据，该模块包括发送单元和接收单元，发送单元打包所述数据和发送FIFO队列的控制信号；接收单元接收FIFO队列的所述控制信号，并解析所述数据包。
所述基于FPGA的网络接口控制器的进一步设计在于，通过所述RGMII接口传递的数据的数据宽度为四位。
所述基于FPGA的网络接口控制器的进一步设计在于，所述发送单元首先将待发送的数据发送至FIFO存储器，按照自定义的传输协议将所述待发送的数据打包后形成传输数据，发送给接口模块，再由接口模块将所述传输数据的数据宽度转换为四位，由RGMII接口发送至物理层实现数据传输。
所述基于FPGA的网络接口控制器的进一步设计在于，所述接口模块还包括网络接口，所述网络接口采用自定义协议。
所述基于FPGA的网络接口控制器的进一步设计在于，通过所述RGMII接口传递的数据的数据帧格式采用自定义协议，数据帧格式包括帧头、帧尾、帧的类型及承载的数据。
本发明的优点如下：
本发明提供的基于FPGA的网络接口控制器，物理层芯片只需满足四位数据位宽即可以完成数据传输，因此采用自定义协议，将含有数据信息与配置信息的回传数据加上特定的帧头、帧尾打包成数据包，通过RGMII接口将数据传送至物理层。另外，由于本发明的技术方案仅考虑在FPGA与FPGA之间传递数据，不需要按照标准的以太帧协议打包数据，通过自定义协议大大简化代码量，节省逻辑资源，提高数据传输效率。
附图说明
图1是发送主卡总体结构示意图。
图2是网络接口控制器结构示意图。
图3是配置帧格式示意图。
图4是数据帧格式示意图。
具体实施方式
下面结合附图对本发明方案进行详细说明。
本实施例以一款全彩LED屏异步控制卡作为验证平台。LED屏异步控制卡的总体架构如图1所示，主要由LVDS控制器、网络接口控制器、LPDDR控制器、I2C接口、LED显示模块、SPIflash、JTAG调试、LED显示屏以及控制模块组成。其中网络接口控制器即为本发明技术方案方案所述的控制器。
本实施例提供的基于FPGA的网络接口控制器，包括接口模块与传输模块。接口模块，包括RGMII接口，传送所述流媒体数据的回传数据，完成数据从媒体介入控制层到物理层或从物理层到媒体介入控制层的数据传递。
传输模块，接收所述流媒体数据的回传数据。其传输模块中，分为如下两个单元：
发送单元，首先将要发送的数据进发送FIFO队列缓存，然后按照自定义的传输协议将待发送的数据打包，发送给RGMII接口单元，再由RGMII接口单元处理数据，实现数据的八位（本实施例以8位数据为例，其他的数据类型以此类推不再赘述）转四位，再发送给物理层芯片，实现数据传输；
接收单元——按自定义传输协议实现数据接收。控制主卡传输模块可以接收从接收卡回传的数据包（含有配置信息与数据信息），传输模块接收部分可以对接收卡回传的数据包进行解包，提取有效数据，将有效数据送入接收FIFO中缓存，以便实现从PHY端到MAC端的数据传输。
通过RGMII接口传递的数据的数据帧格式采用自定义协议，如图4，数据帧格式包括帧头、帧尾、帧的类型及承载的数据，具体定义参见表1。配置帧格式参见图3。
表1
本实施例提供的基于FPGA的网络接口控制器，RGMII接口单元即ReducedGMII，是GMII的简化版本，RGMII均采用四位数据接口，工作时钟125MHz，并且在上升沿和下降沿同时传输数据，因此传输速率可达1000Mbps。本实施例提供的基于FPGA的网络接口控制器，物理层芯片只需满足四位数据位宽即可以完成数据传输，因此采用自定义协议，将含有数据信息与配置信息的回传数据加上特定的帧头、帧尾打包成数据包，通过RGMII接口将数据传送至物理层。
由于本发明的技术方案仅考虑在FPGA与FPGA之间传递数据，不需要按照标准的以太帧协议打包数据，通过自定义协议大大简化代码量，节省逻辑资源，提高数据传输效率。网络接口控制器与例化IP核所占资源的对比如表2所示。
表2

Claims (5)

1.一种基于FPGA的网络接口控制器，其特征在于向接收卡发送流媒体数据，包括
接口模块，包括RGMII接口，传送所述流媒体数据的回传数据，完成数据从媒体介入控制层到物理层或从物理层到媒体介入控制层的数据传递；
传输模块，接收所述流媒体数据的回传数据，该模块包括发送单元和接收单元，发送单元打包所述数据和发送FIFO队列的控制信号；接收单元接收FIFO队列的所述控制信号，并解析所述数据包。
2.根据权利要求1所述的基于FPGA的网络接口控制器，其特征在于通过所述RGMII接口传递的数据的数据宽度为四位。
3.根据权利要求2所述的基于FPGA的网络接口控制器，其特征在于所述发送单元首先将待发送的数据发送至FIFO存储器，按照自定义的传输协议将所述待发送的数据打包后形成传输数据，发送给接口模块，再由接口模块将所述传输数据的数据宽度转换为四位，由RGMII接口发送至物理层实现数据传输。
4.根据权利要求1所述的基于FPGA的网络接口控制器，其特征在于所述接口模块还包括网络接口，所述网络接口采用自定义协议。
5.根据权利要求2所述的基于FPGA的网络接口控制器，其特征在于通过所述RGMII接口传递的数据的数据帧格式采用自定义协议，数据帧格式包括帧头、帧尾、帧的类型及承载的数据。
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