CN104485937A - 延迟信号发生器的输出电平转换电路 - Google Patents
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Abstract
本发明涉及信号模拟器领域，公开了一种延迟信号发生器的输出电平转换电路。所述提供的延迟信号发生器的输出电平转换电路，通过双向电平转换芯片将从FPGA芯片输出的TO同步脉冲信号和TX回波脉冲信号同步从3.3V提升至5V，同时为两路脉冲信号配置用于连接示波器的射频接头，示波器的测试端可直接连接所述射频接头，实现对接测试，方便实用。
Description
技术领域
本发明涉及信号模拟器领域，具体地，涉及一种延迟信号发生器的输出电平转换电路。
背景技术
信号模拟器为复杂电磁环境仿真系统的信号发生设备，将软件系统的仿真结果经过模拟器转换成真实信号。模拟器能够产生空间任意一点的电磁背景信号，或特定通信、导航，雷达等信号，并以天线向空间发送或以电缆直接注入被测试设备，完成仿真系统功能。延迟信号发生器作为信号模拟器中的其中一种，用于在延迟模拟测试时提供两路脉冲信号，所述两路脉冲信号分别为TO同步脉冲信号和TX回波脉冲信号，这两路脉冲信号的脉冲频率均为10KHz，两者的时间之差即为需要测试的时延，通常延迟信号发生器还需要外接示波器以观察时延数值。
所述TO同步脉冲信号和TX回波脉冲信号均由位于延迟信号发生器内部的中频信号板上的FPGA（Field-Programmable Gate Array，现场可编程门阵列）芯片输出，但是FPGA芯片的输出信号电平只有3.3V，而外接示波器的输出电平则需要5V,两者不能直接对接，因此需要设计一个输出电路，提升FPGA芯片输出的两路脉冲信号的电平，实现延迟信号发生器与示波器的对接测试。
发明内容
针对上述目前延迟信号发生器的输出问题，本发明提供了一种延迟信号发生器的输出电平转换电路，能够将FPGA芯片输出的两路脉冲信号的电平从3.3V提升至5V，从而实现延迟信号发生器与示波器的对接测试。
本发明采用的技术方案，提供了一种延迟信号发生器的输出电平转换电路，其特征在于，包括：双向电平转换芯片，电容C1，电容C2，电容C3，电阻R1，电阻R2，第一射频接头和第二射频接头；双向电平转换芯片的第一电源端连接电容C1的第一端和第一直流电压源VCC1，电容C1的第二端接地，双向电平转换芯片的第二电源端连接电容C2的第一端和第二直流电压源VCC2，电容C2的第二端接地，双向电平转换芯片的接地端接地，双向电平转换芯片的方向选择端连接电容C3的第一端和第一直流电压源VCC1，电容C3的第一端接地；双向电平转换芯片的第一输入端用于输入第一测试射频信号，双向电平转换芯片的第一输出端连接电阻R1的第一端，电阻R1的第二端连接第一射频接头；双向电平转换芯片的第二输入端用于输入第二测试射频信号，双向电平转换芯片的第二输出端连接电阻R2的第一端，电阻R2的第二端连接第二射频头；直流电压源VCC1的供电电压为3.3V，直流电压源VCC2的供电电压为5V。
具体的，所述双向转换芯片为SN74LVC2T45，第一电源端为VCCA端，第二电源端为VCCB端，第一输入端为A1端，第二输入端为A2端，第一输出端为B1端，第二输出端为B2端，接地端为GND端，方向选择端为DIR端。
具体的，所述第一射频接头为SMA接头，SMB接头或N型接头中的任一一种。所述第二射频接头为SMA接头，SMB接头或N型接头中的任一一种。
综上，采用本发明所述提供的延迟信号发生器的输出电平转换电路，通过双向电平转换芯片将从FPGA芯片输出的TO同步脉冲信号和TX回波脉冲信号同步从3.3V提升至5V，同时为两路脉冲信号配置用于连接示波器的射频接头，示波器的测试端可直接连接所述射频接头，实现对接测试，方便实用。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的延迟信号发生器的输出电平转换电路图。
具体实施方式
以下将参照附图，通过实施例方式详细地描述本发明提供的一种延迟信号发生器的输出电路。在此需要说明的是，对于这些实施例方式的说明用于帮助理解本发明，但并不构成对本发明的限定。
本文中描述的各种技术可以用于但不限于信号模拟器领域，还可以用于其它类似领域。
本文中术语“和/或”，仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，单独存在B，同时存在A和B三种情况，本文中术语“或/和”是描述另一种关联对象关系，表示可以存在两种关系，例如，A或/和B，可以表示：单独存在A，单独存在A和B两种情况，另外，本文中字符“/”，一般表示前后关联对象是一种“或”关系。
实施例一，图1示出了本实施例提供的延迟信号发生器的输出电平转换电路图。所述延迟信号发生器的输出电平转换电路，其特征在于，包括：双向电平转换芯片，电容C1，电容C2，电容C3，电阻R1，电阻R2，第一射频接头和第二射频接头；双向电平转换芯片的第一电源端连接电容C1的第一端和第一直流电压源VCC1，电容C1的第二端接地，双向电平转换芯片的第二电源端连接电容C2的第一端和第二直流电压源VCC2，电容C2的第二端接地，双向电平转换芯片的接地端接地，双向电平转换芯片的方向选择端连接电容C3的第一端和第一直流电压源VCC1，电容C3的第一端接地；双向电平转换芯片的第一输入端用于输入第一测试射频信号，双向电平转换芯片的第一输出端连接电阻R1的第一端，电阻R1的第二端连接第一射频接头；双向电平转换芯片的第二输入端用于输入第二测试射频信号，双向电平转换芯片的第二输出端连接电阻R2的第一端，电阻R2的第二端连接第二射频头；直流电压源VCC1的供电电压为3.3V，直流电压源VCC2的供电电压为5V。所述输出电路结构中，双向电平转换芯片用于同步提升从FPGA芯片输出的两路脉冲信号：TO同步脉冲信号和TX回波脉冲信号，电容C1用于滤除第一电源端的杂散信号，电容C2用于滤除第二电源端的杂散信号，电容C3用于滤除方向选择端的杂散信号，方向旋转端用于控制电平转换方向，在本实施例中，方向旋转端连接高电平，实现所述两路脉冲信号电平从3.3V向5V转换，电阻R1和电阻R2用于限制电流。作为优化的，在本实施例中，所述电容C1的容值为0.1微法，电容C2的容值为0.1微法，电容C3的容值为0.1微法，电阻R1的阻值为10K欧姆，电阻R2de阻值为10K欧姆。
具体的，所述双向转换芯片为SN74LVC2T45，第一电源端为VCCA端，第二电源端为VCCB端，第一输入端为A1端，第二输入端为A2端，第一输出端为B1端，第二输出端为B2端，接地端为GND端，方向选择端为DIR端。
具体的，所述第一射频接头为SMA接头，SMB接头或N型接头中的任一一种。所述第二射频接头为SMA接头，SMB接头或N型接头中的任一一种。所述第一射频接头和第二射频接头连接示波器或其它外部仪器，实现所述两路脉冲信号的无耗输出。作为优化的，本实施例中，所述第一射频接头和第二射频接头均为SMA接头。
本实施例提供的延迟信号发生器的输出电平转换电路，通过双向电平转换芯片将从FPGA芯片输出的TO同步脉冲信号和TX回波脉冲信号同步从3.3V提升至5V，同时为两路脉冲信号配置用于连接示波器的射频接头，示波器的测试端可直接连接所述射频接头，实现对接测试，方便实用。
如上所述，可较好的实现本发明。对于本领域的技术人员而言，根据本发明的教导，设计出不同形式的延迟信号发生器的输出电平转换电路并不需要创造性的劳动。在不脱离本发明的原理和精神的情况下对这些实施例进行变化、修改、替换、整合和变型仍落入本发明的保护范围内。
Claims (4)
1.一种延迟信号发生器的输出电平转换电路，其特征在于，包括：双向电平转换芯片，电容C1，电容C2，电容C3，电阻R1，电阻R2，第一射频接头和第二射频接头；
双向电平转换芯片的第一电源端连接电容C1的第一端和第一直流电压源VCC1，电容C1的第二端接地，双向电平转换芯片的第二电源端连接电容C2的第一端和第二直流电压源VCC2，电容C2的第二端接地，双向电平转换芯片的接地端接地，双向电平转换芯片的方向选择端连接电容C3的第一端和第一直流电压源VCC1，电容C3的第一端接地；
双向电平转换芯片的第一输入端用于输入第一测试射频信号，双向电平转换芯片的第一输出端连接电阻R1的第一端，电阻R1的第二端连接第一射频接头；
双向电平转换芯片的第二输入端用于输入第二测试射频信号，双向电平转换芯片的第二输出端连接电阻R2的第一端，电阻R2的第二端连接第二射频头；
直流电压源VCC1的供电电压为3.3V，直流电压源VCC2的供电电压为5V。
2.如权利要求1所述的延迟信号发生器的输出电平转换电路，其特征在于：
所述双向转换芯片为SN74LVC2T45，第一电源端为VCCA端，第二电源端为VCCB端，第一输入端为A1端，第二输入端为A2端，第一输出端为B1端，第二输出端为B2端，接地端为GND端，方向选择端为DIR端。
3.如权利要求1所述的延迟信号发生器的输出电平转换电路，其特征在于：
所述第一射频接头为SMA接头，SMB接头或N型接头中的任一一种。
4.如权利要求1所述的延迟信号发生器的输出电平转换电路，其特征在于：
所述第二射频接头为SMA接头，SMB接头或N型接头中的任一一种。
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