CN1017862B - 综合数字调制器 - Google Patents
综合数字调制器Info
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Abstract
本发明公开了一种综合数字调制器，它主要由单片计算机、累加器、正弦表输出器、控制器等部件组成，能适合应用于各种场合、各种信道和不同时间的调制，能选择最佳调制参数，而且各种调制参数可任意选择，因此通用性强、变化灵活、抗干扰性强、保密性好、可靠性高、体积小、重量轻、自动化程度高，是一种替代现行模拟调制器的具有多功能、多用途的理想综合数字调制器，有极大的推广应用价值。
Description
本发明涉及了一种改进了的无线电遥控、遥测和通信等工程设备中信号传输的综合数字调制器。
目前在KOJIO WATANABE，KENJI INOUE AND YOICHISATOA 4800Bit/S Microprocessor Data Modem IEEE TRANSACT ION ON COMMUNICATIONS，VOL，COM-26，NO.5 MAY 1978 P 493-498之中公开了一种数据调制解调器，这种数据调制解调器它只能完成单一功能的8DPSK调制方式，只有一种码速率，码速不能任意改变，同时也只有一个付载波频率，其缺点使用不灵活，很不方便，对于不同的无线电工程设备信道，都要有专门配套的调制器，即使在同一频道下，要想改变一下付载波频率或码速率也是非常困难，显然对需要最佳选择的信道参数，需要经常改变调制制式及改变各种调制参数的场合也是很不方便。
本发明的目的在于避免上述现有技术的不足之处而提供一种综合数字调制器，它能够根据不同要求的无线电工程设备使用场合，不同的信道和不同的时间等来选择最佳的调制制式、最佳的付载波频率、最佳码的码速率和码长等调制参数，并且能使各种调制参数任意选择，从而能灵活、方便地获得最佳的通信质量。
本发明目的是以下述方式完成的，它由输入输出接口装置（1）、
单片计算机（2）、程序存储器（3）、累加器（4）、正弦表输出器（5）、数字模拟转换器（6）、低通滤波器（7）、输出放大器（8）、控制器（9）组成。其中累加器（4）由频率锁存器（10）、全加器（11）、三态门（12），初相锁存器（13）、D触发器（14）构成，单片计算机（2）的出端（1）总线与频率锁存器（10）入端总线连接，频率锁存器（10）出端总线通过全加器（11）与三态门（12）入端总线串接，三态门（12）出端总线与初相锁存器（13）出端总线并接后与D触发器（14）入端总线连接，D触发器（14）出端总线与全加器（11）另一入端总线和正弦表输出器（5）入端总线连接。正弦表输出器（5）由正弦表高字节存储器（15）、正弦表低字节存储器（16）、数据取样输出锁存器（17）构成，由累加器（4）的D触发器（14）出端总线与正弦表高字节、低字节存储器（15）（16）并接，正弦表高字节、低字节存储器（15）（16）的各出端总线与数据取样输出锁存器（17）入端总线连接，数据取样输出锁存器（17）的出端总线与数字模拟转换器（6）入端总线连接。控制器（9）由计数译码器（18）、时序产生器（19）构成，单片计算机（2）的控制出端（2）总线与计数译码器（18）入端总线连接，计数译码器（18）出端总线与时序产生器（19）入端总线连接，时序产生器（19）出端总线分别与频率锁存器（10）、三态门（12）、初相锁存器（13）、D触发器（14）、数据取样输出锁存器（17）的控制入端总线并接。
本发明比现有技术有如下优点：本发明具有通用性强、变化灵活，能适合不同场合，不同信道和不同时间的调制，根据要求它能选择最佳的稠制参数，并且各种调制参数可任意选择。本发明采用
数字调制体制，抗干扰性强、保密性好、可靠性高、体积小、重量轻、自动化程度高，经在多项无线电工程设备上试验应用，效果良好，是一种理想的多功能、多用途综合数字调制器。
以下结合附图对本发明作进一步详细描述。
图1是本发明原理方框图。
图2是本发明累加器（4）、正弦表输出器（5）、控制器（9）的接线原理图。
参照图1、图2，本发明由输入输出接口装置（1）、单片计算机（2）、程序存储器（3）、累加器（4）、正弦表输出器（5）、数字模拟转换器（6）、低通滤波器（7）、输出放大器（8）、控制器（9）组成。把需要调制的输入调制参数和调制信号（20）通过输入总线经输入输出接口装置（1）输入至单片计算机（2），输入输出接口装置（1）作用完成对外来初始化数据和所要传输的数据与单片计算机进行接口传输，实施例它采用市售8255型集成电路组成并行接口，采用市售8251型集成电路组成串行接口，并可分别独立地工作。单片计算机（2）作用是完成对各种输入数据的读写启动、控制、定时和编程，实施例它采用8098型单片微电子计算机。程序存储器（3）的输入输出总线与单片计算机（2）连接，其作用是提供单片计算机（2）的工作应用软件指令，实施例它采用2764型EPROM可擦除存储器制作成。单片计算机（2）的出端（1）总线与累加器（4）的频率锁存器（10）入端总线连接，其中累加器（4）由频率锁存器（10）、全加器（11）、三态门（12）、初相锁存器（13）、D触发器（14）构成，频率锁存器（10）出端总线通
过全加器（11）与三态门（12）入端总线串接，三态门（12）出端总线与初相锁存器（13）出端总线并接后与D触发器（14）入端总线连接，D触发器（14）出端总线与全加器（11）另一入端总线和正弦表输出器（5）入端总线连接。累加器6其作用完成对输入调制参数、调制信号的取样和累加等处理产生所需要的数字调制信号，实施例累加器（4）中的频率锁存器（10）采用2片74LS373型集成块制作而成，全加器（11）采用4片74LS283型集成块制作而成，三态门（12）采用2片74LS373集成块制作而成，初相锁存器（13）采用2片74LS373型集成块制作而成，D触发器（14）采用2片74LS2273型集成块制作而成。
正弦表输出器（5）由正弦表高字节存储器（15）、正弦表低字节存储器（16）、数据取样输出锁存器（17）构成，由累加器（4）和D触发器（14）出端总线与正弦表高字节、低字节存储器（15）（16）入端总线并接，正弦表高字节、低字节存储器（15）（16）各出端总线与数据取样输出锁存器（17）入端总线连接，数据取样输出锁存器（17）的出端总线与数字模拟转换器（6）入端总线连接，正弦表输出器（5）其作用完成对一系列正弦波的样点值的计算，并按取样频率逐个输出样点值，实施例正弦表高字节存储器（15）采用市售27256型集成块制作而成，正弦表低字节存储器（16）也采用市售27256型集成块制作，数据取样输出锁存器（17）采用2片74LS273型集成块制作而成。
控制器（9）由计数译码器（18）、时序产生器（19）构成，单片计算机（2）的控制出端（2）总线通过计数译码器（18）与时序产生器（19）入端总线连接，时序产生器（19）出端总线分别与频率锁存器（10）、三
态门（12）、初相锁存器（13）、D触发器（14），数据取样输出锁存器（17）的控制入端总线并接。控制器（9）其作用完成对各种调制参数的变换控制。实施例计数译码器（18）采用市售2片74LS74型集成块制作而成，时序产生器（19）采用4片74LS20型集成块制作而成。
数字模拟转换器（6）通过低通滤波器（7）、输出放大器（8）串接后输出所需要的调制信号，数字模拟转换器（6）其作用是把输出的各数字调制信号转换为模拟调制信号，低通滤波器（7）起平滑滤波输出模拟信号，经输出放大器（8）放大后输出所需要的调制信号（21），实施例数字模拟转换器（6）采用市售DAC1222型D/A数字模拟转换器装配而成，低通滤波器（7）、输出放大器（8）均自行设计采用通用电路制作而成。
本发明简要工作原理如下：把需要调制的调制参数及调制信号（20）通过输入输出接口装置（1）输入至单片计算机（2），单片计算机（2）由程序存储器（3）提供的应用软件指令进行操作，并向累加器（4）输入不同的调制参数，累加器（4）按输入的调制参数调制变换输出等间隔的对应于调制参数下的地址值和相位值，然后输入正弦表输出器（5），正弦表输出器（5）把输入的地址值和相位值调制变换输出对应下的正弦值，通过数字模拟转换器（6）转换成对应的模拟值再通过低通泸波器（7）平滑后输出模拟信号，经输出放大器（8）放大后输出所需要的调制信号（21）。
当需要改变调制参数时，只要重新置入所需要的各种调制参数及调制信号（20），就能很方便地、灵活地立即获得与新输入调制参
数及调制信号（21）相一致的新输出调制信号（21），达到调制参数、调制制式、付载波频率、码速率、码长，重发次数等任意选择的目的。本发明实施例可完成JASK、PSK、DPSK、MFSK等多种制式的调制，付载波频率可在20Hz至150KHz范围内在低端每10Hz，或在高端每20Hz可变，码速率可在1至8000b/s范围内每比特可变，码长可在1Kb/s内任意可变，重发次数可在255以内任意可变，因而本发明可广泛应用于遥控、遥测、通信等领域作调制器，大大提高无线电工程设备信道的传输信号质量。
Claims (4)
1、一种由输入输出接口装置(1)、单片计算机(2)、程序存储器(3)、数字模拟转换器(6)、低通滤波器(7)、输出放大器(8)组成的综合数字调制器，其特征在于还有累加器(4)、正弦表输出器(5)、控制器(9)组成，其中把需要调制的输入调制参数和调制信号(20)通过输入总线与输入输出接口装置(1)入端连接，输入输出接口装置(1)出端总线与单片计算机(2)入端总线连接，单片计算机(2)的出端(1)总线并通过各级的总线串联连接累加器(4)、正弦表输出器(5)、数字模拟转换器(6)、低通滤波器(7)、输出放大器(8)，输出放大器(8)出端输出所需要的调制信号(21)，单片计算机(2)的出端(2)总线与控制器(9)入端总线连接，控制器(9)的出端总线分别并联连接累加器(4)、正弦表输出器(5)各入端总线连接，单片计算机(2)输入输出总线与程序存储器(3)输入输出总线连接。
2、根据权利要求1所述的综合数字调制器，其特征在于累加器（4）由频率锁存器（10）、全加器（11）、三态门（12）、初相锁存器（13）、D触发器（14）构成，单片计算机（2）的出端（1）总线与频率锁存器（10）入端总线连接，频率锁存器（10）出端总线通过全加器（11）与三态门（12）入端总线串接，三态门（12）出端总线与初相锁存器（13）出端总线并接后与D触发器（14）入端总线连接，D触发器（14）出端总线与全加器（11）另一入端总线和正弦表输出器（5）入端总线连接。
3、根据权利要求1或2所述的综合数字调制器，其特征在于正弦表输出器（5）由正弦表高字节存储器（15）、正弦表低字节存储器（16）、数据取样输出锁存器（17）构成，由累加器（4）的D触发器（14）出端总线与正弦表高字节、低字节存储器（15）、（16）并接，正弦表高字节、低字节存储器（15）、（16）的各出端总线与数据取样输出锁存器（17）入端总线连接，数据取样输出锁存器（17）的出端总线与数字模拟转换器（6）入端总线连接。
4、根据权利要求1或3所述的综合数字调制器，其特征在于控制器（9）由计数译码器（18）、时序产生器（19）构成，单片计算机（2）的控制出端（2）总线与计数译码器（18）入端总线连接，计数译码器（18）出端总线与时序产生器（19）入端总线连接，时序产生器（19）出端总线分别与频率锁存器（10）、三态门（12）、初相锁存器（13）、D触发器（14）、数据取样输出锁存器（17）的控制入端总线并接。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN 90104782 CN1017862B (zh) | 1990-07-18 | 1990-07-18 | 综合数字调制器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN 90104782 CN1017862B (zh) | 1990-07-18 | 1990-07-18 | 综合数字调制器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| CN1048639A CN1048639A (zh) | 1991-01-16 |
| CN1017862B true CN1017862B (zh) | 1992-08-12 |
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ID=4878737
Family Applications (1)
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| CN 90104782 Expired CN1017862B (zh) | 1990-07-18 | 1990-07-18 | 综合数字调制器 |
Country Status (1)
| Country | Link |
|---|---|
| CN (1) | CN1017862B (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100466467C (zh) * | 2004-12-02 | 2009-03-04 | 上海交通大学 | 具有自动增益控制功能的音量自动限幅装置 |
-
1990
- 1990-07-18 CN CN 90104782 patent/CN1017862B/zh not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100466467C (zh) * | 2004-12-02 | 2009-03-04 | 上海交通大学 | 具有自动增益控制功能的音量自动限幅装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| CN1048639A (zh) | 1991-01-16 |
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