CH457554A - Anordnung mit mehreren hintereinandergeschalteten logischen Schalteinheiten - Google Patents

Anordnung mit mehreren hintereinandergeschalteten logischen Schalteinheiten

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CH457554A
CH457554A CH171462A CH171462A CH457554A CH 457554 A CH457554 A CH 457554A CH 171462 A CH171462 A CH 171462A CH 171462 A CH171462 A CH 171462A CH 457554 A CH457554 A CH 457554A
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CH
Switzerland
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series
arrangement
switching units
units connected
logical switching
Prior art date
Application number
CH171462A
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English (en)
Inventor
Paul Bigo Ernest Henri
Pleshko Peter
Original Assignee
Standard Telephon & Radio Ag
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
    • H03K19/08—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices
    • H03K19/10—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices using tunnel diodes

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US3421029A (en) * 1965-12-17 1969-01-07 Bell Telephone Labor Inc Bistable circuit employing negative resistance semiconductor diodes

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Publication number Publication date
DE1161582B (de) 1964-01-23
US3124704A (en) 1964-03-10
GB981720A (en) 1965-01-27

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