JPS6364099B2 - - Google Patents

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JPS6364099B2
JPS6364099B2 JP57212251A JP21225182A JPS6364099B2 JP S6364099 B2 JPS6364099 B2 JP S6364099B2 JP 57212251 A JP57212251 A JP 57212251A JP 21225182 A JP21225182 A JP 21225182A JP S6364099 B2 JPS6364099 B2 JP S6364099B2
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JP
Japan
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circuit
data
output
gate
signal
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JP57212251A
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Japanese (ja)
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JPS59103434A (en
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    • GPHYSICS
    • G08SIGNALLING
    • G08BSIGNALLING OR CALLING SYSTEMS; ORDER TELEGRAPHS; ALARM SYSTEMS
    • G08B3/00Audible signalling systems; Audible personal calling systems
    • G08B3/10Audible signalling systems; Audible personal calling systems using electric transmission; using electromagnetic transmission
    • G08B3/1008Personal calling arrangements or devices, i.e. paging systems
    • G08B3/1016Personal calling arrangements or devices, i.e. paging systems using wireless transmission

Description

【発明の詳細な説明】 本発明は、呼出し信号と必要なメツセージ信号
とにより選択的に呼出しをする方式に使用する受
信機に関し、特に送信側より送出されてくるデー
タ情報を告知すると共に、必要に応じて外部装置
に対して再び出力する機能を備えた受信機に関す
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a receiver used in a method of selectively calling using a calling signal and a necessary message signal, and in particular, it notifies data information sent from a transmitting side, and The present invention relates to a receiver having a function of re-outputting the output to an external device according to the request.

従来、送信側より送られてくる信号により選択
的に呼出し受信する方式の受信機においては受信
された信号を表示装置のCRTスクリーン上に表
示するか、あるいは音声信号としてラウドスピー
カやイヤホーンなどから出力するにとどまつてい
た。従つて、受信機がデータ信号を受信するもの
である場合には、受信されたデータ信号をいつた
ん表示装置上に表示するか、あるいは音声信号と
してラウドスピーカまたはイヤホーンから取出し
た後、人手を介して他の外部装置に加えなければ
ならなかつた。そのため、人件費の増大、あるい
はわずらわしさを招くとともに、人手を介してデ
ータを取扱うことによる誤りが無視できないと云
う欠点があつた。
Conventionally, in receivers that selectively call and receive signals sent from the transmitting side, the received signals are displayed on a CRT screen of a display device, or output as audio signals from loudspeakers, earphones, etc. It was all I could do. Therefore, if the receiver is to receive a data signal, the received data signal must be displayed on a display device or manually after being extracted from a loudspeaker or earphone as an audio signal. had to be added to other external devices. This results in an increase in labor costs and inconvenience, and also has the disadvantage that errors caused by manual data handling cannot be ignored.

本発明は上記従来方式における欠点を除去する
ため、送信側から送られてくるデータ信号を選択
して受信し、受信された信号のデータ情報を表示
信号、および(または)音声信号として取出すと
共に、外部装置に対してデータ情報を出力するこ
とができる機能を具備した受信機を提供すること
が目的である。
In order to eliminate the drawbacks of the conventional method, the present invention selectively receives data signals sent from the transmitting side, extracts data information of the received signals as display signals and/or audio signals, and It is an object of the present invention to provide a receiver equipped with a function capable of outputting data information to an external device.

本発明による選択呼出し受信機は受信回路と、
受信信号復元回路と、呼出し信号検出回路と、第
1〜第5のANDゲートと、ORゲートと、受信デ
ータデコード回路と、データ記憶回路と、制御回
路と、内部データ出力回路と、外部出力インター
フエース回路と、フアンクシヨンスイツチと、モ
ード切換えスイツチとを具備したものである。
A selective calling receiver according to the present invention includes a receiving circuit;
A received signal restoration circuit, a calling signal detection circuit, first to fifth AND gates, an OR gate, a received data decoding circuit, a data storage circuit, a control circuit, an internal data output circuit, and an external output interface. It is equipped with an ace circuit, a function switch, and a mode changeover switch.

受信回路は送信側から送られてくる信号を受信
するための回路であり、受信信号復元回路は受信
回路の出力をもとにしてデータ信号を復元する回
路である。呼出し信号検出回路は受信信号復元回
路からのデータ信号をもとに、データ信号内に自
己の呼出し符号が存在するか否かをチエツクする
回路である。第1のANDゲートは自己の呼出し
符号が検出された時に限つて開くゲートである。
受信データデコード回路は第1のANDゲートに
より選択されたデータ信号をシステムデータフオ
ーマツトに変換して、データ記憶装置と第2の
ANDゲートに送出するものである。データ記憶
回路は受信データデコード回路から送られてきた
データを格納しておくための回路であり、第2の
ANDゲートは受信データデコード回路から送ら
れてきたデータを即刻、後段の内部データ出力回
路と外部出力インターフエース回路とに送出する
ためのゲートである。第3のANDゲートは、い
つたんデータ記憶回路に格納されたデータを後段
の内部データ出力回路と外部出力インターフエー
ス回路とに送出するためのゲートである。ORゲ
ートは第2、および第3のANDゲートの出力を
混合するためのゲートである。制御回路は上記選
択、出力、送出などの動作のタイミングを決定す
るための回路である。第4のANDゲートはデー
タの表示出力と音声出力とを選択し、これを内部
データ出力回路に送出するためのゲートである。
内部データ出力回路は表示出力、ならびに(ある
いは)音声出力を行うための回路である。第5の
ANDゲートはデータの外部装置への送出を選択
して、外部出力インターフエース回路に与えるた
めのゲートである。外部出力インターフエース回
路は第5のANDゲートより送出されてきた内部
データを外部装置に適したシリアルデータ、また
はパラレルデータにフオーマツト変換し、外部装
置へ送出するための回路である。フアンクシヨン
スイツチは呼出し時の警報音をリセツトすると共
に、スタンドバイ状態ではデータ信号の読出しを
制御するためのスイツチである。モード切換えス
イツチは内部データ出力回路と外部出力インター
フエース回路とのうちの一方、あるいは両方をイ
ネーブルすためのスイツチである。
The receiving circuit is a circuit for receiving a signal sent from the transmitting side, and the received signal restoration circuit is a circuit for restoring a data signal based on the output of the receiving circuit. The paging signal detection circuit is a circuit that checks whether or not its own paging code is present in the data signal based on the data signal from the received signal restoration circuit. The first AND gate is a gate that opens only when its own call code is detected.
The receive data decoding circuit converts the data signal selected by the first AND gate into a system data format and outputs the data signal to the data storage device and the second
This is what is sent to the AND gate. The data storage circuit is a circuit for storing data sent from the reception data decoding circuit, and is a circuit for storing data sent from the reception data decoding circuit.
The AND gate is a gate for immediately sending the data sent from the received data decoding circuit to the subsequent internal data output circuit and external output interface circuit. The third AND gate is a gate for sending the data stored in the data storage circuit to the subsequent internal data output circuit and external output interface circuit. The OR gate is a gate for mixing the outputs of the second and third AND gates. The control circuit is a circuit for determining the timing of operations such as selection, output, and sending. The fourth AND gate is a gate for selecting data display output and audio output, and sending the selected data to the internal data output circuit.
The internal data output circuit is a circuit for performing display output and/or audio output. fifth
The AND gate is a gate for selecting data to be sent to an external device and providing it to the external output interface circuit. The external output interface circuit is a circuit for converting the internal data sent from the fifth AND gate into serial data or parallel data suitable for an external device, and sending the converted data to the external device. The function switch is a switch that resets the alarm sound when a call is made, and also controls the reading of data signals in the standby state. The mode changeover switch is a switch for enabling one or both of the internal data output circuit and the external output interface circuit.

次に、本発明について図面を参照して詳細に説
明する。第1図は本発明による選択呼出し受信機
のブロツク構成を示す図である。第1図におい
て、選択呼出し受信機は受信回路1と、受信信号
復元回路2と、呼出し信号検出回路3と、第1〜
第5のANDゲート4,7,8,11,13と、
ORゲート9と、受信データデコード回路5と、
データ記憶回路6と、制御回路10と、内部デー
タ出力回路12と、外部出力インターフエース回
路14と、フアンクシヨンスイツチ16と、モー
ド切換えスイツチ17とを具備したものである。
Next, the present invention will be explained in detail with reference to the drawings. FIG. 1 is a diagram showing the block configuration of a selective calling receiver according to the present invention. In FIG. 1, the selective calling receiver includes a receiving circuit 1, a received signal restoring circuit 2, a calling signal detecting circuit 3, and first to
fifth AND gates 4, 7, 8, 11, 13;
OR gate 9, received data decoding circuit 5,
It comprises a data storage circuit 6, a control circuit 10, an internal data output circuit 12, an external output interface circuit 14, a function switch 16, and a mode changeover switch 17.

受信回路1により受信された信号は受信信号復
元回路2により復元され、信号線101上に送出
されて受信データ信号になる。受信データは呼出
し信号検出回路3に送出され、受信された信号内
に自己の呼出し符号が存在するか否かがここでチ
エツクされる。自己の呼出し符号が信号検出回路
3により検出されると、呼出し信号検出回路3は
信号線109を介して呼出し検出信号を制御回路
10に送出し、データ情報の受入れるための初期
設定が制御回路10により行われる。制御回路1
0は信号線102上に受信データ・ゲート制御信
号を送出し、この信号によつて第1のANDゲー
ト4が開く。第1のANDゲート4が開くと、信
号線101上のデータ信号は受信データ・デコー
ド回路5に送出される。データ信号は受信データ
デコード回路5により、制御回路10から信号線
110を介して送出されてくる受信データ・デコ
ード制御信号の制御のもとで、システム・デー
タ・フオーマツトに変換され、データ信号として
データ記憶回路6と第2のANDゲート7とに送
出される。データ記憶回路6に送出されたデータ
信号は信号線103を介してデータ記憶回路6に
送出され、信号線109上に存在するデータ記憶
回路制御信号の制御のもとでデータ記憶回路6に
格納される。信号線103を介して第2のAND
ゲート7に送出されたデータ信号は、信号線11
1を介して第1のANDゲート7に加えられた受
信記憶データ・ゲート制御信号の制御のもとで、
第2のANDゲート7を通過してORゲート9に加
えられる。ORゲート9を通つたデータ信号は第
4および第5のANDゲート11,13に送出さ
れる。いつぽう、第3のANDゲート8はいつた
んデータ記憶回路6に格納されたデータを上記と
同様にして送出するためのゲートである。信号線
111を介して加えられた受信記憶データ・ゲー
ト制御信号の制御のもとで、上記データ信号は第
3のANDゲート8を通つてORゲート9に加えら
れる。ORゲート9はこれらのANDゲートの出力
を混合するためのゲートである。ORゲート9の
出力は第4および第5のゲート11,13に加え
られているが、これらのゲートはモード切換えス
イツチ17の設定に従つて制御回路10により制
御される。すなわち、モード切換えスイツチ17
を1の位置にセツトすると、表示出力と音声出力
とを同時に与える機能がセツトされ、信号線10
7を介して内部出力制御信号が第4のANDゲー
ト11に送出される。次に、モード切換えスイツ
チ17を3の位置にセツトすると外部出力機能が
設定され、信号線108を介して外部出力制御信
号により第5のANDゲート13が開く、さらに、
第4および第5のANDゲート11,13を開き、
内部出力と外部出力との両機能をイネーブルする
ためにはモード切換えスイツチ17を2の位置に
セツトする。第4のANDゲート11が開いてい
る場合には、データ信号が信号線106を介して
第4のANDゲート11と内部データ出力回路1
2とに加えられ、内部データ出力回路12により
表示出力、および(あるいは)音声出力が与えら
れる。いつぽう、第5のANDゲート13が開い
ている場合には、データ信号が信号線106を介
して第5のANDゲート13と外部出力インター
フエース回路14とに加えられ、外部インターフ
エース回路14によりデータ信号はシリアルデー
タ、またはパラレルデータに変換され、外部出力
データとして外部出力端子15から外部装置へ送
出される。フアンクシヨンスイツチ16は呼出し
時の警報音のリセツト、ならびにデータ信号の制
御を行うためのもので、スタンドバイ時には、記
憶されたデータを読出すことができる。すなわ
ち、記憶されているデータをデータ記憶回路6か
ら送出するためには、制御回路10から信号線1
11を介して第3のANDゲート8を開かせてい
る。
The signal received by the reception circuit 1 is restored by the reception signal restoration circuit 2, and sent onto the signal line 101 to become a reception data signal. The received data is sent to the paging signal detection circuit 3, where it is checked whether or not the own paging code is present in the received signal. When the own call code is detected by the signal detection circuit 3, the call signal detection circuit 3 sends a call detection signal to the control circuit 10 via the signal line 109, and the control circuit 10 is initialized to accept data information. This is done by Control circuit 1
0 sends a receive data gate control signal on signal line 102, which causes the first AND gate 4 to open. When the first AND gate 4 opens, the data signal on the signal line 101 is sent to the receive data decoding circuit 5. The data signal is converted into a system data format by the reception data decoding circuit 5 under the control of the reception data decoding control signal sent from the control circuit 10 via the signal line 110, and the data is converted into a system data format as a data signal. The signal is sent to the memory circuit 6 and the second AND gate 7. The data signal sent to the data storage circuit 6 is sent to the data storage circuit 6 via the signal line 103 and stored in the data storage circuit 6 under the control of the data storage circuit control signal present on the signal line 109. Ru. The second AND via signal line 103
The data signal sent to the gate 7 is sent to the signal line 11.
Under the control of the receive storage data gate control signal applied to the first AND gate 7 via 1,
It passes through a second AND gate 7 and is applied to an OR gate 9. The data signal passing through OR gate 9 is sent to fourth and fifth AND gates 11 and 13. The third AND gate 8 is a gate for transmitting the data stored in the data storage circuit 6 in the same manner as described above. Under the control of a receive storage data gate control signal applied via signal line 111, said data signal is applied to OR gate 9 through a third AND gate 8. OR gate 9 is a gate for mixing the outputs of these AND gates. The output of OR gate 9 is applied to fourth and fifth gates 11 and 13, which are controlled by control circuit 10 according to the setting of mode changeover switch 17. That is, the mode changeover switch 17
When set to the 1 position, the function of providing display output and audio output simultaneously is set, and the signal line 10
An internal output control signal is sent to the fourth AND gate 11 via 7. Next, when the mode changeover switch 17 is set to position 3, the external output function is set, and the fifth AND gate 13 is opened by the external output control signal via the signal line 108.
Open the fourth and fifth AND gates 11 and 13,
To enable both internal output and external output functions, mode selector switch 17 is set to position 2. When the fourth AND gate 11 is open, the data signal is passed through the signal line 106 to the fourth AND gate 11 and the internal data output circuit 1.
2, and an internal data output circuit 12 provides a display output and/or an audio output. On the other hand, when the fifth AND gate 13 is open, the data signal is applied to the fifth AND gate 13 and the external output interface circuit 14 via the signal line 106, and is output by the external interface circuit 14. The data signal is converted into serial data or parallel data and sent as external output data from the external output terminal 15 to an external device. The function switch 16 is used to reset the alarm sound when calling and to control data signals, and can read out stored data during standby. That is, in order to send out the stored data from the data storage circuit 6, the signal line 1 is connected from the control circuit 10.
11 to open the third AND gate 8.

本発明においては選択的に受信したデータを表
示出力したり音声出力したりするほか、データを
いつたん記憶することができると共に、外部装置
に対して出力することができる機能を有するの
で、これにより他の装置に対して印字出力等の制
御を行うことができ、さらに処理情報をデータ端
末等に対しても与えることができるため、任意の
時間に必要に応じて表示出力、および(あるい
は)音声出力を与える従来の動作に加え、制御デ
ータを含むデータ信号を外部装置に与えることも
きわめて廉価に、しかも短時間のうちに簡易にで
きると云う効果があり、低廉化と省力化とにきわ
めて有効である。
In the present invention, in addition to selectively displaying and outputting received data, it also has functions that can temporarily store data and output it to an external device. It is possible to control print output, etc. for other devices, and it is also possible to provide processing information to data terminals, etc., so it is possible to output display and/or audio as needed at any time. In addition to the conventional operation of providing output, it also has the effect of providing data signals including control data to external devices at an extremely low cost and in a short time, making it extremely effective in reducing costs and saving labor. It is.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明により構成した選択呼出し受信
機の一実施例のブロツク構成を示す図である。 1……受信回路、2……受信信号復元回路、3
……呼出し信号検出回路、4,7,8,11,1
3……ANDゲート、9……ORゲート、5……受
信データデコード回路、6……データ記憶回路、
10……制御回路、12……内部データ出力回
路、14……外部出力インターフエース回路、1
5……外部出力端子、16……フアンクシヨンス
イツチ、17……モード切換えスイツチ、101
〜111……信号線。
FIG. 1 is a diagram showing a block configuration of an embodiment of a selective call receiver constructed according to the present invention. 1... Receiving circuit, 2... Received signal restoration circuit, 3
...Call signal detection circuit, 4, 7, 8, 11, 1
3...AND gate, 9...OR gate, 5...Reception data decoding circuit, 6...Data storage circuit,
10...Control circuit, 12...Internal data output circuit, 14...External output interface circuit, 1
5... External output terminal, 16... Function switch, 17... Mode changeover switch, 101
~111...Signal line.

Claims (1)

【特許請求の範囲】[Claims] 1 送信側から送られてくる信号を受信するため
の受信回路と、前記受信回路の出力をもとにして
データ信号を復元するための受信信号復元回路
と、前記受信信号復元回路からのデータ信号をも
とにして前記データ信号の内部に自己の呼出し符
号が存在するか否かをチエツクするための呼出し
信号検出回路と、前記自己の呼出し符号が検出さ
れた場合に限つて前記受信信号復元回路の出力を
選択して通過させるための第1のANDゲートと、
前記第1のANDゲートにより選択された前記出
力をシステムデータフオーマツトに従つて変換す
るための受信データデコード回路と、前記データ
デコード回路からの出力データを一時的に格納し
ておくためのデータ記憶回路と、前記データデコ
ード回路からの出力データを即刻、後段の回路に
送出するための第2のANDゲートと、前記デー
タ記憶回路にいつたん記憶されたデータを後段の
回路に送出するための第3のANDゲートと、前
記第2および第3のANDゲートの出力を混合す
るためのORゲートと、前記選択と、出力と、送
出との動作タイミングを決定するための制御回路
と、前記ORゲートの出力を選択して表示出力、
および(あるいは)音声出力をするための第4の
ANDゲートと、前記第4のANDゲートからの出
力により表示出力、および(あるいは)音声出力
を与えるための内部データ出力回路と、前記OR
ゲートの出力を選択して外部装置に出力するため
の第5のANDゲートと、前記第5のANDゲート
からの出力により前記外部装置に適したシリアル
データ、またはパラレルデータに変換して送出す
るための外部出力インターフエース回路と、呼出
し警報音をリセツトすると共にスタンドバイ状態
ではデータ信号の読出しを制御するためのフアン
クシヨンスイツチと、前記内部データ出力回路と
前記外部出力インターフエース回路とのうちの一
方、あるいは両方をイネーブルするためのモード
切換えスイツチとを具備したことを特徴とする選
択呼出し受信機。
1. A receiving circuit for receiving a signal sent from the transmitting side, a receiving signal restoring circuit for restoring a data signal based on the output of the receiving circuit, and a data signal from the receiving signal restoring circuit. a calling signal detection circuit for checking whether or not the own calling code exists in the data signal based on the data signal; and the received signal restoration circuit only when the own calling code is detected. a first AND gate for selecting and passing the output of;
a received data decoding circuit for converting the output selected by the first AND gate according to a system data format; and a data storage for temporarily storing output data from the data decoding circuit. a second AND gate for immediately sending the output data from the data decoding circuit to the subsequent circuit, and a second AND gate for sending the data temporarily stored in the data storage circuit to the subsequent circuit. 3 AND gate, an OR gate for mixing the outputs of the second and third AND gates, a control circuit for determining the operation timing of the selection, output, and sending, and the OR gate. Select the output and display the output,
and/or a fourth for audio output.
an AND gate, an internal data output circuit for providing display output and/or audio output by the output from the fourth AND gate, and the OR
a fifth AND gate for selecting the output of the gate and outputting it to an external device; and converting the output from the fifth AND gate into serial data or parallel data suitable for the external device and sending it out. an external output interface circuit of the internal data output circuit and an external output interface circuit of the internal data output circuit and the external output interface circuit; 1. A selective call receiver comprising a mode changeover switch for enabling one or both.
JP57212251A 1982-12-03 1982-12-03 Selective calling receiver Granted JPS59103434A (en)

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