JPS62290225A - Scramble/descramble system for narrow band transmission system - Google Patents

Scramble/descramble system for narrow band transmission system

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Publication number
JPS62290225A
JPS62290225A JP61134375A JP13437586A JPS62290225A JP S62290225 A JPS62290225 A JP S62290225A JP 61134375 A JP61134375 A JP 61134375A JP 13437586 A JP13437586 A JP 13437586A JP S62290225 A JPS62290225 A JP S62290225A
Authority
JP
Japan
Prior art keywords
signal
clock
scramble
waveform
switch means
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP61134375A
Other languages
Japanese (ja)
Inventor
Masashi Shimakata
島方 正志
Megumi Iwao
恵 岩男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Pioneer Communications Corp
Original Assignee
Pioneer Ansafone Manufacturing Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Pioneer Ansafone Manufacturing Corp filed Critical Pioneer Ansafone Manufacturing Corp
Priority to JP61134375A priority Critical patent/JPS62290225A/en
Publication of JPS62290225A publication Critical patent/JPS62290225A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To improve a scramble effect and to cut down costs by sampling a transmission signal and its inversion signal with the aid of a clock signal subjected to pattern setting and its inversion signal, scrambling them through addition and descrambling them with the aid of a clock reproduction signal under the same constitution. CONSTITUTION:For outputting a prescribed clock pulse, the transmission signal A inputted to an input terminal 1 becomes a waveform B when it passes through the 1st switch means 3 and goes to a waveform C when it passes through the 2nd switching means 5. As a result, an output signal from an adder 7 becomes a waveform D, is completely deformed, and demonstrates a scramble effect. Since a clock pattern generator 9 sets the clock signal A to a sample pulse by a pattern having a frequency with different iterations, the scramble effect is further improved. A reception side operates in the reverse way of the above- mentioned procedure, and descramble is completed. A normal signal is outputted to an output terminal 8.

Description

【発明の詳細な説明】[Detailed description of the invention]

3、発明の詳細な説明 3. Detailed description of the invention

【産業上の利用分野】[Industrial application field]

本発明は、狭帯域伝送系のスクランブル・デスクランブ
ル方式に関するものである。
The present invention relates to a scrambling/descrambling method for a narrowband transmission system.

【発明の概要1 本発明は、パターン設定されたクロック信号およびその
反転信号を用いて伝送信号およびその反転信号をサンプ
リングして、これを加算することで′スクランブルし、
同じ構成でクロック再生信号によりデスクランブルする
狭帯域伝送系のスクランブル・デスクランブル方式であ
る。 【従来の技術1 狭帯域伝送系において、伝送信号をスクランブルし、ま
た、端末においてこれをデスクランブルすることにより
、正規の端末以外での盗聴を防止するようにした方式は
幾つか知られている。とくに電話など、使用帯域幅の狭
い伝送系では、−今まで相当複雑な構成のものが使用さ
れていて、コスト高であった。 [発明が解決しようとする問題点] そこで、狭帯域伝送系にJjいて、簡単な構成により伝
送(a丹をサンプリングし、抑圧されたΔM(AIIl
plirude  MQdulation )をかける
方式が提唱されている。 本発明は、上記事情に基づいてなされたもので、充分な
スクランブル効果を発揮すると共に、構成の簡素化でコ
ストを低減できるようにした狭帯域伝送系のスクランブ
ル・デスクランブル方式を提供しようとするものである
。 【問題点を解決するための手段】 上記の目的を達成するため、本発明は、パターン設定さ
れたクロック信号で第1のスイッチ手段をオン・オフし
て伝送信号を加算器に供給すると共に、上記クロック信
号の反転信号で第2のスイッチ手段をオン・オフして伝
送信号の反転信号を上記加算器に供給することによりス
クランブルし、クロック再生回路およびパターン設定回
路を介して同じ回路構成でデスクランブルすることを特
徴とするものである。 [実 施 例] 以下、本発明方式を図面を参照して具体的に説明する。 第1図は伝送信号をスクランブルするための回路構成図
であり、図中、符号1は伝送信号入力端子、2はクロッ
クパルス発生回路、9は上記゛クロックパルス発生回路
2からの基準クロックパターン設定可能な、繰返しの異
なった周波数のサンプルパルスを発生するクロックパタ
ーンジェネレータ、3は上記ジェネレータ9からのクロ
ック信号でオン・オフする第1のスイッチ手段、4は上
記クロック信号を反転させるインバータ、5は上記反転
クロック信号でオン・オフする第2のスイッチ手段、6
は伝送信号を反転するインバータ、7は加算器、8は伝
送信号の出力端子である。 しかして、第1および第2のスイッチ手段3゜5のスイ
ッチのオン・オフは互いに反転しており、伝送信号は、
スイッチ手段3.5のいずれかを介して加算器7にもた
らされ、出力端子8へと送出される。この場合、インバ
ータ6経出では伝送信号が反転されているので、出力端
子8への出ツノは正規信号ではなく、スクランブルされ
ている。 すなわち、第2図に示すように所定のクロックパルス(
第2図(2)参照)を出力する時には、入力端子1に入
力された伝送信号A(第2図(ロ)参照)は、第1のス
イッチ手段3を経由する際に8の波形〈第2図(C)参
照)となり、また、第2のスイッチ手段5を経由する際
にはCの波形(第2図0参照)となる。このため加算器
1からの出力信号は、Dの波形(第2図(e)参照)と
なり、完全に変形され、スクランブル効果を発揮する。 とくにクロック信号Aは、クロックパターンジェネレー
タ9により、繰返しの異なった周波数のパターンでのサ
ンプルパルスに設定されているので、スクランブル効果
は一層向上する。 受信側では、上述とは逆にクロック再生回路10を経由
して伝送信号に重畳したクロック信号を分離し、これを
クロックパターンジェネレータ9で処理Iノ、その出力
パルス信号を同じ構成の第1のスイッチ手段3.第2の
スイッチ手段5へと送り、オン・オフ制御する。また、
第2のスイッチ手段5には反転用のインバータ4がある
ので、両スイッチ手段3.5は交互にオン・オフ制御さ
れる。 そして両スイッチ手段3,5を経由した信号は、加算器
1で再生される。この場合の信号の状態変化は、第4図
Q〜(e)に示す通りである。 すなわち、第3図に示ずように、クロックパターンジェ
ネレータ9で出力されたクロックパルス(第4図(2)
参照)を出力する時には、入力端子1に入力された伝送
スクランブル信号A(第4図(1))参照)は、第1の
スイッチ手段3を経由する際にBの波形(第4図(C)
 看照)となり、また、第2のスイッチ手段5を経由す
る際にはCの波形(第4図(φ参照)となる。その結果
、加算器7で加算し、バンドパスフィルタ11でクロッ
ク信号を除去すると、デスクランブルが完成し、出力端
子8には、正規信号(第4図(e)参照)が出力される
ことになる。
Summary of the Invention 1 The present invention samples a transmission signal and its inverted signal using a patterned clock signal and its inverted signal, and scrambles the signals by adding the samples.
This is a scramble/descramble method for a narrowband transmission system that uses the same configuration but uses a clock recovery signal to perform descrambling. [Prior art 1] In a narrowband transmission system, there are several known methods that scramble the transmitted signal and descramble it at the terminal to prevent eavesdropping on terminals other than the authorized one. . Particularly in transmission systems with narrow bandwidths, such as those used in telephones, devices with fairly complex configurations have been used until now, resulting in high costs. [Problems to be Solved by the Invention] Therefore, in a narrowband transmission system, a simple configuration is used to sample the transmission (a) and suppressed ΔM (AIIl).
A method has been proposed that multiplies (prirude MQduration). The present invention has been made based on the above circumstances, and aims to provide a scrambling/descrambling method for a narrowband transmission system that exhibits a sufficient scrambling effect and can reduce costs by simplifying the configuration. It is something. [Means for Solving the Problems] In order to achieve the above object, the present invention turns on and off a first switch means using a patterned clock signal to supply a transmission signal to an adder, and Scramble is performed by turning on and off the second switch means using an inverted signal of the clock signal and supplying an inverted signal of the transmission signal to the adder. It is characterized by scrambling. [Example] Hereinafter, the system of the present invention will be specifically explained with reference to the drawings. FIG. 1 is a circuit configuration diagram for scrambling a transmission signal. In the figure, reference numeral 1 is a transmission signal input terminal, 2 is a clock pulse generation circuit, and 9 is a reference clock pattern setting from the above-mentioned clock pulse generation circuit 2. 3 is a first switch means that is turned on and off by the clock signal from the generator 9; 4 is an inverter that inverts the clock signal; 5 is a clock pattern generator that generates sample pulses of different repetition frequencies; a second switch means 6 that is turned on and off by the inverted clock signal;
is an inverter for inverting the transmission signal, 7 is an adder, and 8 is an output terminal for the transmission signal. Therefore, the on/off states of the first and second switch means 3.5 are reversed, and the transmission signal is
Via one of the switch means 3.5 it is applied to the adder 7 and sent to the output terminal 8. In this case, since the transmission signal is inverted at the output from the inverter 6, the output to the output terminal 8 is not a regular signal but is a scrambled signal. That is, as shown in FIG.
2 (2))), the transmission signal A input to the input terminal 1 (see Fig. 2 (B)) passes through the first switch means 3 to output the waveform 8 (see Figure 2 (2)). 2(C)), and when passing through the second switch means 5, the waveform becomes C (see FIG. 20). Therefore, the output signal from the adder 1 has a waveform of D (see FIG. 2(e)), is completely transformed, and exhibits a scrambling effect. In particular, since the clock signal A is set by the clock pattern generator 9 to sample pulses with patterns of different repetition frequencies, the scrambling effect is further improved. On the receiving side, contrary to the above, the clock signal superimposed on the transmission signal is separated via the clock regeneration circuit 10, processed by the clock pattern generator 9, and the output pulse signal is sent to the first generator having the same configuration. Switch means 3. It is sent to the second switch means 5 for on/off control. Also,
Since the second switch means 5 includes an inverter 4 for reversing, both switch means 3.5 are controlled to be turned on and off alternately. The signals passing through both switch means 3 and 5 are reproduced by adder 1. The state changes of the signal in this case are as shown in FIGS. 4Q to 4E. That is, as shown in FIG. 3, the clock pulses output by the clock pattern generator 9 (FIG. 4 (2)
When outputting the transmission scramble signal A (see FIG. 4 (1))) input to the input terminal 1, the transmission scramble signal A (see FIG. )
When passing through the second switch means 5, the waveform becomes C (see FIG. When , the descrambling is completed and a normal signal (see FIG. 4(e)) is outputted to the output terminal 8.

【発明の効果】【Effect of the invention】

以上の説明から明らかなように、本発明の狭帯域伝送系
のスクランブル・デスクランブル方式は、伝送信Cをパ
ターン設定可能な、繰返しの箕なった周波数のサンプリ
ング信号でサンプリングすることにより、抑圧されたA
Mをかけることでスクランブルでき、また、反対にデス
クランブルすることができ、スクランブル効果が高い。 さらに、その構成が簡素であり、コストの低減を図るこ
とができる。
As is clear from the above explanation, the narrowband transmission system scramble/descramble method of the present invention suppresses the transmission by sampling the transmitted signal C with a pattern-setting, repetitive sampling signal of a small frequency. A
Scrambling can be performed by multiplying by M, and conversely, it can be descrambled, resulting in a high scrambling effect. Furthermore, the configuration is simple and costs can be reduced.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明のスクランブル方式を実現するための一
実施例を示す回路構成図、第2図は各部における信号波
形を示す図、第3図は本発明のデスクランブル方式を実
現するための一実施例を示す回路構成図、第4図は各部
における信号波形を示す図である。 1・・・入力端子、2・・・クロックパルス発生回路、
3・・・第1のスイッチ手段、4・・・インバータ、5
・・・第2のスイッチ手段、6・・・インバータ、7・
・・加算器、8・・・出力端子、9・・・クロックパタ
ーンジェネレータ、10・−・クロック再生回路、11
・・・バンドパスフィルタ。
Fig. 1 is a circuit configuration diagram showing an embodiment for realizing the scrambling method of the present invention, Fig. 2 is a diagram showing signal waveforms in each part, and Fig. 3 is a circuit diagram showing an embodiment for realizing the descrambling method of the present invention. FIG. 4 is a circuit configuration diagram showing one embodiment. FIG. 4 is a diagram showing signal waveforms in each part. 1... Input terminal, 2... Clock pulse generation circuit,
3... first switch means, 4... inverter, 5
. . . second switch means, 6. inverter, 7.
...Adder, 8...Output terminal, 9...Clock pattern generator, 10...Clock regeneration circuit, 11
...Band pass filter.

Claims (1)

【特許請求の範囲】[Claims] パターン設定されたクロック信号で第1のスイッチ手段
をオン・オフして伝送信号を加算器に供給すると共に、
上記クロック信号の反転信号で第2のスイッチ手段をオ
ン・オフして伝送信号の反転信号を上記加算器に供給す
ることによりスクランブルし、クロック再生回路および
パターン設定回路を介して同じ回路構成でデスクランブ
ルすることを特徴とする狭帯域伝送系のスクランブル・
デスクランブル方式。
Turning on and off the first switch means using the patterned clock signal to supply the transmission signal to the adder;
Scramble is performed by turning on and off the second switch means using an inverted signal of the clock signal and supplying an inverted signal of the transmission signal to the adder. Scrambling and scrambling of narrowband transmission systems characterized by scrambling
Descrambling method.
JP61134375A 1986-06-10 1986-06-10 Scramble/descramble system for narrow band transmission system Pending JPS62290225A (en)

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JP61134375A JPS62290225A (en) 1986-06-10 1986-06-10 Scramble/descramble system for narrow band transmission system

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02274029A (en) * 1989-04-17 1990-11-08 Fujitsu Ltd Multiplying circuit

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