JPS6157394A - Ｉｃカ−ド - Google Patents
Ｉｃカ−ドInfo
- Publication number
- JPS6157394A JPS6157394A JP59180133A JP18013384A JPS6157394A JP S6157394 A JPS6157394 A JP S6157394A JP 59180133 A JP59180133 A JP 59180133A JP 18013384 A JP18013384 A JP 18013384A JP S6157394 A JPS6157394 A JP S6157394A
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- JP
- Japan
- Prior art keywords
- card
- reset
- power supply
- supply voltage
- circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（発明の技術分野）
この発明はＩＣカードの構造に関し、特に使用の際に電
源電圧の印加によって必ずリセントされ、初期設定され
る構造のＩＣカードに関する。
源電圧の印加によって必ずリセントされ、初期設定され
る構造のＩＣカードに関する。
（発明の技術的背景とその問題点）
近年、マイクロコンピュータ、メモリ等のＩＣチップを
モジュール化したＩＣモジュールを装着、埋込あるいは
内蔵したチップカー１・、メモリカード、マイコンカー
ド、電子カード等と称されるカード（以下、ここではＩ
Ｃカードという）の研究開発がなされている。このＩＣ
カードは従来の磁気ストライブカードに比べてその記憶
容１ｉｌが大きいことから、金融関係ではｆｎ金通帳に
替って預貯金の履歴を記録あるいは記ｔなしたり、クレ
ジット関係では買物等の取引履歴を記録あるいは記憶さ
れるようなことが考えられている。かかるＩＣカードは
メモリやデータ処理回路等の電子回路を内蔵したＩＣモ
ジュールと、このＩＣモジュールをデータ伝送装置等の
外部装置に電気的に接続する接点電子（電極）とを具備
している。 ＩＣカード上の外部接続用接点端子と、Ｉ
Ｃモジュールのリード端子とは導体ワイヤによって電気
的に接続されている。
モジュール化したＩＣモジュールを装着、埋込あるいは
内蔵したチップカー１・、メモリカード、マイコンカー
ド、電子カード等と称されるカード（以下、ここではＩ
Ｃカードという）の研究開発がなされている。このＩＣ
カードは従来の磁気ストライブカードに比べてその記憶
容１ｉｌが大きいことから、金融関係ではｆｎ金通帳に
替って預貯金の履歴を記録あるいは記ｔなしたり、クレ
ジット関係では買物等の取引履歴を記録あるいは記憶さ
れるようなことが考えられている。かかるＩＣカードは
メモリやデータ処理回路等の電子回路を内蔵したＩＣモ
ジュールと、このＩＣモジュールをデータ伝送装置等の
外部装置に電気的に接続する接点電子（電極）とを具備
している。 ＩＣカード上の外部接続用接点端子と、Ｉ
Ｃモジュールのリード端子とは導体ワイヤによって電気
的に接続されている。
第３図は従来のＩＣカードを例示する図である。 ＩＣ
カード４の内部にマイクロコンピュータつまりＣＰＵ５
．データメモリ６、プログラムメモリ（＋２０１１）？
、及びデータ演算メモリ（ＲＡ）り ８が配設されて
いる。この従来のＩＣカード４は、外部接続用リセット
端子ＲＳＴに印加されたリセット信号が直接にｃｐｕｔ
のリセット端子に印加される構造となっている。クレジ
ットカードとして検討されているＩＣカードでは、ＩＣ
カード内のマイクロコンピュータの動作を初期設定する
ためのりセラＩ・信号を外部から印加することができる
ように、リセット信号入出力用接点端子をＩＣカード上
に設けることが国際標準化機構ＩＳＯ等において提案さ
れている。しかし、カードリーグ（あるいはライタ）の
誤動作等の理由による過失によって、もしくは故意にリ
セットを行なわずにＩＣカード内のＣＰＵＩを動作させ
た場合には、ＣＰＵＩは初期設定されず、そのためいわ
ゆる暴走状態となる。その結果、最悪の場合にはＩＣカ
ード内のＰＲＯＮ、ＥＦＲＯＭもしくはＥＥＦＲＯＭ等
のデータ格納用メモリに既に格納されているデータが消
去されてり、書替えられたりする可能性がある。
カード４の内部にマイクロコンピュータつまりＣＰＵ５
．データメモリ６、プログラムメモリ（＋２０１１）？
、及びデータ演算メモリ（ＲＡ）り ８が配設されて
いる。この従来のＩＣカード４は、外部接続用リセット
端子ＲＳＴに印加されたリセット信号が直接にｃｐｕｔ
のリセット端子に印加される構造となっている。クレジ
ットカードとして検討されているＩＣカードでは、ＩＣ
カード内のマイクロコンピュータの動作を初期設定する
ためのりセラＩ・信号を外部から印加することができる
ように、リセット信号入出力用接点端子をＩＣカード上
に設けることが国際標準化機構ＩＳＯ等において提案さ
れている。しかし、カードリーグ（あるいはライタ）の
誤動作等の理由による過失によって、もしくは故意にリ
セットを行なわずにＩＣカード内のＣＰＵＩを動作させ
た場合には、ＣＰＵＩは初期設定されず、そのためいわ
ゆる暴走状態となる。その結果、最悪の場合にはＩＣカ
ード内のＰＲＯＮ、ＥＦＲＯＭもしくはＥＥＦＲＯＭ等
のデータ格納用メモリに既に格納されているデータが消
去されてり、書替えられたりする可能性がある。
特に、データ格納用メモリが主回路電源電圧と同一電圧
の電源からの供給によってデータの書込みあるいは消去
が可能である場合には、特別な書込み用電源電圧の供給
を必要とせずにデータの変更あるいは消去が可能になり
、暴走状態になると非常に危険である。
の電源からの供給によってデータの書込みあるいは消去
が可能である場合には、特別な書込み用電源電圧の供給
を必要とせずにデータの変更あるいは消去が可能になり
、暴走状態になると非常に危険である。
（発明の目的）
この発明の目的は、電源電圧の印加の際にこの電源電圧
から自動的にリセットパルスを発生し、内蔵しているマ
イクロコンピュータを必ず初期設定する構造とし、高機
密で信頼性の高いＩＣカードを提供することにある。
から自動的にリセットパルスを発生し、内蔵しているマ
イクロコンピュータを必ず初期設定する構造とし、高機
密で信頼性の高いＩＣカードを提供することにある。
（発明の概要）
この発明は、電源電圧端子に印加された電源電圧から、
内蔵しているマイクロコンピュータを初期設定するため
のリセットパルスを自動的に発生するパワーオンリセト
回路を備えたＩＣカードである。このパワーオンリセッ
ト回路は。
内蔵しているマイクロコンピュータを初期設定するため
のリセットパルスを自動的に発生するパワーオンリセト
回路を備えたＩＣカードである。このパワーオンリセッ
ト回路は。
抵抗、コンデンサが直列接続された積分回路と、上記抵
抗とコンデンサの接続点からの入力を波形整形して所定
のリセットパルスとしてマイクロコンピュータのリセッ
ト端子に与える波形整形回路とから成っている。このパ
ワーオンリセット回路は外部回路として構成することも
、集積回路としてマイクロコンピュータチップと一体に
構成することもできる。
抗とコンデンサの接続点からの入力を波形整形して所定
のリセットパルスとしてマイクロコンピュータのリセッ
ト端子に与える波形整形回路とから成っている。このパ
ワーオンリセット回路は外部回路として構成することも
、集積回路としてマイクロコンピュータチップと一体に
構成することもできる。
（発明の実施例）
ｙｒｌ１図（Ａ）はこの発明のＩＣカードの一実施例を
示す図である。直列接続された抵抗ｒとコンデンサＣと
から成る積分回路が電源電圧端子Ｖｃｃ と接地端子Ｇ
ＮＤとの間に接続されており、リセット端子Ｒ９Ｔが図
示のように抵抗ｒとコンデンサＣとの接続点に接続され
ている。電源電圧端子Ｖｃｃに＋５ｖの電源電圧が印加
されると、コンデンサＣの電位つまり外部接続用のリセ
ット端子ＲＳＴの電位が上昇する。第１図（Ｂ）のタイ
ミングチャートに示すように、抵抗ｒ及びコンデンサＣ
で決まる積分回路の特定数に応じた所定時間経過後、こ
のリセット端子ＲＳＴの電位が＋５ｖに達すると、波形
整形回路２がなまった入力波形をリセットパルス波形に
整形して出力する。これによって、ｃｐｕ ｔのリセッ
ト電子ＲＳＴに自動的に所定のリセットパルスが与えら
れ、ＣＰＵＩは電源電位の印加によって必ず初期設定さ
れることになる。従って、この発明によれば外部からの
リセットパルス入力は必ずしも必要でなく、ＩＣカード
上にリセット端子ＲＳＴを設けなくても良い。
示す図である。直列接続された抵抗ｒとコンデンサＣと
から成る積分回路が電源電圧端子Ｖｃｃ と接地端子Ｇ
ＮＤとの間に接続されており、リセット端子Ｒ９Ｔが図
示のように抵抗ｒとコンデンサＣとの接続点に接続され
ている。電源電圧端子Ｖｃｃに＋５ｖの電源電圧が印加
されると、コンデンサＣの電位つまり外部接続用のリセ
ット端子ＲＳＴの電位が上昇する。第１図（Ｂ）のタイ
ミングチャートに示すように、抵抗ｒ及びコンデンサＣ
で決まる積分回路の特定数に応じた所定時間経過後、こ
のリセット端子ＲＳＴの電位が＋５ｖに達すると、波形
整形回路２がなまった入力波形をリセットパルス波形に
整形して出力する。これによって、ｃｐｕ ｔのリセッ
ト電子ＲＳＴに自動的に所定のリセットパルスが与えら
れ、ＣＰＵＩは電源電位の印加によって必ず初期設定さ
れることになる。従って、この発明によれば外部からの
リセットパルス入力は必ずしも必要でなく、ＩＣカード
上にリセット端子ＲＳＴを設けなくても良い。
第２図はこの発明のＩＣカードの別の実施例を示す図で
ある。この実施例では、波形整形回路２がＣＰＵＩのチ
ップの内部に一体で構成されている。更に、図示はして
いないが、抵抗ｒ及びコンデンサＣも集積回路素子によ
りｃｐｕｔのチップの内部に一体に集積化して構成する
こともできる。この場合には外観上は回路接続は第３図
の従来のＩＣカードと同様の構成となる。これによって
、上述の場合と同様なリセット動作を行なうことができ
る。
ある。この実施例では、波形整形回路２がＣＰＵＩのチ
ップの内部に一体で構成されている。更に、図示はして
いないが、抵抗ｒ及びコンデンサＣも集積回路素子によ
りｃｐｕｔのチップの内部に一体に集積化して構成する
こともできる。この場合には外観上は回路接続は第３図
の従来のＩＣカードと同様の構成となる。これによって
、上述の場合と同様なリセット動作を行なうことができ
る。
（発明の効果）
この発明の効果は、使用の際に電源電圧が印加された時
に必ず初期状態にリセットされ、そのため暴走状態が防
止されるＩＣカードが得られることである。
に必ず初期状態にリセットされ、そのため暴走状態が防
止されるＩＣカードが得られることである。
第１図（Ａ）はこの発明のＩＣカードの一実施例を示す
図、第１図ＣＢ）は第１図（Ａ）の実施例のタイミュノ
グチャート、第２図はこの発明のＩＣカードの別の実施
例を示す図、第３図は従来のＩＣカードを例示する図で
ある。 １・・・ＧＰＵ、２・・・波形整形回路、４・・・ＩＣ
カード、５・・・ＧＰＵ、６・・・データメモリ、７・
・・プログラムメモリ、８・・・データ演算メモリ、ｒ
・・・抵抗、Ｃ・・・コンデンサ。 出願人代理人 安 形 雄 三 茶 ｌ 図 （Ｂ） 第 ２ 図 ！ 第 ３ 図
図、第１図ＣＢ）は第１図（Ａ）の実施例のタイミュノ
グチャート、第２図はこの発明のＩＣカードの別の実施
例を示す図、第３図は従来のＩＣカードを例示する図で
ある。 １・・・ＧＰＵ、２・・・波形整形回路、４・・・ＩＣ
カード、５・・・ＧＰＵ、６・・・データメモリ、７・
・・プログラムメモリ、８・・・データ演算メモリ、ｒ
・・・抵抗、Ｃ・・・コンデンサ。 出願人代理人 安 形 雄 三 茶 ｌ 図 （Ｂ） 第 ２ 図 ！ 第 ３ 図
Claims (3)
- （１）少なくともマイクロコンピュータと外部接続用端
子郡とを有するＩＣカードにおいて、電源電圧端子に印
加された電源電圧を検出して、この電源電圧から前記マ
イクロコンピュータを初期設定するためのリセットパル
スを自動的に発生するパワーオンリセット回路を備える
ことを特徴とするＩＣカード。 - （２）前記パワーオンリセット回路が、外部接続用の電
源電圧端子から接地端子へ抵抗、コンデンサの順に直列
接続された積分回路と、外部接続用リセット端子が接続
されている前記抵抗及びコンデンサの接続点からの入力
を波形成形して所定のリセットパルスとして前記マイク
ロコンピュータのリセット端子に与える波形成形回路と
で成る特許請求の範囲第１項に記載のＩＣカード。 - （３）前記パワーオンリセット回路が、前記マイクロコ
ンピュータチップ内に一体に集積されて構成されている
特許請求の範囲第１項に記載のＩＣカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59180133A JPS6157394A (ja) | 1984-08-29 | 1984-08-29 | Ｉｃカ−ド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59180133A JPS6157394A (ja) | 1984-08-29 | 1984-08-29 | Ｉｃカ−ド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6157394A true JPS6157394A (ja) | 1986-03-24 |
Family
ID=16077985
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59180133A Pending JPS6157394A (ja) | 1984-08-29 | 1984-08-29 | Ｉｃカ−ド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6157394A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61117681A (ja) * | 1984-11-13 | 1986-06-05 | Mitsubishi Electric Corp | Ｉｃカ−ド |
| US5471203A (en) * | 1991-11-14 | 1995-11-28 | Fujitsu Limited | Admission managing system |
-
1984
- 1984-08-29 JP JP59180133A patent/JPS6157394A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61117681A (ja) * | 1984-11-13 | 1986-06-05 | Mitsubishi Electric Corp | Ｉｃカ−ド |
| US5471203A (en) * | 1991-11-14 | 1995-11-28 | Fujitsu Limited | Admission managing system |
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| JPS62220398A (ja) | Ｉｃカ−ド | |
| JPH0529898Y2 (ja) |