JPS6144291B2 - - Google Patents
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- JPS6144291B2 JPS6144291B2 JP6089079A JP6089079A JPS6144291B2 JP S6144291 B2 JPS6144291 B2 JP S6144291B2 JP 6089079 A JP6089079 A JP 6089079A JP 6089079 A JP6089079 A JP 6089079A JP S6144291 B2 JPS6144291 B2 JP S6144291B2
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- JP
- Japan
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- ecd
- power supply
- segment
- supply voltage
- transistor
- Prior art date
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- Expired
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Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Electrochromic Elements, Electrophoresis, Or Variable Reflection Or Absorption Elements (AREA)
Description
【発明の詳細な説明】
本発明は、ECD(エレクトロ・クロミツク・
デイスプレイ)を表示に利用した電子機器におい
て、ECDに過大電荷量が書込まれることを防止
するようにしたものである。[Detailed Description of the Invention] The present invention is an electrochromic device (ECD).
This is designed to prevent an excessive amount of charge from being written to the ECD in electronic equipment that uses a display (display) for display.
ECDの駆動回路例を第1図に示す。まず最
初、ECDセル1の任意のセグメント2が消色状
態にあるものとする。 Figure 1 shows an example of an ECD drive circuit. First, it is assumed that an arbitrary segment 2 of the ECD cell 1 is in a colorless state.
今、トランジスタTr1がオフ、トランジスタ
Tr2がオンになつたとすると、カウンタ3からセ
グメント2に電流IWが流れセグメント2は着色
される。この着色の色は、EC物質としてWO3を
用いた場合青色である。そして、着色濃度はセグ
メント2に流れた電荷量QW=IW・TWに比例し
て決定される。なお、TWはトランジスタTr2の
オン時間である。 Now transistor Tr 1 is off, transistor
When Tr 2 is turned on, a current I W flows from counter 3 to segment 2 and segment 2 is colored. The color of this staining is blue when WO 3 is used as the EC substance. The coloring density is determined in proportion to the amount of charge Q W =I W ·T W flowing into the segment 2. Note that T W is the on time of the transistor Tr 2 .
一旦、着色されたセグメント2はトランジスタ
Tr1,Tr2をオフしても、ECD自身にメモリ機能
があることによつてその着色状態が保持される。
このような状態でトランジスタTr1をオン、トラ
ンジスタTr2をオフすると、セグメント2からカ
ウンタ3に電流IEが流れ消色される。 Once colored segment 2 is a transistor
Even if Tr 1 and Tr 2 are turned off, the colored state is maintained because the ECD itself has a memory function.
When the transistor Tr 1 is turned on and the transistor Tr 2 is turned off in this state, a current I E flows from the segment 2 to the counter 3 and the color is erased.
電池E1は消失時に電圧VEを、電池E2は着色時
に電圧VWをそれぞれECDセル1に印加するため
のものである。 The battery E 1 is used to apply a voltage V E to the ECD cell 1 when it is extinguished, and the battery E 2 is used to apply a voltage V W to the ECD cell 1 when it is colored.
ところで、着色動作において、過大電荷量の着
色が行なわれるとECDセルは破壊される。具体
的に言えば、ECDセグメント部が茶色等に変色
し、表示装置としての商品性が非常に低下する。
本発明はこのような点に鑑みてなされたものであ
つて、ECDに過大電荷量が書込まれることを防
止する回路を附加し、ECDセルの破壊をなくし
た有用な電子機器を提供することを目的とする。 By the way, in the coloring operation, if coloring with an excessive amount of charge is performed, the ECD cell will be destroyed. Specifically, the ECD segment portion becomes discolored to brown or the like, and the marketability of the display device is greatly reduced.
The present invention has been made in view of these points, and it is an object of the present invention to provide a useful electronic device that eliminates destruction of the ECD cell by adding a circuit that prevents an excessive amount of charge from being written to the ECD. With the goal.
回路が誤動作する原因に電源電圧が低下したこ
とによる場合がある。すなわち、電源電圧が低下
すると、第1図のトランジスタTr2の入力がH
(=GND)レベルになりつぱなしになつてしま
い、トランジスタTr2がオンし続けセグメント2
に過大電荷量が書込まれることがある。本発明は
この点に着目し、電源電圧の低下を検出して、過
大電荷量の書込みを防止するようにしたものであ
つて、以下第2図、第3図に従つて本発明の一実
施例を詳細に説明する。 There are cases where a circuit malfunctions due to a drop in the power supply voltage. That is, when the power supply voltage decreases, the input of transistor Tr 2 in FIG.
(=GND) level and the transistor Tr 2 continues to turn on.
An excessive amount of charge may be written to. The present invention focuses on this point and detects a drop in the power supply voltage to prevent writing of an excessive amount of charge. An example will be explained in detail.
第2図は本発明の一実施例を示す電気回路図で
ある。なお、第2図において第1図と同一機能を
有するものは同一符号を付して示している。 FIG. 2 is an electrical circuit diagram showing one embodiment of the present invention. In FIG. 2, parts having the same functions as those in FIG. 1 are designated by the same reference numerals.
電圧検出回路VDは電源電圧|−VE−VW|を
検出するものであり、その出力はインバータInを
介してセグメント書込み制御信号SWを他方に入
するアンドゲートAに入力される。 The voltage detection circuit VD detects the power supply voltage |-V E -V W |, and its output is inputted to an AND gate A which inputs the segment write control signal S W to the other via an inverter In.
第2図の各部信号波形は第3図のタイムチヤー
トに示されるとおりであり、電源電圧|VE−VW
|が所定値以上あると、電圧検出回路VDの出力
はL(=−VE−VW)レベル、従つてインバータ
Inの出力はH(=GND)レベルであり、アンド
ゲートAは所望時に入力されるセグメント書込み
制御信号SWを通過させ書込動作を行なう。しか
し電源電圧|−VE−VW|が低下すると、電圧検
出回路VDの出力はH(=GND)レベル、すなわ
ちインバータInの出力がL(=GND)レベルと
なり、アンドゲートAの出力をL(=−VE−V
W)レベルに保持し、トランジスタTr2を強制的
にオフにする。このとき、セグメント書込み制御
信号SWがH(=GND)レベルを呈したとして
も、トランジスタTr2はオフのままであり通電荷
量の書込みが防止される。 The signal waveforms of each part in FIG. 2 are as shown in the time chart of FIG. 3, and the power supply voltage |V E −V W
| is above a predetermined value, the output of the voltage detection circuit VD is at the L (=-V E -V W ) level, and therefore the inverter
The output of In is at the H (=GND) level, and AND gate A passes the segment write control signal SW input at a desired time to perform a write operation. However, when the power supply voltage |-V E -V W (=-V E -V
W ) level and forces transistor Tr 2 off. At this time, even if the segment write control signal SW exhibits an H (=GND) level, the transistor Tr 2 remains off, and writing of the amount of charge is prevented.
以上のように本発明は、電源電圧の低下を検出
してECDに過大電荷量が書込まれることを防止
するものであり、有用なECD表示電子機器が提
供できる。 As described above, the present invention detects a drop in power supply voltage and prevents an excessive amount of charge from being written to the ECD, and can provide a useful ECD display electronic device.
第1図は基本的構成例を示す電気回路図、第2
図は本発明の一実施例を示す電気回路図、第3図
は第2図の各部信号波形を示すタイムチヤートで
ある。
1……ECDセル、2……セグメント、3……
カウンタ、Tr1,Tr2……スイツチング用トラン
ジスタ、VD……電圧検出回路、In……インバー
タ、A……アンドゲート、SW……セグメント書
込み制御信号。
Figure 1 is an electrical circuit diagram showing a basic configuration example, Figure 2
The figure is an electric circuit diagram showing one embodiment of the present invention, and FIG. 3 is a time chart showing signal waveforms at various parts in FIG. 1...ECD cell, 2...segment, 3...
Counter, Tr 1 , Tr 2 ... switching transistor, VD ... voltage detection circuit, In ... inverter, A ... AND gate, SW ... segment write control signal.
Claims (1)
該機器の電源電圧を検出する手段、及び該検出出
力に従つてECDの書込みを制御する手段を設
け、前記電源電圧が所定値以下に低下したとき、
ECDの書込みスイツチング手段を強制的にオフ
となるよう構成したことを特徴とするECD表示
電子機器。1 In electronic devices that use ECD for display,
Means for detecting the power supply voltage of the device and means for controlling writing to the ECD according to the detection output are provided, and when the power supply voltage falls below a predetermined value,
An ECD display electronic device characterized in that an ECD write switching means is configured to be forcibly turned off.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6089079A JPS55151696A (en) | 1979-05-16 | 1979-05-16 | Electronic device for displaying ecd |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6089079A JPS55151696A (en) | 1979-05-16 | 1979-05-16 | Electronic device for displaying ecd |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS55151696A JPS55151696A (en) | 1980-11-26 |
JPS6144291B2 true JPS6144291B2 (en) | 1986-10-02 |
Family
ID=13155397
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6089079A Granted JPS55151696A (en) | 1979-05-16 | 1979-05-16 | Electronic device for displaying ecd |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS55151696A (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57151996A (en) * | 1981-03-16 | 1982-09-20 | Seiko Instr & Electronics | Electrochromism driving circuit |
-
1979
- 1979-05-16 JP JP6089079A patent/JPS55151696A/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS55151696A (en) | 1980-11-26 |
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