JPS6141211A - Nonlinear output compensation circuit - Google Patents

Nonlinear output compensation circuit

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JPS6141211A
JPS6141211A JP16028084A JP16028084A JPS6141211A JP S6141211 A JPS6141211 A JP S6141211A JP 16028084 A JP16028084 A JP 16028084A JP 16028084 A JP16028084 A JP 16028084A JP S6141211 A JPS6141211 A JP S6141211A
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03FAMPLIFIERS
    • H03F1/00Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
    • H03F1/32Modifications of amplifiers to reduce non-linear distortion
    • H03F1/3241Modifications of amplifiers to reduce non-linear distortion using predistortion circuits

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  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Electronic Switches (AREA)
  • Amplifiers (AREA)

Abstract

PURPOSE:To ensure compensation of a nonlinear part of an amplifier, etc. with no negative feedback of output, by having the symmetrical connection between a pair of transistors Tr and supplying the symmetrical input voltage having their levels changing in two steps to the bases of said Tr. CONSTITUTION:The collectors and emitters of npn Trs 2 and 4 are connected to each other. A control voltage signal Vi 1 whose level changes in two steps is supplied to a base input terminal 14. While a control voltage signal Vi 2 symmetrical to the signal Vi 1 is supplied to a base input terminal 16. Thus a V- shaped part 22 where the current value is reduced suddenly at a period 21 when both signals Vi 1 and Vi 2 cross is formed to the waveform of a collector current ID. Thus a nonlinear part of an amplifier circuit, etc. is improved by making use of such output waveform characteristics.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はダイオード、トランジスタを使用したアンプ及
びスイッチング回路の非直線性出力を直線性出力に改善
するための非直線出力補償回路に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a nonlinear output compensation circuit for improving the nonlinear output of an amplifier and switching circuit using diodes and transistors to linear output.

〔従来の技術〕[Conventional technology]

ダイオード、トランジスタを使用したアンプ及びスイッ
チング回路等では非直線性部分を使用しないかあるいは
、非直線性が回路目的に影響を与えない場合は別として
半導体の導通開始及び飽和附近の非直線性を改善するに
は増幅された出力を負帰還させて直線性を改善するのが
一般的である。
In amplifiers, switching circuits, etc. that use diodes and transistors, nonlinear parts are not used, or nonlinearity at the start of conduction and near saturation of semiconductors is improved, unless the nonlinearity does not affect the purpose of the circuit. To achieve this, it is common to provide negative feedback to the amplified output to improve linearity.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

出力を負帰還させて直線性を改善する方法では入力を増
幅して出力するため信号処理が高速化するにしたがって
位相のずれ、極端な場合に回路の発振等の問題があり、
特に半導体の動作領域を越えて未導通から飽和迄直線性
が要求され且つ高速性も要求される場合。
In the method of improving linearity by negative feedback of the output, the input is amplified and output, so as signal processing speeds up, there are problems such as phase shift and, in extreme cases, circuit oscillation.
Especially when linearity is required from non-conduction to saturation beyond the operating range of the semiconductor, and high speed is also required.

出力を入力側に負帰還させることなく直線性を改善しな
ければならない。本発明は上記問題点を解決することを
目的とするものである。
Linearity must be improved without negative feedback of the output to the input side. The present invention aims to solve the above problems.

〔問題点を解決する手段〕[Means to solve problems]

上記目的を達成するため1本発明は一対のトランジスタ
2,4が対称となるように該−対のトランジスタ2,4
のコレクタどうし及びエミッタどうしをそれぞれ接続し
、該トランジスタ2,4のベースに、レベルが2段階に
変化する互いに対称な一対の電圧信号を印加し、該電圧
信号が交差する時に前記トランジスタ2,4のコレクタ
電流が7字状に変化するようにしたことを特徴とするも
のである。
In order to achieve the above object, the present invention provides a structure in which the pair of transistors 2 and 4 are arranged symmetrically.
The collectors and emitters of the transistors 2 and 4 are connected to each other, and a pair of symmetrical voltage signals whose levels change in two steps is applied to the bases of the transistors 2 and 4, and when the voltage signals cross, the transistors 2 and 4 This is characterized in that the collector current changes in a seven-figure pattern.

〔作用〕[Effect]

上記した構成において、一対のトランジスタ2,4のう
ちの一方のベースに、レベルが2段階に変化する互いに
対称な一対の電圧信号V i 1 、 V i 2のう
ちの一方の電圧信号Vj1を印加し、前記トランジスタ
2,4のうちの他方のベースに、上記一対の電圧信号の
うちの他方の電圧信号V i 2を印加すると、上記一
対の電圧信号V i 1 、 V i 2が交差すると
きに前記トランジスタ2,4のコレクタ電流がV字状に
変化する。従ってこのV字状出力を、スイッチング回路
等の出力の非直線部に付加すれば、該非直線部を改善す
ることができる。
In the above configuration, one voltage signal Vj1 of a pair of mutually symmetrical voltage signals V i 1 and V i 2 whose level changes in two steps is applied to the base of one of the pair of transistors 2 and 4. However, when the other voltage signal V i 2 of the pair of voltage signals is applied to the base of the other of the transistors 2 and 4, when the pair of voltage signals V i 1 and V i 2 intersect , the collector currents of the transistors 2 and 4 change in a V-shape. Therefore, by adding this V-shaped output to the non-linear portion of the output of a switching circuit or the like, the non-linear portion can be improved.

〔実施例〕〔Example〕

以下に本発明の構成を添付図面に示す実施例に基いて詳
細に説明する。
The configuration of the present invention will be described in detail below based on embodiments shown in the accompanying drawings.

第1図a、bは、非直線補償回路を示している。aにお
いて、2個のNPNトランジスタ2,4のそれぞれのコ
レクタは互いに接続し、且つNPNトランジスタ2,4
のそれぞれのエミッタが互いに接続している。bに示す
補償回路も同様に一対のPNPトランジスタ6.8の互
いのコレクタ及びエミッタどうしが接続している。a、
t)のそれぞれの2個のトランジスタ2と4及び6と8
は、互いに対称に接続している。図中、10.12は基
準電圧供給端子、14,16,18.20は入力端であ
る。上記補償回路a、bのそれぞれのベース入力端14
.18に第2図に示すレベルが2段階に変化する制御電
圧信号■11が入力され、ベース入力端16,20に前
記Vilに対称な制御電圧信号V i 2が入力される
と、補償回路a、bのコレクタ電流より、IUの波形に
第2図す、cに示す如く上記VilとVi2が交叉する
時期21に急激に電流値がV字状に減少するV字状部2
2゜24が形成される。この出力波形特性を利用して、
アンプ、スイッチング回路の非直線部を改善することが
できる。この原理を第11図及び第12図を参照して説
明する。負荷抵抗RLに電流が流れ込むライン26にP
NPトランジスタから成る補償回路すを接続し。
Figures 1a and 1b show a nonlinear compensation circuit. At a, the respective collectors of the two NPN transistors 2 and 4 are connected to each other, and the NPN transistors 2 and 4 are connected to each other.
The respective emitters of are connected to each other. Similarly, in the compensation circuit shown in b, the collectors and emitters of a pair of PNP transistors 6.8 are connected to each other. a,
t) respectively two transistors 2 and 4 and 6 and 8
are symmetrically connected to each other. In the figure, 10.12 is a reference voltage supply terminal, and 14, 16, 18.20 are input terminals. Base input terminal 14 of each of the compensation circuits a and b
.. When the control voltage signal 11 whose level changes in two steps as shown in FIG. , b, the waveform of IU shows a V-shaped portion 2 in which the current value suddenly decreases in a V-shape at the time 21 when the above-mentioned Vi1 and Vi2 intersect, as shown in Fig. 2c.
2°24 is formed. Using this output waveform characteristic,
Non-linear parts of amplifiers and switching circuits can be improved. This principle will be explained with reference to FIGS. 11 and 12. P to the line 26 through which current flows into the load resistor RL.
Connect a compensation circuit consisting of an NP transistor.

負荷抵抗RLに対して電流が流れ出すライン28にNP
Nトランジスタから成る補償回路aを接続した場合、ラ
イン26を流れる電流をIP、ライン28を流れる電流
をINとすると、 (I P −I N)  RL=Vo u を従って、
TNが7字状に変化すると、V o utは第12図a
に示す如く逆V字状に変化し、IPがV字状に変化する
と、V o u tは第12図すに示す如く7字状に変
化する。これにより、NPNトランジスタ型補償回路と
PNPトランジスタ型補償回路を負荷抵抗に対して適宜
接続することにより、V字状出力電圧と逆V字状の出力
電圧を得ることが理解できる。この出力電圧をアンプ、
スイッチング回路の非直線部に付加すれば、該非直線部
を直線状に改善することができる。
NP to the line 28 from which current flows to the load resistance RL.
When a compensation circuit a consisting of N transistors is connected, and if the current flowing through the line 26 is IP and the current flowing through the line 28 is IN, then (I P - I N) RL=Vou Therefore,
When TN changes into a 7-figure shape, V out is as shown in Figure 12a.
When the IP changes into an inverted V shape as shown in FIG. 12, V out changes into a seven character shape as shown in FIG. 12. From this, it can be understood that by appropriately connecting the NPN transistor type compensation circuit and the PNP transistor type compensation circuit to the load resistor, a V-shaped output voltage and an inverted V-shaped output voltage can be obtained. Amplify this output voltage,
By adding it to a non-linear part of a switching circuit, the non-linear part can be improved into a straight line.

上記VilとVi2の電圧信号は第3図に示す差動型ス
イッチ回路によって造出することかできる。
The voltage signals Vil and Vi2 can be generated by a differential switch circuit shown in FIG.

第3図において、30.32はNPNトランジスタであ
り、これらは対称的に接続している。34は定電流回路
を構成するNPNトランジスタ、36.38はコレクタ
電源である。
In FIG. 3, 30 and 32 are NPN transistors, which are symmetrically connected. 34 is an NPN transistor constituting a constant current circuit, and 36 and 38 are collector power supplies.

トランジスタ32のベースには、基準電圧V′SIが印
加されている。上記した構成において、第4図に示す入
力電圧■′iがトランジスタ30のベースに供給される
と、ライン40.42にVilとV i 2の電圧信号
が発生する。上記VilとV i 2の交点Xは」二記
基準電圧V’SIのレベルを調整することによって所望
の時期に設定することができる。次に、NPNトランジ
スタ型非型線直線補償回路いて差動型スイッチング回路
の非直線性を改善した例を第5図を参照して説明する。
A reference voltage V'SI is applied to the base of the transistor 32. In the above configuration, when the input voltage ■'i shown in FIG. 4 is supplied to the base of transistor 30, voltage signals Vil and V i 2 are generated on lines 40 and 42. The intersection point X between Vil and V i 2 can be set at a desired time by adjusting the level of the reference voltage V'SI. Next, an example of improving the nonlinearity of a differential switching circuit using an NPN transistor type non-linear linear compensation circuit will be described with reference to FIG.

図中、NPNトランジスタ44.46は差動型スイッチ
ング回路を構成し、トランジスタ46のベースには基準
電圧VSIが印加されている。端子48.50はコレク
タ電源に接続している。第6図に示す入力電圧Viがト
ランジスタ2のベースに入力されると、非直線補償回路
52のV字状の補償特性によってトランジスタ44.4
6のコレクタ電流の波形a、bの部分54,56の非直
線性が改善され、該部分は直線的に変化する。
In the figure, NPN transistors 44 and 46 constitute a differential switching circuit, and a reference voltage VSI is applied to the base of the transistor 46. Terminals 48,50 are connected to the collector power supply. When the input voltage Vi shown in FIG. 6 is input to the base of the transistor 2, the V-shaped compensation characteristic of the nonlinear compensation circuit 52 causes the transistor 44.
The nonlinearity of the parts 54 and 56 of the collector current waveforms a and b of No. 6 is improved, and the parts change linearly.

次に、第8図に示す余り出力変換回路58の出力の非直
線性を改善した実施例について説明する6余り出力変換
回路58のスイッチ回路部60は複数の並列に接続さ九
た差動型スイッチ回路により構成され、該差動型スイッ
チ回路は一対のNPNトランジスタによって構成されて
いる。一対のNPN)−ランジスタロ2.64のうちの
一方のトランジスタ62のベースにはそれぞれ基準電位
Vsが印加されている。この基準電位Vsは、ラインL
に設けられた多数の分割抵抗66によって設定されてい
る。複数の差動型スイッチ回路の出力ラインは制限付き
定電流回路68に接続し。
Next, we will explain an embodiment in which the non-linearity of the output of the remainder output conversion circuit 58 shown in FIG. It is composed of a switch circuit, and the differential switch circuit is composed of a pair of NPN transistors. A reference potential Vs is applied to the base of one transistor 62 of a pair of NPN transistors 2.64. This reference potential Vs is the line L
This is set by a large number of dividing resistors 66 provided in the. The output lines of the plurality of differential switch circuits are connected to a limited constant current circuit 68.

該回路68の出力ラインには常に一定の電流例えばLm
Aが流れている。抵抗67をIKΩとすると抵抗67に
LmAの電流が流れると、抵抗67の両端には1ボルト
の電圧が生じる。今、 (1) V s −V I N > 1ボルトの状態に
あると、トランジスタ62のエミッタ・コレクタ間即ち
A′ラインに電流が流れ、トランジスタ64のエミッタ
・コレクタ間即ちBラインの電流はゼロ(CUFF’)
となる。
The output line of the circuit 68 always has a constant current, for example, Lm.
A is flowing. Assuming that the resistor 67 is IKΩ, when a current of LmA flows through the resistor 67, a voltage of 1 volt is generated across the resistor 67. Now, (1) When Vs - V I N > 1 volt, current flows between the emitter and collector of transistor 62, that is, line A', and the current flows between the emitter and collector of transistor 64, that is, line B, which is zero. (CUFF')
becomes.

このときVout(出力)の電圧は上昇する。At this time, the voltage of Vout (output) increases.

(2) 0<V s −V I N< 1ボルトとなる
とA′ライン、B′ラインともに導通し、A′ラインを
流れる電流値とB′ラインを流れる電流値との和はLm
Aとなる。このとき、V o u tの電圧は下降する
(2) When 0<V s -V I N< 1 volt, both the A' and B' lines become conductive, and the sum of the current flowing through the A' line and the current flowing through the B' line is Lm
It becomes A. At this time, the voltage of V out falls.

(3) V s −V I N<0 となるとA′ラインがOFFとなって電流がゼロとなり
、B′ラインにはLmAの電流が流れる。
(3) When V s −V I N<0, the A' line is turned off and the current becomes zero, and a current of LmA flows through the B' line.

上記(1)(2)(3)の動作を行う作動型スイッチ回
路が多数並列に接続されているため、第6図に示す入力
アナログ電圧Viは、第7図に示す交番2通用の余り出
力68に変換される。この余り出力68の非直線部70
゜72.74に補償回路による逆V字状の電圧信号84
を付加し、非直線部76.78に補償回路によるV字状
の電圧88を付加すれば。
Since a large number of actuated switch circuits that perform the operations (1), (2), and (3) above are connected in parallel, the input analog voltage Vi shown in Fig. 6 is the remainder output for the two-pass alternating box shown in Fig. 7. 68. Non-linear portion 70 of this remainder output 68
At ゜72.74, an inverted V-shaped voltage signal 84 is generated by the compensation circuit.
If we add V-shaped voltage 88 from the compensation circuit to the non-linear portions 76 and 78.

上記余り出力68の波形の非直線部70,72.74,
76.78が改善される。補償回路は、第8図の定電流
回路68の部分80に、該定電流回路68の替りに第9
図に示す如く接続する。第9図において、余り出力変換
回路58のVINの入力信号はレベルコンバータ82を
介して、トランジスタ30のベースに供給される。上記
構成によってNPNトランジスタ型補償回路aによる逆
V字状電圧84が余り出力変換回路58のV o u 
を電圧に付加され、余り出力68の部分70,72゜7
4の非直線部が改善される。第9図中のA。
Non-linear parts 70, 72, 74 of the waveform of the remainder output 68,
76.78 is improved. The compensation circuit includes a ninth part 80 of the constant current circuit 68 in FIG. 8 instead of the constant current circuit 68.
Connect as shown. In FIG. 9, the VIN input signal of the remainder output conversion circuit 58 is supplied to the base of the transistor 30 via a level converter 82. With the above configuration, the inverted V-shaped voltage 84 caused by the NPN transistor type compensation circuit a is left over and V o u of the output conversion circuit 58
is added to the voltage and the remainder output 68 portion 70,72°7
The non-linear portion of No. 4 is improved. A in Figure 9.

B、Cは第8図中のA、B、Cに対応している。NPN
PNトランジスタ償回路は上記差動型スイッチ回路と同
数設ける。尚、補償回路は余り出力変換回路58とは別
個に設けるようにしても良い。余り出力68の部分76
゜78の非直線部を改善する回路は、第10図に示され
ている。PNPトランジスタ型補償回路すは、PNPト
ランジスタ6.8によって構成され、そのライン86は
、第8図のVout端子に接続される。このPNPトラ
ンジスタ型補償回路は上記差動型スイッチ回路と同数設
ける。この補償回路によるV字状電圧88は、第7図に
示す如く余り出力68の部分76.78の非直線部に付
加され、該部分が改善される。尚、第10図中、90は
定電流回路、92はレベルコンバータ、94は第3図の
制御信号発生回路に対応する、PNPトランジスタから
成る制御信号発生回路である。
B and C correspond to A, B and C in FIG. NPN
The same number of PN transistor compensation circuits as the differential switch circuits are provided. Note that the compensation circuit may be provided separately from the remainder output conversion circuit 58. Portion 76 of remainder output 68
A circuit for improving the .degree. 78 non-linearity is shown in FIG. The PNP transistor type compensation circuit is constituted by a PNP transistor 6.8, the line 86 of which is connected to the Vout terminal in FIG. The same number of PNP transistor type compensation circuits as the differential type switch circuits are provided. The V-shaped voltage 88 generated by this compensation circuit is applied to the non-linear portion of the portion 76,78 of the remainder output 68, as shown in FIG. 7, and the portion is improved. In FIG. 10, 90 is a constant current circuit, 92 is a level converter, and 94 is a control signal generation circuit composed of a PNP transistor, which corresponds to the control signal generation circuit in FIG.

〔効果〕〔effect〕

本発明は上述の如く、一対のトランジスタを対称的に接
続し、該一対のトランジスタのベースにレベルが2段階
に変化する互いに対称的な入力電圧を入力することによ
って、該一対の入力電圧の波形が交差する点でコレクタ
電流が7字状に変化するようにしたのでこのV字状に変
化する特性によりダイオード。
As described above, the present invention enables a pair of transistors to be connected symmetrically, and by inputting mutually symmetrical input voltages whose levels change in two steps to the bases of the pair of transistors, the waveform of the pair of input voltages is The collector current changes in a 7-shape at the intersection of the diodes.

トランジスタを使用したアンプ及びスイッチング回路等
の非直線性部分を出力を負帰還させることなく、補償す
ることができる効果が存する。
This has the effect of being able to compensate for non-linear parts such as amplifiers and switching circuits using transistors without negative feedback of the output.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は回路図、第2図は波形図、第3図は回路図、第
4図は波形図、第5図は回路図、第6図は波形図、第7
図は波形図、第8図は回路図、第9図は回路図、第10
図は回路図。 第11図は説明回路図、第12図は説明図である。 2.4・・・・トランジスタ、  6,8・・・・トラ
ンジスタ、   10.12・・・・電流、  14゜
16.18.20・・・・入力端、  22.24・・
・・V字状部、  26.28・・・・ライン。 30.32・・・・NPNトランジスタ、34・・・・
定電流回路、  36.38・・・・コレクタ電源、 
 40.42・・・・ライン、  44.46・・・・
トランジスタ、  48.50・・・・端子。 52・・・・非直線補償回路、54..56・・・・部
分、 58・・・・余り出力変換回路、60・パ°スイ
ッチ回路部、  62.64・・・・トランジスタ、 
66・・・・分割抵抗、  68・・・・余り出力、 
 70,72,74,76.78・・・・非直線部、 
80・・・・部分、 82・・・・レベルコンバータ、
  84・・・・ライン。 86・・・・ライン 第1図 第2図 1(b) 第3図 第4図 第5図 第8図 第9図 第12図 (0)        (b) 昭和60年3月tq−日 昭和59年特許願第160280号 2、発明の名称 非直線出力補償回路 3、補正をする者 事件との関係  特許出願人 住 所  東京都大田区大森北4−17−18ナカムラ
ヒロム 氏名中村弘 住 所  〒150  東京都渋谷区神宮前6−19−
15(1)図面 6、補正の内容 (1)第8図を別紙の通り訂正する。
Figure 1 is a circuit diagram, Figure 2 is a waveform diagram, Figure 3 is a circuit diagram, Figure 4 is a waveform diagram, Figure 5 is a circuit diagram, Figure 6 is a waveform diagram, Figure 7 is a waveform diagram.
The figure is a waveform diagram, Figure 8 is a circuit diagram, Figure 9 is a circuit diagram, and Figure 10 is a circuit diagram.
The figure is a circuit diagram. FIG. 11 is an explanatory circuit diagram, and FIG. 12 is an explanatory diagram. 2.4...Transistor, 6,8...Transistor, 10.12...Current, 14゜16.18.20...Input terminal, 22.24...
...V-shaped part, 26.28...line. 30.32...NPN transistor, 34...
Constant current circuit, 36.38...Collector power supply,
40.42... line, 44.46... line
Transistor, 48.50...terminal. 52...Nonlinear compensation circuit, 54. .. 56...part, 58...remainder output conversion circuit, 60...pass switch circuit section, 62.64...transistor,
66...Division resistor, 68...Remainder output,
70, 72, 74, 76.78... non-linear part,
80... part, 82... level converter,
84...line. 86... Line Figure 1 Figure 2 Figure 1 (b) Figure 3 Figure 4 Figure 5 Figure 8 Figure 9 Figure 12 (0) (b) March 1985 tq - Day 1988 Patent Application No. 160280 2, Title of the invention: Non-linear output compensation circuit 3, Relationship with the amended person's case Patent applicant address: Hiromu Nakamura, 4-17-18 Omori Kita, Ota-ku, Tokyo Name: Hiromu Nakamura Address: 150 6-19- Jingumae, Shibuya-ku, Tokyo
15 (1) Drawing 6, details of amendment (1) Figure 8 is corrected as shown in the attached sheet.

Claims (1)

【特許請求の範囲】 一対のトランジスタ2、4が対称となるよ うに該一対のトランジスタ2、4のコレクタどうし及び
エミッタどうしをそれぞれ接続し、該トランジスタ2、
4のベースに、レベルが2段階に変化する互いに対称な
一対の電圧信号を印加し、該電圧信号が交差する時に、
前記トランジスタ2、4のコレクタ電流がV字状に変化
するようにしたことを特徴とする非直線出力補償回路。
[Claims] The collectors and emitters of the pair of transistors 2 and 4 are connected to each other so that the pair of transistors 2 and 4 are symmetrical, and the transistors 2 and
A pair of symmetrical voltage signals whose levels change in two steps are applied to the base of 4, and when the voltage signals cross,
A non-linear output compensation circuit characterized in that the collector currents of the transistors 2 and 4 change in a V-shape.
JP16028084A 1984-08-01 1984-08-01 Nonlinear output compensation circuit Granted JPS6141211A (en)

Priority Applications (1)

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JP16028084A JPS6141211A (en) 1984-08-01 1984-08-01 Nonlinear output compensation circuit

Applications Claiming Priority (1)

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JP16028084A JPS6141211A (en) 1984-08-01 1984-08-01 Nonlinear output compensation circuit

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JPS6141211A true JPS6141211A (en) 1986-02-27
JPH0576806B2 JPH0576806B2 (en) 1993-10-25

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ID=15711575

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* Cited by examiner, † Cited by third party
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JP2002532883A (en) * 1998-12-07 2002-10-02 テレフオンアクチーボラゲツト エル エム エリクソン(パブル) Analog switch

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JP4838421B2 (en) * 1998-12-07 2011-12-14 インフィネオン テクノロジーズ アーゲー Analog switch

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