JPH0831986B2 - Character / pattern memory playback device - Google Patents

Character / pattern memory playback device

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JPH0831986B2
JPH0831986B2 JP1085038A JP8503889A JPH0831986B2 JP H0831986 B2 JPH0831986 B2 JP H0831986B2 JP 1085038 A JP1085038 A JP 1085038A JP 8503889 A JP8503889 A JP 8503889A JP H0831986 B2 JPH0831986 B2 JP H0831986B2
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JP
Japan
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character
memory
pattern information
circuit
video signal
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恵爾 木村
好宏 西田
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Description

【発明の詳細な説明】 〈産業上の利用分野〉 本発明は、タイトル文字あるいは図形等の画像パター
ン等を記憶し、他の映像に重ねて出力することの出来る
文字・パターン記憶装置に関するものである。
TECHNICAL FIELD The present invention relates to a character / pattern storage device capable of storing an image pattern such as a title character or a graphic, and outputting the image pattern superimposed on another image. is there.

〈従来の技術〉 近年、家庭用VTRの普及にともない家庭用ビデオカメ
ラの需要が増加し、家庭用ビデオカメラの多機能化及び
編集機能等に対する要求が高まつてきた。
<Prior Art> In recent years, with the spread of home VTRs, the demand for home video cameras has increased, and demands for multifunctional and editing functions of home video cameras have increased.

これらの機能の中で、タイトル等の挿入を行うインポ
ーズ及びテロツパ等特に要求の多い機能の一つである。
Among these functions, it is one of the most demanded functions such as imposing for inserting a title and terrorism.

以下、従来のタイトル等の挿入を行うテロツプ装置に
ついて、第4図を用いて説明する。第4図において、
(1)はビデオ信号入力端子、(2)は文字・パターン
情報を抽出する検出回路、(3)はビデオ信号入力から
同期信号を分離する同期分離回路、(4)はシリアルパ
ラレル変換回路、(5)はパラレルシリアル変換回路、
(6)はメモリ、(7)は基準クロツクの発振回路、
(8)(9)はそれぞれメモリ(6)のアドレスを指令
する垂直カウンタ、水平カウンタ、(10)は同期分離回
路(3)及び発振回路(7)から垂直カウンタ(8)、
水平カウンタ(9)のアツプダウンのタイミングを制御
する分周回路、(11)はコントローラ、(12)はスイツ
チ等のユーザーの指令信号、(13)は文字・パターン情
報を他のビデオ信号と重畳するための文字重畳回路、
(14)はビデオ信号出力端子である。
A conventional telop device for inserting a title or the like will be described below with reference to FIG. In FIG.
(1) is a video signal input terminal, (2) is a detection circuit that extracts character / pattern information, (3) is a synchronization separation circuit that separates a synchronization signal from a video signal input, (4) is a serial-parallel conversion circuit, 5) is a parallel-serial conversion circuit,
(6) is a memory, (7) is a reference clock oscillation circuit,
(8) and (9) are vertical counters and horizontal counters that respectively instruct addresses of the memory (6), and (10) is a vertical counter (8) from the sync separation circuit (3) and the oscillation circuit (7),
A frequency dividing circuit for controlling the up-down timing of the horizontal counter (9), (11) a controller, (12) a user command signal such as a switch, and (13) superimposing character / pattern information on another video signal. Character superposition circuit for
(14) is a video signal output terminal.

まず、文字・パターン信号の主な流れを説明する。ビ
デオ信号入力端子(1)により入力されたビデオ信号
は、同期分離回路(3)により同期信号が作成されると
同時に、検出回路(2)により二値化されデジタル信号
となる。このデジタル信号は、シリアルパラレル変換回
路(4)により8ビツト等のデジタル信号となりメモリ
(6)に記憶される。またメモリ(6)に記憶された文
字・パターン等の情報である8ビツト等のデジタル信号
は、パラレルシリアル変換回路(5)によりシリアルデ
ジタル信号となり文字重畳回路(13)により本来のビデ
オ信号に重畳された形でビデオ出力端子(14)に出力さ
れる。
First, the main flow of the character / pattern signal will be described. The video signal input from the video signal input terminal (1) is converted into a digital signal by the detection circuit (2) at the same time that a synchronization signal is generated by the synchronization separation circuit (3). This digital signal becomes a digital signal of 8 bits or the like by the serial / parallel conversion circuit (4) and is stored in the memory (6). A digital signal of 8 bits or the like, which is information such as characters and patterns stored in the memory (6), becomes a serial digital signal by the parallel-serial conversion circuit (5) and is superimposed on the original video signal by the character superposition circuit (13). Output to the video output terminal (14).

以上のような動作を実現するため、本回路の発振回路
(7)で基準クロツクを作成し、この基準クロツクをシ
リアルパラレル変換回路(4)及びパラレルシリアル変
換回路(5)に供給し変換タイミングを与える。また、
このクロツクは分周回路(10)により分周された後、メ
モリ(6)の下位ビツトのアドレス指定カウンタである
水平カウンタ(9)に供給され、メモリ(6)のアドレ
ス指定を行う。水平カウンタ(9)の桁上げ信号は、メ
モリ(6)の上位ビツトのアドレス指定カウンタである
垂直カウンタ(8)に供給されメモリ(6)のアドレス
指定を行う。また、コントローラ(11)は、スイツチ等
の指令信号(12)により文字・パターンの書き込みまた
は読み込みかを指定される。これによりコントローラ
(11)は、メモリ(6)、シリアルパラレル変換回路
(4)、パラレルシリアル変換回路(5)、水平カウン
タ(9)、垂直カウンタ(8)、分周回路(10)、発振
回路(7)を動作または非動作状態にする。コントロー
ラ(11)は、同期分離回路(3)により供給された同期
信号を基準にして、1フイールドの始点で水平カウンタ
(9)、垂直カウンタ(8)のリセツトを行い、画面内
のパターン、文字等の位置とメモリ(6)のアドレスと
の相関をとる。ここで、メモリへの書き込み動作タイミ
ングについて説明する。例えば8ビツト構成のメモリの
場合には、第5図の様になり、メモリの1ビツト分、す
なわち1画素分にあたるシリアルデータクロツク(A)
に対して、メモリのアドレスは、8画素分毎に変化させ
る。さらにメモリへの書き込みのデータのシリアル・パ
ラレル変換タイミングを変換パルス(C)により行な
い、メモリへの書き込みは、次の変換パルス(C)が来
るまでのメモリライト(D)に表示している期間に行な
う。
In order to realize the above operation, a reference clock is created by the oscillation circuit (7) of this circuit, and this reference clock is supplied to the serial-parallel conversion circuit (4) and the parallel-serial conversion circuit (5) to convert the conversion timing. give. Also,
This clock is divided by a frequency dividing circuit (10) and then supplied to a horizontal counter (9) which is an addressing counter of a lower bit of the memory (6) to address the memory (6). The carry signal of the horizontal counter (9) is supplied to the vertical counter (8), which is the upper bit addressing counter of the memory (6), to address the memory (6). Further, the controller (11) is designated by a command signal (12) such as a switch to write or read a character / pattern. As a result, the controller (11) has a memory (6), a serial-parallel conversion circuit (4), a parallel-serial conversion circuit (5), a horizontal counter (9), a vertical counter (8), a frequency dividing circuit (10), and an oscillation circuit. (7) is set to the operating or non-operating state. The controller (11) resets the horizontal counter (9) and the vertical counter (8) at the start point of one field with the sync signal supplied by the sync separation circuit (3) as a reference, and patterns and characters on the screen are displayed. Correlation is made between the positions such as and the address of the memory (6). Here, the write operation timing to the memory will be described. For example, in the case of a memory having an 8-bit structure, the result is as shown in FIG. 5, and one bit of the memory, that is, one pixel worth of serial data clock (A).
On the other hand, the address of the memory is changed every 8 pixels. Further, the serial / parallel conversion timing of the data to be written to the memory is performed by the conversion pulse (C), and the writing to the memory is performed during the period displayed on the memory write (D) until the next conversion pulse (C) comes. To do.

〈発明が解決しようとする課題〉 以上、従来の文字・パターン記憶再生装置について述
べたが、従来の文字・パターン記憶再生装置では、前回
メモリに記憶された情報を消さずに、新たな文字・パタ
ーン情報をメモリに加算記憶(アドオンと称す)し再生
することが出来なかつた。本発明の目的は、家庭用ビデ
オカメラ等において、文字・パターン情報を加算記憶
(アドオン)し、再生出来る文字・パターン記憶再生装
置を提供することにある。
<Problems to be Solved by the Invention> The conventional character / pattern storage / reproduction device has been described above. However, in the conventional character / pattern storage / reproduction device, a new character / pattern storage / reproduction device is used without erasing the information previously stored in the memory. The pattern information could not be added and stored in the memory (called add-on) and played back. It is an object of the present invention to provide a character / pattern storage / reproduction device capable of additionally storing (add-on) character / pattern information and reproducing it in a home video camera or the like.

〈課題を解決するための手段〉 この発明に係る文字・パターン記憶再生装置は、所定
の画面サイズを有し外部から入力される第1の入力ビデ
オ信号をデジタル化して文字・パターン情報を形成する
文字・パターン情報形成手段と、該文字・パターン情報
形成手段により形成された文字・パターン情報を記憶す
るメモリ手段と、該メモリ手段より文字・パターン情報
を読み出すとともにこれを第2の入力ビデオ信号に加算
重畳して出力ビデオ信号を形成する出力ビデオ信号形成
手段と、上記メモリ手段に記憶された文字・パターン情
報にこれと同じ画面サイズを有し外部から入力される別
の文字・パターン情報を加算して該メモリ手段に再記憶
する再記憶手段とを備えるようにしたものである。
<Means for Solving the Problem> A character / pattern storage / reproduction device according to the present invention forms a character / pattern information by digitizing a first input video signal having a predetermined screen size and input from the outside. Character / pattern information forming means, memory means for storing the character / pattern information formed by the character / pattern information forming means, character / pattern information is read from the memory means, and this is used as a second input video signal. Output video signal forming means for adding and superimposing to form an output video signal, and another character / pattern information having the same screen size and inputted from the outside to the character / pattern information stored in the memory means are added. And re-storing means for re-storing in the memory means.

〈作用〉 この発明においては、上述のように構成したことによ
り、現在、メモリに記憶されている文字・パターン情報
を消さずに、新たな入力情報を加算記憶(アドオンと称
す)して、文字・パターン画として再生出来る。
<Operation> According to the present invention, with the configuration described above, new input information is added and stored (referred to as an add-on) without deleting the character / pattern information currently stored in the memory, and the character・ Can be played as a pattern image.

〈発明の実施例〉 以下、この発明の実施例を図面を用いて説明する。<Examples of the Invention> Examples of the present invention will be described below with reference to the drawings.

第1図は、本発明による文字・パターン記憶再生装置
の一実施例を示すブロツク図である。第1図において、
(1)はビデオ信号入力端子、(2)は文字・パターン
情報を抽出する検出回路、(3)はビデオ信号入力から
同期信号を分離する同期分離回路、(4)はシリアルパ
ラレル変換回路、(5)はパラレルシリアル変換回路、
(6)はメモリ、(7)は基準クロツクの発振回路、
(8)(9)はそれぞれメモリ(6)のアドレスを指令
する垂直カウンタ、水平カウンタ、(12)はスイツチ等
のユーザーの指令信号、(13)は文字・パターン情報を
他のビデオ信号と重畳するための文字重畳回路、(14)
はビデオ出力端子、(11)は指令信号(12)及び同期分
離回路(3)からの同期信号を入力し、垂直カウンタ
(8)、水平カウンタ(9)のカウント及びリセツトの
タイミングやメモリ(6)の読み出し、書き込みを制御
するコントローラ、(15)は加算ゲートでメモリから読
み出された信号をイネーブルするAND回路(16)と、AND
回路(16)からの信号と、シリアル・パラレル変換回路
(4)からの入力信号を加算するOR回路(17)で構成さ
れている。(18)はアドオン指令信号である。
FIG. 1 is a block diagram showing an embodiment of a character / pattern storage / reproduction device according to the present invention. In FIG.
(1) is a video signal input terminal, (2) is a detection circuit that extracts character / pattern information, (3) is a synchronization separation circuit that separates a synchronization signal from a video signal input, (4) is a serial-parallel conversion circuit, 5) is a parallel-serial conversion circuit,
(6) is a memory, (7) is a reference clock oscillation circuit,
(8) and (9) are vertical counters and horizontal counters for instructing the addresses of the memory (6), (12) is a user command signal such as a switch, and (13) is superimposition of character / pattern information on other video signals. Character superposition circuit for, (14)
Is a video output terminal, (11) is a command signal (12) and the sync signal from the sync separation circuit (3) is input, and the count and reset timings of the vertical counter (8) and horizontal counter (9) and the memory (6 ) Is a controller for controlling reading and writing, and (15) is an AND circuit (16) for enabling a signal read from the memory by an addition gate and an AND circuit (16).
It is composed of an OR circuit (17) for adding a signal from the circuit (16) and an input signal from the serial / parallel conversion circuit (4). (18) is an add-on command signal.

第1図において、指令信号(12)により、コントロー
ラ(11)の制御でビデオ信号入力端子(1)の信号をメ
モリ(6)に記憶し、他のビデオ入力信号の時にメモリ
(6)から読み出し文字重畳回路(13)で加算して、ビ
デオ信号出力端子(14)から出力する動作は従来例と同
じである。
In FIG. 1, the signal of the video signal input terminal (1) is stored in the memory (6) under the control of the controller (11) by the command signal (12), and is read out from the memory (6) at the time of another video input signal. The operation of adding in the character superimposing circuit (13) and outputting from the video signal output terminal (14) is the same as the conventional example.

いま、従来と同じ記憶の時は、アドオン信号(18)が
無しでコントローラ(11)からのイネーブル信号(a)
が“L"になり、AND回路の出力は全て“L"となる。した
がつてOR回路(16)の出力はシリアル・パラレル変換回
路(4)の出力と同じ信号となり、メモリ(6)に記憶
され、従来の文字・パターン重畳装置と同じ動作とな
る。次に、アドオンモードの時は、アドオン信号(18)
が有りとなりコントローラ(11)からのイネーブル信号
(a)が“H"となる。いま例として8ビツトの場合につ
いて第2図を使つて説明すると、メモリ(6)への書き
込みデータのシリアル・パラレル変換パルスが出てから
次のシリアル・パラレル変換パルスが出るまでの期間を
メモリリード/ライト(D)の様に、1サイクルの前半
をリードとし書き込むべきアドレスのメモリ(6)の内
容を読み出し、リードデータラツチパルス(E)でラツ
チし、8ビツトのOR回路(17)で、前記、シリアル・パ
ラレル変換パルスで変換されたデータと加算され、1サ
イクルの後半をライトとしメモリ(6)に書き込む、こ
の時の論理は例えば次の様になる。
Now, with the same memory as before, the enable signal (a) from the controller (11) without the add-on signal (18)
Becomes "L", and all outputs of the AND circuit become "L". Therefore, the output of the OR circuit (16) becomes the same signal as the output of the serial / parallel conversion circuit (4) and is stored in the memory (6), and the same operation as that of the conventional character / pattern superposing device is performed. Next, when in add-on mode, add-on signal (18)
Is present, the enable signal (a) from the controller (11) becomes "H". As an example, the case of 8 bits will be explained with reference to FIG. 2. The period from the output of the serial / parallel conversion pulse of the write data to the memory (6) to the output of the next serial / parallel conversion pulse is read from the memory. As in / write (D), the first half of one cycle is read and the contents of the memory (6) at the address to be written are read, latched by the read data latch pulse (E), and the 8-bit OR circuit (17) The data converted by the serial / parallel conversion pulse is added, and the latter half of one cycle is written as a write and written in the memory (6). The logic at this time is as follows, for example.

以上の様にメモリ(6)への書き込みを行なえば、第
3図の様に、前回までに記憶した情報(m)に今回の入
力情報(n)が、加算記憶されてメモリのパターン・文
字情報(l)となり、最終的に他の映像入力と加算重畳
され再生出力(K)となる。ここで加算ゲート(15)は
前記〔論理表〕を満たすものであれば、AND回路(1
6)、OR回路(17)の構成にかぎらないのは云うまでも
ない。
When the writing to the memory (6) is performed as described above, the input information (n) of this time is added and stored to the information (m) stored up to the previous time as shown in FIG. Information (1) is obtained, and finally it is added and superposed with another video input to become a reproduction output (K). If the addition gate (15) satisfies the above [logical table], the AND circuit (1
6), needless to say, it is not limited to the configuration of the OR circuit (17).

〈発明の効果〉 以上のように、この発明に係る文字・パターン記憶再
生装置によれば、所定の画面サイズを有し外部から入力
される第1の入力ビデオ信号をデジタル化して文字・パ
ターン情報を形成する文字・パターン情報形成手段と、
該文字・パターン情報形成手段により形成された文字・
パターン情報を記憶するメモリ手段と、該メモリ手段よ
り文字・パターン情報を読み出すとともにこれを第2の
入力ビデオ信号に加算重畳して出力ビデオ信号を形成す
る出力ビデオ信号形成手段と、上記メモリ手段に記憶さ
れた文字・パターン情報にこれと同じ画面サイズを有し
外部から入力される別の文字・パターン情報を加算して
該メモリ手段に再記憶する再記憶手段とを備えるように
したので、メモリに記憶されている情報を消さずに新し
い文字・パターン情報を加算記憶し再生出来る。
<Effect of the Invention> As described above, according to the character / pattern storage / reproduction device of the present invention, the character / pattern information is obtained by digitizing the first input video signal having a predetermined screen size and input from the outside. Character / pattern information forming means for forming
Characters formed by the character / pattern information forming means
Memory means for storing pattern information; output video signal forming means for reading character / pattern information from the memory means and adding and superposing this on the second input video signal to form an output video signal; Since the stored character / pattern information is provided with a re-storing means for adding another character / pattern information having the same screen size as that of this and input from the outside and storing again in the memory means, New character / pattern information can be added and stored and played back without erasing the information stored in.

【図面の簡単な説明】[Brief description of drawings]

第1図、第2図、第3図は本発明の一実施例を示す図
で、第1図は構成を示すブロツク図、第2図はメモリ記
憶タイミング図、第3図は動作例画面図である。第4
図、第5図は従来例を示す図で、第4図は構成を示すブ
ロツク図、第5図はメモリ記憶タイミング図である。 2:検出回路、4:シリアルパラレル変換回路、5:パラレル
シリアル変換回路、6:メモリ、11:コントローラ、13:文
字重畳回路、15:加算ゲート、16:AND回路、17:OR回路、
18:アドオン信号 なお、図中、同一符号は同一、または相当部分を示す。
FIGS. 1, 2 and 3 are diagrams showing an embodiment of the present invention. FIG. 1 is a block diagram showing the configuration, FIG. 2 is a memory storage timing diagram, and FIG. 3 is an operation example screen diagram. Is. Fourth
5 and 5 are diagrams showing a conventional example, FIG. 4 is a block diagram showing the configuration, and FIG. 5 is a memory storage timing diagram. 2: Detection circuit, 4: Serial-parallel conversion circuit, 5: Parallel-serial conversion circuit, 6: Memory, 11: Controller, 13: Character superposition circuit, 15: Addition gate, 16: AND circuit, 17: OR circuit,
18: Add-on signal In the drawings, the same reference numerals indicate the same or corresponding parts.

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】所定の画面サイズを有し外部から入力され
る第1の入力ビデオ信号をデジタル化して文字・パター
ン情報を形成する文字・パターン情報形成手段と、 該文字・パターン情報形成手段により形成された文字・
パターン情報を記憶するメモリ手段と、 該メモリ手段より文字・パターン情報を読み出すととも
にこれを第2の入力ビデオ信号に加算重畳して出力ビデ
オ信号を形成する出力ビデオ信号形成手段と、 上記メモリ手段に記憶された文字・パターン情報にこれ
と同じ画面サイズを有し外部から入力される別の文字・
パターン情報を加算して該メモリ手段に再記憶する再記
憶手段とを備えたことを特徴とする文字・パターン記憶
再生装置。
1. A character / pattern information forming means for digitizing a first input video signal having a predetermined screen size and inputted from the outside to form character / pattern information, and the character / pattern information forming means. Formed characters
Memory means for storing pattern information; output video signal forming means for reading out character / pattern information from the memory means and adding and superposing this on the second input video signal to form an output video signal; Another character that has the same screen size as the stored character / pattern information and is input from the outside
A character / pattern storing / reproducing apparatus comprising: a re-storing unit that adds pattern information and stores it again in the memory unit.
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