JPH0694772A - Binary signal detection circuit having abnormality detecting function - Google Patents

Binary signal detection circuit having abnormality detecting function

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JPH0694772A
JPH0694772A JP4269729A JP26972992A JPH0694772A JP H0694772 A JPH0694772 A JP H0694772A JP 4269729 A JP4269729 A JP 4269729A JP 26972992 A JP26972992 A JP 26972992A JP H0694772 A JPH0694772 A JP H0694772A
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JP
Japan
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potential
input
comparator
transistor
resistor
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Application number
JP4269729A
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Japanese (ja)
Inventor
Kazuhiro Shimizu
和洋 清水
Tetsushi Haseda
哲志 長谷田
Yoshihiko Tsuzuki
嘉彦 都築
Mitsuo Nakamura
三津男 中村
Takashi Inaba
隆史 稲葉
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Denso Corp
Original Assignee
NipponDenso Co Ltd
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Publication date
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  • Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)
  • Steering Control In Accordance With Driving Conditions (AREA)

Abstract

PURPOSE:To detect trouble such as disconnection or earthing without delay. CONSTITUTION:The first resistor R11 connected to a transistor T-1 in parallel, the second resistors R22, R23 connected across an input terminal IN and earth, a first comparator CMP1 inputting the input potential Vin proportional to the potential of the input temtinal IN and first reference potential Vref1, a second comparator CMP2 inputting the input potential Vin and third reference potential Vref2 and a third comparator CMP3 inputting the input potential Vin and third reference potential Vref3 are provided. By setting the first, second and third reference potentials Vref1, Vref2, Vref3 to predetermined relation, the output level of the first comparator is changed corresponding to ON/OFF of the transistor and, in the case of earthing trouble and disconnection trouble, the outputs of the second and third comparators can be reversed and abnormality can be detected on the basis of this reversal without delay.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、センサ部と受信回路と
を離間して設けた2値信号検出回路の異常検出機能を有
する回路に関する。例えば、自動車における各物理量を
2値信号で検出する操舵角検出回路、車速検出回路等の
各種の検出回路に応用できる。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a circuit having a function of detecting an abnormality of a binary signal detecting circuit provided with a sensor section and a receiving circuit separated from each other. For example, it can be applied to various detection circuits such as a steering angle detection circuit and a vehicle speed detection circuit that detect each physical quantity in a vehicle by a binary signal.

【0002】[0002]

【従来技術】従来、4輪操舵装置においては、操舵角を
検出して、その操舵角に応じて後輪を操舵することが行
われている。この場合、センサ部はステアリングシャフ
ト部分に取付けられ、受信回路は各種の制御装置の配設
されている車体本体に配設され、センサ部と受信回路と
の間は比較的長い配線で接続されている。そして、セン
サ部はホールIC、ホトカプラ等で構成されており、ス
テアリングシャフトの回転に伴って2値信号のパルス列
が出力され、このパルス列を計数することで、回転角を
検出するようにしている。以上の構成の4輪操舵装置に
おいては、操舵角を誤りなく検出することが必要であ
り、配線の電源への短絡、接地、断線等が発生した場合
には、直ちに、後輪の操舵を停止することが必要とな
る。
2. Description of the Related Art Conventionally, in a four-wheel steering system, a steering angle is detected and the rear wheels are steered according to the steering angle. In this case, the sensor part is attached to the steering shaft part, the receiving circuit is arranged in the body of the vehicle in which various control devices are arranged, and the sensor part and the receiving circuit are connected by relatively long wiring. There is. The sensor unit is composed of a Hall IC, a photocoupler, and the like, and a pulse train of a binary signal is output as the steering shaft rotates, and the rotation angle is detected by counting this pulse train. In the four-wheel steering system configured as described above, it is necessary to detect the steering angle without error, and in the event of a short circuit to the power source of the wiring, grounding, disconnection, etc., immediately stop the steering of the rear wheels. Will be required.

【0003】[0003]

【発明が解決しようとする課題】上記のように、操舵角
センサの出力の異常においては、特開平3−11497
3号公報に記載されたように、操舵角センサの出力信号
レベルが所定時間以上連続して変化しない状態が検出さ
れた時を異常検出とすることが行われている。従って、
異常検出が異常発生時に対して上記の所定時間だけ遅延
し、フエイルセーフが遅れるという問題がある。
As described above, when the output of the steering angle sensor is abnormal, Japanese Patent Laid-Open No. 11497/1991 is available.
As described in Japanese Patent No. 3, the abnormality detection is performed when the state where the output signal level of the steering angle sensor does not continuously change for a predetermined time or longer is detected. Therefore,
There is a problem that the abnormality detection is delayed by the above-mentioned predetermined time with respect to the occurrence of the abnormality, and the fail safe is delayed.

【0004】本発明は、上記の課題を解決するために成
されたものであり、その目的は、センサ部と受信回路と
が配線により接続された2値信号検出回路において、配
線の断線、接地、電源への短絡等の故障に対して、遅延
なく異常を検出することである。
The present invention has been made to solve the above problems, and an object thereof is to disconnect a wire or ground in a binary signal detection circuit in which a sensor section and a receiving circuit are connected by a wire. For a failure such as a short circuit to the power supply, it is to detect an abnormality without delay.

【0005】[0005]

【課題を解決するための手段】本発明の構成は、第1
に、エミッタ又はソース接地、オープンコレクタ又はオ
ープンドレイン構造の出力段トランジスタのオンオフに
応じて2値信号を出力するセンサ部と、トランジスタの
コレクタ又はドレインと受信回路との間に配設された配
線と、配線の受信回路側の入力端子を負荷抵抗を介して
基準電源に接続し、入力端子の電位に比例した電位を2
値信号の受信信号とする受信回路とを有する検出回路で
ある。そして、この検出回路において、トランジスタの
両端子間に接続された第1抵抗と、入力端子とアース間
に接続された第2抵抗と、入力端子の電位に比例した入
力電位及び第1基準電位を入力する第1コンパレータ
と、入力電位及び第2基準電位を入力する第2コンパレ
ータと、入力電位及び第3基準電位を入力する第3コン
パレータとが設けられている。さらに、第1基準電位
は、トランジスタがオフ状態にある時の入力電位とトラ
ンジスタがオン状態にある時の入力電位との間の電位
に、第2基準電位は、トランジスタがオン状態にある時
の入力電位とアース電位との間の電位に、第3基準電位
は、トランジスタがオフ状態にある時の入力電位と配線
が断線した状態にある時の入力電位との間の電位に、そ
れぞれ、設定されている。そして、第1コンパレータの
出力を2値信号の正常な検出信号とし、第2、第3コン
パレータの出力に応じて、異常検出を行う。
The constitution of the present invention is as follows:
A sensor section for outputting a binary signal in response to ON / OFF of an output stage transistor having an emitter or source grounded, open collector or open drain structure, and wiring arranged between the collector or drain of the transistor and the receiving circuit. , Connect the input terminal on the receiving circuit side of the wiring to the reference power source via the load resistance, and set the potential proportional to the potential of the input terminal to 2
It is a detection circuit which has a receiving circuit which makes it a received signal of a value signal. Then, in this detection circuit, a first resistor connected between both terminals of the transistor, a second resistor connected between the input terminal and ground, an input potential proportional to the potential of the input terminal, and a first reference potential are provided. A first comparator for inputting, a second comparator for inputting an input potential and a second reference potential, and a third comparator for inputting an input potential and a third reference potential are provided. Further, the first reference potential is a potential between the input potential when the transistor is in the off state and the input potential when the transistor is in the on state, and the second reference potential is the potential when the transistor is in the on state. The third reference potential is set to a potential between the input potential and the ground potential, and the third reference potential is set to a potential between the input potential when the transistor is off and the input potential when the wiring is disconnected. Has been done. Then, the output of the first comparator is used as a normal detection signal of a binary signal, and abnormality detection is performed according to the outputs of the second and third comparators.

【0006】[0006]

【作用】正常時には、入力電位は、トランジスタがオン
状態にある時のエミッタ又はソース、コレクタ又はドレ
イン間電圧(トランジスタのオン電圧)に応じた電位
(以下、「Lレベル」という)と、トランジスタがオフ
状態にある時の入力端子に比例した電位(入力電位)、
即ち、基準電源電圧を負荷抵抗と、第1抵抗と第2抵抗
とを並列接続した抵抗とで分圧した電位に比例した電位
(以下、「Hレベル」という)の2値をとる。第1基準
電位は、LレベルとHレベルの間に設定されているの
で、第1コンパレータの出力レベルはトランジスタのオ
ンオフに応じて変化することになり、正常な2値信号の
検出が行われる。一方、第2基準電位はアースレベルと
Lレベルとの間の電位に設定されているので、入力電位
がLレベルとHレベルとで変化しても、第2コンパレー
タの出力レベルは変化しない。又、第3基準電位はHレ
ベルと、配線が断線した時の入力端子の電位に比例した
電位、即ち、基準電源電圧を負荷抵抗と第2抵抗とで分
圧した電位に比例した電位(以下、「SHレベル」と言
う。第1抵抗への電流の分流がないので、|SHレベル
|≧|Hレベル|である。)との間の電位に設定されて
いるので、入力電位がLレベルとHレベルとで変化して
も、第3コンパレータの出力レベルは変化しない。第2
及び第3コンパレータの出力が上記のレベルにある時、
2値信号の検出は正常と見なすことができる。
When the transistor is in a normal state, the input potential is a potential (hereinafter referred to as "L level") corresponding to the voltage between the emitter or the source, the collector or the drain when the transistor is in the ON state (hereinafter referred to as "L level"), and A potential (input potential) proportional to the input terminal when in the off state,
That is, the reference power supply voltage takes a binary value of a potential (hereinafter, referred to as “H level”) proportional to a potential obtained by dividing the reference power supply voltage by the load resistance and the resistance in which the first resistance and the second resistance are connected in parallel. Since the first reference potential is set between the L level and the H level, the output level of the first comparator changes according to the on / off state of the transistor, and a normal binary signal is detected. On the other hand, since the second reference potential is set to a potential between the ground level and the L level, the output level of the second comparator does not change even if the input potential changes between the L level and the H level. Further, the third reference potential is H level and a potential proportional to the potential of the input terminal when the wiring is broken, that is, a potential proportional to the potential obtained by dividing the reference power supply voltage by the load resistor and the second resistor (hereinafter , "SH level". Since there is no shunt of the current to the first resistor, it is set to a potential between | SH level | ≧ | H level |). Therefore, the input potential is L level. And H level, the output level of the third comparator does not change. Second
And when the output of the third comparator is at the above level,
Detection of a binary signal can be considered normal.

【0007】一方、配線がアースに接続した場合には、
入力電位はアース電位となる。よって、入力電位と第2
基準電位の大小関係が反転するので、第2コンパレータ
の出力レベルは反転する。これにより、配線がアースに
接続された故障が発生したことが、直ちに、検出され
る。
On the other hand, when the wiring is connected to the ground,
The input potential is the ground potential. Therefore, the input potential and the second
Since the magnitude relationship of the reference potential is inverted, the output level of the second comparator is inverted. As a result, the occurrence of a failure in which the wiring is connected to the ground is immediately detected.

【0008】又、配線が断線した場合には、入力電位
は、SHレベルとなる。よって、入力電位と第3基準電
位との大小関係が反転するので、第3コンパレータの出
力レベルは反転する。これにより、配線が断線した故障
が発生したことが、直ちに、検出される。
When the wiring is broken, the input potential becomes SH level. Therefore, the magnitude relationship between the input potential and the third reference potential is inverted, so that the output level of the third comparator is inverted. As a result, it is immediately detected that the wiring has been broken.

【0009】さらに、配線が電源に接続された場合に
は、入力電位はSHレベルを越える。よって、断線故障
と同様に第3コンパレータの出力レベルが反転するの
で、これにより、配線の電源への接続故障を、直ちに、
検出することができる。
Furthermore, when the wiring is connected to the power supply, the input potential exceeds the SH level. Therefore, the output level of the third comparator is inverted similarly to the disconnection failure, so that the connection failure of the wiring to the power supply can be immediately
Can be detected.

【0010】[0010]

【発明の効果】本発明は、オープンコレクタ又はオープ
ンドレイン構造のトランジスタ、トランジスタに並列接
続された第1抵抗、基準電源とアース間に接続された負
荷抵抗と第2抵抗との直列接続により、負荷抵抗と第2
抵抗との接続点である入力端子の電位に比例した入力電
位は、正常時の2値信号のレベルと、配線の接地、断
線、電源への短絡等の故障時の電位とは別のレベルとな
る。よって、第2コンパレータと第3コンパレータの出
力レベルの変化により、異常検出を直ちに行うことが可
能となる。
According to the present invention, a transistor having an open collector or open drain structure, a first resistor connected in parallel with the transistor, a load resistor connected between a reference power source and ground, and a second resistor are connected in series to form a load. Resistance and second
The input potential, which is proportional to the potential of the input terminal, which is the connection point with the resistor, is different from the level of the binary signal in the normal state and the potential in the case of failure such as grounding, disconnection, or short circuit to the power supply. Become. Therefore, the abnormality detection can be immediately performed by the change in the output level of the second comparator and the third comparator.

【0011】[0011]

【実施例】以下、本発明を具体的な一実施例に基づいて
説明する。図2は4輪操舵装置を構成を示している。本
操舵装置では、、操舵角センサ12、車輪速度センサ1
3、車速センサ14、後輪操舵角センサ15からの出力
信号は、制御装置(ECU)10に入力される。これら
の信号に基づいてECU10で、後輪操舵角指令値が演
算され、その指令値はモータドライバ11に出力され
る。そして、モータドライバ11によりブラシレスモー
タ16が駆動され、後輪が指令値に応じて操舵される。
本4輪操舵装置は以上のように構成されており、上記の
各センサ12、13、14、15が本発明にかかる2値
信号検出回路のセンサ部となる。そして、受信回路は制
御装置10内に存在する。
EXAMPLES The present invention will be described below based on a specific example. FIG. 2 shows the configuration of the four-wheel steering system. In this steering device, the steering angle sensor 12 and the wheel speed sensor 1 are used.
3, output signals from the vehicle speed sensor 14 and the rear wheel steering angle sensor 15 are input to the control unit (ECU) 10. Based on these signals, the ECU 10 calculates a rear wheel steering angle command value, and the command value is output to the motor driver 11. Then, the brushless motor 16 is driven by the motor driver 11, and the rear wheels are steered according to the command value.
The four-wheel steering system is configured as described above, and each of the sensors 12, 13, 14, and 15 described above serves as the sensor unit of the binary signal detection circuit according to the present invention. The receiving circuit is present in the control device 10.

【0012】次に、本2値信号検出回路の詳細な構成を
図1に基づいて説明する。センサ部20は、軸の回転を
検出するホールIC21と、出力段トランジスタTr1
と、トランジスタTrに並列に接続された第1抵抗R11、
出力保護抵抗R1 とで構成されている。又、受信回路3
0は、基準電源V1(5V),負荷抵抗R21、保護ダイ
オードD1 、第2抵抗を構成する抵抗R22と抵抗R23、
第1コンパレータCMP1、第2コンパレータCMP2、第3コ
ンパレータCMP3とで構成されている。抵抗R4 、R5
は、コンパレータの出力のプルアップ抵抗である。本実
施例では、第2抵抗を抵抗R22と抵抗R23の直列接続で
構成している。入力端子INは配線40の受信回路30側
の端子である。抵抗R22と抵抗R23との接続点の電位が
入力電位Vinであり、入力電位Vinは、当然に、入力端
子INの電位に比例している。尚、抵抗R22と出力保護抵
抗R1 と保護ダイオードD1 は必ずしも必要ではない。
抵抗R22を設けない場合には、第2抵抗は抵抗R23だけ
で構成され、入力電位Vinは、入力端子INの電位に等し
くなる。
Next, the detailed structure of the binary signal detection circuit will be described with reference to FIG. The sensor unit 20 includes a Hall IC 21 that detects rotation of the shaft and an output stage transistor Tr1.
And a first resistor R11 connected in parallel with the transistor Tr,
It is composed of an output protection resistor R1. Also, the receiving circuit 3
0 is a reference power source V1 (5V), a load resistor R21, a protection diode D1, a resistor R22 and a resistor R23 which form a second resistor,
It is composed of a first comparator CMP1, a second comparator CMP2, and a third comparator CMP3. Resistance R4, R5
Is a pull-up resistor of the output of the comparator. In this embodiment, the second resistor is composed of a resistor R22 and a resistor R23 connected in series. The input terminal IN is a terminal of the wiring 40 on the receiving circuit 30 side. The potential at the connection point between the resistor R22 and the resistor R23 is an input voltage V in, input potential V in is in course, proportional to the potential of the input terminal IN. The resistor R22, the output protection resistor R1, and the protection diode D1 are not always necessary.
If no resistance R22 provided, the second resistor is constituted by only the resistance R23, the input potential V in is equal to the potential of the input terminal IN.

【0013】次に、この検出回路の動作について説明す
る。受信回路30の入力電位Vinは、 (1)配線40のバ
ッテリへの短絡故障、 (2)配線40の接地故障、 (3)配
線40の断線故障、 (4)正常時におけるトランジスタTr
1のオフ状態、及び、 (5)正常時におけるトランジスタ
Tr1のオン状態に応じて、5レベルをとり得る。以下、
上記5つの状態に別けて動作状態を説明する。
Next, the operation of this detection circuit will be described. The input potential V in of the receiving circuit 30 is (1) a short circuit failure of the wiring 40 to the battery, (2) a grounding failure of the wiring 40, (3) a disconnection failure of the wiring 40, and (4) a transistor Tr in a normal state.
1 OFF state, and (5) Normal transistor
It can take 5 levels depending on the ON state of Tr1. Less than,
The operation state will be described separately for the above five states.

【0014】(1)配線40のバッテリへの短絡故障 配線40のバッテリへの短絡故障が発生すると、短絡電
流はバッテリー→入力端子IN→抵抗R22→抵抗R23→グ
ラウンドと流れる。したがって、バッテリ電圧をVBATT
とすると、この時の入力電位をVin1は次式で表され
る。
(1) Short-circuit failure of the wiring 40 to the battery When a short-circuit failure of the wiring 40 to the battery occurs, a short-circuit current flows from battery → input terminal IN → resistor R22 → resistor R23 → ground. Therefore, the battery voltage is changed to V BATT.
Then, the input potential V in 1 at this time is represented by the following equation.

【数1】Vin1=VBATT・R23/(R22+R23)[ Equation 1] V in 1 = V BATT · R23 / (R22 + R23)

【0015】(2)配線40の接地故障 配線40の接地故障が発生すると入力端子INの電位は0
Vとなり、基準電源V1 →負荷抵抗R21→保護ダイオー
ドD1 →入力端子IN→配線40→グラウンドへ電流が流
れ、この時の入力電位Vin2はアース電位となる。よっ
て、
(2) Ground fault of wiring 40 When a ground fault of the wiring 40 occurs, the potential of the input terminal IN becomes zero.
The voltage becomes V, and a current flows from the reference power source V1 → load resistance R21 → protection diode D1 → input terminal IN → wiring 40 → ground, and the input potential V in 2 at this time becomes the ground potential. Therefore,

【数2】Vin2=0V[Formula 2] V in 2 = 0V

【0016】(3)配線40の断線故障 配線40の断線故障では、入力端子INからセンサ部20
を見たインピーダンスが無限大となるので、電流は、基
準電源V1 →負荷抵抗R21→保護ダイオードD1 →抵抗
R22→抵抗R23→グラウンドの経路で流れる。この故障
時の入力電位Vin3は、保護ダイオードD1 の順方向電
圧をVF とすると、
(3) Disconnection failure of the wiring 40 In the case of the disconnection failure of the wiring 40, the sensor unit 20 from the input terminal IN
Since the impedance seen is infinite, the current flows through the path of the reference power source V1, the load resistance R21, the protection diode D1, the resistance R22, the resistance R23, and the ground. When the forward voltage of the protection diode D1 is V F , the input potential V in 3 at the time of this failure is

【数3】 Vin3=(V1 −VF )・R23/(R21+R22+R23) となる。この電位が入力電位VinのSHレベルとなる。## EQU3 ## V in 3 = (V 1 −V F ) R23 / (R21 + R22 + R23) This potential becomes the SH level of the input potential V in .

【0017】(4)正常時におけるトランジスタTr1のオ
フ状態 トランジスタTr1 がオフ状態の時、電流は、基準電源V
1 →負荷抵抗R21→保護ダイオードD1 と流れ、保護ダ
イオードD1 から保護抵抗R1 →第1抵抗R11→グラウ
ンドの経路と、負荷抵抗R22→負荷抵抗R23→グラウン
ドの経路との2つの経路に分流する。この時の入力電位
in4は、
(4) Off state of transistor Tr1 in normal state When transistor Tr1 is off, the current is the reference power source V
1 → Load resistance R21 → Protection diode D1 and flows from the protection diode D1 into two paths: protection resistance R1 → first resistance R11 → ground path and load resistance R22 → load resistance R23 → ground path. The input potential V in 4 at this time is

【数4】Vin4=(V1 −VF)・R23(R1+R11)/
〔(R1 +R11)(R22+R23)+R21{ (R1 +R11)
+ (R22+R23) }] となる。この電位が入力電位VinのHレベルである。
[Formula 4] V in 4 = (V 1 −V F ) · R 23 (R 1 + R 11) /
[(R1 + R11) (R22 + R23) + R21 {(R1 + R11)
+ (R22 + R23)}]. This potential is the H level of the input potential V in .

【0018】(5)正常時におけるトランジスタTr1のオ
ン状態 トランジスタTr1 がオン状態の時、電流は、基準電源V
1 →負荷抵抗R21→保護抵抗D1 と流れ、保護ダイオー
ドD1 から保護抵抗R1 →トランジスタTr1 →グラウン
ドの経路と、負荷抵抗R22→負荷抵抗R23→グラウンド
の経路との2つの経路に分流する。この時の入力電位V
in5は、トランジスタTr1 のオン時のコレクタ・エミッ
タ間電圧をVCEとすると、
(5) ON state of transistor Tr1 in normal state When the transistor Tr1 is in the ON state, the current is the reference power source V
1 → load resistance R21 → protection resistance D1 and flows from the protection diode D1 into two paths: protection resistance R1 → transistor Tr1 → ground path and load resistance R22 → load resistance R23 → ground path. Input potential V at this time
In 5, when the collector-emitter voltage when the transistor Tr1 is on is V CE ,

【数5】Vin5=(V1 −VF)・R1・R23/R21
(R1+R22+R23)+VCE・R23/(R1+R22+R2
3) となる。この電位が入力電位VinのLレベルである。
[Equation 5] V in 5 = (V1 −V F ) · R1 · R23 / R21
(R1 + R22 + R23) + V CE・ R23 / (R1 + R22 + R2
3) This potential is the L level of the input potential V in .

【0019】ここで、上記5つの式の入力電位Vinの大
小関係が、Vin2<Vin5<Vin4<Vin3<Vin1と
なるように各抵抗値を定める。さらに、第1、第2、第
3コンパレータCMP1〜CMP3の第1、第2、第3
基準電位Vref 1 〜Vref 3を、それぞれ、Vin5<V
ref 1 <Vin4、Vin2<Vref 2<Vin5、Vin4<
ref 3<Vin3と定める。そして、基準電位Vref 1
を第1コンパレータCMP1の反転入力端子に、第2基
準電位Vref 2を第2コンパレータCMP2の反転入力
端子に、第3基準電位Vref 3を第3コンパレータCM
P3の非反転入力端子に、それぞれ、印加する。
Here, each resistance value is determined so that the magnitude relationship of the input potentials V in in the above five equations is V in 2 <V in 5 <V in 4 <V in 3 <V in 1. Furthermore, the first, second, and third comparators CMP1 to CMP3 have the first, second, and third comparators CMP1 to CMP3.
The reference potentials V ref 1 to V ref 3 are respectively V in 5 <V
ref 1 <V in 4, V in 2 <V ref 2 <V in 5, V in 4 <
It is defined that V ref 3 <V in 3. Then, the reference potential V ref 1
To the inverting input terminal of the first comparator CMP1, the second reference potential V ref 2 to the inverting input terminal of the second comparator CMP2, and the third reference potential V ref 3 to the third comparator CM.
It is applied to the non-inverting input terminal of P3.

【0020】この状態で、第1コンパレータCMP1の
出力は、トランジスタTr1 がオン状態の時Lレベルとな
り、トランジスタTr1 がオフ状態の時Hレベルとなる。
よって、第1コンパレータCMP1の出力端子に接続さ
れたプルアップ抵抗R4によりECU10には、それぞ
れ、トランジスタTr1 のオンオフに応じて電圧0V及び
5Vが入力される。又、第2コンパレータCMP2の出
力は、配線40が接地故障の時、Lレベルとなり、その
他の場合にはHレベルとなる。又、第3コンパレータC
MP3の出力レベルは、配線40が断線故障およびバッ
テリ短絡故障した時、Lレベルとなり、その他の場合に
はHレベルとなる。第2コンパレータCMP2と第3コ
ンパレータCMP3との出力は、それぞれ、同一のプル
アップ抵抗R5に接続されているので、配線40の接地
故障、断線故障、バッテリ短絡故障等の異常時に0Vの
出力電圧がECU10に入力され、正常時には5Vの出
力電圧がECU10に入力される。
In this state, the output of the first comparator CMP1 becomes L level when the transistor Tr1 is in the ON state, and becomes H level when the transistor Tr1 is in the OFF state.
Therefore, the pull-up resistor R4 connected to the output terminal of the first comparator CMP1 inputs the voltages 0V and 5V to the ECU 10 according to the on / off state of the transistor Tr1. The output of the second comparator CMP2 becomes L level when the wiring 40 has a ground fault, and becomes H level in other cases. Also, the third comparator C
The output level of MP3 becomes L level when the wire 40 has a disconnection failure and a battery short-circuit failure, and otherwise becomes H level. Since the outputs of the second comparator CMP2 and the third comparator CMP3 are connected to the same pull-up resistor R5, respectively, the output voltage of 0V is output when the wiring 40 has an abnormality such as a ground fault, a disconnection fault, or a battery short-circuit fault. The output voltage of 5 V is input to the ECU 10, and when normal, the output voltage of 5 V is input to the ECU 10.

【0021】よって、ECU10は、第1コンパレータ
CMP1の出力をセンサ出力信号(2値信号)として読
取り、第2、第3コンパレータCMP2、CMP3の出
力をセンサ異常検出信号として読取り、センサ異常検出
信号が0Vの時、本検出回路に異常が発生したと見做し
て、センサ出力信号によっては、後輪の操舵を実行しな
いようにすることができる。このように、故障発生と同
時に第2、第3コンパレータCMP2、CMP3の出力
レベルは5Vから0Vに反転するので、異常検出が瞬時
に行われる。
Therefore, the ECU 10 reads the output of the first comparator CMP1 as a sensor output signal (binary signal), reads the outputs of the second and third comparators CMP2, CMP3 as a sensor abnormality detection signal, and outputs the sensor abnormality detection signal. When the voltage is 0 V, it can be considered that an abnormality has occurred in the detection circuit, and the steering of the rear wheels can be prevented from being executed depending on the sensor output signal. As described above, since the output levels of the second and third comparators CMP2 and CMP3 are inverted from 5V to 0V at the same time when the failure occurs, the abnormality detection is instantaneously performed.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の具体的な実施例に係る異常検出機能を
有した2値信号検出回路の構成を示した回路図。
FIG. 1 is a circuit diagram showing a configuration of a binary signal detection circuit having an abnormality detection function according to a specific embodiment of the present invention.

【図2】上記の検出回路を用いた4輪操舵装置の構成を
示した構成図。
FIG. 2 is a configuration diagram showing a configuration of a four-wheel steering system using the above detection circuit.

【符号の説明】[Explanation of symbols]

10…ECU 11…モータドライバ 12…操舵角センサ 13…車輪速度センサ 14…車速センサ 15…後輪操舵角センサ 20…センサ部 30…受信回路 40…配線 Tr1 …トランジスタ(オープンコレクタ構造のトランジ
スタ) R1 …出力保護抵抗 R11…第1抵抗 R21…負荷抵抗 R22,R23…第2抵抗 IN…入力端子 Vin…入力電位 CMP1…第1コンパレータ CMP2…第2コンパレータ CMP3…第3コンパレータ Vref 1 …第1基準電位 Vref 2 …第2基準電位 Vref 3 …第3基準電位 D1 …保護ダイオード
10 ... ECU 11 ... Motor driver 12 ... Steering angle sensor 13 ... Wheel speed sensor 14 ... Vehicle speed sensor 15 ... Rear wheel steering angle sensor 20 ... Sensor unit 30 ... Reception circuit 40 ... Wiring Tr1 ... Transistor (transistor of open collector structure) R1 ... output protection resistor R11 ... first resistor R21 ... load resistor R22, R23 ... second resistor iN ... input terminal V in ... input potential CMP1 ... first comparator CMP2 ... second comparator CMP3 ... third comparator V ref 1 ... first Reference potential V ref 2 ... Second reference potential V ref 3 ... Third reference potential D1 ... Protection diode

───────────────────────────────────────────────────── フロントページの続き (72)発明者 中村 三津男 愛知県刈谷市昭和町1丁目1番地 日本電 装株式会社内 (72)発明者 稲葉 隆史 愛知県刈谷市昭和町1丁目1番地 日本電 装株式会社内 ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Inventor Mitsuo Nakamura 1-1, Showa-cho, Kariya city, Aichi prefecture, Nihon Denso Co., Ltd. (72) Inventor Takashi Inaba 1-1-cho, Showa-cho, Kariya city, Aichi prefecture Within the corporation

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 エミッタ又はソース接地、オープンコレ
クタ又はオープンドレイン構造の出力段トランジスタの
オンオフに応じて2値信号を出力するセンサ部と、前記
トランジスタのコレクタ又はドレインと受信回路との間
に配設された配線と、前記配線の受信回路側の入力端子
を負荷抵抗を介して基準電源に接続し、前記入力端子の
電位に比例した電位を前記2値信号の受信信号とする受
信回路とを有する検出回路において、 前記トランジスタの両端子間に接続された第1抵抗と、 前記入力端子とアース間に配設された第2抵抗と、 前記入力端子の電位に比例した入力電位及び第1基準電
位を入力する第1コンパレータと、 前記入力電位及び第2基準電位を入力する第2コンパレ
ータと、 前記入力電位及び第3基準電位を入力する第3コンパレ
ータと を有し、 前記第1基準電位は、前記トランジスタがオフ状態にあ
る時の前記入力電位と前記トランジスタがオン状態にあ
る時の前記入力電位との間の電位に、 前記第2基準電位は、前記トランジスタがオン状態にあ
る時の前記入力電位とアース電位との間の電位に、 前記第3基準電位は、前記トランジスタがオフ状態にあ
る時の前記入力電位と前記配線が断線した状態にある時
の前記入力電位との間の電位に、それぞれ、設定されて
おり、 前記第1コンパレータの出力を前記2値信号の正常な検
出信号とし、前記第2、第3コンパレータの出力に応じ
て、異常検出を行う2値信号検出回路。
1. A sensor unit for outputting a binary signal according to ON / OFF of an output stage transistor having an emitter or source grounded, open collector or open drain structure, and disposed between a collector or drain of the transistor and a receiving circuit. And a receiving circuit that connects an input terminal on the receiving circuit side of the wiring to a reference power source via a load resistor and uses a potential proportional to the potential of the input terminal as a reception signal of the binary signal. In the detection circuit, a first resistor connected between both terminals of the transistor, a second resistor disposed between the input terminal and ground, an input potential proportional to the potential of the input terminal, and a first reference potential. A first comparator that inputs the input potential, a second comparator that inputs the input potential and a second reference potential, and a third comparator that inputs the input potential and a third reference potential. The first reference potential is a potential between the input potential when the transistor is in the off state and the input potential when the transistor is in the on state, and the second reference potential is Is a potential between the input potential and the ground potential when the transistor is in the on state, and the third reference potential is a state in which the wiring is disconnected from the input potential when the transistor is in the off state. The potential of the first comparator is set to a potential between the input potential and the output of the first comparator as a normal detection signal of the binary signal, depending on the outputs of the second and third comparators. And a binary signal detection circuit for detecting abnormality.
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Cited By (6)

* Cited by examiner, † Cited by third party
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