JPH0544228B2 - - Google Patents

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JPH0544228B2
JPH0544228B2 JP57070077A JP7007782A JPH0544228B2 JP H0544228 B2 JPH0544228 B2 JP H0544228B2 JP 57070077 A JP57070077 A JP 57070077A JP 7007782 A JP7007782 A JP 7007782A JP H0544228 B2 JPH0544228 B2 JP H0544228B2
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JP
Japan
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signal
recording
circuit
control circuit
power
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JP57070077A
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Japanese (ja)
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JPS58187080A (en
Inventor
Makoto Takayama
Susumu Kozuki
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Canon Inc
Original Assignee
Canon Inc
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Publication date
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Publication of JPS58187080A publication Critical patent/JPS58187080A/en
Publication of JPH0544228B2 publication Critical patent/JPH0544228B2/ja
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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N23/00Cameras or camera modules comprising electronic image sensors; Control thereof
    • H04N23/60Control of cameras or camera modules

Description

【発明の詳細な説明】 本発明は被写体像を電気信号に変換し、前記電
気信号を記録媒体上に記録するビデオ信号記録装
置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a video signal recording device that converts a subject image into an electrical signal and records the electrical signal on a recording medium.

かかるビデオ信号記録装置としては従来より、
動画を記録するビデオカメラ及びVTRより成る
システムが良く知られている。かかるビデオ信号
記録装置にあつては一般にテープをドラムにロー
デイングし、ヘツド及びキヤプスタンを回転させ
ておくスタンバイモードが存在する。このスタン
バイモードでトリガスイツチが操作されると同時
に実際の録画動作が実行される。
Conventionally, such video signal recording devices include:
Systems consisting of video cameras and VTRs that record moving images are well known. Such video signal recording devices generally have a standby mode in which the tape is loaded onto the drum and the head and capstan are kept rotating. In this standby mode, the actual recording operation is executed at the same time as the trigger switch is operated.

しかし、このスタンバイモードで待期する時間
が長いと電地寿命の点で問題がある。
However, if the waiting time in this standby mode is long, there is a problem in terms of the life of the battery.

また、撮像の為の撮像管域は記録の為のキヤプ
スタンモータ等が充分立ち上がつていない状態で
実際の録画動作を開始すると、動作開始から立上
るまでの時間は映像が正確に記録されない。この
ような事態の発生は特に静止画の記録の場合には
特に大きな問題となる。また、この状態で撮像素
子や信号処理回路を動作させることも省電力化を
図る上で問題となる。
In addition, if the actual recording operation is started before the capstan motor etc. for recording has sufficiently started up in the imaging control area for imaging, the time from the start of operation to the start up of the image will not be accurate. Not recorded. The occurrence of such a situation becomes a particularly serious problem especially when recording still images. Further, operating the image sensor and the signal processing circuit in this state also poses a problem in terms of power saving.

本発明は上述の点に鑑み、省電力の達成が可能
でしかも映像信号の正確な記録が可能なビデオ信
号記録装置の提供を目的としている。
In view of the above-mentioned points, it is an object of the present invention to provide a video signal recording device capable of achieving power saving and accurately recording video signals.

以下本発明の実施例を図面に従い詳細に説明す
る。
Embodiments of the present invention will be described in detail below with reference to the drawings.

本明細書中の実施例では磁気デイスクを媒体と
した静止画のビデオシステムについて説明する
が、本発明はこれに限られるものではない。
Although the embodiments in this specification describe a still image video system using a magnetic disk as a medium, the present invention is not limited to this.

第1図はスチールビデオカメラの構成の一実施
例をを示すブロツク図である。
FIG. 1 is a block diagram showing one embodiment of the configuration of a still video camera.

図中1は撮像光学系である。2は絞り手段であ
つて、物性的なものであつても機械的なものであ
つても良い。3はシヤツター手段であつて、やは
り物性的なものでも機械的なものでも良い。又絞
り2と兼用されるものであつても良い。5は例え
ばCCD(Charge coupled device)の如き光電変
換素子(撮像素子)である。
1 in the figure is an imaging optical system. Reference numeral 2 is a constriction means, which may be physical or mechanical. 3 is a shutter means, which may be physical or mechanical. Further, it may also be used as the aperture 2. 5 is a photoelectric conversion element (imaging element) such as a CCD (Charge coupled device).

4は該撮像手段5の前に配置された色フイルタ
ーであつてストライプ型でもモザイク型等であつ
ても良い。
Reference numeral 4 denotes a color filter disposed in front of the imaging means 5, which may be of a stripe type, a mosaic type, or the like.

又、このフイルターは白黒画像のみを得る為に
はなくても良い。6はシヤツター秒時設定回路、
7は映像信号処理処理回路であつて変換素子5よ
り得られた画像情報を適宜の信号形態に変換す
る。8はドライバ回路(撮像素子駆動回路)であ
つて、変換素子5の走査、転送等を制御する。9
はシヤツター制御回路であつて前記設定回路6の
設定値に応じてシヤツター手段3の開閉を制御す
る。10はシーケンス制御回路であつて本実施例
のスチールビデオカメラ全体のシーケンス等を制
御する。11はモーター制御回路であつて電源ス
イツチの投入に伴ないシーケンス制御回路により
制御される。12は該制御回路11により同期制
御されるモーター、13はモーターにより回転駆
動される磁気デイスク、14は磁気ヘツド(記録
ヘツド)、15はPGヘツドであり、モーターの回
転位相をモーター制御回路11にフイードバツク
する。端子Fはサーボロツク信号を出力する端
子、16はクロツク発振器、17は被写体像を表
示する電子ビユーフアインダ装置、18は電源ス
イツチ、19はバツテリーである。20は被写体
までの距離を検出する検出器、21は検出器20
で検出された距離に応じて撮像素子1のレンズを
駆動するレンズ駆動回路22を制御するオートフ
オーカス制御回路(以下AF制御回路)である。
Further, this filter may be omitted in order to obtain only black and white images. 6 is the shutter time setting circuit;
Reference numeral 7 denotes a video signal processing circuit which converts the image information obtained from the conversion element 5 into an appropriate signal form. Reference numeral 8 denotes a driver circuit (imaging element driving circuit), which controls scanning, transfer, etc. of the conversion element 5. 9
is a shutter control circuit which controls the opening and closing of the shutter means 3 according to the setting value of the setting circuit 6. Reference numeral 10 denotes a sequence control circuit which controls the overall sequence of the still video camera of this embodiment. Reference numeral 11 denotes a motor control circuit, which is controlled by a sequence control circuit when the power switch is turned on. 12 is a motor synchronously controlled by the control circuit 11; 13 is a magnetic disk rotationally driven by the motor; 14 is a magnetic head (recording head); and 15 is a PG head. The rotation phase of the motor is transmitted to the motor control circuit 11. Give feedback. Terminal F is a terminal for outputting a servo lock signal, 16 is a clock oscillator, 17 is an electronic viewfinder device for displaying a subject image, 18 is a power switch, and 19 is a battery. 20 is a detector that detects the distance to the subject, 21 is a detector 20
This is an autofocus control circuit (hereinafter referred to as an AF control circuit) that controls a lens drive circuit 22 that drives the lens of the image sensor 1 according to the distance detected by the AF control circuit.

第2図に第1図のシーケンス制御回路10の詳
細回路図を示し、第3図に第2図の各部のタイミ
ングチヤートを示す。
FIG. 2 shows a detailed circuit diagram of the sequence control circuit 10 of FIG. 1, and FIG. 3 shows a timing chart of each part of FIG. 2.

第2図において、25,26,27は夫々遅延
時間がτ1,τ2,τ3のタイマ、28,29,32は
スイツチ、30はレリーズボタン、31はレリー
ズ可を表示する表示器である。以下、第3図のタ
イミングチヤートを元に説明する。
In FIG. 2, 25, 26, and 27 are timers with delay times τ 1 , τ 2 , and τ 3 , respectively, 28, 29, and 32 are switches, 30 is a release button, and 31 is an indicator that indicates whether the release is possible. . The following will explain based on the timing chart shown in FIG.

電源スイツチ18が押されると、バツテリー1
9からの電源はタイマ25,26,27、発振器
16、モータ制御回路11、電子ビユーフアイン
ダ17、及び表示器31に印加される。
When the power switch 18 is pressed, the battery 1
Power from 9 is applied to timers 25, 26, 27, oscillator 16, motor control circuit 11, electronic viewfinder 17, and display 31.

モータ制御回路11は電源印加と同時にモータ
を回転させ、発振器16からの同期信号とPGヘ
ツド15の出力パルスとにより磁気デイスクを所
定速度で回転させるべく制御を開始する。
The motor control circuit 11 rotates the motor at the same time as power is applied, and starts control to rotate the magnetic disk at a predetermined speed using a synchronizing signal from the oscillator 16 and an output pulse from the PG head 15.

電子ビユーフアインダ17に印加された電源は
フアインダ17の陰極の加熱を開始する。電源ス
イツチ18の投入から時間τ1後タイマ25の出力
(第1のタイミング信号)がハイレベルとなり、
スイツチ28がオンする。するとAF制御回路2
1及びレンズ駆動回路22に電源が供給されて自
動的に焦点調節される。
The power applied to the electronic viewfinder 17 begins to heat the cathode of the viewfinder 17. After a time τ 1 from turning on the power switch 18, the output of the timer 25 (first timing signal) becomes high level.
Switch 28 is turned on. Then AF control circuit 2
1 and the lens drive circuit 22, and the focus is automatically adjusted.

更に電源スイツチ18の投入から時間τ2後タイ
マ26の出力(第2のタイミング信号)がハイレ
ベルとなり、スイツチ29がオンし、映像信号処
理回路7、及びドライバ回路8に電源が供給され
る。
Furthermore, after a time τ 2 after the power switch 18 is turned on, the output of the timer 26 (second timing signal) becomes high level, the switch 29 is turned on, and power is supplied to the video signal processing circuit 7 and the driver circuit 8.

そして電源スイツチ18の投入から時間τ3後タ
イマ27の出力がハイレベルとなり、表示器31
を点灯し、レリーズ可能(撮映可能)であること
を撮映者に知らせる。
Then, after a time τ 3 from turning on the power switch 18, the output of the timer 27 becomes high level, and the display 31
lights up to notify the photographer that it is possible to release the camera (shooting is possible).

この時点で撮映者がレリーズボタン30を押す
と、スイツチ32が閉じ、シヤツタ制御回路9が
動作する。するとシヤツタが開閉し、変換素子5
からの信号が映像信号処理回路7を介して記録ヘ
ツド14に印加され、正常に回転している磁気デ
イスク13に記録される。ここで電源スイツチ1
8のオンから時間τ3が経過しない前にレリーズボ
タン30を押してもタイマ27の出力はローレベ
ルなのでスイツチ32は閉じない。従つて撮像及
び記録動作は実行されない。
When the photographer presses the release button 30 at this point, the switch 32 closes and the shutter control circuit 9 operates. Then, the shutter opens and closes, and the conversion element 5
A signal is applied to the recording head 14 via the video signal processing circuit 7, and recorded on the normally rotating magnetic disk 13. Here, power switch 1
Even if the release button 30 is pressed before the time τ 3 has elapsed since the switch 8 was turned on, the output of the timer 27 is at a low level, so the switch 32 will not close. Therefore, no imaging and recording operations are performed.

ここで、モータ制御回路11及び電子ビユーフ
アインダ17の立上り特性を第3図S4に、AF
制御回路21及びレンズ駆動回路22の立上り特
性を第3図S5に、映像信号処理回路7及びドラ
イバ回路の立上り特性を第3図S6に示してい
る。図に示す如く、モータ制御回路11に電源が
供給されてから実際に磁気デイスクが正常な速度
で回転するまでに要する時間が時間τ3である。電
子ビユーフアインダ17に電源が供給されてから
フアインダが可視状態となるまでの時間もほぼ時
間τ3と一致する。
Here, the rise characteristics of the motor control circuit 11 and the electronic viewfinder 17 are shown in FIG. 3 S4.
The rise characteristics of the control circuit 21 and the lens drive circuit 22 are shown in FIG. 3 S5, and the rise characteristics of the video signal processing circuit 7 and the driver circuit are shown in FIG. 3 S6. As shown in the figure, the time required from when power is supplied to the motor control circuit 11 until the magnetic disk actually rotates at a normal speed is time τ 3 . The time from when power is supplied to the electronic viewfinder 17 to when the viewfinder becomes visible also substantially coincides with time τ 3 .

又、AF制御回路21及びレンズ駆動回路22
に電源が供給されてから、レンズが自動焦点位置
に達するのに必要な時間の最大値は時間(τ3
τ1)である。
Moreover, the AF control circuit 21 and the lens drive circuit 22
The maximum time required for the lens to reach the autofocus position after power is applied to the lens is time (τ 3
τ 1 ).

そして映像信号処理回路7及びドライバ回路8
に電源が供給されてから、変換素子5から信号読
出が可能とななるのに必要な時間は時間(τ3
τ2)である。そして図から明らかなようにτ1<τ2
<τ3,(τ3−τ2)<(τ3−τ1)<τ3である。
And a video signal processing circuit 7 and a driver circuit 8
The time required for the signal to be read from the conversion element 5 after power is supplied to the conversion element 5 is the time (τ 3
τ 2 ). And as is clear from the figure, τ 1 < τ 2
3 , (τ 3 - τ 2 ) < (τ 3 - τ 1 ) < τ 3 .

このように本実施例では電源スイツチの投入か
ら撮映可能となるまでの時間τ3の間に、立上りに
要する時間が長いものから順に電源を投入してい
る。
As described above, in this embodiment, during the time τ 3 from turning on the power switch to when imaging becomes possible, the power is turned on in descending order of the time required for startup.

かかる構成により、消費電力を極めて少く押さ
えることができる。特に最終的にすべての撮映に
必要な手段の立上り時間を一致させることにより
消費電力を最低とすることができる。特に、AF
制御回路、レンズ駆動回路等へ電源が投入され、
正常な記録動作が行えるようになつた後、信号処
理回路やCCDのドライバ回路に電源を投入する
構成としたため、消費電力は大幅に軽減されるこ
とになる。
With this configuration, power consumption can be kept extremely low. In particular, power consumption can be minimized by finally matching the rise times of all the means necessary for photographing. In particular, AF
Power is turned on to the control circuit, lens drive circuit, etc.
Power is turned on to the signal processing circuit and CCD driver circuit after normal recording operation has been achieved, resulting in a significant reduction in power consumption.

又、撮映及び記録に必要な手段が正常に動作し
てから、撮映を許可しているので、記録ミス、或
は不適正な記録の発生がなくなる。
In addition, since photographing is permitted only after the means necessary for photographing and recording are operating normally, recording errors or inappropriate recordings are prevented from occurring.

第1図のシーケンス制御回路10はタイマの動
作により、各部への電源投入タイミングを定めて
いるが、第4図A,B及び第5図の例では他の手
法について説明する。図において第2図と同様の
機能を有するものについは「′」をつけて示した。
図において、50,51は分圧用抵抗器、52は
コンパレータ、53,55はスイツチ、54はタ
イマ、56は位相比較器、57は速度制御器であ
る。又、信号Saは電源スイツチ18′のオン信
号、Sbは位相誤差信号、Scはコンパレータ52
の出力信号、Sdはタイマ54の出力信号、Seは
信号処理回路7′、及びドライバ回路8′の立上り
状態を示す信号である。
Although the sequence control circuit 10 shown in FIG. 1 determines the power-on timing for each part by the operation of a timer, other methods will be explained in the examples shown in FIGS. 4A and 4B and FIG. 5. In the figure, components having the same functions as those in FIG. 2 are indicated with a ``''' symbol.
In the figure, 50 and 51 are voltage dividing resistors, 52 are comparators, 53 and 55 are switches, 54 is a timer, 56 is a phase comparator, and 57 is a speed controller. Further, the signal Sa is the on signal of the power switch 18', Sb is the phase error signal, and Sc is the comparator 52.
, Sd is the output signal of the timer 54, and Se is a signal indicating the rising state of the signal processing circuit 7' and the driver circuit 8'.

電源スイツチ18′の投入により発振器16′か
らの同期信号がモータ制御回路11′に印加され、
又モータ制御回路11′には同時に電源が供給さ
れる。モータ制御回路11′は第4図Bに詳細に
示す如く、位相比較器56、及び速度制御器57
より成り、モータ12′からのFGパルスが速度制
御器57に帰還され、DGパルスが位相比較器に
帰還される。位相比較器56は発振器16′から
の同期信号とPGパルスの位相誤差を比較し、速
度制御器57に位相誤差を示す位相誤差を出力す
る。この位相誤差信号Sbがコンパレータ52の
一方の入力端子に入力される。コンパレータ52
のもう一方の入力端子にはレベルLEの電圧が入
力されている。誤差信号Sbのレベルがある程度
小さくなり、レベルLEを下廻ると、コンパレー
タ52の出力Scはハイレベルとなりスイツチ5
3を閉じ、映像信号処理回路7′、ドライバ回路
8′に電源を供給する。又、同時にタイマ54も
計時を開始する。タイマ54の計時時間はτ4でこ
れは映像信号処理回路7′、ドライバ回路8′の立
上りに要する時間と大略同一に設定する。タイマ
54が計時を終了すると、その出力がハイレベル
となり、表示器31′に撮映可能であることを表
示する。そしてレリーズボタン30′の動作で撮
映が行なわれる。また、タイマ54の計時が終了
する時点では位相誤差信号Sbのレベルは0とな
つている。
When the power switch 18' is turned on, a synchronizing signal from the oscillator 16' is applied to the motor control circuit 11'.
At the same time, power is supplied to the motor control circuit 11'. The motor control circuit 11' includes a phase comparator 56 and a speed controller 57, as shown in detail in FIG. 4B.
The FG pulse from the motor 12' is fed back to the speed controller 57, and the DG pulse is fed back to the phase comparator. The phase comparator 56 compares the phase error between the synchronizing signal from the oscillator 16' and the PG pulse, and outputs a phase error indicating the phase error to the speed controller 57. This phase error signal Sb is input to one input terminal of the comparator 52. Comparator 52
A level LE voltage is input to the other input terminal. When the level of the error signal Sb decreases to a certain extent and falls below the level LE, the output Sc of the comparator 52 becomes high level and the switch 5
3 is closed, and power is supplied to the video signal processing circuit 7' and the driver circuit 8'. At the same time, the timer 54 also starts counting. The time measured by the timer 54 is τ 4 , which is set to be approximately the same as the time required for the video signal processing circuit 7' and the driver circuit 8' to rise. When the timer 54 finishes counting, its output becomes high level, and the display 31' indicates that it is possible to take an image. Then, shooting is performed by operating the release button 30'. Furthermore, at the time when the timer 54 finishes counting, the level of the phase error signal Sb is 0.

かかる構成例の手法では、実際にモータの位相
誤差量を検出してやることにより、、レリーズボ
タン操作時には確実に磁気デイスクが正常に回転
しており、正確に撮像信号の記録が行える。
In the method of this configuration example, by actually detecting the amount of phase error of the motor, it is ensured that the magnetic disk is rotating normally when the release button is operated, and the imaging signal can be accurately recorded.

第6図はこの手法を用いた本発明の第2の実施
例たるシーケンス制御回路10の構成を示す。第
5図において第2図、第4図Aと同様の機能を有
するものについては「″」をつけて示した。
FIG. 6 shows the configuration of a sequence control circuit 10 which is a second embodiment of the present invention using this method. In FIG. 5, components having the same functions as those in FIG. 2 and FIG. 4A are marked with "''.

61,66はスイツチ、62,63は抵抗器、
64はコンパレータである。
61 and 66 are switches, 62 and 63 are resistors,
64 is a comparator.

電源スイツチ18″の投入後、位相誤差信号が
あるレベル以下になつた事をコンパレータ52″
で検出し、その出力(第1のタイミング信号)に
よりスイツチ61を閉じてAF制御回路21″、及
びレンズ駆動回路22″を動作状態とする。そし
てAF制御回路21″のレンズ駆動回路22″への
焦点位置からのずれ量を示すレンズ駆動制御信号
レベルが所定レベル以下となつたことをコンパレ
ータ64で検出する。コンパレータ64の出力
(第2のタイミング信号)がハイレベルとなると
スイツチ66を閉じ、映像信号処理回路7″、及
びドライバ回路8″をオンする。以後の動作は第
4図の回路と同様である。
After turning on the power switch 18'', the comparator 52'' indicates that the phase error signal has fallen below a certain level.
The output (first timing signal) closes the switch 61 and puts the AF control circuit 21'' and lens drive circuit 22'' into operation. The comparator 64 then detects that the level of the lens drive control signal, which indicates the amount of deviation of the AF control circuit 21'' from the focal point position of the lens drive circuit 22'', has fallen below a predetermined level. When the output (second timing signal) of the comparator 64 becomes high level, the switch 66 is closed and the video signal processing circuit 7'' and the driver circuit 8'' are turned on. The subsequent operation is similar to that of the circuit shown in FIG.

第7図に第6図の各部の信号波形を示す。SA
は電源スイツチ18″の投入信号、SBは位相誤差
信号、SCはコンパレータ52″の出力信号、SD
はレンズ駆動制御信号、SEはコンパレータ64
の出力信号、SFはタイマ54″の出力信号、SG
は映像信号処理回路7″、及びドライバ回路8″の
立上り状態を示す図である。
FIG. 7 shows signal waveforms at various parts in FIG. 6. S.A.
is the input signal of power switch 18", SB is the phase error signal, SC is the output signal of comparator 52", SD
is the lens drive control signal, SE is the comparator 64
SF is the output signal of timer 54'', SG
7 is a diagram showing the startup state of the video signal processing circuit 7'' and the driver circuit 8''.

第7図に示す如く、位相誤差信号SBのレベル
がゼロになる時点T3でレンズ駆動制御信号SDの
レベルがゼロとなり、同時に映像信号処理回路
7″、及びドライバ回路8″も立上がる如くコンパ
レータ52″,64の参照電圧は設定されている。
As shown in FIG. 7, at time T3 when the level of the phase error signal SB becomes zero, the level of the lens drive control signal SD becomes zero, and at the same time, the video signal processing circuit 7'' and the driver circuit 8'' also rise. Reference voltages 52'' and 64 are set.

このように磁気デイスクが正常に回転し、焦点
位置が正確に合い、しかも信号処理回路が立上つ
た状態ではじめて、レリーズが可能となる。した
がつて、ピントずれがなく、しかも正確な磁気記
録が可能となる。
In this manner, release is possible only when the magnetic disk rotates normally, the focus position is accurately aligned, and the signal processing circuit is turned on. Therefore, there is no focus shift and accurate magnetic recording is possible.

尚、以上の実施例においては電源スイツチとレ
リーズボタンを別々に設けたが、第1ストローク
で電源スイツチがオンし、レリーズボタンは第2
ストロークで動作する構成としてもよい。
In the above embodiment, the power switch and release button were provided separately, but the power switch is turned on with the first stroke, and the release button is turned on with the second stroke.
It may be configured to operate by stroke.

以上詳述した様に本発明は録画に必要な各手段
のうちAF制御回路、レンズ駆動回路等への電源
が投入され、正常な記録動作が行えるようになつ
た後、信号処理回路や撮像素子の駆動回路に電源
を投入し、記録可能とする構成としたため、速写
性を損うことなく消費電流を少く出来る。更に、
レコーダ及びカメラが記録及び撮影のための準備
を完了した後に録画動作に移行するものなので、
不適性な録画を防止することができる。
As described in detail above, the present invention enables the signal processing circuit, the image sensor Since the configuration is such that power is applied to the drive circuit to enable recording, current consumption can be reduced without impairing quick shooting performance. Furthermore,
The recording operation starts after the recorder and camera complete preparations for recording and shooting.
Inappropriate recording can be prevented.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はスチル・ビデオカメラの構成の一例を
示すブロツク図、第2図は第1図のシーケンス制
御回路の一実施例の回路図、第3図は第2図の各
部の信号波形図、第4図Aは第1図のシーケンス
制御回路の一部の構成を変更した回路図、第4図
Bは第4図Aのモータ制御回路の詳細を示す図、
第5図は第4図Aの各部の信号波形図、第6図は
第1図のシーケンス制御回路の他の実施例の回路
図、第7図は第6図の各部の信号波形図である。 図において、1は撮像光学系、2は絞り手段、
3はシヤツター手段、5は光電変換素子(撮像素
子)、7は映像信号処理回路、9はシヤツタ制御
回路、10はシーケンス制御回路、11はモータ
制御回路、12はモータ、13は磁気デイスク、
14は記録ヘツド、18は電源スイツチ、21は
AF制御回路、22はレンズ駆動回路、25,2
6,27はタイマ、30はレリーズボタンを夫々
示す。
Fig. 1 is a block diagram showing an example of the configuration of a still/video camera, Fig. 2 is a circuit diagram of an embodiment of the sequence control circuit of Fig. 1, Fig. 3 is a signal waveform diagram of each part of Fig. 2, FIG. 4A is a circuit diagram with a partially changed configuration of the sequence control circuit in FIG. 1, FIG. 4B is a diagram showing details of the motor control circuit in FIG. 4A,
5 is a signal waveform diagram of each part of FIG. 4A, FIG. 6 is a circuit diagram of another embodiment of the sequence control circuit of FIG. 1, and FIG. 7 is a signal waveform diagram of each part of FIG. 6. . In the figure, 1 is an imaging optical system, 2 is an aperture means,
3 is a shutter means, 5 is a photoelectric conversion element (imaging element), 7 is a video signal processing circuit, 9 is a shutter control circuit, 10 is a sequence control circuit, 11 is a motor control circuit, 12 is a motor, 13 is a magnetic disk,
14 is a recording head, 18 is a power switch, and 21 is a
AF control circuit, 22 is a lens drive circuit, 25, 2
6 and 27 are timers, and 30 is a release button.

Claims (1)

【特許請求の範囲】 1 レンズを有する撮像光学系と、 該撮像光学系を介した被写体像を電気信号に変
換する撮像素子と、 該撮像素子を駆動する撮像素子駆動回路と、 前記電気信号を記録信号に変換する信号処理回
路と、 被写体距離を検出するオートフオーカス制御回
路と、 該オートフオーカス制御回路で検出された被写
体距離に応じて前記レンズを駆動するレンズ駆動
回路と、 前記記録信号を記録媒体上に記録する記録手段
と、 電源スイツチと、 前記電源スイツチの操作後、第1のタイミング
信号を発生し、該第1のタイミング信号により前
記オートフオーカス制御回路及びレンズ駆動回路
に電源を供給し、該第1のタイミング信号の発生
後に第2のタイミング信号を発生し、該第2のタ
イミング信号により前記撮像素子駆動回路及び前
記信号処理回路に電源を供給し、該第2のタイミ
ング信号の発生後に前記記録手段による記録を可
能とするシーケンス制御回路と を有することを特徴とするビデオ信号記録装置。
[Scope of Claims] 1. An imaging optical system having a lens, an imaging device that converts a subject image via the imaging optical system into an electrical signal, an imaging device drive circuit that drives the imaging device, and an imaging device drive circuit that drives the electrical signal. a signal processing circuit that converts the recording signal into a recording signal; an autofocus control circuit that detects a subject distance; a lens drive circuit that drives the lens according to the subject distance detected by the autofocus control circuit; and the recording signal. a recording means for recording on a recording medium; a power switch; after the power switch is operated, a first timing signal is generated, and the first timing signal powers the autofocus control circuit and the lens drive circuit; generating a second timing signal after generating the first timing signal; supplying power to the image sensor driving circuit and the signal processing circuit by the second timing signal; A video signal recording apparatus comprising: a sequence control circuit that enables the recording means to perform recording after a signal is generated.
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