JPH0348592A - Drop out compensation circuit - Google Patents

Drop out compensation circuit

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JPH0348592A
JPH0348592A JP1184049A JP18404989A JPH0348592A JP H0348592 A JPH0348592 A JP H0348592A JP 1184049 A JP1184049 A JP 1184049A JP 18404989 A JP18404989 A JP 18404989A JP H0348592 A JPH0348592 A JP H0348592A
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delay
delay line
circuit
doc
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Takao Yoshikawa
吉川 孝雄
Isao Masuda
益田 功
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Sony Corp
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Abstract

PURPOSE:To reduce the delay quantity of a signal in a low-pass area and to inexpensively improve picture quality by providing a chroma trap circuit on a delay line including a delay element. CONSTITUTION:A signal PB-C is mixed with a signal sent via the output side terminal 3c of a DOC(drop out correction) switch 3 controlled with a DOC detection circuit 3A via an adder 7, and is sent to a voltage controlled type variable gain amplifier VCA 9 via the delay line 8 using a charge coupled device(CCD), and gain loss due to the CCD delay line 8 is compensated. The macro trap circuit 10 is arranged at the rear stage of the delay line 8, and eliminates a chroma signal component. Thereby, the delay line 8 can be used in common with the delay line for comb-line filter in a reproducing signal system, and also, no LPF for DOC is required at the rear stage of the delay line, which reduces the delay quantity of the signal in the low-pass area. Therefore, the image can be inexpensively improved.

Description

【発明の詳細な説明】 本発明ドロップアウト補償回路の詳細を以下の項目に従
って説明する。
DETAILED DESCRIPTION OF THE INVENTION The details of the dropout compensation circuit of the present invention will be explained according to the following items.

A、産業上の利用分野 B0発明の概要 C0従来技術[第2図] D1発明が解決しようとする課題[第3図]E1課題を
解決するための手段 F、実施例[第1図コ 80回路 す3作用 G0発明の効果 (A、産業上の利用分野) 本発明は新規なドロップアウト補償回路に関する。詳し
くは、ドロップアウト補償回路用の遅延線を複数のくし
型フィルター(例えば、輝度信号やクロマ信号)用の遅
延線と全く同一のものを用いて回路を構成し得るように
したドロップアウト補償回路であって、遅延線上にトラ
ップ回路を設けることによって信号の低域における遅延
量を低減してドロップアウト補償回路の性能の向上を図
り、しかも、これを安価に実現することができるように
した新規なドロップアウト補償回路を提供しようとする
ものである。
A. Industrial field of application B0 Overview of the invention C0 Prior art [Figure 2] D1 Problem to be solved by the invention [Figure 3] E1 Means for solving the problem F. Example [Figure 1 Effects of the invention (A. Field of industrial application) The present invention relates to a novel dropout compensation circuit. Specifically, this is a dropout compensation circuit in which the circuit can be constructed using the same delay line for multiple comb filters (for example, luminance signals and chroma signals) as the delay line for the dropout compensation circuit. This is a new technology that improves the performance of the dropout compensation circuit by reducing the amount of delay in the low frequency range of the signal by providing a trap circuit on the delay line, and also achieves this at a low cost. The purpose of this invention is to provide a dropout compensation circuit that provides a reliable dropout compensation circuit.

(B、発明の概要) 本発明ドロップアウト補償回路は、くし型フィルターの
遅延要素と共用化され、かつ−の遅延出力をもつ遅延要
素と、該遅延要素による利得損失を補償するためのAG
C回路とを備えたドロップアウト補償回路であって、遅
延要素を含む遅延線上にクロマトラップ回路を設けるこ
とによって、信号の低域における信号の遅延量を低減し
て、画質の向上を安価に実現することができるようにし
たものである。
(B. Summary of the Invention) The dropout compensation circuit of the present invention includes a delay element that is shared with a delay element of a comb filter and has a delay output of -, and an AG for compensating for gain loss due to the delay element.
This is a dropout compensation circuit equipped with a C circuit, and by providing a chroma trap circuit on a delay line that includes a delay element, the amount of signal delay in the low frequency range of the signal is reduced, and image quality can be improved at low cost. It was made so that it could be done.

(C,従来技術)[第2図] 一木の遅延線を複数のくし型フィルターの遅延線として
共用するシステムにあっては、複数の遅延出力をもつカ
スタムIC化された遅延素子が用いられることが多く、
−例としては、特開昭62−164398号公報に示さ
れるものがある。
(C, Prior Art) [Figure 2] In a system in which one tree of delay lines is shared as a delay line for multiple comb filters, a custom IC delay element with multiple delay outputs is used. Often,
- An example is shown in Japanese Patent Application Laid-Open No. 62-164398.

この場合、第2図に示すように、ICaにおいて、くシ
型フィルター用の2つの遅延出力(これらをS01、S
o2とする。)のうちの一方S01が人力信号(S+ 
とする。)に遅延量(これをαとする。)を与えた信号
とされ、他方302が、入力信号S!にIH(1水平走
査期間)+αの遅延量を与えた信号とされており、くし
型フィルターにおいてこの両者の差をとることによって
正確にIHだけ遅れた遅延出力が得られるようになって
いる。そして、同時にDOC(ドロップアウト補償)用
の遅延出力(Soocとする。)も■Caにおいて作ら
れ、この場合の遅延量は上記した遅延量とは異なる値(
これをβとする。)とされ、人力信号S、に関してIH
−βだけ遅延した信号として出力され、その後段に設け
られたローパスフィルターbを介して不要(クロマ)成
分が除去されるようになっていた。
In this case, as shown in FIG.
Let it be o2. ), one of them S01 is the human signal (S+
shall be. ) is given a delay amount (this is α), and the other 302 is the input signal S! A delay amount of IH (one horizontal scanning period) + α is given to the signal, and by taking the difference between the two in a comb filter, a delayed output delayed by exactly IH can be obtained. At the same time, a delay output (Sooc) for DOC (dropout compensation) is also created in ■Ca, and the delay amount in this case is a different value from the above-mentioned delay amount (
Let this be β. ), and with respect to the human signal S, IH
The signal is output as a signal delayed by −β, and unnecessary (chroma) components are removed via a low-pass filter b provided at the subsequent stage.

(D、発明が解決しようとする課題)[第3図] ところで、上記した回路にあっては遅延出力s ooc
はローパスフィルターbを介しているため信号の低域に
おける遅延量が多くなってしまい、DOC回路の性能の
低下を招いてしまうという問題があり、例えば、第3図
に概略的に示すように、テレビ画面C上に、−木の黒色
(斜線で示す)の縦線dが描かれるような映像信号eを
再生したときに、何かの拍子で数H分のドロップアウト
が発生すると(矢印f参照)、信号の遅延量が積み重な
ってその時の走査線上における黒色部分が斜めにずれて
画面上の歪みとなって映し出されることになる。
(D. Problem to be Solved by the Invention) [Figure 3] By the way, in the above circuit, the delayed output s ooc
Since the signal is passed through the low-pass filter b, the amount of delay in the low frequency range of the signal increases, leading to a decrease in the performance of the DOC circuit. For example, as schematically shown in Fig. 3, When playing back a video signal e in which a black (diagonal line) vertical line d is drawn on the TV screen C, if a dropout of several H minutes occurs for some reason (arrow f ), the amount of signal delay accumulates, and the black portion on the scanning line at that time shifts diagonally, resulting in distortion on the screen.

また、遅延用ICに関しても、DOC用の遅延信号に関
する遅延量がくし型フィルターの遅延信号のそれと異な
るため、これが回路の複雑化及びICのコスト上昇につ
ながり、結果として製品コストの上昇を招いてしまうと
いった問題がある。
Furthermore, regarding delay ICs, the amount of delay associated with the DOC delay signal is different from that of the comb filter delay signal, which leads to circuit complexity and an increase in IC cost, resulting in an increase in product cost. There are problems like this.

(E、課題を解決するための手段) そこで、本発明ドロップアウト補償回路は上記した課題
を解決するために、くし型フィルターの遅延要素と共用
化され、かつ−の遅延出力をもつ遅延要素と、該遅延要
素による利得損失を補償するためのAGC回路とを備え
たドロップアウト補償回路であって、遅延要素を含む遅
延線上にクロマトラップ回路を設けたものである。
(E. Means for Solving the Problems) Therefore, in order to solve the above-mentioned problems, the dropout compensation circuit of the present invention has a delay element that is commonly used as a delay element of a comb filter and has a delay output of -. , and an AGC circuit for compensating for gain loss due to the delay element, and a chroma trap circuit is provided on a delay line including the delay element.

従って、本発明によれば、従来のDOC用ローパスフィ
ルターに代ってトラップ回路を用いることによって信号
の低域での遅延量を低減し、しかも、くし型フィルター
との間で同一の遅延出力をもつ遅延線を共用することが
できるので、回路を安価に構成することができる。
Therefore, according to the present invention, by using a trap circuit in place of the conventional low-pass filter for DOC, the amount of delay in the low frequency range of the signal can be reduced, and moreover, the same delay output can be achieved with the comb filter. Since the delay line can be shared, the circuit can be constructed at low cost.

(F、実施例)[第1図コ 以下に、本発明ドロップアウト補償回路の詳細を図示し
た実施例に従って説明する。尚、図示した実施例は本発
明ドロップアウト補償回路をVTR等においてDOC回
路の遅延線と再生Y(輝度)信号(以下、rPB−YJ
とする。)及び再生クロマ信号(以下、rPB−CJと
する。)用のくし型フィルターの遅延線とを共用化した
システムに適用したものである。
(F. Embodiment) [FIG. 1C Below, details of the dropout compensation circuit of the present invention will be explained according to the illustrated embodiment. The illustrated embodiment uses the dropout compensation circuit of the present invention to connect the delay line of the DOC circuit and the reproduced Y (luminance) signal (hereinafter rPB-YJ) in a VTR or the like.
shall be. ) and a comb filter delay line for a reproduced chroma signal (hereinafter referred to as rPB-CJ).

(a、回路) 1はDOC回路である。(a, circuit) 1 is a DOC circuit.

2は信号入力端子であり、信号PB−Yが人力される。2 is a signal input terminal to which the signal PB-Y is input manually.

3はDOCスイッチであり、DOC検波回路3Aによっ
てスイッチング制御されるようになっており、その入力
端端子の一方3aは上記信号入力端子2に接続され、他
方3bが後述するクランプ回路の出力端子に接続されて
いる。また、出力側端子3cはイコライザー4を介して
減算器5に接続されている。
3 is a DOC switch whose switching is controlled by a DOC detection circuit 3A, one of its input terminals 3a is connected to the signal input terminal 2, and the other 3b is connected to the output terminal of a clamp circuit to be described later. It is connected. Further, the output terminal 3c is connected to a subtracter 5 via an equalizer 4.

6は信号入力端子であり、信号PB−Cが入力され、該
信号はその後段に配置された加算器7においてDOCス
イッチ3の出力側端子3Cを介して送られてくる信号と
混合され、CCDを用いた遅延線8を介してVCA (
電圧制御型可変利得増幅器)9に送出され、ここでCC
D遅延線8による利得損失が補償されるようになってい
る。尚、このCCD遅延線8としては汎用ICが用いら
れ、入力信号に対して所定の遅延量を与えられた−の遅
延信号を出力するようになっている。
6 is a signal input terminal, into which the signal PB-C is input, and this signal is mixed with the signal sent via the output side terminal 3C of the DOC switch 3 in the adder 7 arranged at the subsequent stage, and the CCD VCA (
voltage-controlled variable gain amplifier) 9, where CC
Gain loss due to the D delay line 8 is compensated for. A general-purpose IC is used as the CCD delay line 8, and is configured to output a - delayed signal that is given a predetermined amount of delay with respect to the input signal.

10はf sc (色副搬送波周波数)43.58MH
2を中心としたクロマトラップ回路であり、CCD遅延
線8の後段に配置され、クロマ信号成分の除去用に設け
られている。
10 is f sc (color subcarrier frequency) 43.58MH
2 is a chroma trap circuit centered on CCD delay line 8, and is arranged after the CCD delay line 8, and is provided for removing chroma signal components.

11はクランプ回路であり、DCレベル調整のために上
記クロマトラップ回路10の後段に配置されている。そ
して、該クランプ回路11の出力端子は、後述するAG
C検出回路の一方の入力端子とDOCスイッチ3の入力
端端子3bに接続されている。
Reference numeral 11 denotes a clamp circuit, which is arranged after the chroma trap circuit 10 for DC level adjustment. The output terminal of the clamp circuit 11 is connected to an AG
It is connected to one input terminal of the C detection circuit and the input terminal 3b of the DOC switch 3.

12はAGC検出回路であり、その一方の入力端子に上
記クランプ回路11からの遅延信号が人力されると共に
、他方の入力端子にはPB−Y信号の本信号が人力され
るように信号入力端子2に接続されている。そして、該
AGC検出回路12の出力はVCA9への制御18号と
して送出され、これによってVCA9の利得制御がなさ
れるようになっている。尚、13はAGC検出回路12
の出力端子とグランドラインとの間に介挿されたコンデ
ンサである。
12 is an AGC detection circuit, which has signal input terminals such that one input terminal receives the delayed signal from the clamp circuit 11, and the other input terminal receives the main signal of the PB-Y signal. Connected to 2. The output of the AGC detection circuit 12 is sent as a control signal 18 to the VCA 9, thereby controlling the gain of the VCA 9. In addition, 13 is the AGC detection circuit 12
This is a capacitor inserted between the output terminal and the ground line.

14は減算器であり、信号PR−Yの本信号から遅延信
号を差し引き、その出力を図示しないリミッタ−やアッ
テネータ等を介して減算器5に負信号として送出するよ
うになっている。そして、この減算器5においてイコラ
イザー4の出力信号から減算器14の送出する信号が差
し引かれて、くし型フィルターを通った信号PB−Y(
これを、rPB−Yco□」とする。)が信号出力端子
15に出力される。尚、減算器14に人力される遅延信
号は、場合に応じて、第1図に破線で示すようにVCA
9の直後から取り出しても良い。
A subtracter 14 subtracts the delayed signal from the main signal PR-Y and sends the output as a negative signal to the subtracter 5 via a limiter, attenuator, etc. (not shown). Then, in this subtracter 5, the signal sent from the subtracter 14 is subtracted from the output signal of the equalizer 4, and the signal PB-Y(
This is referred to as "rPB-Yco□". ) is output to the signal output terminal 15. Note that the delay signal manually input to the subtracter 14 may be input to the VCA as indicated by the broken line in FIG.
You may take it out immediately after 9.

16は減算器であり、加算器7の後段において分岐され
た信号からCCD遅延線8の後ろで分岐された信号を差
し引き、バンドパスフィルター17を介して信号出力端
子18にくし型フィルターを通った信号PB−C(これ
を「PB−cooMIl」とする。)として出力するよ
うになっている。尚、CCD遅延線8から減算器16に
至る経路上に設けられたVCA、クランプ回路、AGC
検出回路系については図示を省略した。
16 is a subtracter which subtracts the signal branched after the CCD delay line 8 from the signal branched after the adder 7, and passes the signal through a comb filter to the signal output terminal 18 via a bandpass filter 17. It is designed to be output as a signal PB-C (this will be referred to as "PB-cooMIl"). Note that the VCA, clamp circuit, and AGC provided on the path from the CCD delay line 8 to the subtracter 16
The illustration of the detection circuit system is omitted.

(b、作用) しかして、上記したDOC回路1にあってはそのCCD
遅延線8を再生信号系のくし型フィルター用の遅延線と
共用すると共に、その後ろにクロマトラップ回路10を
設けており、従来のように複数の遅延出力をもった遅延
線の後段にDOC用の特別なローパスフィルターを設け
る必要がないため、Y信号の低域における遅延量が低減
される。
(b. Effect) However, in the DOC circuit 1 described above, the CCD
The delay line 8 is shared with the delay line for the comb filter of the reproduced signal system, and a chroma trap circuit 10 is provided behind it, and the DOC circuit is installed after the delay line with multiple delay outputs as in the conventional case. Since there is no need to provide a special low-pass filter, the amount of delay in the low frequency range of the Y signal is reduced.

(G、発明の効果) 以上に記載したところから明らかなように、本発明ドロ
ップアウト補償回路は、(し型フィルターの遅延要素と
共用化され、かつ−の遅延出力をもつ遅延要素と、該遅
延要素による利得損失を補償するためのAGC回路とを
備えたドロップアウト補償回路であって、遅延要素を含
む遅延線上にクロマトラップ回路を設けたことを特徴と
する。
(G. Effects of the Invention) As is clear from the above description, the dropout compensation circuit of the present invention has a delay element that is shared with the delay element of the rectangular filter and has a delay output of -; This dropout compensation circuit includes an AGC circuit for compensating gain loss due to delay elements, and is characterized in that a chroma trap circuit is provided on a delay line including the delay elements.

従って、本発明によれば、−従来のDOC用ローパスフ
ィルターに代ってトラップ回路を用いることによって信
号の低域での遅延量を低減し、しかも、くし型フィルタ
ーとの間で同一の遅延出力をもつ遅延線を共用すること
ができるので、回路を安価に構成することができる。
Therefore, according to the present invention, the amount of delay in the low frequency range of the signal is reduced by using a trap circuit instead of the conventional low-pass filter for DOC, and the same delay output is obtained between the comb filter and the comb filter. Since a delay line with a delay line having a delay line having a delay line can be shared, the circuit can be constructed at low cost.

尚、前記した実施例においては、トラップ回路をVCA
の後段に配置した例を示したが、本発明ドロップアウト
補償回路の技術的範囲がこれのみに限定される訳ではな
く、遅延線上であればどこに配置しても良い。
In the above embodiment, the trap circuit is a VCA.
Although an example in which the dropout compensation circuit of the present invention is placed in the latter stage is shown, the technical scope of the dropout compensation circuit of the present invention is not limited to this only, and the dropout compensation circuit may be placed anywhere on the delay line.

ブロック図であり、第3図は問題点を説明するための概
略図である。
It is a block diagram, and FIG. 3 is a schematic diagram for explaining the problem.

符号の説明 1・・・ドロップアウト補償回路、 8・・・遅延要素、 9.12・・・AGC回路、 10・・・クロマトラップ回路 出  願  人Explanation of symbols 1...dropout compensation circuit, 8...delay element, 9.12...AGC circuit, 10...Chroma trap circuit applicant

Claims (1)

【特許請求の範囲】  くし型フィルターの遅延要素と共用化され、かつ−の
遅延出力をもつ遅延要素と、該遅延要素による利得損失
を補償するためのAGC回路とを備えたドロップアウト
補償回路であって、 遅延要素を含む遅延線上にクロマトラップ回路を設けた ことを特徴とするドロップアウト補償回路
[Claims] A dropout compensation circuit comprising a delay element that is shared with a delay element of a comb filter and has a delay output of -, and an AGC circuit for compensating for gain loss due to the delay element. A dropout compensation circuit characterized in that a chroma trap circuit is provided on a delay line including a delay element.
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