JPH01270116A - Zero cross detecting circuit - Google Patents
Zero cross detecting circuitInfo
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- JPH01270116A JPH01270116A JP9819588A JP9819588A JPH01270116A JP H01270116 A JPH01270116 A JP H01270116A JP 9819588 A JP9819588 A JP 9819588A JP 9819588 A JP9819588 A JP 9819588A JP H01270116 A JPH01270116 A JP H01270116A
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- Control Of Voltage And Current In General (AREA)
Abstract
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は正弦波や生体情報波形などの不規則波のゼロク
ロス検出回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a zero-cross detection circuit for irregular waves such as sine waves and biological information waveforms.
（従来の技術）
従来、正弦波や生体情報波形などの不規則波のゼロクロ
スを検出する場合、簡易にして的確なゼロクロスを検出
する回路が見当たらないのが現状である。(Prior Art) Conventionally, when detecting zero crossings of irregular waves such as sine waves and biological information waveforms, there is currently no circuit that can easily and accurately detect zero crossings.
（発明が解決しようとする課題）
そこで、本発明は、上記した現状に鑑みて、簡易にして
、的確にゼロクロスを検出することができるゼロクロス
検出回路を提供することを目的とする。(Problems to be Solved by the Invention) In view of the above-mentioned current situation, it is an object of the present invention to provide a zero-crossing detection circuit that can easily and accurately detect zero-crossings.
（課題を解決するための手段）
本発明は、ゼロのレベルを基準にして交番する入力波の
ゼロクロスを検出するゼロクロス検出回路において、前
記レベルより高い入力波をゼロ近傍の正の第１の基準レ
ベルと比較し、第１のパルスを得る手段と、前記ゼロの
レベルより低い入力波をゼロ近傍の負の第２の基準レベ
ルと比較し、第２のパルスを得る手段と、前記第１のパ
ルスと第２のパルスとをＮＯＲ回路に入力し、ゼロクロ
ス検出パルスを得る手段とを設けるようにしだものであ
る。(Means for Solving the Problems) The present invention provides a zero-crossing detection circuit that detects zero-crossings of alternating input waves with a zero level as a reference, in which an input wave higher than the level is detected as a positive first reference near zero. means for comparing the input wave lower than the zero level with a negative second reference level near zero to obtain a second pulse; A means for inputting the pulse and the second pulse to a NOR circuit to obtain a zero-crossing detection pulse is provided.
（作用）
本発明によれば、第２図に示すような、入力波ｖ０が存
在し、そのゼロクロス検出を行う場合、入力波ＶｉＮの
正の部分のゼロ近傍の第１のＪｌ値とその入力波ＶｉＮ
とを比較し、第１のパルスａを得る。また、入力波Ｖ
ｉ Ｎの負の部分のゼロ近傍の第２の基準値とその入力
波ＶｉＮとを比較し、第２のパルスｂを得る。そこで、
第１のパルスａと第２のパルスｂとをＮＯＲ回路に入力
して、パルスＣを得ることにより、ゼロクロスを検出す
る。(Operation) According to the present invention, when an input wave v0 exists as shown in FIG. 2 and its zero cross is detected, the first Jl value near zero of the positive part of the input wave ViN and its input Wave ViN
The first pulse a is obtained. Also, the input wave V
A second reference value near zero of the negative part of iN is compared with the input wave ViN to obtain a second pulse b. Therefore,
A zero cross is detected by inputting the first pulse a and the second pulse b to a NOR circuit to obtain a pulse C.
（実施例） 以下、本発明の実施例を図面を用いて詳細に説明する。(Example) Embodiments of the present invention will be described in detail below with reference to the drawings.
第１図は本発明の実施例を示すゼロクロス検出回路図、
第２図はそのゼロクロス検出タイミングチャート、第３
図は第２図のＡ部の拡大図である。FIG. 1 is a zero-cross detection circuit diagram showing an embodiment of the present invention;
Figure 2 is the zero cross detection timing chart, Figure 3 is the zero cross detection timing chart.
The figure is an enlarged view of section A in FIG. 2.
図中、ＶｉＮは入力電圧、ＶＤｌｌは電′ａ電圧、Ｖ
Ｌ Ａ ＋ＶＬＩは検出電圧、■、。は出力電圧、１１
．１２はオペアンプ、１３はＮＯＲ回路、Ｒ１は入力電
圧ＶＩＮの分圧抵抗、Ｒ１２は前記オペアンプ１１の反
転入力端子（負入力端子）に接続される基準電位を設定
するための分圧抵抗、ＲＩ３はオペアンプ１２の非反転
入力端子（正入力端子）に接続される基準電位を設定す
るための分圧抵抗、Ｒ１４は電源電圧ｖＤＤと検出電圧
■ＬＡに接続される抵抗、ｌ？ｉｓは電源電圧■。。と
検出電圧■、にそれぞれ接続される抵抗、また、Ｒいは
出力端とアース間に接続される抵抗である。In the figure, ViN is the input voltage, VDll is the voltage a, and V
L A +VLI is the detection voltage, ■. is the output voltage, 11
．． 12 is an operational amplifier, 13 is a NOR circuit, R1 is a voltage dividing resistor for input voltage VIN, R12 is a voltage dividing resistor for setting a reference potential connected to the inverting input terminal (negative input terminal) of the operational amplifier 11, and RI3 is a voltage dividing resistor for setting a reference potential connected to the inverting input terminal (negative input terminal) of the operational amplifier 11. R14 is a voltage dividing resistor connected to the non-inverting input terminal (positive input terminal) of the operational amplifier 12 for setting the reference potential, and R14 is a resistor connected to the power supply voltage vDD and the detection voltage ■LA, l? is is the power supply voltage ■. . and detection voltage (2), respectively, and R is a resistance connected between the output terminal and ground.
次に、このゼロクロス検出回路の動作を第１図乃至第３
図を用いて説明する。Next, the operation of this zero-cross detection circuit will be explained in Figures 1 to 3.
This will be explained using figures.
まず、第２図（ａ）に示すような入力電圧ｖｌＮが印加
されると、その入力電圧■、の正の部分はオペアンプ１
１によって比較され、第２図（ｂ）に示すように、検出
電圧ＶＬＡが得られる。一方、その入力電圧ＶｔＳの負
の部分はオペアンプ１２によって比較され、第２図（ｃ
）に示すように、検出電圧ｖｉ、ｓが得られる。これら
の検出電圧■、と■、はＮ。First, when an input voltage vlN as shown in FIG. 2(a) is applied, the positive part of the input voltage .
1, and a detected voltage VLA is obtained as shown in FIG. 2(b). On the other hand, the negative part of the input voltage VtS is compared by the operational amplifier 12, and the negative part of the input voltage VtS is compared by the operational amplifier 12.
), the detection voltages vi,s are obtained. These detection voltages ■, and ■ are N.
Ｒ回路１３に入力され、第２図（ｄ）に示すように、出
力電圧■１゜を得ることができる。つまり、ゼロクロス
を検出することができる。The voltage is input to the R circuit 13, and as shown in FIG. 2(d), an output voltage of 1° can be obtained. In other words, zero crossings can be detected.
また、ゼロ近傍を拡大すると、第３図に示すようになり
、ゼロ点Ｐ０、第１の基準値との比較点Ｐｃい第２の基
準値との比較点Ｐｃｔとして示される。Further, when the vicinity of zero is enlarged, it becomes as shown in FIG. 3, and is shown as a zero point P0, a comparison point Pc with the first reference value, and a comparison point Pct with the second reference value.
なお、前記した分圧抵抗Ｒ１２＋ Ｒ１３を調整するこ
とにより、ゼロクロス構出精度を高めることができるこ
とは言うまでもない。It goes without saying that zero-cross configuration accuracy can be improved by adjusting the voltage dividing resistors R12+R13 described above.
第４図は本発明の他の実施例を示すゼロクロス検出回路
図である。FIG. 4 is a diagram of a zero-cross detection circuit showing another embodiment of the present invention.
図中、２１は回路の途中に挿入される双方向性ダイオー
ド、２２はフォトカブラであり、発光ダイオード２３と
フォト・トランジスタ２４からなる第１の組と発光ダイ
オード２５とフォト・トランジスタ２６からなる第２の
組との２組のフォトカブラからなる。２７はＮＯＲ回路
、Ｌ＋ は入力電圧ＶｉＮの検出抵抗、ＲｌＺは入力回
路の制限抵抗、ＲＺ３は′ｒ４ｉｉｌＸ電圧■。と検電
圧圧■い間に接続される抵抗、Ｒ１４は電源電圧■。。In the figure, 21 is a bidirectional diode inserted in the middle of the circuit, 22 is a photo coupler, a first set consisting of a light emitting diode 23 and a photo transistor 24, and a first set consisting of a light emitting diode 25 and a photo transistor 26. It consists of two sets of photocabras. 27 is a NOR circuit, L+ is a detection resistor for input voltage ViN, RlZ is a limiting resistor of the input circuit, and RZ3 is 'r4iilX voltage ■. The resistor connected between the and the detection voltage voltage, R14, is the power supply voltage. .
と検出電圧Ｖｔｓ間に接続される抵抗、８口は出力端子
とアース間に接続される抵抗である。and the detection voltage Vts, and 8 resistors are connected between the output terminal and the ground.
このゼロクロス検出回路の動作も第２図に示される通り
であり、第２図（ａ）に示すような入力電圧ＶＡＮが印
加されると、その入力電圧ＶｉＭの正の部分は発光ダイ
オード２３とフォト・トランジスタ２４からなるフォト
カブラを介して、第２図（ｂ）に示すように、検出電圧
ＶＬＡが得られ、一方、その入力電圧■ｌＮの負の部分
は発光ダイオード２５とフォト・トランジスタ２６から
なるフォトカブラを介して、第２図（ｃ）に示すように
、検出電圧ＶｔＳが得られる。これらの検出電圧ＶＬＡ
とＶＬＩはＮＯＲ回路２７に入力され、第２図（ｄ）に
示すように、出力電圧■７゜を得ることができる。つま
り、ゼロクロスを検出することができる。The operation of this zero cross detection circuit is also as shown in FIG. 2. When an input voltage VAN as shown in FIG.・As shown in FIG. 2(b), the detection voltage VLA is obtained through the photocoupler consisting of the transistor 24, while the negative part of the input voltage lN is obtained from the light emitting diode 25 and the phototransistor 26. As shown in FIG. 2(c), a detection voltage VtS is obtained through the photocoupler. These detection voltages VLA
and VLI are input to the NOR circuit 27, and as shown in FIG. 2(d), an output voltage of 7° can be obtained. In other words, zero crossings can be detected.
このように簡便な回路でゼロクロスを容易に検出するこ
とができる。また、出力電圧■ア◎をカウントすること
により、所定時間ごとのゼロクロス数をカウントするこ
とができる。Zero crossings can be easily detected with such a simple circuit. Furthermore, by counting the output voltage ■A◎, it is possible to count the number of zero crosses at each predetermined time.
なお、本発明は上記実施例に限定されるものではなく、
本発明の趣旨に基づいて種々の変形が可能であり、これ
らを本発明の範囲から排除するものではない。Note that the present invention is not limited to the above embodiments,
Various modifications are possible based on the spirit of the present invention, and these are not excluded from the scope of the present invention.
（発明の効果）
以上、詳細に説明したように、本発明によれば、簡便な
回路でゼロクロスを容易に検出することができる。また
、出力電圧ｖＴ。をカウントすることにより、所定時間
ごとのゼロクロス数をカウントすることができる。(Effects of the Invention) As described above in detail, according to the present invention, zero crossings can be easily detected with a simple circuit. Also, the output voltage vT. By counting, it is possible to count the number of zero crosses at each predetermined time.
このように、簡単な構成でもって、的確にゼロクロスを
検出することができ、その効果は著大である。In this way, zero crossings can be detected accurately with a simple configuration, and the effect is significant.
第１図は本発明の実施例を示すゼロクロス検出回路図、
第２図はそのゼロクロス検出タイミングチャート、第３
図は第２図のＡ部の拡大図、第４図は本発明の他の実施
例を示すゼロクロス検出回路図である。
１１、１２・・・オペアンプ、１３．２７−Ｎ ＯＲ回
路、２１・・・双方向性ダイオード、２２・・・フォト
カブラ、２３゜２５・・・発光ダイオード、２４．２６
・・・フォト・トランジスタ。
特許出願人 沖電気工業株式会社FIG. 1 is a zero-cross detection circuit diagram showing an embodiment of the present invention;
Figure 2 is the zero cross detection timing chart, Figure 3 is the zero cross detection timing chart.
This figure is an enlarged view of section A in FIG. 2, and FIG. 4 is a zero-cross detection circuit diagram showing another embodiment of the present invention. 11, 12... Operational amplifier, 13.27-N OR circuit, 21... Bidirectional diode, 22... Photocoupler, 23° 25... Light emitting diode, 24.26
...Phototransistor. Patent applicant Oki Electric Industry Co., Ltd.
Claims (1)
を検出するゼロクロス検出回路において、 （ａ）前記レベルより高い入力波をゼロ近傍の正の第１
の基準レベルと比較し、第１のパルスを得る手段と、 （ｂ）前記ゼロのレベルより低い入力波をゼロ近傍の負
の第２の基準レベルと比較し、第２のパルスを得る手段
と、 （ｃ）前記第１のパルスと第２のパルスとをＮＯＲ回路
に入力し、ゼロクロス検出パルスを得る手段とを具備す
るゼロクロス検出回路。[Claims] In a zero-crossing detection circuit that detects zero-crossings of input waves that alternate with a zero level as a reference, (a) an input wave higher than the level is detected by a positive first wave near zero;
(b) means for comparing the input wave lower than the zero level with a negative second reference level near zero to obtain a second pulse; (c) A zero-cross detection circuit comprising: means for inputting the first pulse and the second pulse to a NOR circuit to obtain a zero-cross detection pulse.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9819588A JPH01270116A (en) | 1988-04-22 | 1988-04-22 | Zero cross detecting circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9819588A JPH01270116A (en) | 1988-04-22 | 1988-04-22 | Zero cross detecting circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01270116A true JPH01270116A (en) | 1989-10-27 |
Family
ID=14213219
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9819588A Pending JPH01270116A (en) | 1988-04-22 | 1988-04-22 | Zero cross detecting circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01270116A (en) |
-
1988
- 1988-04-22 JP JP9819588A patent/JPH01270116A/en active Pending
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