JP6956598B2 - Separation method of semiconductor test equipment and semiconductor elements - Google Patents

Separation method of semiconductor test equipment and semiconductor elements Download PDF

Info

Publication number
JP6956598B2
JP6956598B2 JP2017216297A JP2017216297A JP6956598B2 JP 6956598 B2 JP6956598 B2 JP 6956598B2 JP 2017216297 A JP2017216297 A JP 2017216297A JP 2017216297 A JP2017216297 A JP 2017216297A JP 6956598 B2 JP6956598 B2 JP 6956598B2
Authority
JP
Japan
Prior art keywords
semiconductor element
main surface
surface side
interstitial material
semiconductor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2017216297A
Other languages
Japanese (ja)
Other versions
JP2019086454A (en
Inventor
幸博 徳
武彦 中原
忠之 酒井
伊藤 嘉教
勇史 海老池
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP2017216297A priority Critical patent/JP6956598B2/en
Publication of JP2019086454A publication Critical patent/JP2019086454A/en
Application granted granted Critical
Publication of JP6956598B2 publication Critical patent/JP6956598B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Testing Of Individual Semiconductor Devices (AREA)

Description

本発明は、半導体試験装置および半導体素子の分離方法に関し、特に、半導体素子に直流の大電流を通電する半導体試験装置と、半導体試験装置から半導体素子を分離する半導体素子の分離方法とに関するものである。 The present invention relates to a semiconductor test apparatus and a method for separating a semiconductor element, and more particularly to a semiconductor test apparatus for energizing a semiconductor element with a large DC current and a method for separating the semiconductor element for separating the semiconductor element from the semiconductor test apparatus. be.

従来より、大電流が流される用途の半導体素子では、あらかじめ、半導体素子に大電流を通電することによって電気的特性を評価することが行われている。電気的特性を評価するため、半導体試験装置が用いられている。そのような半導体試験装置を開示した特許文献として、たとえば、特許文献1および特許文献2がある。 Conventionally, in a semiconductor element for which a large current flows, the electrical characteristics have been evaluated in advance by energizing the semiconductor element with a large current. Semiconductor test equipment is used to evaluate electrical properties. Patent documents that disclose such a semiconductor test apparatus include, for example, Patent Document 1 and Patent Document 2.

特許文献1に開示された半導体試験装置では、半導体素子の上に加圧板を直接載置し、加圧板によって半導体素子に下向きの押圧力を加えながら半導体素子に大電流を流すよう構成されている。また、特許文献2に開示されている半導体試験装置では、半導体素子と加圧板との間に、積層金属箔等の間材を挟み込んだ状態で通電試験を行う手法が提案されている。 In the semiconductor test apparatus disclosed in Patent Document 1, a pressure plate is directly placed on the semiconductor element, and a large current is passed through the semiconductor element while applying a downward pressing force to the semiconductor element by the pressure plate. .. Further, in the semiconductor test apparatus disclosed in Patent Document 2, a method of performing an energization test in a state where a material such as a laminated metal foil is sandwiched between a semiconductor element and a pressure plate has been proposed.

国際公開第2014/148294号International Publication No. 2014/148294 特開2016−11862号公報Japanese Unexamined Patent Publication No. 2016-11862

半導体試験装置では、半導体素子を試験する際には、半導体素子に大電流が流されることになる。このため、特許文献2に開示された半導体試験装置では、積層金属箔等の間材が、半導体素子と加圧板とに溶着してしまうことが想定される。 In a semiconductor test apparatus, when testing a semiconductor element, a large current is passed through the semiconductor element. Therefore, in the semiconductor test apparatus disclosed in Patent Document 2, it is assumed that a material such as a laminated metal foil is welded to the semiconductor element and the pressure plate.

間材と半導体素子等とが溶着した場合には、たとえば、間材および半導体素子等のうちの一方を吸着させ、その状態で、他方を人の手によって引っ張ることで、他方を一方から分離する必要がある。このように、半導体試験装置から半導体素子を分離するのに、人手によって行うことは手間と時間とを要し、工程の自動化を妨げる要因となる。 When the interstitial material and the semiconductor element or the like are welded together, for example, one of the interstitial material and the semiconductor element or the like is adsorbed, and in that state, the other is pulled by a human hand to separate the other from the other. There is a need. As described above, it takes time and effort to manually separate the semiconductor element from the semiconductor test apparatus, which is a factor that hinders the automation of the process.

本発明はこのような問題点に鑑みてなされたものであり、一つの目的は、人手を要することなく半導体試験装置から半導体素子を分離することができる半導体試験装置を提供することであり、他の目的は、半導体試験装置から半導体素子を分離する半導体素子の分離方法を提供することである。 The present invention has been made in view of such problems, and one object is to provide a semiconductor test apparatus capable of separating a semiconductor element from a semiconductor test apparatus without manpower. It is an object of the present invention to provide a method for separating a semiconductor element from the semiconductor test apparatus.

本発明に係る半導体試験装置は、加圧通電部と分離部とを有する。加圧通電部は、互いに対向する第1主面および第2主面を有する半導体素子を、間材を介して加圧しながら半導体素子に電気的試験をする。分離部は、半導体素子と間材とを分離する。分離部は、保持部と位置変更部とを備えている。保持部は、間材を保持する。位置変更部は、間材を保持した状態で保持部の位置を変更し、間材と半導体素子との間に隙間を生じさせることによって、半導体素子を間材から分離させる。 The semiconductor test apparatus according to the present invention has a pressurized energizing unit and a separating unit. The pressurizing and energizing unit conducts an electrical test on the semiconductor element while pressurizing the semiconductor element having the first main surface and the second main surface facing each other through the interstitial material. The separation unit separates the semiconductor element and the interstitial material. The separating portion includes a holding portion and a position changing portion. The holding part holds the interstitial material. The position changing portion changes the position of the holding portion while holding the interleaving material, and creates a gap between the interleaving material and the semiconductor element to separate the semiconductor element from the interleaving material.

本発明に係る半導体素子の分離方法は、半導体試験装置において、互いに対向する第1主面および第2主面を有する半導体素子を、間材を介して加圧しながら電気的試験を行った後に、半導体素子を間材から分離する半導体素子の分離方法であって、以下の動作を行う。間材として、半導体素子の第1主面側に第1主面側間材を配置する。第1主面側間材における第1位置を保持するとともに、第1位置から距離を隔てられた第2位置を保持する。第1主面側間材における第1位置および第2位置を保持した状態で、距離を縮めることによって第1主面側間材を変形させ、第1主面側間材と半導体素子との間に隙間を生じさせて、半導体素子を第1主面側間材から分離する。 In the method for separating a semiconductor element according to the present invention, in a semiconductor test apparatus, a semiconductor element having a first main surface and a second main surface facing each other is electrically tested while being pressurized through an interleaving material, and then the semiconductor element is electrically tested. This is a method for separating a semiconductor element from the interstitial material, and performs the following operations. As the interstitial material, the interstitial material on the first main surface side is arranged on the first main surface side of the semiconductor element. The first position in the first main surface side interleaving member is held, and the second position separated from the first position is held. While holding the first and second positions of the first main surface side interstitial material, the first main surface side interstitial material is deformed by shortening the distance, and between the first main surface side interstitial material and the semiconductor element. A gap is formed in the semiconductor element to separate the semiconductor element from the first main surface side interleaving material.

本発明に係る半導体試験装置によれば、分離部によって、間材を保持した状態で保持部の位置を変更することで、間材と半導体素子との間に隙間が生じる。これにより、人手を要さずに、半導体素子と間材とを分離させることができる。 According to the semiconductor test apparatus according to the present invention, by changing the position of the holding portion while holding the interleaving material by the separating portion, a gap is generated between the interleaving material and the semiconductor element. As a result, the semiconductor element and the interstitial material can be separated without human intervention.

本発明に係る半導体素子の分離方法によれば、第1主面側間材をそれぞれ保持した第1位置と第2位置との距離を縮めることによって、第1主面側間材が変形して、第1主面側間材と半導体素子との間に隙間が生じる。これにより、人手を要さずに、半導体素子と第1主面側間材とを分離することができる。 According to the method for separating semiconductor elements according to the present invention, the first main surface side interleaving material is deformed by reducing the distance between the first position and the second position holding the first main surface side interleaving material, respectively. , A gap is formed between the first main surface side interleaving material and the semiconductor element. As a result, the semiconductor element and the first main surface side interleaving member can be separated without human intervention.

実施の形態1に係る半導体試験装置の斜視図である。It is a perspective view of the semiconductor test apparatus which concerns on Embodiment 1. FIG. 同実施の形態において、半導体試験装置の試験対象となる半導体素子の一例を示す斜視図である。In the same embodiment, it is a perspective view which shows an example of the semiconductor element which is the test object of the semiconductor test apparatus. 同実施の形態において、半導体試験装置に配置されている加圧通電部を示す、一部断面を含む正面図である。In the same embodiment, it is a front view including a partial cross section which shows the pressurizing current part arranged in the semiconductor test apparatus. 同実施の形態において、半導体試験装置に配置されている分離部を示す斜視図である。In the same embodiment, it is a perspective view which shows the separation part arranged in the semiconductor test apparatus. 同実施の形態において、半導体試験装置による動作を説明するための一動作を示す断面図である。In the same embodiment, it is sectional drawing which shows one operation for demonstrating the operation by the semiconductor test apparatus. 同実施の形態において、図5に示す動作の後に行われる動作を示す断面図である。FIG. 5 is a cross-sectional view showing an operation performed after the operation shown in FIG. 5 in the same embodiment. 同実施の形態において、図6に示す動作の後に行われる動作を示す断面図である。It is sectional drawing which shows the operation performed after the operation shown in FIG. 6 in the same embodiment. 同実施の形態において、図7に示す動作の後に行われる動作を示す断面図である。It is sectional drawing which shows the operation performed after the operation shown in FIG. 7 in the same embodiment. 同実施の形態において、図8に示す動作の後に行われる動作を示す、一部断面を含む正面図である。In the same embodiment, it is a front view including a partial cross section which shows the operation performed after the operation shown in FIG. 同実施の形態において、図9に示す動作の後に行われる動作を示す、一部断面を含む正面図である。In the same embodiment, it is a front view including a partial cross section which shows the operation performed after the operation shown in FIG. 同実施の形態において、図10に示す動作の後に行われる動作を示す正面図および上面図である。In the same embodiment, it is a front view and a top view which show the operation performed after the operation shown in FIG. 同実施の形態において、図11に示す動作の後に行われる動作を示す正面図および上面図である。In the same embodiment, it is a front view and a top view which show the operation performed after the operation shown in FIG. 同実施の形態において、図12に示す動作の後に行われる動作を示す正面図および上面図である。In the same embodiment, it is a front view and a top view which show the operation performed after the operation shown in FIG. 同実施の形態において、図13に示す動作の後に行われる動作を行うための爪部を含む機構を示す正面図である。In the same embodiment, it is a front view which shows the mechanism including the claw part for performing the operation performed after the operation shown in FIG. 同実施の形態において、爪部による動作を説明するための第3間材の形状の一例を示す平面図である。In the same embodiment, it is a top view which shows an example of the shape of the 3rd interstitial material for explaining the operation by a claw part. 同実施の形態において、爪部による動作を説明するための、第3間材および半導体素子を含む位置決めガイドの上面図である。In the same embodiment, it is a top view of the positioning guide including the third interstitial material and the semiconductor element for explaining the operation by the claw portion. 同実施の形態において、図13に示す動作の後に行われる動作を示す正面図である。It is a front view which shows the operation performed after the operation shown in FIG. 13 in the same embodiment. 同実施の形態において、図17に示す動作の後に行われる動作を示す正面図である。It is a front view which shows the operation performed after the operation shown in FIG. 17 in the same embodiment. 実施の形態2に係る半導体試験装置における分離部を示す斜視図である。It is a perspective view which shows the separation part in the semiconductor test apparatus which concerns on Embodiment 2. 同実施の形態において、半導体試験装置による動作を説明するための一動作を示す上面図である。It is a top view which shows one operation for demonstrating the operation by the semiconductor test apparatus in the same embodiment. 同実施の形態において、半導体試験装置による動作を説明するための一動作を示す正面図である。In the same embodiment, it is a front view which shows one operation for demonstrating the operation by the semiconductor test apparatus.

実施の形態1.
実施の形態1に係る半導体試験装置の一例について説明する。実施の形態に係る半導体試験装置は、大電流を流す用途で用いられる半導体素子の電気的特性を評価するために用いられる。
Embodiment 1.
An example of the semiconductor test apparatus according to the first embodiment will be described. The semiconductor test apparatus according to the embodiment is used to evaluate the electrical characteristics of a semiconductor element used in an application in which a large current is passed.

図1に示すように、半導体試験装置1は、加圧通電部3、通電制御部4、移送部5、分離部6および回収部7を備えている。加圧通電部3、通電制御部4、移送部5、分離部6および回収部7は、土台2に配置されている。 As shown in FIG. 1, the semiconductor test apparatus 1 includes a pressurized energization unit 3, an energization control unit 4, a transfer unit 5, a separation unit 6, and a recovery unit 7. The pressurized energization unit 3, the energization control unit 4, the transfer unit 5, the separation unit 6, and the recovery unit 7 are arranged on the base 2.

加圧通電部3は、冷却板31、位置決めガイド32、加圧通電プローブ33、加圧板34および精密サーボプレス35を備えている。精密サーボプレス35は、支柱36に支持されている。通電制御部4は、プログラマブルロジックコントローラ41、グラフィックオペレーションターミナル42、プレスコントローラ43、通電電源44および電源コントローラ45を備えている。 The pressurized energizing unit 3 includes a cooling plate 31, a positioning guide 32, a pressurized energizing probe 33, a pressure plate 34, and a precision servo press 35. The precision servo press 35 is supported by a support column 36. The energization control unit 4 includes a programmable logic controller 41, a graphic operation terminal 42, a press controller 43, an energization power supply 44, and a power supply controller 45.

移送部5は、X方向移送機構51、Y方向移送機構52、搬送台53およびZ方向移送機構54を備えている。分離部6は、吸着パッド61a、61b、61c、シリンダ62a、62bおよびエアーチューブ63を備えている。回収部7は、半導体素子回収トレイ71および間材回収箱72を備えている。 The transfer unit 5 includes an X-direction transfer mechanism 51, a Y-direction transfer mechanism 52, a transfer base 53, and a Z-direction transfer mechanism 54. The separation unit 6 includes suction pads 61a, 61b, 61c, cylinders 62a, 62b, and an air tube 63. The recovery unit 7 includes a semiconductor element recovery tray 71 and an interstitial material recovery box 72.

図2に示すように、電気的特性が評価される半導体素子11は、互いに対向する第1主面としての表面11aと、第2主面としての裏面11bとを有している。表面11aには表面電極12が配置されている。裏面11bには裏面電極13が配置されている。半導体素子11が、たとえば、MOSFET(Metal Oxide Semiconductor Field Effect Transistor)の場合には、表面電極12としてソース電極およびゲート電極が配置される。裏面電極13としてドレイン電極が配置される。なお、表面電極12の形状および裏面電極13の形状は、一例に過ぎず、これらの形状に限られるものではない。 As shown in FIG. 2, the semiconductor element 11 whose electrical characteristics are evaluated has a front surface 11a as a first main surface and a back surface 11b as a second main surface facing each other. A surface electrode 12 is arranged on the surface 11a. A back surface electrode 13 is arranged on the back surface 11b. When the semiconductor element 11 is, for example, a MOSFET (Metal Oxide Semiconductor Field Effect Transistor), a source electrode and a gate electrode are arranged as surface electrodes 12. A drain electrode is arranged as the back surface electrode 13. The shape of the front electrode 12 and the shape of the back electrode 13 are merely examples, and are not limited to these shapes.

次に、加圧通電部3について、具体的に説明する。図3に示すように、加圧通電部3は、冷却板31、位置決めガイド32、第1主面側間材第2部としての第1間材21、第1主面側間材第1部としての第2間材23、第2主面側間材としての第3間材25、加圧通電プローブ33、加圧板34および精密サーボプレス35を備えている。 Next, the pressurized energization unit 3 will be specifically described. As shown in FIG. 3, the pressurized energizing unit 3 includes a cooling plate 31, a positioning guide 32, a first interstitial member 21 as a second interstitial material on the first main surface side, and a first interstitial material on the first main surface side. It is provided with a second interstitial material 23 as a second interstitial material, a third interstitial material 25 as a second main surface side interstitial material, a pressurized energizing probe 33, a pressure plate 34, and a precision servo press 35.

冷却板31は、半導体素子11が載置される板状の部材である。冷却板31は、矩形の平面形状を有する。冷却板31は、半導体試験装置において通電評価を行う際に発熱した半導体素子11を冷却するための部材である。 The cooling plate 31 is a plate-shaped member on which the semiconductor element 11 is placed. The cooling plate 31 has a rectangular planar shape. The cooling plate 31 is a member for cooling the semiconductor element 11 that has generated heat when performing an energization evaluation in the semiconductor test apparatus.

冷却板31の中央には、凸部31aが設けられている。冷却板31は、熱伝導性が高く、導電性を有する材料が好ましく、たとえば、アルミニウム、銅およびカーボンからなる群から選ばれるいずれかの材料によって形成されていることが好ましい。 A convex portion 31a is provided in the center of the cooling plate 31. The cooling plate 31 is preferably made of a material having high thermal conductivity and conductivity, and is preferably formed of, for example, any material selected from the group consisting of aluminum, copper and carbon.

位置決めガイド32は、冷却板31における半導体素子11の位置を決めるための部材である。位置決めガイド32の中央には、穴32aが設けられている。その穴32aに冷却板31の凸部31aが嵌め込まれる。さらに、その穴32aに、後述する第3間材25と半導体素子11とが嵌め込まれる。こうして、半導体素子11の冷却板31における位置決めが行われる。 The positioning guide 32 is a member for determining the position of the semiconductor element 11 on the cooling plate 31. A hole 32a is provided in the center of the positioning guide 32. The convex portion 31a of the cooling plate 31 is fitted into the hole 32a. Further, the third interstitial material 25 and the semiconductor element 11 described later are fitted into the holes 32a. In this way, the positioning of the semiconductor element 11 on the cooling plate 31 is performed.

位置決めガイド32の材料(材質)としては、半導体素子11への通電を分流させないようにするため、絶縁性、耐熱性および耐摩耗性を有する材料であればよく、たとえば、セラミックス系の高分子材料が好ましい。また、銅またはアルミニウム等の金属材料の表面に、絶縁性の膜をコーティングしたものを適用してもよい。絶縁性の膜としては、たとえば、絶縁テープ、セラミックスコーティング、ガラスコーティング等が好ましい。これらの材料を適用することで、たとえば、電流の分流等、通電検査のプロセスに影響を及ぼす要因を、安価に排除することができる。 The material (material) of the positioning guide 32 may be any material having insulation, heat resistance, and wear resistance so as not to divert the energization to the semiconductor element 11. For example, a ceramic polymer material. Is preferable. Further, a metal material such as copper or aluminum coated with an insulating film may be applied. As the insulating film, for example, insulating tape, ceramic coating, glass coating and the like are preferable. By applying these materials, factors affecting the energization inspection process, such as current shunting, can be eliminated at low cost.

第1間材21は、半導体素子11と後述する加圧通電プローブ33との間に配置される。第1間材21には、半導体素子11への通電によって発生する熱を裏面内において均等に分布させるとともに、半導体素子11を冷却させる機能をもたせる必要がある。このため、第1間材21のサイズとしては、半導体素子11の平面視のサイズと同等のサイズを有していることが好ましい。 The first interstitial material 21 is arranged between the semiconductor element 11 and the pressurized energizing probe 33 described later. The first interstitial material 21 needs to have a function of evenly distributing the heat generated by energization of the semiconductor element 11 on the back surface and cooling the semiconductor element 11. Therefore, it is preferable that the size of the first interstitial material 21 is the same as the size of the semiconductor element 11 in a plan view.

第1間材21の厚さとしては、耐久性の観点からは厚い方が好ましいが、冷却性の観点からは、厚さを厚くしすぎると冷却性が悪化する。このため、半導体素子11の厚さと同程度の厚さか、半導体素子11の厚さよりも薄く、通電試験中に破壊されない程度の厚さが好ましい。 The thickness of the first interstitial material 21 is preferably thick from the viewpoint of durability, but from the viewpoint of cooling performance, if the thickness is too thick, the cooling performance deteriorates. Therefore, it is preferable that the thickness is about the same as the thickness of the semiconductor element 11 or thinner than the thickness of the semiconductor element 11 so as not to be destroyed during the energization test.

第1間材21には、加圧通電プローブ33が接触するため、第1間材21と加圧通電プローブ33との接触面積を増やすには、第1間材21の面粗さを小さくすることが好ましい。第1間材21の面粗さとしては、たとえば、平面度10μm程度が好ましい。また、第1間材21は、下降した加圧通電プローブ33の底面と半導体素子11との平行度のずれを吸収する役割を有する。 Since the pressurized energizing probe 33 comes into contact with the first interstitial material 21, the surface roughness of the first interstitial material 21 is reduced in order to increase the contact area between the first interstitial material 21 and the pressurized energizing probe 33. Is preferable. The surface roughness of the first interstitial material 21 is preferably, for example, a flatness of about 10 μm. Further, the first interstitial material 21 has a role of absorbing the deviation of the parallelism between the bottom surface of the lowered pressurized energizing probe 33 and the semiconductor element 11.

特に、複数の加圧通電プローブ33を適用する場合には、加圧通電プローブ33の長さにばらつきがある場合がある。複数の加圧通電プローブ33による加圧力を均一化するには、第1間材21の厚さとして所望の厚さが必要とされる。第1間材21の厚さが薄い場合には、塑性変形を起こしやすく、均一な加圧力を得ることが難しくなる。また、半導体素子11を破損させてしまうおそれがある。さらに、通電を行う際に電流が局所的に流れてしまい、半導体素子11の裏面が酸化しやすくなる。 In particular, when a plurality of pressurized energizing probes 33 are applied, the length of the pressurized energizing probe 33 may vary. In order to make the pressing force by the plurality of pressurized energizing probes 33 uniform, a desired thickness is required as the thickness of the first interstitial material 21. When the thickness of the first interstitial material 21 is thin, plastic deformation is likely to occur, and it becomes difficult to obtain a uniform pressing force. In addition, the semiconductor element 11 may be damaged. Further, when energization is performed, a current flows locally, and the back surface of the semiconductor element 11 is easily oxidized.

第2間材23は、半導体素子11と加圧通電プローブ33との間に配置され、特に、半導体素子11と第1間材21との間に配置される。第2間材23は、半導体素子11の表面電極12に接触する。 The second interstitial material 23 is arranged between the semiconductor element 11 and the pressurized energization probe 33, and in particular, is arranged between the semiconductor element 11 and the first interstitial material 21. The second interstitial material 23 comes into contact with the surface electrode 12 of the semiconductor element 11.

第2間材23のサイズとしては、半導体素子11を覆うことができるサイズであればよいが、後述するように、第2間材23を変形させて、半導体素子11と第2間材23との間に隙間を生じさせるには、長手方向と短手方向とを有するサイズであることが好ましい。第2間材23の厚さとしては、半導体素子11の表面11aに形成されている表面電極の数μm程度の段差を吸収しうる程度の厚さが必要とされる。第2間材23の厚さが薄すぎる場合には、通電試験中に第2間材23が破断してしまい、通電試験を行うことができないおそれが生じる。 The size of the second interleaving material 23 may be a size that can cover the semiconductor element 11, but as will be described later, the second interleaving material 23 is deformed to form the semiconductor element 11 and the second interleaving material 23. In order to form a gap between the two, it is preferable that the size has a longitudinal direction and a lateral direction. The thickness of the second interstitial material 23 is required to be thick enough to absorb a step of about several μm of the surface electrode formed on the surface 11a of the semiconductor element 11. If the thickness of the second interstitial material 23 is too thin, the second interstitial material 23 may break during the energization test, and the energization test may not be possible.

一方、第2間材23の厚さが厚すぎる場合には、加圧通電試験の際の発熱によって、圧延方向に熱膨張が大きくなる。このため、第2間材23の熱膨張と半導体素子11の熱膨張とで熱膨張差が生じ、半導体素子11に傷がつきやすくなる。また、第2間材23の剛性が高くなることで、加圧通電試験の際に、半導体素子11の表面形状に対応した変形によって空隙ができるおそれがある。その結果、放熱性が悪化し、半導体素子11の裏面11b(図2参照)が酸化しやすくなる。 On the other hand, if the thickness of the second interstitial material 23 is too thick, thermal expansion increases in the rolling direction due to heat generated during the pressurization and energization test. Therefore, a difference in thermal expansion occurs between the thermal expansion of the second interstitial material 23 and the thermal expansion of the semiconductor element 11, and the semiconductor element 11 is easily damaged. Further, since the rigidity of the second interstitial material 23 is increased, there is a possibility that a gap may be formed due to deformation corresponding to the surface shape of the semiconductor element 11 during the pressurization energization test. As a result, the heat dissipation property deteriorates, and the back surface 11b (see FIG. 2) of the semiconductor element 11 is easily oxidized.

第3間材25は、冷却板31の凸部31aと半導体素子11との間に配置される。第3間材25は、半導体素子11の裏面電極13に接触する。第3間材25は、裏面電極13と通電電源44との電気的な接続を行っている。第3間材25は、冷却板31を介して、通電電源44の正極または負極に電気的に接続されている。第1間材21、第2間材23および第3間材25の材料(材質)としては、電気伝導度が高く、耐熱性を有し、耐摩耗性を有する材料が好ましく、たとえば、銅、アルミニウム等が好ましい。 The third interstitial material 25 is arranged between the convex portion 31a of the cooling plate 31 and the semiconductor element 11. The third interstitial material 25 comes into contact with the back surface electrode 13 of the semiconductor element 11. The third inter-material 25 electrically connects the back surface electrode 13 and the energizing power supply 44. The third interstitial material 25 is electrically connected to the positive electrode or the negative electrode of the energizing power supply 44 via the cooling plate 31. As the material (material) of the first interstitial material 21, the second interstitial material 23, and the third interstitial material 25, a material having high electrical conductivity, heat resistance, and abrasion resistance is preferable, and for example, copper. Aluminum or the like is preferable.

加圧通電プローブ33は、第1間材21の直上に配置されている。加圧通電プローブ33は、通電電源44と電気的に接続されている。加圧通電プローブ33が第1間材21に接触することによって、半導体素子11へ大電流が供給されることになる。加圧通電プローブ33は、Z方向に延在する円筒形状をしている。加圧通電プローブ33は加圧板34に固定されている。加圧板34には、精密サーボプレス35が取り付けられている。精密サーボプレス35によって、加圧通電プローブ33が上下方向(Z方向)に移動する。 The pressurized energizing probe 33 is arranged directly above the first interstitial material 21. The pressurized energizing probe 33 is electrically connected to the energizing power supply 44. When the pressurized energizing probe 33 comes into contact with the first interstitial material 21, a large current is supplied to the semiconductor element 11. The pressurized energizing probe 33 has a cylindrical shape extending in the Z direction. The pressurized energizing probe 33 is fixed to the pressure plate 34. A precision servo press 35 is attached to the pressure plate 34. The precision servo press 35 moves the pressurized energizing probe 33 in the vertical direction (Z direction).

加圧通電プローブ33の材料としては、電気伝導度が高く、耐熱性、耐摩耗性および耐荷重を有する材料が好ましく、たとえば、カーボンフィラー等を含んだ導電性樹脂材料、真鍮またはステンレス等が好ましい。また、加圧通電プローブ33は、たとえば、タングステン等の炭素工具鋼によって形成されていてもよい。 The material of the pressurized energizing probe 33 is preferably a material having high electrical conductivity, heat resistance, abrasion resistance, and load capacity, and for example, a conductive resin material containing a carbon filler or the like, brass, stainless steel, or the like is preferable. .. Further, the pressurized energizing probe 33 may be formed of, for example, carbon tool steel such as tungsten.

加圧通電プローブ33として、ここでは、3本の加圧通電プローブ33が示されているが、加圧通電プローブ33一本当たりの荷重と電流密度に耐えることができれば、一本の加圧通電プローブ33によって加圧通電するようにしてもよい。また、3本に限られず、複数本の加圧通電プローブ33によって加圧通電するようにしてもよい。 As the pressurized energizing probe 33, three pressurized energizing probes 33 are shown here, but if the load and current density per pressurizing energizing probe 33 can be withstood, one pressurized energizing probe 33 is shown. Pressurization and energization may be performed by the probe 33. Further, the pressure is not limited to three, and pressure may be applied by a plurality of pressure-energized probes 33.

加圧板34の材料としては、加圧通電プローブ33との電気的な接続と、発熱した加圧通電プローブ33を冷却するために、電気伝導度が高く、耐熱性および耐摩耗性を有する材料が好ましく、たとえば、銅またはアルミニウム等が好ましい。また、加圧板34は、たとえば、炭素工具鋼によって形成されていてもよい。 As the material of the pressurizing plate 34, a material having high electrical conductivity, heat resistance and abrasion resistance is used for electrically connecting to the pressurized energizing probe 33 and cooling the generated pressurized energizing probe 33. Preferably, for example, copper or aluminum is preferable. Further, the pressure plate 34 may be formed of, for example, carbon tool steel.

次に、移送部5について、具体的に説明する。搬送台53には、冷却板31等が配置される。Y方向移送機構は、搬送台53または半導体素子11等をY方向に移送する。搬送台53は、加圧通電プローブ33の直下の位置にまで移動可能とされる。X方向移送機構51は、半導体素子11等をX方向に移送する。Z方向移送機構54は、半導体素子11等をZ方向に移送する。 Next, the transfer unit 5 will be specifically described. A cooling plate 31 and the like are arranged on the transport table 53. The Y-direction transfer mechanism transfers the transfer table 53, the semiconductor element 11, or the like in the Y direction. The transport table 53 can be moved to a position directly below the pressurized energization probe 33. The X-direction transfer mechanism 51 transfers the semiconductor element 11 and the like in the X direction. The Z-direction transfer mechanism 54 transfers the semiconductor element 11 and the like in the Z direction.

次に、分離部6について、具体的に説明する。図4に示すように、分離部6は、保持部としての吸着パッド61a、61b、61cと、位置変更部としてのシリンダ62a、62bとを有する。吸着パッド61aは、第1間材21に吸着する。吸着パッド61bは、第2間材23の一端側を吸着する。吸着パッド61cは、第2間材23の他端側を吸着する。 Next, the separation unit 6 will be specifically described. As shown in FIG. 4, the separating portion 6 has suction pads 61a, 61b, 61c as holding portions and cylinders 62a, 62b as position changing portions. The suction pad 61a sucks on the first interstitial material 21. The suction pad 61b sucks one end side of the second interstitial material 23. The suction pad 61c sucks the other end side of the second interstitial material 23.

吸着パッド61a、61b、61cには、エアーチューブ63が接続されている。シリンダ62aは、吸着パッド61bと吸着パッド61aとの間の距離が変えられるよう駆動する。シリンダ62bは、吸着パッド61cと吸着パッド61aとの間の距離が変えられるよう駆動する。 An air tube 63 is connected to the suction pads 61a, 61b, 61c. The cylinder 62a is driven so that the distance between the suction pad 61b and the suction pad 61a can be changed. The cylinder 62b is driven so that the distance between the suction pad 61c and the suction pad 61a can be changed.

次に、通電制御部4について、具体的に説明する。通電制御部4は、移送部5の駆動と、加圧通電部3への通電とを制御する。プログラマブルロジックコントローラ41では、移送部5の駆動と、加圧通電部3への通電と、分離部6の駆動とを制御する一連のプログラムがインストールされている。グラフィックオペレーションターミナル42を通じて、プログラマブルロジックコントローラ41を操作する。なお、グラフィックオペレーションターミナル42として、たとえば、三菱電機製のグラフィックオペレーションターミナルが用いられる。 Next, the energization control unit 4 will be specifically described. The energization control unit 4 controls the drive of the transfer unit 5 and the energization of the pressurized energization unit 3. In the programmable logic controller 41, a series of programs for controlling the drive of the transfer unit 5, the energization of the pressurized energization unit 3, and the drive of the separation unit 6 are installed. The programmable logic controller 41 is operated through the graphic operation terminal 42. As the graphic operation terminal 42, for example, a graphic operation terminal manufactured by Mitsubishi Electric is used.

通電制御部4は、以下に示す機能を有する。プレスコントローラ43によって、加圧通電部3の精密サーボプレス35の駆動が制御される。通電電源44から必要な電力が供給される。電源コントローラ45によって、通電電源44からの電力の供給が制御される。 The energization control unit 4 has the following functions. The press controller 43 controls the drive of the precision servo press 35 of the pressurizing and energizing unit 3. The required power is supplied from the energized power supply 44. The power controller 45 controls the supply of electric power from the energized power supply 44.

プログラマブルロジックコントローラ41からの指示によって、プレスコントローラ43にあらかじめ設定されている条件を読み込むことで、精密サーボプレス35が駆動し加圧板34を下降させる。加圧板34が下降することで、加圧通電プローブ33が第1間材21に接触する。次に、プログラマブルロジックコントローラ41からの指示によって、加圧通電プローブ33の加圧力を、任意に設定された規定の荷重値(25kg〜100kg)まで上昇させる。 By reading the conditions set in advance in the press controller 43 according to the instruction from the programmable logic controller 41, the precision servo press 35 is driven and the pressure plate 34 is lowered. As the pressure plate 34 descends, the pressure energizing probe 33 comes into contact with the first interstitial material 21. Next, according to the instruction from the programmable logic controller 41, the pressing force of the pressurized energizing probe 33 is increased to an arbitrarily set specified load value (25 kg to 100 kg).

次に、電源コントローラ45にあらかじめ設定されている条件を読み込むことで、通電電源44から、任意に設定された電流を第1間材21等を介して半導体素子11へ順方向に流す。電流密度は、たとえば、120A/cm以上400A/cm以下に設定される。電流を流す際には、半導体素子11の温度は、たとえば、150℃以上230℃以下に設定されている。 Next, by reading the conditions set in advance in the power supply controller 45, an arbitrarily set current is flowed in the forward direction from the energized power supply 44 to the semiconductor element 11 via the first interstitial material 21 and the like. The current density is set to, for example, 120 A / cm 2 or more and 400 A / cm 2 or less. When passing an electric current, the temperature of the semiconductor element 11 is set to, for example, 150 ° C. or higher and 230 ° C. or lower.

冷却板31の凸部31aには、熱電対(図示せず)が取り付けられている。通電加圧中の半導体素子11の温度は、この熱電対によって常時測定される。測定される温度が規定の温度範囲(150℃以上230℃以下)から外れた場合には、プログラマブルロジックコントローラ41から、プレスコントローラ43と電源コントローラ45とへ、通電加圧を停止する信号が送られる。 A thermocouple (not shown) is attached to the convex portion 31a of the cooling plate 31. The temperature of the semiconductor element 11 during energization and pressurization is constantly measured by this thermocouple. When the measured temperature deviates from the specified temperature range (150 ° C or higher and 230 ° C or lower), the programmable logic controller 41 sends a signal to the press controller 43 and the power supply controller 45 to stop energization and pressurization. ..

また、電流密度が規定の電流範囲(120A/cm以上400A/cm以下)から外れた場合には、電源コントローラ45は、加圧通電中の半導体素子11が不良品であると判定し、その結果がプログラマブルロジックコントローラ41に送信される。プログラマブルロジックコントローラ41からは、プレスコントローラ43と電源コントローラ45とへ、通電加圧を停止する信号が送られる。この通電加圧を、異常発生時に停止させることで、周辺機構部へのダメージが抑制されることになる。実施の形態1に係る半導体試験装置は上記のように構成される。 When the current density deviates from the specified current range (120 A / cm 2 or more and 400 A / cm 2 or less), the power controller 45 determines that the semiconductor element 11 being pressurized and energized is a defective product. The result is transmitted to the programmable logic controller 41. A signal for stopping energization and pressurization is sent from the programmable logic controller 41 to the press controller 43 and the power supply controller 45. By stopping this energization and pressurization when an abnormality occurs, damage to the peripheral mechanism is suppressed. The semiconductor test apparatus according to the first embodiment is configured as described above.

次に、上述した半導体試験装置の動作の一例について説明する。まず、加圧通電部3の動作について説明する。図5に示すように、位置決めガイド32の穴32aに、冷却板31の凸部31aを嵌め込む態様で、位置決めガイド32を冷却板31に配置する。次に、第3間材25を、穴32a内に位置する凸部31aの上に載置する。 Next, an example of the operation of the above-mentioned semiconductor test apparatus will be described. First, the operation of the pressurized energizing unit 3 will be described. As shown in FIG. 5, the positioning guide 32 is arranged in the cooling plate 31 in a manner in which the convex portion 31a of the cooling plate 31 is fitted into the hole 32a of the positioning guide 32. Next, the third interstitial member 25 is placed on the convex portion 31a located in the hole 32a.

次に、図6に示すように、第3間材25の上に半導体素子11を載置する。次に、図7に示すように、半導体素子11を覆うように、第2間材23を載置する。次に、図8に示すように、第2間材23の上に第1間材21を載置する。次に、図9に示すように、第1間材21が載置された冷却板31等を、加圧通電プローブ33の直下に配置する。冷却板31等は、搬送台53(図1参照)に載置されている。 Next, as shown in FIG. 6, the semiconductor element 11 is placed on the third interstitial material 25. Next, as shown in FIG. 7, the second interstitial member 23 is placed so as to cover the semiconductor element 11. Next, as shown in FIG. 8, the first interstitial material 21 is placed on the second interstitial material 23. Next, as shown in FIG. 9, the cooling plate 31 or the like on which the first interstitial material 21 is placed is arranged directly under the pressurized energizing probe 33. The cooling plate 31 and the like are placed on the transport table 53 (see FIG. 1).

次に、図10に示すように、通電制御部4からの信号により、精密サーボプレス35を駆動させて、加圧板34等を下降させ、加圧通電プローブ33を第1間材21に接触させる。このとき、加圧通電プローブ33の加圧力を、規定の荷重値(25kg〜100kg)まで上昇させる。また、半導体素子11の温度が、たとえば、150℃以上230℃以下に設定される。 Next, as shown in FIG. 10, the precision servo press 35 is driven by the signal from the energization control unit 4, the pressure plate 34 and the like are lowered, and the pressurization energization probe 33 is brought into contact with the first interstitial material 21. .. At this time, the pressing force of the pressurized energizing probe 33 is increased to a specified load value (25 kg to 100 kg). Further, the temperature of the semiconductor element 11 is set to, for example, 150 ° C. or higher and 230 ° C. or lower.

次に、通電電源44から、第1間材21等を介して半導体素子11へ電流を順方向に流す。このとき、電流密度は、たとえば、120A/cm以上400A/cm以下に設定される。 Next, a current is passed in the forward direction from the energized power supply 44 to the semiconductor element 11 via the first interstitial material 21 and the like. At this time, the current density is set to, for example, 120 A / cm 2 or more and 400 A / cm 2 or less.

なお、半導体素子11の温度が規定の温度範囲(150℃以上230℃以下)から外れた場合には、加圧通電が停止される。また、電流密度が規定の電流範囲(120A/cm以上400A/cm以下)から外れた場合には、通電加圧中の半導体素子11が不良品であると判定されて、加圧通電が停止される。 When the temperature of the semiconductor element 11 deviates from the specified temperature range (150 ° C. or higher and 230 ° C. or lower), the pressurized energization is stopped. When the current density deviates from the specified current range (120 A / cm 2 or more and 400 A / cm 2 or less), it is determined that the semiconductor element 11 under energization and pressurization is a defective product, and the pressurization and energization is performed. It will be stopped.

この加圧通電による試験において、半導体素子11と第2間材23とが溶着することがある。第2間材23と第1間材21とが溶着することがある。半導体素子11と第3間材25とが溶着することがある。 In this test by pressurizing and energizing, the semiconductor element 11 and the second interstitial material 23 may be welded. The second interstitial material 23 and the first interstitial material 21 may be welded. The semiconductor element 11 and the third interstitial material 25 may be welded.

加圧通電部3による半導体素子11の試験が完了すると、半導体素子11を搭載した冷却板31等を、搬送台53とともにY方向移送機構52によって、分離部6が配置されている位置(Y方向)へ搬送する(図1参照)。次に、X方向移送機構51によって、分離部6を、冷却板31等が配置されている位置(X方向)へ搬送する(図1参照)。 When the test of the semiconductor element 11 by the pressurized energizing unit 3 is completed, the cooling plate 31 or the like on which the semiconductor element 11 is mounted is placed at the position (Y direction) where the separating unit 6 is arranged by the Y-direction transfer mechanism 52 together with the transport table 53. ) (See Fig. 1). Next, the separation unit 6 is transported to the position (X direction) where the cooling plate 31 and the like are arranged by the X-direction transfer mechanism 51 (see FIG. 1).

次に、図11に示すように、Z方向移送機構54(図1参照)によって、分離部6を下降させて、吸着パッド61a、61b、61cを第1間材21または第2間材23に接触させる。このとき、吸着パッド61aを、第1間材21に接触させる。吸着パッド61bを、第2間材23の一端部に接触させる。吸着パッド61cを、第2間材23の他端部に接触させる。次に、吸着パッド61a、61b、61cによる吸着を同時に開始する。 Next, as shown in FIG. 11, the separation portion 6 is lowered by the Z-direction transfer mechanism 54 (see FIG. 1), and the suction pads 61a, 61b, 61c are attached to the first interstitial material 21 or the second interstitial material 23. Make contact. At this time, the suction pad 61a is brought into contact with the first interstitial material 21. The suction pad 61b is brought into contact with one end of the second interstitial material 23. The suction pad 61c is brought into contact with the other end of the second interstitial material 23. Next, suction by the suction pads 61a, 61b, 61c is started at the same time.

次に、図12に示すように、吸着パッド61a、61b、61cによる吸着状態を維持しながら、シリンダ62aを駆動させることによって、吸着パッド61aと吸着パッド61bとの距離(間隔)を縮める。第1間材21を吸着する吸着パッド61aと第2間材23の一端部を吸着する吸着パッド61bとの間隔が狭まることで、第2間材23が変形を起こし、第2間材23と半導体素子11との間に隙間が生じる。 Next, as shown in FIG. 12, the distance (interval) between the suction pad 61a and the suction pad 61b is shortened by driving the cylinder 62a while maintaining the suction state by the suction pads 61a, 61b, 61c. By narrowing the distance between the suction pad 61a that sucks the first interstitial material 21 and the suction pad 61b that adsorbs one end of the second interstitial material 23, the second interstitial material 23 is deformed, and the second interstitial material 23 and the second interstitial material 23 are deformed. A gap is created between the semiconductor element 11 and the semiconductor element 11.

次に、図13に示すように、さらに、シリンダ62bを駆動させることによって、吸着パッド61aと吸着パッド61cとの距離(間隔)を縮める。第1間材21を吸着する吸着パッド61aと第2間材23の他端部を吸着する吸着パッド61cとの間隔が狭まることで、第2間材23がさらに変形を起こし、第2間材23と半導体素子11との間の隙間がさらに広がる。 Next, as shown in FIG. 13, the distance (interval) between the suction pad 61a and the suction pad 61c is further shortened by further driving the cylinder 62b. By narrowing the distance between the suction pad 61a that sucks the first interstitial material 21 and the suction pad 61c that adsorbs the other end of the second interstitial material 23, the second interstitial material 23 is further deformed and the second interstitial material 23 is further deformed. The gap between the 23 and the semiconductor element 11 is further widened.

次に、第2間材23と半導体素子11との間に隙間が生じた状態から、たとえば、位置決めガイド32に半導体素子11の側面を接触させて、半導体素子11を第2間材23から分離させる。分離した半導体素子11は冷却板31へ落下する。第1間材21および第2間材23は、吸着パッド61a、61b、61cに吸着された状態で搬送されて、間材回収箱72に回収される。 Next, from the state where a gap is formed between the second interstitial material 23 and the semiconductor element 11, for example, the side surface of the semiconductor element 11 is brought into contact with the positioning guide 32 to separate the semiconductor element 11 from the second interstitial material 23. Let me. The separated semiconductor element 11 falls on the cooling plate 31. The first interstitial material 21 and the second interstitial material 23 are conveyed in a state of being adsorbed by the suction pads 61a, 61b, 61c and collected in the interstitial material collection box 72.

冷却板31に落下した半導体素子11には、第3間材25が溶着していることがある。次に、図14に示すように、半導体素子11に溶着した第3間材25を、爪部69a、69bによって分離する。図14および図15に示すように、第3間材25には、半導体素子11が載置された状態で、半導体素子11から面方向に突出する突出部25aが設けられている。 The third interstitial material 25 may be welded to the semiconductor element 11 that has fallen onto the cooling plate 31. Next, as shown in FIG. 14, the third interstitial material 25 welded to the semiconductor element 11 is separated by the claw portions 69a and 69b. As shown in FIGS. 14 and 15, the third interstitial member 25 is provided with a protruding portion 25a that projects in the plane direction from the semiconductor element 11 in a state where the semiconductor element 11 is mounted.

図16に示すように、半導体素子11が冷却板31に落下した状態(載置されている状態)で、位置決めガイド32には、この突出部25aを露出させる部分が設けられている。第3間材25は、爪部69a、69bを突出部25aに引っ掛けることで、半導体素子11と分離される。 As shown in FIG. 16, the positioning guide 32 is provided with a portion for exposing the protruding portion 25a in a state where the semiconductor element 11 is dropped (mounted) on the cooling plate 31. The third interstitial material 25 is separated from the semiconductor element 11 by hooking the claw portions 69a and 69b on the protruding portion 25a.

図17に示すように、爪部69aを第3間材25の一端側の突出部25aに当接させ、爪部69bを第3間材25の他端側の突出部25aに当接させる。次に、図18に示すように、爪部69a、69bを突出部25aに当接させた状態で、半導体素子11を上方に引き上げる。これは、たとえば、吸着パッド61aを半導体素子11に吸着させて行うことができる。 As shown in FIG. 17, the claw portion 69a is brought into contact with the protruding portion 25a on one end side of the third interleaving member 25, and the claw portion 69b is brought into contact with the protruding portion 25a on the other end side of the third interleaving member 25. Next, as shown in FIG. 18, the semiconductor element 11 is pulled upward in a state where the claw portions 69a and 69b are in contact with the protruding portions 25a. This can be done, for example, by sucking the suction pad 61a onto the semiconductor element 11.

第3間材25と分離された半導体素子11は、半導体素子回収トレイ71に回収される。一方、分離された第3間材25は、間材回収箱72に回収される。こうして、半導体試験装置1による一連の加圧通電試験が完了する。 The semiconductor element 11 separated from the third interstitial material 25 is collected in the semiconductor element recovery tray 71. On the other hand, the separated third interstitial material 25 is collected in the interstitial material collection box 72. In this way, a series of pressurized energization tests by the semiconductor test apparatus 1 are completed.

上述した半導体試験装置1では、分離部6を備えていることで、半導体素子11に第2間材23等が溶着した場合であっても、人の手を要さずに、半導体素子11と第2間材23等とを自動で分離させることができる。これにより、半導体素子11と第2間材23等とを分離させる作業を含む一連の加圧通電試験に要する時間を短縮することができ、生産能力の増強および省人化に寄与することができる。 Since the semiconductor test apparatus 1 described above is provided with the separation unit 6, even when the second interstitial material 23 or the like is welded to the semiconductor element 11, it can be combined with the semiconductor element 11 without human intervention. The second interstitial material 23 and the like can be automatically separated. As a result, the time required for a series of pressurization and energization tests including the work of separating the semiconductor element 11 and the second interstitial material 23 and the like can be shortened, which can contribute to the enhancement of production capacity and labor saving. ..

従来、半導体素子11と第2間材23等とが溶着した場合には、溶着した際の接着力以上の接着力を有する粘着テープを使って、半導体素子11と第2間材23等とを分離することが行われていた。このため、粘着テープを使用した場合には、粘着テープの新生面を使用できるように、使用した箇所をカットして廃棄する機構が必要とされた。また、粘着テープの新生面を取り出すためのローラ等が必要とされた。上述した半導体試験装置1では、その機構等が不要になり、ランニングコストを抑えることができる。 Conventionally, when the semiconductor element 11 and the second interleaving material 23 or the like are welded together, the semiconductor element 11 and the second interleaving material 23 or the like are bonded to each other by using an adhesive tape having an adhesive strength equal to or higher than the adhesive strength at the time of welding. Separation was being done. Therefore, when the adhesive tape is used, a mechanism for cutting and discarding the used portion is required so that the new surface of the adhesive tape can be used. In addition, a roller or the like for taking out the new surface of the adhesive tape was required. In the semiconductor test apparatus 1 described above, the mechanism and the like are not required, and the running cost can be suppressed.

また、上述した半導体試験装置の分離部6のシリンダ62a、62bとして、電動のシリンダを適用してもよい。この場合には、吸着パッド61a、61b、61cによって吸着搬送される対象ワーク(半導体素子11および第2間材23等)のサイズに応じて、吸着パッド61a、61b、61cによる吸着位置を容易に変えることができる。このため、対象ワークのサイズに対応させるための分離部6における吸着部分の改造が不要になる。また、対象ワークのサイズに対応した他の分離部を搭載する必要もなくなる。これらの結果、半導体試験装置1の省スペース化と低コスト化とを図ることができる。 Further, an electric cylinder may be applied as the cylinders 62a and 62b of the separation unit 6 of the semiconductor test apparatus described above. In this case, the suction position by the suction pads 61a, 61b, 61c can be easily determined according to the size of the target work (semiconductor element 11 and the second interstitial material 23, etc.) that is suction-conveyed by the suction pads 61a, 61b, 61c. Can be changed. Therefore, it is not necessary to modify the suction portion in the separation portion 6 to correspond to the size of the target work. In addition, it is not necessary to mount another separation unit corresponding to the size of the target work. As a result, it is possible to save space and reduce the cost of the semiconductor test apparatus 1.

さらに、分離部6の吸着パッド61a、吸着パッド61bおよび吸着パッド61cの配置位置として、たとえば、図4に示される矩形状の第2間材23の対角線に沿って配置してもよい。すなわち、吸着パッド61bのY方向位置を、吸着パッド61aのY方向位置よりも負側の位置に配置し、吸着パッド61cのY方向位置を、吸着パッド61aのY方向位置よりも正側の位置に配置してもよい。この場合には、シリンダ62a、62bが動作をすると、第2間材23にねじり方向の力が加えられて、半導体素子11と第2間材23との間に隙間を生じさせやすくすることができる。その結果、半導体素子11と第2間材23等とを確実に分離させることができる。 Further, the suction pad 61a, the suction pad 61b, and the suction pad 61c of the separation unit 6 may be arranged along the diagonal line of the rectangular second interstitial material 23 shown in FIG. 4, for example. That is, the Y-direction position of the suction pad 61b is arranged at a position on the negative side of the Y-direction position of the suction pad 61a, and the Y-direction position of the suction pad 61c is a position on the positive side of the Y-direction position of the suction pad 61a. May be placed in. In this case, when the cylinders 62a and 62b operate, a force in the twisting direction is applied to the second interleaving member 23, which makes it easy to create a gap between the semiconductor element 11 and the second interleaving member 23. can. As a result, the semiconductor element 11 and the second interstitial material 23 and the like can be reliably separated.

なお、上述した半導体試験装置1では、シリンダ62aおよびシリンダ62bの双方を動作させる場合について説明したが、シリンダ62aおよびシリンダ62bのうちの一方だけを動作させても、半導体素子11と第2間材23等とを分離させることができる。 In the semiconductor test apparatus 1 described above, the case where both the cylinder 62a and the cylinder 62b are operated has been described. However, even if only one of the cylinder 62a and the cylinder 62b is operated, the semiconductor element 11 and the second interleaving material are used. It can be separated from the 23 mag.

また、上述した半導体試験装置1では、位置決めガイド32に半導体素子11の側面を接触させて半導体素子11を第2間材23等から分離させる場合について説明したが、必ずしも位置決めガイド32に半導体素子11の側面を接触させる必要はない。たとえば、第2間材23と半導体素子11との間に十分な隙間が生じた場合には、半導体素子11は第2間材23から容易に分離して、冷却板31へ落下することになる。 Further, in the semiconductor test apparatus 1 described above, the case where the side surface of the semiconductor element 11 is brought into contact with the positioning guide 32 to separate the semiconductor element 11 from the second interstitial material 23 or the like has been described, but the semiconductor element 11 is not necessarily attached to the positioning guide 32. There is no need to touch the sides of the. For example, when a sufficient gap is formed between the second interleaving material 23 and the semiconductor element 11, the semiconductor element 11 is easily separated from the second interleaving material 23 and falls to the cooling plate 31. ..

実施の形態2.
前述した半導体試験装置の分離部では、吸着パッドをシリンダによって動作させる場合について説明した。ここでは、吸着パッドをモータとギア等によって動作させる分離部を備えた半導体試験装置の一例について説明する。
Embodiment 2.
In the separation section of the semiconductor test apparatus described above, a case where the suction pad is operated by a cylinder has been described. Here, an example of a semiconductor test apparatus provided with a separation portion for operating the suction pad by a motor and a gear or the like will be described.

図19に示すように、半導体試験装置の分離部6は、ピニオンギア64、モータ65、ラック66a、66b、リニアガイドブロック67およびリニアガイドレール68を備えている。ピニオンギア64はモータ65によって回転する。ラック66a、66bは、ピニオンギア64に噛み合うように配置されている。ラック66a、66bには、リニアガイドブロック67およびリニアガイドレール68が固定されている。 As shown in FIG. 19, the separation unit 6 of the semiconductor test apparatus includes a pinion gear 64, a motor 65, racks 66a and 66b, a linear guide block 67, and a linear guide rail 68. The pinion gear 64 is rotated by a motor 65. The racks 66a and 66b are arranged so as to mesh with the pinion gear 64. A linear guide block 67 and a linear guide rail 68 are fixed to the racks 66a and 66b.

リニアガイドブロック67は、ラック66a、66bにおける歯が配置されている面とは反対側の面に固定されている。リニアガイドブロック67は、リニアガイドレール37に沿って直線状(X方向)にスライドする。リニアガイドレール37は、たとえば、X方向に延在するようにラック66a、66bに固定されている。なお、これ以外の構成については、図1に示す半導体試験装置1の構成と同様なので、同一部材には同一符号を付し、必要である場合を除きその説明を繰り返さないこととする。 The linear guide block 67 is fixed to the surface of the racks 66a and 66b opposite to the surface on which the teeth are arranged. The linear guide block 67 slides in a straight line (X direction) along the linear guide rail 37. The linear guide rail 37 is fixed to the racks 66a and 66b so as to extend in the X direction, for example. Since the other configurations are the same as those of the semiconductor test apparatus 1 shown in FIG. 1, the same members are designated by the same reference numerals, and the description thereof will not be repeated unless necessary.

次に、上述した半導体試験装置の動作の一例について説明する。前述したように、加圧通電部3による半導体素子11の試験が行われ、その試験が完了すると、半導体素子11を搭載した冷却板31等が、分離部6の直下の位置に搬送される(図19参照)。 Next, an example of the operation of the above-mentioned semiconductor test apparatus will be described. As described above, the semiconductor element 11 is tested by the pressurized energizing unit 3, and when the test is completed, the cooling plate 31 or the like on which the semiconductor element 11 is mounted is conveyed to a position directly below the separating unit 6 ( (See FIG. 19).

次に、図19に示すように、吸着パッド61aを第1間材21に接触させる。吸着パッド61bを、第2間材23の一端部に接触させ、吸着パッド61cを、第2間材23の他端部に接触させる。次に、吸着パッド61a、61b、61cによる吸着を同時に開始する。 Next, as shown in FIG. 19, the suction pad 61a is brought into contact with the first interstitial material 21. The suction pad 61b is brought into contact with one end of the second interstitial material 23, and the suction pad 61c is brought into contact with the other end of the second interstitial material 23. Next, suction by the suction pads 61a, 61b, 61c is started at the same time.

次に、図20および図21に示すように、吸着パッド61a、61b、61cによる吸着状態を維持しながら、モータ65によりピニオンギア64を回転させる。ピニオンギア64が回転することで、ラック66aはX方向(正)へスライドし、ラック66bはX方向(負)へスライドする。すなわち、ラック66aとラック66bとは同期してスライドすることになる。 Next, as shown in FIGS. 20 and 21, the pinion gear 64 is rotated by the motor 65 while maintaining the suction state by the suction pads 61a, 61b, 61c. As the pinion gear 64 rotates, the rack 66a slides in the X direction (positive), and the rack 66b slides in the X direction (negative). That is, the rack 66a and the rack 66b slide in synchronization with each other.

この動作により、吸着パッド61bは吸着パッド61aへ接近するとともに、吸着パッド61cは吸着パッド61aへ接近する。吸着パッド61bと吸着パッド61aとの間隔が縮まるとともに、吸着パッド61cと吸着パッド61aとの間隔が縮まることで、図13に示されるのと同様にして、第2間材23が変形を起こし、第2間材23と半導体素子11との間に隙間が生じる。 By this operation, the suction pad 61b approaches the suction pad 61a, and the suction pad 61c approaches the suction pad 61a. As the distance between the suction pad 61b and the suction pad 61a is shortened and the distance between the suction pad 61c and the suction pad 61a is shortened, the second interstitial material 23 is deformed in the same manner as shown in FIG. A gap is formed between the second interstitial material 23 and the semiconductor element 11.

その後、前述した動作と同様にして、たとえば、位置決めガイド32に半導体素子11の側面を接触させて、第2間材23から半導体素子11を分離させる。さらに、爪部により、半導体素子11を第3間材25から分離させる。こうして、半導体試験装置1による一連の加圧通電試験が完了する。 After that, in the same manner as described above, for example, the side surface of the semiconductor element 11 is brought into contact with the positioning guide 32 to separate the semiconductor element 11 from the second interstitial member 23. Further, the claw portion separates the semiconductor element 11 from the third interstitial material 25. In this way, a series of pressurized energization tests by the semiconductor test apparatus 1 are completed.

上述した半導体試験装置では、前述した効果に加えて、次のような効果が得られる。すなわち、分離部6では、モータ65の回転を、ピニオンギア64およびラック66a、66bによって、吸着パッド61bと吸着パッド61cとの同期したスライド動作に変換させることができる。これにより、吸着パッド61bと吸着パッド61cとを個別に動作させる場合と比べて、駆動軸の数を減らすことができる。 In the above-mentioned semiconductor test apparatus, the following effects can be obtained in addition to the above-mentioned effects. That is, in the separation unit 6, the rotation of the motor 65 can be converted into a synchronized slide operation of the suction pad 61b and the suction pad 61c by the pinion gear 64 and the racks 66a and 66b. As a result, the number of drive shafts can be reduced as compared with the case where the suction pad 61b and the suction pad 61c are operated individually.

なお、吸着パッド61bと吸着パッド61cとを同期させてスライド動作させる必要は必ずしもなく、吸着パッド61bおよび吸着パッド61cのうち、一方を先にスライド動作させ、他方を遅れてスライド動作させるようにしてもよい。たとえば、リニアガイドレール68を1本として、吸着パッド61bと吸着パッド61cとを、非同期に2つのステージをもってスライド動作させる機構としてもよい。 It is not always necessary to synchronize the suction pad 61b and the suction pad 61c to slide the suction pad 61b, and one of the suction pad 61b and the suction pad 61c is slid first and the other is slid later. May be good. For example, the linear guide rail 68 may be used as one, and the suction pad 61b and the suction pad 61c may be asynchronously slid with two stages.

また、分離部6ではモータ65を駆動源としたが、モータの代わりに、たとえば、シリンダ等の駆動源を別途配置させて、ローラチェーンまたはベルト等によって駆動力を伝達するようにしてもよい。 Further, although the motor 65 is used as the drive source in the separation unit 6, for example, a drive source such as a cylinder may be separately arranged instead of the motor, and the drive force may be transmitted by a roller chain, a belt, or the like.

さらに、吸着パッド61a、61b、61cによって、第2間材23等を吸着させる場合について説明したが、第2間材23等を保持することができれば、吸着パッド61a、61b、61cに限られるものではなく、他の保持部でもよい。 Further, the case where the second interstitial material 23 and the like are adsorbed by the suction pads 61a, 61b and 61c has been described, but if the second interstitial material 23 and the like can be held, the suction pads 61a, 61b and 61c are limited. However, it may be another holding unit.

各実施の形態において説明した、分離部を備えた半導体試験装置については、必要に応じて種々組み合わせることが可能である。 The semiconductor test apparatus provided with the separation unit described in each embodiment can be combined in various ways as needed.

今回開示された実施の形態は例示であってこれに制限されるものではない。本発明は上記で説明した範囲ではなく、特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲でのすべての変更が含まれることが意図される。 The embodiments disclosed this time are examples and are not limited thereto. The present invention is shown by the scope of claims, not the scope described above, and is intended to include all modifications in the sense and scope equivalent to the scope of claims.

本発明は、半導体素子に直流の大電流を通電する半導体試験装置に有効に利用される。 INDUSTRIAL APPLICABILITY The present invention is effectively used in a semiconductor test apparatus that energizes a semiconductor element with a large direct current.

1 半導体試験装置、2 土台、3 加圧通電部、4 通電制御部、5 移送部、6 分離部、7 回収部、11 半導体素子、11a 表面、11b 裏面、12 表面電極、13 裏面電極、21 第1間材、23 第2間材、25 第3間材、25a 突出部、31 冷却板、31a 凸部、32 位置決めガイド、33 加圧通電プローブ、34 加圧板、35 精密サーボプレス、36 支柱、41 プログラマブルロジックコントローラ、42 グラフィックオペレーションターミナル、43 プレスコントローラ、44 通電電源、45 電源コントローラ、51 X方向移送機構、52 Y方向移送機構、53 搬送台、54 Z方向移送機構、61a、61b、61c 吸着パッド、62a、62b シリンダ、63 エアーチューブ、64 ピニオンギア、65 モータ、66a、66b ラック、67 リニアガイドブロック、68 リニアガイドレール、69a、69b 爪部、71 半導体素子回収トレイ、72 間材回収箱。 1 Semiconductor test equipment, 2 Base, 3 Pressurized energizing part, 4 Energizing control part, 5 Transfer part, 6 Separation part, 7 Recovery part, 11 Semiconductor element, 11a front side, 11b back side, 12 front side electrode, 13 back side electrode, 21 1st interleaving material, 23 2nd interleaving material, 25 3rd interleaving material, 25a projecting part, 31 cooling plate, 31a convex part, 32 positioning guide, 33 pressurized energizing probe, 34 pressure plate, 35 precision servo press, 36 columns , 41 programmable logic controller, 42 graphic operation terminal, 43 press controller, 44 energized power supply, 45 power supply controller, 51 X direction transfer mechanism, 52 Y direction transfer mechanism, 53 transfer stand, 54 Z direction transfer mechanism, 61a, 61b, 61c Suction pad, 62a, 62b cylinder, 63 air tube, 64 pinion gear, 65 motor, 66a, 66b rack, 67 linear guide block, 68 linear guide rail, 69a, 69b claw, 71 semiconductor element recovery tray, 72 interstitial material recovery box.

Claims (14)

互いに対向する第1主面および第2主面を有する半導体素子を、間材を介して加圧しながら前記半導体素子に電気的試験をする加圧通電部と、
前記半導体素子から前記間材を分離する分離部と
を有し、
前記分離部は、
前記間材を保持する保持部と、
前記間材を保持した状態で前記保持部の位置を変更し、前記間材と前記半導体素子との間に隙間を生じさせることによって、前記半導体素子を前記間材から分離させる位置変更部と
を備えた、半導体試験装置。
A pressurizing and energizing unit that electrically tests the semiconductor element while pressurizing the semiconductor element having the first main surface and the second main surface facing each other through the interstitial material.
It has a separation part that separates the interstitial material from the semiconductor element.
The separation part
A holding part for holding the interstitial material and
By changing the position of the holding portion while holding the interleaving material and creating a gap between the interleaving material and the semiconductor element, a position changing portion for separating the semiconductor element from the interleaving material is provided. A semiconductor test device equipped.
前記間材は、前記加圧通電部に載置される前記半導体素子の前記第1主面に接触するように配置され、長手方向と短手方向とを有する第1主面側間材を含み、
前記分離部では、
前記保持部は、
前記第1主面側間材の前記長手方向における第1位置を保持する第1保持部と、
前記第1主面側間材の前記長手方向における前記第1位置から第1距離を隔てられた第2位置を保持する第2保持部と
を有し、
前記位置変更部では、前記第1距離を縮めることによって、前記第1主面側間材を変形させる、請求項1記載の半導体試験装置。
The interstitial material includes a first main surface side interstitial material which is arranged so as to be in contact with the first main surface of the semiconductor element mounted on the pressurized current-carrying portion and has a longitudinal direction and a lateral direction. ,
In the separation part
The holding part is
A first holding portion that holds the first position of the first main surface side interleaving member in the longitudinal direction, and a first holding portion.
It has a second holding portion for holding a second position separated by a first distance from the first position in the longitudinal direction of the first main surface side interleaving member.
The semiconductor test apparatus according to claim 1, wherein the position changing portion deforms the first main surface side interleaving member by shortening the first distance.
前記分離部では、
前記保持部は、
前記第1主面側間材の前記長手方向における、前記第2位置とは前記第1位置を挟んで反対側に位置し、前記第1位置から第2距離を隔てられた第3位置を保持する第3保持部と
を有し、
前記位置変更部では、前記第2距離を縮めることによって、前記第1主面側間材を変形させる、請求項2記載の半導体試験装置。
In the separation part
The holding part is
The first main surface side interleaving member is located on the opposite side of the first position from the second position in the longitudinal direction, and holds a third position separated from the first position by a second distance. Has a third holding part
The semiconductor test apparatus according to claim 2, wherein the position changing portion deforms the first main surface side interleaving member by shortening the second distance.
前記第1主面側間材は、
前記半導体素子に接触する第1主面側間材第1部と、
前記第1主面側間材第1部に接触する第1主面側間材第2部と
を含む、請求項2または3に記載の半導体試験装置。
The first main surface side interstitial material is
The first part of the first main surface side interleaving material that comes into contact with the semiconductor element, and
The semiconductor test apparatus according to claim 2 or 3, further comprising a second part of the first main surface side interleaving material that comes into contact with the first part of the first main surface side interleaving material.
前記間材は、前記加圧通電部に載置される前記半導体素子の前記第2主面に接触するように配置され、前記半導体素子から突出して前記半導体素子の前記第2主面に接触しない突出部を有する第2主面側間材を含み、
前記分離部は、前記第2主面側間材の前記突出部に当接する爪部を有し、
前記分離部では、前記爪部を前記第2主面側間材の前記突出部に当接させた状態で、前記保持部によって保持した前記半導体素子を前記第2主面側間材から引き離すことによって、前記半導体素子から前記第2主面側間材を分離させる、請求項1記載の半導体試験装置。
The interstitial material is arranged so as to be in contact with the second main surface of the semiconductor element placed on the pressurized current-carrying portion, and does not protrude from the semiconductor element and come into contact with the second main surface of the semiconductor element. Includes second main surface side interstitial material with protrusions,
The separating portion has a claw portion that abuts on the protruding portion of the second main surface side interleaving member.
In the separating portion, the semiconductor element held by the holding portion is pulled away from the second main surface side interleaving member in a state where the claw portion is in contact with the protruding portion of the second main surface side interleaving member. The semiconductor test apparatus according to claim 1, wherein the second main surface side interleaving material is separated from the semiconductor element.
前記位置変更部は、シリンダによって前記保持部の位置を変更する機構を含む、請求項1記載の半導体試験装置。 The semiconductor test apparatus according to claim 1, wherein the position changing portion includes a mechanism for changing the position of the holding portion by a cylinder. 前記位置変更部は、ラックおよびピニオンギアによって前記保持部の位置を変更する機構を含む、請求項1記載の半導体試験装置。 The semiconductor test apparatus according to claim 1, wherein the position changing portion includes a mechanism for changing the position of the holding portion by a rack and a pinion gear. 前記加圧通電部は、
前記半導体素子が載置される冷却板と、
前記冷却板の上に配置され、前記冷却板に対する前記半導体素子の位置を合わせをする位置決めガイドと
を有する、請求項1記載の半導体試験装置。
The pressurized energizing unit
A cooling plate on which the semiconductor element is placed and
The semiconductor test apparatus according to claim 1, further comprising a positioning guide that is arranged on the cooling plate and aligns the semiconductor element with respect to the cooling plate.
前記半導体素子への通電を制御する通電制御部を有する、請求項1記載の半導体試験装置。 The semiconductor test apparatus according to claim 1, further comprising an energization control unit that controls energization of the semiconductor element. 前記加圧通電部から前記分離部へ前記半導体素子を移送する移送部を有する、請求項1記載の半導体試験装置。 The semiconductor test apparatus according to claim 1, further comprising a transfer unit for transferring the semiconductor element from the pressurized energization unit to the separation unit. 前記半導体素子および前記間材をそれぞれを回収する回収部を有する、請求項1記載の半導体試験装置。 The semiconductor test apparatus according to claim 1, further comprising a recovery unit for recovering the semiconductor element and the interstitial material. 半導体試験装置において、互いに対向する第1主面および第2主面を有する半導体素子を、間材を介して加圧しながら電気的試験を行った後に、前記半導体素子を前記間材から分離する前記半導体素子の分離方法であって、
前記間材として、前記半導体素子の前記第1主面側に第1主面側間材を配置する動作と
前記第1主面側間材における第1位置を保持するとともに、前記第1位置から距離を隔てられた第2位置を保持する動作と、
前記第1主面側間材における前記第1位置および前記第2位置を保持した状態で、前記距離を縮めることによって前記第1主面側間材を変形させ、前記第1主面側間材と前記半導体素子との間に隙間を生じさせて、前記半導体素子を前記第1主面側間材から分離する動作と
を備えた、半導体素子の分離方法。
In the semiconductor test apparatus, after conducting an electrical test while pressurizing a semiconductor element having a first main surface and a second main surface facing each other through an interleaving material, the semiconductor element is separated from the interleaving material. It is a method of separating semiconductor elements.
As the interstitial material, the operation of arranging the first main surface side interstitial material on the first main surface side of the semiconductor element and the first position in the first main surface side interstitial material are maintained, and from the first position. The action of holding the second position separated by a distance,
While holding the first position and the second position in the first main surface side interstitial material, the first main surface side interstitial material is deformed by shortening the distance, and the first main surface side interstitial material is deformed. A method for separating a semiconductor element, comprising an operation of creating a gap between the semiconductor element and the semiconductor element to separate the semiconductor element from the first main surface side interleaving material.
前記第1位置および前記第2位置をそれぞれ保持する動作では、前記第1主面側間材が、前記半導体素子の前記第1主面と対向している面と反対側の表面の部分が保持される、請求項12記載の半導体素子の分離方法。 In the operation of holding the first position and the second position, respectively, the first main surface side interstitial material is held by the portion of the surface of the semiconductor element opposite to the surface facing the first main surface. The method for separating a semiconductor element according to claim 12. 前記間材として、前記半導体素子における前記第2主面に接触する第2主面側間材を係止するとともに、前記半導体素子を保持しながら、前記第2主面側間材を前記半導体素子から引き離す動作を備えた、請求項12記載の半導体素子の分離方法。
As the interstitial material, the second main surface side interstitial material in contact with the second main surface of the semiconductor element is locked, and while holding the semiconductor element, the second main surface side interstitial material is used as the semiconductor element. The method for separating a semiconductor element according to claim 12, further comprising an operation of pulling away from the semiconductor element.
JP2017216297A 2017-11-09 2017-11-09 Separation method of semiconductor test equipment and semiconductor elements Active JP6956598B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2017216297A JP6956598B2 (en) 2017-11-09 2017-11-09 Separation method of semiconductor test equipment and semiconductor elements

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2017216297A JP6956598B2 (en) 2017-11-09 2017-11-09 Separation method of semiconductor test equipment and semiconductor elements

Publications (2)

Publication Number Publication Date
JP2019086454A JP2019086454A (en) 2019-06-06
JP6956598B2 true JP6956598B2 (en) 2021-11-02

Family

ID=66762845

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2017216297A Active JP6956598B2 (en) 2017-11-09 2017-11-09 Separation method of semiconductor test equipment and semiconductor elements

Country Status (1)

Country Link
JP (1) JP6956598B2 (en)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7298553B2 (en) * 2020-06-23 2023-06-27 三菱電機株式会社 Semiconductor test equipment and semiconductor device manufacturing method
WO2023167013A1 (en) * 2022-03-04 2023-09-07 三菱電機株式会社 Semiconductor test apparatus

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002196040A (en) * 2000-12-25 2002-07-10 Ando Electric Co Ltd Automatic handler and control method for automatic handler
JP2011080796A (en) * 2009-10-05 2011-04-21 Mitsubishi Electric Corp Package of semiconductor element, and socket for testing the semiconductor element
JP6548871B2 (en) * 2014-05-03 2019-07-24 株式会社半導体エネルギー研究所 Laminated substrate peeling apparatus
JP6289287B2 (en) * 2014-06-27 2018-03-07 三菱電機株式会社 Semiconductor test equipment

Also Published As

Publication number Publication date
JP2019086454A (en) 2019-06-06

Similar Documents

Publication Publication Date Title
KR101735992B1 (en) Printed circuit board inspection device
US9485810B2 (en) Handler and inspection apparatus
KR102426032B1 (en) Flexible substrate inspecting apparatus
JP6956598B2 (en) Separation method of semiconductor test equipment and semiconductor elements
CN103163031A (en) Tester apparatus for obtaining forming limit diagram and forming limit diagram test method
JP2009128189A (en) Device and method for testing element
TWI491896B (en) Array test apparatus having a plurality of head units
KR20110117756A (en) Step pressing apparatus using numerical control of x-y multi direction
JP6692282B2 (en) Semiconductor chip test apparatus and semiconductor chip test method
CN106455473B (en) Tray conveying device and mounting device
CN212136868U (en) Flat cable processing equipment
KR102343647B1 (en) Flexible display divice bonding table structure
JP6144074B2 (en) Charge / discharge inspection system, detachable unit
KR101392163B1 (en) Flatness testing apparatus of squeeze blade for screen printer
TWI434046B (en) Probe device and manufacturing method thereof
KR20030088640A (en) Anisotropid Conductive Film Bonding Machine
TWI709521B (en) Attaching mechanism of conveying device and testing equipment for its application
JP2013015403A (en) Semiconductor inspection device
CN114536939B (en) Floating type spot-pressing module and working mode thereof
JP5108427B2 (en) Electronic component mounting apparatus and mounting method
KR101284513B1 (en) Module bonding apparatus for producing a plate type display
KR101284384B1 (en) Module bonding apparatus for producing a plate type display
JP2006349619A (en) Inspection device and carrier used for the inspection device
CN103415197A (en) PCB locating and stroke-limiting hot-pressing fixture
JP2008145254A (en) Load-measuring device and method for thermocompression bonding head

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20200908

TRDD Decision of grant or rejection written
A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20210831

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20210907

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20211005

R150 Certificate of patent or registration of utility model

Ref document number: 6956598

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150