JP6264948B2 - Information processing apparatus, hardware test control method, and program - Google Patents
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Description
本発明は、情報処理装置、ハードウェア試験制御方法およびプログラムに関する。 The present invention relates to an information processing apparatus, a hardware test control method, and a program.
サーバ装置に接続される入出力装置の検証を行う技術が、例えば、特許文献1に記載されている。
For example,
特許文献1に記載の検証装置は、情報処理装置に接続される入出力装置のハードウェア構成を認識し、予め外部記憶装置に格納された入出力装置の動作テスト基本手順から、上記認識したハードウェア構成に一致する手順を選択して、テスト実行手順とし、当該テスト実行手順に基づいて、テストを実行する。
The verification device described in
サーバ装置等のハードウェア試験では、例えば、メモリなどのオプションデバイスの構成を、人手によって物理的に組み替えることにより、複数のハードウェア構成パターンを作成して行われていた。 In a hardware test of a server device or the like, for example, a plurality of hardware configuration patterns are created by physically rearranging the configuration of an optional device such as a memory manually.
しかしながら、オプションデバイスの小型化が進むにつれ、サーバ装置に搭載可能なオプションデバイスの種類や数が増加している。これに伴い、ハードウェア試験に必要なハードウェアの構成パターンが飛躍的に増加している。これにより、サーバ装置開発におけるハードウェア試験に費やす期間の長期化、試験工数増加によるコストアップが課題になっていた。そのため、サーバ装置のハードウェア試験を自動的に行う方法が求められている。 However, as the size of option devices is reduced, the types and number of option devices that can be installed in the server apparatus are increasing. Along with this, the number of hardware configuration patterns required for hardware testing has increased dramatically. As a result, it has been a problem to increase the time spent on hardware testing in server device development and to increase costs by increasing the number of test steps. Therefore, a method for automatically performing a hardware test of a server device is required.
特許文献1の技術では、情報処理装置の外部に接続される入出力装置を対象としている。しかしながら、これらの入出力装置の構成を自動的に変更することについては、何ら開示されていない。また、情報処理装置内部のハードウェア構成の変更についても何ら開示されていない。
The technique disclosed in
本発明は上記課題に鑑みてなされたものであり、その目的は、情報処理装置のハードウェア試験を、より好適に、自動的に行うことが可能な情報処理装置を提供することにある。 The present invention has been made in view of the above problems, and an object of the present invention is to provide an information processing apparatus capable of more appropriately and automatically performing a hardware test of the information processing apparatus.
本発明の一態様に係る情報処理装置は、情報処理装置のハードウェア試験を制御する制御手段と、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記制御手段に実行させるプログラム、および、前記ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶する記憶手段と、を備え、前記プログラムは、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する隠蔽処理を前記制御手段に実行させるものであり、前記制御手段は、前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う。 An information processing apparatus according to an aspect of the present invention includes a control unit that controls a hardware test of an information processing apparatus, one or a plurality of hardware devices, and a program that causes the control unit to execute boot processing for booting an operating system. And storage means for storing a hardware configuration information table including hardware configuration information indicating a hardware configuration used for the hardware test, and the program is configured according to the hardware configuration information. Among the devices, the control unit executes a concealing process for concealing a hardware device that is not used for the hardware test from the operating system, and the control unit is a hardware that is not concealed from the operating system. Device Stomach, perform a hardware test.
本発明の一態様に係るハードウェア試験制御方法は、情報処理装置を制御する制御手段と、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記制御手段に実行させるプログラム、および、ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶する記憶手段と、を備えた情報処理装置のハードウェア試験制御方法であって、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽し、前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う。 A hardware test control method according to an aspect of the present invention includes a control unit that controls an information processing apparatus, one or more hardware devices, a program that causes the control unit to execute a boot process that boots an operating system, and A hardware test control method for an information processing apparatus, comprising: a storage unit that stores a hardware configuration information table including hardware configuration information indicating a hardware configuration used for a hardware test, the hardware configuration According to the information, a hardware device that is not used for the hardware test among the hardware devices is hidden from the operating system, and a hardware test is performed using a hardware device that is not hidden from the operating system.
本発明の一態様に係るプログラムは、プロセッサと、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記プロセッサに実行させるプログラム、および、ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶するメモリと、を備えた情報処理装置に、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する処理を、実行させる。 The program which concerns on 1 aspect of this invention shows the hardware constitutions used for a processor, the 1 or several hardware device, the program which makes the said processor perform the boot process which boots an operating system, and a hardware test A hardware device that is not used for the hardware test among the hardware devices according to the hardware configuration information, in an information processing apparatus that includes a memory that stores a hardware configuration information table including hardware configuration information. Then, a process of hiding from the operating system is executed.
本発明によれば、情報処理装置のハードウェア試験を、より好適に、自動的に行うことができる。 According to the present invention, the hardware test of the information processing apparatus can be automatically performed more suitably.
<第1の実施の形態>
本発明の第1の実施の形態について、図面を参照して詳細に説明する。
<First Embodiment>
A first embodiment of the present invention will be described in detail with reference to the drawings.
図1は、本実施の形態に係る情報処理装置の構成の一例を示す図である。本実施の形態に係る情報処理装置は、情報処理装置のハードウェア試験を行うことができる装置である。図1に示す通り、本実施の形態に係る情報処理装置100は、不揮発性メモリ(記憶手段)40と、制御部110と、1または複数のハードウェアデバイス120と、を備えている。なお、本実施の形態においては、ハードウェアをHWとも呼ぶ。
FIG. 1 is a diagram illustrating an example of the configuration of the information processing apparatus according to the present embodiment. The information processing apparatus according to the present embodiment is an apparatus that can perform a hardware test of the information processing apparatus. As illustrated in FIG. 1, the
ハードウェアデバイス120は、制御部110に接続されたオプションデバイスである。ハードウェアデバイス120は、例えば、プロセッサ、メモリ、PCI(Peripheral Components Interconnect)カード、HDD(Hard Disk Drive)等で実現される。
The
不揮発性メモリ40は、制御部110に接続された記憶装置である。不揮発性メモリ40は、図1に示す通り、BIOS(Basic Input/Output System)プログラム41およびHW構成情報テーブル42を格納している。
The
BIOSプログラム41は、情報処理装置100を起動するための起動処理等、一般的な装置の初期化/制御を行うためのプログラムである。つまり、BIOSプログラム41は、情報処理装置100に電源が投入されたとき、または、情報処理装置100が再起動したとき、OS(Operating System)をブートするブート処理を制御部110に実行させるプログラムである。また、BIOSプログラム41は、後述するハードウェア構成情報に従って、1または複数のハードウェアデバイス120のうち、ハードウェア試験に使用しないハードウェアデバイスを、OSから隠蔽する隠蔽処理を制御部110に実行させるプログラムである。なお、BIOSプログラム41を、単に、BIOSとも呼ぶ。
The
HW構成情報テーブル42は、ハードウェア試験に使用するハードウェア構成を示す情報(ハードウェア構成情報、ハードウェア構成パターンとも呼ぶ)を含むものである。ハードウェア試験に使用するハードウェア構成を示す情報とは、情報処理装置100に搭載されている1または複数のハードウェアデバイスのうち、ハードウェア試験に使用する1または複数のハードウェアデバイスを示す情報である。例えば、情報処理装置1に搭載されたハードウェアデバイスが、メモリ、プロセッサ、HDDおよびPCIカードであり、ハードウェア試験に使用するハードウェアデバイスが、プロセッサおよびHDDである場合について説明する。この場合、ハードウェア試験に使用するハードウェア構成は、プロセッサおよびHDDからなる構成である、と言える。よって、ハードウェア構成情報には、情報処理装置1に搭載されたハードウェアデバイスのうち、プロセッサおよびHDDがハードウェア試験で使用されるハードウェアデバイスであり、メモリおよびPCIカードがハードウェア試験で使用されないハードウェアデバイスであることを示す情報が含まれている。
The HW configuration information table 42 includes information (also referred to as hardware configuration information or hardware configuration pattern) indicating the hardware configuration used for the hardware test. The information indicating the hardware configuration used for the hardware test is information indicating one or more hardware devices used for the hardware test among the one or more hardware devices mounted on the
HW構成情報テーブル42に含まれるハードウェア構成情報は、ハードウェア試験を行う作業者によって、予め登録されたものである。ハードウェア試験を行う作業者は、複数のハードウェア構成情報を、試験に必要なハードウェア構成を検討して、予め登録する。 The hardware configuration information included in the HW configuration information table 42 is registered in advance by an operator who performs a hardware test. An operator who performs a hardware test registers a plurality of pieces of hardware configuration information in advance by considering a hardware configuration necessary for the test.
制御部110は、情報処理装置100全体を制御する。制御部110は、例えば、CPU(Central Processing Unit)、ROM(Read Only Memory)、RAM(Random Access Memory)等を備え、ROM等に格納されている各種プログラムを、RAMを用いてCPUで実行することによって、情報処理装置100を制御する。制御部110は、例えば、プロセッサ、メインメモリ、IO(Input Output)コントローラ等によって実現される。
The
制御部110は、不揮発性メモリ40のBIOSプログラム41を制御部110上で動作させる。BIOSプログラム41は、上述したとおり、ハードウェア構成情報に従って、ハードウェアデバイスのうち、ハードウェア試験に使用しないハードウェアデバイスをOSから隠蔽する隠蔽処理を、制御部110に実行させるプログラムである。したがって、情報処理装置100を起動した際、BIOSプログラム41によって、ハードウェア試験に使用しないハードウェアデバイスがOSから隠蔽される。
The
ここで、ハードウェアデバイスをOSから隠蔽するとは、ハードウェアデバイスに対し無効の設定を行うことである。ハードウェアデバイスを無効に設定することで、情報処理装置100のOSが起動した際、情報処理装置100のOSは、無効にしたハードウェアデバイスが見えない状態となる。そのため、以下では、ハードウェアデバイスに対し、有効/無効の設定を行う処理のことを、ハードウェアデバイスの隠蔽処理とも呼ぶ。
Here, concealing a hardware device from the OS means performing an invalid setting for the hardware device. By setting the hardware device to invalid, when the OS of the
情報処理装置100を起動すると、制御部110がBIOSプログラム41を動作させる。これにより、ハードウェア構成情報に基づいて、ハードウェア試験に使用するハードウェアデバイスが、OSから有効なデバイスであると認識されるよう、ハードウェア試験に使用しないハードウェアデバイスが無効に設定される。情報処理装置100のOSは、隠蔽されていないハードウェアデバイス、つまり、無効の設定が行われていないハードウェアデバイスを、有効なデバイスと認識する。そして、制御部110は、OSによって認識されたハードウェアデバイスを用いて、ハードウェア試験を行う。
When the
(効果)
本実施の形態における情報処理装置100によれば、情報処理装置100のハードウェア試験を、より好適に、自動的に行うことができる。
(effect)
According to the
なぜならば、BIOSプログラム41が、HW構成情報テーブル42に記憶されたハードウェア構成情報に従って、1または複数のハードウェアデバイスのうち、ハードウェア試験に使用しないハードウェアデバイスを、OSから隠蔽する隠蔽処理を制御部110に実行させるからである。そして、制御部110が、OSから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行うからである。
This is because the
これにより、ハードウェアデバイスを物理的に情報処理装置100に搭載し、上記ハードウェアデバイスをハードウェア試験に使用するか否かを、HW構成情報テーブル42に登録するだけで、情報処理装置100は、ハードウェア試験に使用しないハードウェアデバイスを隠蔽して、自動的にハードウェア試験を行うことができる。したがって、情報処理装置に搭載されたオプションデバイスの構成を、人手によって物理的に組み替える、といった手間を省くことができる。
As a result, the
<第2の実施の形態>
次に、上述した第1の実施の形態を基本とする第2の実施の形態について説明する。なお、説明の便宜上、前述した第1の実施の形態で説明した図面に含まれる部材と同じ機能を有する部材については、同じ符号を付し、その説明を省略する。
<Second Embodiment>
Next, a second embodiment based on the above-described first embodiment will be described. For convenience of explanation, members having the same functions as those included in the drawings described in the first embodiment described above are given the same reference numerals, and descriptions thereof are omitted.
図2は、本実施の形態に係る情報処理装置1のハードウェア構成の一例、および、メインメモリ、不揮発性メモリに夫々格納されているデータの一例を示す図である。図2に示す通り、情報処理装置1は、プロセッサ10、プロセッサ11、メインメモリ20、メモリ21〜23、IOコントローラ30、不揮発性メモリ40、PCIコントローラ50、PCIカード51〜52、SAS(Serial Attached SCSI(Small Computer System Interface))コントローラ60、HDD61〜62、電源回路70およびスイッチ(SW)71〜72を備えている。これらの各部材は、情報処理装置1内のマザーボートに搭載されている。
FIG. 2 is a diagram illustrating an example of a hardware configuration of the
第1の実施の形態で説明した制御部110は、プロセッサ10、メインメモリ20およびIOコントローラ30に相当する。つまり、第1の実施の形態における制御部110は、一般的な回路素子を用いて実現できる。また、ハードウェアデバイス120は、メモリ21〜23、PCIカード51〜52、HDD61〜62に相当する。
The
プロセッサ10は、情報処理装置1全体を制御する。情報処理装置1に電源が入力されたとき、または、情報処理装置1が再起動したとき、プロセッサ10は、不揮発性メモリ40のBIOSプログラム41をプロセッサ10上で動作させる。
The
メインメモリ20は、情報処理装置1の主記憶装置である。メインメモリ20は、図2に示す通り、HW構成テーブル24、システム動作確認試験プログラム25およびHW試験プログラム26を格納している。
The
HW構成テーブル24は、情報処理装置1のOSが、情報処理装置1に搭載されているプロセッサおよびメモリの構成について確認するときに参照するテーブルである。HW構成テーブル24は、例えば、ACPI(Advanced Configuration and Power Interface)テーブルが一例として挙げられる。
The HW configuration table 24 is a table that is referred to when the OS of the
システム動作確認試験プログラム25は、情報処理装置1のハードウェア試験を行う際に用いられるプログラムである。具体的には、システム動作確認試験プログラム25は、情報処理装置1において、予め組み込まれた装置、OS、ソフトウェア等の試験を行い、それによってOSが検出した、情報処理装置1内のハードウェアを稼働させる各種試験を行うためのプログラムである。
The system operation
HW試験プログラム26は、ハードウェア構成を変更しながら、システム動作確認試験プログラム25を起動するプログラムである。ハードウェア構成を変更するために、HW試験プログラム26は、後述するHW構成ポインタ43の値を変更する処理をプロセッサ10に実行させる。また、HW試験プログラム26は、HW構成ポインタ43により示される構成番号が後述する最終HW構成番号44と一致するか否かを確認する処理をプロセッサ10に実行させる。
The
プロセッサ11、および、メモリ21〜23は、夫々、オプションデバイスの一例である。各メモリとプロセッサとは、メモリバスを介して接続している。なお、以下では、オプションデバイスのことを、ハードウェア構成の要素(ハードウェア構成要素)またはハードウェアデバイスとも呼ぶ。
Each of the
なお、本実施の形態では、メモリの数を3つとして説明を行うが、本発明はこれに限定されるものではない。本実施の形態において、メモリ21〜23を、夫々、メモリ(1)〜メモリ(3)とも呼ぶ。また、本実施の形態では、オプションデバイスとしてのプロセッサは1つであることを例に説明を行うが、本発明はこれに限定されるものではない。本実施の形態において、プロセッサ10をプロセッサ(0)とも呼び、プロセッサ11をプロセッサ(1)とも呼ぶ。
In the present embodiment, the number of memories is three, but the present invention is not limited to this. In the present embodiment, the
IOコントローラ30は、プロセッサ10と連携し、プロセッサ10に接続されているIOデバイスとのデータの送受信を制御するためのコントローラである。ここで、IOデバイスとは、不揮発性メモリ40、PCIコントローラ50、SASコントローラ60等のことを指す。具体的には、IOコントローラ30は、不揮発性メモリ40にアクセスして、各種データの書込みや読出しを行う。IOコントローラ30は、図示しないCPU、ROM、RAM等を備え、ROM等に格納されている各種プログラムを、RAMを用いてCPUで実行することによって、各種インタフェースの入出力を制御する。IOコントローラ30の具体的な動作については、後述する。
The
また、IOコントローラ30は、IO制御レジスタ(制御レジスタ)34、35を含んでいる。IO制御レジスタ34、35は、BIOSプログラム41によって設定された値を、夫々、スイッチ71、72に対し、出力する。なお、本実施の形態では、IO制御レジスタの数を、HDDの数と同じ、2つとして説明を行うが、本発明はこれに限定されるものではない。また、IO制御レジスタ34、35は、IOコントローラ30に含まれる構成であることを例に説明を行うが、本発明はこれに限定されるものではない。IO制御レジスタ34、35は、IOコントローラ30とは別個の構成であってもよい。なお、本実施の形態において、IO制御レジスタ34、35を、夫々、IO制御レジスタ(0)、IO制御レジスタ(1)とも呼ぶ。
The
不揮発性メモリ40は、IOコントローラ30に接続された記憶装置である。不揮発性メモリ40は、図2に示す通り、BIOSプログラム41、HW構成情報テーブル42、HW構成ポインタ43および最終HW構成番号44を格納している。
The
BIOSプログラム41は、第1の実施の形態におけるBIOSプログラム41と同様に、情報処理装置1を起動するための起動処理等、一般的な装置の初期化/制御を行うためのプログラムである。情報処理装置1に電源が投入されたとき、または、情報処理装置1が再起動したとき、プロセッサ10は、最初にBIOSプログラム41を実行する。また、BIOSプログラム41は、ハードウェア構成要素を隠蔽するための処理を行うためのプログラムである。
The
HW構成情報テーブル42は、第1の実施の形態におけるHW構成情報テーブル42と同様に、ハードウェア試験に使用するハードウェア構成を示す情報(ハードウェア構成情報)を含むものである。 Similar to the HW configuration information table 42 in the first embodiment, the HW configuration information table 42 includes information (hardware configuration information) indicating the hardware configuration used for the hardware test.
ここで、図3を参照して、HW構成情報テーブル42について、さらに説明する。図3は、HW構成情報テーブル42の一例を示す図である。HW構成情報テーブル42には、構成情報を一意に表すための構成番号と、当該構成番号に関連付けられた、各オプションデバイスが有効か無効かを示す値と、が含まれている。図3におけるテーブルの行(レコード)は、ハードウェア構成の情報を示すハードウェア構成情報である。 Here, the HW configuration information table 42 will be further described with reference to FIG. FIG. 3 is a diagram illustrating an example of the HW configuration information table 42. The HW configuration information table 42 includes a configuration number for uniquely representing configuration information and a value associated with the configuration number and indicating whether each option device is valid or invalid. The row (record) of the table in FIG. 3 is hardware configuration information indicating hardware configuration information.
具体的には、図3に示す通り、HW構成情報テーブル42には、構成番号毎に、プロセッサ11(プロセッサ(1))の有効/無効を示す値、メモリ21〜23(メモリ(1)〜メモリ(3))の有効/無効を示す値、PCIカード51〜52(PCIカード(0)〜PCIカード(1))の有効/無効を示す値、HDD61〜62(HDD(0)〜HDD(1))の有効/無効を示す値、が含まれている。図3に示す通り、HW構成情報テーブル42には、情報処理装置1を起動するに当たり必要な部材(本実施の形態においては、プロセッサ10およびメインメモリ20)のハードウェア構成情報は含まれない。また、HW構成情報テーブル42に登録可能なハードウェア構成情報の数は、特に限定されない。図3においては、ハードウェア構成情報の数は、N(Nは0を除く自然数)とする。
Specifically, as shown in FIG. 3, the HW configuration information table 42 includes, for each configuration number, a value indicating validity / invalidity of the processor 11 (processor (1)),
図3において、構成番号に関連付けられた値は、「1」を有効であるとし、「0」を無効であるとしている。例えば、構成番号が「0」のハードウェア構成情報には、メモリ(1)、メモリ(2)およびHDD(0)が有効であり、プロセッサ(1)、メモリ(3)、PCIカード(0)、PCIカード(1)およびHDD(1)が無効であることを示す情報が含まれている。そして、情報処理装置1は、このハードウェア構成情報に従い、各ハードウェア構成要素を有効または無効に設定する。例えば、構成番号が「0」のハードウェア構成に設定する場合、情報処理装置1は、メモリ(1)、メモリ(2)およびHDD(0)を有効にし、プロセッサ(1)、メモリ(3)、PCIカード(0)、PCIカード(1)およびHDD(1)を無効にする(隠蔽する)。
In FIG. 3, the value associated with the configuration number is “1” is valid and “0” is invalid. For example, memory (1), memory (2), and HDD (0) are valid for the hardware configuration information whose configuration number is “0”, and the processor (1), memory (3), and PCI card (0) , Information indicating that the PCI card (1) and the HDD (1) are invalid is included. Then, the
HW構成ポインタ43は、ハードウェア試験を行う際に、使用する(有効な)ハードウェア構成要素を示すハードウェア構成情報の、HW構成情報テーブル42内の位置(アドレス)を示すためのポインタである。具体的には、HW構成ポインタ43には、HW構成情報テーブル42内の位置を示すための情報として、HW構成情報テーブル42の構成番号が含まれている。なお、本実施の形態では、HW構成ポインタ43は、HW構成情報テーブル42の構成番号をポインタとして使用することを例に説明を行うが、本発明はこれに限定されるものではない。HW構成ポインタ43の値は、HW構成情報テーブル42内の位置を示す情報であればよい。
The
最終HW構成番号44は、HW構成情報テーブル42のうち、どのハードウェア構成までが有効かを示す番号である。本実施の形態では、HW構成情報テーブル42内の最後の構成番号を、最終HW構成番号44として、不揮発性メモリ40に記憶されていることを例に説明を行うが、本発明はこれに限定されるものではない。HW構成情報テーブル42内に利用できないハードウェア構成が含まれている場合、不揮発性メモリ40は、有効なハードウェア構成のうちの最後の番号を最終HW構成番号44として、記憶してもよい。
The final
BIOSプログラム41は、HW構成ポインタ43により示される構成番号を用いて、HW構成情報テーブル42に含まれる複数のハードウェア構成情報のうち、上記構成番号で示される、1つのハードウェア構成情報を選択する選択処理をプロセッサ10に実行させる。
The
そして、BIOSプログラム41は、選択されたハードウェア構成情報に従って、当該ハードウェア構成情報に含まれる各ハードウェア構成要素を隠蔽するための処理を、プロセッサ10に実行させる。
Then, the
PCIコントローラ50は、PCIカード51、52の入出力を司るコントローラである。
The
PCIカード51、52は、夫々、図示しないPCIスロットに装着されるオプションデバイスの一例である。PCIカード51、52は、PCIバスを介して、IOコントローラ30と接続している。
The
なお、本実施の形態では、PCIカードの数を2つとして説明を行うが、本発明はこれに限定されるものではない。また、本実施の形態において、PCIカード51、52を、夫々、PCIカード(0)およびPCIカード(1)とも呼ぶ。
In this embodiment, the number of PCI cards is two, but the present invention is not limited to this. In the present embodiment, the
また、本実施の形態では、拡張カードの一例としてPCIカードを例に説明を行ったが、本発明はこれに限定されるものではない。 In the present embodiment, a PCI card has been described as an example of an expansion card, but the present invention is not limited to this.
SASコントローラ60は、HDD61、62の入出力を司るコントローラである。SASコントローラ60は、IOコントローラ30と、HDD61、62との間でSAS規格に従って、データを送受信する。
The
HDD61〜62は、夫々、オプションデバイスの一例である。 The HDDs 61 to 62 are examples of optional devices, respectively.
電源回路70は、情報処理装置1内の各部に電力を供給するための回路である。
The
スイッチ71〜72は、夫々、HDD61〜62に接続している。スイッチ71、72は、夫々、情報処理装置1の電源回路に接続される電源ライン上に配置されている。スイッチ71、72は、例えば、FET(Field Effect Transistor)等によって実現される。なお、図2では、スイッチをSWと表記している。
The
なお、本実施の形態では、HDD、スイッチの数を2つとして説明を行うが、本発明はこれに限定されるものではない。また、HDD61、62を、夫々、HDD(0)およびHDD(1)とも呼ぶ。また、スイッチ71、72を、夫々、SW(0)およびSW(1)とも呼ぶ。
In this embodiment, the number of HDDs and switches is two. However, the present invention is not limited to this. The HDDs 61 and 62 are also referred to as HDD (0) and HDD (1), respectively. The
(情報処理装置1の機能)
本実施の形態に係る情報処理装置1は、上述したとおり、不揮発性メモリ40に、HW構成情報テーブル42を格納している。そして、情報処理装置1は、情報処理装置1の起動時に、HW構成情報テーブル42から1つの構成を選択して、選択したハードウェア構成となるように、ハードウェア構成要素を個別に隠蔽する。
(Function of information processing apparatus 1)
The
ハードウェア構成要素の隠蔽方法は、そのデバイスの種類によって異なる。したがって、本実施の形態では、(1)プロセッサ11およびメモリ21〜23、(2)PCIカード51、52、(3)HDD61、62の夫々に対する、隠蔽方法について夫々説明する。
The hardware component hiding method varies depending on the type of the device. Therefore, in this embodiment, a concealment method for (1) the
(1)プロセッサ11およびメモリ21〜23の隠蔽方法
まず、プロセッサ11およびメモリ21〜23の隠蔽方法について説明する。プロセッサ11およびメモリ21〜23の有効/無効の設定は、プロセッサ10がBIOSプログラム41を実行することにより行われる。具体的には、プロセッサ10が、BIOSプログラム41を実行することによって、HW構成情報テーブル42が参照され、HW構成テーブル24にプロセッサ11およびメモリ21〜23の夫々に対する有効/無効設定が設定される。
(1) Method for concealing
図3に示すHW構成情報テーブル42を用いて、さらに説明する。プロセッサ10が、BIOSプログラム41を実行することにより、HW構成情報テーブル42が参照される。構成番号が「0」のハードウェア構成情報の場合、当該ハードウェア構成情報には、プロセッサ(1)とメモリ(3)とが無効であり、メモリ(1)とメモリ(2)とが有効であることを示す情報が含まれている。そのため、BIOSプログラム41によって、プロセッサ(1)とメモリ(3)とが無効であり、メモリ(1)とメモリ(2)とが有効であることを示す情報が、HW構成テーブル24に設定される。HW構成テーブル24への設定方法は、HW構成情報テーブル42と同様に、「0」および「1」を用いるものであってもよいし、その他の方法であってもよい。
This will be further described using the HW configuration information table 42 shown in FIG. When the
このように、BIOSプログラム41は、ハードウェア構成情報にハードウェア試験に使用しないと設定されたハードウェア構成要素(例えば、プロセッサ(1))に対し、ハードウェア試験に当該ハードウェア構成要素を使用しないことを示す情報(図3の場合「0」)を、HW構成テーブル24に設定する。これにより、BIOSプログラム41は、当該ハードウェア構成要素をOSから隠蔽する。
As described above, the
なお、BIOSプログラム41は、HW構成情報テーブル42において有効と設定されているハードウェア構成要素が物理的に情報処理装置1に搭載されているかを確認する処理を有する構成であってもよい。BIOSプログラム41は、上記ハードウェア構成要素が物理的に情報処理装置1に搭載されていない場合、HW構成テーブル24の当該ハードウェア構成情報に対応する値として、「0」を設定する。
The
その後、BIOSプログラム41の処理により、各ハードウェア構成要素の有効/無効が設定されたHW構成テーブル24が参照される。そして、BIOSプログラム41の所定のコードにより、HW構成テーブル24の設定情報に従って、プロセッサ(1)およびメモリ(1)〜メモリ(3)のうち、有効と設定されたハードウェア構成要素が、OSから、有効なデバイスであると認識される。
Thereafter, the processing of the
このように、HW構成テーブル24に対し、プロセッサ11、メモリ21〜23の有効/無効設定を行うことにより、情報処理装置1は、HW構成情報テーブル42に無効と設定されたプロセッサ11、メモリ21〜23を夫々隠蔽することができる。
(2)PCIカード51、52の隠蔽方法
次に、PCIカード51、52の隠蔽方法について、図4〜図7を参照して説明する。図4は、本実施の形態に係る情報処理装置1のIOコントローラ30の機能構成の一例を示す機能ブロック図である。図4に示す通り、IOコントローラ30は、トランザクション検出部31、応答トランザクション出力部32、および、トランザクション制御部33を備えている。
As described above, the
(2) Concealing Method for
情報処理装置1のOSがPCIカード(PCIデバイス)の有効/無効を確認する場合、プロセッサ10上で動作するOSは、直接、PCIデバイスにアクセスする。そして、OSは、PCIバスを辿って検出された(応答が返された)PCIデバイスを有効なものと認識する。したがって、情報処理装置1は、HW構成テーブル24を用いることなく有効/無効の確認を行うため、プロセッサ11およびメモリ21〜23とは異なる方法で、PCIカードの隠蔽を行う。以下では、その方法について、説明する。
When the OS of the
本実施の形態に係る情報処理装置1は、PCIカード51、52を隠蔽するための手段として、プロセッサ10と各種IOデバイスの間に位置するIOコントローラ30内に、特定のPCIカードを隠蔽する手段を備える。なお、以下の説明において、「IO側」とは、IOコントローラ30に含まれるインタフェースのうち、不揮発性メモリ40、PCIコントローラ50、SASコントローラ60等が接続されたインタフェースの方のことを指す。
The
図4に示す通り、IOコントローラ30は、トランザクション検出部31、応答トランザクション出力部32、および、トランザクション制御部33を備えている。トランザクション検出部31は、PCIカードを無効とするトランザクションである、特定のIOトランザクション(無効化トランザクションとも呼ぶ)を検出する。応答トランザクション出力部32は、PCIスロットにPCIカードが接続されていない場合に返される応答トランザクションを出力する。トランザクション制御部33は、特定のIOトランザクションを検出した場合に、応答トランザクション出力部32による応答トランザクションを返す。IOコントローラ30の各部の機能については、図面を変えて詳細に説明する。
As illustrated in FIG. 4, the
(トランザクション検出部31)
まず、図5を参照して、トランザクション検出部31について説明する。図5は、本実施の形態におけるトランザクション検出部31の構成の一例を示すブロック図である。
(Transaction detection unit 31)
First, the
図5に示す通り、トランザクション検出部31は、比較器312、317と、論理積回路314、319と、論理和回路315と、PCIカード(0)無効化レジスタ313と、PCIカード(1)無効化レジスタ318と、パターン記憶部310とを備えている。
As shown in FIG. 5, the
なお、図5では、トランザクション検出部31に、パターン記憶部310、PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318が含まれる構成について説明を行うが、本発明はこれに限定されるものではない。パターン記憶部310、PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318は、トランザクション検出部31とは別個の構成であってもよい。
In FIG. 5, a configuration in which the
パターン記憶部310は、PCIカード(0)トランザクションパターン311およびPCIカード(1)トランザクションパターン316を格納する記憶手段である。パターン記憶部310は、図示しない記憶装置(例えば、ROM)で実現される。図5では、PCIカード(0)トランザクションパターン311およびPCIカード(1)トランザクションパターン316を同じパターン記憶部310に格納することを例に説明を行うが、本発明はこれに限定されるものではない。PCIカード(0)トランザクションパターン311とPCIカード(1)トランザクションパターン316とは、異なる記憶装置に記憶されるものであってもよい。
The
また、パターン記憶部310に記憶されているトランザクションパターンの数は、PCIカードの数と同じであることを例に説明を行うが、本発明はこれに限定されるものではない。
The number of transaction patterns stored in the
PCIカード(0)トランザクションパターン311は、PCIカード51に対するトランザクションのパターンである。また、PCIカード(1)トランザクションパターン316は、PCIカード52に対するトランザクションのパターンである。
The PCI card (0)
PCIカード(0)トランザクションパターン311およびPCIカード(1)トランザクションパターン316は、IOコントローラ30に接続するPCIカードに応じて、利用者によって、ハードウェア試験を行う際やハードウェアを搭載した際等に、夫々、パターン記憶部310に登録されるものである。
The PCI card (0)
比較器312は、プロセッサ10から入力されたトランザクションと、PCIカード(0)トランザクションパターン311とを比較する。比較器312は、比較結果を、論理積回路314に出力する。なお、本実施の形態において、比較器312は、比較結果として、プロセッサ10から入力されたトランザクションと、PCIカード(0)トランザクションパターン311とが一致する場合、「1」を出力し、一致しない場合、「0」を出力する。
The
同様に、比較器317は、プロセッサ10から入力されたトランザクションと、PCIカード(1)トランザクションパターン316とを比較し、比較結果を論理積回路319に出力する。
Similarly, the
PCIカード(0)無効化レジスタ313は、PCIカード51を無効化するための設定値が格納されたレジスタである。PCIカード(1)無効化レジスタ318は、PCIカード52を無効化するための設定値が格納されたレジスタである。PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318には、各PCIカードを無効化する場合に「1」が設定され、無効化しない場合(有効化する場合)に「0」が設定される。
The PCI card (0)
なお、上記無効化レジスタ(313、318)は、PCIカードと一対一になるように、設けられていることを例に説明を行うが、無効化レジスタの数はこれに限定されるものではない。 Note that the invalidation registers (313, 318) are provided as an example so as to be one-to-one with the PCI card, but the number of invalidation registers is not limited to this. .
PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318への設定値の設定は、プロセッサ10がBIOSプログラム41を実行することにより行われる。具体的には、プロセッサ10が、BIOSプログラム41を実行することによって、HW構成情報テーブル42を参照し、HW構成情報テーブル42のPCIカード51に対する値を取得する。そして、BIOSプログラム41によって、PCIカード51を無効化するための設定値として、取得したHW構成情報テーブル42のPCIカード51に対する値を反転した値が、PCIカード(0)無効化レジスタ313に設定される。同様に、PCIカード(1)無効化レジスタ318に対する設定値の設定も、プロセッサ10がBIOSプログラム41を実行することにより行われる。
Setting values in the PCI card (0)
図3に示すHW構成情報テーブル42において、構成番号が「0」のハードウェア構成情報の場合、PCIカード(0)およびPCIカード(1)は、無効であるため、PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318には、無効化するための設定値として「1」が設定される。
In the HW configuration information table 42 shown in FIG. 3, in the case of the hardware configuration information with the configuration number “0”, the PCI card (0) and the PCI card (1) are invalid, so the PCI card (0) is invalidated. In the
なお、BIOSプログラム41は、HW構成情報テーブル42において有効と設定されているPCIカードが物理的に情報処理装置1に搭載されているかを確認する処理を有する構成であってもよい。BIOSプログラム41は、PCIカードが物理的に情報処理装置1に搭載されていない場合、対応する上記無効化レジスタの設定値として「1」を設定する。
The
論理積回路314は、比較器312から入力された値(比較結果)と、PCIカード(0)無効化レジスタ313の設定値とを用いて論理積演算を行い、演算結果を出力する論理回路である。
The AND
論理積回路314は論理積演算を行うため、PCIカード(0)無効化レジスタ313の設定値が「0」の場合、つまり、PCIカード51を無効化しない(有効化する)場合、「0」を出力する。論理積回路314は、PCIカード(0)無効化レジスタ313の設定値が「1」の場合、つまり、PCIカード51を無効化する場合、比較器312の比較結果を出力する。
Since the AND
同様に、論理積回路319は、比較器317から入力された比較結果と、PCIカード(1)無効化レジスタ318の設定値とを用いて論理積演算を行い、演算結果を出力する論理回路である。論理積回路319は論理積演算を行うため、PCIカード(1)無効化レジスタ318の設定値が「0」の場合、つまり、PCIカード52を無効化しない(有効化する)場合、「0」を出力する。論理積回路319は、PCIカード(1)無効化レジスタ318の設定値が「1」の場合、つまり、PCIカード51を無効化する場合、比較器317の比較結果を出力する。
Similarly, the
言い換えれば、論理積回路314は、PCIカード(0)無効化レジスタ313の設定値に従い、比較器312の結果を有効にする(「1」を出力する)か、無効にする(「0」を出力する)かを制御する。同様に、論理積回路319は、PCIカード(1)無効化レジスタ318の設定値に従い、比較器317の結果を有効にする(「1」を出力する)か、無効にする(「0」を出力する)かを制御する。
In other words, the AND
この論理積演算結果が「1」とは、対応するPCIカードを無効化するトランザクション(特定のIOトランザクション)が検出されたことを示している。 The logical product operation result “1” indicates that a transaction (specific IO transaction) that invalidates the corresponding PCI card is detected.
論理積回路314および論理積回路319は、上記演算結果を、制御信号として、応答トランザクション出力部32へ送信する。また、論理積回路314および論理積回路319は、上記演算結果を論理和回路315へ出力する。
The AND
論理和回路315は、論理積回路314および論理積回路319から入力された演算結果を用いて論理和演算を行い、演算結果を出力する論理回路である。論理和回路315は、上記演算結果を制御信号としてトランザクション制御部33へ送信する。
The OR
具体的には、論理和回路315は、論理和演算を行うため、以下の(a)および(b)の少なくとも何れかを満たす場合、論理和演算結果として、「1」を出力する。
(a)PCIカード51の無効化の設定がされており、且つ、プロセッサ10から入力されたトランザクションと、PCIカード(0)トランザクションパターン311とが一致する場合、
(b)PCIカード52の無効化の設定がされており、且つ、プロセッサ10から入力されたトランザクションと、PCIカード(1)トランザクションパターン316とが一致する場合。
Specifically, the
(A) When invalidation of the
(B) The
この論理和演算結果が「1」とは、何れかのPCIカードを無効化するトランザクション(特定のIOトランザクション)が検出されたことを示している。一方、論理和演算結果が「0」とは、特定のIOトランザクションが検出されなかったことを示している。 The logical sum operation result “1” indicates that a transaction (specific IO transaction) that invalidates any PCI card is detected. On the other hand, the logical sum operation result “0” indicates that a specific IO transaction has not been detected.
(応答トランザクション出力部32)
次に、図6を参照して、応答トランザクション出力部32について説明する。図6は、本実施の形態における応答トランザクション出力部32の構成の一例を示すブロック図である。図6に示す通り、応答トランザクション出力部32は、応答トランザクション記憶部320とセレクタ323とを備えている。
(Response transaction output unit 32)
Next, the response
なお、図6では、応答トランザクション出力部32に、応答トランザクション記憶部320が含まれる構成について説明を行うが、本発明はこれに限定されるものではない。応答トランザクション記憶部320は、応答トランザクション出力部32とは別個の構成であってもよい。
Although FIG. 6 illustrates a configuration in which the response
応答トランザクション記憶部320は、PCIカード(0)応答トランザクション321およびPCIカード(1)応答トランザクション322を格納する記憶手段である。応答トランザクション記憶部320は、図示しない記憶装置(例えば、ROM)で実現される。図6では、PCIカード(0)応答トランザクション321およびPCIカード(1)応答トランザクション322を同じ応答トランザクション記憶部320に格納することを例に説明を行うが、本発明はこれに限定されるものではない。PCIカード(0)応答トランザクション321およびPCIカード(1)応答トランザクション322は、異なる記憶装置に記憶されるものであってもよい。
The response
PCIカード(0)応答トランザクション321は、PCIカード(0)が対応するPCIスロットに搭載されていないことを示す応答トランザクションである。同様に、PCIカード(1)応答トランザクション322は、PCIカード(1)が対応するPCIスロットに搭載されていないことを示す応答トランザクションである。上記応答トランザクションは、応答トランザクション記憶部320に予め登録されているものであるとするが、本発明はこれに限定されるものではない。
The PCI card (0)
なお、応答トランザクション記憶部320に記憶されているトランザクションの数は、PCIカードの数と同じであることを例に説明を行うが、本発明はこれに限定されるものではない。
The number of transactions stored in the response
セレクタ323は、PCIカード(0)応答トランザクション、または、PCIカード(1)応答トランザクションの何れかを、トランザクション検出部31から出力された制御信号に従って選択する。セレクタ323は、選択した応答トランザクションを、トランザクション制御部33に出力する。
The
ここで、トランザクション検出部31から送信された制御信号は、PCIカード51および52の夫々に対するトランザクションの有無(トランザクションがある場合「1」、無い場合「0」)を示している。セレクタ323は、論理積回路314から無効化するトランザクションがあるという制御信号(本例の場合、「1」)が入力された場合、PCIカード(0)応答トランザクション321を選択し、トランザクション制御部33に出力する。また、セレクタ323は、論理積回路319から、論理積回路314から無効化するトランザクションがあるという制御信号(本例の場合、「1」)が入力された場合、PCIカード(1)応答トランザクション322を選択し、トランザクション制御部33に出力する。
Here, the control signal transmitted from the
応答トランザクション記憶部320に格納されている応答トランザクションは、各PCIカードが、対応するPCIスロットに搭載されていないときに、PCIコントローラ50から返される応答トランザクションであることを説明した。なお、各PCIカードが、対応するPCIスロットに搭載されており、且つ、HW構成情報テーブル42に当該PCIカードに対する設定が有効の設定しかない場合は、応答トランザクション記憶部320には、各PCIカードに対応する、PCIカードが搭載されていることを示す応答トランザクションが格納されていてもよいし、応答トランザクションが格納されていなくてもよい。
It has been described that the response transaction stored in the response
以上のように、応答トランザクション出力部32は、無効とするPCIカードに対応するPCIスロットに、PCIカードが接続されていない場合に返される応答トランザクション(IOトランザクション)を出力する。
As described above, the response
(トランザクション制御部33)
次に、図7を参照して、トランザクション制御部33について説明する。図7は、本実施の形態におけるトランザクション制御部33の構成の一例を示すブロック図である。図7に示す通り、トランザクション制御部33は、入力バッファ331、論理積回路332、出力バッファ333およびセレクタ334を備えている。
(Transaction control unit 33)
Next, the
入力バッファ331は、プロセッサ10から入力されたトランザクションを一時的に格納するバッファである。入力バッファ331に格納されたトランザクションは、出力バッファ333に出力される。また、入力バッファ331は、トランザクションが入力されたことを示す信号を論理積回路332に供給する。
The
論理積回路332は、(a)入力バッファ331から入力される、入力バッファ331にトランザクションが入力されたか否かを示す信号と、(b)トランザクション検出部31から入力される、特定のIOトランザクションが検出されたか否かを示す制御信号と、を用いて論理積演算を行い、演算結果を出力する論理回路である。上記(b)の制御信号は、図7に示すように、反転して、論理積回路332に入力される。
The AND
ここで、上記(b)の制御信号は、上述したとおり、何れかのPCIカードを無効化するトランザクション(特定のIOトランザクション)が検出されたか否かを示す信号であり、検出された場合は「1」、検出されなかった場合は「0」となる信号である。論理積回路332には、上記制御信号が反転して入力されるため、特定のIOトランザクションがある場合は「0」、無い場合は「1」が、論理積回路332に入力される。
Here, as described above, the control signal in (b) is a signal indicating whether a transaction (specific IO transaction) for invalidating any PCI card is detected. “1”, and “0” when not detected. Since the above control signal is inverted and input to the
論理積回路332は、論理積演算を行うため、特定のIOトランザクション(PCIカードを無効化するトランザクション)がある場合は、「0」を出力する。特定のIOトランザクションが無い場合(PCIカードを有効化する場合)、論理積回路332は、入力バッファから入力された値を出力する。なお、論理積回路332からの出力を、データ有効信号(データvalid信号)と呼ぶ。
Since the
出力バッファ333は、入力バッファ331から入力されたトランザクションを一時的に格納し、各IOデバイス側に出力するバッファである。この、出力バッファ333には、データ有効信号が有効であるとき、つまり、データ有効信号が「1」のとき、入力バッファ331から入力されたトランザクションが書き込まれる。これにより、プロセッサ10から入力されたトランザクションがあり、PCIカードを無効化するトランザクションが無い場合、出力バッファ333は、入力バッファ331を介して、プロセッサ10から入力されたトランザクションを各IOに対して出力する。
The
セレクタ334は、応答トランザクション出力部32からの出力、または、IOの出力の何れかを、トランザクション検出部31から出力された制御信号に従って選択する。セレクタ334は、選択した出力を、プロセッサ10に出力する。
The
ここで、IOからの出力とは、出力バッファ333から出力されたトランザクションに対する応答である。また、応答トランザクション出力部32からの出力とは、上述したとおり、PCIスロットにPCIカードが接続されていない場合に返される応答トランザクションである。
Here, the output from the IO is a response to the transaction output from the
セレクタ334は、トランザクション検出部31から出力された制御信号が「1」の場合、つまり、特定のIOトランザクションが検出された場合、応答トランザクション出力部32からの出力を、プロセッサ10に送信する。また、セレクタ334は、トランザクション検出部31から出力された制御信号が「0」の場合、つまり、特定のIOトランザクションが検出されなかった場合、IOからの応答を、プロセッサ10に出力する。
The
図4〜図7を用いて、具体例を挙げて説明する。まず、ハードウェア構成情報のPCIカード51に対応する値が「0」の場合、つまり、PCIカード51を隠蔽する場合について説明する。
A specific example will be described with reference to FIGS. First, a case where the value corresponding to the
このとき、BIOSプログラム41は、PCIカード(0)無効化レジスタ313に「1」を設定する。
At this time, the
上述したとおり、OSは、直接、PCIカード51にアクセスするため、プロセッサ10からPCIカード51に対するトランザクション(トランザクション(0)と呼ぶ)がトランザクション検出部31およびトランザクション制御部33に入力される。比較器312は、トランザクション検出部31に入力されたトランザクション(0)がPCIカード(0)トランザクションパターン311と一致すると判定し、「1」を出力する。PCIカード(0)無効化レジスタ313には、「1」が設定されているため、論理積回路314は、「1」を出力する。一方、比較器317は、トランザクション(0)と、PCIカード(1)トランザクションパターン316とが一致しないため、「0」を出力する。よって、論理積回路319も「0」を出力する。したがって、論理和回路315は、「1」を出力する。
As described above, since the OS directly accesses the
応答トランザクション出力部32のセレクタ323は、論理積回路314から「1」が出力されているため、この出力(制御信号)に従って、PCIカード(0)応答トランザクション321を選択し、出力する。
Since “1” is output from the AND
トランザクション制御部33の入力バッファ331には、トランザクション(0)が入力される。入力バッファ331にトランザクションが入力されたので、論理積回路332には、トランザクションが入力されたことを示す信号「1」が入力される。また、論理積回路332には、トランザクション検出部31の論理和回路315から出力された制御信号「1」を反転した値「0」が入力される。よって、論理積回路332は、データ有効信号として「0」を出力する。データ有効信号が「0」のため、出力バッファ333には、トランザクション(0)が格納されない。また、セレクタ334は、トランザクション検出部31からの制御信号が「1」であるため、応答トランザクション出力部32の出力である、PCIカード(0)が対応するPCIスロットに搭載されていないことを示す応答トランザクション(PCIカード(0)応答トランザクション321)を、プロセッサ10に出力する。
The transaction (0) is input to the
次に、ハードウェア構成情報のPCIカード51に対応する値が「1」の場合、つまり、PCIカード51が有効である場合について説明する。このとき、BIOSプログラム41は、PCIカード(0)無効化レジスタ313に「0」を設定する。
Next, a case where the value corresponding to the
プロセッサ10からPCIカード51に対するトランザクション(0)がトランザクション検出部31およびトランザクション制御部33に入力されると、比較器312は、「1」を出力する。PCIカード(0)無効化レジスタ313には、「0」が設定されているため、論理積回路314は、「0」を出力する。比較器317は、「0」を出力し、論理積回路319も「0」を出力する。したがって、論理和回路315は、「0」を出力する。
When the transaction (0) for the
トランザクション制御部33の入力バッファ331には、トランザクション(0)が入力される。入力バッファ331にトランザクションが入力されたので、論理積回路332には、トランザクションが入力されたことを示す信号「1」が入力される。また、論理積回路332には、トランザクション検出部31の論理和回路315から出力された制御信号「0」を反転した値「1」が入力される。よって、論理積回路332は、データ有効信号として「1」を出力する。データ有効信号が「1」のため、出力バッファ333には、トランザクション(0)が格納され、当該トランザクション(0)がIO側に出力される。セレクタ334は、トランザクション検出部31からの制御信号が「0」であるため、上記IO側からの応答トランザクションであって、上記IO側に出力したトランザクション(0)に対する応答を、プロセッサ10に出力する。
The transaction (0) is input to the
これにより、IOコントローラ30は、無効と設定されたPCIカード51、52を隠蔽し、有効と設定されたPCIカード51、52からの応答のみをプロセッサ10に出力することができる。これにより、プロセッサ10上で動作するOSは、応答が返ってきたPCIカードを、有効であると認識することができる。
As a result, the
このように、BIOSプログラム41は、ハードウェア構成情報に含まれる、ハードウェア試験にPCIカード51、52を使用しないことを示す情報(図3の場合、「0」)を用いて、PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318の設定値(本実施の形態の場合「1」)を設定する。これにより、ハードウェア構成情報にハードウェア試験に使用されないと設定されたPCIカード51、52を、夫々、OSから隠蔽することができる。
As described above, the
(3)HDD61、62の隠蔽方法
次に、HDD61、62の隠蔽方法について説明する。
(3) Concealing Method for
情報処理装置1のOSがHDDの有効/無効を確認する場合、HDDの入出力を制御するSASコントローラ60上で動作するファームウェアが、SASコントローラ60に接続されたHDDをサーチして検出する。これにより、検出されたHDDが、OSからアクセスできる状態であると認識される。したがって、情報処理装置1は、HW構成テーブル24、および、IOコントローラ30の各手段を用いることなく有効/無効の確認を行うため、プロセッサ11、メモリ21〜23およびPCIカード51、52とは異なる方法で、HDDの隠蔽を行う。以下では、その方法について、説明する。
When the OS of the
本実施の形態に係る情報処理装置1は、図2に示す通り、情報処理装置1の電源回路に接続される電源ライン上にスイッチ71、72を配置している。スイッチ71、72は、夫々、HDD61、62に電源を供給するか否かを制御する。スイッチ71、72は、夫々、IOコントローラ30のIO制御レジスタ34、35からの出力信号で制御される。
In the
IO制御レジスタ34、35には、夫々、スイッチ71、72を制御するための設定値が設定されている。IOコントローラ30のIO制御レジスタ34およびIO制御レジスタ35への設定値の設定は、プロセッサ10がBIOSプログラム41を実行することにより行われる。具体的には、プロセッサ10が、BIOSプログラム41を実行することによって、HW構成情報テーブル42を参照し、HW構成情報テーブル42のHDD61に対する値を取得する。そして、BIOSプログラム41によって、スイッチ71を制御するための設定値として、取得したHW構成情報テーブル42のHDD61に対する値を、IO制御レジスタ34に設定する。同様に、IO制御レジスタ35に対する設定値の設定も、プロセッサ10がBIOSプログラム41を実行することにより行われる。
Setting values for controlling the
IO制御レジスタ34に設定した値は、IOコントローラ30のピンからスイッチ71に対して出力される。そして、スイッチ71は、入力された値に従って、電源回路70から出力される電力をHDD61に供給するか否かを制御する。したがって、IO制御レジスタ34に設定される、スイッチ71を制御するための設定値とは、HDD61を有効/無効に設定するための設定値であると言える。同様に、IO制御レジスタ35に設定した値は、HDD62を有効/無効に設定するための設定値であると言える。
The value set in the IO control register 34 is output from the pin of the
なお、BIOSプログラム41は、HW構成情報テーブル42において有効と設定されているHDDが物理的に情報処理装置1に搭載されているかを確認する処理を有する構成であってもよい。BIOSプログラム41は、上記HDDが物理的に情報処理装置1に搭載されていない場合、対応する上記IO制御レジスタの設定値として「0」を設定する。
The
これにより、HW構成情報テーブル42に有効と設定されたHDDに対してのみ、電源が供給される。したがって、情報処理装置1のOSがHDDの有効/無効を確認する場合、SASコントローラ60上で動作するファームウェアが、SASコントローラ60に接続された、電源が供給されたHDDをサーチする。したがって、OSは、検出されたHDDを有効であると認識することができる。
As a result, power is supplied only to the HDDs that are set valid in the HW configuration information table 42. Therefore, when the OS of the
このように、BIOSプログラム41は、ハードウェア構成情報に含まれる、ハードウェア試験にHDD61、62を使用しないことを示す情報(図3の場合、「0」)を、IO制御レジスタ34およびIO制御レジスタ35の設定値として設定する。これにより、ハードウェア構成情報にハードウェア試験に使用されないと設定されたHDD61、62を、夫々、OSから隠蔽することができる。
As described above, the
(情報処理装置1の動作の説明)
次に、図8を参照して、情報処理装置1によるハードウェア試験の処理の流れについて説明する。図8は、本実施の形態に係る情報処理装置1のハードウェア試験の流れの一例を示すフローチャートである。情報処理装置1を利用するオペレータ等が、ハードウェア試験の開始を、情報処理装置1に対して指示することにより、情報処理装置1は、ハードウェア試験を開始する。
(Description of operation of information processing apparatus 1)
Next, with reference to FIG. 8, the flow of the hardware test process by the
まず、プロセッサ10がHW試験プログラム26を実行することにより、メインメモリ20に格納されたシステム動作確認試験プログラム25が起動される。これにより、情報処理装置1は、システム動作確認試験を行う(ステップS81)。システム動作確認試験では、情報処理装置1や情報処理装置1を含むシステムを構築する際に必要とされる試験である。具体的には、情報処理装置1において、予め組み込まれた装置、OS、ソフトウェア等に対する試験が開始され、それによってOSが検出した情報処理装置1内のハードウェアを稼働させる各種試験が行われる。
First, when the
システム動作確認試験が終了する(ステップS81が終了する)と、HW試験プログラム26が、HW構成ポインタ43により示されている構成番号を読み出す(ステップS82)。
When the system operation check test ends (step S81 ends), the
そして、HW試験プログラム26は、読み出した構成番号が、最終HW構成番号44と一致するか否かを確認する(ステップS83)。一致する場合(ステップS83にてYES)、HW試験プログラム26は、HW構成ポインタ43の値を0にする(ステップS84)。そして、情報処理装置1は、ハードウェア試験を終了する。これにより、HW構成ポインタ43により示されている構成番号が「0」となるため、次回起動時において、情報処理装置1は、構成番号「0」のハードウェア構成情報で示される構成で設定されて起動されることになる。
Then, the
HW試験プログラム26が読み出した構成番号が、最終HW構成番号44と一致しない場合(ステップS83にてNO)、HW試験プログラム26は、読み出した構成番号をインクリメントする。そして、HW試験プログラム26は、インクリメントした構成番号をHW構成ポインタ43の値として設定する(ステップS85)。
When the configuration number read by
その後、HW試験プログラム26は、情報処理装置1を再起動させる(ステップS86)。
Thereafter, the
情報処理装置1が再起動すると、プロセッサ10がBIOSプログラム41をメインメモリ20上に展開して、プロセッサ10上で当該BIOSプログラム41を実行する。これにより、ハードウェア構成設定処理が行われる(ステップS87)。なお、ハードウェア構成設定処理については、図面を変えて説明する。
When the
ハードウェア構成設定処理が完了する(ステップS87が終了する)と、一般的なコンピュータ装置で動作するBIOSと同様、プロセッサ10上で実行されているBIOSプログラム41によって、ハードウェアの初期化が行われる(ステップS88)。
When the hardware configuration setting process is completed (step S87 ends), the hardware is initialized by the
その後、情報処理装置1のOSが起動する(ステップS89)。本実施の形態では、情報処理装置1のOS起動後に、HW試験プログラム26が自動的に再開される設定がされているとする。したがって、情報処理装置1の処理がステップS81に戻る。これにより、情報処理装置1は、前回とは異なるハードウェア構成で、システム動作確認試験(ステップS81)を開始する。
Thereafter, the OS of the
次に、図9を参照して、ハードウェア構成設定処理(ステップS87)について説明する。図9は、本実施の形態に係る情報処理装置1におけるハードウェア構成設定処理の流れの一例を示すフローチャートである。以下に示すステップS91〜S99の処理は、プロセッサ10がBIOSプログラム41を実行することにより、行われる。
Next, the hardware configuration setting process (step S87) will be described with reference to FIG. FIG. 9 is a flowchart showing an example of the flow of the hardware configuration setting process in the
プロセッサ10がBIOSプログラム41を実行することにより、不揮発性メモリ40のHW構成ポインタ43により示されている構成番号を読み出す(ステップS91)。そして、BIOSプログラム41が、読み出した構成番号に関連付けられたハードウェア構成情報から、プロセッサ11(プロセッサ(1))の有効/無効を示す値を取得し、有効か無効かを確認する(ステップS92)。取得した値が、プロセッサ11が有効であることを示す場合(ステップS92にてYES)、BIOSプログラム41は、プロセッサ11が物理的に情報処理装置1に搭載されているかを確認する(ステップS93)。なお、プロセッサ11が情報処理装置1に物理的に搭載されているか否かを確認する方法は、一般的な手法を用いるため、本実施の形態においては、説明を省略する。
When the
プロセッサ11が物理的に情報処理装置1に搭載されている場合(ステップS93にてYES)、BIOSプログラム41は、メインメモリ20のHW構成テーブル24に対し、プロセッサ11を有効にする設定を行う(ステップS94)。
When the
取得した値が、プロセッサ11が無効であることを示す場合(ステップS92にてNO)、または、プロセッサ11が物理的に情報処理装置1に搭載されていない場合(ステップS93にてNO)、BIOSプログラム41は、メインメモリ20のHW構成テーブル24に対し、プロセッサ11を無効にする設定を行う(ステップS95)。
When the acquired value indicates that
ステップS94終了後、または、ステップS95終了後、BIOSプログラム41は、メモリ(1)に対してもプロセッサ11と同様の処理を行う(ステップS96〜ステップS99)。また、BIOSプログラム41は、メモリ(2)、メモリ(3)に対しても、同様の処理を行う。
After step S94 ends or after step S95 ends, the
更に、PCIカード51、52に対しても、BIOSプログラム41は、ステップS92およびS93と同様の処理を行う。また、PCIカード51、52における、有効/無効の設定(ステップS94およびS95に対応する処理)は、HW構成テーブル24にではなく、PCIカード(0)無効化レジスタ313およびPCIカード(1)無効化レジスタ318に対して行われる。
Further, the
更に、HDD61、62に対しても、BIOSプログラム41は、ステップS92およびS93と同様の処理を行う。また、PCIカード51、52における、有効/無効の設定(ステップS94およびS95に対応する処理)は、HW構成テーブル24にではなく、IOコントローラ30のIO制御レジスタ34、35に対して行われる。
Further, the
なお、図9において、プロセッサ11に対する有効/無効設定を行った後に、メモリ21に対する有効/無効設定を行うことを例に説明を行ったが、ハードウェア構成要素に対する有効/無効設定は、この順に限定されるものではない。ハードウェア構成要素に対する有効/無効設定は、どのような順番で行われてもよい。
In FIG. 9, the example has been described in which the valid / invalid setting for the
また、上述したステップS92、S96では、対応するハードウェア構成要素の有効/無効を示す値を取得しているが、本発明はこれに限定されるものではない。例えば、ステップS91の後に、読み出した構成番号に関連付けられたハードウェア構成情報に含まれる全てのハードウェア構成要素の夫々に対する有効/無効を示す値を取得する構成であってもよい。そして、ステップS92、S96において、上記取得した値を用いて、対応するハードウェア構成要素が有効か無効かを確認してもよい。 In steps S92 and S96 described above, a value indicating validity / invalidity of the corresponding hardware component is acquired, but the present invention is not limited to this. For example, the configuration may be such that after step S91, a value indicating validity / invalidity for each of all the hardware components included in the hardware configuration information associated with the read configuration number is acquired. In steps S92 and S96, whether the corresponding hardware component is valid or invalid may be confirmed using the acquired value.
更に詳細に、図8、図9の処理について説明する。図2に示すハードウェア構成要素が全て情報処理装置1に搭載されており、不揮発性メモリ40の最終HW構成番号44が「1」の場合を例に説明を行う。ここで、HW構成ポインタ43の値は「0」であるとする。そのため、情報処理装置1は、HW構成情報テーブル42における、構成番号「0」のハードウェア構成情報で示される構成で設定されて起動されているとする。
The processing in FIGS. 8 and 9 will be described in more detail. An example in which all the hardware components shown in FIG. 2 are installed in the
HW試験プログラム26が、システム動作確認試験プログラム25を起動することによって、HW構成情報テーブル42における、構成番号「0」のハードウェア構成情報で示される構成で、システム動作確認試験が行われる。
When the
その後、HW試験プログラム26が、HW構成ポインタ43により示されている構成番号である「0」を読み出し(ステップS82)、最終HW構成番号44と一致するか否かを確認する(ステップS83)。上述したとおり、最終HW構成番号44は、「1」であるため、処理は、ステップS85に進む。
Thereafter, the
HW試験プログラム26は、構成番号をインクリメントし(ステップS85)、インクリメントした値である「1」をHW構成ポインタ43の値として設定する(ステップS85)。
The
情報処理装置1の再起動(ステップS86)後、BIOSプログラム41は、HW構成情報テーブル42における、構成番号「1」のハードウェア構成情報で示される構成で設定される(ステップS87(ステップS91〜S99))。
After the
そして、ハードウェアの初期化が行われ(ステップS88)、OSが起動される(ステップS89)。その後、ステップS81に戻り、HW構成情報テーブル42における構成番号「1」のハードウェア構成情報で示される構成で、システム動作確認試験が行われる。 Then, the hardware is initialized (step S88), and the OS is started (step S89). Thereafter, the process returns to step S81, and a system operation check test is performed with the configuration indicated by the hardware configuration information of the configuration number “1” in the HW configuration information table 42.
システム動作確認試験が終了すると、HW試験プログラム26が、HW構成ポインタ43により示されている構成番号である「1」を読み出し(ステップS82)、最終HW構成番号44と一致するか否かを確認する(ステップS83)。上述したとおり、最終HW構成番号44は、「1」であるため、処理は、ステップS84に進む。そして、HW試験プログラム26は、「0」をHW構成ポインタ43の値として設定する(ステップS84)。これにより、情報処理装置1のハードウェア試験が終了する。
When the system operation check test is completed, the
以上のように、HW構成情報テーブル42に登録されたハードウェア構成のうち、0から最終HW構成番号44に設定された値(本例では「1」)までのハードウェア構成で、システム動作確認試験プログラム25によるシステム動作確認試験を自動的に行うことができる。
As described above, of the hardware configurations registered in the HW configuration information table 42, the system operation check is performed with the hardware configuration from 0 to the value set to the final HW configuration number 44 (in this example, “1”). A system operation confirmation test by the
これにより、HW構成情報テーブル42の設定内容と、最終HW構成番号44の値を変えるだけで、最大N種類のハードウェア構成によるシステム動作確認試験を行うことができる。
As a result, a system operation confirmation test with a maximum of N types of hardware configurations can be performed simply by changing the setting contents of the HW configuration information table 42 and the value of the final
(効果)
本実施の形態における情報処理装置1によれば、情報処理装置1のハードウェア試験を、より好適に、自動的に行うことができる。
(effect)
According to the
なぜならば、BIOSプログラム41が、HW構成情報テーブル42に記憶されたハードウェア構成情報に従って、1または複数のハードウェア構成要素のうち、ハードウェア試験に使用しないハードウェア構成要素を、OSから隠蔽する隠蔽処理を、プロセッサ10に実行させるからである。そして、HW試験プログラム26が、OSから隠蔽されていないハードウェア構成要素を用いて、ハードウェア試験を行うからである。
This is because the
これにより、ハードウェア構成要素を物理的に情報処理装置1に搭載し、上記ハードウェア構成要素をハードウェア試験に使用するか否かを、HW構成情報テーブル42に登録するだけで、情報処理装置1は、ハードウェア試験に使用しないハードウェア構成要素を隠蔽して、自動的にハードウェア試験を行うことができる。
As a result, the hardware components are physically mounted on the
また、情報処理装置1は、HW構成ポインタ43を用いて、HW構成情報テーブル42から1つのハードウェア構成情報を選択して、選択したハードウェア構成情報に従って、前記ハードウェア試験に使用しないハードウェア構成要素を、OSから隠蔽する。
Further, the
これにより、複数のハードウェア構成を自動で切り替えながら複数のハードウェア構成の夫々に対する、ハードウェア試験を実行することができる。そのため、情報処理装置1のハードウェア試験の作業者は、物理的なハードウェア入替えにかかる手間を省くことができる。したがって、ハードウェア試験の工数を大幅に削減できる。例えば、100通りのハードウェア構成に対するハードウェア試験が必要な場合、ハードウェアの入替えにかかる工数を1/100にすることができる。
Thereby, a hardware test can be executed for each of the plurality of hardware configurations while automatically switching the plurality of hardware configurations. Therefore, the operator of the hardware test of the
また、自動化によって、作業者による上記入替え作業を行わなくても、ハードウェア構成を変更してハードウェア試験を行うことができるため、作業者が試験を行わない時間帯(例えば、夜間)も有効活用することができる。したがって、試験期間を大幅に短縮することができる。例えば、作業者の勤務時間が日中の12時間である場合、人手による上記作業が必要なハードウェア試験は半日しか行えないが、本実施の形態による情報処理装置1によれば、終日ハードウェア試験を行うことができる。
In addition, because of the automation, the hardware configuration can be changed and the hardware test can be performed without performing the above replacement work by the worker, so that the time when the worker does not perform the test (for example, at night) is also effective. Can be used. Therefore, the test period can be greatly shortened. For example, if the worker's working hours are 12 hours during the day, the hardware test that requires the above-described work by hand can only be performed for half a day. However, according to the
本発明は、情報処理装置1の利用者が選択可能な複数のオプション機器に対し、これらのオプション機器の搭載が可能なサーバ装置、パーソナルコンピュータ、その他の電子機器類の製造分野に好適に利用することができる。
The present invention is suitably used in the field of manufacturing server devices, personal computers, and other electronic devices that can be equipped with a plurality of optional devices that can be selected by the user of the
なお、上述した各実施の形態は、本発明の好適な実施の形態であり、上記各実施の形態にのみ本発明の範囲を限定するものではなく、本発明の要旨を逸脱しない範囲において当業者が上記各実施の形態の修正や代用を行い、種々の変更を施した形態を構築することが可能である。 Each of the above-described embodiments is a preferred embodiment of the present invention, and the scope of the present invention is not limited only to the above-described embodiments, and those skilled in the art do not depart from the gist of the present invention. However, it is possible to construct a form in which various modifications are made by correcting or substituting the above-described embodiments.
例えば、上述した実施の形態における各動作は、ハードウェアまたはソフトウェア、あるいはその両方の複合構成によって実行することも可能である。 For example, each operation in the above-described embodiment can be executed by hardware, software, or a combined configuration of both.
なお、ソフトウェアによる処理を実行する場合には、例えば、上記各処理が実行可能な汎用コンピュータにプログラムをインストールして実行させることが可能である。また、上記プログラムは、例えば、ハードディスクなどの記録媒体に記録しておくことが可能である。 In addition, when executing processing by software, for example, it is possible to install and execute a program on a general-purpose computer capable of executing each processing described above. The program can be recorded on a recording medium such as a hard disk.
上記の実施の形態の一部または全部は、以下の付記のようにも記載されうるが、以下には限られない。 A part or all of the above embodiment can be described as in the following supplementary notes, but is not limited thereto.
(付記1)情報処理装置のハードウェア試験を制御する制御手段と、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記制御手段に実行させるプログラム、および、前記ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶する記憶手段と、を備え、前記プログラムは、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する隠蔽処理を前記制御手段に実行させるものであり、前記制御手段は、前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う、ことを特徴とする情報処理装置。 (Supplementary Note 1) Control means for controlling hardware test of information processing apparatus, one or a plurality of hardware devices, a program for causing the control means to execute boot processing for booting an operating system, and hardware test Storage means for storing a hardware configuration information table including hardware configuration information indicating a hardware configuration to be used, and the program performs the hardware test among the hardware devices according to the hardware configuration information. The control unit executes a concealing process for concealing a hardware device not used in the operating system from the operating system, and the control unit performs a hardware test using a hardware device that is not concealed from the operating system. The Cormorants, the information processing apparatus characterized by.
(付記2)前記ハードウェア構成情報テーブルには、前記ハードウェア構成情報が複数含まれており、前記プログラムは、更に、前記ハードウェア構成情報テーブルに含まれる複数のハードウェア構成情報のうち1つを選択する選択処理を前記制御手段に実行させ、前記隠蔽処理は、前記選択されたハードウェア構成情報に従って、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する処理である、ことを特徴とする付記1に記載の情報処理装置。
(Supplementary Note 2) The hardware configuration information table includes a plurality of the hardware configuration information, and the program further includes one of the plurality of hardware configuration information included in the hardware configuration information table. The concealment process is a process of concealing a hardware device that is not used for the hardware test from the operating system according to the selected hardware configuration information. The information processing apparatus according to
(付記3)前記記憶手段は、前記複数のハードウェア構成情報の何れかを示すポインタを記憶し、前記制御手段は、前記ポインタの値を変更し、前記選択処理は、前記ポインタが示す前記ハードウェア構成情報を選択する処理である、ことを特徴とする付記2に記載の情報処理装置。
(Supplementary Note 3) The storage means stores a pointer indicating any of the plurality of hardware configuration information, the control means changes a value of the pointer, and the selection process is performed by the hardware indicated by the pointer. The information processing apparatus according to
(付記4)前記プログラムは、更に、前記ハードウェアデバイスが物理的に前記情報処理装置に搭載されているかを確認する確認処理を前記制御手段に実行させ、前記隠蔽処理は、前記確認処理によって前記情報処理装置に搭載されていないと確認されたハードウェアデバイスを、前記ハードウェア試験に使用しないハードウェアデバイスとして、前記オペレーティングシステムから隠蔽する、ことを特徴とする付記1から3の何れかに記載の情報処理装置。 (Supplementary Note 4) The program further causes the control unit to execute a confirmation process for confirming whether the hardware device is physically mounted in the information processing apparatus, and the concealment process is performed by the confirmation process. The hardware device that is confirmed not to be mounted on the information processing apparatus is hidden from the operating system as a hardware device that is not used in the hardware test. Information processing device.
(付記5)前記ハードウェアデバイスには、プロセッサおよびメモリの少なくとも何れかが含まれており、前記制御手段は、前記オペレーティングシステムが、当該情報処理装置に搭載された前記ハードウェアデバイスを確認する際に参照するハードウェア構成テーブルを含み、前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記ハードウェア構成テーブルに設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記1から4の何れかに記載の情報処理装置。
(Supplementary Note 5) The hardware device includes at least one of a processor and a memory, and the control unit is configured to check the hardware device installed in the information processing apparatus by the operating system. The concealment processing sets information indicating that the hardware device is not used for the hardware test, which is included in the hardware configuration information, in the hardware configuration table. The information processing apparatus according to any one of
(付記6)前記ハードウェアデバイスには、拡張スロットに搭載された拡張カードが含まれており、前記制御手段は、前記拡張カードを無効化するための設定値を格納するレジスタと、前記レジスタに格納された、前記拡張カードを無効化するための設定値に従って、前記拡張カードを無効とする無効化トランザクションを検出するトランザクション検出手段と、当該拡張カードが搭載された拡張スロットに、前記拡張カードが搭載されていないことを示す応答トランザクションを出力する応答トランザクション出力手段と、前記無効化トランザクションを検出したとき、前記応答トランザクションを出力するトランザクション制御手段と、を備え、前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を用いて、前記レジスタの設定値を設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記1から5の何れかに記載の情報処理装置。
(Supplementary Note 6) The hardware device includes an expansion card mounted in an expansion slot, and the control means includes a register for storing a setting value for invalidating the expansion card, and the register In accordance with the stored setting value for invalidating the expansion card, transaction detection means for detecting an invalidation transaction for invalidating the expansion card, and the expansion card installed in the expansion slot in which the expansion card is mounted Response transaction output means for outputting a response transaction indicating that the transaction is not mounted, and transaction control means for outputting the response transaction when the invalidation transaction is detected, and the concealment processing includes the hardware configuration The hardware test included in the information includes the hardware Any one of
(付記7)前記ハードウェアデバイスには、ハードディスクが含まれており、前記情報処理装置は、前記ハードディスクに電源を供給するか否かを制御するスイッチと、前記スイッチを制御するための設定値を格納する制御レジスタと、を更に備え、前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記制御レジスタの設定値として設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記1から6の何れかに記載の情報処理装置。
(Supplementary Note 7) The hardware device includes a hard disk, and the information processing apparatus includes a switch for controlling whether or not to supply power to the hard disk, and a setting value for controlling the switch. A control register for storing, wherein the concealment processing sets information indicating that the hardware device is not used for the hardware test, which is included in the hardware configuration information, as a setting value of the control register The information processing apparatus according to any one of
(付記8)前記プログラムは、BIOS(Basic Input/Output System)である、ことを特徴とする付記1から7の何れかに記載の情報処理装置。
(Supplementary note 8) The information processing apparatus according to any one of
(付記9)情報処理装置を制御する制御手段と、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記制御手段に実行させるプログラム、および、ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶する記憶手段と、を備えた情報処理装置のハードウェア試験制御方法であって、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽し、前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う、ことを特徴とするハードウェア試験制御方法。 (Supplementary Note 9) Control means for controlling information processing apparatus, one or more hardware devices, program for causing control means to execute boot process for booting operating system, and hardware configuration used for hardware test A hardware test control method for an information processing apparatus comprising: a storage unit that stores a hardware configuration information table that includes hardware configuration information indicating, in accordance with the hardware configuration information, among the hardware devices, A hardware test control method, wherein a hardware device that is not used for the hardware test is concealed from the operating system, and a hardware test is performed using a hardware device that is not concealed from the operating system. .
(付記10)前記ハードウェア構成情報テーブルには、前記ハードウェア構成情報が複数含まれており、前記ハードウェア試験制御方法は、前記ハードウェア構成情報テーブルに含まれる複数のハードウェア構成情報のうち1つを選択し、前記選択されたハードウェア構成情報に従って、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する、ことを特徴とする付記9に記載のハードウェア試験制御方法。 (Supplementary Note 10) The hardware configuration information table includes a plurality of the hardware configuration information, and the hardware test control method includes a plurality of pieces of hardware configuration information included in the hardware configuration information table. The hardware test control method according to appendix 9, wherein one is selected and a hardware device that is not used for the hardware test is hidden from the operating system according to the selected hardware configuration information. .
(付記11)前記記憶手段は、前記複数のハードウェア構成情報の何れかを示すポインタを記憶するものであり、前記ハードウェア試験制御方法は、前記ポインタの値を変更し、前記ポインタが示す前記ハードウェア構成情報を選択する、ことを特徴とする付記10に記載のハードウェア試験制御方法。
(Additional remark 11) The said memory | storage means memorize | stores the pointer which shows either of the said some hardware configuration information, The said hardware test control method changes the value of the said pointer, and the said pointer shows The hardware test control method according to
(付記12)前記ハードウェアデバイスが物理的に前記情報処理装置に搭載されているかを確認し、前記情報処理装置に搭載されていないと確認されたハードウェアデバイスを、前記ハードウェア試験に使用しないハードウェアデバイスとして、前記オペレーティングシステムから隠蔽する、ことを特徴とする付記9から11の何れかに記載のハードウェア試験制御方法。 (Additional remark 12) Confirm whether the said hardware device is physically mounted in the said information processing apparatus, and do not use the hardware device confirmed not mounted in the said information processing apparatus for the said hardware test. The hardware test control method according to any one of appendices 9 to 11, wherein the hardware device is hidden from the operating system.
(付記13)前記ハードウェアデバイスには、プロセッサおよびメモリの少なくとも何れかが含まれており、前記制御手段は、前記オペレーティングシステムが、当該情報処理装置に搭載された前記ハードウェアデバイスを確認する際に参照するハードウェア構成テーブルを含み、前記ハードウェア試験制御方法は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記ハードウェア構成テーブルに設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記9から12の何れかに記載のハードウェア試験制御方法。 (Supplementary Note 13) The hardware device includes at least one of a processor and a memory, and the control unit is configured to check the hardware device installed in the information processing apparatus by the operating system. And the hardware test control method includes information indicating that the hardware device is not used for the hardware test included in the hardware configuration information. 13. The hardware test control method according to any one of appendices 9 to 12, wherein the hardware device is hidden from the operating system by setting to.
(付記14)前記ハードウェアデバイスには、拡張スロットに搭載された拡張カードが含まれており、前記制御手段は、前記拡張カードを無効化するための設定値を格納するレジスタを備え、前記ハードウェア試験制御方法は、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を用いて、前記レジスタの設定値を設定し、前記レジスタに格納された、前記拡張カードを無効化するための設定値に従って、前記拡張カードを無効とする無効化トランザクションを検出し、当該拡張カードが搭載された拡張スロットに、前記拡張カードが搭載されていないことを示す応答トランザクションを出力し、前記無効化トランザクションを検出したとき、前記応答トランザクションを出力することにより、前記ハードウェア構成情報に含まれる当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記9から13の何れかに記載のハードウェア試験制御方法。 (Supplementary Note 14) The hardware device includes an expansion card mounted in an expansion slot, and the control means includes a register for storing a setting value for invalidating the expansion card, The hardware test control method sets the set value of the register using information indicating that the hardware device is not used for the hardware test, and invalidates the expansion card stored in the register. The invalidation transaction for invalidating the expansion card is detected in accordance with the set value of, and a response transaction indicating that the expansion card is not installed is output to the expansion slot in which the expansion card is installed, and the invalidation is output. When the transaction is detected, the response transaction is output, so that the hardware The hardware devices included in the formed information to conceal from the operating system, hardware test control method according to any one of Supplementary Note 9 13, characterized in that.
(付記15)前記ハードウェアデバイスには、ハードディスクが含まれており、前記情報処理装置は、前記ハードディスクに電源を供給するか否かを制御するスイッチと、前記スイッチを制御するための設定値を格納する制御レジスタと、を更に備え、前記ハードウェア試験制御方法は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記制御レジスタの設定値として設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする付記9から14の何れかに記載のハードウェア試験制御方法。 (Supplementary Note 15) The hardware device includes a hard disk, and the information processing apparatus includes a switch for controlling whether or not to supply power to the hard disk, and a setting value for controlling the switch. A control register for storing the control register, wherein the hardware test control method sets information in the hardware configuration information indicating that the hardware device is not used for the hardware test. 15. The hardware test control method according to any one of appendices 9 to 14, wherein the hardware device is hidden from the operating system by setting as a value.
(付記16)前記プログラムは、BIOS(Basic Input/Output System)である、ことを特徴とする付記9から15の何れかに記載のハードウェア試験制御方法。 (Supplementary note 16) The hardware test control method according to any one of supplementary notes 9 to 15, wherein the program is a BIOS (Basic Input / Output System).
(付記17)プロセッサと、1または複数のハードウェアデバイスと、オペレーティングシステムをブートするブート処理を前記プロセッサに実行させるプログラム、および、ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶するメモリと、を備えた情報処理装置に、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する処理を、実行させることを特徴とするプログラム。 (Supplementary Note 17) A processor, one or a plurality of hardware devices, a program for causing the processor to execute a boot process for booting an operating system, and hardware configuration information indicating a hardware configuration used for a hardware test are included. An information processing apparatus comprising a memory for storing a hardware configuration information table, wherein hardware devices that are not used for the hardware test among the hardware devices are concealed from the operating system according to the hardware configuration information. A program characterized by causing a process to be executed to be executed.
(付記18)前記プログラムは、BIOSである、ことを特徴とする付記17に記載のプログラム。 (Supplementary note 18) The program according to supplementary note 17, wherein the program is a BIOS.
(付記19)付記17または付記18に記載のプログラムを記憶する、ことを特徴とするコンピュータ読み取り可能な記録媒体。 (Supplementary note 19) A computer-readable recording medium storing the program according to supplementary note 17 or supplementary note 18.
1 情報処理装置
10 プロセッサ
11 プロセッサ
20 メインメモリ
21〜23 メモリ
24 HW構成テーブル
25 システム動作確認試験プログラム
26 HW試験プログラム
30 IOコントローラ
31 トランザクション検出部
310 パターン記憶部
311 PCIカード(0)トランザクションパターン
312 比較器
313 PCIカード(0)無効化レジスタ
314 論理積回路
315 論理和回路
316 PCIカード(1)トランザクションパターン
317 比較器
318 PCIカード(1)無効化レジスタ
319 論理積回路
32 応答トランザクション出力部
320 応答トランザクション記憶部
321 PCIカード(0)応答トランザクション
322 PCIカード(1)応答トランザクション
323 セレクタ
33 トランザクション制御部
331 入力バッファ
332 論理積回路
333 出力バッファ
334 セレクタ
34 IO制御レジスタ
35 IO制御レジスタ
40 不揮発性メモリ
41 BIOSプログラム
42 HW構成情報テーブル
43 HW構成ポインタ
44 最終HW構成番号
50 PCIコントローラ
51〜52 PCIカード
60 SASコントローラ
61〜62 HDD
70 電源回路
71〜72 スイッチ(SW)
100 情報処理装置
110 制御部
120 ハードウェアデバイス
DESCRIPTION OF
70 Power supply circuit 71-72 Switch (SW)
DESCRIPTION OF
Claims (10)
1または複数のハードウェアデバイスと、
オペレーティングシステムをブートするブート処理を前記制御手段に実行させるプログラム、および、前記ハードウェア試験に使用するハードウェア構成を示すハードウェア構成情報を含むハードウェア構成情報テーブルを記憶する記憶手段と、を備え、
前記プログラムは、前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する隠蔽処理を前記制御手段に実行させるものであり、
前記制御手段は、前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う、ことを特徴とする情報処理装置。 Control means for controlling a hardware test of the information processing apparatus;
One or more hardware devices;
A storage unit for storing a hardware configuration information table including a program for causing the control unit to execute a boot process for booting an operating system, and hardware configuration information indicating a hardware configuration used for the hardware test. ,
According to the hardware configuration information, the program causes the control unit to execute a concealment process of concealing from the operating system a hardware device that is not used for the hardware test among the hardware devices.
The information processing apparatus, wherein the control means performs a hardware test using a hardware device that is not hidden from the operating system.
前記プログラムは、更に、前記ハードウェア構成情報テーブルに含まれる複数のハードウェア構成情報のうち1つを選択する選択処理を前記制御手段に実行させ、
前記隠蔽処理は、前記選択されたハードウェア構成情報に従って、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する処理である、ことを特徴とする請求項1に記載の情報処理装置。 The hardware configuration information table includes a plurality of the hardware configuration information,
The program further causes the control means to perform a selection process for selecting one of a plurality of hardware configuration information included in the hardware configuration information table,
The information processing according to claim 1, wherein the concealment process is a process of concealing a hardware device not used in the hardware test from the operating system according to the selected hardware configuration information. apparatus.
前記制御手段は、前記ポインタの値を変更し、
前記選択処理は、前記ポインタが示す前記ハードウェア構成情報を選択する処理である、ことを特徴とする請求項2に記載の情報処理装置。 The storage means stores a pointer indicating any of the plurality of hardware configuration information,
The control means changes the value of the pointer,
The information processing apparatus according to claim 2, wherein the selection process is a process of selecting the hardware configuration information indicated by the pointer.
前記制御手段は、前記オペレーティングシステムが、当該情報処理装置に搭載された前記ハードウェアデバイスを確認する際に参照するハードウェア構成テーブルを含み、
前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記ハードウェア構成テーブルに設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする請求項1から3の何れか1項に記載の情報処理装置。 The hardware device includes at least one of a processor and a memory,
The control means includes a hardware configuration table referred to when the operating system confirms the hardware device mounted on the information processing apparatus,
In the concealment process, information indicating that the hardware device is not used for the hardware test, which is included in the hardware configuration information, is set in the hardware configuration table, so that the hardware device is The information processing apparatus according to claim 1, wherein the information processing apparatus is concealed from the system.
前記制御手段は、
前記拡張カードを無効化するための設定値を格納するレジスタと、
前記レジスタに格納された、前記拡張カードを無効化するための設定値に従って、前記拡張カードを無効とする無効化トランザクションを検出するトランザクション検出手段と、
当該拡張カードが搭載された拡張スロットに、前記拡張カードが搭載されていないことを示す応答トランザクションを出力する応答トランザクション出力手段と、
前記無効化トランザクションを検出したとき、前記応答トランザクションを出力するトランザクション制御手段と、を備え、
前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を用いて、前記レジスタの設定値を設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする請求項1から4の何れか1項に記載の情報処理装置。 The hardware device includes an expansion card mounted in an expansion slot,
The control means includes
A register for storing a setting value for invalidating the expansion card;
Transaction detecting means for detecting an invalidation transaction for invalidating the expansion card according to a setting value for invalidating the expansion card stored in the register;
Response transaction output means for outputting a response transaction indicating that the expansion card is not mounted in the expansion slot in which the expansion card is mounted;
Transaction control means for outputting the response transaction when the invalidation transaction is detected, and
The concealment process sets the setting value of the register using information indicating that the hardware device is not used for the hardware test, which is included in the hardware configuration information. The information processing apparatus according to claim 1, wherein the information processing apparatus is hidden from the operating system.
前記情報処理装置は、前記ハードディスクに電源を供給するか否かを制御するスイッチと、前記スイッチを制御するための設定値を格納する制御レジスタと、を更に備え、
前記隠蔽処理は、前記ハードウェア構成情報に含まれる、前記ハードウェア試験に前記ハードウェアデバイスを使用しないことを示す情報を、前記制御レジスタの設定値として設定することにより、当該ハードウェアデバイスを前記オペレーティングシステムから隠蔽する、ことを特徴とする請求項1から5の何れか1項に記載の情報処理装置。 The hardware device includes a hard disk,
The information processing apparatus further includes a switch that controls whether to supply power to the hard disk, and a control register that stores a setting value for controlling the switch.
The concealment process sets information indicating that the hardware device is not used for the hardware test, which is included in the hardware configuration information, as a setting value of the control register. The information processing apparatus according to claim 1, wherein the information processing apparatus is concealed from an operating system.
前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽し、
前記オペレーティングシステムから隠蔽されていないハードウェアデバイスを用いて、ハードウェア試験を行う、ことを特徴とするハードウェア試験制御方法。 Control means for controlling the information processing apparatus, one or a plurality of hardware devices, a program for causing the control means to execute boot processing for booting an operating system, and hardware indicating a hardware configuration used for hardware testing A storage unit storing a hardware configuration information table including configuration information, and a hardware test control method for an information processing apparatus comprising:
According to the hardware configuration information, of the hardware devices, the hardware devices not used for the hardware test are hidden from the operating system,
A hardware test control method, wherein a hardware test is performed using a hardware device that is not hidden from the operating system.
前記ハードウェア構成情報に従って、前記ハードウェアデバイスのうち、前記ハードウェア試験に使用しないハードウェアデバイスを、前記オペレーティングシステムから隠蔽する処理を、実行させることを特徴とするプログラム。 Hardware configuration information including a processor, one or a plurality of hardware devices, a program for causing the processor to execute boot processing for booting an operating system, and hardware configuration information indicating a hardware configuration used for a hardware test An information processing apparatus including a memory for storing a table;
According to the hardware configuration information, a program causing a hardware device that is not used for the hardware test among the hardware devices to be hidden from the operating system.
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