JP5760360B2 - THIN FILM TRANSISTOR AND METHOD FOR PRODUCING THIN FILM TRANSISTOR - Google Patents

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Description

本発明は、薄膜トランジスタ及び薄膜トランジスタの製造方法に関する。   The present invention relates to a thin film transistor and a method for manufacturing the thin film transistor.

情報技術の目覚しい発展により、現在ではノート型パソコンや携帯情報端末などでの情報の送受信が頻繁に行われている。近い将来、場所を選ばずに情報をやり取りができるユビキタス社会が来るであろうことは周知の事実である。そのような社会においては、より軽量、薄型の情報端末が望まれる。   Due to the remarkable development of information technology, information is frequently sent and received at notebook computers and portable information terminals. It is a well-known fact that in the near future, a ubiquitous society where information can be exchanged regardless of location will come. In such a society, a lighter and thinner information terminal is desired.

現在、情報端末の半導体素子に用いられる半導体材料の主流はシリコン系であり、製造方法としては、シリコンをスパッタやCVD等のドライ法で成膜した後、フォトリソグラフィーを用いてパターンニングする方法が一般的である。   At present, the mainstream of semiconductor materials used for semiconductor elements of information terminals is silicon-based, and as a manufacturing method, there is a method of patterning using photolithography after silicon is formed by a dry method such as sputtering or CVD. It is common.

ところで、近年、溶剤を使うウェット法である印刷技術を用いて電子部材を製造するプリンタブルエレクトロニクスが注目されている。この印刷技術を用いることで、フォトリソグラフィーよりも装置や製造上のコストが下がり、また、真空や高温を必要としないことから、プラスチック基板が利用できるなどのメリットが挙げられる。   By the way, in recent years, printable electronics for producing electronic members using a printing technique which is a wet method using a solvent has attracted attention. By using this printing technique, there are advantages such that the cost of apparatus and manufacturing is lower than that of photolithography, and since a vacuum and high temperature are not required, a plastic substrate can be used.

この場合、半導体材料としては、有機溶媒に可溶な有機半導体材料や有機溶媒に分散させた酸化物半導体などを用いることが多く、これにより、半導体層を印刷法により形成できる。   In this case, as the semiconductor material, an organic semiconductor material that is soluble in an organic solvent or an oxide semiconductor dispersed in an organic solvent is often used, whereby a semiconductor layer can be formed by a printing method.

従来、例えば半導体層等に印刷法により形成する技術が提案されている。
例えば特許文献1では、インクジェット法により有機半導体層を形成しており、半導体層に有機半導体材料を用いた薄膜トランジスタ(以下、TFTとも呼ぶ)は特に有機TFTとも呼ばれる。TFTを構成する部材としては、半導体以外に電極や絶縁膜があるが、低コストなTFTを形成する上ではこれらも印刷法やコーディング技術などのウェット法を用いて形成されることが望まれる。
Conventionally, for example, a technique for forming a semiconductor layer or the like by a printing method has been proposed.
For example, in Patent Document 1, an organic semiconductor layer is formed by an inkjet method, and a thin film transistor (hereinafter, also referred to as a TFT) using an organic semiconductor material for the semiconductor layer is particularly referred to as an organic TFT. As a member constituting the TFT, there are an electrode and an insulating film in addition to the semiconductor. However, in order to form a low-cost TFT, it is desired that these are also formed using a wet method such as a printing method or a coding technique.

例えば特許文献2では、インクジェット法を用いて電極を形成しており、また、例えば特許文献3では、スピンコート法を用いてゲート絶縁膜を形成している。   For example, in Patent Document 2, an electrode is formed using an ink jet method, and in Patent Document 3, for example, a gate insulating film is formed using a spin coating method.

さらに、ウェット法を用いて電極を形成する場合に用いられる材料としては、例えば非特許文献1,2のように銀が最も一般的である。銀以外には、例えば非特許文献3のように銅や例えば非特許文献4のように導電性ポリマーを用いた例が挙げられる。   Furthermore, as a material used when forming an electrode using the wet method, silver is the most common as in Non-Patent Documents 1 and 2, for example. In addition to silver, examples include copper as in Non-Patent Document 3 and a conductive polymer as in Non-Patent Document 4, for example.

特開2005−210086号公報Japanese Patent Laid-Open No. 2005-210086 特開2004−297011号公報JP 2004-297011 A 特開2007−266355号公報JP 2007-266355 A

Proceedings of the National Academy of Sciences of the United States of America Vol.15 No.13(2008)4976Proceedings of the National Academy of Sciences of the United States of America, Vol. 15 No. 13 (2008) 4976 Applied Physics Letters 95, 253302(2009)Applied Physics Letters 95, 253302 (2009) Thin Solid Film Vo.515(2007)7706Thin Solid Film Vo. 515 (2007) 7706 Japanese Journal of Applied Physics Vol.44, No.6A(2005)3649Japan Journal of Applied Physics Vol. 44, no. 6A (2005) 3649

しかしながら、以上のように銀や銅を電極材料、特にソース・ドレイン電極に用いた場合には、マイグレーションにより両電極間でのリークやショートを引き起こすことが知られている。   However, as described above, when silver or copper is used for an electrode material, particularly a source / drain electrode, it is known that migration causes a leak or a short circuit between both electrodes.

そこで、マイグレーションを回避するために、電極材料に金を用いることが考えられるが、例えば金のナノ粒子を含むインキは非常に高価であり、また、硬化温度も高いためにフレキシブル基板の適用などは難しい。   Therefore, in order to avoid migration, it is conceivable to use gold as an electrode material. For example, ink containing gold nanoparticles is very expensive, and since the curing temperature is high, application of a flexible substrate is not possible. difficult.

さらに、銀や銅の代わりに導電性ポリマーを電極に用いることも考えられるが、導電率が不足しているため、微細な配線パターンでは配線抵抗が大きくなるという欠点がある。   Furthermore, it is conceivable to use a conductive polymer for the electrode instead of silver or copper. However, since the conductivity is insufficient, there is a drawback that the wiring resistance is increased in a fine wiring pattern.

本発明は上記事情に鑑みてなされたものであって、ウェット法により電極を形成した場合においても、マイグレーションによる不具合が起きず、配線抵抗も十分小さく、かつトランジスタ特性の優れた薄膜トランジスタ及び薄膜トランジスタの製造方法を提供することにある。   The present invention has been made in view of the above circumstances, and even when an electrode is formed by a wet method, a problem due to migration does not occur, wiring resistance is sufficiently small, and a thin film transistor and a thin film transistor having excellent transistor characteristics are manufactured. It is to provide a method.

上記課題を解決するために、本発明の第1の態様は、少なくとも基板上にゲート電極、ゲート絶縁膜、ソース電極及びドレイン電極、有機半導体層を有する薄膜トランジスタにおいて、前記ソース電極及び前記ドレイン電極が3層の積層体からなり、かつ該3層の積層体の膜厚が第1層目、第2層目、第3層目の順に薄くすることを特徴とする薄膜トランジスタである。 In order to solve the above problems, according to a first aspect of the present invention, in a thin film transistor having at least a gate electrode, a gate insulating film, a source electrode and a drain electrode, and an organic semiconductor layer on a substrate, the source electrode and the drain electrode are A thin film transistor comprising a three-layered structure, wherein the thickness of the three-layered structure decreases in the order of the first layer, the second layer, and the third layer.

本発明の第2の態様は、前記3層の積層体のうち、前記第1層目が銀もしくは銅であることを特徴とする第1の態様に記載の薄膜トランジスタである。 According to a second aspect of the present invention, there is provided the thin film transistor according to the first aspect , wherein the first layer of the three-layer laminate is silver or copper.

本発明の第3の態様は、前記3層の積層体のうち、前記第2層目が金であることを特徴とする第1の態様または第2の態様に記載の薄膜トランジスタである。 A third aspect of the present invention is the thin film transistor according to the first aspect or the second aspect , wherein the second layer of the three-layered laminate is gold.

本発明の第4の態様は、前記3層の積層体のうち、前記第3層目が自己組織化単分子膜であることを特徴とする第1の態様ないし第3の態様の何れか一項に記載の薄膜トランジスタである。 A fourth aspect of the present invention, among the stack of the three layers, the third layer is the first aspect to any one of the third aspect, which is a self-assembled monolayer The thin film transistor according to item.

本発明の第5の態様は、自己組織化単分子膜がチオール化合物からなることを特徴とする第4の態様に記載の薄膜トランジスタである。 A fifth aspect of the present invention is the thin film transistor according to the fourth aspect , wherein the self-assembled monolayer is made of a thiol compound.

本発明の第6の態様は、前記基板が可撓性の基板であることを特徴とする第1の態様ないし第5の態様の何れか一項に記載の薄膜トランジスタである。 A sixth aspect of the present invention is the thin film transistor according to any one of the first to fifth aspects , wherein the substrate is a flexible substrate.

本発明の第7の態様は、少なくとも基板上にゲート電極、ゲート絶縁膜、ソース電極及びドレイン電極、有機半導体層の順で形成される薄膜トランジスタの製造方法において、前記ソース電極及び前記ドレイン電極を3層の積層体とするとともに、当該3層の積層体のうち、第1層目を印刷法により形成することを特徴とする薄膜トランジスタの製造方法である。 According to a seventh aspect of the present invention, in the method of manufacturing a thin film transistor in which at least a gate electrode, a gate insulating film, a source electrode and a drain electrode, and an organic semiconductor layer are formed in this order on a substrate, the source electrode and the drain electrode are 3 A method for manufacturing a thin film transistor, characterized in that a first layer of the three-layer stack is formed by a printing method.

本発明の第8の態様は、前記印刷法がインクジェット法もしくは反転オフセット印刷法であることを特徴とする第7の態様に記載の薄膜トランジスタの製造方法である。 An eighth aspect of the present invention is the method for manufacturing a thin film transistor according to the seventh aspect , wherein the printing method is an inkjet method or a reverse offset printing method.

本発明の第9の態様は、前記3層の積層体のうち、第2層目をめっきにより形成することを特徴とする第7の態様に記載の薄膜トランジスタの製造方法である。 According to a ninth aspect of the present invention, in the thin film transistor manufacturing method according to the seventh aspect , the second layer of the three-layer laminate is formed by plating.

本発明の第10の態様は、前記有機半導体層を印刷法により形成することを特徴とする第7の態様に記載の薄膜トランジスタの製造方法である。 A tenth aspect of the present invention is the method of manufacturing a thin film transistor according to the seventh aspect , wherein the organic semiconductor layer is formed by a printing method.

本発明の第11の態様は、前記有機半導体層を形成する印刷法は、インクジェット法もしくは凸版印刷法であることを特徴とする第10の態様に記載の薄膜トランジスタの製造方法である。 An eleventh aspect of the present invention is the method of manufacturing a thin film transistor according to the tenth aspect , wherein the printing method for forming the organic semiconductor layer is an ink jet method or a relief printing method.

以上説明したように、本発明によれば、ソース・ドレイン電極を3層の積層体とすることで、マイグレーションによる不具合をなくすことができ、配線抵抗も十分小さくでき、かつトランジスタ特性(信号変換特性)の優れた薄膜トランジスタを得ることができる。   As described above, according to the present invention, the source / drain electrodes are made of a three-layered structure, so that problems due to migration can be eliminated, wiring resistance can be sufficiently reduced, and transistor characteristics (signal conversion characteristics) ) Excellent thin film transistor can be obtained.

本発明の第1の態様の効果は、ソース・ドレイン電極を3層の積層体とすることで、マイグレーションが抑制でき、配線抵抗を十分小さく保つことができ、トランジスタ特性の優れた薄膜トランジスタを得ることができる。また、第1層目、第2層目、第3層目の順に膜厚を薄くするように形成することで、第1層目にマグレーションの有無にかかわらず、導電性が高くコストも安い材料を用いて配線抵抗を小さくし、第2層目にマグレーションを引き起こさない材料で第1層目を被覆し、第3層目に有機半導体層とのコンタクトを改善させる薄膜を用いることができる。 The effect of the first aspect of the present invention is that a thin film transistor having excellent transistor characteristics can be obtained by making the source / drain electrodes into a three-layered structure so that migration can be suppressed, wiring resistance can be kept sufficiently small. Can do. Also, by forming the first layer, the second layer, and the third layer in order of decreasing film thickness, the first layer has high conductivity and low cost regardless of the presence or absence of the magnetization. It is possible to use a thin film that reduces the wiring resistance by using a material, covers the first layer with a material that does not cause magnetization on the second layer, and improves the contact with the organic semiconductor layer on the third layer. .

本発明の第2の態様の効果は、第1層目を導電率の高い銀もしくは銅とすることで、配線抵抗を小さくすることができ、かつ、比較的低い温度で焼成することが可能となり、可撓性を有する基板を用いることができる。 The effect of the second aspect of the present invention is that the first layer is made of silver or copper having high conductivity, so that the wiring resistance can be reduced and firing can be performed at a relatively low temperature. A flexible substrate can be used.

本発明の第3の態様の効果は、第2層目にマグレーションを引き起こさない金を用いることで、マイグレーションによる不具合をなくすことができる。また、第2層目は第1層目を覆っていればよく、膜厚も薄いことから金の消費量を少なくすることができ、ひいては低コストな薄膜トランジスタを得ることができる。 The effect of the 3rd aspect of this invention can eliminate the malfunction by migration by using the gold | metal | money which does not cause a magnetization in the 2nd layer. Further, the second layer only needs to cover the first layer, and since the film thickness is thin, the consumption of gold can be reduced, and thus a low-cost thin film transistor can be obtained.

本発明の第4の態様の効果は、前記3層の積層体のうち、前記第3層目に自己組織化単分子膜を用いることで、有機半導体層とソース・ドレイン電極とのコンタクトを改善することができ、ひいてはトランジスタ特性の良い薄膜トランジスタを得ることができる。 The effect of the fourth aspect of the present invention is that the contact between the organic semiconductor layer and the source / drain electrodes is improved by using a self-assembled monolayer for the third layer of the three-layered laminate. Thus, a thin film transistor with excellent transistor characteristics can be obtained.

本発明の第5の態様の効果は、自己組織化単分子膜がチオール化合物からなることで、第2層目に用いる金の表面に容易に結合させることができ、ソース・ドレイン電極とのコンタクトを容易に改善させることができる。 The effect of the fifth aspect of the present invention is that, since the self-assembled monolayer is made of a thiol compound, it can be easily bonded to the gold surface used for the second layer, and is in contact with the source / drain electrodes. Can be easily improved.

本発明の第6の態様の効果は、基板が可撓性を有することで、薄膜トランジスタも可撓性を有することができ、一般的に比較的低粘度な有機半導体溶液を用いて微細なパターンを得ることができる。 The effect of the sixth aspect of the present invention is that since the substrate has flexibility, the thin film transistor can also have flexibility, and a fine pattern is generally formed using an organic semiconductor solution having a relatively low viscosity. Can be obtained.

本発明の第7の態様の効果は、3層の積層体のうち、第1層目を印刷法により形成することで、真空装置やフォトリソグラフィーを必要としないために低コストな薄膜トランジスタを製造できる
本発明の第8の態様の効果は、第1層目の印刷法がインクジェット法もしくは反転オフセット印刷法とすることで、比較的粘度の低い金属粒子インクを用いて微細なパターンを形成することができる。
The effect of the seventh aspect of the present invention is that a low-cost thin film transistor can be manufactured by forming the first layer of the three-layered laminate by a printing method and thus does not require a vacuum device or photolithography.
The effect of the eighth aspect of the present invention is that a fine pattern can be formed by using a relatively low viscosity metal particle ink by using the ink jet method or the reverse offset printing method as the first layer printing method. it can.

本発明の第9の態様の効果は、前記3層の積層体のうち、第2層目をめっきにより形成することで、ウェット法を用いて第1層目を覆う形で第2層目を簡便に形成することができる。 The effect of the ninth aspect of the present invention is that the second layer is formed by plating the second layer of the three-layered laminate so as to cover the first layer using a wet method. It can be formed easily.

本発明の第10の態様の効果は、有機半導体層を印刷法により形成することで、低コストな薄膜トランジスタを得ることができる。 According to the tenth aspect of the present invention , a low-cost thin film transistor can be obtained by forming the organic semiconductor layer by a printing method.

本発明の第11の態様の効果は、前記有機半導体層の印刷法をインクジェット法もしくは凸版印刷法とすることで、一般的に比較的低粘度な有機半導体溶液を用いて微細なパターンを得ることができる。 The effect of the eleventh aspect of the present invention is that a fine pattern is generally obtained using an organic semiconductor solution having a relatively low viscosity by using an inkjet method or a relief printing method as the organic semiconductor layer printing method. Can do.

本発明に係る薄膜トランジスタ及びその製造方法の実施形態の一例を示す概略断面図。1 is a schematic cross-sectional view showing an example of an embodiment of a thin film transistor and a method for manufacturing the same according to the present invention. 従来の2層のソース・ドレイン電極を備えた薄膜トランジスタの概略断面図。FIG. 6 is a schematic cross-sectional view of a conventional thin film transistor provided with two layers of source / drain electrodes.

以下、本発明に係るの実施の形態について図面を参照して説明する。
図1は本発明に係る薄膜トランジスタの一実施形態を示す断面図である。
Embodiments of the present invention will be described below with reference to the drawings.
FIG. 1 is a sectional view showing an embodiment of a thin film transistor according to the present invention.

この薄膜トランジスタは、所定の基板10上に例えばフォトリソグラフィー及びエッチングによってゲート電極11を形成した後、基板10上のゲート電極11を覆うように所要のゲート絶縁材料を用いてゲート絶縁膜12を形成する。なお、図1では、ポトムゲート型の薄膜トランジスタの場合を示したが、本発明の薄膜トランジスタは、トップゲート型であってもよく、少なくともゲート電極、ゲート絶縁膜、ソース電極及びドレイン電極、有機半導体層を有する薄膜トランジスタであれば適用できる。   In this thin film transistor, after a gate electrode 11 is formed on a predetermined substrate 10 by, for example, photolithography and etching, a gate insulating film 12 is formed using a required gate insulating material so as to cover the gate electrode 11 on the substrate 10. . Note that FIG. 1 shows a case of a thin film transistor of a gate gate type, but the thin film transistor of the present invention may be a top gate type, and includes at least a gate electrode, a gate insulating film, a source electrode and a drain electrode, and an organic semiconductor layer. Any thin film transistor can be used.

ゲート絶縁膜12の上面には順次第1層目〜第3層目のソース・ドレイン電極13〜15を施した後、有機半導体層16を形成する。   The first to third source / drain electrodes 13 to 15 are sequentially formed on the upper surface of the gate insulating film 12, and then the organic semiconductor layer 16 is formed.

ここで、ソース・ドレイン電極13〜15を形成す3層の各膜厚は特に限定されるものではないが、配線抵抗やゲート絶縁膜12を介したリークなどを考慮すると、第1層目のソース・ドレイン電極13は、50nmから200nm程度が望ましい。   Here, the thickness of each of the three layers forming the source / drain electrodes 13 to 15 is not particularly limited. However, in consideration of wiring resistance and leakage through the gate insulating film 12, the first layer is formed. The source / drain electrode 13 is preferably about 50 nm to 200 nm.

次に、第2層目のソース・ドレイン電極14は、マイグレーションが起こらないよう第1層目のソース・ドレイン電極13の表面を覆うように形成し、少なくとも第1層目のソース・ドレイン電極13の厚さよりも薄くなるように形成することが望ましく、5nmから20nm程度が特に望ましい。   Next, the source / drain electrode 14 of the second layer is formed so as to cover the surface of the source / drain electrode 13 of the first layer so that migration does not occur, and at least the source / drain electrode 13 of the first layer is formed. It is desirable to form the film so as to be thinner than the thickness of about 5 nm to 20 nm.

そして、第3層目のソース・ドレイン電極15は、第3層目のソース・ドレイン電極15上に形成される有機半導体層16とのコンタクトを改善すればよく、具体的には1nm程度が特に望ましい。以上のように、第1〜第3の各層の厚さは徐々に薄くなるように形成することが望ましい。   The third-layer source / drain electrode 15 may be improved in contact with the organic semiconductor layer 16 formed on the third-layer source / drain electrode 15, and specifically about 1 nm. desirable. As described above, it is desirable that the thicknesses of the first to third layers be gradually reduced.

次に、各層のソース・ドレイン電極13〜15に用いる材料について説明する。   Next, materials used for the source / drain electrodes 13 to 15 of each layer will be described.

第1層目のソース・ドレイン電極13の材料は特に限定されるものではないが、第2層目のソース・ドレイン電極14の材料との関係を考慮しつつ選択する。第1層目のソース・ドレイン電極13としては、例えば金、銀、銅、アルミニウム、モリブデンなどの金属材料やインジウム錫酸化物などの酸化物材料、ポリ(エチレンジオキシチオフェン)/ポリスチレンスルホネート(PEDOT/PSS)やポリアニリンなどの導電性高分子などを用いることができる。   The material of the source / drain electrode 13 of the first layer is not particularly limited, but is selected in consideration of the relationship with the material of the source / drain electrode 14 of the second layer. As the source / drain electrodes 13 of the first layer, for example, metal materials such as gold, silver, copper, aluminum and molybdenum, oxide materials such as indium tin oxide, poly (ethylenedioxythiophene) / polystyrene sulfonate (PEDOT) / PSS) or conductive polymers such as polyaniline can be used.

印刷法により第1層目を形成する場合には、銀や銅などのナノ粒子や導電性高分子を分散させた溶液などを用いることができるが、第2層目をめっきにより形成する場合には、銀や銅を用いるのが好ましい。   When the first layer is formed by a printing method, a solution in which nanoparticles such as silver or copper or a conductive polymer is dispersed can be used. However, when the second layer is formed by plating. It is preferable to use silver or copper.

なお、印刷法は特に限定されるものではなく、インクジェット法や反転オフセット印刷法、スクリーン印刷法、凸版印刷法、グラビア印刷法などを用いることができる。   Note that the printing method is not particularly limited, and an inkjet method, a reverse offset printing method, a screen printing method, a relief printing method, a gravure printing method, or the like can be used.

次に、第2層目のソース・ドレイン電極14の材料は特に限定されるものではなく、金、銀、銅、アルミニウム、モリブデンなどの金属材料やインジウム錫酸化物などの酸化物材料、ポリ(エチレンジオキシチオフェン)/ポリスチレンスルホネート(PEDOT/PSS)やポリアニリンなどの導電性高分子などを用いることができるが、マイグレーションを起す恐れがある銀や銅は好適ではなく、金が好ましい。めっきにより第2層目を形成する場合には、電界めっきや無電界めっきなどを適宜用いることができる。   Next, the material of the source / drain electrode 14 of the second layer is not particularly limited, and a metal material such as gold, silver, copper, aluminum, molybdenum, an oxide material such as indium tin oxide, poly ( Conductive polymers such as ethylenedioxythiophene) / polystyrene sulfonate (PEDOT / PSS) and polyaniline can be used, but silver or copper which may cause migration is not preferable, and gold is preferable. When the second layer is formed by plating, electroplating or electroless plating can be used as appropriate.

さらに、第3層目のソース・ドレイン電極15の材料は特に限定されるものではないが、第2層目に金を用いた場合にはチオール化合物やジスルフィド化合物、スルフィド化合物などを用いることで容易に自己組織化単分子膜が形成できるため、これらの化合物を用いることが望ましい。処理方法は、前述した化合物を適宜溶媒に溶解させた液体を用いるウェット法、前記化合物の蒸気を利用するドライ法などを用いることができる。   Furthermore, the material of the source / drain electrode 15 of the third layer is not particularly limited. However, when gold is used for the second layer, it is easy to use a thiol compound, a disulfide compound, a sulfide compound, or the like. It is desirable to use these compounds because a self-assembled monolayer can be formed. As a treatment method, a wet method using a liquid in which the above-described compound is appropriately dissolved in a solvent, a dry method using vapor of the compound, or the like can be used.

化合物の一例としては、ベンゼンチオール、クロロベンゼンチオール、ブロモベンゼンチオール、フルオロベンゼンチオール、ペンタフルオロベンゼンチオール、ペンタクロロベンゼンチオール、ニトロチオフェノール、2−メルカプト−5−ニトロベンズイミダゾール、パーフルオロデカンチオール、ペンタフルオロチオフェノール等のチオール化合物、ジフェニルジスルフィド等のジスルフィド化合物、ジフェニルスルフィド等のスルフィド化合物などが挙げられる。   Examples of compounds include benzenethiol, chlorobenzenethiol, bromobenzenethiol, fluorobenzenethiol, pentafluorobenzenethiol, pentachlorobenzenethiol, nitrothiophenol, 2-mercapto-5-nitrobenzimidazole, perfluorodecanethiol, pentafluoro Examples include thiol compounds such as thiophenol, disulfide compounds such as diphenyl disulfide, and sulfide compounds such as diphenyl sulfide.

次に、有機半導体層16について説明する。
半導体材料は特に限定されるものではないが、フレキシブルな基板を用いるためには有機半導体材料や酸化物半導体材料を用いることが望ましく、特に印刷法を用いて半導体層16を形成する際には、有機半導体材料が好ましいが、印刷法により形成できれば酸化物半導体材料であってもよい。
Next, the organic semiconductor layer 16 will be described.
The semiconductor material is not particularly limited, but it is desirable to use an organic semiconductor material or an oxide semiconductor material in order to use a flexible substrate, and particularly when the semiconductor layer 16 is formed using a printing method. An organic semiconductor material is preferable, but an oxide semiconductor material may be used as long as it can be formed by a printing method.

有機半導体材料としては、ポリチオフェン、ポリアリルアミン、フルオレンビチオフェン共重合体、およびそれらの誘導体のような高分子有機半導体材料、およびペンタセン、テトラセン、銅フタロシアニン、ペリレン、およびそれらの誘導体のような低分子有機半導体材料を用いることができる。また、カーボンナノチューブあるいはフラーレンなどの炭素化合物や半導体ナノ粒子分散液なども半導体層の材料として用いることができる。これらの有機半導体材料はトルエンなどの芳香族系の溶媒に溶解又は分散させてインキ状の溶液又は分散液として用いることができ、溶媒に適当な分散剤や安定剤等の添加剤を加えてもよい。   Organic semiconductor materials include high molecular organic semiconductor materials such as polythiophene, polyallylamine, fluorenebithiophene copolymers, and derivatives thereof, and small molecules such as pentacene, tetracene, copper phthalocyanine, perylene, and derivatives thereof. Organic semiconductor materials can be used. Carbon compounds such as carbon nanotubes or fullerenes, semiconductor nanoparticle dispersions, and the like can also be used as the material for the semiconductor layer. These organic semiconductor materials can be dissolved or dispersed in an aromatic solvent such as toluene and used as an ink-like solution or dispersion. Even if an additive such as a suitable dispersant or stabilizer is added to the solvent. Good.

有機半導体の印刷方法としては、グラビア印刷、オフセット印刷、スクリーン印刷およびインクジェット法など、公知の方法を用いることができる。一般に、上記の有機半導体に関しては、溶剤に対する溶解度が低いため、低粘度溶液の印刷に適したフレキソ印刷、反転オフセット印刷、インクジェット法、ディスペンサを用いることが望ましい。特にフレキソ印刷は、印刷時間が短くインク使用量が少ないので最も好ましい。   As a method for printing the organic semiconductor, known methods such as gravure printing, offset printing, screen printing, and ink jet method can be used. In general, since the organic semiconductor has low solubility in a solvent, it is desirable to use flexographic printing, reverse offset printing, an inkjet method, and a dispenser suitable for printing a low-viscosity solution. In particular, flexographic printing is most preferable because the printing time is short and the amount of ink used is small.

酸化物半導体材料としては、例えば、亜鉛、インジウム、スズ、タングステン、マグネシウム、ガリウムのうち一種類以上の元素を含む酸化物が挙げられる。酸化亜鉛、酸化インジウム、酸化インジウム亜鉛、酸化スズ、酸化タングステン、酸化亜鉛ガリウムインジウム(In―Ga―Zn―O)等公知の材料が挙げられるが、これらの材料に限定されるものではない。これらの材料の構造は単結晶、多結晶、微結晶、結晶/アモルファスの混晶、ナノ結晶散在アモルファス、アモルファスのいずれであってもかまわない。   As the oxide semiconductor material, for example, an oxide containing one or more elements of zinc, indium, tin, tungsten, magnesium, and gallium can be given. Known materials such as zinc oxide, indium oxide, indium zinc oxide, tin oxide, tungsten oxide, and zinc gallium indium oxide (In—Ga—Zn—O) can be mentioned, but are not limited to these materials. The structure of these materials may be single crystal, polycrystal, microcrystal, crystal / amorphous mixed crystal, nanocrystal scattered amorphous, or amorphous.

酸化物半導体層の形成方法としては、スパッタリング法、パルスレーザ堆積法、真空蒸着法、CVD法、ゾルゲル法などの方法を用いて成膜した後に、フォトリソグラフィー法やリフトオフ法などを用いてパターンを形成することができるが、酸化物半導体材料を溶媒に分散させた分散液を印刷法により形成することがより好ましい。印刷法としては有機半導体の印刷法で述べたものと同様の方法を用いることができる。   As a method for forming the oxide semiconductor layer, after forming a film using a sputtering method, a pulse laser deposition method, a vacuum evaporation method, a CVD method, a sol-gel method, or the like, a pattern is formed using a photolithography method, a lift-off method, or the like. Although it can be formed, it is more preferable to form a dispersion in which an oxide semiconductor material is dispersed in a solvent by a printing method. As the printing method, the same method as described in the organic semiconductor printing method can be used.

ゲート絶縁膜12の材料としては、特に限定されるものではないが、一般に用いられるポリビニルフェノール、ポリメタクリル酸メチル、ポリイミド、ポリビニルアルコール、パリレン、フッ素樹脂、エポキシ樹脂などの高分子溶液、アルミナやシリカゲルなどの粒子を分散させた溶液、酸化シリコン、窒化シリコン、シリコンオキシナイトライド、酸化アルミニウム、酸化タンタル、酸化イットリウム、酸化ハフニウム、ハフニウムアルミネート、酸化ジルコニア、酸化チタン等の無機材料などがある。また、PETやPEN、PESなどの薄膜フィルムを絶縁膜として用いることもできる。   The material of the gate insulating film 12 is not particularly limited, but generally used polymer solutions such as polyvinyl phenol, polymethyl methacrylate, polyimide, polyvinyl alcohol, parylene, fluororesin, epoxy resin, alumina and silica gel And a solution in which particles such as silicon oxide, silicon oxide, silicon nitride, silicon oxynitride, aluminum oxide, tantalum oxide, yttrium oxide, hafnium oxide, hafnium aluminate, zirconia oxide, and titanium oxide are used. Moreover, thin film films, such as PET, PEN, and PES, can also be used as an insulating film.

ゲート絶縁膜12の形成方法としては特に限定されるものではなく、真空蒸着法やスパッタリング法、CVDなどのドライ法やスピンコート、スリットダイなどのウェット法、ラミネートなどの方法を適宜用いることができる。   The method for forming the gate insulating film 12 is not particularly limited, and a vacuum deposition method, a sputtering method, a dry method such as CVD, a wet method such as spin coating or a slit die, or a method such as lamination can be appropriately used. .

基板10に用いる材料は、特に限定されるものではなく、一般に用いられる材料として、例えばポリエチレンテレフタレート(PET)やポリイミド、ポリエーテルスルホン(PES)、ポリエチレンナフタレート(PEN)、ポリカーボネートなどのフレキシブルなプラスチック材料、石英などのガラス基板やシリコンウェハーなどがある。しかしながら、TFTのフレキシブル化やTFT製造工程における各プロセス温度などを考慮すると、基板としてPENやポリイミドなどを用いることが望ましい。   The material used for the substrate 10 is not particularly limited. Examples of commonly used materials include flexible plastics such as polyethylene terephthalate (PET), polyimide, polyethersulfone (PES), polyethylene naphthalate (PEN), and polycarbonate. Materials include glass substrates such as quartz and silicon wafers. However, considering the flexibility of the TFT and the process temperatures in the TFT manufacturing process, it is desirable to use PEN, polyimide, or the like as the substrate.

さらに、本発明の薄膜トランジスタには、必要に応じて封止層、遮光層などを好適に設けることができる。封止層の材料としてはゲート絶縁膜12の材料と同一の材料から選択して用いることができ、遮光層はゲート材料12に記載されている材料にカーボンブラック等の遮光性材料を分散させたものを用いることができる。そのため、これらの形成方法もゲート絶縁膜12と同一の方法を用いることができる。   Furthermore, the thin film transistor of the present invention can be suitably provided with a sealing layer, a light shielding layer, and the like as necessary. The material for the sealing layer can be selected from the same material as the material for the gate insulating film 12, and the light shielding layer has a light shielding material such as carbon black dispersed in the material described in the gate material 12. Things can be used. Therefore, the same method as that for the gate insulating film 12 can be used for these formation methods.

以下、本発明に係る薄膜トランジスタの具体的な実施例について説明する。なお、本発明は各実施例に限るものではない。   Specific examples of the thin film transistor according to the present invention will be described below. Note that the present invention is not limited to each embodiment.

図1を参照しながら本実施例1について説明する。
図1に示すボトムゲート・ボトムコンタクト型薄膜トランジスタである。
この薄膜トランジスタは、ベースとなる基板10にポリエチレンナフタレート(PEN)フィルム(帝人デュポン製)を用いた。
The first embodiment will be described with reference to FIG.
2 is a bottom-gate / bottom-contact thin film transistor shown in FIG.
In this thin film transistor, a polyethylene naphthalate (PEN) film (manufactured by Teijin DuPont) was used for the base substrate 10.

基板10上にアルミニウムをスパッタリングにて100nm成膜し、フォトリソグラフィー及びエッチング処理によりパターニングしてゲート電極11を作製した。   A gate electrode 11 was fabricated by depositing aluminum with a thickness of 100 nm on the substrate 10 by sputtering and patterning it by photolithography and etching.

次に、ゲート電極11を覆うようにゲート絶縁膜12を作製する。ゲート絶縁材料としてポリビニルフェノール(Aldrich製)を用い、ゲート電極11を含む基板10上にスピンコート法により膜厚1μmのゲート絶縁膜12を作製した。   Next, the gate insulating film 12 is formed so as to cover the gate electrode 11. Polyvinylphenol (manufactured by Aldrich) was used as the gate insulating material, and a gate insulating film 12 having a thickness of 1 μm was formed on the substrate 10 including the gate electrode 11 by spin coating.

続いて、ゲート絶縁膜12上に3層からなるソース・ドレイン電極13〜15を以下の順に作製する。   Subsequently, source / drain electrodes 13 to 15 having three layers are formed on the gate insulating film 12 in the following order.

まず、第1層目のソース・ドレイン電極13は、反転オフセット印刷法によりナノ銀インキをゲート絶縁膜12上の所定位置に印刷して、180℃で1時間ベークして形成した。   First, the source / drain electrode 13 of the first layer was formed by printing nano silver ink at a predetermined position on the gate insulating film 12 by reverse offset printing and baking at 180 ° C. for 1 hour.

次に、第2層目のソース・ドレイン電極14は、金を無電界めっきにより第1層目のソース・ドレイン電極13上を覆うように形成した。   Next, the source / drain electrode 14 of the second layer was formed so as to cover the source / drain electrode 13 of the first layer by electroless plating.

次に、第3層目のソース・ドレイン電極15は、ペンタフルオロチオフェノールをイソプロピルアルコールで1重量%に希釈した溶液に30分浸漬させ、第2層目のソース・ドレイン電極14上に自己組織化単分子膜を作製した。
続いて、3層からなるソース・ドレイン電極間に有機半導体層16を形成する。
Next, the source / drain electrode 15 of the third layer is immersed in a solution of pentafluorothiophenol diluted to 1% by weight with isopropyl alcohol for 30 minutes, and self-organized on the source / drain electrode 14 of the second layer. A monolayer was prepared.
Subsequently, an organic semiconductor layer 16 is formed between the source / drain electrodes composed of three layers.

半導体材料としては、有機半導体材料であるLisicon SP200(Merck製)をテトラリン(関東化学製)で2重量%になるように溶解させた溶液をインクジェット法により、第3層目のソース・ドレイン電極15上の一部を覆うようにしてソース・ドレイン電極間に印刷し、90℃で3時間乾燥させて有機半導体層16を作製した。   As the semiconductor material, a solution obtained by dissolving Lisicon SP200 (made by Merck), which is an organic semiconductor material, with tetralin (made by Kanto Chemical Co., Ltd.) so as to be 2% by weight is formed by the inkjet method, and the source / drain electrodes 15 of the third layer The organic semiconductor layer 16 was produced by printing between the source and drain electrodes so as to cover a part of the upper part and drying at 90 ° C. for 3 hours.

以上のようにして作製した薄膜トランジスタの駆動安定性を調べるため、ゲート電極にプラス20Vからマイナス20Vの矩形波を周波数50Hz、Duty比5%で印加し、ドレイン電極にマイナス15Vの電圧を印加し、ソース電流を測定したところ、7日後にもソース・ドレイン電極間のショートは発生しなかった。   In order to investigate the driving stability of the thin film transistor manufactured as described above, a rectangular wave of plus 20 V to minus 20 V is applied to the gate electrode at a frequency of 50 Hz and a duty ratio of 5%, a voltage of minus 15 V is applied to the drain electrode, When the source current was measured, no short circuit occurred between the source and drain electrodes even after 7 days.

実施例2では、第1層目のソース・ドレイン電極13として銅を用いた以外は実施例1と同様にして薄膜トランジスタを形成した。このようにして作製した薄膜トランジスタの駆動安定性を調べるため、ゲート電極にプラス20Vからマイナス20Vの矩形波を周波数50Hz、Duty比5%で印加し、ドレイン電極にマイナス15Vの電圧を印加し、ソース電流を測定したところ、7日後にもソース・ドレイン電極間のショートは発生しなかった。   In Example 2, a thin film transistor was formed in the same manner as in Example 1 except that copper was used as the source / drain electrode 13 of the first layer. In order to investigate the driving stability of the thin film transistor thus fabricated, a rectangular wave of plus 20 V to minus 20 V is applied to the gate electrode at a frequency of 50 Hz and a duty ratio of 5%, a voltage of minus 15 V is applied to the drain electrode, When the current was measured, no short circuit between the source and drain electrodes occurred even after 7 days.

(比較例1)
一方、前述した実施例1,2と比較するために、図2のように第2層目のソース・ドレイン電極14を作製せずに、第1層目のソース・ドレイン電極13上に実施例の第3層目のソース・ドレイン電極15に相当するペンタフルオロチオフェノールの自己組織化単分子膜を形成したこと以外は実施例1と同様にして薄膜トランジスタを形成した。
(Comparative Example 1)
On the other hand, in order to compare with the first and second embodiments, the second layer source / drain electrode 14 is not formed as shown in FIG. A thin film transistor was formed in the same manner as in Example 1 except that a self-assembled monomolecular film of pentafluorothiophenol corresponding to the third layer source / drain electrode 15 was formed.

このようにして作製した薄膜トランジスタの駆動安定性を調べるため、ゲート電極にプラス20Vからマイナス20Vの矩形波を周波数50Hz、Duty比5%で印加し、ドレイン電極にマイナス15Vの電圧を印加し、ソース電流を測定したところ、12時間後にソース・ドレイン電極間にショートが発生し、顕微鏡観察を行ったところ銀のマイグレーションが確認された。   In order to investigate the driving stability of the thin film transistor thus fabricated, a rectangular wave of plus 20 V to minus 20 V is applied to the gate electrode at a frequency of 50 Hz and a duty ratio of 5%, a voltage of minus 15 V is applied to the drain electrode, When the current was measured, a short circuit occurred between the source and drain electrodes after 12 hours, and silver migration was confirmed by microscopic observation.

その他、本発明は、上記実施形態及び実施例に限定されることなく、その要旨を逸脱しない範囲で種々変形して実施できる。   In addition, the present invention is not limited to the above-described embodiments and examples, and various modifications can be made without departing from the scope of the invention.

10…基板、11…ゲート電極、12…ゲート絶縁膜、13…第1層目のソース・ドレイン電極、14…第2層目のソース・ドレイン電極、15…第3層目のソース・ドレイン電極、16…有機半導体層。   DESCRIPTION OF SYMBOLS 10 ... Substrate, 11 ... Gate electrode, 12 ... Gate insulating film, 13 ... First layer source / drain electrode, 14 ... Second layer source / drain electrode, 15 ... Third layer source / drain electrode 16 ... Organic semiconductor layer.

Claims (5)

少なくとも基板上にゲート電極、ゲート絶縁膜、ソース電極及びドレイン電極、有機半導体層を有する薄膜トランジスタにおいて、
前記ソース電極及び前記ドレイン電極が3層の積層体からなり、かつ該3層の積層体の膜厚が第1層目、第2層目、第3層目の順に薄くし、
前記3層の積層体のうち、前記第1層目が銀である
ことを特徴とする薄膜トランジスタ。
In a thin film transistor having at least a gate electrode, a gate insulating film, a source electrode and a drain electrode, and an organic semiconductor layer on a substrate,
The source electrode and the drain electrode are composed of a three-layer laminate, and the thickness of the three-layer laminate is reduced in order of the first layer, the second layer, and the third layer,
The thin film transistor, wherein the first layer of the three-layer stack is silver.
前記3層の積層体のうち、前記第2層目が金であることを特徴とする請求項1に記載の薄膜トランジスタ。   2. The thin film transistor according to claim 1, wherein the second layer of the three-layer stack is gold. 前記3層の積層体のうち、前記第3層目が自己組織化単分子膜であることを特徴とする請求項1または請求項2に記載の薄膜トランジスタ。   3. The thin film transistor according to claim 1, wherein the third layer of the three-layer stack is a self-assembled monomolecular film. 4. 前記自己組織化単分子膜がチオール化合物からなることを特徴とする請求項3に記載の薄膜トランジスタ。   The thin film transistor according to claim 3, wherein the self-assembled monolayer is made of a thiol compound. 前記基板としては、可撓性の基板であることを特徴とする請求項1ないし請求項4の何れか一項に記載の薄膜トランジスタ。   The thin film transistor according to any one of claims 1 to 4, wherein the substrate is a flexible substrate.
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