JP5746771B2 - 低電力スタンバイモード制御回路用装置 - Google Patents
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Description
本出願は、2011年2月7日に出願された米国仮出願61/440,131の関連出願であり、当該仮出願に対する優先権を主張し、かかる仮出願は引用により本明細書に組み込まれる。
(技術分野)
本発明の実施形態は全体的に、電子デバイスの分野に関し、より詳細には、低電力スタンバイモード制御回路用装置に関する。
(1)チップがスタンバイモードに入り、すなわち、Vccが0Vに移行し、LPSBVは3.3Vである。
(2)CBUS_HPDパッド(図2及び3を参照)にてスティミュラス信号を受け取るまでスタンバイモードで待機し、以下の動作を行う。
(a)LP_POCがhighになり、次いでLPSBがhighになる。
(b)CBUS_HPDはlowであり、LPCTRLをhighにし、INTをlowにする(回路315)。
(3)CBUS_HPDがlowからhighに移行すると、
(a)LPCTRLがlowになり、INTがlowからhighになる。
(b)システム基板上のMICOMがこの信号を検出し、チップで通常電力を生成するコマンドを提供する。
(c)RPWR、SBVCC5、Vccが通常動作値に移行し、LP_POCがlowになる。
(4)図2に示すように、LPCTRLは全てのポートにおいてワイヤードOR回路であるので、ポートの1つがスタンバイモードからのウェークアップスティミュラス信号を検出した場合、チップは、ウェークアップ手順を開始する。
100:MHLシンク
110:MHLトランスミッタ
115:MHLケーブル
120:MHLケーブル検出
125:メインプロセッサ
130:スタンバイプロセッサ
135:MHL抵抗
Claims (17)
- プロセッサと、
第2の装置とケーブル接続するためのインタフェースと、
前記インタフェースにおいて前記第2の装置とケーブル接続されたことを検出する検出要素と、
演算回路と、
を備えた装置であって、前記プロセッサが、スタンバイモードにおいて前記演算回路への1つ又はそれ以上の電源接続部をディスエーブルにするものであり、
前記装置が更に、
スタンバイ電力源を用いて作動するスタンバイモード制御回路を備え、
該スタンバイモード制御回路が、前記第2の装置からのスティミュラス信号を検出し、該スティミュラス信号に応答して前記プロセッサに信号を送り、前記プロセッサが前記演算回路の1つ又はそれ以上の電源接続部をイネーブルにするようにし、
前記スティミュラス信号は、前記検出要素が前記ケーブル接続を検出したことに関連して、前記演算回路と結合されている制御バス上で受信される、装置。 - 前記演算回路が、レシーバチップである、請求項1に記載の装置。
- 前記装置が、MHL(モバイル・ハイデフニション・リンク)互換デバイスである、請求項1に記載の装置。
- 前記演算回路が、複数のトランジスタ素子を含み、前記1つ又はそれ以上の電源接続部がディスエーブルにされたときに前記トランジスタ素子がディスエーブルにされる、請求項1に記載の装置。
- 前記演算回路が、スタンバイモードにおいて電源ダウン状態にされる、請求項1に記載の装置。
- 前記制御バスと前記演算回路とを接続する第1のスイッチを備え、
前記第1のスイッチは、前記検出要素が前記ケーブル接続を検出したことに応じて有効となる、請求項1に記載の装置。 - 前記スティミュラス信号は、前記制御バス上における電圧レベルの変化である、請求項1に記載の装置。
- 装置又はシステムをスタンバイモードに移行させる段階と、
演算回路への1つ又はそれ以上の電源接続部をプロセッサによってディスエーブルにする段階と、
スタンバイモード制御回路をスタンバイ電力源により作動させる段階と、
検出要素にて、第2の装置又は第2のシステムとケーブル接続されたことを検出する段階と、
前記スタンバイモード制御回路にて前記第2の装置又は第2のシステムからスティミュラス信号を受け取る段階と、
前記スティミュラス信号に応答して、前記スタンバイモード制御回路から前記プロセッサへの信号を生成し、前記スタンバイモード制御回路からの信号に応答して、前記プロセッサが前記1つ又はそれ以上の電源接続部をイネーブルにする段階と、を含み、
前記スティミュラス信号は、前記検出要素が前記ケーブル接続を検出したことに関連して、前記演算回路と結合されている制御バス上で受信される、方法。 - 前記1つ又はそれ以上の電源接続部をディスエーブルにすることにより、前記演算回路が電源オフモードになる、請求項8に記載の方法。
- スタンバイモードの前記演算回路の複数のトランジスタをディスエーブルにすることにより、前記装置又はシステムの漏洩電流消費量を低減する段階を更に含む、請求項8に記載の方法。
- 前記演算回路がレシーバチップである、請求項8に記載の方法。
- 前記装置又はシステムがMHL(モバイル・ハイデフニション・リンク)互換装置又はシステムである、請求項8に記載の方法。
- 一連の命令を表すデータを格納させた非一時的コンピュータ可読記憶媒体であって、前記命令が、プロセッサによって実行されたときに、
装置又はシステムをスタンバイモードに移行させる段階と、
演算回路への1つ又はそれ以上の電源接続部をプロセッサによってディスエーブルにする段階と、
スタンバイモード制御回路をスタンバイ電力源により作動させる段階と、
検出要素にて、第2の装置又は第2のシステムとケーブル接続されたことを検出する段階と、
前記スタンバイモード制御回路にて前記第2の装置又は第2のシステムからスティミュラス信号を受け取る段階と、
前記スティミュラス信号に応答して、前記スタンバイモード制御回路から前記プロセッサへの信号を生成し、前記スタンバイモード制御回路からの信号に応答して、前記プロセッサが前記1つ又はそれ以上の電源接続部をイネーブルにする段階と、
を含む動作を前記プロセッサに実施させ、
前記スティミュラス信号は、前記検出要素が前記ケーブル接続を検出したことに関連して、前記演算回路と結合されている制御バス上で受信される、媒体。 - 前記1つ又はそれ以上の電源接続部をディスエーブルにすることにより、前記演算回路が電源オフモードになる、請求項13に記載の媒体。
- 前記プロセッサによって実行されたときに、スタンバイモードの前記演算回路の複数のトランジスタをディスエーブルにすることにより、前記装置又はシステムの漏洩電流消費量を低減する段階を含む動作を前記プロセッサに実施させる命令を更に含む、請求項13に記載の媒体。
- 前記演算回路がレシーバチップである、請求項13に記載の媒体。
- 前記装置又はシステムがMHL(モバイル・ハイデフニション・リンク)互換装置又はシステムである、請求項13に記載の媒体。
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