JP4123225B2 - Distortion compensation amplifier - Google Patents

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JP4123225B2 JP2004344085A JP2004344085A JP4123225B2 JP 4123225 B2 JP4123225 B2 JP 4123225B2 JP 2004344085 A JP2004344085 A JP 2004344085A JP 2004344085 A JP2004344085 A JP 2004344085A JP 4123225 B2 JP4123225 B2 JP 4123225B2
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Description

この発明は、移動体通信基地局や多機能レーダ装置などに使用される電力増幅器等の非線形増幅回路における歪み成分を補償する歪補償増幅器に係り、特に少ないビット数のアナログディジタル変換器(A/D変換器)を使用して広範な入力信号のダイナミックレンジに対応可能な歪補償増幅器に関する。 The present invention relates to a distortion compensation amplifier that compensates for distortion components in a nonlinear amplifier circuit such as a power amplifier used in a mobile communication base station, a multi-function radar apparatus, and the like, and more particularly, an analog-digital converter (A / A) having a small number of bits. The present invention relates to a distortion compensation amplifier that can handle a wide dynamic range of input signals using a D converter.

一般に、各種の通信システムに用いられる電力増幅器では、増幅器の非線形に起因する増幅信号の歪みを補償するために、アダプティブプリディスト−タ等の歪み補償回路を用いることにより、増幅信号の歪みを補償することが行われている。 In general, in power amplifiers used in various communication systems, distortion of an amplified signal is compensated by using a distortion compensation circuit such as an adaptive predistorter in order to compensate for distortion of the amplified signal caused by nonlinearity of the amplifier. To be done.

特開2004−32252号公報図1にはディジタルプリディストータ型の歪補償送信装置に関し、DA変換器のダイナミックレンジ最大範囲までを有効に活用してディジタル信号をアナログ信号に変換する回路が開示されている。 FIG. 1 discloses a circuit for converting a digital signal to an analog signal by effectively utilizing the dynamic range of the DA converter up to the maximum dynamic range of the DA converter. ing.

すなわち、特開2004−32252号公報図1において、DA変換器7−4に入力される送信信号の振幅レベルの最大値を最大値検出部1−1により検出し、閾値比較部1−2によるこの最大値と閾値との大小比較判定を基に、DA変換器7−4の入力信号の最大値が、DA変換器7−4のダイナミックレンジの最大値と略等しくなるよう、第1のゲイン制御部1−3でDA変換器7−4の入力信号のゲイン調整を行なう。また、DA変換器7−4から出力されるアナログ信号に対して、第2のゲイン調整部1−5で可変減衰器1−6の減衰量を設定し、元の振幅に戻して電力増幅器等のアナログ送信回路部7−5に入力している。 That is, in FIG. 1 of Japanese Patent Application Laid-Open No. 2004-32252, the maximum value of the amplitude level of the transmission signal input to the DA converter 7-4 is detected by the maximum value detector 1-1, and the threshold value comparator 1-2. The first gain is set so that the maximum value of the input signal of the DA converter 7-4 is substantially equal to the maximum value of the dynamic range of the DA converter 7-4 based on the comparison of the maximum value and the threshold. The controller 1-3 adjusts the gain of the input signal of the DA converter 7-4. Further, with respect to the analog signal output from the DA converter 7-4, the attenuation amount of the variable attenuator 1-6 is set by the second gain adjusting unit 1-5, and the original amplitude is restored to a power amplifier or the like. To the analog transmission circuit section 7-5.

また、特開2002−111401号公報図1にはビット精度が相対的に低く、動作周波数も相対的に低いアナログ・ディジタル変換器を用いることができる歪補償装置が開示されている。 Japanese Laid-Open Patent Publication No. 2002-111401 discloses a distortion compensation apparatus that can use an analog / digital converter with relatively low bit accuracy and relatively low operating frequency.

すなわち、特開2002−111401号公報図1において、ディジタル入力信号Xi,Xqは、乗算器31で歪補償係数記憶部33の歪補償係数と乗算された後、変調/増幅部1で処理され、アナログ出力信号Zとして送信される。一方、アナログ送信信号Zは、フィードバックされ、減算器43、ミクサ41、直交復調器39等で処理された後、減算器35i,35qに与えられる。減算器35i,35qは、アナログ入力信号Xi,Xqとアナログ・フィードバック信号Yi,Yqとの差(誤差)を求め、このアナログ誤差信号をADC36i,36qに与える。ADC36i,36qは、アナログ誤差信号をデジタル信号に変換し歪補償係数演算部5に与える。歪補償係数演算部5は、新たな歪補償係数を求め歪補償係数記憶部33を更新している。 That is, in FIG. 1 of Japanese Patent Application Laid-Open No. 2002-111401, digital input signals Xi and Xq are multiplied by a distortion compensation coefficient in a distortion compensation coefficient storage unit 33 by a multiplier 31 and then processed by a modulation / amplification unit 1. It is transmitted as an analog output signal Z. On the other hand, the analog transmission signal Z is fed back, processed by the subtractor 43, the mixer 41, the quadrature demodulator 39, etc., and then given to the subtractors 35i and 35q. The subtractors 35i and 35q obtain differences (errors) between the analog input signals Xi and Xq and the analog feedback signals Yi and Yq, and supply the analog error signals to the ADCs 36i and 36q. The ADCs 36 i and 36 q convert the analog error signal into a digital signal and give it to the distortion compensation coefficient calculation unit 5. The distortion compensation coefficient calculation unit 5 obtains a new distortion compensation coefficient and updates the distortion compensation coefficient storage unit 33.

特開2004−32252号公報JP 2004-32252 A

特開2002−111401号公報JP 2002-111401 A

特開2004−32252号公報図1では、DA変換器のダイナミックレンジ最大範囲までを有効に活用することが開示されているものの、動作周波数やそのスルーレート及びアナログ入力のダイナミックレンジにより精度がDA変換器以上に要求されるAD変換器については言及されていない。また、特開2002−111401号公報図1では、ディジタル入力信号をアナログ信号に変換し、アナログ入力信号と増幅器のアナログ出力信号との差分から増幅器の歪成分をアナログ領域で求め、その後歪成分をディジタル化するため、分岐した入力信号を一旦DA変換する必要があり、構成が複雑になると言う問題点があった。 In Japanese Patent Laid-Open No. 2004-32252, although it is disclosed that the DA converter is effectively used up to the maximum dynamic range, the DA frequency is converted according to the operating frequency, its slew rate, and the analog input dynamic range. No mention is made of an AD converter that is required more than a converter. In FIG. 1 of Japanese Patent Laid-Open No. 2002-111401, a digital input signal is converted into an analog signal, a distortion component of the amplifier is obtained in the analog domain from a difference between the analog input signal and the analog output signal of the amplifier, and then the distortion component is calculated. In order to digitize, it is necessary to DA convert the branched input signal once, and there is a problem that the configuration becomes complicated.

この発明に係る歪補償増幅器は上記のような問題点を解決するためになされたもので、歪信号をディジタル信号で得ると共に増幅器の出力信号に大きな変動があってもその帰還信号が入力されるA/D変換器(AD変換器又はADC)の歪特性を劣化させない最適な大きさの入力電力でもって制御することにより、少ないビット数のA/D変換器で広いダイナミックレンジにわたり良好な歪補償を行い得る低コストな歪補償増幅器を得ることを目的とする。 The distortion compensating amplifier according to the present invention is made to solve the above-described problems. A distortion signal is obtained as a digital signal, and the feedback signal is inputted even if the output signal of the amplifier is largely varied. Good distortion compensation over a wide dynamic range with an A / D converter with a small number of bits by controlling with an input power of an optimal magnitude that does not degrade the distortion characteristics of the A / D converter (AD converter or ADC) An object of the present invention is to obtain a low-cost distortion compensation amplifier capable of performing the above.

この発明の請求項1に係る歪補償増幅器は、時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐されたもう一方の分岐信号とを合成して歪信号を得る合成器と、スロット毎の前記帰還信号を検波し平均電力を求め、その平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する利得調整手段を含む電力計算部とからなる比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えたものである。   A distortion compensation amplifier according to claim 1 of the present invention branches and outputs a digitized input signal including a time division slot, converts one of the signals into an analog signal, amplifies the power by a nonlinear amplifier circuit, and outputs an analog signal including the distortion. A variable attenuator that feeds back a part of the signal and adjusts the level of the feedback signal, an A / D converter that is provided on the output side of the variable attenuator and digitally converts the feedback signal, and this A / D conversion A multiplier which is provided on the output side of the multiplier and digitally multiplies in conjunction with the amount of attenuation of the variable attenuator, and combines the output of the multiplier and the other branch signal branched from the digitized input signal. A synthesizer for obtaining a distorted signal, and detecting the feedback signal for each slot to obtain an average power. If the average power value is greater than or equal to a predetermined value of the dynamic range of the input signal of the A / D converter, an initial setting is made. Instructing the multiplier the amount of increase from the reference attenuation of the variable attenuator, and instructing the multiplier to the inverse of the increase. A comparator including a power calculation unit including a gain adjustment means for instructing a reduction amount from the amount and instructing the multiplier of the reciprocal of the reduction amount, and the synthesizer which is continuously digitally output in time series Among the distortion signals, a predistortion circuit including a distortion compensation coefficient calculation unit for the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of each slot in the power calculation unit And a data selection unit for prohibiting the output to.

この発明の請求項2に係る歪補償増幅器は、前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項1に記載のものである。   The distortion compensating amplifier according to claim 2 of the present invention is characterized in that the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter.

この発明の請求項3に係る歪増幅器は、前記帰還信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記帰還信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項1又は2に記載のものである。   The distortion amplifier according to claim 3 of the present invention increases the amount of increase from the reference attenuation amount of the variable attenuator when the average power per slot of the feedback signal is continuously equal to or greater than the predetermined value, The amount of decrease from a reference attenuation amount of the variable attenuator is increased when average power per slot of the feedback signal is continuously equal to or less than the predetermined value. Is.

この発明の請求項4に係る歪補償増幅器は、時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐され、このディジタル化入力信号の平均電力を計算する電力計算部を経由するもう一方の分岐信号とを合成して歪信号を得る合成器と、前記電力計算部で求めた平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する前記電力計算部と利得調整手段とを含む比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えたものである。   According to a fourth aspect of the present invention, there is provided a distortion compensating amplifier for branching and outputting a digitized input signal including a time division slot, converting one of the signals into an analog signal, amplifying the power by a non-linear amplifier circuit, and an analog output including the distortion. A variable attenuator that feeds back a part of the signal and adjusts the level of the feedback signal, an A / D converter that is provided on the output side of the variable attenuator and digitally converts the feedback signal, and this A / D conversion A multiplier that is provided on the output side of the multiplier and digitally multiplies in conjunction with the attenuation amount of the variable attenuator, branches from the output of the multiplier and the digitized input signal, and calculates the average power of the digitized input signal A synthesizer that synthesizes the other branch signal that passes through the power calculation unit to obtain a distorted signal, and the average power value obtained by the power calculation unit is the dynamic level of the input signal of the A / D converter. When the value is equal to or greater than a predetermined value, the increment of the initially set variable attenuator from the reference attenuation is instructed and the reciprocal of the increment is instructed to the multiplier. A comparator including the power calculator and a gain adjustment unit for instructing a reduction amount of the set variable attenuator from the reference attenuation amount and instructing the multiplier to the inverse of the reduction amount; and a time series Among the distortion signals of the synthesizer that are digitally output continuously, the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of each slot in the power calculator. And a data selection unit for prohibiting output to a predistortion circuit including a distortion compensation coefficient calculation unit.

この発明の請求項5に係る歪補償増幅器は、前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項4に記載のものである。   The distortion compensating amplifier according to claim 5 of the present invention is characterized in that the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter.

この発明の請求項6に係る歪補償増幅器は、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項4又は5に記載のものである。   According to a sixth aspect of the present invention, when the average power for each slot of the digitized input signal is continuously equal to or greater than the predetermined value, the distortion compensation amplifier according to the sixth aspect of the present invention increases the increase from the reference attenuation of the variable attenuator. 5. The amount of decrease from the reference attenuation amount of the variable attenuator is increased when the average power per slot of the digitized input signal is continuously equal to or less than the predetermined value. Or it is a thing of 5.

この発明の請求項7に係る歪補償増幅器は、時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をディジタル化入力信号の平均電力を計算する電力計算部を経由してアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐されたもう一方の分岐信号とを合成して歪信号を得る合成器と、前記電力計算部で求めた平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する前記電力計算部と利得調整手段とを含む比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えたものである。   According to a seventh aspect of the present invention, a distortion compensating amplifier branches and outputs a digitized input signal including a time division slot, and one of the signals is analogized via a power calculation unit that calculates the average power of the digitized input signal. A variable attenuator that converts and amplifies the power by a nonlinear amplifier circuit, feeds back a part of the analog output signal including the distortion, and adjusts the level of the feedback signal, and the feedback provided on the output side of the variable attenuator An A / D converter for digitally converting the signal; a multiplier provided on the output side of the A / D converter for digitally multiplying in accordance with an attenuation amount of the variable attenuator; an output of the multiplier and the digital A synthesizer that synthesizes the other branch signal branched from the generalized input signal to obtain a distortion signal, and the average power value obtained by the power calculation unit is the dynamic range of the input signal of the A / D converter When the value is equal to or greater than a predetermined value, the initial value of the variable attenuator is instructed to increase from the reference attenuation amount, and the reciprocal of the amount of increase is instructed to the multiplier. A comparator including the power calculation unit for instructing a reduction amount from the reference attenuation amount of the variable attenuator and instructing the multiplier to the inverse of the reduction amount, and a gain adjustment means; Among the distortion signals of the synthesizer that are digitally output, the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of each slot in the power calculation unit is distorted. And a data selection unit that prohibits output to a predistortion circuit including a compensation coefficient calculation unit.

この発明の請求項8に係る歪補償増幅器は、前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項7に記載のものである。   The distortion compensating amplifier according to an eighth aspect of the present invention is the distortion compensating amplifier according to the seventh aspect, wherein the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter.

この発明の請求項9に係る歪補償増幅器は、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項7又は8に記載のものである。   According to a ninth aspect of the present invention, when the average power per slot of the digitized input signal is continuously equal to or greater than the predetermined value, the distortion compensation amplifier according to a ninth aspect of the present invention increases the amount of increase from the reference attenuation amount of the variable attenuator. The amount of decrease from the reference attenuation amount of the variable attenuator is increased when the average power per slot of the digitized input signal is continuously equal to or less than the predetermined value. Or it is a thing of 8.

この発明に係る歪補償増幅器では、歪信号をディジタル信号で得ると共に増幅器の出力信号に大きな変動があってもその帰還信号が入力されるAD変換器(ADC)の歪特性を劣化させない最適な大きさの入力電力でもって制御することにより、少ないビット数のADCで広いダイナミックレンジにわたり良好な歪補償を行い得る低コストな歪補償増幅器を得ることが可能である。 In the distortion compensating amplifier according to the present invention, the distortion signal is obtained as a digital signal, and an optimum magnitude that does not deteriorate the distortion characteristics of the AD converter (ADC) to which the feedback signal is input even if the output signal of the amplifier has a large variation. By controlling with the input power, it is possible to obtain a low-cost distortion compensation amplifier that can perform good distortion compensation over a wide dynamic range with an ADC having a small number of bits.

実施例1.
図1はこの発明の実施例1による歪補償増幅器の構成図である。1は多数のスロット(タイムスロット又はchとも便宜上呼ぶ)毎に時分割的に送られてくるディジタル入力信号端子、2は歪補償増幅器回路の歪信号を補償するプリディストーション回路であり、歪補償部2a、歪補償係数記憶部2b、歪補償係数計算部2cから構成される。
Example 1.
1 is a block diagram of a distortion compensating amplifier according to Embodiment 1 of the present invention. Reference numeral 1 denotes a digital input signal terminal sent in a time-sharing manner for each of a number of slots (also referred to as time slots or ch for convenience), and 2 denotes a predistortion circuit for compensating a distortion signal of a distortion compensation amplifier circuit. 2a, a distortion compensation coefficient storage unit 2b, and a distortion compensation coefficient calculation unit 2c.

3はディジタル入力信号端子(入力端子)に入力されたベースバンドのディジタル入力信号(入力信号)を変調する変調器、4は変調されたディジタル入力信号をアナログ信号に変換するディジタル・アナログ変換器(DA変換器又はDAC)、5はアナログ変換された入力信号を増幅する電力増幅器などの非線形増幅回路、6は電力増幅された入力信号を一定比率で分岐分配する分配器、7は分配器6から分岐出力された出力信号端子(出力端子)であり、次段送信アンテナもしくは終段送信装置など(いずれも図示せず)に接続される。 Reference numeral 3 denotes a modulator that modulates a baseband digital input signal (input signal) input to the digital input signal terminal (input terminal), and reference numeral 4 denotes a digital / analog converter that converts the modulated digital input signal into an analog signal ( DA converter or DAC), 5 is a nonlinear amplifier circuit such as a power amplifier that amplifies the analog-converted input signal, 6 is a distributor that branches and distributes the power-amplified input signal at a constant ratio, and 7 is from the distributor 6. This is an output signal terminal (output terminal) that is branched and output, and is connected to a next-stage transmitting antenna or a final-stage transmitting device (both not shown).

8は分配器6から分岐されたもう一方の出力(帰還信号)をモニターする検波器であり、ほとんどの帰還信号はそのまま出力される。9は帰還信号のレベルを調整する可変減衰器であり、アナログ方式の可変減衰回路が使用される。10は可変減衰器9からの帰還信号をディジタル信号に変換するアナログ・ディジタル変換器(AD変換器又はADC)、11はディジタル化された帰還信号を乗算する乗算器、12はディジタル乗算された帰還信号をベースバンド信号に復調する復調器、13は入力端子1から入力されたベースバンドのディジタル入力信号と復調後のベースバンドのディジタル化された帰還信号とを合成し、歪信号を抽出する合成器である。 Reference numeral 8 denotes a detector for monitoring the other output (feedback signal) branched from the distributor 6, and most of the feedback signal is output as it is. A variable attenuator 9 adjusts the level of the feedback signal, and an analog variable attenuation circuit is used. 10 is an analog / digital converter (AD converter or ADC) that converts the feedback signal from the variable attenuator 9 into a digital signal, 11 is a multiplier that multiplies the digitized feedback signal, and 12 is a digitally multiplied feedback. A demodulator for demodulating the signal into a baseband signal, 13 synthesizes the baseband digital input signal input from the input terminal 1 and the demodulated baseband digital feedback signal, and extracts a distortion signal It is a vessel.

14は検波器8の情報からスロット毎の一定期間の平均電力を計算する電力計算部、15は電力計算部14で算出したスロット毎の平均電力を予め設定した所定値と比較し、所定値に対して可変減衰器9、乗算器11及び合成器13の出力を制御する信号を送出する比較器、16は比較器15の信号により可変減衰器9をアナログ制御する第1の利得調整部、17は比較器15の信号により乗算器11をディジタル制御する第2の利得調整部、18は合成器13の出力に接続され、比較器15からの信号に基づき、合成器13の出力を時分割的にON/OFFするデータ選択部である。従って、合成器13の出力はデータ選択部18のセレクト信号に基づき制御され、所望の歪信号のみ選択的にプリディストーション回路2の歪補償係数計算部2cに送出される。 14 is a power calculation unit for calculating the average power for a certain period for each slot from the information of the detector 8, and 15 is for comparing the average power for each slot calculated by the power calculation unit 14 with a predetermined value set in advance. On the other hand, a comparator for sending out signals for controlling the outputs of the variable attenuator 9, multiplier 11 and synthesizer 13, 16 is a first gain adjusting unit for analog control of the variable attenuator 9 with the signal from the comparator 15, 17 Is a second gain adjusting unit that digitally controls the multiplier 11 by the signal of the comparator 15, and 18 is connected to the output of the combiner 13, and the output of the combiner 13 is time-divisionally based on the signal from the comparator 15. This is a data selection unit that is turned ON / OFF. Therefore, the output of the synthesizer 13 is controlled based on the select signal of the data selector 18 and only a desired distortion signal is selectively sent to the distortion compensation coefficient calculator 2c of the predistortion circuit 2.

なお、19は入力信号と帰還信号との位相調整用に設けられたベクトル調整器などで構成されたデジタル位相器(遅延回路)である。また、20は合成器13で得られた歪信号に一部重畳するベースバンド信号に対して、歪補償係数記憶部2bに収納し歪補償部2aで再生補正するための入力信号を参照計算する振幅計算部である。 Reference numeral 19 denotes a digital phase shifter (delay circuit) composed of a vector adjuster provided for phase adjustment between the input signal and the feedback signal. Reference numeral 20 designates an input signal stored in the distortion compensation coefficient storage unit 2b and reproduced and corrected by the distortion compensation unit 2a for the baseband signal partially superimposed on the distortion signal obtained by the synthesizer 13. It is an amplitude calculator.

次に動作について説明する。図1において、出力端子7の出力信号は、電力増幅器5の非線形歪みを含むアナログ出力信号であるが、その一部は分配器6を介して検波器8に入力され、一定期間の帰還信号の平均電力が電力計算部14で計算される。 Next, the operation will be described. In FIG. 1, the output signal of the output terminal 7 is an analog output signal including nonlinear distortion of the power amplifier 5, but a part of the output signal is input to the detector 8 via the distributor 6, The average power is calculated by the power calculator 14.

AD変換器(ADC)10は使用方法が両電源の場合には±12V、単電源の場合でも12Vのダイナミックレンジを有する汎用のオペアンプ(OP)などの差動増幅器を使用し、正負電源で使用する場合は零ボルト(0V)がダイナミックレンジ中央、単電源で使用する場合は6Vがダイナミックレンジ中央となる。 The AD converter (ADC) 10 uses a differential amplifier such as a general-purpose operational amplifier (OP) having a dynamic range of ± 12 V when the usage method is a dual power supply and 12 V even when a single power supply is used, and is used with a positive and negative power supply. In this case, zero volts (0V) is the center of the dynamic range, and when using a single power supply, 6V is the center of the dynamic range.

従って、比較器15には予めAD変換器10の歪みが最も安定した入力電圧であるダイナミックレンジ中央値をその閾値として設定しておく。すなわち図2に示すように、ADC10のダイナミックレンジがPAーPB間であるのでその中央値(Pc)を閾値とする。また、本実施例では8ビット(256段階)のADC10を使用しているので1段階当たりの電圧換算分解能は両電源使用の場合は約9mV程度となる。 Therefore, the dynamic range median value, which is the input voltage at which the distortion of the AD converter 10 is most stable, is set in advance in the comparator 15 as the threshold value. That is, as shown in FIG. 2, since the dynamic range of the ADC 10 is between PA and PB, the median value (Pc) is set as a threshold value. In addition, since the 8-bit (256 steps) ADC 10 is used in this embodiment, the voltage conversion resolution per step is about 9 mV when using both power supplies.

分配器6からの帰還信号は電力増幅器の増幅率が約30dBに対応して30dBほどのカップリング量(通過量)でもって検波器8を介して可変減衰器9に入力されるので、可変減衰器9の振幅の中心値がADC10のダイナミックレンジの中央(Pc)に平均電力値を設定できる範囲とする。そのため可変減衰器9の基準減衰量を予め設定し、減衰量の増加・減少の調整範囲を設定する。この設定を含めて帰還信号レベルと呼んでも良い。そして、比較器15では可変減衰器9の入力電力の大きさと電力計算部14で得た平均電力とを参照して予め設定した閾値(所定値)と比較して、ADC10の入力電力の平均値がPcと異なるときはその平均値がPcと等しくなるように第1の利得調整部16で可変減衰器9に対して第1の利得調整を行う。 The feedback signal from the divider 6 is input to the variable attenuator 9 through the detector 8 with a coupling amount (passage amount) of about 30 dB corresponding to the amplification factor of about 30 dB. The center value of the amplitude of the device 9 is set to a range in which the average power value can be set at the center (Pc) of the dynamic range of the ADC 10. Therefore, the reference attenuation amount of the variable attenuator 9 is set in advance, and the adjustment range for increasing / decreasing the attenuation amount is set. This setting may be referred to as a feedback signal level. The comparator 15 compares the input power of the variable attenuator 9 and the average power obtained by the power calculator 14 with a preset threshold value (predetermined value) and compares the average value of the input power of the ADC 10. Is different from Pc, the first gain adjustment unit 16 performs the first gain adjustment on the variable attenuator 9 so that the average value becomes equal to Pc.

すなわち図3に示すようにADC10の入力電力の平均値が常にPcとなるように調整される。図3ではG1,G2,G3,G4はそれぞれのタイムスロットの利得調整量を表し、個々のスロットの平均電力は検波器8からの信号に基づき、一定期間の振幅値を基準に決定される。 That is, as shown in FIG. 3, the average value of the input power of the ADC 10 is adjusted to always be Pc. In FIG. 3, G1, G2, G3, and G4 represent gain adjustment amounts of the respective time slots, and the average power of each slot is determined based on the amplitude value for a certain period based on the signal from the detector 8.

次にADC10では利得調整後のアナログ入力信号をディジタル信号に変換される。この出力信号の大きさは可変減衰器9及び第1の利得調整部16で利得調整を行なった帰還信号の振幅変化であるため、第2の利得調整部17で乗算器11に対して第1の利得調整部16で行なった利得調整分をキャンセルするように第1の利得の逆数倍(1/G1,1/G2,1/G3,1/G4)の利得調整を行う。 Next, the ADC 10 converts the gain-adjusted analog input signal into a digital signal. Since the magnitude of the output signal is a change in the amplitude of the feedback signal that has been gain-adjusted by the variable attenuator 9 and the first gain adjuster 16, the second gain adjuster 17 causes the first change to the multiplier 11. The gain adjustment of the inverse of the first gain (1 / G1, 1 / G2, 1 / G3, 1 / G4) is performed so as to cancel the gain adjustment performed by the gain adjustment unit 16.

たとえば、可変減衰器9の基準減衰量からの増加量が11/10倍であれば、その減衰分を補うべくその逆数である10/11倍の利得係数を第2の利得調整部17から乗算器11に指示する。また、可変減衰器9の基準減衰量からの低下量が10/11倍であれば、その利得分を補うべくその逆数である11/10倍の利得係数を第2の利得調整部17から乗算器11に指示する。なお、本実施例1では比較器15は単一の閾値であることと、ADC10に隣接する周辺回路も一体化構成し簡略化を図るため、利得調整部16及び17は2値信号とし、1は可変減衰器9の基準減衰量からの増分とし、0は基準減衰量からの減少もしくは低下分とした。従って利得調整部16及び17から同時に送られてくる2値信号の信号指示が無い場合には、可変減衰器9及び乗算器11は基準値でそのまま出力される。 For example, if the increase amount from the reference attenuation amount of the variable attenuator 9 is 11/10 times, the second gain adjustment unit 17 multiplies the gain factor of 10/11 times that is the reciprocal number to compensate for the attenuation. The instrument 11 is instructed. If the amount of decrease from the reference attenuation amount of the variable attenuator 9 is 10/11 times, the second gain adjustment unit 17 multiplies the gain coefficient by 11/10 times the reciprocal number to compensate for the gain. The instrument 11 is instructed. In the first embodiment, the comparator 15 has a single threshold value, and the peripheral circuits adjacent to the ADC 10 are integrated and simplified so that the gain adjusting units 16 and 17 are binary signals. Is an increment from the reference attenuation of the variable attenuator 9, and 0 is a decrease or a decrease from the reference attenuation. Therefore, when there is no signal indication of the binary signal sent simultaneously from the gain adjusting units 16 and 17, the variable attenuator 9 and the multiplier 11 are output as they are with the reference value.

図4にスロット毎の動作フローチャートを示す。図4では電力計算部14、比較器15、利得調整部16及び17の一連のスロット毎の動作について言及している。これらはデータ選択部18を除き回路構成では比較器15を中心に一体化して組み込まれる。なお、データ選択部18の機能については後述する。 FIG. 4 shows an operation flowchart for each slot. In FIG. 4, the operation for each series of slots of the power calculation unit 14, the comparator 15, and the gain adjustment units 16 and 17 is mentioned. With the exception of the data selector 18, these are integrated and integrated around the comparator 15 in the circuit configuration. The function of the data selection unit 18 will be described later.

次に乗算器11の出力は復調器12で復調後、合成器13に出力される。従って、合成器13には第1の利得調整を実施しない場合のADC10に入力された帰還信号と同じレベルのディジタル化された帰還信号が入力される。 Next, the output of the multiplier 11 is demodulated by the demodulator 12 and then output to the combiner 13. Accordingly, the synthesizer 13 receives a digitized feedback signal at the same level as the feedback signal input to the ADC 10 when the first gain adjustment is not performed.

合成器13では、復調されたディジタル化帰還信号と、入力端子1からのベースバンド信号である参照信号とが与えられ、この参照信号と帰還信号との差分である誤差信号が計算される。この誤差信号は、参照信号と帰還信号との差なので、電力増幅器5で発生する歪み成分を主体に含んでおり、歪信号と呼ぶ。 The synthesizer 13 is supplied with the demodulated digitized feedback signal and a reference signal which is a baseband signal from the input terminal 1, and calculates an error signal which is a difference between the reference signal and the feedback signal. Since this error signal is the difference between the reference signal and the feedback signal, it mainly contains a distortion component generated in the power amplifier 5 and is called a distortion signal.

データ選択部18では、利得の切り替え処理途中にADC10で変換された信号を除去(禁止)してから歪補償係数計算部2cに出力する。このようにすることで、歪補償係数計算部2cは正しく利得調整を受けた信号から歪補償係数記憶部2bを更新する。図5に連続的に時系列(t)で出力される合成器13の出力とデータ選択部18との関係を示す。図中、Aは歪信号振幅情報、Sは歪信号位相情報を示す。図では合成器13の出力のt0〜t1期間中の歪補償係数計算部2cへの歪信号の更新情報の変更を禁止している。このような場合には変更情報指示が無かったものとして、元の歪補償係数でプリディストーション回路2は作動する。なお、図5では便宜上位相変化情報は一律として表示している。 The data selection unit 18 removes (inhibits) the signal converted by the ADC 10 during the gain switching process, and then outputs the signal to the distortion compensation coefficient calculation unit 2c. In this way, the distortion compensation coefficient calculation unit 2c updates the distortion compensation coefficient storage unit 2b from the signal that has been correctly gain adjusted. FIG. 5 shows the relationship between the output of the synthesizer 13 continuously output in time series (t) and the data selection unit 18. In the figure, A indicates distortion signal amplitude information, and S indicates distortion signal phase information. In the figure, it is prohibited to change the distortion signal update information to the distortion compensation coefficient calculation unit 2c during the period t0 to t1 of the output of the synthesizer 13. In such a case, it is assumed that there is no change information instruction, and the predistortion circuit 2 operates with the original distortion compensation coefficient. In FIG. 5, the phase change information is displayed uniformly for convenience.

歪み補償係数計算部2cでは、例えば一般にLMS(Least Mean Square)アルゴリズムと呼ぶ適応アルゴリズムにより、この誤差信号が最小となるように、歪み係数記憶部2bを更新する。歪み補償係数記憶部2bは入力信号の振幅をアドレスとした歪み補正係数(歪み量を規定するパラメータ)が収められたテーブルである。そして、歪補償部2aは入力端子1からの入力信号と、振幅計算部20で計算された入力信号の振幅値に応じて歪み補償係数記憶部2bから読み出した補正係数とを複素乗算し、電力増幅器5で発生する歪みを打ち消すようなディジタル信号(プリディストーション信号)を発生する。このプリディストーション信号は直交変調され、DAC4でアナログプリディストーション信号となり、電力増幅器5に入力される。電力増幅器5は、このプリディストーション信号を増幅するため、最終的に歪みが抑圧された増幅信号が分配器6を介して出力端子7より出力される。 In the distortion compensation coefficient calculation unit 2c, the distortion coefficient storage unit 2b is updated by an adaptive algorithm generally called an LMS (Least Mean Square) algorithm so that the error signal is minimized. The distortion compensation coefficient storage unit 2b is a table that stores distortion correction coefficients (parameters that define the amount of distortion) using the amplitude of the input signal as an address. Then, the distortion compensation unit 2a performs complex multiplication of the input signal from the input terminal 1 and the correction coefficient read from the distortion compensation coefficient storage unit 2b according to the amplitude value of the input signal calculated by the amplitude calculation unit 20, and the power A digital signal (predistortion signal) that cancels the distortion generated in the amplifier 5 is generated. This predistortion signal is quadrature modulated and converted into an analog predistortion signal by the DAC 4 and input to the power amplifier 5. Since the power amplifier 5 amplifies the predistortion signal, an amplified signal whose distortion is finally suppressed is output from the output terminal 7 via the distributor 6.

なお、この発明の実施例1では、比較器15の閾値はADC10のダイナミックレンジの中央付近としたが、比較器15による利得調整は歪み特性を劣化させることのない範囲であれば実用上は問題がないため、帰還信号の振幅最大値及び振幅最小値が、帰還信号の平均電力値(振幅値)との間で予めレベルが確定している場合には、ADC10の閾値の最適レベル(Pc)を中央から若干PaもしくはPb側に変更しても構わない。 In the first embodiment of the present invention, the threshold value of the comparator 15 is set in the vicinity of the center of the dynamic range of the ADC 10. However, the gain adjustment by the comparator 15 has a practical problem as long as the distortion characteristics are not deteriorated. Therefore, when the level is determined in advance between the maximum amplitude value and the minimum amplitude value of the feedback signal and the average power value (amplitude value) of the feedback signal, the optimum threshold level (Pc) of the ADC 10 May be slightly changed from the center to the Pa or Pb side.

以上のように、ADC10の入力電力の大きさとADC10の歪み特性が所望の歪みとなる電力範囲を比較して、ADC10の入力電力が常に歪みの最適入力電力範囲となるようにADC10の入力信号に利得調整を行い、さらに利得調整の切り替え処理途中の不正な誤差信号が歪補償係数計算部2cに入力されないようデータ選択部18で選択することにより、この発明の歪補償増幅器の入力信号のダイナミックレンジより少ないダイナミックレンジを持つADCを使用しても良好な歪み補償を行うことが出来る。 As described above, the input power of the ADC 10 is compared with the power range in which the distortion characteristics of the ADC 10 have a desired distortion by comparing the magnitude of the input power of the ADC 10 and the input signal of the ADC 10 is always in the optimum input power range of distortion. The dynamic range of the input signal of the distortion compensation amplifier according to the present invention is adjusted by performing the gain adjustment and selecting the data selection unit 18 so that an illegal error signal in the process of switching the gain adjustment is not input to the distortion compensation coefficient calculation unit 2c. Even if an ADC having a smaller dynamic range is used, good distortion compensation can be performed.

すなわち、この発明に係る歪補償増幅器では、歪信号をディジタル信号で得ると共に増幅器の出力信号に大きな変動があってもその帰還信号が入力されるA/D変換器(ADC)の歪特性を劣化させない最適な大きさの入力電力でもって制御することにより、少ないビット数のADCで広いダイナミックレンジにわたり良好な歪補償を行い得る低コストな歪補償増幅器を得ることが可能である。 That is, in the distortion compensation amplifier according to the present invention, a distortion signal is obtained as a digital signal, and the distortion characteristic of an A / D converter (ADC) to which the feedback signal is input is deteriorated even if the output signal of the amplifier is largely varied. By controlling with an input power having an optimum magnitude that is not generated, it is possible to obtain a low-cost distortion compensation amplifier that can perform good distortion compensation over a wide dynamic range with an ADC having a small number of bits.

実施例2.
図6はこの発明の実施例2による歪補償増幅器の構成図である。なお、図1と同一符号は同一又は相当部分を示す。図6において、141は電力計算部(平均電力計算部)、151は比較器である。本実施例2ではADC10に最適な入力信号を導出するための手段として、入力信号の平均電力を直接電力計算部141で得る。本実施例の場合には、ADC10入力直前のアナログ帰還信号の平均電力は抽出しないので、実施例1に示したものよりは若干、平均電力計算の測定環境精度は低下するが、平均電力の計算を直接ディジタル入力信号から求めるので図1で示したアナログの検波器8は不要となる。
Example 2
FIG. 6 is a block diagram of a distortion compensating amplifier according to Embodiment 2 of the present invention. 1 denote the same or corresponding parts. In FIG. 6, 141 is a power calculation unit (average power calculation unit), and 151 is a comparator. In the second embodiment, the average power of the input signal is directly obtained by the power calculation unit 141 as a means for deriving an optimal input signal for the ADC 10. In the case of the present embodiment, the average power of the analog feedback signal immediately before the ADC 10 input is not extracted, so that the measurement environment accuracy of the average power calculation is slightly lower than that shown in the first embodiment, but the average power calculation is performed. Is obtained directly from the digital input signal, the analog detector 8 shown in FIG. 1 is not necessary.

次に動作について説明する。図6において、出力端子7の出力信号は、電力増幅器5の非線形歪みを含むアナログ出力信号であるが、その一部は分配器6を介してADC10に入力される。この場合、入力信号端子1からの入力信号からADC10までの可変減衰器9の基準減衰量を含む電力通過量は既知であるため、合成部13に入力される信号レベルは計算可能である。従ってADC10の入力電力も入力信号端子1からの入力信号の変動分を除き計算可能である。 Next, the operation will be described. In FIG. 6, the output signal at the output terminal 7 is an analog output signal including nonlinear distortion of the power amplifier 5, but a part thereof is input to the ADC 10 via the distributor 6. In this case, since the power passing amount including the reference attenuation amount of the variable attenuator 9 from the input signal from the input signal terminal 1 to the ADC 10 is known, the signal level input to the combining unit 13 can be calculated. Therefore, the input power of the ADC 10 can also be calculated excluding the fluctuation of the input signal from the input signal terminal 1.

以上から本構成では検波回路を介在させないで、入力信号の平均電力を直接ディジタル計算するので計算精度が向上し、回路環境による不利をカバーし、図1で示した検波器8も不要となるため、回路の構成コストが低減できる利点がある。 As described above, in this configuration, since the average power of the input signal is directly digitally calculated without interposing a detector circuit, the calculation accuracy is improved, the disadvantage due to the circuit environment is covered, and the detector 8 shown in FIG. 1 is not required. There is an advantage that the configuration cost of the circuit can be reduced.

実施例3.
図7はこの発明の実施例3による歪補償増幅器の構成図である。なお、図1と同一符号は同一又は相当部分を示す。図7において、142は電力計算部(平均電力計算部)、152は比較器である。本実施例3ではADC10に最適な入力信号を導出するための手段として、歪補償部2aで補正された入力信号の平均電力を直接電力計算部142で得る。本実施例の場合には、ADC10入力直前のアナログ帰還信号の平均電力は抽出しないので、実施例1に示したものよりは若干、平均電力計算の測定環境精度は低下するが、実施例2同様、平均電力の計算を直接ディジタル信号から求めるので図1で示したアナログの検波器8は不要となる。
Example 3
FIG. 7 is a block diagram of a distortion compensating amplifier according to Embodiment 3 of the present invention. 1 denote the same or corresponding parts. In FIG. 7, 142 is a power calculator (average power calculator), and 152 is a comparator. In the third embodiment, the average power of the input signal corrected by the distortion compensator 2a is directly obtained by the power calculator 142 as a means for deriving an optimal input signal for the ADC 10. In the case of the present embodiment, the average power of the analog feedback signal immediately before the ADC 10 input is not extracted, so that the measurement environment accuracy of the average power calculation is slightly lower than that shown in the first embodiment, but similar to the second embodiment. Since the average power is calculated directly from the digital signal, the analog detector 8 shown in FIG. 1 is not necessary.

次に動作について説明する。図7において、出力端子7の出力信号は、電力増幅器5の非線形歪みを含むアナログ出力信号であるが、その一部は分配器6を介してADC10に入力される。この場合、入力信号の歪補償部2aからADC10までの可変減衰器9の基準減衰量を含む電力通過量は既知であるため、合成部13に入力される信号レベルは計算可能である。従ってADC10の入力電力も入力信号端子1からの入力信号の変動分を除き計算可能である。 Next, the operation will be described. In FIG. 7, the output signal at the output terminal 7 is an analog output signal including nonlinear distortion of the power amplifier 5, but a part thereof is input to the ADC 10 via the distributor 6. In this case, since the power passing amount including the reference attenuation amount of the variable attenuator 9 from the distortion compensation unit 2a to the ADC 10 of the input signal is known, the signal level input to the combining unit 13 can be calculated. Therefore, the input power of the ADC 10 can also be calculated excluding the fluctuation of the input signal from the input signal terminal 1.

以上から本構成では検波回路を介在させないで、歪補償部2aで補正された入力信号の平均電力を直接ディジタル計算すると共に帰還信号を使用した場合の電力計算と比べて、電力歪が少ないので平均電力の計算精度が向上し、図1で示した検波器8も不要となるため、回路の構成コストが低減できる利点がある。 As described above, in this configuration, the average power of the input signal corrected by the distortion compensator 2a is directly digitally calculated without using a detection circuit, and the power distortion is small compared to the power calculation when the feedback signal is used. Since the power calculation accuracy is improved and the detector 8 shown in FIG. 1 is not required, the circuit configuration cost can be reduced.

実施例4.
この発明の実施例1乃至3においては、比較器15、151及び152の閾値(所定値)は1段階とし、所定値はADC10の入力ダイナミックレンジの略中央とした。また、電力計算部14、141及び142の計算結果を基に可変減衰器9では基準減衰量を中心に1段階の減衰量の増減を計り、それに対応して乗算器11では1段階の利得の増減を計った。実施例4では、第1の利得調整部16及び第2の利得調整部17に2値を越える信号の変更指示を持たせた場合について述べる。
Example 4
In the first to third embodiments of the present invention, the threshold values (predetermined values) of the comparators 15, 151, and 152 are set to one level, and the predetermined value is approximately the center of the input dynamic range of the ADC 10. Further, based on the calculation results of the power calculators 14, 141 and 142, the variable attenuator 9 measures increase / decrease in one step centering on the reference attenuation, and the multiplier 11 correspondingly increases / decreases the gain in one step. Increase / decrease was measured. In the fourth embodiment, a case will be described in which the first gain adjustment unit 16 and the second gain adjustment unit 17 are instructed to change signals exceeding two values.

実施例1乃至3で述べた図1、図6及び図7の電力計算部14、141及び142は各スロット毎の平均電力を一定期間サンプリングし、その平均電力を求めるが、各スロットは通常、複数であり、周期的に連続して時間的に周回動作をしている。従って、隣接するスロット、もしくは周期的に繰り返す当該スロット間の平均電力の差分を抽出し、電力計算部14、141もしくは142では平均電力の差分情報も第1の利得調整部16及び第2の利得調整部に記憶させることにより、ADC10の入力電力を細分化して調整する。 The power calculators 14, 141, and 142 in FIGS. 1, 6, and 7 described in the first to third embodiments sample the average power for each slot for a certain period to obtain the average power. There are a plurality, and cyclic operation is performed continuously in time. Therefore, an average power difference between adjacent slots or periodically repeated slots is extracted, and the power calculation unit 14, 141, or 142 extracts the average power difference information from the first gain adjustment unit 16 and the second gain. By storing in the adjustment unit, the input power of the ADC 10 is subdivided and adjusted.

たとえば、周期的に再来するチャンネル(当該スロット)の場合について述べると、先行する当該スロットの平均電力に対して引き続き再来する当該スロットとの平均電力の差分がADC10入力換算でダイナミックレンジ中央を中心に2digits以上ある場合には可変減衰器9の基準減衰量からの増加量を当初1.1倍であった場合には1.2倍とすると共に同時に乗算器11の利得も調整し、合成器13における帰還信号を一定に保つ。 For example, in the case of a channel that periodically returns (the slot), the difference between the average power of the preceding slot and the average power of the slot that continues to return is centered around the center of the dynamic range in terms of ADC10 input. When there are 2 digits or more, the increase amount from the reference attenuation amount of the variable attenuator 9 is 1.1 times when it is 1.1 times at the beginning, and the gain of the multiplier 11 is adjusted at the same time. The feedback signal at is kept constant.

また、ADC10入力換算でダイナミックレンジ中央を中心に2digits以下の場合には可変減衰器9の基本減衰量からからの減少(低下)量を当初0.9倍であった場合には0.8倍とすると共に同時に乗算器11の利得も調整し、合成器13における帰還信号を一定に保つ。なお、電力計算器14、141もしくは142で得た平均電力の差分情報は比較器15、151もしくは152を介さず直接利得調整部16及び17に入力されるので、図8に示すように電力計算部14及び比較器15を用いた実施例1で述べたような構成では、2ビットを越える制御信号でもって可変減衰器9及び乗算器11は駆動される。 In addition, when the input value is equal to or less than ADC and the dynamic range is centered at 2 digits or less, the amount of decrease (decrease) from the basic attenuation of the variable attenuator 9 is initially 0.9 times 0.8 times. At the same time, the gain of the multiplier 11 is adjusted to keep the feedback signal in the synthesizer 13 constant. Since the difference information of the average power obtained by the power calculator 14, 141 or 142 is directly input to the gain adjusting units 16 and 17 without passing through the comparator 15, 151 or 152, the power calculation as shown in FIG. In the configuration described in the first embodiment using the unit 14 and the comparator 15, the variable attenuator 9 and the multiplier 11 are driven by a control signal exceeding 2 bits.

以上から比較器15、151及び152の所定値(閾値)を1段階で設定してもADC10の入力信号レベルを多段階にわたって変更指示できるため、ADC10の飽和歪みや量子化歪みの無い簡便な歪補償増幅器が実現可能である。 As described above, even if the predetermined values (threshold values) of the comparators 15, 151 and 152 are set in one step, the change of the input signal level of the ADC 10 can be instructed in multiple steps. Therefore, simple distortion without saturation distortion or quantization distortion of the ADC 10 A compensation amplifier is feasible.

この発明の実施例1による歪補償増幅器の構成図である。It is a block diagram of the distortion compensation amplifier by Example 1 of this invention. この発明の実施例1による歪補償増幅器の入力信号とAD変換器のダイナミックレンジとの関係を示す図である。It is a figure which shows the relationship between the input signal of the distortion compensation amplifier by Example 1 of this invention, and the dynamic range of AD converter. この発明の実施例1による歪補償増幅器の平均電力の利得調整を説明する図である。It is a figure explaining the gain adjustment of the average electric power of the distortion compensation amplifier by Example 1 of this invention. この発明の実施例1による歪補償増幅器の時間的動作を説明するフローチャートである。It is a flowchart explaining the time operation | movement of the distortion compensation amplifier by Example 1 of this invention. この発明の実施例1による合成器出力とデータ選択部との関係を説明する図である。It is a figure explaining the relationship between the combiner output by Example 1 of this invention, and a data selection part. この発明の実施例2による歪補償増幅器の構成図である。It is a block diagram of the distortion compensation amplifier by Example 2 of this invention. この発明の実施例3による歪補償増幅器の構成図である。It is a block diagram of the distortion compensation amplifier by Example 3 of this invention. この発明の実施例4による歪補償増幅器の構成図である。It is a block diagram of the distortion compensation amplifier by Example 4 of this invention.

符号の説明Explanation of symbols

1 入力信号端子(入力端子)、 2 プリディストーション回路、 2a 歪補償部、 2b 歪補償係数記憶部、 2c 歪補償係数計算部、 3 変調器、 4 DA変換器、 5 電力増幅器(非線形増幅器)、 6 アナログ分配器(分配器)、 7 出力信号端子(出力端子)、 8 アナログ検波器(検波器)、 9 アナログ可変減衰器(可変減衰器)、 10 AD変換器(ADC)、 11 ディジタル乗算器(乗算器)、 12 復調器、 13 合成器、 14 電力計算部(平均電力計算部)、 15 比較器、 16 第1の利得調整部(利得調整手段1)、 17 第2の利得調整部(利得調整手段2)、 18 データ選択部、 19 遅延回路、 20 振幅計算部、 141 電力計算部(平均電力計算部)、 142 電力計算部(平均電力計算部)、 151 比較器、 152 比較器。
DESCRIPTION OF SYMBOLS 1 Input signal terminal (input terminal), 2 Predistortion circuit, 2a Distortion compensation part, 2b Distortion compensation coefficient memory | storage part, 2c Distortion compensation coefficient calculation part, 3 Modulator, 4 DA converter, 5 Power amplifier (nonlinear amplifier), 6 Analog distributor (distributor), 7 Output signal terminal (output terminal), 8 Analog detector (detector), 9 Analog variable attenuator (variable attenuator), 10 AD converter (ADC), 11 Digital multiplier (Multiplier), 12 demodulator, 13 combiner, 14 power calculator (average power calculator), 15 comparator, 16 first gain adjuster (gain adjuster 1), 17 second gain adjuster ( Gain adjustment means 2), 18 data selection unit, 19 delay circuit, 20 amplitude calculation unit, 141 power calculation unit (average power calculation unit), 142 power calculation unit (average power calculation unit), 151 comparator, 1 52 Comparator.

Claims (9)

時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐されたもう一方の分岐信号とを合成して歪信号を得る合成器と、スロット毎の前記帰還信号を検波し平均電力を求め、その平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する利得調整手段を含む電力計算部とからなる比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えた歪補償増幅器。 A digitized input signal including a time division slot is branched and output, one of the signals is converted into an analog signal, power amplified by a non-linear amplifier circuit, a part of the analog output signal including the distortion is fed back, and the level of this feedback signal A variable attenuator for adjusting the output of the variable attenuator, an A / D converter for digitally converting the feedback signal provided on the output side of the variable attenuator, and an attenuation of the variable attenuator provided on the output side of the A / D converter. A multiplier that digitally multiplies in accordance with the amount; a combiner that combines the output of the multiplier and the other branch signal branched from the digitized input signal to obtain a distortion signal; and the feedback for each slot. The signal is detected to obtain an average power, and when the average power value is equal to or greater than a predetermined value of the dynamic range of the input signal of the A / D converter, an increase from the initially set reference attenuation amount of the variable attenuator is performed. Instructing the multiplier and the reciprocal of the increase amount to the multiplier, and instructing the amount of decrease from the reference attenuation amount of the initially set variable attenuator when the value is equal to or less than a predetermined value, A comparator comprising a power calculation unit including a gain adjusting means for instructing the multiplier to the reciprocal, and each of the distortion signals of the synthesizer that is digitally output in time series in the power calculation unit. A data selection unit for prohibiting output of the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of the slot to a predistortion circuit including a distortion compensation coefficient calculation unit; Distortion compensation amplifier. 前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項1記載の歪補償増幅器。 2. The distortion compensation amplifier according to claim 1, wherein the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter. 前記帰還信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記帰還信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項1又は2に記載の歪補償増幅器。 When the average power for each slot of the feedback signal is continuously greater than or equal to the predetermined value, the amount of increase from the reference attenuation of the variable attenuator is increased, and the average power for each slot of the feedback signal is continuously increased. 3. The distortion compensation amplifier according to claim 1, wherein the amount of decrease from the reference attenuation amount of the variable attenuator is increased when the value is equal to or less than the predetermined value. 時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐され、このディジタル化入力信号の平均電力を計算する電力計算部を経由するもう一方の分岐信号とを合成して歪信号を得る合成器と、前記電力計算部で求めた平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する前記電力計算部と利得調整手段とを含む比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えた歪補償増幅器。 A digitized input signal including a time division slot is branched and output, one of the signals is converted into an analog signal, power amplified by a non-linear amplifier circuit, a part of the analog output signal including the distortion is fed back, and the level of this feedback signal A variable attenuator for adjusting the output of the variable attenuator, an A / D converter for digitally converting the feedback signal provided on the output side of the variable attenuator, and an attenuation of the variable attenuator provided on the output side of the A / D converter. A multiplier that digitally multiplies in accordance with the quantity, and another branch signal that is branched from the output of the multiplier and the digitized input signal and that passes through a power calculator that calculates the average power of the digitized input signal; Is synthesized when the average power value obtained by the power calculation unit is greater than or equal to a predetermined value of the dynamic range of the input signal of the A / D converter. An increase amount from the reference attenuation amount of the variable attenuator is instructed, and an inverse number of the increase amount is instructed to the multiplier. A comparator including the power calculation unit for instructing the multiplier and a reciprocal of the reduction amount to the multiplier and a gain adjusting means, and the combiner that is continuously digitally output in time series. Of the distortion signal, the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of each slot in the power calculation unit is output to a predistortion circuit including a distortion compensation coefficient calculation unit. A distortion compensation amplifier including a data selection unit that prohibits the operation. 前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項4記載の歪補償増幅器。 5. The distortion compensation amplifier according to claim 4, wherein the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter. 前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項4又は5に記載の歪補償増幅器。 When the average power per slot of the digitized input signal is continuously greater than or equal to the predetermined value, the amount of increase from the reference attenuation of the variable attenuator is increased, and the average of the digitized input signal per slot is increased. 6. The distortion compensating amplifier according to claim 4, wherein when the electric power is continuously equal to or less than the predetermined value, the amount of decrease from the reference attenuation amount of the variable attenuator is increased. 時分割スロットを含むディジタル化入力信号を分岐出力し、その一方の信号をディジタル化入力信号の平均電力を計算する電力計算部を経由してアナログ変換し、非線形増幅回路で電力増幅し、その歪を含むアナログ出力信号の一部を帰還させ、この帰還信号のレベルを調整する可変減衰器と、この可変減衰器の出力側に設けられ前記帰還信号をディジタル変換するA/D変換器と、このA/D変換器の出力側に設けられ前記可変減衰器の減衰量に連動してディジタル乗算する乗算器と、この乗算器の出力と前記ディジタル化入力信号から分岐されたもう一方の分岐信号とを合成して歪信号を得る合成器と、前記電力計算部で求めた平均電力値が前記A/D変換器の入力信号のダイナミックレンジの所定値以上の場合には初期設定された前記可変減衰器の基準減衰量からの増加量を指示すると共にその増加量の逆数を前記乗算器に指示し、所定値以下の場合には初期設定された前記可変減衰器の前記基準減衰量からの低下量を指示すると共にその低下量の逆数を前記乗算器に指示する前記電力計算部と利得調整手段とを含む比較器と、時系列的に連続してディジタル出力される前記合成器の前記歪信号の内、前記電力計算部における各スロットの平均電力算出期間後の前記可変減衰器及び前記乗算器の調整動作期間中の前記歪信号を、歪補償係数計算部を含むプリディストーション回路に出力することを禁止するデータ選択部とを備えた歪補償増幅器。 A digitized input signal including a time division slot is branched and output, and one of the signals is converted into an analog signal via a power calculation unit that calculates the average power of the digitized input signal, and is amplified by a non-linear amplifier circuit. A variable attenuator that feeds back a part of the analog output signal including the signal and adjusts the level of the feedback signal; an A / D converter that is provided on the output side of the variable attenuator and converts the feedback signal into digital; A multiplier which is provided on the output side of the A / D converter and digitally multiplies in accordance with the attenuation amount of the variable attenuator; an output of the multiplier; and another branch signal branched from the digitized input signal; And a synthesizer that obtains a distorted signal, and the average power value obtained by the power calculation unit is initially set when the dynamic range of the input signal of the A / D converter is equal to or greater than a predetermined value. Instructing the multiplier from the reference attenuation amount of the variable attenuator and instructing the multiplier to the reciprocal of the increase amount. If the value is less than a predetermined value, the variable attenuator is initialized from the reference attenuation amount. A comparator including the power calculation unit for instructing a reduction amount and an inverse number of the reduction amount to the multiplier and a gain adjusting unit; and the distortion of the combiner that is continuously digitally output in time series. Among the signals, the distortion signal during the adjustment operation period of the variable attenuator and the multiplier after the average power calculation period of each slot in the power calculation unit is output to a predistortion circuit including a distortion compensation coefficient calculation unit. A distortion compensation amplifier including a data selection unit that prohibits the above. 前記所定値は前記A/D変換器の入力信号のダイナミックレンジの略中央値であることを特徴とする請求項7記載の歪補償増幅器。 8. The distortion compensation amplifier according to claim 7, wherein the predetermined value is a substantially median value of a dynamic range of an input signal of the A / D converter. 前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以上の場合には、前記可変減衰器の基準減衰量からの増加量を増大し、前記ディジタル化入力信号のスロット毎の平均電力が連続して前記所定値以下の場合には、前記可変減衰器の基準減衰量からの低下量を増大することを特徴とする請求項7又は8に記載の歪補償増幅器。
When the average power per slot of the digitized input signal is continuously greater than or equal to the predetermined value, the amount of increase from the reference attenuation of the variable attenuator is increased, and the average of the digitized input signal per slot is increased. 9. The distortion compensating amplifier according to claim 7, wherein when the electric power is continuously equal to or less than the predetermined value, the amount of decrease from the reference attenuation amount of the variable attenuator is increased.
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