JP3152018B2 - Method of manufacturing field emission device - Google Patents

Method of manufacturing field emission device

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JP3152018B2 JP15353493A JP15353493A JP3152018B2 JP 3152018 B2 JP3152018 B2 JP 3152018B2 JP 15353493 A JP15353493 A JP 15353493A JP 15353493 A JP15353493 A JP 15353493A JP 3152018 B2 JP3152018 B2 JP 3152018B2
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】本発明は、発光型表示装置、プリ
ンタ用光源、電子顕微鏡、電子ビーム露光装置、CRT
用電子銃、マイクロ波増幅管、センサーなど各種電子ビ
ーム応用装置の電子源として利用することができる電界
放出素子の製造方法に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a light-emitting display device, a light source for a printer, an electron microscope, an electron beam exposure apparatus, and a CRT.
The present invention relates to a method for manufacturing a field emission device that can be used as an electron source for various electron beam applied devices such as an electron gun for use, a microwave amplification tube, and a sensor.

【0002】[0002]

【従来の技術】従来の電界放出素子としては、アメリカ
のSRIやフランスのLETIがマイクロチップディス
プレイとして発表した通称Spindt型カソードが知
られている。図3(a)〜(f)に、Spindt型カ
ソードの作製手順の一例を示す。
2. Description of the Related Art As a conventional field emission device, a so-called Spindt type cathode, which has been announced as a microchip display by SRI in the United States and LETI in France, is known. 3A to 3F show an example of a procedure for manufacturing a Spindt-type cathode.

【0003】図3(a)に示すように、Si基板100
上に熱酸化膜からなる絶縁層101を形成し、その上に
Nbからなるゲート層102を形成する。
[0003] As shown in FIG.
An insulating layer 101 made of a thermal oxide film is formed thereon, and a gate layer 102 made of Nb is formed thereon.

【0004】図3(b)に示すように、前記ゲート層1
02の上にレジスト103を塗布し、図示しないマスク
を介して露光した後に現像を行ない、所定パターンの孔
104を形成する。
[0004] As shown in FIG.
A resist 103 is applied on the substrate 02 and exposed through a mask (not shown), followed by development to form a hole 104 having a predetermined pattern.

【0005】図3(c)に示すように、SF6 等を用い
たRIEによりゲート層102に開口105を形成し、
続けてBHFで絶縁層101をエッチングしてSi基板
100に達する空孔106を形成する。
[0005] As shown in FIG. 3 C, an opening 105 is formed in the gate layer 102 by RIE using SF 6 or the like.
Subsequently, the insulating layer 101 is etched with BHF to form a hole 106 reaching the Si substrate 100.

【0006】図3(d)に示すように、ゲート層102
上にAlの剥離層107を斜め蒸着で形成する。即ち、
Si基板100に垂直な開口105乃至空孔106の中
心軸Xに対してSi基板100にほぼ平行の浅い入射角
でAlを斜め蒸着させてゲート層102上に剥離層10
7を形成する。
[0006] As shown in FIG.
An Al release layer 107 is formed thereon by oblique evaporation. That is,
Al is obliquely vapor-deposited at a shallow angle of incidence substantially parallel to the Si substrate 100 with respect to the central axis X of the opening 105 to the hole 106 perpendicular to the Si substrate 100 and the release layer 10 is formed on the gate layer 102.
7 is formed.

【0007】図3(e)に示すように、Si基板100
の垂直上方からエミッタ材料であるMoを蒸着させ、空
孔106内のSi基板100上にコーン形状のエミッタ
108を形成する。
[0007] As shown in FIG.
Mo, which is an emitter material, is vapor-deposited from above vertically to form a cone-shaped emitter 108 on the Si substrate 100 in the hole 106.

【0008】図3(f)に示すように、剥離層107と
ともにゲート層102上に堆積したMoを除去し、電界
放出素子が完成する。
As shown in FIG. 3F, Mo deposited on the gate layer 102 together with the release layer 107 is removed, and the field emission device is completed.

【0009】[0009]

【発明が解決しようとする課題】前述した従来の製造方
法には次のような問題があった。 1)Alの剥離層107を斜め蒸着で形成しなければな
らない。これはゲート層102の開口105から空孔1
06内にAlが入らないようにするためである。もしA
lが空孔106内に蒸着されると、エミッタ108を作
製した後のAl剥離の工程で、エミッタ108も一緒に
剥離してしまうからである。しかしこの斜め蒸着法は、
その角度によりAlの膜質を変化させ、特に開口部の結
晶状態が変化すると、それが電界放出特性を決めるエミ
ッタ108の形成に影響を与える為、カソードのエミッ
ション特性の均一性、再現性、絶縁歩留まりに影響し、
極めて再現性が悪い。またディスプレイ用電子源等、大
型電界放出基板を作製する際には、その原理上、蒸着装
置を極めて大型にし、蒸着源と基板との距離を十分にと
らなければ、Alを均一な角度で斜め蒸着することはで
きない。このため、斜め蒸着法は、蒸着材料の使用量が
多く、装置の大型化の点で量産化には不向きである。
The above-mentioned conventional manufacturing method has the following problems. 1) The Al release layer 107 must be formed by oblique evaporation. This is because the holes 1
This is to prevent Al from entering into the area 06. If A
This is because if l is vapor-deposited in the hole 106, the emitter 108 is also peeled off in the Al peeling step after the emitter 108 is manufactured. However, this oblique deposition method,
When the film quality of Al changes depending on the angle, and particularly when the crystal state of the opening changes, it affects the formation of the emitter 108 that determines the field emission characteristics, so that the uniformity, reproducibility, and insulation yield of the emission characteristics of the cathode are obtained. Affect
Very poor reproducibility. In addition, when manufacturing a large field emission substrate such as an electron source for a display, the deposition apparatus is extremely large in principle, and if the distance between the deposition source and the substrate is not sufficient, the Al is obliquely formed at a uniform angle. It cannot be deposited. For this reason, the oblique vapor deposition method uses a large amount of vapor deposition material, and is not suitable for mass production in terms of increasing the size of the apparatus.

【0010】2)従来のゲート層102の開口105の
加工工程では、開口105の穴径をパターニングし、N
b膜をSF6 等を用いたRIEにより穴を開け、続いて
ウエットエッチング法では緩衝フッ酸等により、または
ドライエッチング法ではCHF3 により、SiO2 の絶
縁層101にSi基板100まで空孔106を立て彫り
していた。しかしこの工程では、ゲート層102上、ゲ
ート層102の結晶粒界中および空孔106内部の絶縁
層101等の表面に、Fおよびそれらの化合物が残存す
る。これらの物質は、複雑なカソード基板の構造上、後
工程で完全に除去することが困難であり、最終的にカソ
ードの電子線放出時にそれらの各部分から放出され、エ
ミッタへのガス吸着汚染物質となり、電界放出素子の寿
命特性に悪影響を及ぼす。
2) In the conventional process of forming the opening 105 of the gate layer 102, the hole diameter of the opening 105 is patterned and N
Holes are formed in the b film by RIE using SF 6 or the like, and then holes 106 are formed in the insulating layer 101 of SiO 2 to the Si substrate 100 by buffer hydrofluoric acid or the like in a wet etching method or by CHF 3 in a dry etching method. Was carved upright. However, in this step, F and their compounds remain on the gate layer 102, in the crystal grain boundaries of the gate layer 102, and on the surface of the insulating layer 101 and the like inside the holes 106. Due to the complicated structure of the cathode substrate, these substances are difficult to completely remove in a later process, and finally are released from each of the parts when the cathode emits an electron beam, and gas adsorbed contaminants to the emitter are emitted. And adversely affect the life characteristics of the field emission device.

【0011】本発明は、大型の基板上においても、再現
性、均一性、量産性に優れた電界放出素子を製造できる
電界放出素子の製造方法を提供することを目的としてい
る。
SUMMARY OF THE INVENTION An object of the present invention is to provide a method for manufacturing a field emission device capable of manufacturing a field emission device excellent in reproducibility, uniformity, and mass productivity even on a large-sized substrate.

【0012】[0012]

【課題を解決するための手段】請求項1に記載された電
界放出素子の製造方法は、基板と、前記基板上に設けら
れた絶縁層と、前記絶縁層に形成された空孔の内部にお
いて前記基板上に設けられたエミッタ電極と、前記絶縁
層の上面に形成されて前記空孔に対応したゲート孔を有
するゲート電極を備えた電界放出素子の製造方法におい
て、前記基板上に絶縁層とゲート電極と剥離層を順次積
層して形成する工程と、前記剥離層の表面にレジスト層
を形成して該レジスト層に開口部を形成する工程と、前
記剥離層とゲート電極と絶縁層をガスクラスタイオンビ
ームで加工して前記ゲート孔及び空孔を形成する工程
と、前記剥離層側からエミッタ材料を蒸着して前記空孔
内にエミッタ電極を形成する工程と、前記剥離層上に被
着したエミッタ材料を該剥離層とともに除去する工程を
有することを特徴としている。
According to a first aspect of the present invention, there is provided a method of manufacturing a field emission device, comprising the steps of: forming a substrate; an insulating layer provided on the substrate; and a hole formed in the insulating layer. An emitter electrode provided on the substrate, and a method for manufacturing a field emission device including a gate electrode formed on an upper surface of the insulating layer and having a gate hole corresponding to the hole, wherein an insulating layer is provided on the substrate. Forming a gate electrode and a peeling layer by sequentially laminating them; forming a resist layer on the surface of the peeling layer to form an opening in the resist layer; and forming a gas through the peeling layer, the gate electrode, and the insulating layer. Forming the gate hole and the hole by processing with a cluster ion beam; depositing an emitter material from the release layer side to form an emitter electrode in the hole; Emitter material It is characterized by having a step of removing with the release layer.

【0013】請求項2に記載された電界放出素子の製造
方法は、基板と、前記基板上に設けられた第一の絶縁層
と、前記第一の絶縁層に形成された空孔の内部において
前記基板上に設けられたエミッタ電極と、前記第一の絶
縁層の上面に形成されて前記空孔に対応したゲート孔を
有するゲート電極と、前記ゲート電極の上面に形成され
て前記ゲート孔に対応する空孔が形成された第二の絶縁
層と、前記第二の絶縁層の上面に形成された集束電極を
備えた電界放出素子の製造方法において、前記基板上に
第一の絶縁層とゲート電極と第二の絶縁層と集束電極と
剥離層を順次積層して形成する工程と、前記剥離層の表
面にレジスト層を形成して該レジスト層に開口部を形成
する工程と、前記剥離層と集束電極と第二の絶縁層とゲ
ート電極と第一の絶縁層をガスクラスタイオンビームで
加工して前記空孔を形成する工程と、前記剥離層側から
エミッタ材料を蒸着して前記空孔内にエミッタ電極を形
成する工程と、前記剥離層上に被着したエミッタ材料を
該剥離層とともに除去する工程を有することを特徴とし
ている。
According to a second aspect of the present invention, there is provided a method for manufacturing a field emission device, wherein a substrate, a first insulating layer provided on the substrate, and a hole formed in the first insulating layer. An emitter electrode provided on the substrate, a gate electrode formed on the upper surface of the first insulating layer and having a gate hole corresponding to the hole, and a gate electrode formed on the upper surface of the gate electrode and In a method for manufacturing a field emission device including a second insulating layer in which corresponding holes are formed, and a focusing electrode formed on an upper surface of the second insulating layer, a first insulating layer is provided on the substrate. Forming a gate electrode, a second insulating layer, a focusing electrode, and a release layer by sequentially laminating them; forming a resist layer on the surface of the release layer to form an opening in the resist layer; Layer, focusing electrode, second insulating layer, gate electrode and first Processing the edge layer with a gas cluster ion beam to form the holes; depositing an emitter material from the release layer side to form an emitter electrode in the holes; A step of removing the attached emitter material together with the release layer.

【0014】本発明によれば、前記各方法において、基
板はカソード電極を含んでいてもよいし、カソード電極
と抵抗層を含んでいてもよい。
According to the present invention, in each of the above methods, the substrate may include a cathode electrode, or may include a cathode electrode and a resistive layer.

【0015】[0015]

【実施例】本発明の一実施例を図1及び図2を参照して
説明する。図1(a)に示すように、Si基板1の表面
にSiO2 の酸化膜からなる絶縁層2を形成し、その上
にNb膜からなるゲート電極としてのゲート層3を形成
する。ゲート層3の上には、アルミニウムからなる剥離
層4を真空蒸着又はスパッタ法等により形成する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS One embodiment of the present invention will be described with reference to FIGS. As shown in FIG. 1 (a), an insulating layer 2 made of an oxide film of SiO 2 on the surface of the Si substrate 1, to form the gate layer 3 as a gate electrode made of Nb film thereon. On the gate layer 3, a release layer 4 made of aluminum is formed by vacuum deposition or sputtering.

【0016】図1(b)に示すように、前記剥離層4の
上にレジスト層5を塗布し、図示しないマスクを介した
露光の後に現像して所定パターンの開口部6を形成す
る。
As shown in FIG. 1B, a resist layer 5 is applied on the release layer 4 and developed after exposure through a mask (not shown) to form an opening 6 having a predetermined pattern.

【0017】所定パターンの開口部6が形成された前記
レジスト層5をマスクとして、ガスクラスターイオンビ
ームによって、図1(c)に示すようにSi基板1の表
面があらわれるまでエッチングを行い、絶縁層2の空孔
7と該空孔7に対応するゲート層3のゲート孔8を形成
する。なお、レジスト層5がエッチング終了後に剥離層
4の上に残るようにすれば、オーバーエッチングを防止
することができる。
Using the resist layer 5 in which the openings 6 of the predetermined pattern are formed as a mask, etching is performed by a gas cluster ion beam until the surface of the Si substrate 1 is exposed as shown in FIG. Two holes 7 and gate holes 8 of the gate layer 3 corresponding to the holes 7 are formed. If the resist layer 5 is left on the peeling layer 4 after the completion of the etching, over-etching can be prevented.

【0018】図2は、図1(c)の工程で用いられるガ
スクラスターイオンビーム装置11を示す。略筒状の本
体12の内部は、排気手段13,14,15によって高
真空状態に排気されるようになっている。該本体12の
一端にある導入部16は、内径0.1mm程度以下の細
いノズルを有しており、該ノズルから本体12の内部に
数気圧の圧力でガスが噴射されるようになっている。そ
して、このガスは、クラスター発生部17及びイオン化
部18に導かれる。ここで形成されたガスクラスターイ
オンは、偏向系19,19、レンズ系20、質量分離系
21及び加速管22を経て加速され、本体12内の他端
に設けられたターゲットとしての前記Si基板1に照射
される。
FIG. 2 shows a gas cluster ion beam apparatus 11 used in the step of FIG. The inside of the substantially cylindrical main body 12 is evacuated to a high vacuum state by exhaust means 13, 14, 15. The introduction portion 16 at one end of the main body 12 has a thin nozzle with an inner diameter of about 0.1 mm or less, and gas is injected from the nozzle into the main body 12 at a pressure of several atmospheres. . Then, this gas is guided to the cluster generation unit 17 and the ionization unit 18. The gas cluster ions formed here are accelerated through deflection systems 19 and 19, a lens system 20, a mass separation system 21 and an accelerating tube 22, and the Si substrate 1 as a target provided at the other end in the main body 12 Is irradiated.

【0019】ここで、Si基板1に照射されるガスクラ
スターイオンにおいて、クラスターを構成している原子
の内、1個の原子が電荷を持っている。すなわち、数百
から数千個の原子の集団の内の1個の原子をイオン化さ
せるので、ガスクラスターイオンはあたかも数百から数
千倍の質量を持った塊としてターゲットに作用する。こ
の場合、クラスターを構成する原子は互いに弱く結合し
ており、その数を今Nとすると、エネルギーはN分の
1、電荷質量比もN分の1になるので、等価的に低エネ
ルギーが得られる。
Here, in the gas cluster ions irradiated to the Si substrate 1, one of the atoms constituting the cluster has an electric charge. That is, since one atom of a group of hundreds to thousands of atoms is ionized, the gas cluster ions act on the target as a mass having a mass several hundred to several thousand times. In this case, the atoms constituting the cluster are weakly bonded to each other, and if the number is N, the energy becomes 1 / N and the charge-mass ratio becomes 1 / N. Can be

【0020】従って、本製造方法において絶縁層2とゲ
ート層3のエッチング工程にガスクラスターイオンビー
ムを用いると、次のような効果が得られる。 1)数eVから数百eVの低エネルギーのビームで照射
することが出来る。 2)小電流で多量の原子が輸送出来る。 3)絶縁物のエッチングが可能。 4)高いスパッタ率が得られる(百倍以上)。 5)エッチングガスとしてAr,CO2 ,N2 等反応性
や吸着性の弱いガスを用いることが出来る。
Therefore, when the gas cluster ion beam is used in the etching process of the insulating layer 2 and the gate layer 3 in the present manufacturing method, the following effects can be obtained. 1) Irradiation can be performed with a low energy beam of several eV to several hundred eV. 2) A large amount of atoms can be transported with a small current. 3) Insulating material can be etched. 4) A high sputtering rate is obtained (100 times or more). 5) As the etching gas, a gas having low reactivity or adsorptivity such as Ar, CO 2 , N 2 can be used.

【0021】次に残ったレジスト層5を除去した後、図
1(d)に示すように、電子ビーム蒸着法等の手段によ
り、Si基板1に対して垂直上方からエミッタ材料とし
てのMoを蒸着し、絶縁層2の空孔7内にコーン形状の
エミッタ電極9を形成する。
Next, after removing the remaining resist layer 5, Mo as an emitter material is vapor-deposited on the Si substrate 1 from above vertically by means such as an electron beam vapor deposition method as shown in FIG. Then, a cone-shaped emitter electrode 9 is formed in the hole 7 of the insulating layer 2.

【0022】最後に、図1(e)に示すように、剥離層
4とともにゲート層3上のMoを除去し、電界放出素子
10が完成する。
Finally, as shown in FIG. 1E, Mo on the gate layer 3 is removed together with the release layer 4, and the field emission device 10 is completed.

【0023】以上説明した一実施例では、基板としてS
i基板を用いたが、ガラス基板も利用できる。その場
合、ガラス基板の上面に金属薄膜からなるエミッタ用電
極を設け、その上にCVD等によってSiO2 等の絶縁
層を形成すればよい。さらに、エミッタ用電極と各エミ
ッタの間に抵抗層を設けるようにしてもよい。
In one embodiment described above, the substrate is S
Although an i-substrate was used, a glass substrate can also be used. In that case, an emitter electrode made of a metal thin film may be provided on the upper surface of the glass substrate, and an insulating layer such as SiO 2 may be formed thereon by CVD or the like. Further, a resistance layer may be provided between the emitter electrode and each emitter.

【0024】前記一実施例は、Si基板1上にエミッタ
電極9とゲート層3の2極を有する構造の電界放出素子
10に関するものであったが、本発明の製造方法は3極
構造の素子にも適用しうる。例えば、前記ゲート層3の
上に第2の絶縁層を介して制御電極としての集束電極が
設けられ、ゲート層3のゲート孔8に対応する孔が第2
の絶縁層と集束電極に形成された電界放出素子の製造に
対しても本発明は有用である。
The above-described embodiment relates to the field emission device 10 having the structure in which the emitter electrode 9 and the gate layer 3 are formed on the Si substrate 1. It can also be applied to For example, a focusing electrode as a control electrode is provided on the gate layer 3 with a second insulating layer interposed therebetween, and a hole corresponding to the gate hole 8 of the gate layer 3 is formed as a second electrode.
The present invention is also useful for manufacturing a field emission device formed on the insulating layer and the focusing electrode.

【0025】このような3極構造の電界放出素子の製造
方法においては、まず、基板上に第一の絶縁層とゲート
電極と第二の絶縁層と集束電極と剥離層を順次積層して
形成する。次に、前記剥離層の表面にレジスト層を形成
して該レジスト層に所定パターンの開口部を形成する。
そして、前記レジスト層をマスクとして、前記剥離層と
集束電極と第二の絶縁層とゲート電極と第一の絶縁層に
対し、前記基板に到達する連続した孔をガスクラスタイ
オンビームで形成する。
In the method for manufacturing such a three-electrode field emission device, first, a first insulating layer, a gate electrode, a second insulating layer, a focusing electrode, and a release layer are sequentially laminated on a substrate. I do. Next, a resist layer is formed on the surface of the release layer, and an opening having a predetermined pattern is formed in the resist layer.
Then, using the resist layer as a mask, continuous holes reaching the substrate are formed in the release layer, the focusing electrode, the second insulating layer, the gate electrode, and the first insulating layer by a gas cluster ion beam.

【0026】上記の工程により、前記第1の絶縁層及び
ゲート電極には、前記第1実施例と同様の空孔及びゲー
ト孔が形成される。さらに第2の絶縁層、集束電極及び
剥離層にも、これら空孔及びゲート孔に対応する孔が形
成される。
Through the above steps, the same holes and gate holes as in the first embodiment are formed in the first insulating layer and the gate electrode. Further, holes corresponding to these holes and gate holes are also formed in the second insulating layer, the focusing electrode, and the release layer.

【0027】次に、前記剥離層側からエミッタ材料を基
板に垂直に蒸着して前記空孔内にエミッタ電極を形成す
る。そして最後に、前記剥離層上に被着したエミッタ材
料を該剥離層とともに除去する。
Next, an emitter material is vertically deposited on the substrate from the release layer side to form an emitter electrode in the hole. Finally, the emitter material deposited on the release layer is removed together with the release layer.

【0028】[0028]

【発明の効果】本発明によれば、基板上に積層させた絶
縁層やゲート電極等に、ガスクラスタイオンビームを用
いて基板に達する連続した開口部を容易に形成できる。
According to the present invention, a continuous opening reaching a substrate can be easily formed in an insulating layer, a gate electrode or the like laminated on the substrate by using a gas cluster ion beam.

【0029】このため、従来のように、剥離層を膜質制
御の困難な斜め蒸着法で形成する必要がなく、面積の大
きい基板の全面にわたって膜質・開口形状の均一な剥離
層を形成できる。
Therefore, unlike the conventional case, it is not necessary to form the peeling layer by the oblique deposition method in which it is difficult to control the film quality, and it is possible to form a peeling layer having a uniform film quality and opening shape over the entire surface of a substrate having a large area.

【0030】従って、エミッタ電極を再現性よく形成で
き、特性のよい電界放出素子を形成することができる。
また、工程、設備が簡略化されるので、量産性に優れて
いる。さらに、ガスクラスタイオンビームに使用される
ガスが、Ar,CO2 ,N2など無害な不活性ガスであ
ることから、ガスを貯蔵するための設備等が簡単で、電
界放出素子の製造工程に容易に組み込むことができる。
Therefore, the emitter electrode can be formed with good reproducibility, and a field emission device having good characteristics can be formed.
In addition, since the steps and equipment are simplified, mass productivity is excellent. Further, since the gas used for the gas cluster ion beam is a harmless inert gas such as Ar, CO 2 , and N 2 , equipment for storing the gas is simple, and the gas is used in the manufacturing process of the field emission device. Can be easily incorporated.

【0031】さらに、ガスクラスタインビームに使用さ
れる前述したような不活性ガスは、ハロゲン等のように
吸着性、反応性の強いガスと異なり、電界放出素子の特
性に悪影響を及ぼすことがないので、開口部の洗浄工程
を簡略化または不要とすることができる。
Further, the above-mentioned inert gas used for the gas cluster in-beam does not adversely affect the characteristics of the field emission device, unlike a gas having a high adsorptivity and reactivity such as halogen. Therefore, the step of cleaning the opening can be simplified or unnecessary.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施例を示す工程図である。FIG. 1 is a process chart showing one embodiment of the present invention.

【図2】本発明の一実施例で用いられるガスクラスタイ
オンビーム装置の概略図である。
FIG. 2 is a schematic view of a gas cluster ion beam apparatus used in one embodiment of the present invention.

【図3】従来の電界放出素子の製造方法の一例を示す工
程図である。
FIG. 3 is a process chart showing an example of a conventional method for manufacturing a field emission device.

【符号の説明】[Explanation of symbols]

1 基板としてのSi基板 2 絶縁層 3 ゲート電極としてのゲート層 4 剥離層 5 レジスト層 6 開口部 7 空孔 8 ゲート孔 9 エミッタ電極 10 電界放出素子 Reference Signs List 1 Si substrate as substrate 2 Insulating layer 3 Gate layer as gate electrode 4 Release layer 5 Resist layer 6 Opening 7 Vacancy 8 Gate hole 9 Emitter electrode 10 Field emission device

Claims (4)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 基板と、前記基板上に設けられた絶縁層
と、前記絶縁層に形成された空孔の内部において前記基
板上に設けられたエミッタ電極と、前記絶縁層の上面に
形成されて前記空孔に対応したゲート孔を有するゲート
電極を備えた電界放出素子の製造方法において、 前記基板上に絶縁層とゲート電極と剥離層を順次積層し
て形成する工程と、前記剥離層の表面にレジスト層を形
成して該レジスト層に開口部を形成する工程と、前記剥
離層とゲート電極と絶縁層をガスクラスタイオンビーム
で加工して前記ゲート孔及び空孔を形成する工程と、前
記剥離層側からエミッタ材料を蒸着して前記空孔内にエ
ミッタ電極を形成する工程と、前記剥離層上に被着した
エミッタ材料を該剥離層とともに除去する工程を有する
ことを特徴とする電界放出素子の製造方法。
A substrate, an insulating layer provided on the substrate, an emitter electrode provided on the substrate inside holes formed in the insulating layer, and an upper surface of the insulating layer. A method for manufacturing a field emission device including a gate electrode having a gate hole corresponding to the hole, a step of sequentially laminating and forming an insulating layer, a gate electrode, and a release layer on the substrate; Forming a resist layer on the surface to form openings in the resist layer, and forming the gate holes and holes by processing the release layer, the gate electrode, and the insulating layer with a gas cluster ion beam, Forming an emitter electrode in the hole by depositing an emitter material from the release layer side, and removing the emitter material deposited on the release layer together with the release layer. Release Manufacturing method for the device.
【請求項2】 基板と、前記基板上に設けられた第一の
絶縁層と、前記第一の絶縁層に形成された空孔の内部に
おいて前記基板上に設けられたエミッタ電極と、前記第
一の絶縁層の上面に形成されて前記空孔に対応したゲー
ト孔を有するゲート電極と、前記ゲート電極の上面に形
成されて前記ゲート孔に対応する空孔が形成された第二
の絶縁層と、前記第二の絶縁層の上面に形成された集束
電極を備えた電界放出素子の製造方法において、 前記基板上に第一の絶縁層とゲート電極と第二の絶縁層
と集束電極と剥離層を順次積層して形成する工程と、前
記剥離層の表面にレジスト層を形成して該レジスト層に
開口部を形成する工程と、前記剥離層と集束電極と第二
の絶縁層とゲート電極と第一の絶縁層をガスクラスタイ
オンビームで加工して前記空孔を形成する工程と、前記
剥離層側からエミッタ材料を蒸着して前記空孔内にエミ
ッタ電極を形成する工程と、前記剥離層上に被着したエ
ミッタ材料を該剥離層とともに除去する工程を有するこ
とを特徴とする電界放出素子の製造方法。
2. A substrate, a first insulating layer provided on the substrate, an emitter electrode provided on the substrate inside a hole formed in the first insulating layer, A gate electrode formed on the upper surface of one insulating layer and having a gate hole corresponding to the hole, and a second insulating layer formed on the upper surface of the gate electrode and having a hole corresponding to the gate hole formed therein And a method of manufacturing a field emission device having a focusing electrode formed on the upper surface of the second insulating layer, wherein the first insulating layer, the gate electrode, the second insulating layer, the focusing electrode, and the Forming a layer by sequentially stacking layers; forming a resist layer on the surface of the release layer to form an opening in the resist layer; and forming the release layer, the focusing electrode, the second insulating layer, and the gate electrode. Before processing the first insulating layer with a gas cluster ion beam Forming a hole, depositing an emitter material from the release layer side to form an emitter electrode in the hole, and removing the emitter material deposited on the release layer together with the release layer A method for manufacturing a field emission device, comprising:
【請求項3】 前記基板がエミッタ電極に通電するため
のカソード電極を含むことを特徴とする請求項1または
請求項2記載の電界放出素子の製造方法。
3. The method according to claim 1, wherein the substrate includes a cathode electrode for supplying a current to the emitter electrode.
【請求項4】 前記基板がエミッタ電極に通電するため
のカソード電極と該カソード電極の上面または側面に形
成された抵抗層を含むことを特徴とする請求項1または
請求項2記載の電界放出素子の製造方法。
4. The field emission device according to claim 1, wherein the substrate includes a cathode electrode for supplying a current to the emitter electrode, and a resistive layer formed on an upper surface or a side surface of the cathode electrode. Manufacturing method.
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