JP2003116069A - 画像信号処理装置 - Google Patents
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
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- H04N25/71—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors
- H04N25/75—Circuitry for providing, modifying or processing image signals from the pixel array
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- G03B—APPARATUS OR ARRANGEMENTS FOR TAKING PHOTOGRAPHS OR FOR PROJECTING OR VIEWING THEM; APPARATUS OR ARRANGEMENTS EMPLOYING ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ACCESSORIES THEREFOR
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Abstract
する。 【解決手段】 信号処理回路9の前段に第1のレギュレ
ート回路22を配置し、出力回路14の前段に第2のレ
ギュレート回路23を配置する。第1のレギュレート回
路22は、電源電圧VDDを取り込んで第1の電圧VAを
発生し、信号処理回路9に供給する。第2のレギュレー
ト回路23は、電源電圧VDDを取り込んで第2の電圧V
Bを発生し、出力回路14に供給する。出力回路14
は、第2の電圧VBを受けて動作し、画像信号Y’(n)を
外部機器に出力する。
Description
用いた撮像装置に係り、特に、固体撮像素子から出力さ
れる画像信号に対して所定の信号処理を施し、所定のフ
ォーマットに従う画像信号を外部機器に出力する画像信
号処理装置に関する。
を用いたデジタルスチルカメラ等の撮像装置において
は、動作電源にバッテリが用いられる。このようなバッ
テリは、出力電圧の幅が限られているため、CCDイメ
ージセンサの駆動用にレギュレート回路や昇圧回路が設
けられる。図6は、水平ドライバ8、信号処理回路9、
タイミング制御回路13及び出力回路を内蔵する信号処
理装置7を示すものであり、この信号処理装置7を採用
する撮像装置の構成を示すブロック図である。ここに示
す撮像装置は、レギュレート回路2が入力側に設けら
れ、バッテリから供給される電源電圧をレギュレート回
路2で所定の電圧に変換し、レギュレート回路2から供
給される単一の動作電圧で動作するように構成されてい
る。
ーム転送型であり、撮像部、蓄積部、水平転送部及び出
力部より構成される。撮像部は、入射される光に応答し
て発生する情報電荷を複数の受光画素に蓄積する。蓄積
部は、撮像部から取り込んだ1画面分の情報電荷を一時
的に保持する。水平転送部は、蓄積部から出力された情
報電荷を逐次取り込み、水平方向に転送して順次1画素
単位で出力する。出力部は、水平転送部から出力された
情報電荷を、1画素単位で電荷量に対応する電圧値に変
換し、画像信号Y(t)として出力する。
バ6よりなり、昇圧回路4及び垂直ドライバ6の各回路
が同一の半導体基板上に形成されて構成される。
給される調整電圧VK(例えば、2.9V)を所定の電圧
に昇圧して、CCDイメージセンサ3に供給すると共
に、垂直ドライバ6に供給する。この昇圧回路5は、正
電圧発生用チャージポンプと負電圧発生用チャージポン
プとを含み、正電圧発生用チャージポンプで調整電圧V
Kを正電圧側の所定電圧VOH(例えば、5V)に昇圧
し、負電圧発生用チャージポンプで調整電圧VKを負電
圧側の所定電圧VOL(例えば、−5V)に昇圧する。
ポンプで生成された負電圧側の所定電圧VOLを受けて動
作し、フレーム転送クロックφf及び垂直転送クロック
φvを生成してCCDイメージセンサ3の撮像部及び蓄
積部に供給する。ここで、フレーム転送クロックφf及
び垂直転送クロックφvは、タイミング制御回路13か
ら供給されるフレームシフトタイミング信号FT、垂直
同期信号VT及び水平同期信号HTに従うタイミングで
生成される。これにより、撮像部に蓄積される情報電荷
がフレームシフトタイミング信号FTに従うタイミング
で蓄積部にフレーム転送され、蓄積部に保持される情報
電荷が垂直同期信号VT及び水平同期信号HTに従うタ
イミングで水平転送部にライン転送される。
ら供給される調整電圧VKを受けて動作し、水平転送ク
ロックφhを生成してCCDイメージセンサ3の水平転
送部に供給する。ここで、水平転送クロックφhは、タ
イミング制御回路13から供給される垂直同期信号及び
水平同期信号に従うタイミングで生成される。これによ
り、水平転送部に取り込まれた情報電荷が、水平同期信
号HTに従うタイミングで順次1画素単位で水平転送さ
れて、画像信号Y(t)として出力される。
A/D変換器11及びデジタル処理部12から構成さ
れ、レギュレート回路2から供給される調整電圧VKを
受けて動作する。アナログ処理部10は、CCDイメー
ジセンサ3から出力される画像信号Y(t)を取り込ん
で、サンプルホールド、ゲイン調整等の各種のアナログ
信号処理を施す。A/D変換器11は、アナログ信号処
理の施された画像信号Y(t)を取り込み、1画素毎にデ
ジタル信号に変換し、画像データY(n)を生成する。デ
ジタル処理部12は、画像データY(n)に対して所定の
マトリクス処理を施し、輝度データと色データとを生成
した後、輝度データに対して輪郭補正やガンマ補正等の
処理を施して、画像データY'(n)を出力する。
回路2から供給される調整電圧VKで動作し、一定周期
の基準クロックCKを分周して、CCDイメージセンサ
3の垂直走査及び水平走査のタイミングを決定する。そ
して、決定したタイミングに従って、垂直同期信号VT
及び水平同期信号HTを生成すると共に、垂直同期信号
VTに一致する周期でフレームシフト信号FTを生成す
る。
作し、信号処理回路9から出力される画像データY’
(n)を取り込んで、CPU(Central Processing Unit)
16、メモリ17、ディスプレイドライバ18の外部機
器にシステムバス15を介して出力する。CPU16
は、外部から命令される指示に応答して、撮像装置、メ
モリ17、ディスプレイドライバ18の動作を制御する
制御装置である。メモリ17は、例えば、フラッシュメ
モリ、メモリカード等の脱着可能なリムーバブルメモ
リ、ハードディスク等の固定メモリであり、撮像装置か
ら出力される画像データY'(n)を記憶する。ディスプレ
イドライバ18は、撮像装置から出力される画像データ
Y'(n)を受けて表示パネル19を駆動し、再生画像を表
示する。
次のように動作する。先ず、バッテリからの電源電圧V
DD(例えば、3.2V)が供給されると、レギュレート
回路2に取り込まれ、電源電圧VDDよりも低い調整電圧
VK(例えば、2.9V)に調整されて出力される。次い
で、この調整電圧VKは、駆動装置4及び信号処理装置
7内の各回路に供給される。
Kは、正電圧発生用チャージポンプで正電圧側の所定電
圧(例えば、5V)に昇圧されて電子シャッタ用の排出
電圧としてCCDイメージセンサ3に供給される。ま
た、駆動回路5に取り込まれた調整電圧VKは、負電圧
発生用チャージポンプで負電圧側の所定の電圧(例え
ば、−5V)に昇圧されて垂直ドライバ6に供給され
る。そして、垂直ドライバ6を動作させ、CCDイメー
ジセンサ3のフレーム転送及びライン転送に必要なクロ
ックパルスφf、φvが生成され、撮像部及び蓄積部に
供給される。
電圧VKは、水平ドライバ8、信号処理回路9、タイミ
ング制御回路13及び出力回路14の各回路に取り込ま
れ、各回路を動作させる。タイミング制御回路13で、
各種のタイミング信号が生成されて各回路に供給され、
水平ドライバ8でCCDイメージセンサ3の水平転送に
必要なクロックパルスφhが生成される。また、信号処
理回路9でCCDイメージセンサ3から出力される画像
信号Y(t)に対して所定のアナログ信号処理及びデジタ
ル信号処理が施され、画像信号Y'(n)が出力回路14か
らシステムバス15を介して出力される。
載される信号処理装置においては、バッテリからの電源
電圧をレギュレート回路で所定の調整電圧に調整した後
に、信号処理装置を構成するすべての回路に共通に供給
するように構成している。このため、信号処理装置内の
回路に供給される電源電圧は単一であり、レギュレート
回路では、通常、信号処理回路よりも動作電圧の高い出
力回路の動作電圧に合わせて調整電圧の電圧値が設定さ
れている。このため、信号処理回路は、レギュレート回
路で設定される調整電圧よりも低い電源電圧で動作する
にも拘わらず、それよりも高い電源電圧が供給されてお
り、不要な電力を消費している。これにより、撮像装置
全体としての消費電力を増大させているという問題があ
った。
信号処理回路及び出力回路のそれぞれに独立して電源電
圧を供給し、消費電力を低減することのできる画像信号
処理装置の提供を目的とする。
に鑑み、なされたもので、その特徴とするところは、固
体撮像素子から出力される画像信号に対して所定の信号
処理を施し、所定のフォーマットに従う画像信号を外部
機器に出力する画像信号処理装置において、電源電圧を
取り込んで前記固体撮像素子の出力レベルに応じた第1
の電圧を発生する第1のレギュレート回路と、前記電源
電圧を取り込んで前記外部機器の入力レベルに応じた第
2の電圧を発生する第2のレギュレート回路と、前記第
1の電圧を受けて動作し、前記固体撮像素子から出力さ
れる画像信号に対して所定の信号処理を施す信号処理回
路と、前記第2の電圧を受けて動作し、前記信号処理回
路で信号処理の施された画像信号を出力する出力回路
と、を備えたことにある。
のレギュレート回路から第1の電圧を供給し、出力回路
に対して第2のレギュレート回路から第2の電圧を供給
する。これにより、信号処理回路及び出力回路のそれぞ
れに対し、適した電圧を独立して供給することができ
る。
号に対して所定の信号処理を施し、所定のフォーマット
に従う画像信号を外部機器に出力する画像信号処理装置
において、前記固体撮像素子の出力レベルに応じた電源
電圧を取り込んで前記外部機器の入力レベルに応じた調
整電圧を発生するレギュレート回路と、前記電源電圧を
受けて動作し、前記固体撮像素子から出力される画像信
号に対して所定のアナログ信号処理を施すアナログ処理
回路と、前記調整電圧を受けて動作し、前記アナログ信
号処理の施された後にデジタル信号に変換された画像信
号に対して所定のデジタル信号処理を施すデジタル処理
回路と、前記調整電圧を受けて動作し、前記デジタル信
号処理の施された画像信号を出力する出力回路と、を備
えたことを特徴とする。
ながら、各回路に適した電圧を供給することができる。
を採用する撮像装置の構成を示すブロック図である。
尚、この図において、図4と同一の構成については同じ
符号が付してある。本願発明の特徴とするところは、信
号処理装置21内の信号処理回路9及び出力回路14に
対して、それぞれレギュレート回路を設け、各回路に独
立して電源電圧を供給することにある。
号処理回路9、タイミング制御回路13及び出力回路1
4から構成され、CCDイメージセンサ3から出力され
る画像信号Y(t)に対して所定の信号処理を施し、信号
処理の施された画像信号をメモリ17やディスプレイド
ライバ18等の外部機器に出力する。更に、信号処理装
置21は、第1及び第2のレギュレート回路22、23
を有し、水平ドライバ8及び信号処理回路9の前段に第
1のレギュレート回路22が接続され、出力回路14の
前段に第2のレギュレート回路23が接続される。
3から供給される水平同期信号HTに従うタイミング
で、水平転送クロックφhを生成し、CCDイメージセ
ンサ3の水平転送部に供給する。
A/D変換器11、デジタル処理部12から構成され
る。この信号処理回路9は、CCDイメージセンサ3の
出力レベルに応じた第1の電圧で動作し、CCDイメー
ジセンサ3から出力される画像信号に対して、所定の信
号処理を施す。アナログ処理部10は、CCDイメージ
センサ3から出力される画像信号Y(t)に対して、CD
S(Correlated Double Sampling:相関二重サンプリン
グ)、AGC(Automatic Gain Control:自動利得制
御)等のアナログ信号処理を施す。CDSでは、リセッ
トレベルと信号レベルとを繰り返す画像信号Y(t)に対
し、リセットレベルをクランプした後に信号レベルを取
り出すようにして、信号レベルの連続する画像信号を生
成する。AGCでは、CDSで取り出された画像信号を
1画面或いは、1垂直走査期間単位で積分して、その積
分データを所定の範囲内に収めるようにゲインのフィー
ドバック制御を行う。A/D変換器11は、アナログ処
理部10から出力される画像信号をCCDイメージセン
サ3の出力タイミングに同期して規格化し、デジタル信
号の画像データY(n)を出力する。
に対して、色分離、マトリクス演算等の処理を施し、輝
度信号及び色差信号を含む画像データY'(n)を生成す
る。例えば、色分離処理においては、CCDイメージセ
ンサ3の撮像部に装着されるカラーフィルタの色配列に
従って画像データY(n)を振り分け、複数の色成分信号
を生成する。また、マトリクス演算処理においては、振
り分けた各色成分を合成して輝度信号を生成すると共
に、各色成分から輝度成分を差し引いて色差信号を生成
する。
準クロックCKをカウントする複数のカウンタから構成
され、CCDイメージセンサ3の垂直走査及び水平走査
のタイミングを決定する。タイミング制御回路13は、
クロック供給端子(図示せず)を介して供給される基準
クロックCKを分周して、フレームタイミング信号F
T、垂直同期信号VT及び水平同期信号HTを生成し、
垂直ドライバ6及び水平ドライバ8に供給する。また、
タイミング制御回路13は、アナログ処理部10、A/
D変換器11及びデジタル処理部12に対してタイミン
グ信号を供給し、各回路の動作をCCDイメージセンサ
3の動作タイミングに同期させる。
イドライバ18等の外部機器の入力レベルに対応する第
2の電圧で動作し、信号処理回路9から出力される画像
データY’(n)を、システムバス12を介して外部機器
に出力する。
3は、電源供給端子を介してバッテリ(図示せず)から
供給される電源電圧VDDを取り込んで所定の調整電圧を
生成する。これら第1及び第2のレギュレート回路2
2、23は、次段の回路に合わせて出力電圧が設定され
ている。具体的には、第1のレギュレート回路22は、
その出力電圧が次続の水平ドライバ8及び信号処理回路
9の最適動作電圧(例えば、2.0〜2.5V)と同等と
なるように設定されており、第1の電圧VAを出力す
る。第2のレギュレート回路23においても、その出力
電圧が出力回路14の最適動作電圧(例えば、2.9
V)、即ち、外部機器の入力レベルに対応するように設
定されており、第1の電圧VAより電圧値の高い第2の
電圧VBを出力する。
2、23は、出力回路14と繋がるシステムバス15の
使用状態に応じて動作するように構成されている。具体
的には、システムバス15を介してデータやコントロー
ル信号の伝達が行われず、システムバス15が使用され
ないとき、第1及び第2の電圧VA、VBの出力を停止す
る。即ち、第1及び第2のレギュレート回路22、23
は、システムバス15の状態を示す制御信号REを受け
て動作するように構成され、制御信号REがシステムバ
ス15の未使用状態を示すとき、第1及び第2の電圧V
A、VBの出力を停止する。この構成によれば、CCDイ
メージセンサ3及び外部機器が停止しており、システム
バス15が使用されないときに、信号処理回路9及び出
力回路14に対して、電源電圧が供給されるのが防止さ
れる。これは、信号処理装置が外部に接続されるバッテ
リを電源として動作している場合に有効である。バッテ
リを電源として用いる場合、CCDイメージセンサ3及
び外部機器を含むシステム全体が停止しているにも拘わ
らず、信号処理装置に電源電圧が供給され得る。従っ
て、信号処理回路9及び出力回路14が動作を停止して
いても、回路内部で電流リークが発生することがあり、
実質的には電力が消費されている。そこで、CCDイメ
ージセンサ3及び外部機器が停止中に、第1及び第2の
電圧のVA、VBの出力を停止することで、信号処理回路
9及び出力回路14内で発生する電流リークを確実に防
止し、電力消費を抑制することができる。
21は、次のように動作する。先ず、バッテリからの電
源電圧VDD(例えば、3.2V)が供給されると、電源
電圧VDDが第1及び第2のレギュレート回路22、23
に取り込まれる。第1のレギュレート回路22に供給さ
れた電源電圧VDDは、水平ドライバ8及びアナログ回路
9の最適動作電圧と同等の第1の電圧VAに変換され
る。そして、第1の電圧VAは、水平ドライバ8及び信
号処理回路9に供給され、水平ドライバ8及び信号処理
回路9が動作する。
電源電圧VDDは、外部機器の入力レベルに応じた第2の
電圧VBに変換される。そして、第2の電圧VBは、出力
回路14に供給され、出力回路14が動作する。
レギュレート回路を設け、信号処理回路9及び出力回路
14の各回路に対してそれぞれレギュレート回路を配置
することで、独立して電源電圧を供給することができ
る。これにより、信号処理回路9及び出力回路14の各
回路に対して互いに異なる電源電圧を供給することがで
き、消費電力の低減を図ることができる。更に、レギュ
レート回路の出力電圧の設定を、信号処理回路9及び出
力回路14の各回路の最適な動作電圧に対応付けること
により、それぞれに最適な電源電圧を供給することがで
きる。これにより、各回路の動作特性の向上を図ること
ができる。
22、23の一例を示す回路構成図である。第1及び第
2のレギュレート回路22、23の各回路は、基本的に
同一の構成であり、接続切換部31、Pチャンネル型ト
ランジスタ32、抵抗器列33、コンパレータ34及び
基準電圧発生部35で構成される。接続切換部31は、
電源供給端子とPチャンネル型トランジスタ32との間
に接続される。Pチャンネル型トランジスタ32は、接
続切換部31とレギュレート回路の出力端子との間に接
続され、ゲートがコンパレータ34の出力端子に接続さ
れる。抵抗器列33は、Pチャンネル型トランジスタ3
2のドレインと接地側との間に抵抗器33a及び抵抗器
33bが直列に接続されて構成され、抵抗器33aと抵
抗器33bとの中間点がコンパレータ34の非反転入力
端子に接続される。基準電圧発生部35は、コンパレー
タ34の反転入力端子に接続される。
3は、次のように動作する。ここで、抵抗器33a及び
抵抗器33bの抵抗値をそれぞれR1、R2とする。先
ず、電源供給端子を介して電源電圧VDDが供給される
と、Pチャンネル型トランジスタ32がオンし、電源電
圧VDDが抵抗器列33に供給される。次いで、抵抗器列
33によって電源電圧VDDが分圧されて、抵抗器列33
の中間点の電位VXがVX=(R2/(R1+R2))・V
DDとなり、コンパレータ34の非反転入力端子に供給さ
れる。
と反転入力端子に供給される基準電圧VRとの電位差に
応じて動作し、分圧電圧VXと基準電圧VRが等しくなる
ようにPチャンネル型トランジスタ32のオン抵抗を制
御する。具体的には、基準電圧VRよりも分圧電圧VXの
方が高い場合にPチャンネル型トランジスタ32をオン
する方向に動作し、基準電圧VRよりも分圧電圧VXの方
が低い場合にPチャンネル型トランジスタ32をオフす
る方向に動作する。そして、抵抗器列33を構成する各
抵抗器33a、33bの抵抗値R1、R2の比と、基準電
圧発生部35から出力される基準電圧VRとによって、
一定の電圧VOUT=((R1+R2)/R2)・VRがレギュ
レート回路の出力端子側に生成され、調整電圧として次
段の回路に供給される。
る調整電圧は、抵抗器列33の分圧比及び基準電圧VR
によって決定される。従って、第1及び第2のレギュレ
ート回路22、23の各回路において、次段の回路の最
適動作電圧に応じて、抵抗器列33の分圧比及び基準電
圧VRが設定され、各回路に適した調整電圧が生成され
る。
3の各回路は、上述の構成に加え、接続切換部31、コ
ンパレータ34及び基準電圧発生部35が、システムバ
ス15の使用状態に応じて動作するように構成されてい
る。具体的には、接続切換部31、コンパレータ34及
び基準電圧発生部35は、制御信号REを受けて動作
し、制御信号REがシステムバス15の使用中に対応す
るレベルを示すとき、接続切換部31が電源供給端子と
Pチャンネル型トランジスタ32とを接続し、基準電圧
発生部35が基準電圧VRを出力し、コンパレータ34
が分圧電圧VXと基準電圧VRとを等しくするように動作
する。一方、制御信号REがシステムバス15の未使用
に対応するレベルを示すとき、接続切換部31が電源供
給端子とPチャンネル型トランジスタ32との接続を遮
断し、コンパレータ34及び基準電圧発生部35がその
動作を停止する。
応じて、レギュレート回路を構成する各部の動作を停止
することで、信号処理回路9及び出力回路14での電流
リークを防止するだけでなく、レギュレート回路自体で
の電力消費を防止することができる。これにより、消費
電力を更に低減させることができる。
レギュレート回路22、23を信号処理装置21に内蔵
し、同一の半導体基板上に形成して1チップ構成として
いる。これにより、第1及び第2のレギュレート回路2
2、23を、信号処理装置21を構成する他の回路と共
に一括的に製造することができ、コストの低減や製造歩
留まりの向上を図ることができる。
図であり、本願発明の信号処理装置を採用する撮像装置
の構成を示すブロック図である。この図において、図1
と同一の構成については、同じ符号が付してあり、その
説明を割愛する。
信号処理回路9、タイミング制御回路13、出力回路1
4及び第1乃至第3のレギュレート回路22、23、4
1で構成される。この信号処理装置21’は、アナログ
処理部10及びA/D変換器11の前段に第1のレギュ
レート回路22を設け、出力回路14の前段に第2のレ
ギュレート回路23を設け、更に、デジタル処理部12
及びタイミング制御回路13の前段に第3のレギュレー
ト回路41を設ける。
処理部10及びA/D変換器11の最適な動作電圧(例
えば、2.5V)と同等の電圧を出力するように設定さ
れており、バッテリ(図示せず)からの電源電圧VD D
を取り込んで、第1の電圧VAを生成する。第2のレギ
ュレート回路23は、出力回路14の最適動作電圧(例
えば、2.9V)、即ち、外部機器の入力レベルに対応
する電圧を出力するように設定されており、バッテリか
らの電源電圧VDDを取り込んで、第1の電圧VAより電
圧値の高い第2の電圧VBを生成する。第3のレギュレ
ート回路41は、デジタル処理部12及びタイミング制
御回路13の最適な動作電圧(例えば、2.0V)と同
等の電圧を出力するように設定されており、バッテリか
らの電源電圧VDDを取り込んで、第1の電圧VAより電
圧値の低い第3の電圧VCを生成する。
タル処理部12の各部に対してレギュレート回路を配置
することで、アナログ処理部10及びデジタル処理部1
2の各部に適した電源電圧を供給することができる。こ
れにより、各部の信号処理動作における特性の向上を図
ることができる。更に、第3のレギュレート回路41
で、第1の電圧VAより電圧値の低い第3の電圧VCを生
成し、独立してデジタル処理部12に供給することで、
消費電力の低減を図ることができる。
2、23、41の各レギュレート回路は、図2に示すも
のと同一の構成であり、次段の回路の最適な動作電圧に
応じて抵抗器列の分圧比及び基準電圧発生部の基準電圧
が設定されていると共に、制御信号REを受けて動作す
るように構成される。即ち、制御信号REがシステムバ
ス15の使用の停止に対応するレベルを示すとき、第1
乃至第3の電圧VA〜VCの出力を停止すると共に、レギ
ュレート回路内部の基準電圧発生部及びコンパレータの
動作を停止する。これにより、システムバス15が未使
用のときのアナログ処理部10、デジタル処理部12及
び出力回路14における電流リークによる電力消費を防
止する共に、レギュレート回路自身における電力消費を
抑制する。
図であり、本願発明の信号処理装置を採用する撮像装置
の構成を示すブロック図である。尚、この図において、
図1乃至図3と同一の構成については、同じ符号が付し
てあり、その説明を割愛する。
3に示す第1の実施形態や第2の実施形態と相違する点
は、外部レギュレート回路2を設け、この外部レギュレ
ート回路2からの出力電圧を信号処理装置51内の水平
ドライバ8、アナログ処理部10及びA/D変換器11
に供給する点にある。
のと同一の構成を有し、その出力電圧(調整電圧VK)
を信号処理装置51に供給する。ただし、この第3の実
施形態では、調整電圧VKが水平ドライバ8、アナログ
処理部10及びA/D変換器11の最適な動作電圧(例
えば、2.5V)に合わせて設定されている。第3の実
施形態においては、この外部レギュレート回路2からの
出力電圧が、信号処理装置51に対する電源電圧となっ
ている。
1、21’と同様に、水平ドライバ8、信号処理回路
9、タイミング制御回路13及び出力回路14を有し、
デジタル処理部12の前段に第1のレギュレート回路2
2、出力回路14の前段に第2のレギュレート回路23
を設けて構成される。
処理部12及びタイミング制御回路13の最適な動作電
圧(例えば、2.0V)と同等の電圧を出力するように
設定されており、外部レギュレート回路2からの電源電
圧を取り込んで、第1の電圧VA’を生成する。第2の
レギュレート回路23は、図1及び図3と同様であり、
外部機器の入力レベルに応じた第2の電圧(VB)を生
成する。また、これら2つの内部レギュレート回路は、
図1及び図3のレギュレート回路と同様に、制御信号R
Eに受けて動作する。これにより、システムバス15が
未使用のときの電力消費を防止することができる。
施形態や第2の実施形態と同様に、信号処理装置51内
の各回路に適した電圧を供給することができる。これに
より、信号処理装置51の動作特性を向上させることが
できると共に、消費電力の低減を図ることができる。
図であり、本願発明の信号処理装置を採用する撮像装置
の構成を示すブロック図である。尚、この図において、
図1乃至図4と同一の構成については、同じ符号が付し
てあり、その説明を割愛する。
実施形態と相違する点は、信号処理装置61内のデジタ
ル信号処理部12、タイミング制御回路13及び出力回
路14で第1のレギュレート回路22を共有化する点に
ある。この第4の実施形態は、CPU16、メモリ17
等の外部機器の都合によって、外部機器の入力レベルが
デジタル処理部12、タイミング制御回路13と略同じ
電圧(例えば、2.0V、或いは、2.0V付近)とな
る場合に適用できる。
ュレート回路2からの出力電圧を取り込んで、デジタル
処理部12、タイミング制御回路13及び出力回路14
に適した動作電圧(例えば、2.0V)に合わせて設定
された第1の電圧VA’を生成する。また、この第1の
レギュレート回路22は、図1乃至図4に示す内部レギ
ュレート回路と同様に、制御信号REに受けて動作す
る。これにより、システムバス15が未使用のときの電
力消費を防止することができる。
縮小を可能としながら、先の第1乃至第3の実施形態と
同様の効果を得ることができる。
明の実施形態を説明した。以上の実施形態においては、
水平ドライバ8に対して、アナログ処理部10及びA/
D変換器11と同等の電圧を供給する構成としている
が、これに限られるものではない。例えば、CCDイメ
ージセンサ3の仕様によって、水平ドライバ8の最適な
動作電圧がアナログ処理部10及びA/D変換器11の
動作電圧よりもデジタル処理部12及びタイミング制御
回路13の動作電圧に近くなったような場合には、デジ
タル処理部12及びタイミング制御回路13と同等の電
圧を供給する構成としても良い。
力回路のそれぞれにレギュレート回路を設けることで、
信号処理回路及び出力回路の各回路に対して、独立して
電源電圧を供給することができる。これにより、不要な
電力消費を防止することができ、消費電力の低減を図る
ことができる。
願発明の信号処理装置を採用する撮像装置の構成を示す
ブロック図である。
図である。
願発明の信号処理装置を採用する撮像装置の構成を示す
ブロック図である。
願発明の信号処理装置を採用する撮像装置の構成を示す
ブロック図である。
願発明の信号処理装置を採用する撮像装置の構成を示す
ブロック図である。
る。
Claims (7)
- 【請求項1】 固体撮像素子から出力される画像信号に
対して所定の信号処理を施し、所定のフォーマットに従
う画像信号を外部機器に出力する画像信号処理装置にお
いて、 電源電圧を取り込んで前記固体撮像素子の出力レベルに
応じた第1の電圧を発生する第1のレギュレート回路
と、 前記電源電圧を取り込んで前記外部機器の入力レベルに
応じた第2の電圧を発生する第2のレギュレート回路
と、 前記第1の電圧を受けて動作し、前記固体撮像素子から
出力される画像信号に対して所定の信号処理を施す信号
処理回路と、 前記第2の電圧を受けて動作し、前記信号処理回路で信
号処理の施された画像信号を出力する出力回路と、を備
えたことを特徴とする画像信号処理装置。 - 【請求項2】 請求項1に記載の画像信号処理装置にお
いて、 前記第1及び第2のレギュレート回路は、前記出力回路
が接続されるバスの使用状態に応じて動作し、前記バス
の使用が停止されている間の少なくとも一部の期間に、
前記第1及び第2の電圧の出力を停止することを特徴と
する画像信号処理装置。 - 【請求項3】 請求項1又は請求項2に記載の画像信号
処理装置において、 前記電源電圧を取り込んで第3の電圧を発生する第3の
レギュレート回路を更に備え、 前記信号処理回路は、前記固体撮像素子から出力される
画像信号に対して所定のアナログ信号処理を施すアナロ
グ処理部と、前記アナログ信号処理が施された後にデジ
タル信号に変換された画像信号に対して所定のデジタル
信号処理を施すデジタル処理部と、を含み、 前記デジタル処理部は、前記第3の電圧を受けて動作す
ることを特徴とする画像信号処理装置。 - 【請求項4】 請求項3に記載の画像信号処理装置にお
いて、 前記第3のレギュレート回路は、前記第1の電圧より電
圧値の低い前記第3の電圧を出力することを特徴とする
画像信号処理装置。 - 【請求項5】 請求項3又は請求項4に記載の画像信号
処理装置において、 前記第3のレギュレート回路は、前記出力回路が接続さ
れるバスの使用状態に応じて動作し、前記バスの使用が
停止されている間の少なくとも一部の期間に、前記第3
の電圧の出力を停止することを特徴とする画像信号処理
装置。 - 【請求項6】 請求項1又は請求項2に記載の画像信号
処理装置において、 前記信号処理回路は、前記固体撮像素子から出力される
画像信号に対して所定のアナログ信号処理を施すアナロ
グ処理部と、前記アナログ信号処理が施された後にデジ
タル信号に変換された画像信号に対して所定のデジタル
信号処理を施すデジタル処理部と、を含み、 前記アナログ処理部は、前記電源電圧を受けて動作し、 前記デジタル処理部は、前記第1の電圧を受けて動作す
ることを特徴とする画像信号処理装置。 - 【請求項7】 固体撮像素子から出力される画像信号に
対して所定の信号処理を施し、所定のフォーマットに従
う画像信号を外部機器に出力する画像信号処理装置にお
いて、 前記固体撮像素子の出力レベルに応じた電源電圧を取り
込んで前記外部機器の入力レベルに応じた調整電圧を発
生するレギュレート回路と、 前記電源電圧を受けて動作し、前記固体撮像素子から出
力される画像信号に対して所定のアナログ信号処理を施
すアナログ処理回路と、 前記調整電圧を受けて動作し、前記アナログ信号処理の
施された後にデジタル信号に変換された画像信号に対し
て所定のデジタル信号処理を施すデジタル処理回路と、 前記調整電圧を受けて動作し、前記デジタル信号処理の
施された画像信号を出力する出力回路と、を備えたこと
を特徴とする画像信号処理装置。
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