DE10085374B4 - Systemmanagementspeicher für die Systemmanagement-Interrupt-Behandler wird in die Speichersteuereinrichtung integriert, unabhängig vom BIOS und Betriebssystem - Google Patents

Systemmanagementspeicher für die Systemmanagement-Interrupt-Behandler wird in die Speichersteuereinrichtung integriert, unabhängig vom BIOS und Betriebssystem Download PDF

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Abstract

Speichersteuereinrichtung (120), die mit einem Prozessor (110) und einem Systemhauptspeicher (150) gekoppelt ist, wobei der Prozessor (110) eine Abrufadresse zum Abrufen einer Systemmanagement-Interrupt(SMI)-Behandlungsroutine aus einem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) speichert und bei Empfang eines Systemmanagement-Interrupts (SMI) (111) ein SMI-Bestätigungssignal (113) und die Abrufadresse zum Abrufen der SMI-Behandlungsroutine ausgibt, wobei die Speichersteuereinrichtung (120) aufweist:
einen Latch-Speicher (134), der auf den Empfang des SMI-Bestätigungssignals (113) hin die von dem Prozessor (110) ausgegebene Abrufadresse zwischenspeichert,
einen integrierten Systemmanagementspeicher (124), der eine weitere SMI-Behandlungsroutine speichert, wobei die weitere SMI-Behandlungsroutine am Schluss einen Befehl enthält, der den Prozessor (110) veranlasst, zu der in dem Latch-Speicher (134) zwischengespeicherten Abrufadresse zu springen,
eine Vergleichseinheit (136) zum Vergleichen der von dem Prozessor (110) ausgegebenen Adressen mit der zwischengespeicherten Abrufadresse, und
einen mit dem Latch-Speicher (134) und der Vergleichseinheit (136) gekoppelten Decodierer (132),
der nach dem Zwischenspeichern der Abrufadresse und unabhängig von dieser...

Description

  • Die vorliegende Erfindung betrifft eine Speichersteuereinrichtung, die mit einem Prozessor und einem Systemhauptspeicher gekoppelt ist, wobei der Prozessor eine Abrufadresse zum Abrufen einer Systemmanagement-Interrupt(SMI)-Behandlungsroutine aus einem Systemmanagementspeicherbereich des Systemhauptspeichers speichert und bei Empfang eines Systemmanagement-Interrupts (SMI) ein SMI-Bestätigungssignal und die Abrufadresse zum Abrufen der SMI-Behandlungsroutine ausgibt, wobei die Speichersteuereinrichtung die Abrufadresse empfängt und die Befehle der SMI-Behandlungsroutine abruft. Ferner betrifft die Erfindung ein eine solche Speichersteuereinrichtung enthaltendes Computersystem sowie ein Verfahren zum Behandeln eines Systemmanagement-Interrupts.
  • Eine große Mehrheit der heutigen Personalcomputersysteme implementiert einen Systemmanagement-Interrupt (SMI). Ein SMI-Signal wird an einen Prozessor angelegt, um dem Prozessor zu melden, dass ein SMI-Ereignis aufgetreten ist. Das SMI-Signal wird üblicherweise von einer eine Speichersteuereinrichtung aufweisenden Systemlogikeinrichtung an den Prozessor angelegt. Die Systemlogikeinrichtung kann das SMI-Signal aus einer Vielzahl von möglichen Gründen anlegen. Das SMI-Signal kann z. B. angelegt werden, wenn eine Systemressource Zugriff auf einen bestimmten Speicherbereich oder eine bestimmte Eingabe/Ausgabeadresse anfordert. Dieser Speicher und die Eingabe/Ausgabe-Adressen können über einen Satz von Registern programmierbar sein, welche sich üblicherweise in der Systemlogikeinrichtung befinden. Das SMI-Signal kann ebenfalls angelegt werden, wenn bestimmte Systemereignisse auftreten. In einem Computersystem können z. B. verschiedene Taktgeber bzw. Zeitgeber zum Timing verschiedener Systemereignisse implemen tiert sein. Das SMI-Signal kann angelegt werden, wenn einer dieser Taktgeber abläuft.
  • Das Anlegen des SMI-Signals zeigt dem Prozessor an, dass der Prozessor damit beginnen soll, Befehle von einer Adresse abzurufen, die in einem der Register des Prozessors gespeichert ist. Dieses Register wird manchmal als Systemmanagementspeicher-Basisadressregister bezeichnet. Der Speicherbereich, der sich an der Adresse befindet, auf die das Systemmanagementspeicher-Basisadressregister verweist, kann als Systemmanagementspeicher (SMM) bezeichnet werden. In dem SMM ist eine SMI-Behandlungsroutine (SMI-Behandler) gespeichert. Der SMI-Behandler kann derart implementiert werden, dass er eine Vielfalt von Funktionen ausführen kann. Z. B. kann der SMI-Behandler Energiemanagementfunktionen ausführen oder versuchen, Systemfehlfunktionen zu korrigieren.
  • Der SMM, und damit der SMI-Behandler, untersteht der Kontrolle des Basis-Eingabe/Ausgabe-Systems (BIOS). Das BIOS wird üblicherweise von einem der verschiedenen BIOS-Softwareunternehmen entwickelt und implementiert. Der SMI-Behandler wird üblicherweise während des Herstellungsprozesses des Systems in das Computersystem installiert.
  • Es besteht oft der Bedarf, nach dem Herstellungsprozeß Änderungen an dem SMI-Behandler vorzunehmen. Eine solche Situation kann auftreten, wenn ein Chipsatzhersteller die Berichtigung für einen Fehler zur Verfügung stellen möchte oder neue Merkmale aktivieren oder alte Merkmale deaktivieren möchte. Diese Wünsche können durch eine Veränderung des SMI-Behandlers erfüllt werden. Das Produkt eines Chipsatzherstellers kann jedoch in Computersystemen verwendet werden, die von Dutzenden von verschiedenen Computersystemherstellern gebaut werden. Außerdem verwenden diese Systemhersteller üblicherweise irgendeines der zahlreichen BIOS-Softwareunternehmen, um den SMI-Behandler zu konzipieren und zu implementieren. Wenn der Chipsatzhersteller die SMI-Behandler verändern muss, muss er daher mit vielen verschiedenen Parteien verhandeln, um die Veränderungen durchzuführen. Der Chipsatzhersteller kann ebenfalls versuchen, mit den Vertreibern von Betriebssystemen zu verhandeln, um die Anforderungen des Chipsatzherstellers in die Betriebssysteme zu implementieren. Keine dieser Alternativen ist wünschenswert, im Wesentlichen aufgrund des großen Zeitbedarfs und Aufwandes, der erforderlich ist, um die Verhandlungen durchzuführen und die Anforderungen des Chipsatzherstellers zu implementieren.
  • Aus dem US-Patent 5,307,482 ist ein Computersystem bekannt, bei dem ein Prozessor über eine Speichersteuereinheit mit einem Systemspeicher gekoppelt ist. Im Falle eines nicht-maskierbaren Interrupts (NMI) wird von dem Prozessor über die Speichersteuereinheit eine NMI-Behandlungsroutine abgerufen. Die NMI-Behandlungsroutine ist Bestandteil der Betriebssystemroutinen, die im Hauptspeicher gespeichert sind. Die Druckschrift stellt sich die Aufgabe, die NMI-Behandlungsroutinen bei einem neuen System zu aktualisieren, beispielsweise neue Funktionen hinzuzufügen, ohne die Routinen des Betriebssystems ändern zu müssen. Um dies ausführen zu können, schlägt die Druckschrift vor, im Falle des Auftretens eines NMI zunächst nicht die Routinen des Betriebssystems, sondern systemspezifische NMI-Behandlungsroutinen auszuführen, die in einem speziellen Speicherbereich eines Firmware-Subsystems im ROM gespeichert sind. Um die Befehlsabrufe des Prozessors von den ursprünglichen NMI-Behandlungsroutinen im Hauptspeicher auf die systemspezifischen NMI-Behandlungsroutinen im Firmware-ROM umzulenken, ist neben der Speichersteuereinheit ein Override-Controller zusammen mit einer zusätzlichen Adressierlogik vorgesehen. Im Falle eines NMI fängt der Override-Controller Speicheranforderungen aus dem Prozessor ab und adressiert damit den ROM. Darüber hinaus legt er ein spezielles Signal an die Speichersteuereinheit an, damit diese Adressen und Steuersignale aus dem Prozessor ignoriert. Die systemspezifische Routine sorgt dann in einem letzten Schritt dafür, ein Abbruchbit zu setzen, welches dem Override-Controller signalisiert, dass die systemspezifische NMI-Behandlungsroutine beendet ist. Das Abbruchbit wird beispielsweise in der Speichersteuereinheit gesetzt. Die Speichersteuereinheit erzeugt daraufhin ein Beendigungsignal an den Override-Controller, wel cher daraufhin ein CPU-NMI-Signal neu erzeugt und an den Prozessor sendet. Anschließend führt der Prozessor die normale NMI-Routine im Systemspeicher über die Speichersteuereinheit aus. Das für das NMI bekannte Verfahren hat nicht nur den Nachteil, dass es eine erhebliche zusätzliche Logik erfordert; es erfordert zudem einen speziellen Befehl in der systemspezifischen NMI-Routine in Verbindung mit einem speziellen Register zum Aufnehmen des Abbruchbits.
  • Aus dem US-Patent 5,978,903 sind Computersysteme bekannt, die einen gegenüber normalen Systemoperationen transparenten Systemmanagementmodus verwenden. In einem geschützten Bereich eines DRAM wird ein Systemmanagement-Adressraum zur Verfügung gestellt, in welchem beispielsweise SMI-Behandler gespeichert sind.
  • Der System-Management-Modus des Pentium-Prozessors ist beispielsweise in dem Abschnitt 11.5 auf den Seiten 345 bis 348 des ”PC-Hardwarebuch” von Hans-Peter Messmer, 5. Auflage, Addison Wesley, 1998, beschrieben. Gemäß Seite 203 dieses Buches kann der Systemmanagement-Interrupt als eine Art übergeordneter NMI verstanden werden.
  • Ausgehend von dem oben genannten Stand der Technik liegt der Erfindung die Aufgabe zugrunde, eine Möglichkeit der Aktualisierung von SMI-Behandlungsroutinen zu schaffen, die sowohl unabhängig vom BIOS als auch vom Betriebssystem ist, und bei der die zusätzlichen SMI-Behandlungsroutinen keine zusätzliche Spezialhardware erfordernden Befehle enthalten.
  • Diese Aufgabe wird erfindungsgemäß durch eine Speichersteuereinrichtung mit den Merkmalen des Anspruchs 1 bzw. ein Computersystem mit den Merkmalen des Anspruchs 5 bzw. durch ein Verfahren mit den Merkmalen des Anspruchs 6 gelöst.
  • Die Erfindung wird anhand der folgenden ausführlichen Beschreibung und anhand der beigefügten Zeichnungen von Ausführungsbeispielen der Erfindung besser verständlich, wobei diese jedoch nicht als Einschränkung der Erfindung auf bestimmte beschriebene Ausführungsbeispiele angesehen werden sollten, sondern lediglich der Erläuterung und dem Verständnis dienen.
  • 1 zeigt ein Blockschaltbild eines Computersystems, das ein Ausführungsbeispiel einer Speichersteuereinrichtung aufweist, die gemäß der Erfindung implementiert ist.
  • 2 zeigt ein Flussdiagramm eines Ausführungsbeispiels eines Verfahrens zur Nutzung eines integrierten Systemmanagementspeicherbereichs.
  • 3 zeigt ein Flussdiagramm eines Ausführungsbeispiels eines zusätzlichen Verfahrens zur Nutzung eines Systemmanagementspeichers, der in eine Speichersteuereinrichtung integriert ist.
  • Es wird ein Ausführungsbeispiel einer Speichersteuereinrichtung mit einem integrierten Systemmanagementspeicherbereich beschrieben. Die Speichersteuereinrichtung empfängt ein SMI-Bestätigungssignal von einem Prozessor. Der Prozessor liefert dann eine Systemmanagementspeicheradresse an die Speichersteuereinrichtung. Statt SMI-Behandlerbefehle von der Adresse abzurufen, die von dem Prozessor angezeigt wird, ruft die Speichersteuereinrichtung statt dessen SMI-Behandlerbefehle aus ihrem integrierten Systemmanagementspeicherbereich ab. Bei Beendigung des SMI-Behandlers des integrierten Systemmanagementspeichers wird der Prozessor angewiesen, Befehle von der von dem Prozessor ursprünglich angegebenen Adresse abzurufen. Auf diese Weise kann eine BIOS-SMI-Routine nach der Ausführung der integrierten SMI-Routine ausgeführt werden. Der integrierte Systemmanagementspeicherbereich ermöglicht es den Herstellern von Chipsätzen oder von anderen Systemkomponenten herstellerspezifische SMI-Routinen zu vertreiben, ohne dass BIOS- oder Betriebssystemvertreiber einbezogen werden müssen. Die herstellerspezifischen SMI-Routinen können für jeden Zweck genutzt werden, der von einer Software-Routine erfüllt werden kann, einschließlich der Bereitstellung von Lösungen für Fehler oder der Aktivierung oder Deaktivierung von Systemoder Chipsatzmerkmalen, sind jedoch nicht hierauf beschränkt.
  • 1 zeigt ein Blockschaltbild eines Computersystems 100, das einen Prozessor 110 aufweist, der mit einer Speichersteuereinrichtung 120 gekoppelt ist. Das System 100 weist fer ner einen Systemhauptspeicher 150 auf, der ebenfalls mit der Speichersteuereinrichtung 120 gekoppelt ist.
  • Die Speichersteuereinrichtung 120 weist eine Host-Schnittstelleneinheit 122 auf, welche die Kommunikation mit dem Prozessor 110 ermöglicht. Wenn ein SMI-Ereignis auftritt, legt die Host-Einheit ein Systemmanagement-Interrupt-Signal 111 an den Prozessor 110 an. Systeme können mit verschiedensten SMI-Ereignissen implementiert sein, einschließlich Energiemanagementfunktionen und Zugriffen auf bestimmte Speicherbereiche, sind jedoch nicht hierauf beschränkt. Der Begriff ”SMI-Ereignis” ist hierbei so zu verstehen, daß er einen weiten Bereich von Computersystemaktivitäten einschließt, die Entwickler von Computersystemen als solche Aktivitäten möglicherweise implementieren möchten, welche die Ausführung einer Systemmanagement-Interrupt-Behandlungsroutine auslösen.
  • Nachdem der Prozessor 110 das Systemmanagement-Interrupt-Signal 111 empfangen hat, sendet der Prozessor ein Systemmanagement-Interrupt-Bestätigungssignal 113 an die Speichersteuereinrichtung 120 zurück. Der Prozessor 110 liefert außerdem eine Abrufadresse an die Speichersteuereinrichtung über einen Host-Bus 115. Die von dem Prozessor 110 gelieferte Abrufadresse entspricht einer Adresse, die in einem (nicht dargestellten) Systemmanagement-Speicherbasisadressregister in dem Prozessor gespeichert ist. Die in dem Systemmanagement-Speicherbasisadressregister gespeicherte Adresse zeigt an, an welchem Speicherplatz sich der BIOS-Systemmanagementspeicher befindet.
  • Die Abrufadresse wird von dem Prozessor 110 über den Host-Bus 115 geliefert und von einem Latch 134 zwischengespeichert, das sich in einer Systemmanagement-Interrupt-Adressdecodiereinheit 130 befindet. Die Abrufadresse wird über einen Adresspfad 121, der die Host-Einheit 122 mit anderen Einheiten in der Speichersteuereinrichtung 120 verbindet, an das Latch 134 geliefert. Wenn die Abrufadresse in dem Latch 134 zwischengespeichert ist, wird ein Setz-Signal 131 an ein Flip-Flop 135 geliefert. Das Setz-Signal 131 verursacht das Anlegen eines Auswahlsignals 137. Das Auswahlsignal 137 zeigt einem Decoder 132 an, dass er die SMI-Behandlungsroutine aus einem Systemmanagementspeicher 124 abrufen soll, der in die Speichersteuereinrichtung 120 integriert ist. Der Decoder ruft SMI-Behandlerbefehle aus dem Systemmanagementspeicher 124 ab und liefert diese Befehle an den Prozessor 110. Der Prozessor 110 führt die gelieferten SMI-Behandlerbefehle aus.
  • Die SMI-Behandlungsroutine, die in dem Systemmanagementspeicher 124 gespeichert ist, beinhaltet am Schluss der Routine einen Befehl, der den Prozessor 110 veranlasst, zu der in dem Latch 134 gespeicherten Adresse zu springen. Eine Vergleichseinheit 136 empfängt die von dem Prozessor 110 an die Host-Schnittstelleneinheit 122 über den Adressenpfad 121 gelieferten Adressen. Die Vergleichseinheit 136 vergleicht die empfangenen Adressen mit dem Inhalt des Latch 134. Eine Übereinstimmung zwischen einer neu empfangenen Adresse und dem Inhalt des Latch 134 zeigt an, dass die in dem Systemmanagementspeicher 124 gespeicherte SMI-Routine vollständig ausgeführt wurde, und dass der Prozessor 110 nun versucht auf die SMI-Routine zuzugreifen, die an der Adresse gespeichert ist, welche ursprünglich in dem Systemmanagement-Speicherbasisadressregister des Prozessors spezifiziert wurde. Wird eine Übereinstimmung gefunden, liefert die Vergleichseinheit 136 ein Reset-Signal 133 an das Flip-Flop 135. Das Reset-Signal 133 bewirkt die Wegnahme des Auswahlsignals 137. Der Decoder 132 ruft dann Befehle aus dem SMM-Bereich ab, auf den die übereinstimmenden Adressen verweisen.
  • Der SMM-Bereich, auf den die in dem SystemmanagementSpeicherbasisadressregister des Prozessors gespeicherte Adresse ursprünglich verwies, kann sich in einem BIOS-Systemmanagementspeicherbereich 152 befinden, der in dem Systemhauptspeicher 150 angeordnet. Der Decoder 132 greift auf den BIOS-Systemmanagementspeicherbereich 152 über eine Systemhauptspeicherschnittstelle 126 zu.
  • Der Status eines BIOS-SMI-Freigaberegisters 138 bestimmt, ob die in dem BIOS-Systemmanagementspeicherbereich 152 gespeicherte SMI-Routine nachfolgend zu der Ausführung der in dem Systemmanagementspeicher 124 gespeicherten SMI-Routine ausgeführt wird. Das BIOS-SMI-Freigaberegister 138 teilt dem Decoder 132 mit Hilfe eines Freigabesignals 139 seinen Status mit.
  • Ein anderes Ausführungsbeispiel der Speichersteuereinrichtung 130 kann ein Freigaberegister aufweisen, das bei Löschung die Ausführung der integrierten SMI-Routine verhindert. Das Setzen dieses Registers würde die oben beschriebene Ausführung der integrierten SMI-Behandlungsroutine ermöglichen.
  • 2 zeigt ein Flussdiagramm eines Verfahrens zur Ausführung einer SMI-Behandlungsroutine, die in einem integrierten Systemmanagementspeicher gespeichert ist. Im Schritt 210 wird ein Systemmanagement-Interrupt-Bestätigungssignal von einem Prozessor empfangen. In Schritt 220 werden Systemmanagement-Interrupt-Behandlungsbefehle von einem in eine Speichersteuereinrichtung integrierten Systemmanagementspeicher abgerufen. Der Abruf des Befehls von dem integrierten Systemmanagementspeicher erfolgt als Antwort auf den Empfang des Systemmanagement-Interrupt-Bestätigungssignals im Schritt 210.
  • 3 zeigt ein Flussdiagramm eines zusätzlichen Ausführungsbeispiels des beanspruchten Verfahrens zum Behandeln eines Systemmanagement-Interrupts (SMI), bei welchem eine SMI-Bahandlungsroutine in einem Systemmanagementspeicherbereich (152) eines Systemhauptspeichers (150) gespeichert ist, deren Abrufadresse in einem Prozessor (110) gespeichert ist, und eine weitere SMI-Behandlungsroutine in einem in eine Speichersteuereinrichtung (120) integrierten Systemmanagementspeicher (124) gespeichert ist. Im Schritt 310 wird ein Systemmanagement-Interrupt-Bestätigungssignal des Prozessors empfangen. Dem Schritt 310 folgend, wird eine Systemmanagementspeicheradresse von dem Prozessor geliefert und im Schritt 320 zwischengespeichert. Im Schritt 330 wird dann ein Systemmanagement-Interrupt-Behandlerbefehl von dem integrierten Systemmanagementspeicher abgerufen. Unabhängig von der durch den Prozessor spezifizierten Adresse erfolgt dieser Abruf aus dem integrierten Speicher. Im Schritt 340 führt der Prozessor den abgerufenen Befehl aus.
  • Im Schritt 350 wird eine Vergleichsoperation ausgeführt, um zu bestimmen, ob eine neu von dem Prozessor gelieferte Adresse mit der zuvor im Schritt 320 zwischengespeicherten Adresse übereinstimmt. Wenn die Adressen nicht übereinstimmen, kehrt der Prozessfluss zu Schritt 330 zurück. Wenn die Adressen jedoch übereinstimmen, wird im Schritt 360 die SMI-Behandlungsroutine von dem durch das BIOS gesteuerten Bereich des Systemhauptspeichers abgerufen.
  • Obwohl der Systemmanagementspeicherbereich bei den oben beschriebenen Ausführungsbeispielen in eine Speichersteuereinrichtung integriert ist, sind andere Ausführungsbeispiele möglich, bei denen sich der Systemmanagementspeicherbereich an anderer Stelle befindet. Die Verwendung eines Systemmanagementspeicherbereiches, der physikalisch getrennt von dem durch das BIOS gesteuerten Systemmanagementspeicherbereich ist, und ebenfalls getrennt ist von dem Systemhauptspeicher, hat den Vorteil, dass weder das BIOS noch ein anderes Betriebssystem oder Programm den Systemmanagementspeicher versehentlich überschreiben kann.

Claims (6)

  1. Speichersteuereinrichtung (120), die mit einem Prozessor (110) und einem Systemhauptspeicher (150) gekoppelt ist, wobei der Prozessor (110) eine Abrufadresse zum Abrufen einer Systemmanagement-Interrupt(SMI)-Behandlungsroutine aus einem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) speichert und bei Empfang eines Systemmanagement-Interrupts (SMI) (111) ein SMI-Bestätigungssignal (113) und die Abrufadresse zum Abrufen der SMI-Behandlungsroutine ausgibt, wobei die Speichersteuereinrichtung (120) aufweist: einen Latch-Speicher (134), der auf den Empfang des SMI-Bestätigungssignals (113) hin die von dem Prozessor (110) ausgegebene Abrufadresse zwischenspeichert, einen integrierten Systemmanagementspeicher (124), der eine weitere SMI-Behandlungsroutine speichert, wobei die weitere SMI-Behandlungsroutine am Schluss einen Befehl enthält, der den Prozessor (110) veranlasst, zu der in dem Latch-Speicher (134) zwischengespeicherten Abrufadresse zu springen, eine Vergleichseinheit (136) zum Vergleichen der von dem Prozessor (110) ausgegebenen Adressen mit der zwischengespeicherten Abrufadresse, und einen mit dem Latch-Speicher (134) und der Vergleichseinheit (136) gekoppelten Decodierer (132), der nach dem Zwischenspeichern der Abrufadresse und unabhängig von dieser Abrufadresse Befehle der weiteren SMI-Behandlungsroutine aus dem integrierten Systemmanagementspeicher (124) abruft und der nach einer von der Vergleichseinheit (136) gefundenen Übereinstimmung zwischen der zwischengespeicherten Abrufadresse und einer von dem Prozessor (110) empfangenen Adresse Befehle nicht weiter aus dem integrierten Systemmanagementspeicher (124), sondern aus dem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) beginnend an der Abrufadresse abruft.
  2. Speichersteuereinrichtung nach Anspruch 1, dadurch gekennzeichnet, dass die in dem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) gespeicherte SMI-Behandlungsroutine Teil des BIOS ist.
  3. Speichersteuereinrichtung nach Anspruch 1 oder 2, dadurch gekennzeichnet, dass der integrierte Systemmanagementspeicher (124) mindestens eine Größe von 128 Bytes aufweist.
  4. Speichersteuereinrichtung nach einem der Ansprüche 1–3, gekennzeichnet durch ein mit dem Decodierer (132) gekoppeltes Freigaberegister, das dann, wenn es gelöscht ist, die Ausführung der weiteren SMI-Behandlungsroutine des integrierten Systemmanagementspeichers (124) verhindert, und dann, wenn es gesetzt ist, die Ausführung der weiteren SMI-Behandlungsroutine vor der SMI-Behandlungsroutine aus dem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) freigibt.
  5. Computersystem (1) mit einem Prozessor (110), einem Systemhauptspeicher (150) und einer den Prozessor (110) mit dem Systemhauptspeicher (150) koppelnden Speichersteuereinrichtung (120) nach Anspruch 1, wobei der Prozessor (110) ein Systemmanagementspeicher-Basisadress-Register zum Speichern der Abrufadresse aufweist.
  6. Verfahren zum Behandeln eines Systemmanagement-Interrupts (SMI), bei welchem eine SMI-Behandlungsroutine in einem Systemmanagementspeicherbereich (152) eines Systemhauptspeichers (150) gespeichert ist, deren Abrufadresse in einem Prozessor (110) gespeichert ist, und eine weitere SMI-Behandlungsroutine in einem in eine Speichersteuereinrichtung (120) integrierten Systemmanagementspeicher (124) gespeichert ist, wobei: a) ein SMI-Signal (111) von der Speichersteuereinrichtung (120) an den Prozessor (110) angelegt wird, b) ein SMI-Bestätigungssignal (113) von dem Prozessor zurückgegeben und von der Speichersteuereinrichtung empfangen wird (310), c) anschließend die von dem Prozessor gelieferte Abrufadresse der SMI-Behandlungsroutine in einem Latch-Speicher (134) in der Speichersteuereinrichtung zwischengespeichert wird (320), d) durch einen Decodierer (132) der Speichersteuereinrichtung unabhängig von der zwischengespeicherten Abrufadresse der SMI-Behandlungsroutine ein Befehl der in dem Systemmanagementspeicher (124) enthaltenen weiteren SMI-Behandlungsroutine abgerufen (330) und von dem Prozessor ausgeführt wird (340), wobei die in dem Systemmanagementspeicher (124) enthaltene SMI-Behandlungsroutine am Schluss einen Befehl enthält, der den Prozessor (110) anweist, zu der in dem Latch-Speicher (134) zwischengespeicherten Abrufadresse zu springen, und e) die von dem Prozessor an die Speichersteuereinrichtung ausgegebene Adresse mit der zwischengespeicherten Abrufadresse der SMI-Behandlungsroutine verglichen wird (350), wobei e1) bei Nicht-Übereinstimmung (350: Nein) der nächste Befehl der in dem Systemmanagementspeicher (124) enthaltenen weiteren SMI-Behandlungsroutine gemäß Schritt d) abgerufen (330) und von dem Prozessor ausgeführt (340) wird und der Vergleich gemäß Schritt e) wiederholt wird (350), oder e2) bei Übereinstimmung (350: Ja) der Befehlsabruf aus dem integrierten Systemmanagementspeicher (124) endet und der nächste Befehl durch den Decodierer von der Abrufadresse der SMI-Behandlungsroutine aus dem Systemmanagementspeicherbereich (152) des Systemhauptspeichers (150) abgerufen (360) und an den Prozessor zur Ausführung geliefert wird.
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