KR970031845A - 디지탈 영상신호처리장치 및 그 방법 - Google Patents
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Abstract
본 발명은 디지탈카메라에서의 영상신호처리방법 및 그 장치에 관한 것으로, 디지탈 휘도신호와 디지탈 동기신호를 합성하기 위한 동기신호처리수단 ; 상기 동기신호처리수단에서 출력된 디지탈 합성신호를 아날로그신호로 변환하기 위한 제1변환수단 ; 동기신호처리수단에 의한 동기신호 처리시에 발생하는 휘도신호와 칼라신호간의 지연 시간차를 보상하기 위한 칼라신호지연수단 ; 칼라신호지연수단에서 출력된 디지탈 칼라신호를 아날로그신호로 변환하기 위한 제2변환수단 ; 및 제1변환수단에서 출력된 아날로그신호와 제2변환수단에서 출력된 아날로그신호를 합성하여 복합영상신호를 생성하기 위한 아날로그신호합성수단을 포함함을 특징으로 하며, 본 발명에 의하면 동기신호와 영상휘도신호, 칼라신호의 합성타이밍이 어긋나는 것을 제거할 수 있을 뿐만 아니라 보다 간단한 구조의 시스템을 구현할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 디지탈 카메라시스템의 구성블럭도.
제3도는 제2도에 도시된 본 발명에 의한 디지탈카메라프로세서의 상세한 구성블럭도.
제4도는 제3도에 도시된 본 발명에 의한 동기신호처리기의 상세한 구성블럭도.
Claims (11)
- 광원에 의하여 발생된 영상신호로부터 변환된 디지탈신호인 휘도신호, 칼라신호 및 동기신호를 합성하여 아날로그신호인 복합영상신호를 생성하기 위한 디지탈 영상신호처리장치에 있어서, 디지탈 동기신호를 디지탈 휘도신호의 다이내믹영역에 따라 규정된 레벨값에 의하여 설정하여, 디지탈 휘도신호와 디지탈 동기신호를 합성하기 위한 동기신호처리수단 ; 상기 동기신호처리수단에서 출력된 디지탈 합성신호를 아날로그신호로 변환하기 위한 제1변환수단 ; 동기신호처리수단에 의한 동기신호 처리시에 발생하는 휘도신호와 칼라신호간의 지연 시간차를 보상하기 위한 칼라신호지연수단 ; 상기 칼라신호지연수단에서 출력된 디지탈 칼라신호를 아날로그신호로 변환하기 위한 제2변환수단 ; 및 상기 제1변환수단에서 출력된 아날로그신호와 상기 제2변환수단에서 출력된 아날로그신호를 합성하여 복합영상신호를 생성하기 위한 아날로그신호합성수단을 포함함을 특징으로 하는 디지탈 영상신호처리장치.
- 디지탈 영상신호처리에서 디지탈 휘도신호와 동기신호를 합성하여 디지탈 동기휘도신호를 발생하기 위한 디지탈 동기휘도신호합성장치에 있어서, 상기 입력휘도신호의 데이타 비트수를 확장하기 위한 비트확장수단 ; 확장된 비트수에 따라 상기 입력휘도신호의 이득을 조정하기 위한 및 이득조정수단 ; 및 영상신호의 동기신호 및 블랭크 신호의 논리상태에 따라, 상기 이득조정된 휘도신호 및 동기신호를 합성하기 위한 신호합성수단을 포함함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제2항에 있어서, 상기 비트확장수단은 8비트의 입력휘도신호를 10비트의 데이타로 변환함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제2항에 있어서, 상기 이득조정수단은 비트확장에 따라 규정된 소정의 이득값을 저정하기 위한 저장수단 ; 및 상기 비트확장수단을 통하여 출력된 휘도신호와 상기 저장수단에 저장된 이득값을 곱하여 이득조정된 휘도신호를 발생하기 위한 곱셈수단을 포함함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제2항에 있어서, 상기 신호합성수단은 소정의 표준규격에 의하여 규정된 동기레벨, 셋업레벨 및 제로레벨에 해당하는 값을 저장하기 위한 레벨값저장수단 ; 블랭크신호가 로우레벨이고 동기신호가 하이레벨이면 제1제어신호를, 동기신호와 블랭크신호 모두 하이레벨이면 제2제어신호를, 그리고 동기신호와 블랭크신호 모두 로우레벨이면 제3제어신호를 발생하기 위한 제어신호발생수단 ; 및 상기 제어신호발생수단에서 발생된 제어신호가 입력되어, 제1제어신호이면 동기레벨값을, 그리고 제2제어신호이면 셋업레벨값을 선택하여 상기 이득조정된 휘도신호와 상기 선택된 레벨값을 더한 신호를 출력하고, 제3제어신호이면 제로신호를 출력하기 위한 레벨값선택수단을 포함함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제4항에 있어서, 상기 레벨값저장수단은 영상신호가 NTSC신호인 경우에 신호의 다이내믹영역에서 동기레벨로 0%레벨값을, 셋업레벨 7.5% 레벨값을, 그리고 제로레벨로 -40%레벨값을 각각 저장함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제4항에 있어서, 상기 레벨값저장수단은 영상신호가 PAL신호인 경우에 신호의 다이내믹영역에서 동기레벨과 셋업레벨로 0%레벨값을 그리고 제로레벨로 -40%레벨값을 각각 저장함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제5항에 있어서, 상기 제어신호발생수단은 동기신호가 입력되는 제1인버터 ; 블랭크신호가 입력되는 제2인버터 ; 상기 제1인버터 및 상기 제2인버터의 출력신호가 입력되는 제1AND게이트 ; 동기신호 및 블랭크신호가 입력되는 제2AND게이트 ; 및 동기신호 및 상기 제2인버터의 출력신호가 입력되는 제3AND게이트를 구비하고, 상기 제3AND게이트의 출력신호는 동기레벨설정을 위한 제1제어신호로서, 상기 제2AND게이트의 출력신호는 셋업레벨설정을 위한 제1제어신호로서, 상기 제1AND게이트의 출력신호는 제로레벨설정을 위한 제3제어신호로서 출력함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 제5항에 있어서, 상기 레벨값선택수단은 상기 레벨값저장수단으로부터 공급되는 동기레벨값 및 셋업레벨값이 입력되어, 상기 제1 및 제2제어신호에 따라 하나의 레벨값을 출력하기 위한 제1먹스수단 ; 상기 제1먹스수단로부터 출력된 레벨값을 상기 이득조정된 휘도신호와 합하여 출력하기 위한 합성수단 ; 상기 제3제어신호에 따라 상기 합성수단의 출력신호를 제로레벨로 설정하여 출력하기 위한 제2먹스수단을 포함함을 특징으로 하는 디지탈 동기휘도신호합성장치.
- 광원에 의하여 발생된 영상신호로부터 변환된 디지탈신호인 휘도신호, 칼라신호 및 동기신호를 합성하여 아날로그신호인 복합영상신호를 생성하기 위한 디지탈 영상신호처리장치에 있어서, 동기신호와 블랭크신호의 논리상태에 따라 디지탈 휘도신호와 동기신호를 합성하는 제1과정 ; 상기 합성신호를 아날로그신호로 변환하는 제2과정; 디지탈 칼라신호를 아날로그신호로 변환하는 제3과정 ; 및 상기 아날로그 칼라신호와 상기 아날로그 합성신호를 합성하여 복합영상신호를 발생하는 제4과정을 포함함을 특징으로 하는 디지탈 영상신호처리방법.
- 제10항에 있어서, 상기 제1과정은 디지탈 휘도신호의 비트를 확장하고, 확장된 비트에 따라 설정된 이득값에 의하여 상기 디지탈 휘도신호의 이득을 조정한 다음, 상기 이득조정된 디지탈 휘도신호와 동기신호를 합성함을 특징으로 하는 디지탈 영상신호처리방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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| KR1019950042617A KR0183756B1 (ko) | 1995-11-21 | 1995-11-21 | 디지탈 영상신호처리장치 및 그 방법 |
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Family Applications (1)
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| KR1019950042617A KR0183756B1 (ko) | 1995-11-21 | 1995-11-21 | 디지탈 영상신호처리장치 및 그 방법 |
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- 1995-11-21 KR KR1019950042617A patent/KR0183756B1/ko not_active IP Right Cessation
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