KR950014089B1 - 동기식 디램의 히든 셀프 리프레쉬 방법 및 장치 - Google Patents

동기식 디램의 히든 셀프 리프레쉬 방법 및 장치 Download PDF

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Abstract

내용 없음.

Description

동기식 디램의 히든 셀프 리프레쉬 방법 및 장치
제 1 도는 종래의 셀프 리프레쉬 장치를 포함하는 로오 어드레스 패스를 도시한 블럭구성도.
제 2 도는 본 발명의 히든 셀프 리프레쉬 장치의 제 1 실시예를 포함하는 로오 어드레스 패스를 도시한 블럭구성도.
제 3 도는 본 발명의 히든 셀프 리프레쉬 장치의 제 2 실시예를 포함하는 로오 어드레스 패스를 도시한 블럭구성도.
제 4 도는 다수개의 레지스터가 포함된 본 발명의 리프레쉬 카운터를 도시한 블럭구성도.
* 도면의 주요부분에 대한 부호의 설명
1 : 뱅크 2 : 디코더
3 :로오 어드레스 버퍼 4 : 셀프 리프레쉬 오실레이터/타이머
5,5A-D,12 : 리프레쉬 카운터 6 :어드레스 멀티플렉서
7 :로오 어드레스 래치 회로 8 :로오 어드레스 순간 래치 회로
9 :로오 어드레스 래치 회로/로오 어드레스 버퍼
10A-D,11 :레지스터
본 발명은 동기식 디램(synchronous DRAM)에 관한 것으로, 특히 다수 개의 셀 뱅크(cell bank) 운용시에 소자 외부로부터 특별한 타이밍 시퀀스(timing sequence)가 필요없이 소자 내부에서 자체적으로 셀 리프레쉬(cell refresh) 동작이 가능하도록 하는 히든 셀프 리프레쉬(hidden self refresh) 방법 및 장치에 관한 것이다.
본 발명은 동기식 디램을 다수개의 셀 뱅크, 예를 들어 네개의 셀 뱅크로 나눌때에 실제 정상 리드/라이트(read/write) 동작이 이루어지지 않는 하나의 뱅크를 리프레쉬 모드에 있게 하여 셀프 리프레쉬 동작을 수행함으로써 디램 칩 자체로는 리프레쉬 하는데 걸리는 시간을 단축시킬 수 있으므로 셀의 데이타 리텐션 타임(data retention time)을 줄일 수 있으며, 디램을 포함하는 전체 시스템(system)의 측면에서는 리프레쉬 모드를 위한 특별한 동작이 필요없게 되므로 시스템(system)의 측면에서는 리프레쉬 모드를 위한 특별한 동작이 필요없게 되므로 시스템을 고속으로 동작시킬 수 있다.
일반적으로 디램 셀은 .하나의 캐패시터(capacitor)와 하나의 트랜지스터(transistior)로 이루어져 있고 캐패시터에 전하(charge)를 충전 또는 방전함으로써 데이타를 저장하기 때문에 데이타를 저장한 후에 일정시간이 경과하면 캐패시터에 저장되어 있는 전하가 셀 플레이트등을 통해 조금씩 방지되게 되므로, 주기적으로 디램 셀에 저장된 데이타를 리프레쉬해 주어야 한다.
디램 셀을 리프레쉬하기 위해서 초기에는 라스 온리 리프레쉬(RAS only refresh) 방식을 사용해 오다가 온-칩 어드레스 카운터(on-chip address counter)를 탑재하여 리프레쉬 어드레스를 칩 자체적으로 결정하게 하는 카스 비포 라스 리프레쉬(CAS befor RAS refresh) 방식 및 설프 리프레쉬 방식등으로 발전되어 왔다. 그러나, 각 방식은 모두 소자 외부로부터 리프레쉬 모드로 전환할 수 있도록 하는 특별한 클럭 시퀀스(clock sequence)를 필요하며, 리프레쉬 동작이 이루어지고 있는 시간 동안의 입력과 출력은 일반적으로 휴지 상태로 있어야 하므로 이로 인해 디램의 고속화 사용에 지장을 초래하게 된다.
또한, 고집적 메모리 소자의 경우에는 칩의 효과적인 운용을 위해 리프레쉬 주기가 길어져야 하는데, 이럴 경우에는 셀의 데이타 리텐션 타임의 한계에 이르게 되어 소자의 신뢰성(reliability)을 저하시키는 원인이 되기도 한다.
따라서, 본 발명에서는 동기식 디램을 다수개의 셀 뱅크로 나누고, 소자 외부로부터 리프레쉬 모드를 위한 특별한 클럭 시퀀스의 입력 없이 그 중 하나를 항상 리프레쉬 모드로 동작하도록 하는 리프레쉬 방법 및 장치를 구현하였다.
즉, 각각의 셀 뱅크별로 리프레쉬 카운터를 독립적으로 운용하거나, 리프레쉬 카운터에 셀 뱅크 수만큼의 레지스터(register)를 탑재하여 임의의 한 뱅크가 리프레쉬 모드로 들어가게 되면 어드레스 카운터에 의해 순차적으로 리프레쉬가 일어나게 하였다.
이때, 시스템 측면에서는 일정 시간 동안 뱅크를 선택하는 어드레스만을 변환시킴으로써 뱅크이 리프레쉬가 가능하게 되므로, 시스템 측면에서 보면 히든 셀프 리프레쉬라 할 수 있다.
제 1 도는 종래의 셀프 리프레쉬 장치를 포함하는 로오 어드레스 패스를 도시한 블럭구성도로서, 네개의 셀 뱅크(1)로 이루어진 경우이다.
정상적인 리드/라이트 동작을 행할 때에는 로오 어드레스 래치(row address latch)회로(7)에 이미 래치되어 있는 로오 어드레스를 어드레스 멀티플렉서(address multiplexer)(6)에서 멀티플렉싱한 후에 로오 어드레스 버퍼(row address buffer)(3)를 거쳐서 디코더(decoder)(2)에서 디코딩하게 된다.
반면에 셀프 리프레쉬 오실레이터(oscillator) 및 타이머(timer)(4)를 통해 리프레쉬 모드가 인지되면 리프레쉬 카운터(5)에서 출력되는 어드레스를 멀티플렉싱한 후에 상기와 동일한 과정을 거쳐 디코딩하게 된다.
제 1 도에 도시된 바와같이 종래의 리프레쉬 장치의 경우는 리프레쉬 카운터의 출력 또는 로오 어드레스 래치 회로의 출력을 선택적으로 멀티플렉싱하여 리프레쉬 동작 또는 정상 리드/라이트 동작을 실시하므로, 리프레쉬 동작 중에는 정상 리드/라이트 동작이 이루어지지 못하게 되어 디램의 고속화 사용에 지장을 주는 단점이 있다.
따라서, 본 발명에서는 뱅크별로 독립적으로 리프레쉬 동작이 이루어질 수 있도록 리프레쉬 장치를 구현하여, 정상 리드/라이트 동작이 실행되고 있는 뱅크를 제외한 나머지 뱅크중 하나에서 정상 동작과 동시에 리프레쉬 동작이 이루어지도록 하는데에 그 목적이 있다.
상기 목적을 달성하기 위하여, 본 발명에서는 각각의 셀 뱅크별로 리프레쉬 카운터를 독립적으로 운용하거나, 리프레쉬 카운터에 셀 뱅크 수만큼의 레지스터를 탑재하여 임의의 한 뱅크가 리프레쉬 모드로 들어가게 되면 어드레스 카운터에 의해 순차적으로 리프레쉬가 일어나도록 하였다.
제 2 도는 본 발명의 히든 셀프 리프레쉬 장치의 제 1 실시예를 포함하는 로오 어드레스 패스를 도시한 블럭구성도로서, 제 1 도의 로오 어드레스 래치 회로를 일시적 래치 기능을 갖는 로오 어드레스 순간 래치(row address temporary latch)회로로 대치하고 리프레쉬 카운터와 어드레스 래치 회로를 로오 어드레스 버퍼와 같이 각 뱅크별로 구현하여 뱅크 선택 어드레스로 그 동작을 제어하도록 하였다.
로오 어드레스 순간 래치 회로(8)의 일시적 래치 기능은 정상적인 리드/라이트 동작의 경우에 로오 어드레스 선택 및 비트라인 센싱(bit line sensing)에 영향을 주지 않을 시간 동안만 어드레스를 래치시키고, 어드레스를 멀티플렉싱한 후에 다시 래치 및 로오 어드레스 버퍼(9)를 거쳐 디코딩하게 된다.
이때, 로오 어드레스 래치 회로(9)는 두개의 어드레스 비트(An,An-1)에 의해 제어되며 선택된 뱅크의 래치 회로를 제외한 다른 뱅크의 래치 회로는 동작하지 않는다.
한편, 리프레쉬 동작을 위해 지정된 한 뱅크는 상기에서 설명한 바와같이 비트라인 센싱에 영향을 주지 않을 시간에서 동작 가능한 상태를 유지시키면 그때부터 네개의 리프레쉬 카운터(5A) 중에서 선택된 리프레쉬 카운터가 동작되고, 리프레쉬 카운터(5A)에서 출력된 어드레스가 어드레스 멀티플렉서(6)에서 멀티플렉싱되어 리프레쉬를 위해 지정된 뱅크의 로오 어드레스를 디코딩하게 된다.
그런데, 리프레쉬 동작이 진행되고 있는 도중에 입력되는 어드레스가 변하게 되면 선택된 뱅크가 바뀌게 되는데, 이때 제 2 도의 경우에는 뱅크 수만큼의 리프레쉬 카운터를 독립적으로 운용함으로써 각 뱅크의 리프레쉬 어드레스를 순차적으로 지정해 줄 수 있다.
제 3 도는 본 발명의 히든 셀프 리프레쉬 장치의 제 2 실시예를 포함하는 로오 어드레스 패스를 도시한 블럭구성도로서, 제 1 도의 로오 어드레스 래치 회로를 일시적 래치 기능을 갖는 로오 어드레스 순간 래치 회로로 대치하고, 어드레스 래치 회로를 로오 어드레스 버퍼와 같이 각 뱅크별로 구현하며 리프레쉬 카운터에 각 뱅크별로 레지스터를 접속하여 뱅크 선택 어드레스로 그 동작을 제어하도록 하였다.
정상 리드/라이트 동작은 상기 제 2 도에서와 동일하게 이루어지고, 리프레쉬 동작은 제 2 도에서와는 달리 네개의 뱅크에 공통으로 이용되는 리프레쉬 카운터(5)의 출력에 의해 이루어진다.
단, 리프레쉬 동작이 진행되고 있는 도중에 입력되는 어드레스가 변하게 되면 순차적으로 진행해가던 리프레쉬 카운터(5)의 출력 데이타를 네개의 레지스터(10)중 선택된 레지스터에 저장함으로써 효율적으로 리프레쉬를 할 수 있도록 하였다.
이는 제 4 도에 도시된 발명의 리프레쉬 카운터와 같이 리프레쉬 카운터에 뱅크 수만큼의 레지스터(11)를 탑재시켜, 각 레지스터에 각 뱅크에서 리프레쉬 동작을 수행하던 최종 어드레스 데이타를 기억시켜 두었다가 다시 그 뱅크가 선태되었을 때에 해당 레지스터(11)에 저장되어 있던 어드레스 데이타를 리프레쉬 카운터(12)에 입력시켜 다시 순차적으로 리프레쉬 동작을 수행하도록 한다.
한편, 동기식 디램이 인터리브드 사이클(interleaved cycle)로 동작할 경우에는 버스트 길이(burst length)만큼의 연속적인 데이타가 나오게 되는데, 이때 도중에 선택된 뱅크가 변하여 다른 뱅크의 데이타가 우선적으로 처리되고 그 이후에 이전의 뱅크에서 버스트 길이만큼의 나머지 데이타를 출력해야할 경우에는 컬럼 어드레스 카운터(column address counter)에 상기 리프레쉬 카운터와 마찬가지로 레지스터를 탑재하여 우선적으로 처리를 요하는 뱅크의 데이타를 먼저 출력한 후에 자동적으로 이전에 수행 중이던 뱅크의 데이타를 출력하게 할 수도 있다.
즉, 하나의 어드레스 카운터를 여러 뱅크에 병행해서 사용하고자 하는 경우에 있어서 제 3 도에 도시된 바와같이 레지스터를 탑재하면 효율적으로 운용할 수 있다.
이상에서 설명한 바와같이, 종래의 리프레쉬 방법에서는 리프레쉬를 위하여 별도의 모드를 소자 외부에서 입력시켜 주어야 하며 리프레쉬 동작이 진행되는 동안에는 디램은 리드/라이트 동작이 수행되지 않는 휴지 상태에 있어야 하지만, 본 발명의 히든 셀프 리프레쉬 장치를 사용하게 되면 단지 로오 어드레스에 의해 리프레쉬 모드로 들어가게 되며, 동시에 리프레쉬 동작이 이루어지지 않는 다른 뱅크에서 정상적인 리드/라이트 동작을 수행할 수 있기 때문에, 시스템 측면에서 볼 때 리프레쉬 기능이 훨씬 쉬워지고 리프레쉬를 위한 시간 또한 별도로 지정되지 않으므로 디램을 고속으로 동작시키기에도 유리한 효과가 있다.
또한, 동기식 디램이 인터리브드 사이클로 동작하는 경우에 있어서도 컬럼 어드레스 카운터에 레지스터를 탑재함으로써, 여러 뱅크의 데이타를 효율적으로 출력하는 효과를 얻게 된다.

Claims (3)

  1. 다수개의 셀 뱅크(cell bank)를 포함하는 동기식 디램(synchronous DRAM)의 히든 셀프 리프레쉬(hidden self rdfresh) 방법에 있어서, 소자 내부적으로 리프레쉬 동작을 개시하는 과정과, 셀 뱅크 선택 어드레스에 의해 선택된 리프레쉬 카운팅 수단을 이용하여 내부 어드레스 신호를 출력하는 과정과, 상기 내부 어드레스 신호를 멀티플렉싱(multiplexing)하고 디코딩(decoding)하는 과정을 포함하고, 다수개의 셀 뱅크 중에서 뱅크 선택 어드레스에 의해 선택된 셀 뱅크는 정상 리드/라이트 동작에 상관없이 항상 리프레쉬 동작을 수행하도록 하는 것을 특징으로 하는 리프레쉬 방법.
  2. 다수개의 셀 뱅크를 포함하는 동기식 디램의 히든 셀프 리프레쉬 장치에 있어서, 소자 내부적으로 리프레쉬 모드를 개시하는 수단과, 상기 리프레쉬 모드 개시 수단의 출력과 뱅크 선택 어드레스에 의해 제어되어 내부 어드레스 신호를 출력하는 뱅크수와 동일한 갯수의 리프레쉬 카운팅 수단과, 소자 외부로부터 입력되는 어드레스를 일시적으로 래치시키는 로오 어드레스 순간 래치 수단과, 상기 리프레쉬 카운팅 수단의 출력과 상기 로오 어드레스 순간 래치 순간의 출력을 선택적으로 멀티플렉싱하는 어드레스 멀티플렉싱 수단과, 뱅크 선택 어드레스에 의해 제어되며, 어드레스 멀티플렉싱 수단을 통해 멀티플렉싱된 어드레스를 각 뱅크 별로 래치시키고 버퍼링하는 로오 어드레스 래치 수단 및 로오 어드레스 버퍼링 수단을 포함하는 것을 특징으로 하는 리프레쉬 장치.
  3. 제 2 항에 있어서, 상기 뱅크수와 동일한 갯수의 리프레쉬 카운팅 수단 대신에, 하나의 공통 리프레쉬 카운팅 수단에 접속되고 뱅크 선택 어드레스에 의해 제어되는 뱅크수와 동일한 갯수의 레지스터를 사용하는 것을 특징으로 하는 리프레쉬 장치.
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