KR940000632Y1 - Voice choice circuit of hi-fi vcr - Google Patents
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Abstract
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Description
제1도는 본 고안에 따른 하이파이 VCR에서의 음성선택회로의 실시예를 나타내는 회로도이다.1 is a circuit diagram showing an embodiment of a voice selection circuit in a hi-fi VCR according to the present invention.
* 도면의 주요부부에 대한 부호의 설명* Explanation of symbols on the main parts of the drawings
1,2,3 : 오디오 재생헤드 AMP1,AMP2,AMP3 : 증폭기1,2,3: Audio playback head AMP1, AMP2, AMP3: Amplifier
10,11 : 복조기 20,21 : 잡음제거기10,11 demodulator 20,21 noise canceller
30 : 매트릭스 B1,B2 : 버퍼30: matrix B1, B2: buffer
R1∼R5 : 저항 VR1,VR2 : 가변저항R1 to R5: resistance VR1, VR2: variable resistor
Q1∼Q7 : 트랜지스터 D1,D2 : 다이오드Q1 to Q7: Transistors D1 and D2: Diodes
C1∼C6 : 콘덴서 40 : 스위치C1 to C6: Capacitor 40: Switch
50 : 혼합기 60 : 위상조정회로50: mixer 60: phase adjustment circuit
70 : 차동증폭기 80 : 적분회로70: differential amplifier 80: integral circuit
90 : 비교기 100 : 제어용 스위치수단90: comparator 100: control switch means
200 : 제어수단200: control means
본 고안은 하이파이 기능을 갖는 자기기록 재생장치에 관한 것으로, 특히 하이파이음과 모노음을 선택적으로 믹싱시키는 것을 자동제어하기 위한 하이파이 브이. 시. 알에서의 음성선택회로에 관한 것이다.The present invention relates to a magnetic recording and reproducing apparatus having a hi-fi function, in particular a hi-fi v for automatically controlling mixing of hi-fi and mono sounds. city. A voice selection circuit in eggs.
일반적으로 VHS텔레비젼 같은 경우 하나의 기록매체에 주파수 변조한 하이파이 음성신호를 비디오트랙과 동일 원주상에 심층기록하고 모노음성신호는 오디오트랙상에 기록해 또 그것을 재생하는 것을 원리로 하고 있다.In general, in the case of a VHS television, a hi-fi audio signal frequency-modulated on one recording medium is recorded in the same circumference as a video track, and a mono audio signal is recorded on an audio track and reproduced.
상기와 같은 경우 비디오트랙에 기록되어 있는 하이파이음성과 오디오트랙상에 기록되어 잇는 모노음성이 각각 다른 오디오신호가 기록되어 있다면 믹싱(mixing)시켜서 하이파이 음성신호와 모노음성신호를 동시에 제생 출력시킬 수 있다.In this case, if the hi-fi voice recorded on the video track and the audio signal having different mono voices recorded on the audio track are recorded, the hi-fi voice signal and the mono voice signal can be simultaneously output by mixing. .
그러나 비디오트랙에 기록되어 있는 하이파이 음성과 오디오트랙에 기록되어 있는 모노음성이 동일한 경우 믹싱(mixing)시켜서 출력하면 모노음성이 포함된 잡음성분이 하이파이음성과 동일하게 제셍되는 것은 물론 스테레오음에 모노음이 혼합되어 전체적으로 재생음성신호의 질을 크게 떨어뜨리는 문제점이 있었다.However, if the hi-fi voice recorded on the video track and the mono voice recorded on the audio track are the same, when mixed and outputted, the noise component including the mono voice is generated in the same way as the hi-fi voice, and the stereo sound is the mono tone. This mixture has a problem of greatly reducing the quality of the reproduced audio signal as a whole.
따라서 본 고안의 목적은 자기기록 재생장치에 기록된 신호의 재생시 비디오 트랙에 기록된 하이파이음과 오디오 트랙에 기록된 모노음을 비교하여 동일할 경우는 믹싱되지 않고록 하고 서로 다른 경우에만 사용자가 믹싱동작을 선택하는 하이파이 VCR에서의 음성선택회로를 제공함에 있다.Therefore, the object of the present invention is to compare the high fidelity sound recorded on the video track and the mono sound recorded on the audio track when the signals recorded on the magnetic recording and playback apparatus are reproduced. There is provided a voice selection circuit in a hi-fi VCR for selecting a mixing operation.
상기 목적을 달성하기 위하여 본 고안은 하이파이 기능을 갖는 자기기록 재생장치에 있어서, 기록매체에서 비데오 트랙에 기록되어 있는 하이파이음과 오디오트랙에 기록되어 있는 모노음을 각각 재생하기 위한 재생회로; 상기 재생회로에 재생된 하이파이음과 모노음을 제1제어신호에 의해 하이파이음과 모노음의 믹싱이 제어되고 제2제어신호에 의해 하이파이음증 L채널과 R채널 또는 모노음성을 선택하는 매트릭스; 및 재생된 하이파이음과 모노음이 동일할때는 상기 매트릭스의 믹싱동작을 차단하는 제1제어신호를 상기 매트릭스에 공급하기 위한 제어수단을 구비하는 것을 특징으로 한다.In order to achieve the above object, the present invention provides a magnetic recording and reproducing apparatus having a hi-fi function, comprising: a reproducing circuit for reproducing a hi-fi sound recorded on a video track and a mono sound recorded on an audio track on a recording medium; A matrix for controlling the mixing of the hi-fi sound and the mono sound by the first control signal and selecting the hi-fi sound L channel and the R channel or the mono sound by the second control signal; And control means for supplying the matrix with a first control signal which blocks the mixing operation of the matrix when the reproduced hi-fi sound and the mono sound are the same.
이하 본 고안을 첨부한 도면을 참조하여 상세시 설명한다.Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.
제1도는 본 고안에 따른 은성선택회로의 실시예를 나타내는 회로도이다.1 is a circuit diagram showing an embodiment of the silver selection circuit according to the present invention.
먼저 구성을 살펴보면 오디오재생헤드(1,2)는 증폭기(AMP1)의 제1,2입력단자와 접속하고, 증폭기(AMP1)의 출력단자는 복조기(10,11)의 입력단자와 각각 접속한다. 복조기(10,11)의 출력단자는 잡음제거기(20,21)의 입력단자와 각각 접속하고, 잡음제거기(20,21)의 출력단자는 매트릭스(30)의 제1,2입력단자와, 버퍼(B1,B2)의 입력단자와 각각 접속한다. 버퍼(B1)의 출력단자는 저항(R1)과 접속하고, 버퍼(B2)는 출력단자는 저항(R2)과 접속한다. 저항(R1)의 다른 일측은 저항(R2)의 다른 일측과 접속하며, 저항(R1)과 저항(R2)사이의 접점을 지나는 가변저항(VR1)이 기저전원인 제2전원사이에 접속되어 있다. 오디오 재생헤드(3)는 증폭기(AMP2)의 입력단자와 접속하고, 증폭기(AMP2)의 출력단자는 라인증촉기(Line AMP3)의 입력단자와 접속하며, 라인증폭기(Line AMP3)의 출력단자는 저항(R24)의 일측과 매트릭스(30)의 제3입력단자와 접속한다. 가변저항(VR1)과 콘덴서(C1)의 일측이 접속하고, 콘덴서(C1)의 다른 일측은 저항(R3,R4)의 일측과 트랜지스터(Q1)의 베이스단자와 접속한다. 저항(R3)의 다른 일측은 공급전원(Vcc)과 접속되고, 저항(R4)의 다른 일측은 기저전원인 제2전원과 접속되어 있다. 공급전원(Vcc)과 접속된 저항(R5)의 다른 일측은 트랜지스터(Q1)의 콜랙터단자와 접속하고, 그 사이에 가변저항(VR2)의 일측이 접속한다. 트랜지스터(Q1)의 에미터 단자는 저항(R6)을 사에 두고 기저전원인 제2전원과 접속하며, 저항(R6)과 트랜지스터(Q1)의 에미터단자 사이의 접점을 통과하여 코일(L1)이 있고, 코일(L1)의 다른 일측은 콘덴서(C2)의 일측과 접속한다. 가변저항(VR2)의 다른 일측과 콘덴서(C2)의 일측이 접속하고, 그 사이의 접점을 통과하여 콘덴서(C3)가 존재한다. 공급전원을 유입하기 위한 입력단자(5)와 저항(R7)의 일측이 접속되고, 저항(R7)과 직렬 연결된 저항(R8)이 존재하며, 저항(R8)의 다른 일측은 기저전원인 제2전원과 접속된다.First, the audio reproduction heads 1 and 2 are connected to the first and second input terminals of the amplifier AMP1, and the output terminals of the amplifier AMP1 are connected to the input terminals of the demodulators 10 and 11, respectively. The output terminals of the demodulators 10 and 11 are connected to the input terminals of the noise cancellers 20 and 21, respectively, and the output terminals of the noise cancellers 20 and 21 are connected to the first and second input terminals of the matrix 30 and the buffer B1. And B2) respectively. The output terminal of the buffer B1 is connected to the resistor R1, and the output terminal of the buffer B2 is connected to the resistor R2. The other side of the resistor R1 is connected to the other side of the resistor R2, and the variable resistor VR1 passing through the contact between the resistor R1 and the resistor R2 is connected between the second power source which is the base power source. . The audio reproduction head 3 is connected to the input terminal of the amplifier AMP2, the output terminal of the amplifier AMP2 is connected to the input terminal of the line amplifier AMP3, and the output terminal of the line amplifier AMP3 is connected to the resistor ( One side of R24 and the third input terminal of the matrix 30 are connected. The variable resistor VR1 and one side of the capacitor C1 are connected, and the other side of the capacitor C1 is connected to one side of the resistors R3 and R4 and the base terminal of the transistor Q1. The other side of the resistor R3 is connected to the supply power supply Vcc, and the other side of the resistor R4 is connected to the second power supply that is the base power supply. The other side of the resistor R5 connected to the supply power supply Vcc is connected to the collector terminal of the transistor Q1, and one side of the variable resistor VR2 is connected therebetween. The emitter terminal of the transistor Q1 connects to the second power source, which is the base power source, with the resistor R6 in-between, and passes through the contact between the resistor R6 and the emitter terminal of the transistor Q1 to coil L1. The other side of the coil L1 is connected to one side of the capacitor C2. The other side of the variable resistor VR2 and one side of the capacitor C2 are connected, and the capacitor C3 is present through the contact therebetween. The input terminal 5 for introducing the supply power and one side of the resistor R7 are connected, and there is a resistor R8 connected in series with the resistor R7, and the other side of the resistor R8 is a base power source. It is connected to the power supply.
저항(R7)과 저항(R8)사이를 통과하는 접점을 가운데 두고 콘덴서(C3)의 일측과 트랜지스터(Q2)의 베이스 단자가 접속한다. 트랜지스터(Q2)의 콜렉터 단자는 저항(R9)의 일측과 접속하고, 에미터단자는 제2전원과 접속되며, 트랜지스터(Q3)의 에미터단자는 기전전원인 제2전원과 접속되고, 트랜지스터(Q3)의 베이스단자는 직렬 연결된 저항(R11)과 저항(R12)과 접속하며, 저항(R12)의 다른 일측은 기전전원과 접속된다.One side of the capacitor C3 and the base terminal of the transistor Q2 are connected with the center of the contact passing between the resistor R7 and the resistor R8. The collector terminal of the transistor Q2 is connected to one side of the resistor R9, the emitter terminal is connected to the second power supply, the emitter terminal of the transistor Q3 is connected to the second power supply which is the electromotive power source, and the transistor ( The base terminal of Q3) is connected to the resistor R11 and the resistor R12 connected in series, and the other side of the resistor R12 is connected to the electromotive power source.
그리고 저항(R9)과 저항(R11)의 다른 일측은 공급전원(Vcc)을 유입하기 위한 입력단자(5)와 접속된다. 트랜지스터(Q3)의 콜랜터단자는 입력단자(5)와 접속된 저항(R10)의 일측과 콘덴서(C5)의 일측과 각각 접속한다. 트랜지스터(Q3)의 베이스단자는 직렬연결된 저항(R11,R12)의 사이를 지나 콘덴서(C4)의 일측과 접속되며, 콘덴서(C4)의 다른 일측은 저항(R24)의 일측과 접속되며, 저항(R24)과 콘덴서(C4)의 사이의 접점을 지나 저항(R25)의 일측이 접속되고, 저항(R25)의 다른 일측은 기저전원인 제2전원과 접속된다. 콘덴서(C5)의 일측은 저항(R13), 저항(R14)의 일측과 트랜지스터(Q4)의 베이스단자와 각각 접속되며, 저항(R13)의 다른 일측은 공급전원을 유입하기 위한 입력단자(5)와 접속되고, 저항(R14)의 또 다른 일측은 기저전원인 제2전원과 접속되어 있다. 트랜지스ㅌ(Q4)의 콜렉터단자는 입력단자(5)와 접속되고, 에미터단자는 저항(R15)의 일측과 저항(R16)의 일측이 각각 접속된다. 저항(R15)의 다른 일측은 기저전원인 제2전원과 접속되며, 저헝(R16)의 또 다른 일측은 콘덴서(C6)의 일측과 트랜지스터(Q5)의 베이스단자와 접속한다. 저항(R6)의 또 다른 일측은 기저전원인 제2전원과 접속되며, 트랜지스터(Q5)의 에미터단자는 기저전원인 제2전원과 접속되어 있다. 트랜지스터(Q5)의 콜랙터단자는 저항(R17)의 일측과 저항(R21)의 일측과 각각 접속하며, 저항(R17)의 또 다른 일측은 공급전원을 유입하기 위한 입력단자(5)와 접속된다.The other end of the resistor R9 and the resistor R11 is connected to an input terminal 5 for introducing a supply power supply Vcc. The converter terminal of the transistor Q3 is connected to one side of the resistor R10 and one side of the capacitor C5 connected to the input terminal 5, respectively. The base terminal of the transistor Q3 is connected to one side of the capacitor C4 through the resistors R11 and R12 connected in series, and the other side of the capacitor C4 is connected to one side of the resistor R24. One side of the resistor R25 is connected through the contact between R24 and the capacitor C4, and the other side of the resistor R25 is connected to a second power source which is a base power source. One side of the capacitor C5 is connected to the resistor R13, one side of the resistor R14 and the base terminal of the transistor Q4, respectively, and the other side of the resistor R13 is an input terminal 5 for introducing supply power. The other side of the resistor R14 is connected to a second power source which is a base power source. The collector terminal of the transistor Q4 is connected to the input terminal 5, and the emitter terminal is connected to one side of the resistor R15 and one side of the resistor R16. The other side of the resistor R15 is connected to a second power source, which is a base power source, and the other side of the bottom R16 is connected to one side of the capacitor C6 and the base terminal of the transistor Q5. The other side of the resistor R6 is connected to a second power source which is a base power source, and the emitter terminal of the transistor Q5 is connected to a second power source which is a base power source. The collector terminal of the transistor Q5 is connected to one side of the resistor R17 and one side of the resistor R21, and the other side of the resistor R17 is connected to the input terminal 5 for introducing the supply power. .
트랜지스터(Q6)의 콜렉터 단자는 저항(R18)의 일측과 접속하며, 저항(R18)의 또 다른 일측은 공급전원을 유입하기 위한 입력단자(5)와 접속된다. 트랜지스터(Q6)의 에미터단자는 기저전원인 제2전원과 접속되며, 베이스단자는 저항(R19)의 일측과 다이오드(D1)의 양극단자와 각각 접속한다. 저항(R19)의 또 다른 일측은 공급전원을 유입하기 위한 입력단자(5)와 접속되며, 다이오드(D1)의 음극단자는 또 다른 다이오드 (D2)의 양극 단자와 접속하고, 다이오드(D2)의 음극단자는 저항(R20)을 사이에 두고 기저전원인 제2전원과 접속된다. 저항(R21)의 또 다른 일측은 저항(R22)의 일측과 트랜지스터(Q7)의 베이스단자와 접속하며 저항(R22)의 다른 일측은 기저전원인 제2전원과 접속된다.The collector terminal of transistor Q6 is connected to one side of resistor R18, and the other side of resistor R18 is connected to input terminal 5 for introducing supply power. The emitter terminal of the transistor Q6 is connected to the second power source, which is a base power source, and the base terminal is connected to one side of the resistor R19 and the positive terminal of the diode D1, respectively. Another side of the resistor (R19) is connected to the input terminal 5 for introducing the supply power, the cathode terminal of the diode (D1) is connected to the positive terminal of another diode (D2), of the diode (D2) The negative electrode terminal is connected to a second power source that is a base power source with the resistor R20 therebetween. Another side of the resistor R21 is connected to one side of the resistor R22 and the base terminal of the transistor Q7, and the other side of the resistor R22 is connected to a second power source which is a base power source.
저항(R23)은 공급전원을 유입하기 위한 입력단자(5)와 접속되며, 저항(R23)의 또다른 일측은 트랜지스터(Q7)의 콜렉터단자와 스위치(40)의 제1단자(b)와 각각 접속한다. 그리고 트랜지스터(Q7)의 콜렉터단자는 저항(R23)과 제1단자(b)사이의 접점을 통하여 제어신호출력단자(15)와도 접속된다. 스위치(40)의 제2단자(a)는 기저전원인 제2전원과 접속되어 있다. 그리고 상기 매트릭스(30)는 제어신호 출력단자(15)로 인가되는 제어신호를 유입하기 위한 제1제어신호입력단자(15)와, 하이파이음에서도 왼쪽채널(L채널)과 오른쪽채널(R채널)의 음과 모노음을 선택 제어하는 제2제어신호 입력단자(25)와 스테레오음을 출력하기 위한 출력단자가 있다.The resistor R23 is connected to an input terminal 5 for introducing supply power, and another side of the resistor R23 is connected to the collector terminal of the transistor Q7 and the first terminal b of the switch 40, respectively. Connect. The collector terminal of the transistor Q7 is also connected to the control signal output terminal 15 through a contact between the resistor R23 and the first terminal b. The second terminal a of the switch 40 is connected to a second power source which is a base power source. The matrix 30 includes a first control signal input terminal 15 for introducing a control signal applied to the control signal output terminal 15 and a left channel (L channel) and a right channel (R channel) even in a hi-fi sound. There is a second control signal input terminal 25 for controlling the sound and mono sound of the and the output terminal for outputting stereo sound.
이하 본 고안의 동작을 상세히 설명한다.Hereinafter, the operation of the present invention will be described in detail.
기록매체로부터 오디오 재생헤드는 오디오신호를 픽업(Pick-up)한다. 이때 오디오 재생헤드는 L채널과 R채널에 해당하는 하이파이음성신호를 픽업하기 위한 두개의 헤드(1,2)와, 모노음성을 픽업하기 위한 또 하나의 헤드(3)가 존재한다. L채널과 R채널에 해당하는 오디오신호는 증폭기(AMP1)에서 일차 증폭되어 복조기(10,11)로 전송한다. 복조기(10,11)에서 유입된 오대오신호를 L채널과 R채널에 해당하는 음성신호로 대역필터에 의해 대역제한되어 복조캐리어(FM Carrier)에 의해 복조된 음성신호가 출력된다. 복조기(10,11)의 출력은 잡음제거기(20,21)에서 음성신호가 불필요한 잡음을 제거해 매트릭스(30)와 버퍼(B1,B2)로 공급된다.The audio reproduction head picks up the audio signal from the recording medium. At this time, the audio playhead includes two heads 1 and 2 for picking up the hi-fi audio signals corresponding to the L and R channels, and another head 3 for picking up the mono voice. The audio signals corresponding to the L and R channels are first amplified by the amplifier AMP1 and transmitted to the demodulators 10 and 11. The audio signal introduced by the demodulators 10 and 11 is band-limited by a band filter to a voice signal corresponding to the L channel and the R channel, and outputs a voice signal demodulated by a demodulation carrier. The outputs of the demodulators 10 and 11 are supplied to the matrix 30 and the buffers B1 and B2 by removing noise from which the voice signal is unnecessary in the noise cancellers 20 and 21.
모노음성신호는 증폭기(AMP2)에서 일차 증폭된다. 라인증폭기(Line AMP3)에서는 증폭기(AMP2)에서 증폭된 모노음성신호를 유입하여 전송선로를 통하여 신호를 매트릭스(30)와 저항(R24)로 전달한다.The mono audio signal is first amplified by the amplifier AMP2. The line amplifier AMP3 receives the mono audio signal amplified by the amplifier AMP2 and transfers the signal to the matrix 30 and the resistor R24 through the transmission line.
버퍼(B1,B2)로 공급된 하이파이 음성신호는 저항(R1,R2)에 의해 믹싱 (Mixi ng)되어, 가변저항(VR1)에 의해 신호의 레벨이 조정된 다음, 저한 (R3,R4 ,R5,R6)과 콘덴서(C2)와 코일(L1), 가변저항(VR2), 그리고 트랜지스터 (Q1)에 의해 구성된 위상조정회로(60)에 인가된다.The hi-fi audio signal supplied to the buffers B1 and B2 is mixed by the resistors R1 and R2, and the level of the signal is adjusted by the variable resistor VR1, and then lowered by R3, R4 and R5. Is applied to the phase adjusting circuit 60 constituted by R6, the capacitor C2, the coil L1, the variable resistor VR2, and the transistor Q1.
위상조정회로(60)에서는 저항(R3,R4)에 의해 트랜지스터(Q1)의 베이스단자에 일정한 바이어스전압이 형성되어 트랜지스터(Q1)에서 증폭된 하이파이 음성신호는 저항(R6), 코일(L1), 콘덴서(C2)에 의해 신호의 위상을 상대적으로 조절하여 콘덴서 (C3)로 전송한다.In the phase adjusting circuit 60, a constant bias voltage is formed at the base terminal of the transistor Q1 by the resistors R3 and R4, and the amplified hi-fi audio signal is amplified by the resistor R6, coil L1, The phase of the signal is relatively adjusted by the capacitor C2 and transmitted to the capacitor C3.
콘덴서(C3)에 인가된 하이파이 음성신호는 트랜지스터(Q2,Q3), 저항(R7∼ R12)으로 구성된 차동증폭기(7)로 전송되어 저항(R7,R8)에 의해 결정된 바이어스전압이 트랜지스터(Q2)의 베이스단자에 형성되고, 저항(R11,R12)에 의해 결정된 바이어스전압이 트랜지스터(Q3)의 베이스단자에 형성된다.The hi-fi audio signal applied to the capacitor C3 is transmitted to the differential amplifier 7 composed of the transistors Q2 and Q3 and the resistors R7 to R12 so that the bias voltage determined by the resistors R7 and R8 is the transistor Q2. A bias voltage determined by the resistors R11 and R12 is formed at the base terminal of the transistor Q3.
차동증폭기(70)의 일반적인 특성에 의해 콘덴서(C3)를 통과하여 트랜지스터 (Q2)의 베이스단자에 인가된 하이파이 음성신호와, 저항(R24,R25)에 의해 조절되어 콘덴서(C4)를 통과하여 트랜지스터(Q2)의 베이스단자에 인가된 모노음성신호와의 차성분말을 증폭하여 콘덴서(C5)로 전달한다. 이때 각 베이스단자는 동일한 신호가 인가될 경우, 차동증폭기(70)로 출력되는 신호는 거의 없게되고 서로 다른 신호가 인가되는 경우는, 두 신호의 차성분이 증폭되어 다음단의 적분회로(80)로 인가된다.Due to the general characteristics of the differential amplifier 70, a hi-fi audio signal applied to the base terminal of the transistor Q2 through the capacitor C3 and controlled by the resistors R24 and R25 is passed through the capacitor C4. The difference component with the mono audio signal applied to the base terminal of Q2 is amplified and transferred to the condenser C5. At this time, when the same signal is applied to each base terminal, almost no signal is output to the differential amplifier 70. When different signals are applied, the difference components of the two signals are amplified to integrate the integrated circuit 80 of the next stage. Is applied.
트랜지스터(Q4), 저항(R13,R14,R15,R16), 콘덴서(C6)로 구성된 적분회로 (80)는 인가된 교류성분의 신호를 직류전압으로 변환시켜 다음단의 비교기(90)로 구동한다.An integrating circuit 80 composed of a transistor Q4, resistors R13, R14, R15, R16, and a capacitor C6 converts a signal of an applied AC component into a DC voltage and drives the comparator 90 of the next stage. .
트랜지스터(Q5,Q6), 저항(R17,R18,R19,R20)과, 다이오드(D1,D2)로 구성된 비교기(90)는 저항(R19)과 다이오드(D1,D2)에 의해 결정된 바이어스전압이 트랜지스터(Q6)의 베이스단자에 향상 인가되어 있음으로 인해, 트랜지스터(Q5)의 베이스단자에 인가되는 신호전압이 트랜지스터(Q6)의 베이스단자에 인가되어 있는 기준전압 보다 클때에, 즉, 차동증폭기(70)를 통과하여 적분회로(80)에서 인가된 신호가 있을때, 트랜지스터(Q5)는 턴온(Turn-on)상태가 되어 트랜지스터(Q6)는 턴오프(Turn-off)되고 트랜지스터(Q5)의 콜랙터단자를 통해 출력되는 신호가 로우논리상태가 된다.Comparator 90 composed of transistors Q5 and Q6, resistors R17, R18, R19 and R20 and diodes D1 and D2 has a bias voltage determined by resistor R19 and diodes D1 and D2. Due to the improvement applied to the base terminal of Q6, when the signal voltage applied to the base terminal of transistor Q5 is larger than the reference voltage applied to the base terminal of transistor Q6, that is, differential amplifier 70 When there is a signal applied from the integrating circuit 80 by passing through), transistor Q5 is turned on, and transistor Q6 is turned off and the collector of transistor Q5 is turned on. The signal output through the terminal becomes the low logic state.
이때 제어용스위치수단(100)의 트랜지스터(Q7)는 턴 오프(Turn-off)되어 저항(R23)을 통과하여 인가되는 전원과, 스위치(40)의 작동여부에 따라 출력단자(15)를 통해 하이 또는 로우논리상태의 제어신호를 매트릭스(30)로 인가한다. 이때는 두 신호가 다른 신호일때 이므로 스위치(40)가 정상적으로 작동하게 된다. 즉 믹싱스위치를 선택적으로 사용할 수 있게 된다. 그러나 비교기(90)에서 트랜지스터(Q5)의 베이스단자에 인가되는 신호가 작음으로 인해 트랜지스터(Q5)가 턴오프(Turn-off)상태가 되면, 제어용스위치수단 (100)에서 트랜지스터(Q7)의 베이스단자로 하이논리상태와 같은 신호가 인가되어 트랜지스터(Q7)를 턴온(Turn-on)시킨다. 그러면 스위치(40)의 작동여부와는 상관없이 공급전원을 기저전위로 흐르게 함으로써 출력단자(15)를 통해 매트릭스(30)로 인가되는 제어신호는 로우논리상태가 되므로서 믹싱스위치(40)의 온 오프 동작과 상관없이 하이파이 음성신호와 모노음성신호의 믹싱기능을 수행하지 않게 한다.At this time, the transistor Q7 of the control switch means 100 is turned off and turned high through the output terminal 15 depending on whether the power is applied through the resistor R23 and the operation of the switch 40. Alternatively, a low logic control signal is applied to the matrix 30. In this case, since the two signals are different signals, the switch 40 operates normally. That is, the mixing switch can be selectively used. However, when the transistor Q5 is turned off because the signal applied to the base terminal of the transistor Q5 in the comparator 90 is small, the control switch means 100 controls the base of the transistor Q7. A signal such as a high logic state is applied to the terminal to turn on the transistor Q7. Then, regardless of whether the switch 40 is operated, the control signal applied to the matrix 30 through the output terminal 15 becomes a low logic state by supplying the supply power to the ground potential so that the mixing switch 40 is turned on. Regardless of the off operation, the hi-fi audio signal and the mono sound signal are not mixed.
이때 매트릭스(30)는 제2제어신호입력단자(25)로 인가되는 신호에 따라 L채널과 R채널 그리고 모노음성을 선택하고, 제1제어신호입력단자(15)로 인가되는 신호에 따라 모노음성신호가 스테레오음성신로를 믹싱 또는 각각 선택 출력한다.At this time, the matrix 30 selects the L channel, the R channel, and the mono voice according to the signal applied to the second control signal input terminal 25, and the mono voice according to the signal applied to the first control signal input terminal 15. The signal mixes or selectively outputs stereo speech paths, respectively.
상술한 바와같이, 본 고안에 의한 음성선택회로는 하이파이음성과 모노음성이 다를 경우 사용자의 선택에 의해 믹싱시킬수 있고, 상기 두 신후가 같을 경우 믹싱시키지 않음으로써, 모노음성에 포함된 잡음성분이 하이파이음성과 동시에 재생되는 것을 막을수 있는 이점이 있다.As described above, the voice selection circuit according to the present invention can be mixed by the user's selection when the hi-fi voice and the mono voice are different, and when the two bodies are the same, the voice component is not mixed so that the noise component included in the mono voice is hi-fi. There is an advantage that can be prevented from being played simultaneously with the voice.
Claims (8)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019910013113U KR940000632Y1 (en) | 1991-08-19 | 1991-08-19 | Voice choice circuit of hi-fi vcr |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019910013113U KR940000632Y1 (en) | 1991-08-19 | 1991-08-19 | Voice choice circuit of hi-fi vcr |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR930005464U KR930005464U (en) | 1993-03-22 |
| KR940000632Y1 true KR940000632Y1 (en) | 1994-02-07 |
Family
ID=19318007
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019910013113U KR940000632Y1 (en) | 1991-08-19 | 1991-08-19 | Voice choice circuit of hi-fi vcr |
Country Status (1)
| Country | Link |
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| KR (1) | KR940000632Y1 (en) |
-
1991
- 1991-08-19 KR KR2019910013113U patent/KR940000632Y1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR930005464U (en) | 1993-03-22 |
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