KR20080088737A - A liquid crystal display device - Google Patents

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Abstract

An LCD(Liquid Crystal Display) is provided to form two or more pixel cells, for expressing the same color, in one unit pixel and supply a data signal of gray scales of different sizes to each pixel cell, thereby expressing detail gray scales. Plural gate lines are arranged in one direction. Plural data lines are arranged to cross the gate lines. Plural pixel cells are arranged in a pixel area between data lines. Plural pixel cells having different three colors are arranged in one pixel area. At least two pixel cells of pixel cells included within one unit pixel for displaying one unit image display the same color.

Description

액정표시장치{A liquid crystal display device} Liquid crystal display devices {A liquid crystal display device}

도 1은 본 발명의 제 1 실시예에 따른 액정표시장치를 나타낸 도면 Figure 1 is a view of the liquid crystal display device according to a first embodiment of the present invention

도 2는 도 1에 구비된 임의의 하나의 화소셀에 대한 상세도 Figure 2 is a detail on any one of the pixel cells in the provided in Figure 1

도 3은 도 1에서의 일부 화소셀들을 나타낸 도면 Figure 3 is a view of some of the pixel cells at 1

도 4는 도 3의 각 화소셀들에 공급되는 데이터 신호 및 스캔펄스의 타이밍도를 나타낸 도면 Figure 4 is a diagram showing a timing chart of a data signal and a scan pulse supplied to each pixel cell of FIG. 3

도 5는 본 발명의 제 2 실시예에 따른 액정표시장치를 나타낸 도면 Figure 5 is a view of the liquid crystal display device according to a second embodiment of the present invention

도 6은 도 5에 구비된 임의의 하나의 화소셀에 대한 상세도 Figure 6 is a detailed view of a single pixel cell of any provided in Figure 5

*도면의 주요부에 대한 부호 설명 * Code description of main portions in the drawing

GL : 게이트 라인 DL : 데이터 라인 GL: gate line DL: Data line

PXL : 화소셀 PE : 화소전극 PXL: pixel cells PE: pixel electrode

TFT : 박막트랜지스터 PD : 화소 영역 TFT: thin film transistor PD: pixel region

본 발명은 액정표시장치에 관한 것으로, 특히 충전불량에 따른 화질 저하를 방지할 수 있는 액정표시장치 및 이의 구동방법에 대한 것이다. The present invention relates to, and more particularly a liquid crystal display device and a driving method thereof capable of preventing the image quality deterioration due to charging failure on a liquid crystal display device.

액정표시장치는 비디오신호에 따라 액정셀들의 광투과율을 조절하여 화상을 표시하게 된다. The liquid crystal display device is to display an image by controlling light transmittance of liquid crystal cells in accordance with the video signal. 액티브 매트릭스(Active Matrix) 타입의 액정표시장치는 화소셀마다 스위칭소자(TFT)가 형성되어 동영상을 표시하기에 유리하다. Active-matrix (Active Matrix) liquid crystal display device of the type is formed of a switching element (TFT) for each pixel cell it is advantageous in displaying a video. 스위칭소자(TFT)로는 주로 박막트랜지스터(Thin Film Transistor)가 이용되고 있다. Roneun switching element (TFT) is mainly used a thin film transistor (Thin Film Transistor).

이러한 종래의 액정표시장치는 하나의 단위 화소가 세 색상의 화소셀들로 이루어져 있기 때문에 미세한 계조를 표현하기가 어려운 문제점을 가진다. These conventional liquid crystal display device has a problem that represent a fine gray level is difficult because it consists of the three color component pixel is a unit cell.

본 발명은 상기와 같은 문제점을 해결하기 위하여 안출한 것으로, 하나의 단위 화소에 동일한 색상을 표현하는 화소셀을 2개 이상 형성하고, 각 화소셀에 서로 다른 크기의 계조의 데이터 신호를 공급함으로써 미세한 계조를 표현할 수 있는 액정표시장치를 제공하는데 그 목적이 있다. The present invention is one made in view of the above problems, a pixel cell to represent the same color in a unit pixel two or more, and fine by supplying a data signal of a gradation of a different size to the pixel cells to provide a liquid crystal display device to express a gray scale it is an object.

상기와 같은 목적을 달성하기 위한 본 발명에 따른 액정표시장치는, 일방향으로 배열된 다수의 게이트 라인들; A liquid crystal display device according to the present invention for achieving the above object is, in an array in one direction, a plurality of gate lines; 상기 게이트 라인들에 교차하도록 배열된 다수의 데이터 라인들; The plurality of data lines arranged to cross to the gate lines; 상기 각 데이터 라인 사이의 화소 영역에 배열된 다수의 화소셀들을 포함하며; It includes a plurality of pixel cells arranged in the pixel region between the respective data lines; 하나의 화소 영역에는 서로 다른 3색의 화소셀들이 다수 배열되어 있으며; One pixel region of the pixel cells to each other has the other three colors are the number array; 하나의 단위 화상을 표시하기 위한 하나의 단위 화소내에 포함된 화소셀들 중 적어도 2개의 화소셀이 동일한 색상을 표시하는 것을 그 특징으로 한다. And that at least two pixel cells of the pixel cells included in one unit pixel for displaying a unit image is displayed with the same color as its features.

이하, 첨부된 도면을 참조하여 본 발명의 실시예에 따른 액정표시장치를 상세히 설명하면 다음과 같다. Turning to the liquid crystal display according to the embodiment described below, the present invention will be described with reference to the accompanying drawings in detail as follows.

제 1 실시예 First Embodiment

도 1은 본 발명의 제 1 실시예에 따른 액정표시장치를 나타낸 도면이고, 도 2는 도 1에 구비된 임의의 하나의 화소셀에 대한 상세도이다. 1 is a view showing an LCD device according to a first embodiment of the present invention, Figure 2 is a detailed view for an arbitrary one pixel cell in the provided in Figure 1.

본 발명의 제 1 실시예에 따른 액정표시장치는, 도 1에 도시된 바와 같이, 일방향으로 배열된 다수의 게이트 라인들(GL0 내지 GLn)과, 상기 게이트 라인들(GL0 내지 GLn)에 교차하도록 배열된 다수의 데이터 라인들(DL1 내지 DLm)과, 상기 각 데이터 라인(DL1 내지 DLm) 사이의 화소 영역(PD1 내지 PDm-1)에 배열된 다수의 화소셀(PXL)들과, 상기 게이트 라인들(GL0 내지 GLn)을 구동하기 위한 게이트 드라이버(도시되지 않음)와, 그리고 상기 데이터 라인들(DL1 내지 DLm)을 구동하기 위한 데이터 드라이버(도시되지 않음)를 구비한다. The liquid crystal display device according to a first embodiment of the present invention, as shown in Figure 1, so as to cross in an array in one direction, a plurality of gate lines (GL0 to GLn) and the gate line (GL0 to GLn) It arranged a plurality of data lines (DL1 to DLm) and, each of the data lines (DL1 to DLm) pixel area a plurality of pixel cells (PXL) arranged in (PD1 to PDm-1) between the said gate lines and a s (GL0 to GLn) of the gate driver (not shown) for driving and, and the data lines (DL1 to DLm) (not shown) for driving the data driver.

각 화소셀(PXL)은, 도 2에 도시된 바와 같이, 상기 게이트 라인으로부터의 게이트 신호에 따라 상기 데이터 라인으로부터의 데이터 신호를 스위칭하는 박막트랜지스터(TFT)와, 상기 박막트랜지스터(TFT)로부터의 데이터 신호를 공급받아 화상을 표시하는 화소전극(PE)을 포함한다. From each pixel cell (PXL) is, as shown in Figure 2, a thin film transistor (TFT), and the thin film transistor (TFT) for switching the data signal from the data line in accordance with the gate signal from the gate line receiving the data signal comprises a pixel electrode (PE) for displaying an image.

상기 화소셀(PXL)들은 적색의 화상을 표현하기 위한 적색 화소셀(PXL)과, 녹색의 화상을 표현하기 위한 녹색 화소셀(PXL)과, 그리고 청색을 표현하기 위한 청색 화소셀(PXL)들로 구분된다. The pixel cell (PXL) are blue pixel cell (PXL) to express the red pixel cell (PXL) for representing a red image, the green pixel cell (PXL) for representing an image of a green, and a blue s It is divided into.

여기서, 하나의 화소 영역에는 적어도 2색 이상의 화소셀(PXL)들이 배열되어 있다. Here, there are at least two colors or more pixel cells (PXL) are arranged, one pixel region. 예를 들어, 제 1 화소 영역(PD1)에는 다수의 적색 화소셀(PXL), 다수의 녹색 화소셀(PXL), 및 다수의 청색 화소셀(PXL)이 위치한다. For example, a first pixel region (PD1), the number of red pixel cell (PXL), a plurality of green pixel cells (PXL), and a plurality of blue pixel cell (PXL) position.

또한, 하나의 화소 영역에 위치한 화소셀(PXL)들 중 서로 인접한 두 개의 화소셀(PXL)이 서로 동일한 색상을 표현한다. Also, a pixel area of ​​two pixels of the pixel cell (PXL) which are adjacent to each other in the cell (PXL) is to express the same color each other. 예를 들어, 상기 제 1 화소 영역(PD1)에 위치함과 아울러 박막트랜지스터(TFT)를 통해 제 1 게이트 라인(GL1) 및 제 1 데이터 라인(DL1)에 접속된 화소셀(PXL)과, 상기 제 1 화소 영역(PD1)에 위치함과 아울러 박막트랜지스터(TFT)를 통해 제 2 게이트 라인(GL2) 및 제 1 데이터 라인(DL1)에 접속된 화소셀(PXL)은 서로 동일한 녹색의 화상을 표현한다. For example, the first pixel region (PD1) position hereinafter as well as thin-film transistor (TFT), a pixel cell (PXL) connected to the first gate line (GL1) and the first data line (DL1) via the and, the a first pixel cell (PXL) connected to the pixel region. located in (PD1) and as well as the second gate line through the thin film transistor (TFT) (GL2) and the first data line (DL1) is represented by another image with the same green do.

또한, 서로 인접한 화소 영역간의 화소셀(PXL)들의 색상별 배열순서는 서로 다르다. Further, the arrangement order of each color of pixel cells (PXL) inter-region of pixels adjacent to each other are different from each other. 예를 들어, 제 1 화소 영역(PD1)에 위치한 화소셀(PXL)들의 색상별 배열순서와, 상기 제 1 화소 영역(PD1)에 인접한 제 2 화소 영역(PD2)에 위치한 화소셀(PXL)들의 색상별 배열순서가 서로 다르다. For example, one of the first and the arrangement order of each color of pixel cells (PXL) in a pixel region (PD1), the pixel cells (PXL) in a second pixel region (PD2) adjacent to the first pixel region (PD1) arranged in order by color is different. 상기 제 1 화소 영역(PD1)에 위치한 화소셀(PXL)들은 데이터 라인의 상측으로부터 녹색 화소셀(PXL), 녹색 화소셀(PXL), 청색 화소셀(PXL), 청색 화소셀(PXL), 적색 화소셀(PXL), 및 적색 화소셀(PXL) 순서로 배열되어 있으며, 이에 대하여 제 2 화소 영역(PD2)에 위치한 화소셀(PXL)들은 상기 데이터 라인의 상측으로부터 적색 화소셀(PXL), 적색 화소셀(PXL), 녹색 화소셀(PXL), 녹색 화소셀(PXL), 청색 화소셀(PXL), 및 청색 화소셀(PXL) 순서로 배열되어 있다. The first pixel cell (PXL) in a pixel region (PD1) are green pixel cell from the upper side of the data line (PXL), the green pixel cell (PXL), and blue pixel cells (PXL), and blue pixel cells (PXL), red pixel cells (PXL), and a red pixel cells are arranged in a (PXL) sequence, whereby the pixel cells (PXL) in a second pixel region for (PD2) are cells (PXL) red pixels from the top of the data line, the red are arranged in the pixel cell (PXL), the green pixel cell (PXL), the green pixel cell (PXL), and blue pixel cells (PXL), and a blue pixel cell (PXL) sequence.

또한, 서로 바로 마주보는 인접한 화소 영역의 화소셀(PXL)들의 색상이 서로 다르다. In addition, the color of the pixel cell (PXL) of an adjacent pixel region looking directly facing each other are different from each other. 예를 들어, 상기 제 1 화소 영역(PD1)에 위치함과 아울러 박막트랜지스터(TFT)를 통해 제 2 게이트 라인(GL2) 및 제 1 데이터 라인(DL1)에 접속된 화소셀(PXL)은 녹색의 화상을 표시하며, 이에 대하여 제 2 화소영역에 위치함과 아울러 박막트랜지스터(TFT)를 통해 제 2 게이트 라인(GL2) 및 제 2 데이터 라인(DL2)에 접속된 화소셀(PXL)은 적색의 화상을 표시한다. For example, the pixel cell (PXL) connected to the first pixel region. Located in (PD1) and as well as the second gate line through the thin film transistor (TFT) (GL2) and the first data line (DL1) is in the green and displaying an image, whereby the box located in the second pixel region for the addition of the pixel cell (PXL) connected to the second gate line (GL2) and second data line (DL2) through the thin film transistor (TFT) is the red image the display. 즉, 서로 바로 마주보는 두 화소셀(PXL)은 서로 다른 색상의 화상을 표시한다. That is, the two pixel cells (PXL) looking directly facing each other are displayed the images of different colors.

또한, 서로 다른 화소 영역에 위치하며 가장 최외각에 위치한 화소셀(PXL)들간의 높이가 서로 다르다. In addition, located in different pixel regions from each other and different from the height between the pixel cells (PXL) it is located in the outermost layer. 예를 들어, 제 1 화소 영역(PD1)에서 가장 상측에 위치한 화소셀(PXL)이, 상기 제 2 화소 영역(PD2)에서 가장 상측에 위치한 화소셀(PXL)보다 더 상측에 위치한다. For example, a first pixel region (PD1) pixel cells (PXL) is located in the upper side in this, which is positioned more to the image side than the second pixel region (PD2) pixel cells (PXL) is located in the upper side in the. 그리고, 상기 제 2 화소 영역(PD2)에서 가장 하측에 위치한 화소셀(PXL)이, 상기 제 1 화소 영역(PD1)에서 가장 하측에 위치한 화소셀(PXL)보다 더 하측에 위치한다. Then, the pixel cells (PXL) is located in the lower side in said second pixel region (PD2), and further located at the lower side than the pixel cells (PXL) is located in the lower side in the first pixel region (PD1).

다시말하면, 각 화소 영역(PD1 내지 PDm-1)에 포함된 화소셀(PXL)들의 수는 동일한데, 제 1 화소 영역(PD1)의 화소셀(PXL)들은, 더미 게이트 라인(GL0)부터 제 n-1 게이트 라인 사이에 배열되어 있으며, 이에 대하여 제 2 화소 영역(PD2)의 화소셀(PXL)들은 제 1 게이트 라인(GL1)부터 제 n 게이트 라인 사이에 배열되어 있다. From the other words, the number of pixel cells (PXL) that are included in each pixel region (PD1 to PDm-1) is equal, the first pixel cell (PXL) are, the dummy gate line (GL0) of the pixel region (PD1) the is arranged between the n-1 and the gate line, and thus the pixel cells (PXL) of the second pixel regions for (PD2) are arranged between from the first gate line (GL1) the n-th gate line.

상기 더미 게이트 라인(GL0)은 기수번째 화소 영역에서 가장 상측에 위치한 화소셀(PXL)에 보조용량 커패시터를 형성하기 위한 전극으로 사용된다. The dummy gate line (GL0) is used as an electrode for forming a storage capacitor with the pixel capacitor cell (PXL) is located in the upper side in the odd-numbered pixel region. 즉, 각 화소셀(PXL)의 화소전극(PE)은 전단 화소셀(PXL)을 구동하기 위한 전단 게이트 라인과 소정 부분 중첩하게 되는데, 이들이 중첩하는 부분에 보조용량 커패시터가 형성된다. That is, the pixel electrode (PE) of each pixel cell (PXL) is the front end there is a gate line for driving the front end pixel cells (PXL) and overlapping a predetermined portion, the storage capacitor is a capacitor formed in a portion in which they overlap. 상기 보조용량 커패시터는 상기 화소전극(PE)을 제 1 전극으로 사용하고, 상기 게이트 라인을 제 2 전극으로 사용하고, 상기 화소전극(PE)과 게이트 라인간에 위치한 절연막(도시되지 않음)을 유전체로 사용한다. The auxiliary capacitance capacitor in the insulating film (not shown) in the pixel electrode (PE) used as the first electrode, and, using the gate lines as a second electrode between the pixel electrodes (PE) and the gate line dielectric use.

또한, 서로 인접한 화소 영역에 위치한 화소셀(PXL)들 중 일부 화소셀(PXL)들은 두 화소 영역의 경계부에 위치한 데이터 라인에 공통으로 접속된다. In addition, pixel cells (PXL) some pixel cells (PXL) from each other in the adjacent pixel regions are connected in common to the data line in the boundary between the two pixel regions. 예를 들어, 상기 제 1 화소 영역(PD1)의 화소셀(PXL)들 중 기수번째 화소셀(PXL)들과, 상기 제 2 화소 영역(PD2)의 화소셀(PXL)들 중 기수번째 화소셀(PXL)이 상기 제 1 화소 영역(PD1)과 제 2 화소 영역(PD2)의 경계부에 위치한 데이터 라인에 공통으로 접속된다. For example, the first pixel region (PD1) pixel cells (PXL) among odd-numbered pixel cells (PXL) and the pixel cell (PXL) of odd-numbered pixel cells of the second pixel region (PD2) of (PXL) is connected in common to the data line in the boundary between the first pixel region (PD1) and the second pixel region (PD2). 좀 더 구체적으로, 상기 제 1 화소 영역(PD1)에서 가장 상측에 위치한 기수번째 화소셀(PXL)과, 상기 제 2 화소 영역(PD2)에서 가장 상측에 위치한 기수번째 화소셀(PXL)은 모두 제 2 데이터 라인(DL2)에 접속된다. All More specifically, the first pixel region (PD1) odd-numbered pixel cells (PXL) is located in the upper side and from the second pixel region odd-numbered pixel cells (PXL) is located in the upper side in (PD2) is the 2 is connected to the data line (DL2).

각 화소셀(PXL) 및 화소전극(PE)은 사다리꼴 및 역 사다리꼴 형태를 이룬다. Each pixel cell (PXL) and a pixel electrode (PE) forms a trapezoidal and inverted trapezoidal shape. 구체적으로, 기수번째 화소 영역에 위치함과 아울러 박막트랜지스터(TFT)를 통해 기수번째 게이트 라인에 접속된 화소셀(PXL) 및 이 화소셀(PXL)의 화소전극(PE)은 사다리꼴 형태를 이루며, 기수번째 화소 영역에 위치함과 아울러 박막트랜지스터(TFT)를 통해 우수번째 게이트 라인에 접속된 화소셀(PXL) 및 이 화소셀(PXL)의 화소전극(PE)은 역 사다리꼴 형태를 이룬다. Specifically, the pixel electrode (PE) of the pixel cell (PXL), and a pixel cell (PXL) connected to the rider's in the second pixel region and the well odd-numbered gate line through the thin film transistor (TFT) and is formed a trapezoidal shape, a pixel electrode (PE) of the pixel cell (PXL), and a pixel cell (PXL) connected to the solid-th gate line's in the odd-numbered pixel region and the well via the thin film transistor (TFT) forms an inverted trapezoidal shape.

이에 대하여, 우수번째 화소 영역에 위치함과 아울러 박막트랜지스터(TFT)를 통해 기수번째 게이트 라인에 접속된 화소셀(PXL) 및 이 화소셀(PXL)의 화소전극(PE)은 역 사다리꼴 형태를 이루며, 우수번째 화소 영역에 위치함과 아울러 박막트랜지스터(TFT)를 통해 우수번째 게이트 라인에 접속된 화소셀(PXL) 및 이 화소셀(PXL)의 화소전극(PE)은 사다리꼴 형태를 이룬다. The pixel electrode (PE) of the box for the position in solid second pixel region and the well films of the pixel cell (PXL), and a pixel cell (PXL) connected to odd-numbered gate lines via a transistor (TFT) will form an inverted trapezoidal shape a pixel electrode (PE) of the pixel cell (PXL), and a pixel cell (PXL) connected to the solid's in the second pixel region and the second gate lines as well as excellent via the thin film transistor (TFT) forms a trapezoidal shape.

이에 따라, 동일 화소 영역에 위치하며, 서로 인접하며, 그리고 서로 동일한 색상을 표시하는 두 개의 화소셀(PXL) 및 두 개의 화소 전극은 육각형 헝태를 이룬다. Accordingly, it located in the same pixel region, and adjacent to each other, and two pixel cells (PXL), and two pixel electrodes to display the same color with each other forms a hexagon heongtae.

상기 화소셀(PXL) 및 화소전극(PE)의 형상에 의해 상기 데이터 라인들(DL1 내지 DLm)은 지그 재그 형태의 형상을 이룬다. By the shape of the pixel cell (PXL) and a pixel electrode (PE) to the data lines (DL1 to DLm) forms the shape of the jig zag form.

본 발명에서 하나의 단위 화소는 서로 인접한 2개의 적색 화소셀(PXL)들과, 서로 인접한 2개의 녹색 화소셀(PXL)들과, 그리고 서로 인접한 2개의 청색 화소셀(PXL)들로 구성된다. A unit pixel in the present invention is composed of two red pixel cell (PXL) and two green pixel cells adjacent to each other (PXL) and, and two blue pixel cell (PXL) which are adjacent to each other adjacent to each other. 즉, 하나의 단위 화소는 총 6개의 화소셀(PXL)들로 구성된다. That is, one unit pixel is composed of a total of six pixel cells (PXL).

본 발명에서는 동일한 색상의 화소셀(PXL)들에 동일한 계조의 데이터 신호를 공급할 수도 있으며, 서로 다른 계조의 데이터를 공급할 수 도 있다. According to the present invention may supply a data signal of the same gray level in the pixel cell (PXL) of the same color, there is another to supply the data of other gray level.

동일한 색상의 화소셀(PXL)들에 서로 다른 계조의 데이터 신호가 공급될 경우, 이러한 구조를 갖는 액정표시장치는 종래에 비하여 더 미세한 계조까지 표현할 수 있다. When a data signal of a different gray level supplied to the pixel cells (PXL) of the same color, a liquid crystal display device having such a structure can be expressed in comparison to the conventional finer gradation.

상기 동일한 색상의 화소셀(PXL)들에 서로 다른 계조의 데이터 신호를 공급하기 위해서 다음과 같은 방법이 적용될 수 있다. To the data signals of different gray level to the pixel cells (PXL) of the same color it may be applied the following method. 여기서, 설명의 편의상 상기 동일한 색상의 화소셀(PXL)들을 각각 제 1 화소셀(PXL)과 제 2 화소셀(PXL)로 표현하기로 한다. Here, it will be represented by the pixel cells for convenience each of the first pixel (PXL) cells (PXL) and the second pixel cells (PXL) of the same color of the description.

상기 데이터 드라이버는 타이밍 콘트롤러로부터의 상기 제 1 화소셀(PXL)에 해당하는 데이터 신호를 공급받고, 이 데이터 신호를 복사한다. The data driver receives the data signal corresponding to the first cell pixel (PXL) from the timing controller, and a copy of this data signal. 그리고, 이 복사된 데이터 신호에 미리 설정된 가중치를 더하거나 빼서 상기 원 데이터 신호보다 더 큰 계조의 데이터 신호를 생성하거나, 더 작은 계조의 데이터 신호를 생성한다. Then, by adding or subtracting a pre-set weight to the copied data signal generating a data signal of a larger gray level than the original data signal, and generates a further data signal of a gradation. 그리고, 상기 데이터 드라이버는 이 생성된 데이터 신호를 제 2 화소셀(PXL)에 공급한다. In addition, the data driver supplies the generated data signal to the second pixel cell (PXL).

본 발명에서의 동일한 색상을 갖는 두 개의 화소셀(PXL)은 종래의 하나의 화소셀(PXL)과 동일한 면적을 가질 수 도 있으며, 종래에 비하여 더 큰 면적을 가질 수 도 있다. Two pixel cells having the same color in the present invention (PXL) may also have the same area as a conventional single pixel cell (PXL), may also have a greater area than the prior art.

이와 같이 구성된 본 발명의 실시예에 따른 액정표시장치의 구동방법을 상세시 설명하면 다음과 같다. When a thus driving method of a liquid crystal display according to the embodiment of the present invention will described in detail when follows.

도 3은 도 1에서의 일부 화소셀(PXL)들을 나타낸 도면이고, 도 4는 도 3의 각 화소셀(PXL)들에 공급되는 데이터 신호 및 스캔펄스의 타이밍도를 나타낸 도면이다. Figure 3 is a view showing some of the pixel cells (PXL) in Figure 1, Figure 4 is a view showing the timing chart of the data signal and the scan pulse supplied to each pixel cell (PXL) of Fig.

제 1 기간(T1)에 출력된 제 1 스캔펄스(Vout1)는 제 1 게이트 라인(GL1)에 공급된다. The first scan signal (Vout1) output in a first period (T1) is supplied to the first gate line (GL1). 따라서, 이 제 1 게이트 라인(GL1)에 접속된 화소셀들(G11A, G12A, G13A, G14A)의 박막트랜지스터(TFT)가 턴-온되면서, 이 화소셀들(G11A, G12A, G13A, G14A)의 화소전극(PE)에 해당 데이터 신호가 공급된다. Thus, the first of the pixel cells connected to the gate line (GL1) (G11A, G12A, G13A, G14A) thin film transistor (TFT) is turned on - as one, in the pixel cell (G11A, G12A, G13A, G14A) of the corresponding data signal to the pixel electrode (PE) it is supplied.

여기서, 상기 더미 게이트 라인(GL0)에는 스캔펄스의 로우전압에 해당하는 정전압이 인가되는데, 이 정전압에 의해서 상기 화소셀(G11A, G12A, G13A, G14A)들의 보조용량 커패시터가 충전된다. Here, the dummy gate line (GL0) is applied there is a constant voltage that corresponds to the low voltage of the scan pulse, the storage capacitor is a capacitor of the pixel cells (G11A, G12A, G13A, G14A) is charged by a constant voltage.

이후, 제 2 기간(T2)에 출력된 제 2 스캔펄스(Vout2)는 제 2 게이트 라 인(GL2)에 공급된다. Then, the second scan signal (Vout2) output in the second period (T2) is supplied to the (GL2) as a second gate. 따라서, 이 제 2 게이트 라인(GL2)에 접속된 화소셀들(G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A)의 박막트랜지스터(TFT)가 턴-온되면서, 이 화소셀들(G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A)의 화소전극(PE)에 해당 데이터 신호가 공급된다. Accordingly, the second thin film transistor (TFT) is turned on, the gate line (GL2) of pixel cells (G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A) connected to - as one, in the pixel cell ( a corresponding data signal to the pixel electrode (PE) of G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A) is supplied.

여기서, 상기 제 2 게이트 라인(GL2)에 접속된 화소셀(G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A)들의 보조용량 커패시터는 상기 제 1 게이트 라인(GL1)에 공급된 제 1 스캔펄스(Vout1)의 로우전압에 의해서 충전된다. Here, the second gate line (GL2) pixel cell storage capacitance capacitor of (G11B, R11A, G12B, R12A, G13B, R13A, G14B, R14A) is first supplied to the first gate line (GL1) connected to It is charged by the low voltage of the scan signal (Vout1).

이어서, 제 3 기간(T3)에 출력된 제 3 스캔펄스(Vout3)는 제 3 게이트 라인(GL3)에 공급된다. Subsequently, the third scan signal (Vout3) output in the third period (T3) is supplied to the third gate line (GL3). 따라서, 이 제 3 게이트 라인(GL3)에 접속된 화소셀(B11A, R11B, B12A, R12B, B13A, R13B, B14A, R14B)들의 박막트랜지스터(TFT)가 턴-온되면서, 이 화소셀(PXL)들의 화소전극(PE)에 해당 데이터 신호가 공급된다. Thus, the third thin film transistor (TFT) is turned on by the gate lines (GL3) the pixel cells (B11A, R11B, B12A, R12B, B13A, R13B, B14A, R14B) connected to -, the pixel cells as whole (PXL) the corresponding data signal is supplied to the electrodes of pixels (PE).

여기서, 상기 제 3 게이트 라인(GL3)에 접속된 화소셀(PXL)들의 보조용량 커패시터는 상기 제 2 게이트 라인(GL2)에 공급된 제 2 스캔펄스(Vout2)의 로우전압에 의해서 충전된다. Here, the third gate line capacitor storage capacitor of the pixel cell (PXL) connected to (GL3) is charged by the low voltage of the second scan signal (Vout2) supplied to the second gate line (GL2).

이와 같은 방식으로, 제 4 내지 제 n 게이트 라인에 접속된 화소셀(PXL)들이 순차적으로 데이터 신호를 공급받아 화상을 표시한다. In this manner, the fourth to n pixel cells (PXL) connected to the gate line that displays an image received the data signal in sequence.

제 2 실시예 Second Embodiment

도 5는 본 발명의 제 2 실시예에 따른 액정표시장치를 나타낸 도면이고, 도 6은 도 5에 구비된 임의의 하나의 화소셀(PXL)에 대한 상세도이다. 5 is a view showing a liquid crystal display device according to a second embodiment of the present invention, Figure 6 is a detailed view of a single pixel cell (PXL) of any provided in FIG.

본 발명의 제 2 실시예에 따른 액정표시장치는, 도 5에 도시된 바와 같이, 일방향으로 배열돤 다수의 수평 보조라인들(HAL_u, HAL_d)과, 이 수평 보조라인들(HAL_u, HAL_d)에 교차하도록 배열된 다수의 수직 보조라인(VAL)들을 포함한다. A liquid crystal display device, a, of a one-way arrangement dwan plurality of horizontal auxiliary line (HAL_u, HAL_d), and the horizontal auxiliary line (HAL_u, HAL_d) as shown in Figure 5 according to a second embodiment of the present invention It includes an array so as to intersect a plurality of vertical auxiliary line (VAL).

상기 수평 보조라인들(HAL_u, HAL_d)은 각 게이트 라인(GL0 내지 GLn)의 상측에 위치한 상부 수평 보조라인(HAL_u)들과, 상기 게이트 라인들(GL0 내지 GLn)의 하측에 위치한 하부 수평 보조라인(HAL_d)들로 구분된다. The horizontal auxiliary lines (HAL_u, HAL_d) are each gate line lower horizontal auxiliary line located on the lower side of the upper horizontal auxiliary line (HAL_u) and, each of the gate lines (GL0 to GLn) located on the upper side of (GL0 to GLn) It is divided into (HAL_d).

수평 보조라인은 각 화소 영역(PD1 내지 PDm-1)마다 구비된다. Horizontal auxiliary line is provided for each pixel region (PD1 to PDm-1). 하나의 화소 영역에 위치한 수평 보조라인은 상기 화소 영역에 위치한 화소셀(PXL)들내의 화소전극(PE)의 중심부를 중첩한다. Horizontal auxiliary line which is located in one pixel region overlaps the center of the pixel cell (PXL) a pixel electrode (PE) of deulnae located in the pixel region.

상기 수직 보조라인(VAL)은 상기 데이터 라인과 동일한 물질로 형성되거나, 또는 게이트 라인과 동일한 물질로 형성될 수 있다. The vertical auxiliary line (VAL) may be formed of the same material and may be formed of the same material as the data lines or gate lines.

상기 수직 보조라인(VAL)이 상기 게이트 라인과 동일한 물질로 형성될 경우. If the vertical auxiliary line (VAL) is to be formed of the same material as the gate line. 상기 수직 보조라인(VAL)과 상기 게이트 라인들(GL0 내지 GLn)간의 교차부분에 대응하는 상기 수직 보조라인(VAL) 부분이 단선되며; The vertical auxiliary line (VAL) from the gate lines (GL0 to GLn) the vertical auxiliary line (VAL) is part of a break corresponding to the intersection between; 상기 단선된 부분이 연결부에 의해서 전기적으로 접속되며; Wherein the disconnection portion is electrically connected to by a connecting portion; 상기 연결부는 화소전극(PE)과 동일한 물질로 이루어진다. The connecting portion is made of the same material as the pixel electrode (PE).

상기 상부 수평 보조라인(HAL_u)은 상기 게이트 라인과 동일한 물질로 형성되거나, 또는 데이터 라인과 동일한 물질로 형성될 수 있다. The upper horizontal auxiliary line (HAL_u) may be formed of the same material and may be formed of the same material as the gate line or data line. 상기 상부 수평 보조라인(HAL_u)을 데이터 라인과 동일한 물질로 형성할 경우, 상기 데이터 라인과 short 가 되지 않도록 상기 상부 수평 보조라인(HAL_u)과 상기 데이터 라인간에 거리를 띄워야 한다. When forming the upper horizontal auxiliary line (HAL_u) of the same material as the data line, the ttuiwoya the distance between the data line and a short upper horizontal auxiliary line (HAL_u) and the data lines so as not.

상기 하부 수평 보조라인(HAL_d)은 상기 게이트 라인과 동일한 물질로 형성되거나, 또는 데이터 라인과 동일한 물질로 형성될 수 있다. The lower horizontal auxiliary line (HAL_d) may be formed of the same material and may be formed of the same material as the gate line or data line.

상기 하부 수평 보조라인(HAL_d)이 상기 데이터 라인과 동일한 물질로 형성될 경우, 상기 하부 수평 보조라인(HAL_d)과 상기 데이터 라인들(DL1 내지 DLm)간의 교차부분에 대응하는 상기 하부 수평 보조라인(HAL_d) 부분이 단선되며; When the lower horizontal auxiliary line (HAL_d) is to be formed of the same material as the data lines, the lower horizontal auxiliary line corresponding to the intersection portion between the lower horizontal auxiliary line (HAL_d) and the data lines (DL1 to DLm) ( HAL_d) it is part of the break; 상기 단선된 부분이 연결부에 의해서 전기적으로 접속되며; Wherein the disconnection portion is electrically connected to by a connecting portion; 상기 연결부는 상기 화소셀(PXL)의 화소전극(PE)과 동일한 물질로 이루어진다. The connecting portion is made of the same material as the pixel electrode (PE) of said pixel cells (PXL).

또한, 상기 수평 보조라인들 및 수직 보조라인(VAL)들은 상기 데이터 라인과 동일한 물질로 형성될 수 있다. In addition, the auxiliary horizontal lines and the vertical auxiliary line (VAL) can be formed of the same material as the data line. 이와 같은 경우, 상기 수평 보조라인은 상기 데이터 라인과 교차하게 되는데, 이 교차 부분에서 상기 수평 보조라인은 단선되며, 이 단선된 부분은 연결부를 통해 서로 연결될 수 있다. In this case, the horizontal auxiliary line, there is the intersection with the data line and the horizontal auxiliary line at the intersection is broken, the broken portion may be connected to each other via a connecting portion. 상기 연결부는 상기 화소전극(PE)과 동일한 물질로 형성할 수 있다. The connecting portion may be formed of the same material as the pixel electrode (PE). 즉, 각 단선된 부분을 노출시키는 콘택홀을 형성하고, 이 콘택홀을 통해 상기 단선된 각 부분을 상기 연결부를 통해 서로 전기적으로 연결할 수 있다. That is, it is possible to form a contact hole exposing a portion of each of the disconnection, the disconnection connect each part through the contact holes electrically to each other through the connection portion.

상기 상부 수평 보조라인(HAL_u)들 및 하부 수평 보조라인(HAL_d)들도 화소전극(PE)을 중첩하도록 배열된다. The upper horizontal auxiliary line (HAL_u) and lower horizontal auxiliary line (HAL_d) are also arranged so as to overlap the pixel electrode (PE). 이때, 박막트랜지스터(TFT)기 위치한 부문에는 상기 상부 수평 보조라인(HAL_u)들이 형성되지 않는다. At this time, the thin-film transistor (TFT) in sector group is not formed in the upper horizontal auxiliary line (HAL_u) are.

이와 같은 수직 보조라인(VAL)들과 수평 보조라인들은 교차하는 부분에서 서로 전기적으로 연결된다. The vertical auxiliary line (VAL) and the horizontal auxiliary line, such as are electrically connected to each other at an intersection. 다시말하면, 상기 수직 보조라인(VAL)들과 수평 보조라인들은 일체로 구성된다. That is, the vertical auxiliary line (VAL) and the horizontal auxiliary line are configured in one piece.

이와 같이 본 발명의 제 2 실시예에 따르면, 보조라인과 화소전극(PE)이 중첩하는 부분에서 보조용량 커패시터가 형성된다. In this way a second embodiment of the present invention, a storage capacitor is formed in the auxiliary capacitor line and a portion at which the overlapping pixel electrode (PE). 따라서, 본 발명의 제 2 실시예에서는 더 종래보다 더 큰 용량의 보조용량 커패시터가 형성된다. Therefore, in the second embodiment of the present invention it is further formed a storage capacitor capacitor of larger capacity than before.

이상에서 설명한 본 발명은 상술한 실시예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다. The present invention described above is not limited to the embodiment example described above and the accompanying drawings, conventional in the art that that various changes and modifications may be made without departing from the scope of the present invention to which the invention pertains have the knowledge to those will be obvious.

이상에서 설명한 바와 같은 본 발명에 따른 액정표시장치에는 다음과 같은 효과가 있다. The liquid crystal display device according to the invention as described above has the following advantages.

본 발명의 실시예에 따른 액정표시장치는 하나의 단위 화소에 포함된 화소셀들이 6개로 이루어져 있으며, 두 개의 화소셀이 서로 동일한 색상의 화상을 표시한다. The liquid crystal display device according to an embodiment of the present invention is a pixel cell included in a unit pixel are composed of six, and two pixel cell displays another image of the same color. 본 발명에서는 상기 동일한 색상을 표현하는 두 개의 화소셀에 서로 다른 계조의 데이터 신호를 공급함으로써 종래에 비하여 더 미세한 계조까지 표현할 수 있다. According to the present invention by supplying the data signals of different gray levels in the two pixel cells to express the same color it can be expressed to a finer gray level than in the prior art.

더불어 본 발명에서는 보조라인을 형성함으로써 보조용량 커패시터의 용량을 증가시킬 수 있다. In addition, the present invention can increase the capacity of the storage capacitor by forming the auxiliary capacitor line. 이를 통해 보조 라인 추가로 인해 발생하는 개구부 감소를 보완할 수 있다. Through this it is possible to supplement the reduced opening caused by the additional secondary line.

Claims (18)

  1. 일방향으로 배열된 다수의 게이트 라인들; A plurality of gate lines arranged in one direction;
    상기 게이트 라인들에 교차하도록 배열된 다수의 데이터 라인들; The plurality of data lines arranged to cross to the gate lines;
    상기 각 데이터 라인 사이의 화소 영역에 배열된 다수의 화소셀들을 포함하며; It includes a plurality of pixel cells arranged in the pixel region between the respective data lines;
    하나의 화소 영역에는 서로 다른 3색의 화소셀들이 다수 배열되어 있으며; One pixel region of the pixel cells to each other has the other three colors are the number array;
    하나의 단위 화상을 표시하기 위한 하나의 단위 화소내에 포함된 화소셀들 중 적어도 2개의 화소셀이 동일한 색상을 표시하는 것을 특징으로 하는 액정표시장치. A liquid crystal display device, characterized in that for displaying the pixel cells of the at least two pixel cells are the same color included in a unit pixel for displaying a unit image.
  2. 제 1 항에 있어서, According to claim 1,
    하나의 화소 영역에 위치한 화소셀들 중 서로 인접한 두 개의 화소셀이 서로 동일한 색상을 표현하며; One of the two pixel cells of the pixel cells adjacent to each other in the pixel domain representation of the same color each other;
    제 1 화소 영역에 위치한 화소셀들의 색상별 배열순서와, 상기 제 1 화소 영역에 인접한 제 2 화소 영역에 위치한 화소셀들의 색상별 배열순서가 서로 다르며; The arrangement order of the specific color of the pixel cells in the array and the order of each color of the pixel cells, the second pixel region adjacent to the first pixel region in the first pixel area different from one another;
    서로 바로 마주보는 제 1 및 제 2 화소 영역의 화소셀들의 색상이 서로 다르며; The colors of the first and second pixel cells of the pixel area to view directly facing each other, different from one another;
    제 1 화소 영역에서 가장 상측에 위치한 화소셀이, 상기 제 2 화소 영역에서 가장 상측에 위치한 화소셀보다 더 상측에 위치하며; On the pixel cell located at the most image side in the first pixel region, the first located at the further upper side of the pixel cell located at the most image side in the second pixel region; 그리고, And,
    상기 제 2 화소 영역에서 가장 하측에 위치한 화소셀이, 상기 제 1 화소 영역에서 가장 하측에 위치한 화소셀보다 더 하측에 위치한 것을 특징으로 하는 액정표시장치. Wherein the liquid crystal display device, characterized in that the pixel cell located in the lower side in the second pixel region, located at the lower side more than the pixel cell located in the lower side in the first pixel region.
  3. 제 1 항에 있어서, According to claim 1,
    각 화소셀은 상기 게이트 라인으로부터의 게이트 신호에 따라 상기 데이터 라인으로부터의 데이터 신호를 스위칭하는 박막트랜지스터와, 상기 박막트랜지스터로부터의 데이터 신호를 공급받아 화상을 표시하는 화소전극을 포함하며; Each pixel cell comprising a pixel electrode to display an image received the data signal from the thin film transistor and the thin-film transistor for switching the data signal from the data line in accordance with the gate signals from the gate lines;
    상기 화소셀 및 화소전극은 육각형인 것을 특징으로 하는 액정표시장치. The pixel cells and the pixel electrode The liquid crystal display device, characterized in that hexagon.
  4. 제 1 항에 있어서, According to claim 1,
    상기 제 1 화소 영역의 화소셀들 중 기수번째 화소셀들과, 상기 제 2 화소 영역의 화소셀들 중 기수번째 화소셀이 상기 제 1 화소 영역과 제 2 화소 영역의 경계부에 위치한 데이터 라인에 공통으로 접속된 것을 특징으로 하는 액정표시장치. Wherein the common pixel cells in odd-numbered pixel cells, and pixel cells in odd-numbered pixel cells of the second pixel area of ​​the pixel region to the data line in the boundary between the first pixel region and the second pixel region a liquid crystal display device that the connection with the characteristics.
  5. 제 1 항에 있어서, According to claim 1,
    상기 게이트 라인들은, 상기 게이트 라인들 중 가장 상측에 위치한 제 1 게이트 라인과, 상기 제 1 게이트 라인의 바로 하측에 위치한 제 2 게이트 라인과, 상기 게이트 라인들 중 가장 하측에 위치한 제 3 게이트 라인과, 그리고 상기 제 3 게이트 라인의 바로 상측에 위치한 제 4 게이트 라인을 포함하며; The gate lines, the gate lines, a first gate line located on the upper side of the said first second gate line located on the right lower side of the gate line, and the third gate line is located in the lower side of said gate lines , and comprising a fourth gate line located just above the third gate lines;
    제 1 화소 영역의 화소셀들은, 상기 제 1 게이트 라인부터 상기 제 4 게이트 라인 사이에 배열되어 있으며; And from the pixel cells of one pixel regions, the first gate line is disposed between the fourth gate line;
    제 2 화소영역의 화소셀들은, 상기 제 2 게이트 라인부터 상기 제 3 게이트 라인 사이에 배열된 것을 특징으로 하는 액정표시장치. On the pixel cell of the second pixel regions, from the second gate line liquid crystal display device, characterized in that arranged between the third gate line.
  6. 제 5 항에 있어서, 6. The method of claim 5,
    상기 제 1 화소영역의 화소셀들 중 가장 상측에 위치한 화소셀내의 화소전극은 상기 제 1 게이트 라인과 중첩하는 것을 특징으로 하는 액정표시장치. A pixel electrode in the pixel cell located in the upper side of the pixel cells of the first pixel region has a liquid crystal display device characterized by overlapping the first gate line.
  7. 제 1 항에 있어서, According to claim 1,
    n 번째 게이트 라인에 접속된 화소셀의 화소전극이 n-1 번째 게이트 라인과 중첩하는 것을 특징으로 하는 액정표시장치. A liquid crystal display device which comprises a pixel electrode of the pixel cells connected to the n-th gate line overlaps with the n-1 th gate line.
  8. 제 1 항에 있어서, According to claim 1,
    상기 데이터 라인들에 데이터 신호를 공급하기 위한 데이터 드라이버를 더 포함하며; Further comprising a data driver for supplying data signals to the data lines;
    상기 데이터 드라이버는 상기 단위 화소내에 포함되며, 동일한 색상을 표시하는 화소셀들에 서로 다른 계조의 데이터 신호를 공급함을 특징으로 하는 액정표시장치. The data driver is a liquid crystal display device, characterized by supplying the data signals to the pixels of different gray-scale cells that are contained within the unit pixel, display the same color.
  9. 제 1 항에 있어서, According to claim 1,
    상기 화소 영역에 형성된 수직 보조라인을 더 포함하며; Further comprising an auxiliary vertical line formed on the pixel region;
    상기 수직 보조라인은 상기 게이트 라인들 및 상기 화소 영역의 화소셀들에 포함된 화소전극을 중첩하는 것을 특징으로 하는 액정표시장치. The vertical auxiliary line is a liquid crystal display device, characterized in that for superimposing a pixel electrode included in the pixel cells of the gate lines and the pixel region.
  10. 제 9 항에 있어서, 10. The method of claim 9,
    상기 수직 보조라인은 상기 데이터 라인과 동일한 물질로 형성된 것을 특징으로 하는 액정표시장치. The vertical auxiliary line is a liquid crystal display device, characterized in that formed of the same material as the data line.
  11. 제 9 항에 있어서, 10. The method of claim 9,
    상기 수직 보조라인은 상기 게이트 라인과 동일한 물질로 형성되며; The vertical auxiliary line is formed of the same material as the gate lines;
    상기 수직 보조라인과 상기 게이트 라인들간의 교차부분에 대응하는 상기 수직 보조라인 부분이 단선되며; Wherein the vertical auxiliary line and the break portion corresponding to the vertical auxiliary line and the intersection between the gate line;
    상기 단선된 부분이 연결부에 의해서 전기적으로 접속되며; Wherein the disconnection portion is electrically connected to by a connecting portion;
    상기 연결부는 상기 화소셀의 화소전극과 동일한 물질인 것을 특징으로 하는 액정표시장치. The connecting portion includes a liquid crystal display device, characterized in that the same material as the pixel electrode of the pixel cell.
  12. 제 1 항에 있어서, According to claim 1,
    상기 게이트 라인의 상측에 위치한 상부 수평 보조라인을 더 포함하며; Further comprising: a secondary upper horizontal line located on the upper side of the gate lines;
    상기 상부 수평 보조라인은 데이터 라인들 및 상기 게이트 라인을 따라 배열된 화소 영역들 각각에 위치한 화소셀들의 화소전극을 중첩하는 것을 특징으로 하는 액정표시장치. The upper horizontal line of the auxiliary liquid crystal display device, characterized in that for superimposing the pixel electrode of the pixel cells in each of the pixel regions arranged along the data lines and the gate lines.
  13. 제 12 항에 있어서, 13. The method of claim 12,
    상기 상부 수평 보조라인은 상기 게이트 라인과 동일한 물질로 형성된 것을 특징으로 하는 액정표시장치. The upper horizontal line of the auxiliary liquid crystal display device, characterized in that formed of the same material as the gate line.
  14. 제 12 항에 있어서, 13. The method of claim 12,
    상기 상부 수평 보조라인은 상기 데이터 라인과 동일한 물질로 형성되며; The upper horizontal auxiliary line is formed of the same material as the data lines;
    상기 화소셀내의 박막트랜지스터가 형성된 부분에 대응하는 상기 상부 수평 보조라인 부분이 단선되며; The upper horizontal line and the secondary part is disconnected corresponding to the portion where the thin film transistor in the pixel cells are formed;
    상기 상부 수평 보조라인과 상기 데이터 라인들간의 교차부분에 대응하는 상기 상부 수평 보조라인 부분이 단선되며; Wherein the upper horizontal line and the secondary part is disconnected corresponding to the intersection between the upper horizontal auxiliary line and the data line;
    상기 교차부분에서 단선된 부분이 연결부에 의해서 전기적으로 접속되며; The broken part of the cross section is electrically connected to by a connecting portion;
    상기 연결부는 상기 화소셀의 화소전극과 동일한 물질인 것을 특징으로 하는 액정표시장치. The connecting portion includes a liquid crystal display device, characterized in that the same material as the pixel electrode of the pixel cell.
  15. 제 1 항에 있어서, According to claim 1,
    상기 게이트 라인의 하측에 위치한 하부 수평 보조라인을 더 포함하며; Further comprising: a lower horizontal auxiliary line located beneath the gate lines;
    상기 하부 수평 보조라인은 데이터 라인들 및 상기 게이트 라인을 따라 배열된 화소 영역들 각각에 위치한 화소셀들의 화소전극을 중첩하는 것을 특징으로 하는 액정표시장치 The lower horizontal line of the auxiliary liquid crystal display device, characterized in that for superimposing the pixel electrode of the pixel cells in each of the pixel regions arranged along the data lines and the gate lines
  16. 제 15 항에 있어서, 16. The method of claim 15,
    상기 하부 수평 보조라인은 상기 게이트 라인과 동일한 물질로 형성된 것을 특징으로 하는 액정표시장치. The lower horizontal line of the auxiliary liquid crystal display device, characterized in that formed of the same material as the gate line.
  17. 제 15 항에 있어서, 16. The method of claim 15,
    상기 하부 수평 보조라인은 상기 데이터 라인과 동일한 물질로 형성되며; The lower horizontal auxiliary line is formed of the same material as the data lines;
    상기 하부 수평 보조라인과 상기 데이터 라인들간의 교차부분에 대응하는 상기 하부 수평 보조라인 부분이 단선되며; The lower horizontal auxiliary line is part of a break corresponding to the intersection portion between the lower horizontal auxiliary line and the data line;
    상기 단선된 부분이 연결부에 의해서 전기적으로 접속되며; Wherein the disconnection portion is electrically connected to by a connecting portion;
    상기 연결부는 상기 화소셀의 화소전극과 동일한 물질인 것을 특징으로 하는 액정표시장치. The connecting portion includes a liquid crystal display device, characterized in that the same material as the pixel electrode of the pixel cell.
  18. 제 1 항에 있어서, According to claim 1,
    수직 보조라인, 상부 수평 보조라인, 및 하부 수평 보조라인을 더 포함하며; Further comprising a secondary vertical line, the upper horizontal auxiliary line, and the lower horizontal line, and the secondary;
    수직 보조라인은 화소 영역에 위치하여, 상기 게이트 라인들 및 상기 화소 영역내의 화소셀의 화소전극을 중첩하며; The vertical auxiliary line is located in the pixel region, and superimposing the pixel electrode of the pixel cells in the gate lines and the pixel region;
    상기 상부 수평 보조라인은 상기 게이트 라인의 상측에 위치하여, 상기 데이터 라인들 및 상기 게이트 라인을 따라 배열된 화소 영역들 각각에 위치한 화소셀들의 화소전극을 중첩하며; The upper horizontal auxiliary line to be disposed above the gate line and overlapping the pixel electrodes of the pixel cells in the data lines and the pixel areas arranged along each of the gate lines, and;
    하부 수평 보조라인은 상기 게이트 라인의 하측에 위치하여, 상기 데이터 라인들 및 상기 게이트 라인을 따라 배열된 화소 영역들 각각에 위치한 화소셀들의 화소전극을 중첩하며; Lower horizontal auxiliary line is located in the lower portion of the gate line overlapping the pixel electrodes of the pixel cells in the data lines and the pixel areas arranged along each of the gate lines, and;
    상기 수직 보조라인, 상부 수평 보조라인, 및 하부 수평 보조라인이 모두 동일 물질로 형성되며; The vertical auxiliary line and the upper horizontal auxiliary line, and the lower horizontal auxiliary line are all formed of the same material;
    상기 수직 보조라인, 상부 수평 보조라인, 및 하부 수평 보조라인이 교차하는 부분이 서로 연결된 것을 특징으로 하는 액정표시장치. The vertical auxiliary line, the liquid crystal display device such that a portion at which the upper horizontal auxiliary line, and the lower horizontal auxiliary line cross-linked to each other.
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