KR20020088176A - 교류형 플라즈마 디스플레이 패널의 구동회로 - Google Patents

교류형 플라즈마 디스플레이 패널의 구동회로 Download PDF

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Abstract

본 발명은 램프파 구동방식이 적용된 구동회로에서 스위칭소자 수를 절감할 수 있도록 된 교류형 플라즈마 디스플레이 패널의 구동회로에 대한 것으로서, 이는 디스플레이 패널의 리셋구간, 어드레스구간 및 서스테인구간에 따른 구동동작시 패널로 인가되는 고전류의 유출입 경로상에 제어스위치를 배제시키도록 회로구성을 변경함으로써 구동회로의 요구되는 스위칭 소자수를 절감할 수 있도록 된 것을 특징으로 한다.

Description

교류형 플라즈마 디스플레이 패널의 구동회로{Driving Circuit for AC-type Plasma Display Panel}
본 발명은 플라즈마 디스플레이 패널(PDP : Plasma Display Panel)에 대한 것으로서, 특히 램프파 구동방식이 적용된 구동회로에서 스위칭소자 수를 줄일 수 있도록 된 교류형 플라즈마 디스플레이 패널의 구동회로에 대한 것이다.
일반적으로 플라즈마 디스플레이 패널(이하, 'PDP'라 칭함)은 방전셀(cell)내에 형성된 형광체를 여기하여 화상을 표시하는 발광소자로서, 이는 제조공정이 간단하고 박형, 대화면이 용이한 특성 대문에 화상회의용 디스플레이, 대화면의 벽걸이 TV 등에 사용되는 화상표시장치로서 그 이용이 대폭 증대되고 있는 추세이다.
이러한 PDP는 그 구동전압의 형태의 따라 교류(AC)형과 직류(DC)형으로 구분되며, 교류형 PDP의 경우 구현하는 계조에 따라 한 프레임(frame)을 다수의 서브필드(Sub field)로 분할하여 구동하는 ADS(Addressing Display Separated) 방식이 주로 이용된다. 그리고 각 서브필드는 리셋(Reset)구간, 어드레스(Address)구간, 서스테인(Sustain)구간으로 구분되고, 256 계조를 구현하기 위해 한 프레임은 8 개 이상의 서브필드로 구성된다.
그리고 상기 리셋구간은 이전 서브필드의 서스테인방전(유지방전)이 이루어진 후, PDP의 모든 방전셀에 벽전하를 생성시키고, 생성된 벽전하를 소거시킴으로써 방전셀내 벽전하(Wall charge)를 초기화하는 구간으로서, 후술하는 주사/유지전극에 방전개시전압 이상의 초기화 펄스(램프파 펄스)가 인가되고, 이에 따라 이전 서브필드에서 서스테인방전이 일어난 방전셀에서 후술하는 주사/유지전극으로부터 어드레스전극으로 초기화방전이 이루어지는 구간이다.
그리고 상기 어드레스구간은 상기 리셋구간 이후 각 방전셀에 대하여 선택적으로 화상데이터의 기입방전 즉, 어드레스방전이 수행되는 구간이고, 상기 서스테인구간은 그 어드레스방전을 유지하도록 선택된 방전셀의 방전동작을 반복하여 행하는 구간으로서, 각 서브필드의 방전횟수를 가중하고 이것을 조합하여 계조표시를 행하기 위한 구간이다.
도 1은 상기 ADS 방식에 따라 구동되는 종래 교류형 PDP 장치의 구성을 간략하게 나타낸 블록구성도이다.
도 1에서 참조번호 10은 M 개의 주사/유지전극(Y1∼YM)과 유지전극(X1∼XM)이 평행하게 배열되고, N 개의 어드레스전극(A1∼AN)이 주사/유지전극(Y1∼YM) 및 유지전극(X1∼XM)과 소정 공간을 사이에 두고 직교 배열되며, 주사/유지전극(Y1∼YM), 유지전극(X1∼XM) 및 어드레스전극(A1∼AN)의 교차점 마다 R(Red), G(Green), B(Blue)셀로 구분된 다수의 방전셀(S)이 형성되어 이 방전셀(S)에 의해 매트릭스 형태의 M×N 해상도의 화상을 표시하는 패널(10)이다.
도 1에서 참조번호 20, 30, 40은 각각 상기 주사/유지전극(Y1∼YM)과 유지전극(X1∼XM), 그리고 어드레스전극(A1∼AN)에 소정 구동펄스를 공급하기 위한 주사/유지전극 구동부, 유지전극 구동부, 그리고 어드레스전극 구동부로서, 상기 주사/유지전극 구동부(20)와 유지전극 구동부(30)는 상술한 리셋구간, 어드레스구간, 그리고 서스테인구간 별로 상기 패널(10)에 해당되는 구동펄스를 공급하기 위한 소정 구동회로를 각각 구비하여 구성된다.
그리고 참조번호 50은 외부 입력신호인 클록(CLK), 수평동기신호(HS), 수직동기신호(VS) 및 입력 화상신호(IMAGE)를 근거로 디지털 화상신호를 출력하도록 상기 주사/유지전극 구동부(20), 유지전극 구동부(30) 및 어드레스전극 구동부(40)를 제어하는 콘트롤부이다.
한편 PDP 장치의 구동시 도 1의 패널(10)을 통해서는 예컨대, 100A 이상의 고전류인 충방전전류가 흐르게 된다. 그리고 이 충방전전류는 상기 주사/유지전극 구동부(20)와 유지전극 구동부(30)에 구비되는 소정 구동회로(도시되지 않음)를 통해서 상기 패널(10)로 유출입되며, 현재 상기 구동회로는 이 충방전전류를 견딜 수 있도록 다수의 제어스위치가 병렬 접속된 구성으로 되어 있다.
따라서 이는 생산원가를 상승시키는 원인중의 하나로 작용하고 있으며, 이를 해결하고자 구동회로내 요구되는 제어스위치 수를 절감하기 위한 다양한 시도가 행해지고 있는 것이 현실이다.
또한 최근에는 PDP 장치의 구동방식중 일본국 특개평 제11-133914호(공개번호)에 제안되어 있는 램프파 구동방식의 이용이 증가되고 있다. 상기 램프파 구동방식은 상술한 ADS 구동방식에 따른 리셋구간의 구동펄스로 출력전압의 기울기가 선형적으로 상승/하강하는 램프파 구동펄스를 공급함으로써 어드레스구간의 시작 전에 주사/유지전극 상의 벽전하 분포를 균일하게 형성시켜 방전셀(S)에서 균일한 방전이 이루어지도록 한 방식이다.
그러나 상기한 램프파 구동방식에 따른 구동회로는 PDP 장치의 구동특성을 향상시키는 장점은 있으나, 구동회로내 회로소자(특히, 스위칭소자)가 많이 요구되는 문제점이 있게 된다.
이에 본 발명은 상기한 사정을 감안하여 창출된 것으로서, 램프파 구동방식을 이용하면서도 PDP 장치에 구비되는 구동회로의 스위칭소자 수를 줄일수 있도록 된 교류형 플라즈마 디스플레이 패널의 구동회로를 제공함에 그 목적이 있다.
도 1은 ADS 방식에 따라 구동되는 종래 교류형 PDP 장치의 구성을 간략하게 나타낸 블록구성도.
도 2는 본 발명의 일실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도.
도 3은 본 발명의 일실시예에 따른 Y 구동회로의 출력파형을 나타낸 전압파형도.
도 4는 본 발명의 일실시예에 따른 Y 구동회로의 스위칭 타이밍을 나타낸 타이밍도.
도 5는 본 발명의 다른 실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도.
도 6은 본 발명의 또 다른 실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도.
*** 도면의 주요부분에 대한 부호의 간단한 설명 ***
10 : 패널, 20 : 주사/유지전극 구동부,
30 : 유지전극 구동부, 40 : 어드레스전극 구동부,
50 : 콘트롤부, 200, 300, 400 : Y 구동회로,
210, 310 : 제1 스위칭부, 220, 410 : 제2 스위칭부,
230 : 제3 스위칭부, 231 : 구동IC,
QLH, QLL, Q1~Q7 : 제어스위치, D1~D4 : 다이오드,
C1, C2 : 커패시터.
상기 목적을 달성하기 위한 본 발명에 따른 교류형 플라즈마 디스플레이 패널의 구동회로는 유지전원, 램프전원 및 스캔전원과 패널 사이에 접속되어 리셋구간, 어드레스구간 및 서스테인구간으로 이루어진 구간별 구동펄스를 생성하고, 상기 리셋구간의 구동펄스가 램프파 구동펄스인 교류형 플라즈마 디스플레이 패널의 구동회로에 있어서, 상기 유지전원, 램프전원, 접지단 및 상기 패널 사이에 접속되어 상기 유지전원 및 램프전원을 근거로 상기 패널로 공급되는 소정 구동펄스를 단속하기 위한 제1 스위칭부와, 상기 제1 스위칭부에 전기적으로 직접 결합되고 상기 스캔전원에 의한 소정 구동펄스가 상기 제1 스위칭부로 유입되는 것을 방지하기 위한 제2 스위칭부와, 상기 제1 및 제2 스위칭부와 상기 패널에 각각 전기적으로 직접 결합되어 상기 유지전원, 램프전원 및 스캔전원을 근거로 상기 패널로 공급되는 소정 구동펄스를 단속하기 위한 제3 스위칭부와, 상기 램프전원과 상기 제1 스위칭부 사이에 결합되어 상기 리셋구간에서 상승하는 램프파 구동펄스를 생성하여 상기 패널로 공급하는 제1 적분회로 및, 상기 제1 스위칭부와 접지단 사이에 결합되어 상기 리셋구간에서 하강하는 램프파 구동펄스를 생성하여 상기 패널로 공급하는 제2 적분회로를 구비하여 구성된 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 설명한다.
<제1 실시예>
먼저 도 1의 주사/유지전극 구동부(20)에 구비되는 구동회로를 Y 구동회로라 하고, 상기 유지전극 구동부(30)에 구비되는 구동회로를 X 구동회로라 했을 때 본 실시예는 상기 Y 구동회로의 스위칭 소자수를 절감하기 위한 것으로서, 본 명세서에서 상기 X 구동회로에 대한 상세한 설명은 생략하기로 한다.
도 2는 본 발명의 일실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도로서, 도 2에서 참조번호 200은 유지전원(VS), 램프전원(VR) 및 스캔전원(VF)과 도 1의 패널(10)(도 2에서 참조부호 CP로 표시한 부분) 사이에 접속되고, PDP 장치의 구동시 스위칭 제어되어 상기 패널(10)에 소정 구동펄스를 공급하는 Y 구동회로로서, 이는 PDP 장치의 구동시 도 3에 도시된 리셋구간(A), 어드레스구간(B), 그리고 서스테인구간(C) 구간별 구동펄스를 상기 패널(10)로 인가하도록 다수의 제어스위치(QLH, QLL, Q1~Q7)를 구비하여 구성된다.
도 2에서 상기 제어스위치(QLH, QLL, Q1~Q7)는 전계효과트랜지스터(MOSFET : Metal-Oxide Semiconductor Field-Effect Transistor)와 역병렬 다이오드로 구성되고, 이외에도 절연게이트 바이폴러 트랜지스터(IGBT : Insulated Gate Bipolat Transistor)를 이용하는 것도 가능하다.
도 2에서 참조부호 CP는 상기 패널(10)의 용량성분(이하, '패널커패시터'라 칭함)을 나타낸 것으로서, PDP 장치는 구동시 방전셀(S)내의 주사/유지전극(Y1∼YM)과 유지전극(X1∼XM) 간에 방전개시전압 이상의 고전압을 지속적으로 교번하여 가해주어야 한다. 이때, 상기 주사/유지전극(Y1∼YM)과 유지전극(X1∼XM) 위에는 유전체가 도포되어 있으며, 이로 인하여 양 전극에는 상기 패널커패시터(CP)가 존재하게 된다.
도 2에서 참조번호 210은 유지전원(VS), 램프전원(VR), 접지단 및 패널커패시터(CP) 사이에 접속되어 상기 패널(10)로 공급되는 유지전원(VS) 및 램프전원(VR)을 단속하기 위한 제1 스위칭부로서, 상기 제1 스위칭부(210)는 유지전원(VS)에 애노드가 접속된 역류방지용 다이오드(D1), 적어도 세 개의 제어스위치(QLH, Q1, QLL)가 순차로 직렬 접속되어 구성된다.
그리고 도 2에서 제어스위치(Q1)와 제어스위치(QLL)의 접속노드(a)는 도시되지 않은 에너지 회수회로에 접속되고, 제어스위치(QLH)와 제어스위치(Q1)의 접속노드(b)는 후술하는 구동IC(Integrated Circuit)를 통해 상기 패널커패시터(CP)에 접속된다.
그리고 상기 에너지 회수회로(도시되지 않음)는 상기 패널(10)의 충방전 동작시 발생되는 무효(無效)전력을 회수하기 위한 것으로서, 이에 대한 상세한 설명은 생략하기로 한다.
한편 도 2에서 참조번호 220은 상기 제1 스위칭부(210)와 후술하는 제3 스위칭부 사이에 접속되어 스캔전원(VF)에 의한 구동펄스가 상기 제1 스위칭부(210)로 유입되는 것을 방지하기 위한 제2 스위칭부로서, 상기 제2 스위칭부(220)는 상기 제1 스위칭부(210)에 소스가 접속되고, 후술하는 제3 스위칭부에 드레인이 접속된 제어스위치(Q2)를 구비하여 구성된다.
도 2에서 참조번호 230은 유지전원(VS), 램프전원(VR) 및 스캔전원(VF)을 근거로 상기 패널(10)로 공급되는 각 구간별 구동펄스를 단속하기 위한 제3 스위칭부로서, 상기 제3 스위칭부(230)은 스캔전원(VF)에 애노드가 접속된 역류방지용 다이오드(D2), 제어스위치(Q3), 그리고 구동IC(231)가 순차로 직렬 접속되어 구성된다.
그리고 도 2에서 상기 구동IC(231)는 직렬 접속된 제어스위치(Q4, Q5)를 구비하여 구성되고, 제어스위치(Q4, Q5)의 접속노드(VOUT)는 상기 패널커패시터(CP)에 접속되어 각 구간별 구동펄스를 패널(10)로 공급하게 된다. 한편 본 실시예에서 상기 구동IC(231)는 두 개의 제어스위치(Q4, Q5)가 접속된 구성으로 되어 있으나, 이를 하나의 제어스위치로 구성하는 것도 가능하다.
도 2에서 참조번호 240은 도 3에 도시된 리셋구간(A)에서 상승하는 램프파 구동펄스(Rising Ramp Pulse)를 생성하기 위한 제1 적분회로로서, 이는 램프전원(VR)에 애노드가 접속된 역류방지용 다이오드(D3)와 제어스위치(Q6), 그리고 제어스위치(Q6)의 드레인과 게이트 사이에 접속된 커패시터(C1)를 구비하여 구성된다. 상기 제1 적분회로(240)는 램프파 펄스를 생성하는 일반적인 밀러(Miller) 적분회로로서 이에 대한 상세한 설명은 생략하기로 한다.
도 2에서 참조부호 250은 도 3에 도시된 리셋구간(A)에서 하강하는 램프파 구동펄스(Down Ramp Pulse)를 생성하기 위한 제2 적분회로로서, 이는 제어스위치(Q7)과 커패시터(C2)가 상기 밀러 적분회로를 구성하고, 역류방지용 다이오드(D2)의 캐소드가 상기 제어스위치(Q7)의 드레인에 접속되어 구성된다.
즉, 상기한 구성으로 된 Y 구동회로는 도 3에 도시된 리셋구간(A), 어드레스구간(B), 그리고 서스테인구간(C)으로 구분된 구동펄스를 화상데이터의 각 서브필드별로 패널(10)에 공급하도록 도 4의 타이밍도에 따라 스위칭 제어된다.
이하, 도 3 및 도 4를 참조하여 도 2의 구성으로 된 Y 구동회로(200)의 동작을 설명하기로 한다.
먼저 도 2의 Y 구동회로(200)에서 제1 스위칭부(210)의 제어스위치(Q1)와 제1 적분회로(240)의 제어스위치(Q6)는 상보적으로 온/오프 구동된다. 즉 제어스위치(Q1)가 온구동될 때 제어스위치(Q6)는 오프구동되고, 제어스위치(Q6)가 온구동될 때 제어스위치(Q1)는 오프구동된다. 또한 도 2에서 제2 스위칭부(220)의 제어스위치(Q2)와 제3 스위칭부(230)의 제어스위치(Q3)도 상기한 방식에 따라 상보적으로 온/오프 구동된다. 이는 상기 Y 구동회로(200)의 구동방식중 일예를 나타낸 것으로서, 반드시 상기한 방식으로 구동되어야 하는 것은 아니다.
그리고 도 3에서 TO 구간은 이전 서브필드의 서스테인구간(C)이 종료된 후, 패널(10)을 방전시키기 위한 구간으로서, 이 경우 도 2의 제어스위치(QLL, Q1, Q2, Q5)가 온구동되어 제어스위치(Q5)->제어스위치(Q1)->제어스위치(QLL)의 방전경로가 형성된다. 이때 제어스위치(Q2)는 제어스위치(Q3)가 오프구동되어 상보적으로 온구동된 것이다.
도 3에서 T1 구간은 리셋구간(A)이 시작됨에 따라 도 1의 패널(10)로 상승하는 램프파 구동펄스를 공급하여 패널(10)의 모든 방전셀(S)에 벽전하를 생성시키기 위한 구간으로서, 도 2의 제어스위치(QLH, Q2, Q5, Q6)가 온구동된다.
따라서 유지전원(VS)에 의한 구동펄스가 다이오드(D1)->제어스위치(QLH)->제어스위치(Q5)의 경로를 통해 패널(10)로 공급됨과 아울러 램프전원(VR)에 의한 구동펄스가 다이오드(D3)->제어스위치(Q6)->제어스위치(QLH)->제어스위치(Q5)의 경로를 통해 패널(10)로 공급된다.
이때 도 1의 패널(10)로 인가되는 구동펄스는 도 2의 제1 적분회로(240)에 의해 도 3에 도시된 것처럼 전압상승 기울기가 선형적으로 상승하는 램프파를 형성하고, 그 전압레벨은 유지전압+램프전압(VS+VR) 까지 상승된다.
도 3에서 T2 구간은 패널(10)에 인가되는 램프파 구동펄스의 전압레벨을 일정 기간 유지시키는 휴지구간으로서, 이 경우 도 2의 제어스위치(QLH, Q2, Q5, Q6)가 온구동된다. 즉 도 3의 T2 구간은 방전셀(S)내에 형성되는 공간전하 즉, 프라이밍(Priming) 입자의 감쇠를 기다리기 위한 구간으로서, 이 휴지구간이 없거나 너무 짧게 되면, 방전셀(S)에 자기방전(Self Discharge)이 일어나 PDP의 구동특성을 저하시키게 된다.
도 3에서 T3 구간은 패널(10)에 하강하는 램프파 구동펄스를 공급하기 전에 구동펄스의 전압레벨을 유지전압 VS으로 떨어뜨리는 구간으로서, 이 경우 도 2의 제어스위치(QLH, Q1, Q2, Q5)가 온구동된다. 이때 도 2의 제어스위치(Q1)는 제1 적분회로(240)의 제어스위치(Q6)가 오프구동됨에 따라 상보적으로 온구동된 것이다.
도 3에서 T4 구간은 패널(10)에 하강하는 램프파 구동펄스를 공급하여 모든 방전셀(S)에 형성된 벽전하를 점진적으로 소거시키기 위한 구간으로서, 도 2의 제어스위치(Q1, Q2, Q5, Q7)가 온구동되어 패널커패시터(CP)로부터 제어스위치(Q5)->다이오드(D4)->제어스위치(Q7)의 방전경로가 형성된다.
도 3에서 T5 구간은 어드레스구간(B)이 시작되기 전에 패널(10)을 방전시키기 위한 구간으로서, 도 2의 제어스위치(QLL, Q1, Q2, Q5, Q7)가 온구동되어 패널커패시터(CP)로부터 제어스위치(Q5)->다이오드(D4)->제어스위치(Q7)의 방전경로는 물론 제어스위치(Q5)->제어스위치(Q1)->제어스위치(QLL)의 다른 방전경로가 동시에 형성된다.
도 3에서 T6 및 T7 구간은 패널(10)의 각 방전셀(S)에 화상데이터를 선택적으로 기입하는 기입방전이 이루어지는 어드레스구간(B)으로서, 도 1의 어드레스전극 구동부(40)에 의해 선택된 방전셀(S)에 도 3에 도시된 구동펄스가 순차적으로 공급되어 진다. 이 경우 도 2의 제어스위치(QLL, Q1, Q3, Q4)가 온구동되어 스캔전원(VF)에 의한 구동펄스가 패널(10)로 공급되고(T6 구간), 제어스위치(QLL, Q1, Q3, Q5)가 온구동되어 패널(10)을 방전시키게 된다.(T7 구간)
그리고 상기 T6 구간에서 도 2의 제어스위치(QLL, Q1)는 상기 T7 구간의 방전동작을 위해 미리 온구동된 것이다. 이후 상기 T6 및 T7 구간의 동작은 어드레스구간(B) 동안 반복적으로 수행된다.
도 3에서 T8 및 T9 구간은 화상데이터가 기입된 방전셀(S)에 대하여 계조표시를 위한 서스테인방전(유지방전)이 소정 가중치에 따라 반복적으로 수행되어 화상표시가 이루어지는 서스테인구간(C)이다. 이 경우 도 2의 제어스위치(QLH, Q1,Q2, Q5)가 온구동되어 유지전원(VS)에 의한 구동펄스가 패널(10)로 공급되고(T8 구간), 제어스위치(QLL, Q1, Q2, Q5)가 온구동되어 패널(10)을 방전시키게 된다.(T9 구간)
그리고 상기 T8 및 T9 구간의 동작은 서스테인구간(C) 동안 반복적으로 수행되고, 상기 서스테인구간(C)에서 이루어지는 서스테인방전은 도 2에 도시된 Y 구동회로(200)는 물론 도 1의 유지전극 구동부(30)에 구비되는 X 구동회로(도시되지 않음)를 통해 교번적으로 이루어지게 된다.
상술한 것처럼 본 실시예에 따른 도 2의 Y 구동회로(200)는 유지전원(VS) 및 램프전원(VR)에 의한 구동펄스와 패널(10)의 방전전류의 유출입 경로에 설치되는 제어스위치의 배치를 변경하거나, 배제시킴으로써 램프파 구동방식이 적용된 Y 구동회로의 스위칭소자 수를 절감하도록 된 것이다.
즉, 패널(10)의 충방전 경로 상에 설치되는 제어스위치는 실제로 고압/고전류에 따른 내압을 견디도록 다수의 제어스위치가 병렬 접속된 구성을 취하고 있기 때문에 본 실시예와 같이 도 2의 접속노드(b)와 접속노드(c) 사이에 스위칭 소자를 배제시키게 되면, 제어스위치에 의한 전력소모를 절감함과 아울러 요구되는 회로소자 수를 절감할 수 있게 된다.
<제2 실시예>
도 5는 본 발명의 다른 실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도로서, 도 5에서 도 2에 도시된 구성과 동일한 구성에 대하여는 동일한 참조번호(부호)를 붙이고 그 상세한 설명은 생략하기로 한다.
즉, 도 5의 Y 구동회로(300)는 도 2의 Y 구동회로(200)와 동일한 기능을 수행하면서도 구동회로에 요구되는 스위칭 소자수를 더욱 절감하도록 도 2에 도시된 제1 스위칭부(210)의 회로구성을 변경한 것이다.
도 5에서 참조번호 310은 유지전원(VS), 램프전원(VR), 접지단 및 패널커패시터(CP) 사이에 접속되어 패널(10)로 공급되는 유지전원(VS) 및 램프전원(VR)을 단속하기 위한 제1 스위칭부로서, 상기 제1 스위칭부(310)는 유지전원(VS)에 애노드가 접속된 역류방지용 다이오드(D1), 제어스위치(QLH, QLL)가 순차로 직렬 접속되어 구성된다. 그리고 도 5에서 제어스위치(QLH)와 제어스위치(QLL)의 접속노드(d)는 도시되지 않은 에너지 회수회로에 접속되고, 구동IC(231)를 통해 패널커패시터(CP)에 접속된다.
즉, 도 5에 도시된 제1 스위칭부(310)는 도 2의 제1 스위칭부(210)에서 제어스위치(Q1)을 배제하도록 구성된 것이다. 도 2에서 상기 제어스위치(Q1)는 하나만 도시되어 있으나, 실제로 다수의 제어스위치가 병렬 접속된 구성으로 되어 있는 바, 본 실시예에 의하면 Y 구동회로에 요구되는 제어스위치 수를 더욱 절감할 수 있게 된다.
다만 도 5와 같이 제어스위치(Q1)를 배제하는 경우 도 5의 제어스위치(QLL)의 내압이 증가되는 부담은 있으나, 예컨대 상기 제어스위치(QLL)로 절연게이트 바이폴러 트랜지스터(IGBT)와 같이 내압이 높은 스위칭 소자를 사용하도록 함으로써 그 부담을 극복하는 것이 가능하다.
한편 도 5에 도시된 Y 구동회로(300)의 동작은 도 2의 Y 구동회로(200)와 동일한 방식으로 동작되는 바, 이에 대한 상세한 설명은 생략하기로 한다.
<제3 실시예>
도 6는 본 발명의 또 다른 실시예에 따른 Y 구동회로의 내부구성을 나타낸 회로구성도로서, 도 6에서 도 5에 도시된 구성과 동일한 구성에 대하여는 동일한 참조번호(부호)를 붙이고 그 상세한 설명은 생략하기로 한다.
즉 도 6의 Y 구동회로(400)는 도 5의 Y 구동회로(300)와 동일한 기능을 수행함과 아울러 도 5의 제2 스위칭부(220)내 제어스위치(Q2)를 도 6에 도시된 바와 같이 역전류 방지용 다이오드(D5)로 대체한 것이다. 도 6에서 상기 다이오드(D5)는 애노드가 상기 제1 스위칭부(310)와 제2 적분회로(250)의 접속노드에 연결되고, 캐소드가 상기 제3 스위칭부(400)내 제어스위치(Q3)와 구동IC(231)의 접속노드에 연결되어 스캔전원(VF)에 의한 구동펄스가 상기 제1 스위칭부(310)로 역류되는 것을 방지하게 된다. 따라서 본 실시예에 의하면, Y 구동회로에 요구되는 스위칭 소자수를 더욱 절감할 수 있게 된다.
이상 설명한 바와 같이 본 발명에 의하면, 램프파 구동방식을 이용하는 구동회로에서 요구되는 스위칭 소자수를 대폭 절감함에 따라 생산비를 절감할 수 있게된다. 또한 본 발명에 의하면, 구동회로내 스위칭 소자수를 절감함에 따라 구동회로를 더욱 간결하게 구성하고, 스위칭 소자를 통한 전력소모를 줄일 수 있게 된다.

Claims (5)

  1. 유지전원, 램프전원 및 스캔전원과 패널 사이에 접속되어 리셋구간, 어드레스구간 및 서스테인구간으로 이루어진 구간별 구동펄스를 생성하고, 상기 리셋구간의 구동펄스가 램프파 구동펄스인 교류형 플라즈마 디스플레이 패널의 구동회로에 있어서,
    상기 유지전원, 램프전원, 접지단 및 상기 패널 사이에 접속되어 상기 유지전원 및 램프전원을 근거로 상기 패널로 공급되는 소정 구동펄스를 단속하기 위한 제1 스위칭부,
    상기 제1 스위칭부에 전기적으로 직접 결합되고 상기 스캔전원에 의한 소정 구동펄스가 상기 제1 스위칭부로 유입되는 것을 방지하기 위한 제2 스위칭부,
    상기 제1 및 제2 스위칭부와 상기 패널에 각각 전기적으로 직접 결합되어 상기 유지전원, 램프전원 및 스캔전원을 근거로 상기 패널로 공급되는 소정 구동펄스를 단속하기 위한 제3 스위칭부,
    상기 램프전원과 상기 제1 스위칭부 사이에 결합되어 상기 리셋구간에서 상승하는 램프파 구동펄스를 생성하여 상기 패널로 공급하는 제1 적분회로 및,
    상기 제1 스위칭부와 접지단 사이에 결합되어 상기 리셋구간에서 하강하는 램프파 구동펄스를 생성하여 상기 패널로 공급하는 제2 적분회로를 구비하여 구성된 것을 특징으로 하는 교류형 플라즈마 디스플레이 패널의 구동회로.
  2. 제 1 항에 있어서,
    상기 제1 스위칭부는 상기 유지전원에 애노드가 접속된 역류방지용 다이오드와 적어도 세 개의 제어스위치(QLH, Q1, QLL)가 순차로 직렬접속되어 구성된 것을 특징으로 하는 교류형 플라즈마 디스플레이 패널의 구동회로.
  3. 제 1 항 또는 제 2 항에 있어서,
    상기 제2 스위칭부는 상기 제1 스위칭부에 소스가 접속되고 상기 제3 스위칭부에 드레인이 접속된 제어스위치로 구성된 것을 특징으로 하는 교류형 플라즈마 디스플레이 패널의 구동회로.
  4. 제 1 항에 있어서,
    상기 제1 스위칭수단은 상기 유지전원에 애노드가 접속된 역류방지용 다이오드와 두 개의 제어스위치(QLH, QLL)가 순차로 직렬접속되어 구성된 것을 특징으로 하는 교류형 플라즈마 디스플레이 패널의 구동회로.
  5. 제 4 항에 있어서,
    상기 제2 스위칭수단은 상기 제1 스위칭부에 애노드가 접속되고 상기 제3 스위칭부에 캐소드가 접속된 다이오드로 구성된 것을 특징으로 하는 교류형 플라즈마 디스플레이 패널의 구동회로.
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