KR19990075715A - 0비대칭 디지털 가입자라인 시스템에서의 가입자측 비대칭 디지털 가입자 라인 모뎀의 비동기 전송모드핸들러와 비동기 전송모드 트랜시버간의 인터페이스 회로 - Google Patents
0비대칭 디지털 가입자라인 시스템에서의 가입자측 비대칭 디지털 가입자 라인 모뎀의 비동기 전송모드핸들러와 비동기 전송모드 트랜시버간의 인터페이스 회로 Download PDFInfo
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Abstract
본 발명은 비대칭 디지털 가입자 라인(ADSL) 시스템의 가입자측 ADSL 모뎀에 있어서, ATM 핸들러와 ATM 트랜시버간에 간단한 로직구성의 회로를 추가하여 ATM 핸들러와 ATM 트랜시버간에 UTOPIA Ⅰ 통신방식에 의한 데이터 송/수신이 원할히 이루어질 수 있도록 한 ADSL 시스템에서의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로에 관한 것으로, 외부에서 제공되는 3.2MHz의 클럭에 따라 동일한 물리 계층인 ATM 핸들러와 ATM 트랜시버를 각각 마스터와 슬래이브로 동작하도록 인에이블시키고, 이 인에이블된 ATM 핸들러와 ATM 트랜시버 각각이 ATM 셀 데이터의 송/수신 준비가 완료되었음을 알리는 신호를 송/수신함으로써 첫 번째 ATM 셀 데이터를 시작으로 하여 ATM 핸들러와 ATM 트랜시버간에 ATM 셀 데이터를 송/수신하도록 하는 것을 특징으로 하며, 이와 같이 외부 클럭에 따라 동작하는 간단한 로직회로를 구현하여 ADSL 시스템에서의 가입자측 ADSL 모뎀내 ATM 핸들러와 ATM 트랜시버간에 UTOPIA Ⅰ 통신방식에 의한 ADSL 서비스 데이터의 송/수신을 원할히 수행할 수 있게 되는 효과가 있다.
Description
본 발명은 비대칭 디지털 가입자 라인(Asymmetric Digital Subscriber Line ; 이하, 'ADSL'이라 칭함) 시스템의 가입자측 ADSL 모뎀에 있어서, ATM(Asynchronous Transfer Mode) 핸들러와 ATM 트랜시버간에 간단한 로직(Logic)구성의 회로를 추가하여 ATM 핸들러와 ATM 트랜시버간에 UTOPIA(Universal Test & Operations PHY Interface for ATM) Ⅰ 통신방식에 의한 데이터 송/수신이 원할히 이루어질 수 있도록 한 ADSL 시스템에서의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로에 관한 것이다.
일반적으로 ADSL 시스템은 기존에 설치된 전화선로를 이용하여 전화 서비스 뿐만 아니라 주문자 요구 비디오(Video Of Demand : 이하, 'VOD'라 칭함) 서비스와 같은 대화형 서비스, 데이터 서비스, 고속의 인터넷 서비스 등을 제공할 수 있는 시스템으로, 도 1에 도시된 바와 같이 VOD 서비스를 제공하는 VOD 서버(Server)(1)와, 인터넷 서비스를 제공하는 인터넷 서버(2)와, 상기 VOD 서버(1)와 인터넷 서버(2)에서 제공되는 서비스 데이터 및 제어신호를 ATM 셀 처리하고 스위칭하는 ATM 교환부(4)와 이 ATM 교환부(4)에서 출력되는 데이터 및 제어신호와 전화 교환기(5)에서 출력되는 POTS(Plain Old Telephone Service) 통화신호를 ADSL 신호로 다중화한 후 아날로그 신호로 변조하여 기존의 전화라인으로 전송하는 ADSL 라인 정합부(6)로 이루어진 중앙국(Central Office ; 이하, 'CO'라 칭함)(3)과, 전화라인을 통해 전송되는 상기 CO(3)의 ADSL 신호를 수신하여 데이터 및 제어신호와 POTS 통화신호로 분리하고 각각 분리된 해당 서비스 신호를 TV, PC, 전화기 등을 통해 출력하는 ADSL 모뎀(7)으로 구성된다.
상기와 같이 구성된 ADSL 시스템에서의 ADSL 서비스는 CO(3)에서 ADSL 모뎀(7)까지 최대 2Mbps, ADSL 모뎀(7)에서 CO(3)까지 640Mbps로 전송되며, 이때 CO(3)와 ADSL 모뎀(7)간에는 ADSL 서비스를 위한 데이터 및 제어신호와 함께 POTS 통화신호도 송/수신된다.
상기와 같이 구성된 ADSL 시스템의 가입자측 ADSL 모뎀(7)은 도 2에 도시된 바와 같이, CO(3)로부터 전송되는 ADSL 신호를 데이터 및 제어신호와 POTS 통화신호로 분리하거나, 입력되는 데이터 및 제어신호와 POTS 통화신호를 ADSL 신호로 결합하여 CO(3)로 전송하는 스플리터(Splitter)(10)와, 상기 스플리터(10)에서 분리된 데이터 및 제어신호와 POTS 통화신호를 라인 정합하거나, 입력되는 데이터 및 제어신호와 POTS 통화신호를 라인 정합하여 상기 스플리터(10)로 전송하는 라인 드라이버(Line Driver)(20)와, 상기 라인 드라이버(20)를 통과한 데이터 및 제어신호를 디지털 신호로 변환한 후 DMT 복조하여 바이트(Byte) 단위로 전송하거나, 입력되는 바이트 단위의 데이터 및 제어신호를 ADSL 슈퍼프레임(Superframe)으로 구성하여 DMT 변조한 후 아날로그 신호로 변환하여 상기 라인 드라이버(20)로 전송하는 DMT(Descrete Multi-Tone) 트랜시버(Transceiver)(30)와, 상기 DMT 트랜시버(30)에서 전송되는 바이트 단위의 데이터 및 제어신호를 ATM 셀 처리하여 전송하거나, 입력되는 데이터 및 제어신호를 ATM 셀 처리하여 바이트 단위로 상기 DMT 트랜시버(30)로 전송하는 ATM 핸들러(Handler)(40)와, 상기 ATM 핸들러(40)에서 ATM 셀 처리된 데이터 및 제어신호의 전송속도를 25.6Mbps로 높여 가입자측 PC 터미날인 단말기로 전송하거나, 단말기에서 전송된 데이터 및 제어신호의 전송속도를 3.2Mbps로 낮춰 ATM 핸들러(40)로 전송하는 ATM 트랜시버(50)와, 상기 각 구성(20∼50)의 동작 및 상태를 제어하는 제어부(60)로 구성된다.
상기와 같이 구성된 종래 가입자측 ADSL 모뎀(7)의 ATM 핸들러(40)와 ATM 트랜시버(50)간에는 UTOPIA Ⅰ의 통신방식을 사용하여 ADSL 서비스 데이터 및 제어신호의 송/수신을 수행하게 된다.
그러나, 상기 ATM 핸들러(40)와 ATM 트랜시버(50)는 서로 인터페이스가 맞지않아 별도의 장치를 추가로 사용하여 연결해야 한다.
즉, 종래에는 상기 ATM 핸들러(40)와 ATM 트랜시버(50)가 동일한 물리 계층(PHYsical layer)으로 UTOPIA Ⅰ 통신방식을 사용하기가 힘들고, 이에 따라 ADSL 서비스 데이터 및 제어신호를 송/수신하는 과정이 서로 달라 직접 연결할 수 없게 되는 문제점이 있었다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출한 것으로서, 그 목적은 ADSL 시스템에서의 가입자측 ADSL 모뎀내 ATM 핸들러와 ATM 트랜시버간에 간단한 로직구성의 회로를 추가하여 ATM 핸들러와 ATM 트랜시버를 직접 연결함으로써 UTOPIA Ⅰ 통신방식에 의한 ADSL 서비스 데이터 송/수신을 원할히 수행할 수 있도록 한 ADSL 시스템에서의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로를 제공하는 데에 있다.
도 1은 일반적인 비대칭 디지털 가입자 라인 시스템의 전체 구성도,
도 2는 종래 비대칭 디지털 가입자 라인 시스템의 가입자측 ADSL 모뎀의 블 록 구성도,
도 3은 본 발명에 의한 비대칭 디지털 가입자 라인 시스템에서의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로 구성도.
<도면의 주요부분에 대한 부호의 설명>
41 : 인터페이스 회로 42,43 : 제1, 제2 NOT 게이트
44,45 : 제1, 제2 D-플립플롭 46,47 : 제1, 제2 NAND 게이트
이러한 목적을 달성하기 위한 본 발명의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로는, 외부에서 제공되는 3.2MHz의 클럭에 따라 동일한 물리 계층인 ATM 핸들러와 ATM 트랜시버를 각각 마스터(Master)와 슬래이브(Slave)로 동작하도록 인에이블(Enable)시키고, 이 인에이블된 ATM 핸들러와 ATM 트랜시버 각각이 ATM 셀 데이터의 송/수신 준비가 완료되었음을 알리는 신호를 송/수신함으로써 첫 번째 ATM 셀 데이터를 시작으로 하여 ATM 핸들러와 ATM 트랜시버간에 ATM 셀 데이터를 송/수신하도록 하는 것을 특징으로 한다.
이하, 첨부된 도면을 참고하여 본 발명에 의한 ADSL 시스템에서의 가입자측 ADSL 모뎀내 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로의 구성과 동작을 상세히 설명한다.
도 3은 본 발명에 의한 가입자측 ADSL 모뎀내 ATM 핸들러(40)와 ATM 트랜시버(50)간의 인터페이스 회로(41) 구성도로서, ATM 트랜시버(50)에서 ATM 핸들러(40)로 ATM 셀 데이터를 전송하기 위한 인터페이스 회로는 ATM 핸들러(40)의 TxCLAV 신호를 인버터링(Invertering)하여 ATM 트랜시버(50)의 RxENB 신호로 출력하는 제1 NOT 게이트(42)와, 외부에서 입력되는 3.2MHz의 클럭에 따라 상기 ATM 핸들러(40)의 TxCLAV 신호를 출력하는 제1 D-플립플롭(44)과, 상기 제1 D-플립플롭(44)의 출력신호와 ATM 트랜시버(50)의 RxCLAV 신호를 논리곱하고 인버터링하는 제1 NAND 게이트(46)로 구성되며, ATM 핸들러(40)에서 ATM 트랜시버(50)로 ATM 셀 데이터를 전송하기 위한 인터페이스 회로는 ATM 트랜시버(50)의 TxCLAV 신호를 인버터링하여 ATM 핸들러(40)의 RxENB 신호로 출력하는 제2 NOT 게이트(43)와, 외부에서 입력되는 3.2MHz의 클럭에 따라 상기 ATM 트랜시버(50)의 TxCLAV 신호를 출력하는 제2 D-플립플롭(45)과, 상기 제2 D-플립플롭(45)의 출력신호와 ATM 핸들러(40)의 RxCLAV 신호를 논리곱하고 인버터링하는 제2 NAND 게이트(47)로 구성된다.
상기 ATM 핸들러(40)와 ATM 트랜시버(50)의 TxENB 신호와 RxENB 신호는 ATM 셀 데이터를 송/수신할 수 있도록 ATM 핸들러(40)와 ATM 트랜시버(50)를 인에이블시키기 위한 신호이고, TxCLAV 신호와 RxCLAV 신호는 ATM 핸들러(40)와 ATM 트랜시버(50)가 인에이블되고 나서 ATM 셀 데이터의 송/수신 준비가 완료되었는지를 알려주기 위한 신호이다.
그리고, TxSOC 신호와 RxSOC 신호는 송/수신되는 첫 번째 ATM 셀 데이터를 알려 주기 위한 신호이고, TxDATA 신호와 RxDATA 신호는 송/수신되는 전체 ATM 셀 데이터를 나타내는 신호이며, ATM 핸들러(40)와 ATM 트랜시버(50)간에 ATM 셀 데이터의 송/수신을 위해 동기를 일치시켜 주는 TxCLK 신호와 RxCLK 신호는 외부의 3.2MHz 클럭을 제공받는 신호이다.
상기와 같이 구성된 ATM 핸들러(40)와 ATM 트랜시버(50)간의 인터페이스 회로(41)의 동작을 설명하면 다음과 같다.
본 발명에서 ATM 핸들러(40)와 ATM 트랜시버(50)는 외부에서 제공되는 3.2MHz 클럭에 따라 ATM 셀 데이터의 송/수신을 수행하도록 한다.
먼저, ATM 트랜시버(50)에서 ATM 핸들러(40)로 ATM 셀 데이터를 전송하기 위해서는 제1 NOT 게이트(42)를 통해 ATM 핸들러(40)의 수신준비가 완료됨을 알리는 TxCLAV 신호를 인버터링하여 ATM 트랜시버(50)를 인에이블시키고, 이에 따라 송신준비가 완료됨을 알리는 ATM 트랜시버(50)의 RxCLAV 신호가 제1 NAND 게이트(46)의 한 입력단자로 출력된다.
상기 동작과 동시에 제1 D-플립플롭(44)이 외부 3.2MHz 클럭에 따라 ATM 핸들러(40)의 TxCLAV 신호를 그대로 제1 NAND 게이트(46)로 출력하여, 제1 NAND 게이트(46)에서는 상기 ATM 핸들러(40)의 TxCLAV 신호와 ATM 트랜시버(50)의 RxCLAV 신호를 논리곱하여 인버터링함으로써 ATM 핸들러(40)도 인에이블시킨다.
상기와 같이 외부 3.2MHz의 클럭에 따라 ATM 핸들러(40)와 ATM 트랜시버(50)간에 ATM 셀 데이터의 송/수신 준비가 완료되면, ATM 트랜시버(50)에서 첫 번째 ATM 셀 데이터를 알리는 RxSOC 신호를 ATM 핸들러(40)로 출력하며, 그리고 나서 계속해서 ATM 트랜시버(50)의 나머지 전체 ATM 셀 데이터도 ATM 핸들러(40)로 전송한다.
한편, 상기 ATM 핸들러(40)에서 ATM 트랜시버(50)로 ATM 셀 데이터를 전송하기 위한 인터페이스 동작과정은 상기 과정을 역으로 수행하는 동일한 과정이므로, 상세한 동작 설명은 생략한다.
이상, 상기 설명에서와 같이 본 발명은 외부 클럭에 따라 동작하는 간단한 로직회로를 구현하여 ADSL 시스템에서의 가입자측 ADSL 모뎀내 ATM 핸들러와 ATM 트랜시버간에 UTOPIA Ⅰ 통신방식에 의한 ADSL 서비스 데이터의 송/수신을 원할히 수행할 수 있게 되는 효과가 있다.
Claims (1)
- 스플리터(10)와, 라인 드라이버(20)와, DMT 트랜시버(30)와, ATM 핸들러(40)와, ATM 트랜시버(50)와, 제어부(60)로 구성된 ADSL 시스템의 가입자측 ADSL 모뎀에 있어서,상기 ATM 핸들러(40)와 ATM 트랜시버(50)의 TxCLAV 신호를 인버터링하여 ATM 트랜시버(50)와 ATM 핸들러(40)의 RxENB 신호로 출력하는 제1, 제2 NOT 게이트(42,43)와, 외부에서 입력되는 3.2MHz의 클럭에 따라 상기 ATM 핸들러(40)와 ATM 트랜시버(50)의 TxCLAV 신호를 출력하는 제1, 제2 D-플립플롭(44,45)과, 상기 제1, 제2 D-플립플롭(44,45)의 출력신호와 상기 ATM 트랜시버(50)와 ATM 핸들러(40)의 RxCLAV 신호를 논리곱하고 인버터링하는 제1, 제2 NAND 게이트(46,47)로 구성되는 것을 특징으로 하는 비대칭 디지털 가입자 라인(ADSL) 시스템에서의 가입자측 ADSL 모뎀의 ATM 핸들러와 ATM 트랜시버간의 인터페이스 회로.
Priority Applications (1)
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|---|---|---|---|
| KR1019980010100A KR19990075715A (ko) | 1998-03-24 | 1998-03-24 | 0비대칭 디지털 가입자라인 시스템에서의 가입자측 비대칭 디지털 가입자 라인 모뎀의 비동기 전송모드핸들러와 비동기 전송모드 트랜시버간의 인터페이스 회로 |
Applications Claiming Priority (1)
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| KR20030073577A (ko) * | 2002-03-12 | 2003-09-19 | (주) 윌텍정보통신 | 유토피아 인터페이스 장치 |
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1998
- 1998-03-24 KR KR1019980010100A patent/KR19990075715A/ko not_active Application Discontinuation
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