KR101295096B1 - Display substrate and electro phoretic display device having the same - Google Patents

Display substrate and electro phoretic display device having the same Download PDF

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Abstract

휘도를 향상시키기 위한 표시 기판 및 이를 구비한 전기영동 표시장치가 개시된다. 전기영동 표시장치용 표시 기판은 게이트 배선, 데이터 배선, 스위칭 소자 및 화소 전극을 포함한다. 게이트 배선은 절연 기판 상에 형성된다. 데이터 배선은 게이트 배선과 교차하는 방향으로 연장된다. 스위칭 소자는 게이트 배선과 데이터 배선에 연결된다. 화소 전극은 스위칭 소자와 전기적으로 연결되어, 광을 반사하는 반사 전극층과 광을 흡수하는 불투명 전극층을 포함한다. 이에 따라서, 누설광에 의한 휘도 저하를 방지할 수 있고, 더불어, 누설광에 의한 박막 트랜지스터의 누설 전류를 방지할 수 있다.

Figure R1020060121945

전기영동 표시장치, 박막 트랜지스터, 불투명층

A display substrate for improving brightness and an electrophoretic display device having the same are disclosed. A display substrate for an electrophoretic display device includes a gate wiring, a data wiring, a switching element, and a pixel electrode. The gate wiring is formed on the insulating substrate. The data line extends in the direction crossing the gate line. The switching element is connected to the gate wiring and the data wiring. The pixel electrode is electrically connected to the switching element, and includes a reflective electrode layer that reflects light and an opaque electrode layer that absorbs light. As a result, it is possible to prevent a decrease in luminance due to leakage light and to prevent leakage current of the thin film transistor due to leakage light.

Figure R1020060121945

Electrophoretic Display, Thin Film Transistor, Opaque Layer

Description

표시 기판 및 이를 구비한 전기영동 표시장치{DISPLAY SUBSTRATE AND ELECTRO PHORETIC DISPLAY DEVICE HAVING THE SAME}DISPLAY SUBSTRATE AND ELECTRO PHORETIC DISPLAY DEVICE HAVING THE SAME}

도 1은 본 발명의 실시예에 따른 전기영동 표시장치의 구동원리를 개략적으로 도시한 개략도이다. 1 is a schematic diagram illustrating a driving principle of an electrophoretic display device according to an exemplary embodiment of the present invention.

도 2는 본 발명의 실시예에 따른 전기영동 표시장치의 제조 공정을 도시한 단면도이다.2 is a cross-sectional view illustrating a manufacturing process of an electrophoretic display device according to an exemplary embodiment of the present invention.

도 3은 본 발명의 제 1 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도. 3 is a plan view of an electrophoretic display device including a display substrate according to a first exemplary embodiment of the present invention.

도 4는 도 3에서 IV-IV' 선을 따라 잘라 도시한 단면도이다. 4 is a cross-sectional view taken along the line IV-IV 'of FIG. 3.

도 5는 본 발명의 제 2 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도이다. 5 is a plan view of an electrophoretic display device including a display substrate according to a second exemplary embodiment of the present invention.

도 6은 도 5에서 VI-VI' 선을 따라 잘라 도시한 단면도이다.FIG. 6 is a cross-sectional view taken along the line VI-VI 'of FIG. 5.

도 7은 본 발명의 제 3 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도이다. 7 is a plan view of an electrophoretic display device including a display substrate according to a third exemplary embodiment of the present invention.

도 8은 도 7에서 VI-VI' 선을 따라 잘라 도시한 단면도이다.FIG. 8 is a cross-sectional view taken along the line VI-VI 'of FIG. 7.

도 9a 및 도 9b는 도 8에 도시한 표시 기판의 제1 실시예에 따른 제조 공정도들이다. 9A and 9B illustrate manufacturing process diagrams of a first exemplary embodiment of the display substrate illustrated in FIG. 8.

도 10a 및 도 10b는 도 8에 도시한 표시 기판의 제2 실시예에 따른 제조 공정도들이다. 10A and 10B illustrate manufacturing process diagrams according to a second exemplary embodiment of the display substrate illustrated in FIG. 8.

도 11a 및 도 11b는 도 8에 도시한 표시 기판의 제3 실시예에 따른 제조 공정도들이다. 11A and 11B illustrate manufacturing process diagrams according to a third exemplary embodiment of the display substrate illustrated in FIG. 8.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

210 : 상부 절연기판 200 : 대향 기판210: upper insulating substrate 200: opposing substrate

240 : 공통전극 100a, 100b, 100c : 표시 기판240: common electrode 100a, 100b, 100c: display substrate

121 : 게이트 배선 150 : 반도체층121: gate wiring 150: semiconductor layer

154 : 유기 반도체층 172 : 데이터 배선 154 organic semiconductor layer 172 data wiring

180 : 보호막 181 : 유기막180: protective film 181: organic film

본 발명은 표시 기판과 이를 구비한 전기영동 표시장치(EPD: Electro Phoretic Display)에 관한 것으로, 보다 상세하게는 휘도를 향상시키기 위한 표시 기판 및 이를 구비한 전기영동 표시장치에 관한 것이다. The present invention relates to a display substrate and an electrophoretic display (EPD) having the same, and more particularly, to a display substrate for improving brightness and an electrophoretic display having the same.

전기영동 표시장치는 전자책 등에 사용 가능한 평판 표시 장치의 하나로, 전계 생성 전극이 형성되어 있는 두 장의 기판과 기판 사이에, 각각 흰색과 검은색을 띠고 있으며, 양성 및 음성으로 대전된 안료입자가 미소캡슐에 가두어진 형태로 형성된 표시장치도 있다. The electrophoretic display is one of the flat panel display devices that can be used in electronic books, and has white and black colors between the two substrates on which the field generating electrodes are formed and the substrate, respectively, and the positively and negatively charged pigment particles are minute. There is also a display device which is formed in a shape confined to a capsule.

전기영동 표시장치는 마주하는 두 전극에 전압을 인가하여 전극 양단에 전위차를 발생시킴으로 검은색과 흰색을 띤 대전된 안료입자들을 각각 반대 극성의 전극으로 이동시켜 화상을 표시한다. An electrophoretic display generates an electric potential difference across two electrodes by applying a voltage to two opposite electrodes, thereby moving black and white charged pigment particles to electrodes having opposite polarities, respectively, to display an image.

이러한 전기영동 표시장치는 반사율과 대비비가 높고 액정표시장치와는 달리 시야각에 대한 의존성이 없어서 종이와 같은 편안한 느낌으로 화상을 표시할 수 있는 장점을 가지고 있으며, 쌍안정(bistable)한 특성을 가지고 있어, 지속적인 전압을 인가하지 않더라도 화상을 유지할 수 있어 소비전력이 작다는 장점이 있다. The electrophoretic display has a high reflectance and contrast ratio, and unlike liquid crystal displays, has no dependence on viewing angle, and thus has an advantage of displaying an image with a comfortable feel like paper, and has a bistable characteristic. Therefore, it is possible to maintain the image even if a constant voltage is not applied, which has the advantage of low power consumption.

하지만, 전기영동 표시장치는 외부로부터 입사하는 빛을 차단하거나 화소전극에 의해 제어되지 않는 영역을 가려주는 블랙매트릭스를 가지고 있지 않다는 단점이 있다. However, the electrophoretic display has a disadvantage in that it does not have a black matrix that blocks light incident from the outside or covers an area not controlled by the pixel electrode.

또한, 미소 캡슐을 가지는 전기영동표시 장치의 경우, 미소 캡슐과 캡슐사이를 연결하는 주는 것이 바인더(binder)인데, 바인더 사이로 누설광이 있어 대비비(Contrast Ratio)에 저하를 가져 온다. 미소 캡슐의 크기를 작게 해서, 광이 누설되는 공간을 줄여주는 방식이 제안되기도 하였으나, 캡슐간의 충돌문제가 발생한다. In addition, in the case of an electrophoretic display device having a microcapsule, a connection between the microcapsules and the capsules is a binder, and there is leakage of light between the binders, resulting in a decrease in the contrast ratio. Although a method of reducing the size of the microcapsules to reduce the light leakage space has been proposed, a collision problem occurs between the capsules.

본 발명이 이루고자 하는 기술적 과제는 누설광에 의한 반사를 최소화하기 위한 전기영동 표시장치용 표시 기판을 제공하는 것이다. An object of the present invention is to provide a display substrate for an electrophoretic display device for minimizing reflection by leakage light.

또한, 본 발명이 이루고자 하는 다른 기술적 과제는 상기 표시 기판을 구비한 전기영동 표시장치를 제공하는 것이다. Another object of the present invention is to provide an electrophoretic display device having the display substrate.

상기한 본 발명의 목적을 실현하기 위하여 제1 실시예에 따른 전기영동 표시장치용 표시 기판은 게이트 배선, 데이터 배선, 스위칭 소자 및 화소 전극을 포함한다. 상기 게이트 배선은 절연 기판 상에 형성된다. 상기 데이터 배선은 상기 게이트 배선과 교차하는 방향으로 연장된다. 상기 스위칭 소자는 상기 게이트 배선과 데이터 배선에 연결된다. 상기 화소 전극은 상기 스위칭 소자와 전기적으로 연결되어, 광을 반사하는 반사 전극층과 광을 흡수하는 흡수 전극층을 포함한다. In order to realize the above object of the present invention, the display substrate for an electrophoretic display device according to the first embodiment includes a gate wiring, a data wiring, a switching element, and a pixel electrode. The gate wiring is formed on an insulating substrate. The data line extends in a direction crossing the gate line. The switching element is connected to the gate line and the data line. The pixel electrode is electrically connected to the switching element, and includes a reflective electrode layer that reflects light and an absorption electrode layer that absorbs light.

상기한 본 발명의 목적을 실현하기 위하여 제2 실시예에 따른 전기영동 표시장치용 표시 기판은 게이트 배선, 데이터 배선, 스위칭 소자, 유기막 및 화소 전극을 포함한다. 상기 게이트 배선은 절연 기판 상에 형성된다. 상기 데이터 배선은 상기 게이트 배선과 교차하는 방향으로 연장된다. 상기 스위칭 소자는 상기 게이트 배선과 데이터 배선에 연결된다. 상기 유기막은 상기 스위칭 소자가 형성된 절연 기판 위에 불투명한 유기 물질로 형성된다. 상기 화소 전극은 상기 유기막에 형성된 접촉 구멍을 통해 상기 스위칭 소자와 전기적으로 연결된다. In order to achieve the above object of the present invention, the display substrate for an electrophoretic display device according to the second embodiment includes a gate wiring, a data wiring, a switching element, an organic film, and a pixel electrode. The gate wiring is formed on an insulating substrate. The data line extends in a direction crossing the gate line. The switching element is connected to the gate line and the data line. The organic layer is formed of an opaque organic material on the insulating substrate on which the switching element is formed. The pixel electrode is electrically connected to the switching element through a contact hole formed in the organic layer.

상기한 본 발명의 다른 목적을 실현하기 위한 제1 실시예에 따흔 전기영동 표시장치는 표시 기판, 대향 기판 및 전기영동 입자들을 포함한다. 상기 표시 기판은 서로 교차하는 방향으로 형성된 게이트 배선과 데이터 배선에 연결된 스위칭 소자, 상기 스위칭 소자와 전기적으로 연결되어 광을 반사하는 반사 전극층과 광을 흡수하는 흡수 전극층을 포함하는 화소 전극을 포함한다. 상기 대향 기판은 상기 표시 기판과 결합한다. 상기 전기영동 입자들은 상기 표시 기판과 대향 기판 사이 에 개재된다.In accordance with a first embodiment of the present invention, an electrophoretic display device includes a display substrate, an opposing substrate, and electrophoretic particles. The display substrate includes a pixel electrode including a gate line and a switching element connected to the data line, a reflective electrode layer electrically connected to the switching element to reflect light, and an absorption electrode layer to absorb light. The opposing substrate is coupled to the display substrate. The electrophoretic particles are interposed between the display substrate and the counter substrate.

상기한 본 발명의 다른 목적을 실현하기 위한 제2 실시예에 따흔 전기영동 표시장치는 표시 기판, 대향 기판 및 전기영동 입자들을 포함한다. 상기 표시 기판 절연 기판 위에 서로 교차하는 방향으로 형성된 게이트 배선과 데이터 배선에 연결된 스위칭 소자와, 상기 스위칭 소자가 형성된 절연 기판 위에 불투명한 유기 물질로 형성된 유기막 및 상기 유기막 위에 상기 스위칭 소자와 전기적으로 연결된 화소 전극을 포함한다. 대향 기판은 상기 표시 기판과 결합한다. 상기 전기영동 입자들은 상기 표시 기판과 대향 기판 사이에 개재된다. In accordance with a second exemplary embodiment for realizing another object of the present invention, an electrophoretic display includes a display substrate, an opposing substrate, and electrophoretic particles. A switching element connected to a gate wiring and a data wiring formed in a direction crossing each other on the display substrate insulating substrate; an organic layer formed of an opaque organic material on the insulating substrate on which the switching element is formed; And a connected pixel electrode. The opposite substrate is coupled to the display substrate. The electrophoretic particles are interposed between the display substrate and the counter substrate.

이러한 표시 기판 및 이를 구비한 전기영동 표시장치에 의하면, 전기영동장치의 미소캡슐 사이로 빛의 누설에 의한 반사를 최소화하여 표시 품질을 향상시킬 수 있다. According to the display substrate and the electrophoretic display device having the same, display quality can be improved by minimizing reflection due to leakage of light between the microcapsules of the electrophoretic device.

첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. BRIEF DESCRIPTION OF THE DRAWINGS The above and other features and advantages of the present invention will become more apparent by describing in detail exemplary embodiments thereof with reference to the attached drawings in which: FIG. The present invention may, however, be embodied in many different forms and should not be construed as limited to the embodiments set forth herein.

도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면부호를 붙였다. 층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐 아니라, 그 중간에 또 다른 부분이 있는 경우도 포함한다. 반대로, 어떤 부분이 다른 부분의 "바로 위에" 있다고 할 때에는 중간에 다 른 부분이 없는 것을 뜻한다. 또한, 동일한 구성요소에 대해서는 동일한 도면부호를 부여하여 설명하고, 이하 상세한 설명에서 상기 스위칭 소자는 "박막 트랜지스터"로 명칭한다. In the drawings, the thickness is enlarged to clearly represent the layers and regions. Like parts are designated by like reference numerals throughout the specification. When a portion of a layer, film, region, plate, etc. is said to be "on top" of another part, this includes not only when the other part is "right over", but also when there is another part in between. Conversely, when a part is "just above" another part, there is no other part in the middle. In addition, the same components will be described with the same reference numerals, and in the following detailed description, the switching elements will be referred to as "thin film transistors".

이하, 첨부한 도면들을 참조하여 본 발명의 바람직한 실시예들을 상세히 설명한다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings.

먼저, 도 1 및 도 2를 통하여 본 발명의 실시예에 따른 전기영동 표시장치의 구동 원리와 전기영동 표시장치용 두 기판의 부착 공정에 대하여 설명하기로 한다.First, a driving principle of an electrophoretic display device and an attaching process of two substrates for an electrophoretic display device will be described with reference to FIGS. 1 and 2.

도 1은 본 발명의 실시예에 따른 전기영동 표시장치의 구동 원리를 개략적으로 도시한 개략도이고, 도 2는 본 발명의 실시예에 따른 전기영동 표시장치의 제조 공정을 도시한 단면도이다.1 is a schematic diagram illustrating a driving principle of an electrophoretic display device according to an exemplary embodiment of the present invention, and FIG. 2 is a cross-sectional view illustrating a manufacturing process of the electrophoretic display device according to an exemplary embodiment of the present invention.

도 1에서 보는 바와 같이, 본 발명의 실시예에 따른 전기 영동(electro phoretic) 표시 장치는 전계(-, +) 생성하기 위한 화소 전극(PE, 도 4 참조)과 공통 전극(240, 도 4 참조)을 포함하고, 이들 사이에는 흰색과 검은색을 띠고 있으며 양성(positive) 및 음성(negative)으로 대전된 전기영동 입자들을 포함하는 미소 캡슐(micro capsule)이 배치된다. 상기 전기영동 입자들은 흰색과 검은색 외에, R,G,B,C,N,Y와 같은 색을 가지는 입자일 수도 있다. As shown in FIG. 1, an electrophoretic display device according to an exemplary embodiment of the present invention refers to a pixel electrode PE (see FIG. 4) and a common electrode 240 and FIG. 4 for generating an electric field (−, +). Microcapsules are disposed between them, which are white and black and contain positive and negatively charged electrophoretic particles. The electrophoretic particles may be particles having a color such as R, G, B, C, N, and Y in addition to white and black.

이러한 본 발명의 실시예에 따른 전기영동 표시장치의 마주하는 두 전극에 전압을 인가하여 전극 양단에 전위차(+, -)를 형성하면, 검은색과 흰색의 전기 영동 입자들을 각각 반대 극성의 전극으로 이동하며, 이를 통하여 관찰자(300)는 검 은색 또는 흰색으로 이루어진 화상을 보게 된다. When a potential difference (+,-) is formed at both ends of an electrode by applying a voltage to two opposite electrodes of the electrophoretic display according to the exemplary embodiment of the present invention, the electrophoretic particles of black and white are respectively formed as electrodes having opposite polarities. As a result, the observer 300 sees an image made of black or white.

이러한 본 발명의 실시예에 따른 전기영동 표시장치는 신호 배선들, 화소 전극들 및 신호 배선들과 화소 전극들을 전기적으로 연결하는 박막 트랜지스터들이 형성된 표시 기판(100)과 화소 전극들과 마주하여 전계를 발생키는 공통 전극이 형성된 플라스틱 필름(plastic film, 210)과 그 상부에 형성된 캡슐(220)을 포함하는 대향 기판(200)을 포함한다.An electrophoretic display device according to an exemplary embodiment of the present invention provides an electric field facing a display substrate 100 and pixel electrodes on which signal lines, pixel electrodes, and thin film transistors electrically connecting the signal lines and the pixel electrodes are formed. The generation key includes an opposing substrate 200 including a plastic film 210 having a common electrode formed thereon and a capsule 220 formed thereon.

이 때, 두 기판(100, 200)을 부착하기 위해서 대향 기판(200)은 라미네이터(laminator, 500)를 통하여 표시 기판(100) 상부에 라미네이션(lamination)되며, 접착제(230)에 의해 표시 기판(100)에 부착된다. In this case, in order to attach the two substrates 100 and 200, the opposite substrate 200 is laminated on the display substrate 100 through a laminator 500, and the display substrate ( 100).

다음은, 본 발명의 실시예에 따른 전기영동 표시장치용 두 기판의 구조에 대하여 도면을 참조하여 더욱 상세하게 설명하기로 한다. Next, a structure of two substrates for an electrophoretic display according to an exemplary embodiment of the present invention will be described in more detail with reference to the accompanying drawings.

도 3은 본 발명의 제1 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도이고, 도 4는 도 3에서 IV-IV' 선을 따라 잘라 도시한 단면도이다.3 is a plan view of an electrophoretic display including a display substrate according to a first exemplary embodiment of the present invention, and FIG. 4 is a cross-sectional view taken along the line IV-IV 'of FIG. 3.

본 발명의 실시예에 따른 전기영동 표시장치는 앞에서 설명한 바와 같이 대향 기판(200)과 표시 기판(100a) 및 두 기판(100a, 200) 사이에 형성된 다수의 캡슐(220)과 두 기판(100a, 200)을 결합시키는 접착제(230)를 포함한다. As described above, the electrophoretic display device according to the exemplary embodiment of the present invention has a plurality of capsules 220 and two substrates 100a formed between the opposing substrate 200, the display substrate 100a, and the two substrates 100a and 200. Adhesive 230 to bond 200.

도 3 및 도 4를 참조하면, 표시 기판(100a)에는, 하부 절연 기판(110) 위에 주로 가로 방향으로 연장된 복수의 게이트 배선들(gate line)(121)이 형성된다. 게이트 배선들(121)은 비저항(resistivity)이 낮은 은(Ag) 또는 은 합금(Ag alloy) 또는 알루미늄(Al) 또는 알루미늄 합금(Al alloy), 구리 또는 구리합금으로 이루어 진 단일막으로 이루어질 수도 있고, 이러한 단일막에 더하여 물리적, 전기적 접촉 특성이 좋은 크롬(Cr), 티타늄(Ti), 탄탈륨(Ta) 따위의 물질로 이루어진 다른 막을 포함하는 다층막으로 이루어질 수도 있다. 각 게이트 배선(121)의 일부는 복수의 가지가 뻗어 나와 박막 트랜지스터(TFT)의 게이트 전극(123)을 형성한다. 게이트 배선(121)은 단면은 경사져 있으며, 경사각은 수평면으로부터 20~80° 범위이다.3 and 4, a plurality of gate lines 121 extending mainly in the horizontal direction are formed on the lower insulating substrate 110 in the display substrate 100a. The gate wires 121 may be formed of a single layer made of silver (Ag) or silver alloy (Ag) or aluminum (Al) or aluminum alloy (Al alloy), copper, or copper alloy having low resistivity. In addition to such a single film, it may be made of a multilayer film including other films made of materials such as chromium (Cr), titanium (Ti), and tantalum (Ta) having good physical and electrical contact properties. A portion of each gate line 121 extends to form the gate electrode 123 of the thin film transistor TFT. The gate wiring 121 is inclined in cross section, and the inclination angle is in a range of 20 to 80 ° from the horizontal plane.

게이트 배선(121) 위에는 질화 규소(SiNx) 따위로 이루어진 게이트 절연막(gate insulating layer)(130)이 형성된다.A gate insulating layer 130 made of silicon nitride (SiNx) is formed on the gate wiring 121.

게이트 절연막(130) 상부에는 수소화 비정질 규소(hydrogenated amorphous silicon) 따위로 이루어진 반도체층(silicon island)(150)이 형성된다. 각 반도체층(150)은 해당하는 게이트 전극(123) 위에 형성되어 박막 트랜지스터(TFT)의 채널을 이룬다. 반도체층(150)의 상부에는 실리사이드(silicide) 또는 n형 불순물이 고농도로 도핑된 n+ 수소화 비정질 규소 따위로 만들어진 제1 저항성 접촉층(ohmic contact)(163) 및 제2 저항성 접촉층(165)이 형성된다. 제2 저항성 접촉층(165)은 게이트 전극(123)을 중심으로 제1 저항성 접촉층(163)의 반대쪽에 위치하며 서로 이격된다. 반도체층(150)과 제1 및 제2 저항성 접촉층(163, 165)의 단면은 테이퍼 구조를 가지며, 경사각은 20~80° 범위이다. A semiconductor island 150 made of hydrogenated amorphous silicon is formed on the gate insulating layer 130. Each semiconductor layer 150 is formed on the corresponding gate electrode 123 to form a channel of the thin film transistor TFT. The first ohmic contact 163 and the second ohmic contact layer 165 made of n + hydrogenated amorphous silicon doped with a high concentration of silicide or n-type impurities are disposed on the semiconductor layer 150. Is formed. The second ohmic contact layer 165 is disposed on the opposite side of the first ohmic contact layer 163 with respect to the gate electrode 123 and spaced apart from each other. Cross sections of the semiconductor layer 150 and the first and second ohmic contacts 163 and 165 have a tapered structure, and the inclination angle is in a range of 20 to 80 °.

제1 및 제2 저항성 접촉층(163, 165) 및 게이트 절연막(130) 위에는 복수의 데이터 배선(data line)(172) 과 박막 트랜지스터(TFT)의 드레인 전극(drain electrode)(175)이 형성된다. 데이터 배선(172)과 드레인 전극(175)은 비저항이 낮은 Al 또는 Ag 로 이루어질 수 있으며, 게이트 배선(121)과 같이 다른 물질과 접촉 특성이 우수한 도전 물질을 포함할 수 있다. 데이터 배선(172)은 주로 세로 방향으로 뻗어 게이트 배선(121)과 교차하며 데이터 배선(172)으로부터 연장된 박막 트랜지스터(TFT)의 소스 전극(source electrode)(173)을 포함한다. 소스 전극(173)과 드레인 전극(175)은 해당하는 제1 및 제2 저항성 접촉층(163, 165)의 상부에 형성되고, 서로 마주보고 이격되어 형성된다.A plurality of data lines 172 and drain electrodes 175 of the thin film transistor TFT are formed on the first and second ohmic contacts 163 and 165 and the gate insulating layer 130. . The data line 172 and the drain electrode 175 may be made of Al or Ag with low specific resistance, and may include a conductive material having excellent contact properties with other materials, such as the gate line 121. The data line 172 mainly includes a source electrode 173 of the thin film transistor TFT extending in the vertical direction to cross the gate line 121 and extend from the data line 172. The source electrode 173 and the drain electrode 175 are formed on the corresponding first and second ohmic contacts 163 and 165, and are spaced apart from each other.

데이터 배선(172) 및 드레인 전극(175)의 단면은 20~80° 범위의 경사각을 가지는 테이퍼 구조를 가질 수 있다. Cross sections of the data line 172 and the drain electrode 175 may have a tapered structure having an inclination angle in a range of 20 ° to 80 °.

제1 및 제2 저항성 접촉층(163, 165)은 반도체층(150)과 소스 전극(173) 및 드레인 전극(175) 사이의 접촉 저항을 낮추어 준다. The first and second ohmic contacts 163 and 165 lower the contact resistance between the semiconductor layer 150, the source electrode 173, and the drain electrode 175.

데이터 배선(172), 소스 전극(173) 및 드레인 전극(175)이 형성된 절연 기판(110) 위에는 반도체층(150)을 커버하고 평탄화를 위한 유전율이 낮은 아크릴계의 유기 절연 물질로 이루어진 보호막(180)이 형성된다. A passivation layer 180 made of an acrylic organic insulating material covering the semiconductor layer 150 and having a low dielectric constant for planarization on the insulating substrate 110 on which the data line 172, the source electrode 173, and the drain electrode 175 are formed. Is formed.

이러한 보호막(180)은 드레인 전극(175)을 드러내는 제1 접촉 구멍(185)과, 게이트 절연막(130)과 함께 게이트 배선(121)의 끝 부분(128)을 드러내는 제2 접촉 구멍(188) 및 데이터 배선(172)의 끝 부분(179)을 드러내는 제2 접촉 구멍(189)을 가진다. 제2 및 제3 접촉 구멍(188, 189)은 게이트 배선(121) 및 데이터 배선(172) 과 각각의 구동 회로들(도시하지 않음)을 전기적 연결을 위한 것이다. The passivation layer 180 may include a first contact hole 185 exposing the drain electrode 175, a second contact hole 188 exposing the end portion 128 of the gate wiring 121 together with the gate insulating layer 130, and It has a second contact hole 189 exposing the end portion 179 of the data line 172. The second and third contact holes 188 and 189 are for electrical connection between the gate wiring 121 and the data wiring 172 and respective driving circuits (not shown).

이때, 보호막(180)의 제1, 제2 및 제3 접촉 구멍(185, 188, 189)의 측벽은 경사져 있으며, 경사각은 30~180° 범위인 것이 바람직하다. At this time, the sidewalls of the first, second and third contact holes 185, 188, and 189 of the passivation layer 180 are inclined, and the inclination angle is preferably in the range of 30 ° to 180 °.

보호막(180)의 아래에는 드러난 반도체층(150)의 일부를 덮는 산화 규소 또 는 질화 규소 등의 절연 물질로 이루어진 층간 절연막(도시하지 않음)이 추가될 수 있다. An interlayer insulating film (not shown) made of an insulating material such as silicon oxide or silicon nitride may be added below the passivation layer 180 to cover a portion of the exposed semiconductor layer 150.

보호막(180) 위에는 반사 전극층(191a) 및 흡수 전극층(191b)으로 이루어진 화소 전극(PE)이 형성된다. 반사 전극층(191a)은 보호막(180) 위에 바로 형성되고, 흡수 전극층(191b)은 반사 전극층(191a) 위에 바로 형성된다. The pixel electrode PE including the reflective electrode layer 191a and the absorption electrode layer 191b is formed on the passivation layer 180. The reflective electrode layer 191a is formed directly on the passivation layer 180, and the absorption electrode layer 191b is formed directly on the reflective electrode layer 191a.

반사 전극층(191a)은 크롬(Cr) 또는 몰리(Mo) 등의 금속 물질로 형성된다. 반사 전극층(191a)은 전기영동 표시장치의 배면에서 입사하는 광을 반사시키는 역할을 한다. 배면 입사광을 반사시키는 경우, 광이 미소캡슐(220)사이로 누설되어 전면에서 시인되지 않도록 차단하는 것이 가능하다. The reflective electrode layer 191a is formed of a metal material such as chromium (Cr) or molybdenum (Mo). The reflective electrode layer 191a serves to reflect light incident from the rear surface of the electrophoretic display. When reflecting back incident light, it is possible to block the light from leaking between the microcapsules 220 and not being viewed from the front surface.

흡수 전극층(191b)은 크롬 산화물(CrOx) 또는 몰리 산화물(MoOx) 등의 산화 물질로 형성된다. 또한, 상기 흡수 전극층(191b)은 전기영동 입자들에 의해 반사되거나 산란되는 광을 흡수하는 불투명한 물질로 형성되며, 광학밀도(Optical Density)는 3.6 이상이다. 전면에서 입사된 광에 의해 흰색을 표시하는 경우에는 광이 반사되더라도 휘도에 영향을 크게 주지 않지만, 전기영동 표시장치가 검은색을 표시하는 경우, 휘도를 감소시킬 수 있다. 흡수 전극층(191b)은 전면에서 입사하는 광을 흡수하여 휘도를 향상시킬 수 있다. The absorbing electrode layer 191b is formed of an oxidizing material such as chromium oxide (CrOx) or molybdenum oxide (MoOx). In addition, the absorbing electrode layer 191b is formed of an opaque material that absorbs light reflected or scattered by the electrophoretic particles, and has an optical density of 3.6 or more. In the case of displaying white color by the light incident from the front surface, even if the light is reflected, the brightness is not greatly influenced, but when the electrophoretic display device displays black color, the luminance may be reduced. The absorption electrode layer 191b may absorb the light incident from the front surface thereof to improve luminance.

반사 전극층(191a)과 흡수 전극층(191b)은 제1 접촉 구멍(185)을 통해 박막 트랜지스터(TFT)의 드레인 전극(175)과 전기적으로 연결된다. 반사 전극층(191a)과 흡수 전극층(191b)은 기존의 화소 전극을 형성하는 투명 도전성 물질인 ITO 또는 IZO와 대비하여, 저항이 높지 않아 반사형 표시장치에서 화소 전극으로의 역할이 가능하다. The reflective electrode layer 191a and the absorption electrode layer 191b are electrically connected to the drain electrode 175 of the thin film transistor TFT through the first contact hole 185. The reflective electrode layer 191a and the absorption electrode layer 191b do not have high resistance in comparison with ITO or IZO, which is a transparent conductive material forming a conventional pixel electrode, and thus may serve as a pixel electrode in a reflective display device.

또한, 반사 전극층(191a)과 흡수 전극층(191b)으로 형성된 화소 전극(PE)은 박막 트랜지스터(TFT)의 채널부의 상부까지 연장하여 형성할 수 있다. 불투명한 화소 전극(PE)이 박막 트랜지스터(TFT)의 채널부 상부까지 연장됨에 따라서 누설광이 박막 트랜지스터(TFT)의 채널부에 입사되는 것을 막는다. In addition, the pixel electrode PE formed of the reflective electrode layer 191a and the absorption electrode layer 191b may extend to an upper portion of the channel portion of the thin film transistor TFT. As the opaque pixel electrode PE extends to the upper portion of the channel portion of the thin film transistor TFT, leakage light is prevented from entering the channel portion of the thin film transistor TFT.

따라서, 제1 실시예에 따른 전기영동 표시장치에서는, 대향 기판(200)에 블랙 매트릭스가 없어, 박막 트랜지스터(TFT)의 채널부인 소스 전극(173)과 드레인 전극(175) 사이의 반도체층(150)에 외부로부터 빛이 입사되는 것을 막아 누설광에 의한 누설 전류의 발생을 방지할 수 있다. Therefore, in the electrophoretic display device according to the first exemplary embodiment, there is no black matrix on the opposing substrate 200, so that the semiconductor layer 150 between the source electrode 173 and the drain electrode 175, which is a channel portion of the TFT, is formed. It is possible to prevent light from being incident on the outside to prevent the leakage current caused by the leaked light.

이러한 본 발명의 제1 실시예의 전기영동 표시장치에서 화소 전극(PE)은 게이트 배선(121) 및 데이터 배선(172)과 중첩되어 개구율(aperture)을 높이고 있어, 화소 전극(PE) 사이의 제어되지 않는 영역의 면적을 최소화할 수 있다. 이때, 화소 전극(PE)과 게이트 배선(121) 및 데이터 배선(172) 사이에는 낮은 유전율을 가지는 절연 물질로 이루어진 보호막(180)이 개재되어 있어, 이들 사이에서 발생하는 기생 용량을 최소화할 수 있다. In the electrophoretic display device according to the first exemplary embodiment of the present invention, the pixel electrode PE overlaps the gate line 121 and the data line 172 to increase the aperture ratio, and thus the pixel electrode PE is not controlled between the pixel electrode PE. It is possible to minimize the area of the non-area. In this case, a passivation layer 180 made of an insulating material having a low dielectric constant is interposed between the pixel electrode PE, the gate wiring 121, and the data wiring 172, thereby minimizing parasitic capacitance generated therebetween. .

한편, 보호막(180)의 위에는 제1 및 제2 접촉 전극(contact assistant)(198, 199)이 형성된다. 제1 및 제2 접촉 전극(198, 199)은 제2 및 제3 접촉 구멍(188, 189)을 통하여 게이트 배선(121) 및 데이터 배선(172)의 노출된 끝 부분(128, 179)과 연결되어 있다. 제1 및 제2 접촉 전극(198, 199)은 게이트 배선(121) 및 데이터 배선(172)의 노출된 끝 부분(125, 179)을 보호하고 표시 기판(100a)과 구동 회로의 접착성을 보완하기 위한 것이며 필수적인 것은 아니다. 제1 및 제2 접촉 전극(198, 199)은 화소 전극(PE)과 동일한 층으로 형성된다. Meanwhile, first and second contact assistants 198 and 199 are formed on the passivation layer 180. The first and second contact electrodes 198 and 199 are connected to the exposed ends 128 and 179 of the gate line 121 and the data line 172 through the second and third contact holes 188 and 189. It is. The first and second contact electrodes 198 and 199 protect the exposed ends 125 and 179 of the gate line 121 and the data line 172 and compensate for the adhesion between the display substrate 100a and the driving circuit. It is meant to, and not required. The first and second contact electrodes 198 and 199 are formed of the same layer as the pixel electrode PE.

한편, 표시 기판(100a)과 마주하는 대향 기판(200)에는, 하부 절연 기판(110)과 마주하는 상부 절연 기판(210)의 상부에 투명한 도전 물질로 이루지고, 화소 전극(PE)과 마주하여 양성(positive) 및 음성(negative)으로 대전된 안료 입자를 구동하기 위한 전계를 형성하는 공통 전극(240)이 전면적으로 형성된다. Meanwhile, the opposing substrate 200 facing the display substrate 100a is made of a transparent conductive material on the upper insulating substrate 210 facing the lower insulating substrate 110 and faces the pixel electrode PE. A common electrode 240 is formed over the entire surface to form an electric field for driving the positively and negatively charged pigment particles.

도 5는 본 발명의 제 2 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도이고, 도 6은 도 5에서 VI-VI' 선을 따라 잘라 도시한 단면도이다.5 is a plan view of an electrophoretic display device including a display substrate according to a second exemplary embodiment of the present invention, and FIG. 6 is a cross-sectional view taken along the line VI-VI ′ of FIG. 5.

도 5 및 도 6을 참조하면, 표시 기판(100b)은 투명한 유리, 실리콘(silicone) 또는 플라스틱(plastic) 따위로 만들어진 절연 기판(substrate)(110) 위에 복수의 게이트 배선들(gate line)(121)이 형성된다. 5 and 6, the display substrate 100b includes a plurality of gate lines 121 on an insulating substrate 110 made of transparent glass, silicon, or plastic. ) Is formed.

게이트 배선(121)은 게이트 신호를 전달하며 가로 방향으로 연장되어 형성된다. 게이트 배선(121)은 게이트 배선(121)으로부터 돌출된 게이트 전극(gate electrode)(123)과 다른 층 또는 외부 구동 회로와의 접속을 위한 넓은 끝 부분(129)을 포함한다.The gate line 121 transmits a gate signal and extends in a horizontal direction. The gate wiring 121 includes a wide end portion 129 for connecting a gate electrode 123 protruding from the gate wiring 121 to another layer or an external driving circuit.

게이트 배선(121)을 포함한 절연 기판(110) 전면에는 층간 절연막(143)이 형성된다. 층간 절연막(143)은 용액 공정이 가능한 감광성 유기 물질로 만들어질 수 있으며, 층간 절연막(143)의 두께는 약 5000Å 내지 4㎛ 정도이다.An interlayer insulating layer 143 is formed on the entire surface of the insulating substrate 110 including the gate wiring 121. The interlayer insulating layer 143 may be made of a photosensitive organic material capable of solution processing, and the thickness of the interlayer insulating layer 143 may be about 5000 μm to 4 μm.

층간 절연막(143)은 개구부(144) 및 접촉 구멍(148)을 가진다. 개구부(144) 는 게이트 전극(123)을 드러내는 하부 개구부(144p)와 하부 개구부(144p) 위에 위치하는 상부 개구부(144q)를 포함한다. 하부 개구부(144p)와 상부 개구부(144q)는 계단식으로 형성되며 상부 개구부(144q)가 하부 개구부(144p)보다 크다. 접촉 구멍(148)은 게이트 배선(121)의 끝 부분(129)을 드러낸다.The interlayer insulating film 143 has an opening 144 and a contact hole 148. The opening 144 includes a lower opening 144p exposing the gate electrode 123 and an upper opening 144q positioned over the lower opening 144p. The lower opening 144p and the upper opening 144q are formed stepwise, and the upper opening 144q is larger than the lower opening 144p. The contact hole 148 exposes the end portion 129 of the gate wiring 121.

하부 개구부(144p)에는 게이트 절연막(130)가 형성된다. 하부 개구부(144p)를 둘러싸는 층간 절연막(143)은 게이트 절연막(130)를 가두는 둑(bank) 역할을 한다.The gate insulating layer 130 is formed in the lower opening 144p. The interlayer insulating layer 143 surrounding the lower opening 144p serves as a bank for trapping the gate insulating layer 130.

게이트 절연막(130)는 유기 물질 또는 무기 물질로 만들어진다. 이러한 유기 물질의 예로는 폴리이미드(polyimide), 폴리비닐알코올(polyvinyl alcohol), 플루오란(fluorane)함유 화합물, 파릴렌(parylene) 등의 용해성 고분자 화합물을 들 수 있으며, 무기 물질의 예로는 옥타데실트리클로로실란(octadecyl trichloro silane, OTS)으로 표면처리된 산화규소(SiO2) 따위를 들 수 있다.The gate insulating layer 130 is made of an organic material or an inorganic material. Examples of such organic materials include soluble polymer compounds such as polyimide, polyvinyl alcohol, fluorane-containing compounds, and parylene, and examples of inorganic materials include octadecyl. And silicon oxide (SiO 2) surface-treated with octadecyl trichloro silane (OTS).

게이트 절연막(130) 및 층간 절연막(143) 위에는 데이터 배선(data line)(172), 화소 전극(pixel electrode)(PE) 및 접촉 전극(contact assistant)(198)이 형성된다. A data line 172, a pixel electrode PE, and a contact assistant 198 are formed on the gate insulating layer 130 and the interlayer insulating layer 143.

데이터 배선(172)은 데이터 신호를 전달하며 주로 세로 방향으로 뻗어서 게이트 배선(121)과 교차한다. 데이터 배선(172)은 일부가 돌출된 소스 전극(source electrode)(193)과 다른 층 또는 외부 구동 회로와의 접속을 위한 넓은 끝 부분(199)을 포함한다. The data line 172 transmits a data signal and mainly extends in a vertical direction to cross the gate line 121. The data line 172 includes a wide end portion 199 for connecting a part of the source electrode 193 protruding from another layer or an external driving circuit.

화소 전극(PE)과 데이터 배선(172)은 다층막 구조로 형성된다. 구체적으로, 층간 절연층(143) 바로 위에 투명 도전성 물질로 형성된 제1 및 제2 투명 도전층(191, 192)과, 제1 및 제2 투명 도전층(191, 192) 위에 반사 금속 물질로 형성된 제1 및 제2 반사 전극층(171a, 172a)과, 제1 및 제2 반사 전극층(171a, 172a) 위에 불투명 물질로 형성된 제1 및 제2 흡수 전극층(171b, 172b)으로 이루어진다.The pixel electrode PE and the data line 172 are formed in a multilayer film structure. Specifically, the first and second transparent conductive layers 191 and 192 formed of a transparent conductive material directly on the interlayer insulating layer 143 and the reflective metal material formed on the first and second transparent conductive layers 191 and 192. The first and second reflective electrode layers 171a and 172a and the first and second absorption electrode layers 171b and 172b formed of an opaque material are formed on the first and second reflective electrode layers 171a and 172a.

즉, 화소 전극(PE)은 제1 투명 도전층(191), 제1 반사 전극층(171a) 및 제1 흡수 전극층(171b)으로 이루어지고, 데이터 배선(172)은 제2 투명 도전층(192), 제2 반사 전극층(172a) 및 제2 흡수 전극층(172b)으로 이루어진다. That is, the pixel electrode PE includes the first transparent conductive layer 191, the first reflective electrode layer 171a, and the first absorption electrode layer 171b, and the data line 172 includes the second transparent conductive layer 192. And a second reflective electrode layer 172a and a second absorption electrode layer 172b.

소스 전극(193)과 데이터 배선(172)의 끝 부분(199)은 투명 도전성 물질로 형성된 단일막 구조를 갖는다. 데이터 배선(172)의 끝 부분(179)은 데이터 배선(172)과 동일하게 다층막 구조로 형성될 수 있다.  The source electrode 193 and the end portion 199 of the data line 172 have a single film structure formed of a transparent conductive material. The end portion 179 of the data line 172 may be formed in a multilayered film structure in the same manner as the data line 172.

투명 도전성 물질은 ITO(indium tin oxide) 또는 IZO(indium zinc oxide) 따위의 투명 도전성 산화물로 만들어진다. 반사 금속 물질은 몰리브덴(Mo), 몰리브덴 합금, 크롬(Cr), 크롬 합금, 알루미늄(Al), 알루미늄 합금, 구리(Cu), 구리 합금, 은(Ag), 은 합금 따위의 저저항성 금속으로 형성되며, 바람직하게 크롬(Cr) 또는 몰리(Mo) 등의 금속 물질로 형성된다. 불투명 물질은 검은색 물질 또는 백색 물질로 형성되며, 바람직하게는 크롬 산화물(CrOx) 또는 몰리 산화물(MoOx) 등의 산화 물질로 형성되고, 광학밀도(Optical Density)는 3.6 이상이다. 바람직하게 투명 도전성 물질과 반사 금속 물질은 식각 선택비가 다른 물질이며, 반사 금속 물질과 불투명 물질은 식각 선택비가 유사한 물질이다. The transparent conductive material is made of a transparent conductive oxide such as indium tin oxide (ITO) or indium zinc oxide (IZO). Reflective metal material is formed of low-resistance metal such as molybdenum (Mo), molybdenum alloy, chromium (Cr), chromium alloy, aluminum (Al), aluminum alloy, copper (Cu), copper alloy, silver (Ag), silver alloy It is preferably formed of a metal material such as chromium (Cr) or mol (Mo). The opaque material is formed of a black material or a white material, preferably formed of an oxidizing material such as chromium oxide (CrOx) or molybdenum oxide (MoOx), and has an optical density of 3.6 or more. Preferably, the transparent conductive material and the reflective metal material are materials having different etching selectivity, and the reflective metal material and the opaque material are materials having similar etching selectivity.

드레인 전극(195)은 화소 전극(PE)의 제1 투명 도전층(191)으로부터 연장되 어 게이트 절연막(130) 위에 형성되고, 소스 전극(193)은 데이터 배선(172)의 제2 투명 도전층(192)으로부터 연장되어 드레인 전극(195)과 마주보도록 게이트 절연막(130) 위에 형성된다. The drain electrode 195 extends from the first transparent conductive layer 191 of the pixel electrode PE and is formed on the gate insulating layer 130, and the source electrode 193 is the second transparent conductive layer of the data line 172. The gate insulating layer 130 is formed on the gate insulating layer 130 to extend from 192 to face the drain electrode 195.

화소 전극(PE)은 드레인 전극(195)으로부터 데이터 신호를 인가 받는다. 데이터 전압이 인가된 화소 전극(PE)은 화소 전극(PE)과 마주보며 공통 전압을 인가 받는 공통 전극(도시하지 않음)과 함께 전기장을 생성함으로써, 화소 전극(PE)과 공통 전극 사이의 개재된 양성(positive) 및 음성(negative)으로 대전된 안료 입자를 구동시킨다.The pixel electrode PE receives a data signal from the drain electrode 195. The pixel electrode PE to which the data voltage is applied generates an electric field together with the common electrode (not shown) facing the pixel electrode PE and to which the common voltage is applied, thereby interposing the pixel electrode PE between the pixel electrode PE and the common electrode. Positive and negatively charged pigment particles are driven.

결과적으로, 화소 전극(PE)의 제1 반사 전극층(171a)은 전기영동 표시장치의 배면에서 입사하는 광을 반사시키는 역할을 한다. 배면 입사광을 반사시키는 경우, 광이 미소캡슐(220)사이로 누설되어 전면에서 시인되지 않도록 차단하는 것이 가능하다. 화소 전극(PE)의 흡수 전극층(171b)은 전면에서 입사된 광의 경우, 전기영동 표시장치가 흰색을 표시하는 경우에는 광이 반사되더라도 휘도에 영향을 크게 주지 않지만, 전기영동 표시장치가 검은색을 표시하는 경우, 휘도를 감소시킬 수 있다. 흡수 전극층(171b)은 전면에서 입사하는 광을 흡수하여, 휘도를 향상시킬 수 있다. As a result, the first reflective electrode layer 171a of the pixel electrode PE reflects light incident from the rear surface of the electrophoretic display. When reflecting back incident light, it is possible to block the light from leaking between the microcapsules 220 and not being viewed from the front surface. The absorption electrode layer 171b of the pixel electrode PE does not significantly affect the luminance even when light is reflected when the electrophoretic display displays white light, but the electrophoretic display device is black. In the case of displaying, the luminance can be reduced. The absorbing electrode layer 171b may absorb light incident from the entire surface of the absorbing electrode layer 171b to improve luminance.

접촉 전극(198)은 접촉 구멍(148)을 통하여 게이트 배선(121)의 끝 부분(129)과 연결되며, 게이트 배선(121)의 끝 부분(129)과 외부 장치와의 접착성을 보완하고 이들을 보호한다.The contact electrode 198 is connected to the end portion 129 of the gate wiring 121 through the contact hole 148, and complements the adhesion between the end portion 129 of the gate wiring 121 and an external device and fixes them. Protect.

상부 개구부(144q)에는 유기 반도체층(154)이 형성된다. 유기 반도체층(154)은 상부 개구부(144q)에서 소스 전극(193) 및 드레인 전극(195)과 접촉되며 게이트 전극(123)과 중첩된다.The organic semiconductor layer 154 is formed in the upper opening 144q. The organic semiconductor layer 154 is in contact with the source electrode 193 and the drain electrode 195 in the upper opening 144q and overlaps the gate electrode 123.

유기 반도체층(154)은 수용액이나 유기 용매에 용해되는 고분자 화합물이나 저분자 화합물을 포함할 수 있다.The organic semiconductor layer 154 may include a high molecular compound or a low molecular compound dissolved in an aqueous solution or an organic solvent.

유기 반도체층(154)은 테트라센(tetracene) 또는 펜타센(pentacene)의 치환기를 포함하는 유도체를 포함할 수 있다. 유기 반도체층(154)은 또한 티오펜 링(thiophene ring)의 2, 5 위치에서 연결된 4 내지 8개의 티오펜을 포함하는 올리고티오펜(oligothiophene)을 포함할 수 있다.The organic semiconductor layer 154 may include a derivative including a substituent of tetratracene or pentacene. The organic semiconductor layer 154 may also include oligothiophenes comprising 4 to 8 thiophenes linked at the 2 and 5 positions of the thiophene ring.

유기 반도체층(154)은 폴리티닐렌비닐렌(polythienylenevinylene), 폴리-3-헥실티오펜(poly 3-hexylthiophene), 폴리티오펜(polythiophene), 프탈로시아닌(phthalocyanine), 금속화 프탈로시아닌(metallized phthalocyanine) 또는 그의 할로겐화 유도체를 포함할 수 있다. 유기 반도체층(154)은 또한 페릴렌테트라카르복실산 이무수물(perylenetetracarboxylic dianhydride, PTCDA), 나프탈렌테트라카르복실산 이무수물(naphthalenetetracarboxylic dianhydride, NTCDA) 또는 이들의 이미드(imide) 유도체를 포함할 수 있다. 유기 반도체층(154)은 페릴렌(perylene) 또는 코로넨(coronene)과 그들의 치환기를 포함하는 유도체를 포함할 수도 있다. The organic semiconductor layer 154 may be polythienylenevinylene, poly-3-hexylthiophene, polythiophene, phthalocyanine, metallized phthalocyanine, or Halogenated derivatives thereof. The organic semiconductor layer 154 may also include perylenetetracarboxylic dianhydride (PTCDA), naphthalenetetracarboxylic dianhydride (NTCDA), or imide derivatives thereof. . The organic semiconductor layer 154 may include a derivative including perylene or coronene and substituents thereof.

유기 반도체층(154)의 두께는 약 300Å 내지 1㎛ 정도이다.The thickness of the organic semiconductor layer 154 is about 300 mW to 1 m.

유기 박막 트랜지스터(OTFT)는 게이트 전극(123), 소스 전극(193) 및 드레인 전극(195)을 포함하며, 소스 전극(193)과 드레인 전극(195) 사이에 유기 반도체층(154)으로 형성된 채널부(channel)를 포함한다. 소스 전극(193)과 드레인 전극(195)의 마주하는 부분은 굴곡지게 형성함으로써 채널 폭을 놀려서 전류 특성을 개선할 수도 있다.The organic thin film transistor OTFT includes a gate electrode 123, a source electrode 193, and a drain electrode 195, and a channel formed of the organic semiconductor layer 154 between the source electrode 193 and the drain electrode 195. It includes a channel. The opposing portions of the source electrode 193 and the drain electrode 195 may be formed to bend, thereby making fun of the channel width to improve current characteristics.

유기 반도체층(154) 위에는 보호막(180)이 형성된다. 보호막(180)은 광을 차단하는 불투명한 유기 절연 물질 또는 무기 절연 물질로 형성한다. 보호막(180)은 제조 과정에서 유기 반도체층(154)의 손상되는 것을 방지한다. 보호막(180)을 불투명한 물질로 형성함에 따라서 유기 박막 트랜지스터(OTFT)의 채널부에 광이 들어가서 누설전류가 발생하는 것을 방지할 수 있다. The passivation layer 180 is formed on the organic semiconductor layer 154. The passivation layer 180 is formed of an opaque organic insulating material or an inorganic insulating material that blocks light. The passivation layer 180 prevents the organic semiconductor layer 154 from being damaged during the manufacturing process. As the passivation layer 180 is formed of an opaque material, light may enter the channel portion of the organic thin film transistor OTFT to prevent leakage current.

도 7은 본 발명의 제 3 실시예에 따른 표시 기판을 포함하는 전기영동 표시장치의 평면도이고, 도 8은 도 7에서 VI-VI' 선을 따라 잘라 도시한 단면도이다.FIG. 7 is a plan view of an electrophoretic display including a display substrate according to a third exemplary embodiment of the present invention, and FIG. 8 is a cross-sectional view taken along the line VI-VI 'of FIG. 7.

도 7 및 도 8을 참조하면, 표시 기판(100c)은 투명한 유리, 실리콘(silicone) 또는 플라스틱(plastic) 따위로 만들어진 절연 기판(substrate)(110) 위에 게이트 배선들(gate line)(121)이 형성된다. 게이트 배선(121)은 게이트 배선(121)으로부터 돌출된 게이트 전극(gate electrode)(123)과 다른 층 또는 외부 구동 회로와의 접속을 위한 넓은 끝 부분(129)을 포함한다. 게이트 배선(123)과 평행한 방향으로 스토리지 배선(127)이 형성된다. Referring to FIGS. 7 and 8, the display substrate 100c includes gate lines 121 formed on an insulating substrate 110 made of transparent glass, silicon, or plastic. Is formed. The gate wiring 121 includes a wide end portion 129 for connecting a gate electrode 123 protruding from the gate wiring 121 to another layer or an external driving circuit. The storage wiring 127 is formed in a direction parallel to the gate wiring 123.

게이트 배선들(121)은 비저항(resistivity)이 낮은 은(Ag) 또는 은 합금(Ag alloy) 또는 알루미늄(Al) 또는 알루미늄 합금(Al alloy), 구리 또는 구리합금으로 이루어진 단일막으로 이루어질 수도 있고, 이러한 단일막에 더하여 물리적, 전기적 접촉 특성이 좋은 크롬(Cr), 티타늄(Ti), 탄탈륨(Ta) 따위의 물질로 이루어진 다른 막을 포함하는 다층막으로 이루어질 수도 있다. The gate wirings 121 may be formed of a single film made of silver (Ag) or silver alloy (Ag) or aluminum (Al) or aluminum alloy (Al alloy), copper, or a copper alloy having low resistivity, In addition to such a single film, it may be made of a multilayer film including other films made of materials such as chromium (Cr), titanium (Ti), and tantalum (Ta) having good physical and electrical contact properties.

게이트 배선(121), 게이트 전극(123) 및 스토리지 배선(127) 위에는 질화 규소(SiNx) 등으로 이루어진 게이트 절연막(gate insulating layer)(130)이 형성된다. A gate insulating layer 130 made of silicon nitride (SiNx) or the like is formed on the gate wiring 121, the gate electrode 123, and the storage wiring 127.

게이트 절연막(130) 상부에는 수소화 비정질 규소(hydrogenated amorphous silicon) 따위로 이루어진 반도체층(silicon island)(150)이 형성된다. 반도체층(150)은 해당하는 게이트 전극(123) 위에 형성되어 박막 트랜지스터(TFT)의 채널부를 형성한다. 반도체층(150)의 상부에는 실리사이드(silicide) 또는 n형 불순물이 고농도로 도핑된 n+ 수소화 비정질 규소 따위로 만들어진 제1 저항성 접촉층(163) 및 제2 저항성 접촉층(165)이 형성된다. 제1 및 제2 저항성 접촉층(163, 165)은 게이트 전극(123)을 중심으로 서로 이격된다. A semiconductor island 150 made of hydrogenated amorphous silicon is formed on the gate insulating layer 130. The semiconductor layer 150 is formed on the corresponding gate electrode 123 to form a channel portion of the thin film transistor TFT. A first ohmic contact layer 163 and a second ohmic contact layer 165 made of n + hydrogenated amorphous silicon doped with silicide or n-type impurities at a high concentration are formed on the semiconductor layer 150. The first and second ohmic contacts 163 and 165 are spaced apart from each other with respect to the gate electrode 123.

제1 및 제2 저항성 접촉층(163, 165) 및 게이트 절연막(130) 위에는 데이터 배선들(data line)(172)과 박막 트랜지스터(TFT)의 드레인 전극(drain electrode)(175)이 형성된다. 데이터 배선(172)과 드레인 전극(175)은 비저항이 낮은 Al 또는 Ag 로 이루어질 수 있으며, 게이트 배선(121)과 같이 다른 물질과 접촉 특성이 우수한 도전 물질을 포함할 수 있다. 데이터 배선(172)은 게이트 배선(121)과 교차하는 방향으로 연장되고, 데이터 배선(172)으로부터 연장된 박막 트랜지스터(TFT)의 소스 전극(source electrode)(173)을 포함한다. 소스 전극(173)과 드레인 전극(175)은 해당하는 제1 및 제2 저항성 접촉층(163, 165)의 상부에 형성되고, 서로 마주보고 이격되어 형성된다. 또한, 데이터 배선(172)과 동일 금속층으로 스토리지 배선(127)과 중첩되는 스토리지 전극(177)이 형성된다.Data lines 172 and drain electrodes 175 of the thin film transistor TFT are formed on the first and second ohmic contacts 163 and 165 and the gate insulating layer 130. The data line 172 and the drain electrode 175 may be made of Al or Ag with low specific resistance, and may include a conductive material having excellent contact properties with other materials, such as the gate line 121. The data line 172 extends in a direction crossing the gate line 121 and includes a source electrode 173 of the thin film transistor TFT extending from the data line 172. The source electrode 173 and the drain electrode 175 are formed on the corresponding first and second ohmic contacts 163 and 165, and are spaced apart from each other. In addition, the storage electrode 177 overlapping the storage wiring 127 is formed of the same metal layer as the data wiring 172.

데이터 배선(172), 소스 전극(173), 드레인 전극(175) 및 스토리지 전극(177)이 형성된 절연 기판(110)의 위에는 반도체층(150)을 보호하기 위한 패시베이션층(140)이 형성된다. 패시베이션층(140) 위에는 광을 흡수하는 유기 물질로 이루어진 불투명한 유기막(181)이 형성된다. 불투명한 유기막(181)은 블랙 물질 또는 백색 물질로 약 3㎛ 내지 4㎛ 정도의 두께로 형성된다. The passivation layer 140 for protecting the semiconductor layer 150 is formed on the insulating substrate 110 on which the data line 172, the source electrode 173, the drain electrode 175, and the storage electrode 177 are formed. An opaque organic film 181 made of an organic material absorbing light is formed on the passivation layer 140. The opaque organic layer 181 is formed of a black material or a white material to a thickness of about 3 μm to 4 μm.

불투명한 유기막(181)은 전기영동 표시장치의 전기영동 입자들 사이로 광이 누설되면 누설된 광을 흡수한다. 이에 따라서, 누설된 광이 표시 기판(100c) 상에서 반사되거나 산란되는 것을 막아 휘도를 향상시킬 수 있다. 즉, 대비비(Contrast Ratio)의 저하를 막을 수 있다. 또한, 불투명한 유기막(181)이 박막 트랜지스터(TFT)의 채널부를 커버함으로써 누설광에 의한 박막 트랜지스터(TFT)의 누설전류를 방지할 수 있다.The opaque organic layer 181 absorbs the leaked light when the light leaks between the electrophoretic particles of the electrophoretic display device. Accordingly, the leaked light may be prevented from being reflected or scattered on the display substrate 100c, thereby improving luminance. That is, the lowering of the contrast ratio can be prevented. In addition, since the opaque organic film 181 covers the channel portion of the thin film transistor TFT, leakage current of the thin film transistor TFT due to leakage light can be prevented.

패시베이션층(140)과 불투명한 유기막(181)에는 제1, 제2 및 제3 접촉 구멍(185, 188, 189)이 형성된다. 제1 접촉 구멍(185)은 박막 트랜지스터(TFT)의 드레인 전극(175)을 드러내고, 제2 접촉 구멍(188)은 게이트 배선(121)의 끝 부분(129)을 드러내며, 제3 접촉 구멍(189)은 데이터 배선(172)의 끝 부분(179)을 드러낸다. First, second, and third contact holes 185, 188, and 189 are formed in the passivation layer 140 and the opaque organic layer 181. The first contact hole 185 exposes the drain electrode 175 of the TFT, the second contact hole 188 exposes the end portion 129 of the gate wiring 121, and the third contact hole 189. ) Exposes the end portion 179 of the data line 172.

제1, 제2 및 제3 접촉 구멍(185, 188, 189)이 형성된 불투명한 유기막(181) 위에 투명 도전성 물질로 화소 전극(191), 제1 접촉 전극(198) 및 제2 접촉 전극(199)을 형성한다. The pixel electrode 191, the first contact electrode 198, and the second contact electrode (eg, a transparent conductive material) are formed on the opaque organic layer 181 on which the first, second, and third contact holes 185, 188, and 189 are formed. 199).

도 9a 및 도 9b는 도 8에 도시한 표시 기판의 제1 실시예에 따른 제조 공정 도들이다. 9A and 9B are diagrams illustrating manufacturing processes of the first exemplary embodiment of the display substrate illustrated in FIG. 8.

도 8 및 도 9a를 참조하면, 절연 기판(110) 위에 박막 트랜지스터(TFT)를 포함하는 박막 트랜지스터층(TL)을 형성한다. 박막 트랜지스터층(TL) 상에 패시베이션층(140)을 형성한다. 패시베이션층(140) 위에 제1 포토마스크(410)를 형성한다. 제1 포토마스크(410)는 제1, 제2 및 제3 접촉 구멍(185, 188, 189)에 대응하여 제1 및 제2 및 제3 투과부(415, 418, 419)를 포함한다. 8 and 9A, the thin film transistor layer TL including the thin film transistor TFT is formed on the insulating substrate 110. The passivation layer 140 is formed on the thin film transistor layer TL. The first photomask 410 is formed on the passivation layer 140. The first photomask 410 includes first and second and third transmission portions 415, 418, and 419 corresponding to the first, second, and third contact holes 185, 188, and 189.

제1 포토마스크(410)를 이용해 패시베이션층(140)을 식각하여 패시베이션층(140)에 제1, 제2 및 제3 홀(H1, H2, H3)을 형성한다. The passivation layer 140 is etched using the first photomask 410 to form first, second, and third holes H1, H2, and H3 in the passivation layer 140.

도 8 및 도 9b를 참조하면, 제1, 제2 및 제3 홀(H1, H2, H3)이 형성된 절연 기판(110) 위에 불투명한 유기막(181)을 약 5000Å 내지 4㎛ 정도의 두께로 형성한다. 불투명한 유기막(181) 위에 제2 포토마스크(420)를 형성한다. 제2 포토마스크(420)는 역시 제1, 제2 및 제3 접촉 구멍(185, 188, 189)에 대응하여 제1 및 제2 및 제3 투과부(425, 428, 429)를 포함한다. 제2 포토마스크(420)를 이용해 불투명한 유기막(181)을 식각하여 드레인 전극(175), 게이트 배선의 끝 부분(128) 및 데이터 배선의 끝 부분(179)을 노출시키는 제1, 제2 및 제3 접촉 구멍(185, 188, 189)을 형성한다. 8 and 9B, an opaque organic film 181 is formed on the insulating substrate 110 on which the first, second, and third holes H1, H2, and H3 are formed to have a thickness of about 5000 μm to 4 μm. Form. The second photomask 420 is formed on the opaque organic layer 181. The second photomask 420 also includes first and second and third transmission portions 425, 428, 429 corresponding to the first, second and third contact holes 185, 188, 189. First and second portions of the opaque organic layer 181 may be etched using the second photomask 420 to expose the drain electrode 175, the end portion 128 of the gate line, and the end portion 179 of the data line. And third contact holes 185, 188, 189.

제1, 제2 및 제3 접촉 구멍(185, 188, 189)이 형성된 절연 기판(110) 상에 투명 도전성 물질을 도포 및 패터닝하여 화소 전극(191), 제1 접촉 전극(198) 및 제2 접촉 전극(199)을 형성한다. The pixel electrode 191, the first contact electrode 198, and the second electrode may be coated and patterned on the insulating substrate 110 on which the first, second, and third contact holes 185, 188, and 189 are formed. The contact electrode 199 is formed.

도 10a 및 도 10b는 도 8에 도시한 표시 기판의 제2 실시예에 따른 제조 공 정도들이다. 10A and 10B illustrate manufacturing holes according to the second embodiment of the display substrate illustrated in FIG. 8.

도 8 및 도 10a를 참조하면, 박막 트랜지스터층(TL)이 형성된 절연 기판(110) 위에 패시베이션층(140) 및 불투명한 유기막(181)을 순차적으로 형성한다. 8 and 10A, the passivation layer 140 and the opaque organic layer 181 are sequentially formed on the insulating substrate 110 on which the thin film transistor layer TL is formed.

불투명한 유기막(181) 위에 제1 포토마스크(430)를 형성한다. 제1 포토마스크(430)는 제1, 제2 및 제3 접촉 구멍(185, 188, 189)에 대응하는 제1 및 제2 및 제3 투과부(435, 438, 439)를 포함한다. The first photomask 430 is formed on the opaque organic layer 181. The first photomask 430 includes first and second and third transmission portions 435, 438, and 439 corresponding to the first, second, and third contact holes 185, 188, and 189.

제1 포토마스크(430)를 이용해 불투명한 유기막(181)을 식각하여 불투명한 유기막(181)에 제1, 제2 및 제3 홀(H1, H2, H3)을 형성한다. The opaque organic layer 181 is etched using the first photomask 430 to form first, second and third holes H1, H2, and H3 in the opaque organic layer 181.

도 8 및 도 10b를 참조하면, 제1, 제2 및 제3 홀(H1, H2, H3)이 형성된 불투명한 유기막(181) 위에 노출된 패시베이션층(140)을 제거하기 위한 제2 포토마스크(440)를 형성한다. 제2 포토마스크(440)는 제1, 제2 및 제3 홀(H1, H2, H3)에 대응하는 제1 및 제2 및 제3 투과부(445, 448, 449)를 포함한다. 8 and 10B, a second photomask for removing the passivation layer 140 exposed on the opaque organic layer 181 having the first, second, and third holes H1, H2, and H3 formed therein. 440 is formed. The second photomask 440 includes first, second, and third transmission parts 445, 448, and 449 corresponding to the first, second, and third holes H1, H2, and H3.

제2 포토마스크(440)를 이용해 패시베이션층(140)을 제거하여 제1, 제2 및 제3 접촉 구멍(185, 188, 189)을 형성한다. The passivation layer 140 is removed using the second photomask 440 to form first, second, and third contact holes 185, 188, and 189.

도 11a 및 도 11b는 도 8에 도시한 표시 기판의 제3 실시예에 따른 제조 공정도들이다. 11A and 11B illustrate manufacturing process diagrams according to a third exemplary embodiment of the display substrate illustrated in FIG. 8.

도 8 및 도 11a를 참조하면, 박막 트랜지스터층(TL)이 형성된 절연 기판(110) 위에 패시베이션층(140) 및 불투명한 유기막(181)을 순차적으로 형성한다. 8 and 11A, the passivation layer 140 and the opaque organic layer 181 are sequentially formed on the insulating substrate 110 on which the thin film transistor layer TL is formed.

불투명한 유기막(181) 위에 제1 포토마스크(450)를 형성한다. 제1 포토마스크(450)는 제1, 제2 및 제3 접촉 구멍(185, 188, 189)에 대응하는 제1 및 제2 및 제3 투과부(455, 458, 459)를 포함한다. The first photomask 450 is formed on the opaque organic layer 181. The first photomask 450 includes first and second and third transmission portions 455, 458, and 459 corresponding to the first, second, and third contact holes 185, 188, and 189.

제1 포토마스크(450)를 이용해 불투명한 유기막(181)을 식각하여 불투명한 유기막(181)에 제1, 제2 및 제3 홀(H1, H2, H3)을 형성한다. The opaque organic layer 181 is etched using the first photomask 450 to form first, second and third holes H1, H2, and H3 in the opaque organic layer 181.

도 11b를 참조하면, 제1, 제2 및 제3 홀(H1, H2, H3)이 형성된 불투명한 유기막(181)을 마스크로 하여 노출된 패시베이션층(140)을 제거한다. 이에 따라서, 제1, 제2 및 제3 접촉 구멍(185, 188, 189)을 형성한다. Referring to FIG. 11B, the exposed passivation layer 140 is removed using the opaque organic layer 181 having the first, second, and third holes H1, H2, and H3 formed thereon as a mask. Accordingly, first, second and third contact holes 185, 188 and 189 are formed.

제3 실시예에 따른 제조 공정에 의하면, 제1 및 제2 실시예에 따른 제조 공정에 비해 마스크의 개수를 줄일 수 있다. According to the manufacturing process according to the third embodiment, the number of masks can be reduced as compared with the manufacturing process according to the first and second embodiments.

이상에서 상세하게 설명한 바와 같이 본 발명에 따르면, 불투명한 화소 전극 및 불투명한 물질로 박막 트랜지스터층을 커버하는 보호막을 형성함으로써 누설광에 의한 휘도 저하를 방지할 수 있고, 또한, 누설광에 의한 박막 트랜지스터의 누설 전류를 방지할 수 있다. As described in detail above, according to the present invention, by forming a protective film covering the thin film transistor layer with an opaque pixel electrode and an opaque material, it is possible to prevent a decrease in luminance due to leakage light, and furthermore, a thin film due to leakage light. The leakage current of the transistor can be prevented.

구체적으로, 첫째 반사 전극층과 흡수 전극층을 포함하는 화소 전극을 박막 트랜지스터의 채널부를 덮도록 형성함으로써 전면 및 배면에서 입사된 광을 완전히 차단할 수 있다. 둘째, 박막 트랜지스터층 상에 불투명한 재질의 보호막을 형성함으로써 입사된 광이 반사 및 산란을 막을 수 있다. 이에 따라서, 휘도 저하 및 박막 트랜지스터의 누설 전류를 방지할 수 있다. In detail, first, the pixel electrode including the reflective electrode layer and the absorption electrode layer may be formed to cover the channel portion of the thin film transistor to completely block light incident from the front and rear surfaces thereof. Second, incident light can prevent reflection and scattering by forming a protective film of an opaque material on the thin film transistor layer. As a result, it is possible to prevent a decrease in luminance and a leakage current of the thin film transistor.

이러한 본 발명의 실시예에 따른 표시 기판 및 이를 포함하는 전기영동 표시장치는 이외에도 여러 가지 변형된 형태를 가질 수 있다.The display substrate and the electrophoretic display including the same according to the exemplary embodiment of the present invention may have various modified forms.

이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.Although the preferred embodiments of the present invention have been described in detail above, the scope of the present invention is not limited thereto, and various modifications and improvements of those skilled in the art using the basic concepts of the present invention defined in the following claims are also provided. It belongs to the scope of right.

Claims (30)

절연 기판 상에 형성된 게이트 배선;A gate wiring formed on an insulating substrate; 상기 게이트 배선과 교차하는 방향으로 연장된 데이터 배선;A data line extending in a direction crossing the gate line; 상기 게이트 배선과 데이터 배선에 연결된 스위칭 소자; 및 A switching element connected to the gate line and the data line; And 상기 스위칭 소자와 전기적으로 연결되어, 광을 반사하는 반사 전극층과 광을 흡수하는 불투명한 물질로 형성된 흡수 전극층을 포함하는 화소 전극을 포함하는 것을 특징으로 하는 전기영동 표시장치용 표시 기판. And a pixel electrode electrically connected to the switching element, the pixel electrode including a reflective electrode layer reflecting light and an absorption electrode layer formed of an opaque material absorbing light. 제1항에 있어서, 상기 반사 전극층은 크롬(Cr) 또는 몰리(Mo)로 이루어진 것을 특징으로 하는 전기영동 표시장치용 표시 기판.The display substrate of claim 1, wherein the reflective electrode layer is made of chromium (Cr) or molybdenum (Mo). 제1항에 있어서, 상기 흡수 전극층의 광학밀도(Optical Density)는 3.6 이상인 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 1, wherein an optical density of the absorbing electrode layer is 3.6 or more. 제3항에 있어서, 상기 흡수 전극층은 크롬 산화물(CrOx) 또는 몰리 산화물(MoOx)로 이루어진 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 3, wherein the absorption electrode layer is formed of chromium oxide (CrOx) or molybdenum oxide (MoOx). 제1항에 있어서, 상기 스위칭 소자는 반도체층으로 형성된 채널부를 포함하는 전기영동 표시장치용 표시기판. The display substrate of claim 1, wherein the switching element comprises a channel portion formed of a semiconductor layer. 제5항에 있어서, 상기 화소 전극은 상기 채널부를 덮도록 상기 스위칭 소자 위에 형성된 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 5, wherein the pixel electrode is formed on the switching element to cover the channel portion. 제6항에 있어서, 상기 반사 전극층은 상기 스위칭 소자와 직접 연결되고, 상기 흡수 전극층은 상기 반사 전극층 위에 형성된 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 6, wherein the reflective electrode layer is directly connected to the switching element, and the absorption electrode layer is formed on the reflective electrode layer. 제1항에 있어서, 상기 스위칭 소자는 유기 반도체층으로 형성된 채널부를 포함하는 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 1, wherein the switching element comprises a channel portion formed of an organic semiconductor layer. 제8항에 있어서, 상기 유기 반도체층을 덮도록 형성된 보호막을 더 포함하는 전기영동 표시장치용 표시 기판. The display substrate of claim 8, further comprising a passivation layer formed to cover the organic semiconductor layer. 제9항에 있어서, 상기 보호막은 불투명한 유기 절연 물질로 이루어진 것을 특징으로 하는 전기영동 표시장치용 표시 기판.The display substrate of claim 9, wherein the passivation layer is made of an opaque organic insulating material. 제8항에 있어서, 상기 화소 전극은 투명 도전성 물질로 형성된 투명 전극층을 더 포함하는 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 8, wherein the pixel electrode further comprises a transparent electrode layer formed of a transparent conductive material. 제11항에 있어서, 상기 투명 전극층은 상기 스위칭 소자와 직접 연결되고 상기 반사 전극층은 상기 투명 전극층 위에 형성되고, 상기 흡수 전극층은 상기 반사 전극층 위에 형성된 것을 특징으로 하는 전기영동 표시장치용 표시 기판. The display substrate of claim 11, wherein the transparent electrode layer is directly connected to the switching element, the reflective electrode layer is formed on the transparent electrode layer, and the absorption electrode layer is formed on the reflective electrode layer. 삭제delete 삭제delete 삭제delete 삭제delete 서로 교차하는 방향으로 형성된 게이트 배선과 데이터 배선에 연결된 스위칭 소자, 상기 스위칭 소자와 전기적으로 연결되어 광을 반사하는 반사 전극층과 광을 흡수하는 불투명한 물질로 형성된 흡수 전극층을 포함하는 화소 전극을 포함하는 표시 기판;And a pixel electrode including a switching element connected to a gate line and a data line formed in a direction crossing each other, a reflective electrode layer electrically connected to the switching element to reflect light, and an absorption electrode layer formed of an opaque material to absorb light. Display substrates; 상기 표시 기판과 결합하는 대향 기판; 및 An opposite substrate coupled to the display substrate; And 상기 표시 기판과 대향 기판 사이에 개재된 전기영동 입자들을 포함하는 전기영동 표시장치. An electrophoretic display device comprising electrophoretic particles interposed between the display substrate and the opposite substrate. 제17항에 있어서, 상기 대향 기판은 상기 화소 전극과 대향하는 공통 전극을 더 포함하는 전기영동 표시장치.The electrophoretic display of claim 17, wherein the opposing substrate further comprises a common electrode facing the pixel electrode. 제17항에 있어서, 상기 반사 전극층은 크롬(Cr) 또는 몰리(Mo)로 이루어진 것을 특징으로 하는 전기영동 표시장치.18. The electrophoretic display of claim 17, wherein the reflective electrode layer is made of chromium (Cr) or molybdenum (Mo). 제17항에 있어서, 상기 흡수 전극층의 광학밀도(Optical Density)는 3.6 이상인 것을 특징으로 하는 전기영동 표시장치. 18. The electrophoretic display of claim 17, wherein an optical density of the absorbing electrode layer is 3.6 or more. 제20항에 있어서, 상기 흡수 전극층은 크롬 산화물(CrOx) 또는 몰리 산화물(MoOx)로 이루어진 것을 특징으로 하는 전기영동 표시장치. 21. The electrophoretic display of claim 20, wherein the absorption electrode layer is made of chromium oxide (CrOx) or molybdenum oxide (MoOx). 제17항에 있어서, 상기 스위칭 소자는 반도체층으로 형성된 채널부를 포함하는 전기영동 표시장치. 18. The electrophoretic display of claim 17, wherein the switching element comprises a channel portion formed of a semiconductor layer. 제22항에 있어서, 상기 화소 전극은 상기 채널부를 덮도록 상기 스위칭 소자 위에 형성된 것을 특징으로 하는 전기영동 표시장치. The electrophoretic display of claim 22, wherein the pixel electrode is formed on the switching element to cover the channel portion. 제17항에 있어서, 상기 스위칭 소자는 유기 반도체층으로 형성된 채널부를 포함하는 것을 특징으로 하는 전기영동 표시장치. 18. The electrophoretic display of claim 17, wherein the switching element comprises a channel portion formed of an organic semiconductor layer. 제24항에 있어서, 상기 유기 반도체층을 덮는 불투명한 유기 절연 물질로 형성된 보호막을 더 포함하는 전기영동 표시장치. 25. The electrophoretic display of claim 24, further comprising a protective film formed of an opaque organic insulating material covering the organic semiconductor layer. 제24항에 있어서, 상기 화소 전극은 투명 도전성 물질로 형성된 투명 전극층을 더 포함하는 것을 특징으로 하는 전기영동 표시장치. The electrophoretic display of claim 24, wherein the pixel electrode further comprises a transparent electrode layer formed of a transparent conductive material. 삭제delete 삭제delete 삭제delete 삭제delete
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