KR0134309B1 - 디지탈 주파수 자동조절회로 - Google Patents

디지탈 주파수 자동조절회로

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KR0134309B1
KR0134309B1 KR1019940004803A KR19940004803A KR0134309B1 KR 0134309 B1 KR0134309 B1 KR 0134309B1 KR 1019940004803 A KR1019940004803 A KR 1019940004803A KR 19940004803 A KR19940004803 A KR 19940004803A KR 0134309 B1 KR0134309 B1 KR 0134309B1
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Abstract

본 발명은 위상검출에 의한 별도의 비교주파수를 발전시키기 위해 전압제어발진기를 사용하지 않더라도 수평동기신호에 동기된 주파수신호를 발생시킬 수 있도록 한 디지탈 주파수 자동조절회로에 관한 것이다. 이러한 본 발명은 매 라인마다 검출된 캐리어주푸수의 위상값을 한 라인전의 위상값과 비교하여 그 차이값인 위상에러값을 구하는 위상에러 연산부를 구비한다. 상기 위상에러값은 누적연산된 후 발진스텝 보정부로 인가되고, 여기서 기본발진스텝에 상기 위상에러 누적값에 해당하는 보정스텝이 더해져 최종발진스텝이 출력된다. 캐리어발생부는 상기 최종발진스텝의 누적값을 어드레스로 입력받아 사인파형의 함수값을 출력함으로써 다양한 주파수의 캐리어신호를 발생시킨다. 따라서, 디지탈 영상신호처리장치에 적합하게 규모가 작고 간단하면서도 우수한 성능의 주파수 자동조절회로를 얻을수 있다.

Description

디지탈 주파수 자동조절회로
제1도는 종래의 위상동기루프회로를 이용한 주파수 자동조절회로의 블럭구성도.
제2도는 본 발명의 디지탈 주파수 자동조절회로의 블럭구성도.
제3도는 디지탈 수평동기신호의 검출과 에러의 발생을 설명하기 위한 신호파형도.
* 도면의 주요부분에 대한 부호의 설명
10 : 수평동기신호 분리부 30 : 전압제어발진기
40,50 : 분주회로 100 : 위상에러 연산부
101,104 : 위상보정부 200 : 위상에러 누적부
102,103,107,202,402 : 위상저장부 105 : 위상이동부
106,201,303,401 : 연산부 300 : 발진스텝 보정부
301 : 보정스텝 발생부 302 : 기본스텝 발생부
400 : 어드레스 발생부 500 : 캐리어발생부
본 발명은 디지탈 영상신호처리장치에 적용할 수 있는 주파수 자동조절회로에 관한 것으로, 특히 위상동기루프(Phase Locked Loop)회로를 이용하여 별도의 비교주파수를 발진시키지 않더라도 수평동기신호에 동기된 주파수신호를 발생시킬 수 있도록 한 디지탈 주파수 자동조절회로에 관한 것이다.
일반적으로 영상신호처리장치, 예를들어 비디오테이프레코더에서 반송색신호는 기록시에 저역주파수(VHS방식 : 40fh, 629KHz, 8mm발식 : 40,25Fh, 743KHz)로 변환된 상태로 테이프에 기록된다. 이때 반송색신호를 저역주파수로 변환하기 위해서는 저역캐리어주파수신호를 필요로 하게 되고, 이 저역태리어주파수신호는 수평동기신호와 위상동기를 맞추어야 한다. 즉, 각 라인마다 정확하게 47.25주기(8mm방식) 또는 40주기(VHS방식)를 갖는 주파수신호를 발진시켜야 하는 것이다.
아날로그 영상신호처리장치에서 수평동기신호에 동기된 주파수신호를 발생시키기 위한 회로는 제1도에 도시된 바와 같이 위상동기루프회로를 이용하여 구성하였다. 제1도에서 수평동기신호 분리부(10)는 입력되는 휘도신호로부터 수평동기신호(FH)와 제2분주회로(50)로부터 궤환된 분주신호(Fh)의 위상을 비교하여 두신호의 위상차이를 검출한다. 상기 위상비교기(20)에서 출력된 두 신호의 위상차이에 대한 신호(dc)는 전압 제어발진기(30)에 제어전압으로서 인가되고, 전압제어발진기(30)는 이 제어전압에 따라 발진주파수가 달라지게 된다. 전압제어발진기(30)의 위상비교기(20)사이에는 제1 및 제2분주회로(40)(50)가 연결되는데, 제1분주회로(40)는 전압제어발진기(30)의 출력신호(160Fh)를 1/4배로 분주하여 저역캐리어주파수신호(40Fh)를 출력하게 되고, 상기 제1분주회로(40)의 출력신호(40Fh)는 제2분주회로(50)로 인가된다. 상기 제2분주회로(50)는 제1분주호로(40)의 출력신호를 다시 1/4배로 분주하여 수평동기신호와 같은 주파수의 신호(Fh)를 상기 위상비교(20)로 궤환시킨다.
이와 같이 구성된 종래의 주파수 자동조절회로의 동작을 VHS 회로의 예를들어 설명하면 다음과 같다.
휘도신호가 수평동기신호 분리부(10)로 입력되면, 이 수평동기신호 분리부(10)는 입력신호에서 수평동기신호(FH)만을 분리하여 위상비교기(20)로 출력하고, 이때 위상비교기(20)에는 상기 수평동기신호(FH)외에도 제1분주회로(50)로부터 궤환된 신호(Fh)가 입력된다. 여기서, 상기 궤환신호(Fh)는 전압제어발진기(30)의 출력신호(160Fh)의 주파수를 1/160배로 분주한 신호로서, 상기 수평동기신호(FH)와 동일한 주파수를 갖는다. 위상비교기(20)는 입력되는 두 신호(FH)(Fh)의 위상 및 주파수차이를 검출하여 제어전압(dc)을 전압제어발진기(30)로 출력하고, 수평동기신호(FH)와 궤환신호(Fh)의 위상이 같으면 상기 제어전압(dc)은 0이 된다. 수평동기신호(FH)와 궤환신호(Fh)의 위상차이에 따라 전압제어발진기(30)에는 직류전압(dc)이 인가되는데, 전압제어발진기(30)는 이 직류전압(dc)에 비례하여 발진주파수, 즉 출력번호(160Fh)의 주파수를 가변시켜 전압제어발진기(30)와 제1 및 제2분주회로(40)(50)의 출력주파수를 수평동기신호(FH)에 동기화시킨다.
전압제어발진기(30)에서 출력된 신호(160Fh)는 제1 및 제2분주회로(40)(50)에 의해 낮은 주파수로 변환되는데, 제1분주회로(40)는 입력신호(160Fh)의 주사수를 1/4배로 분조하여 휘도신호로부터 분리된 수평동기신호(FH)에 항상 동기된 저역캐리어주파수신호(40Fh)를 발생시킨다. 제1분주회로(40)에서 출력된 저역캐리어주파수신호(40Fh)는 제2분주회로(50)로 인가되어 1/40배로 분주되고, 제2분주회로(50)에서 출력된 신호(Fh)는 다시 위상비교기(20)로 궤환되어 동이랗ㄴ 주파수의 수평동기신호(FH)와 위상비교됨으로써 상기 수평동기신호(FH)에 동기된 주파수신호를 얻을 수 있게 된다.
이와 같이 종래의 아날로그 회로에서는 전압제어발진기를 사용하여 높은 주파수신호를 발진시키고, 그 발진신호를 다시 낮은 주파수의 신호로 변환하여 원하는 주파수의 신호를 얻었다. 그러나 디지탈 회로에서는 상기와 같은 방식을 적용하기 어려운 단점이 있으므로 전압제어발진기를 사용할 수도 없고, 이로인해 높은 주파수의 신호를 발생시키는 데에도 어려움이 있었다. 특히, 근래에슨 비디오테이프레코더의 신호처리방식이 아날로그방식에서 디지탈방식으로 변환되고 있다. 이와 같이 디지탈방식으로 색신호를 처리하는 경우 기존의 아날로그방식과 같은 알고리즘을 사용하면 회로의 규모가 지나치게 커지는 문제점이 생긴다.
본 발명은 상기와 같은 종래의 문제점을 해결하기 위한 것으로, 본 발명의 목적은 디지탈 영상신호처리장치에 적용할 수 있는 규모가 작고 간단한 구성의 주파수 자동조절회로를 제공하는데 있다.
본 발명의 다른 목적은 위상검출에 의한 별도의 비교주파수를 발전시키기 위해 전압제어발진기를 사용하지 않더라도 수평동기신호에 동기된 주파수신호를 발생시킬 수 있도록 한 디지탈 주파수 자동조절회로를 제공하는데 있다.
상기와 같은 목적물을 달성하기 위해 본 발명의 디지탈 주파수 자동조절회로는 매라인마다 발생된 캐리어 주파수의 위상을 위상을 검출하여 한 라인전의 위상값과 비교하고 두 라인의 위상차를 검출하여 위상에러값을 구하는 위상에러 연산부를 구비한다. 위상에러 연산부에서 출력된 위상에러값은 위상에러 누적부로 인가되고, 이 위상에러 누적부는 현재 검출된 위상에러값에 한 라인전까지의 위상에러 누적부를 더하여 새로운 위상에러 누적값을 출력한다. 위상에러 누적부의 출력단에 연결된 발진스탭 보정부는 상기 위상에러 누적값에 해당하는 보정스탭을 발생시켜 기본발진스탭에 더함으로써 보정된 최종발진스탭을 출력한다. 발진스탭 보정부에서 출력된 최종발진스탭은 어드레스 발생부로 인가되고, 이 어드레스 발생부는 입력된 최종발진스탭을 매 클럭이 입력될때마다 누적연산하여 룩업테이블(Look-up Table)에 인가할 어드레스신호를 발생시킨다. 어드레스 발생부의 출력단에 연결된 캐리어발생부는 입력어드레스에 따라 사인파형의 함수값을 출력하여 다양한 주파수의 캐이어신호를 발생시킨다.
이하, 첨부된 제2도 및 제3도를 참조하여 본 발명의 실시예를 상세히 설명하면 다음과 같다.
제2도의 디지탈 영상신호처리장치에 적용할 수 있는 본 발명의 주파수 자동조절회로의 구성을 나타낸 블럭도이다. 도시된 바와 같이, 본 발명은 매 라인마다 발생의 주파수 위상을 검출하여 한 라인전의 위상값과 비교함으로서 위상에러값을 검출하는 위상에러 연산부(100)를 구비한다. 위상에러 연산부(100)에서 출력된 위상에러값은 위상에서 누적부(200)로 인가되고, 상기 위상에러 누적값을 출력한다. 위상에러 주적부(200)의 출력단에 연결된 발진스텝 보정부(300)는 누적된 주파수 위상에러값에 해당하는 보정스텝을 발생시켜 기본발진스텝에 더함으로써 보정된 최종발진스텝을 출력한다. 발진스텝 보정부(300)에서 출력된 최종발진스텝은 어드레스 발생부(400)로 인가되고, 상기 어드레스 발생부(400)는 입력된 최종발진스텝을 매클럭이 입력될때마다 누적연산하여 룩업테이블에 인가할 어드레스신호를 발생시킨다. 어드레스 발생부(400)의 출력단에 연결된 캐리어발생부(500)는 입력어드레스(위상값)에 따라 사인(또는 코사인)파형의 함수값을 출력하여 다양한 주파수의 캐리어신호를 발생시킨다.
상기와 같이 구성된 디지탈 주파수 자동조절회로의 상세구성 및 동작을 설명하면 다음과 같다.
먼저, 기본동작원리에 설명하면, 이상적인 저역캐리어주파수신호는 매라인(1H)마다 90°씩의 위상차를 갖게 된다. 즉, 8mm방식의 경우 47.25주기에서 각 라인마다 1/4주기(90°)만큼씩의 위상지연이 발생하게 되어 결국 4개의 라인마다 동위상의 저역캐리어주파수신호가 발생하게 된다. VHS방식일 경우에는 40주기, 즉 40Fh이므로 라인간의 위상차는 0이다. 그러므로 어느 한 라인과 그다음 라인의 동일위치에서 검출된 저역캐리어주파수신호의 위상을 비교하여 두 위상값의 차이를 구하면 위상에러의 검출이 가능하고, 검출된 위상에러 만큼 저역캐리어주파수신호의 발진을 조절하면 이상적인 값에 접근된 저역캐리어주파수신호를 발생시킬 수 있게 된다.
제2도에서 첫번째 블럭인 위상에러 연산부(100)는 매 라인마다 발생된 주파수의 위상을 검출하여 한 라인전의 위상값과 비교하고, 두 라인의 위상차를 검출하여 위상에러값을 구한다. 이때 캐리어발생부(500)에서 발생된 캐리어주파수의 위상은 디지탈 수평동기신호에 의해 검출되고, 디지탈 수평동기신호는 ±0.5클럭의 에러를 갖는다. 이를 좀더 상세히 설명하며, 디지탈 수평동기신호 에러값(Herr)이란 아날로그 수평동기신호(제3도의 (E)참조)와 소정주파수의 클럭(제3도의 (C)참조)에 의해 샘플링된 디지탈 수평동기신호(제3도의 (D)참조)와의 오차를 보정용 데이타로서 만든 것으로, 그 원리를 제3도에 나타내었다.
아날로그신호를 디지탈신호(이산신호)로 변환하는데 있어서 샘플링은 필수적이고, 소정주파수의 샘플링클럭에 의해 샘플링이 이루어지는 과정에서 샘플과 샘플사이의 값은 무시되어진다. 이것은 일반데이터상에서는 문제가 되지 않지만, 기준신호가 되는 동기신호의 샘플링에 있어서는 수평동기신호는 1클럭의 오차에 대해서도 매우 민감하게 동작하므로 샘플과 샘플사이에 존재하는 실제의 아날로그 수평동기신호와 디지탈 수평독기신호와의 오차값은 중요한 정보가 된다. 디지탈회로에서는 샐플링된 데이타에 의해 신호처리가 이루어지므로 위상에러의 발생은 필연적이다. 이때 위상에러를 무시하고 디지탈 수평동기신호를 데이타처리시의 기준신호로 삼게 되면, 그에 따라 발생되는 오차를 감수해야 하므로 회로의 동작이 정확하게 행히지지 않고, 성능에 상당한 악영향을 주게 된다.
제3도에서 휘도신호(A)중 수평동기신호(B)의 경사부분이 선형적이라고 가정하고, 수평동기신호 분리기준값(SL)과 그 전후의 두 샘플데이타(S1,S2)를 이용하여 디지탈 수평동기신호 에러값(Herr)을 구할 수 있다. 샘플간의 차이값(S1-S2)이 한 주기(T)에 해당하므로 수평동기신호 분리기준값(SL)과 샘플데이타(S2)와의 차(SL-S2)는 디지탈 수평동기신호 에러값(Herr)에 비례하게 된다.
T : S1-S2-Herr : SL-S2
Herr=[(SL-S2)/(S1-S2)]×T
제2도에서 제1위상보정부(101)는 상기 디지탈 수평동기신호의 에러를 보정해 주기 위한 블럭으로, 후단의 어드레스 발생부(400)로부터 궤환된 어드레스, 즉 캐리어발생부(500)에서 발생된 주파수의 위상값에 상기식에 의해 계산된 디지탈 수평독기신호 에러값(Herr)을 더하여 보정된 위상값을 출력한다. 상기 제1위상보정부(101)에서 출력된 위상값은 제1위상보정부(102)에 저장되고, 제1위상보정부(102)에서 출력된 위상값은 다시 제2위상보정부(103)와 위상이동부(105)로 각각 인가된다. 즉, 제1위상보정부(102)에는 현재 검출된 위상값이 저장되고, 제2위상보정부(103)에는 한 라인전에 검출된 위상값이 저장되는 것이다.
제2위상보정부(103)에서 출력된 한 라인전의 위상값은 제2위상보정부(104)로 입력된다. 제2위상보정부(104)는 라인간의 위상지연(90°)을 제거해 주기 위한 블럭으로, 입력된 한 라인전의 위상값에 지연된 위상값(K), 즉 2n/4(n은 룩업테이블의 어드레스비트수)를 더하여 보정된 한 라인전의 위상값을 위상이동부(105)로 출력한다. 위상이동부(105)에서는 제1위상보정부(102)와 제2위상보정부(104)에서 출력된 두 라인의 위상데이타가 어드레스 양끝에 걸칠 경우에 상기 두 라인의 위상데이타를 비교가 용이한 중앙부로 이동시킨다. 이와 같이 처리된 두 라인의 위상값들은 제1연산부(106)로 인가되어 감산됨으로써 두 위상값들의 차이가 검출되고 여기서 검출된 위상에러값, 즉 주파수발진 에러값은 제3위상저장부(107)에 저장된다.
제2도에서 두번째 블럭의 위상에러 누적부(200)는 현재 발생된 주파수 위상에러값에 한 라인전의 주파수 위상에러값을 더하여 위상에러 누적값을 구하게 된다. 이 과정을 좀더 상세히 설명하면, 상기 제3위상저장부(107)에서 출력된 위상에러값은 제2연상부(201)에는 제4위상저장부(202)에서 출력된 한 라인까지의 위상에러 누적값이 입력되므로 상기 위상에러 누적값에 현재 검출된 위상에러값의 다시 더해져 새로운 위사에러 누적값이 구해진다. 제2연상부(201)에서 누적연산되어 새롭게 구해진 위상에러 누적값은 제4위상저장부(202)에 저장된다.
제2도에서 세번째 블럭인 발진스탭 보정부(300)는 누적된 주파수 위상에러값에 해당하는 보정스텝을 발생시켜 기본발진스텝에 더함으로써 보정된 최종발진스텝을 출력하게 된다. 즉, 사익 제4위상저장부(202)에서 출력된 위상에서 누적값이 보정스텝 보정스텝 발생부(301)로 인가되면, 보정스텝 발생부(301)는 입력된 위상에러 누적값에 해당하는 보정스텝을 발생시키고, 이 보정스텝을 계산하는 식은 아래와 같다.
보정스텝-[2n/(Fs/Fh)]×위상에러값×추적속도
여기서, n은 룩업테이블의 어드레스 비트수이고, Fs는 샘플링부파수이며, Fh는 수평동기신호의 주파수이고, 추적속도는 0에서 1사이의 값으로, 0이면 주파수 자동조절회로가 오프된 상태이고, 1이면 주파수 자동조절회로의 추적속도가 최대임을 나타낸다. 상기 보정스텝 발생부(302)에서 출력된 보정스텝을 제3연산부(303)로 인가되는데, 이때 제3연산부(303)에는 기본스텝 발생부(302)에서 출력된 기본발진스텝이 입력되므로 상기 기본발진스텝에 보정스텝이 더해져 보정된 최종발진스텝이 어드레스 발생부(400)로 출력된다. 이때 상기 기본발진스텝을 계산하는 식은 아래와 같다.
기본발진스텝-(2n×Fcar/Fs)
여기서, Fcar은 저역캐리어주파수로서, 8mm방식인 경우에는 743KHz이고, VHS 방식인 경우에는 629KHz이다.
제2도에서 네번째 블럭인 어드레스 발생부(400)는 최종발진스텝을 매클릭이 입력될 때마다 누적연산하여 캐리어발생부(500)를 구성하는 룩업테이블에 인가할 어드레스신호를 발생시킨다. 이 과정을 좀더 설명하며, 상기 제3연산부(303)에서 출력된 최종발진스텝은 제4연산부(401)로 인가되고, 이때 제4연산부(401)에는 제5위상저장부(402)에서 출력된 최종발진스텝 누적값이 입력괴므로 매 클럭이 입력될 때마다 상기 최종발진스텝 누적값에 새로 입력된 최종발진스텝이 더해져 새로운 최종발진스텝 누적값이 구해진다. 이때 상기 누적연산과정에서 발생되는 캐리(CARRY)는 무시함으로써 제4연산부(401)의 최종발진스텝 누적값이 곈속 반복해서 어드레스신호로서 출력되도록 한다. 제4연산부(401)에서 누적연산된 최종발진스텝 누적값은 캐리어발생부(500)에 인가할 어드레스신호로서 제5위상저장부(402)에 저장된다.
제2도에서 다섯번째 블럭인 캐리어발생부(500)는 제5위상저장부(402)에서 출력된 어드레스신호(위상값)를 입력받아 상기 어드레스신호에 따른 사인(코사인)파형의 함수가 저장된 룩업테이블로서, 상기 룩업테이블로 입력되는 0에서 2n까지의 어드레스는 사인(코사인)파형의 한 주기 위상값(0에서 360°)이 되고, 발진스텝, 즉 어드레스신호로서 입력되는 최종발진스텝 누적값에 따라 룩업테이블에서 출력되는 발진주파수(캐리어주파수)가 변환하게 된다.
이상에서와 같이 본 발명에 의하면, 전압제어발진기를 사용하지 않더라도 수평동기신호에 동기된 주파수 신호를 발생시킬 수 있으므로 디지탈 영상신호처리장치에 적합하게 규모가 작고 간단하면서도 우수한 성능의 주파수 자동조절회로를 얻을 수 있는 효과가 있다.

Claims (10)

  1. 디지탈 수평동기신호에 동기된 주파수신호를 발생시키기 위한 주파수 자동조절회로에 있어서, 매 라인마다 발생된 캐이러주파수의 위상을 검출하여 한 라인전의 위상값과 비교하고 두 라인의 위상차를 검출하여 위상에러값을 구하는 위상에러 연산부와; 위상에러 연산부에서 출력된 위상에러값에 한 라인전까지의 위상에러 누적값을 더하여 새로운 위상에러 누적값을 출력하는 위상에러 누적부와; 상기 위상에러 누적값에 해당하는 보정스템을 발생시켜 기본발진스텝에 더함으로써 보정된 최종발진스텝을 출력하는 발진스텝 보정부와; 발진스텝 보정부에서 출력된 최종발진스텝을 매 클럭이 입력될때마다 누적연산하여 룩업테이블에 인가할 어드레스신호를 발생시키는 어드레스 발생부와; 어드레스 발생부에서 출력된 어드레스신호에 따라 사인파형의 함수값을 출력하여 다양한 주파수의 캐이러신호를 발생시키는 캐리어발생부를 포함하는 것을 특징으로 하는 디지탈 주파수 자동조절회로.
  2. 제1항에 있어서, 상기 위상에러 연산부는 어드레스발생부로부터 궤환된 위상값에 디지탈 수평동기신호에러값을 더하여 보정된 위상값을 출력하는 제1위상보정부와; 제1위상보정부에서 출력된 위상값을 저장하는 제1위상보정부와; 제1위상보정부에서 출력된 위상값을 저장하는 제2위상보정부와; 제2위상보정부에서 출력된 한 라인전의 위상값에 설정된 라인간의 위상지연값을 더하여 보정된 위상값을 출력하는 제2위상보정부와; 상기 제1위상보정부제와 2위상보정부에서 출력된 두 라인의 위상값이 어드레스 양끝에 걸칠 경우에 상기 두 위상값을 비교가 용이한 중앙부로 이동시키는 위상이동부와; 위상이동부에서 출력된 두 라인의 위상값들을 감산하여 위상에러값을 검출하는 제1연산부에서 출력된 위상에러값을 저장하는 제3위상저장부로 구성하는 것을 특징으로 하는 디지탈 주파수 자동조절회로.
  3. 제2항에 있어서, 상기 디지탈 수평동기신호 에러값(Herr)은 아래식에 의해 계산하도록 한 것을 특징으로 하는 디지탈 주파수 자동조절회로.
    Herr=[(SL-S2)/(S1-S2)]×T
    여기서, SL은 수평동기신호 분리기준값이고, S1, S2는 수평동기신호 분리기준값 전후의 두 샘플데이타이며, T는 샘플링클릭의 한 주기이다.
  4. 제2항에 있어서, 8mm방식일 경우 상기 라인간의 위상지연값(K)은 아래식에 설정하도록 한 것을 특징으로 하는 디지탈 주파수 자동조절회로.
    K=2n/4
    여기서, n은 룩업테이블의 어드레스 비트수이다.
  5. 제2항에 있어서, VHS방식일 경우 상기 라인간의 위상지연값(K)은 0인 것을 특징으로 하는 디지탈 주파수 자동조절회로.
  6. 제1항에 있어서, 상기 위상에러 누적부는 위상에러 연산부에서 출력된 위상에러값을 제4위상저장부에서 출력된 한 라인전까지의 위상에러 누적값에 더하여 새로운 위상에러 누적값을 구하는 제2연산부와; 제2연산부에서 출력된 위상에러 누적값을 저장하는 제4위상저장부로 구성하는 것을 특징으로 하는 디지탈 주파수 자동조절회로.
  7. 제1항에 있어서, 상기 발진스텝 보정부는 위상에러 누적부에서 출력된 위상에러 누적값에 해당하는 보정스텝을 발생시키는 보정스텝 발생부와; 기본발진스텝을 발생시키는 기본 스텝 발생부와; 상기 기본스텝 발생부에서 출력된 기본발진스텝에 보정스텝 발생부에서 출력된 보정스텝을 더하여 보정된 최종발진스텝을 출력하는 제3연산부로 구성하는 것을 특징으로 하는 디지탈 주파수 자동조절회로.
  8. 제7항에 있어서, 상기 보정스텝은 아래식에 의해 계산하도록 한 것을 특징으로 하는 디지탈 주파수 자동조절회로.
    보정스텝=[2n/(Fs/Fh)]×위상에러값×추적속도
    여기서, n은 룩업테이블의 어드레스 비트수이고, Fs는 샘플링주파수이며, Fh는 수평동기신호의 주파수이다.
  9. 제7항에 있어서, 상기 기본발진스텝은 아래식에 의해 계산하도록 한 것을 특징으로 하는 디지탈 주파수 자동조절회로.
    기본발진스템=(2n×Fcar/Fs)
    여기서, n은 룩업테이블의 어드레스 비트수이고, Fcar은 지역캐이러주파수이며, Fs는 샘플링주파수이다.
  10. 제1항에 있어서, 상기 어드레스 발생부는 매 클럭이 입력될때마다 발진스텝 보정부에서 출력된 최종발진스텝을 제5위상저장부에서 출력된 최종발진스텝 누적값에 더하여 새로운 최종발진스텝 누적값을 구하는 제4연산부와; 제4연산부에서 출력된 최종발진스텝 누적값을 캐리어발생부에 인가할 어드레스신호로서 저장하는 제5위상저장부를 구성하는 것을 특징으로 하는 디지탈 주파수 자동조절회로.
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Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5796392A (en) * 1997-02-24 1998-08-18 Paradise Electronics, Inc. Method and apparatus for clock recovery in a digital display unit
US6369918B1 (en) * 1999-02-08 2002-04-09 National Semiconductor Corporation Apparatus, method, and computer program to reduce distortion of scanner restarts
JP2002335421A (ja) 2001-05-10 2002-11-22 Mitsubishi Electric Corp 同期信号処理回路
EP1274229A1 (en) * 2001-07-06 2003-01-08 Thomson Licensing S.A. Method for obtaining line synchronization information items from a video signal, and apparatus for carrying out the method
US7876488B2 (en) * 2003-11-01 2011-01-25 Silicon Quest Kabushiki-Kaisha Mirror device having vertical hinge
CN1835389B (zh) * 2005-03-14 2010-07-14 华为技术有限公司 一种可以消除数控振荡器频率误差的方法及相位累加器
KR101675112B1 (ko) * 2010-01-21 2016-11-22 삼성전자주식회사 거리 정보 추출 방법 및 상기 방법을 채용한 광학 장치
CN103067645B (zh) * 2012-10-18 2016-05-18 广东威创视讯科技股份有限公司 行同步信号的稳定化处理方法和装置
GB2585328B (en) * 2018-12-14 2021-07-21 Darkvision Tech Inc Correcting for eccentricity of acoustic sensors in wells and pipes

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1599761A (en) * 1977-03-12 1981-10-07 Lucas Industries Ltd Turbo-supercharged compression ignition engine
FR2510329A1 (fr) * 1981-07-24 1983-01-28 Thomson Csf Procede et dispositif numerique de correction d'erreur de phase lors de l'echantillonnage d'un signal sinusoidal par un signal d'horloge ainsi que l'application a la correction de signaux de television
US4675724A (en) * 1985-09-27 1987-06-23 Ampex Corporation Video signal phase and frequency correction using a digital off-tape clock generator
US4694326A (en) * 1986-03-28 1987-09-15 Rca Corporation Digital phase locked loop stabilization circuitry including a secondary digital phase locked loop which may be locked at an indeterminate frequency
US4694327A (en) * 1986-03-28 1987-09-15 Rca Corporation Digital phase locked loop stabilization circuitry using a secondary digital phase locked loop
US4989073A (en) * 1987-11-25 1991-01-29 Ampex Corporation System for compensating timing errors during sampling of signals
US5267040A (en) * 1991-03-28 1993-11-30 Gossett C Philip Structure and method for detecting phase errors in the horizontal synchronization pulses of television signals
JP2978621B2 (ja) * 1992-02-18 1999-11-15 日本電気アイシーマイコンシステム株式会社 ディジタルｐｌｌ回路
US5418573A (en) * 1993-07-22 1995-05-23 Philips Electronics North America Corporation Apparatus and method for producing periodic synchronization references forming a synchronization signal

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