JPS6324572B2 - - Google Patents

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JPS6324572B2
JPS6324572B2 JP56009991A JP999181A JPS6324572B2 JP S6324572 B2 JPS6324572 B2 JP S6324572B2 JP 56009991 A JP56009991 A JP 56009991A JP 999181 A JP999181 A JP 999181A JP S6324572 B2 JPS6324572 B2 JP S6324572B2
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JP
Japan
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pulse detection
capacitor
circuit
detection circuit
signal
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JP56009991A
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Yoshiaki Ichikawa
Shinjiro Umetsu
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Original Assignee
Nippon Electric Co Ltd
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Priority to AU79802/82A priority patent/AU534191B2/en
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    • H03K5/08—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00—Baseband systems
    • H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
    • H04L25/06—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection
    • H04L25/061—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection providing hard decisions only; arrangements for tracking or suppressing unwanted low frequency components, e.g. removal of dc offset
    • H04L25/062—Setting decision thresholds using feedforward techniques only
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04W—WIRELESS COMMUNICATION NETWORKS
    • H04W52/00—Power management, e.g. TPC [Transmission Power Control], power saving or power classes
    • H04W52/02—Power saving arrangements
    • H04W52/0209—Power saving arrangements in terminal devices
    • H04W52/0261—Power saving arrangements in terminal devices managing power supply demand, e.g. depending on battery level
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04W—WIRELESS COMMUNICATION NETWORKS
    • H04W88/00—Devices specially adapted for wireless communication networks, e.g. terminals, base stations or access point devices
    • H04W88/02—Terminal devices
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    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D30/00—Reducing energy consumption in communication networks
    • Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks

Description

【発明の詳細な説明】 本発明は移動無線装置等のデイジタル通信装置
の受信回路におけるパルス検出回路に関するもの
である。
このようなデイジタル通信装置（例えば個人無
線呼出受信装置）では、その消費電流を低減する
ために、受信装置の電源を周期的に接断するいわ
ゆるバツテリーセービング方式を採用している。
このような受信装置に用いるパルス検出回路（例
えば特願昭51−37961（特開昭52−120748号公報参
照）および特願昭51−37962（特開昭52−120704号
公報参照）は、入力信号を積分する長短２種類の
時定数を有する積分回路と、この積分回路の出力
を基準電圧として入力信号を検出する回路とで構
成されている。このような検出回路では、電源投
入時には短い時定数の積分回路を形成して信号受
信までの時間を短縮させ、また信号受信時には長
い時定数の積分回路を形成して直硫レベル変動の
影響を軽減させるようにしている。しかし、この
ようなパルス検出回路においても、受信選択信号
構成およびバツテリーセービング・タイミングの
関係で、確実な検出動作および受信装置全体の電
力消費の点で不十分であつた。
本発明の目的は、このような欠点を除去したパ
ルス検出回路を提供することにある。
本発明によれば、周期的に電源の接断を行なう
デイジタル通信装置の受信回路に含まれるパルス
検出回路において、コンデンサを含み入力信号を
積分する第１の手段と、前記第１の手段の出力を
基準電圧として前記入力信号を検出する第２の手
段と、電源の断の時前記第１の手段の出力を保持
する第３の手段とを含むことを特徴とするパルス
検出回路が得られる。
以下図面を参照しながら本発明を説明する。
第１図はバツテリーセービング方式を採用した
個別選択呼出受信機の例であつて、空中線１０１
により受信される無線電波は高周波中間周波回路
１０２により増幅され周波数変換されデイスクリ
ミネータ１０３に入力される。このデイスクリミ
ネータ１０３は無線周波信号を復調してパルス検
出回路１０４に復調信号を送る。パルス検出回路
１０４では前記復調信号をデコーダ１０５が判読
できるパルス信号に変換する。デコーダ１０５で
は検出されたパルス信号系列を自己の呼出番号と
照合し一致しておればバツフア１０６にアラート
信号を送り、スピーカ１０７から呼出音が出力さ
れる。スイツチ１１は電池１０９から高周波中間
周波回路１０２，デイスクリミネータ１０３およ
びパルス検出回路１０４への電力供給をデコーダ
１０５からの信号により断続して消費電力の低減
する。
このパルス検出回路１０４は、第２図のよう
に、低域波器１、コンパレータ２、抵抗３〜
５、コンデンサ６およびスイツチ７で構成されて
いる。また、抵抗４とコンデンサ６とで長い時定
数の積分回路を、並列抵抗４，５とコンデンサ６
とで短い時定数の積分回路を構成しコンパレータ
２の基準電圧を発生する。参照番号８は第１図の
スイツチ１１の出力に、９はデコーダ１０５の出
力に接続されている。この回路において、スイツ
チ１１を閉じることにより電源電圧が端子８に供
給された時には、端子９に供給される制御信号に
よりスイツチ７を閉じて短かい時定数の積分回路
を構成させ信号受信までの時間を短縮させる。ま
た、一定時間後、スイツチ７を開いて長い時定数
をもつ積分回路に切換えて信号受信時の直流レベ
ル変動の影響を軽減している。このようなパルス
検出回路をもつ個別選択呼出受信機に対する選択
信号構成としては安定にパルス検出回路を動作さ
せるために電源スイツチ１１が断から接になつて
時積分回路を充電させ、基準電圧を作るために加
入者番号列の前に、片寄りのない“１”“０”の
信号列を置く必要がある。
このような選択信号の構成として第３図に一例
を示すが、この選択信号の１バツチは15のフレー
ムに分かれており、１つのフレームは１ワードの
同期信号を数ワードの加入者番号列から構成され
受信機はそれに割当てられたフレームの位置でス
イツチ１１を接にして、片寄りのない“１”“０”
の同期信号によつて積分回路からコンパレータ２
のための基準電圧を作つている。
ところで、1978年６月発行のイギリス郵政局コ
ード標準化諮問グループが発表した選択信号（Ａ
Report of the studies of the British Post
Office Code Standardization Advisory Group
略してPOCSAGレポートに発表した信号、以下
POCSAG信号と呼ぶ）は第４図に示すように
１／０パターン（プリアンプル信号と呼ばれる）
の後いくつかバツチが続くようになつており、１
バツチは同期信号および８個のフレームにわかれ
ており、１フレームは数ワードの加入者番号列で
構成されている。このPOCSAG信号をパルス検
出回路を用いた受信機が受信する場合、各バツチ
ごとに１つの同期信号しか用意されておらず、各
フレームには同期信号がないので、積分回路の立
上り特性のために自分の受信機に割当てられたフ
レームよりも前に接にする必要があるが、たとえ
ば、１つ前のフレームで接とし同期信号受信後の
電源OFFによつて放電していた積分回路を再び
充電させ、基準電圧を作つていたのでは、加入者
番号に“１”，“０”の符号の片寄があつた場合、
パルス検出回路の基準電圧として正しい値が得ら
れない。したがつて確実に動作させるためにはパ
ルス検出回路は１／０パターンおよび“１”，
“０”の片寄の少ない同期信号にて基準電圧を作
つたあと、すべてのフレームに対し電源ONの状
態を保持しなければならず、消費電力低減の効率
はきわめて悪くなるという欠点がある。
本発明は以上のような従来の欠点を解決するも
のであり、以下本発明につき、第５図〜第７図を
参照して詳細に説明する。
第５図は本発明に係るパルス検出回路の一実施
例を示しており、このパルス検出回路の特徴は、
第２図の従来の回路と比較すれば明らかなよう
に、スイツチ１２をもつことである。
第６図に電源を接断したときのパルス検出回路
主要部の動作タイムチヤートを示す。パルス検出
回路の電源は、第６図ａに示されているように断
続され、電源スイツチ１１を時間t1でオンにする
と同時に、第６図ｃおよびｄに示されているよう
に制御入力１電圧および制御入力２電圧がたとえ
ばデコーダ１０５から加えられてスイツチ回路
７，１２を閉じる。従つて、短い時定数の積分回
路が形成されて急速な充電がなされたのち、時間
t2で制御入力１を低レベルとしスイツチ回路７が
開かれることにより長い時定数の積分回路が形成
され、安定した基準電圧ｂがコンパレータ２に供
給され入力信号の“１”あるいは“０”が検出さ
れる。次に電源スイツチ回路１１が時間t3でオフ
になる時、第６図ｄに示されているように制御入
力２の電圧も低レベルになり、スイツチ１２が開
かれ、コンデンサ６の放電路を切ることによつて
基準電圧ｂを一定に保つ。次に電源スイツチ１１
が時間t4でオンになる時は、制御入力電圧２は高
レベルになり、スイツチ１２が閉じるが、基準電
圧ｂは前回電源オン時（時間t1からt3まで間）に
充電されたままなので、充電時間が不要となりた
だちに入力信号の“１”あるいは“０”が検出で
きる。このパルス検出回路が前記POCSAG信号
を受信する場合の一実施例を第７図に示す。まず
電源オン時（時間t1）に１／０パターンを受信し
たら、スイツチ７および１２を閉じて短い時定数
の積分回路を形成し急速な充電がされ、次の同期
信号も１，０の比較的片寄りの少ない符号なので
同期信号が終る時間t2までにコンパレータ２の基
準電圧を作り出す。そのあとその受信機に割当て
られたフレーム（この例では第２番目のフレー
ム）の始まる時間t3まで電源をオフにすると同時
にスイツチ回路１２を開き、コンデンサ９の電荷
を保持することにより基準電圧を一定に保つ。積
分回路は時定数の長い方に切り替えておく。そし
て第２番目のフレームの少り手前にて電源オンに
しスイツチ１２を閉じることによつてただちに呼
出番号の検出ができるのである。なお、バツチが
複数続く場合は、呼出番号の符号の片寄りによる
基準電圧の変動を考慮して、次の１，０の比較的
片寄りの少ない同期信号の区間（t5〜t6）で再び
短い時定数をもつ積分回路に切り替えて、基準電
圧を校正している。このようにしてPOCSAG信
号を安定に受信することが可能となり、しかもそ
の受信機に割当てられてフレームおよび同期信号
の所でのみ電源オンにすればよいので大幅な消費
電力低減ができる。
以上詳述したように、この発明のパルス検出回
路は、周期的に電源接断する装置において、ある
時定数をもつ積分回路を用いたにもかかわらず、
基準電圧を保持するためのスイツチを備えること
によつて、一度積分回路を充電した後は電源オン
時の積分回路の充電のための時間は省くことが可
能となり、併せて電流レベル変動の影響を軽減
し、かつ電源消費電力を大幅に低下し得るなどの
特長を発揮できるのである。
【図面の簡単な説明】
第１図はパルス検出回路を用いた個別選択呼出
受信機のブロツク図、第２図は従来のパルス検出
回路を示す回路図、第３図は従来の選択呼出方式
における選択信号の構成を示す図、第４図は
POCSAGの信号構成を示す図、第５図は本発明
のパルス検出回路の一実施例を示す回路図、第６
図ａ〜ｄはそれぞれ第５図のパルス検出回路の×
印ａ〜ｄ各部の一例を示すタイムチヤート、第７
図ａ〜dPOCSAG信号受信時における第５図のパ
ルス検出回路の×印ａ〜ｄ各部のタイムチヤート
を示す。 図において、１……低域波器、２……コンパ
レータ、３〜５……抵抗、６……コンデンサ、
７，１１，１２……スイツチ、１０１……空中
線、１０２……高周波中間周波回路、１０３……
デイスクリミネータ、１０４……パルス検出回
路、１０５……デコーダ、１０６……バツフア、
１０７……スピーカ、１０９……電池である。

Claims (1)

  1. 【特許請求の範囲】 １ 周期的に電源の接断を行なうデイジタル通信
    装置の受信回路に含まれるパルス検出回路におい
    て、コンデンサを含み入力信号を積分する第１の
    手段と、前記第１の手段の出力を基準電圧として
    前記入力信号を検出する第２の手段と、電源の断
    の時前記第１の手段の出力を保持する第３の手段
    とを含むことを特徴とするパルス検出回路。 ２ 前記第１の手段が、一端に入力信号を受ける
    抵抗と、前記抵抗の他端とある電位点間に結合さ
    れる前記コンデンサとで構成されたことを特徴と
    する特許請求の範囲第１項記載のパルス検出回
    路。 ３ 前記第３の手段が、前記コンデンサと前記電
    位点間を接断するスイツチで構成されたことを特
    徴とする特許請求の範囲第２項記載のパルス検出
    回路。
JP56009991A 1981-01-26 1981-01-26 Pulse detection circuit Granted JPS57124946A (en)

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CA000394819A CA1167927A (en) 1981-01-26 1982-01-25 Pulse detecting circuit of receiver for use in digital radio communication system
EP82100482A EP0057003B1 (en) 1981-01-26 1982-01-25 Pulse detecting circuit of receiver for use in digital radio communication system
DE8282100482T DE3261981D1 (en) 1981-01-26 1982-01-25 Pulse detecting circuit of receiver for use in digital radio communication system
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