JPS62104304A - 保護回路 - Google Patents
保護回路Info
- Publication number
- JPS62104304A JPS62104304A JP60245088A JP24508885A JPS62104304A JP S62104304 A JPS62104304 A JP S62104304A JP 60245088 A JP60245088 A JP 60245088A JP 24508885 A JP24508885 A JP 24508885A JP S62104304 A JPS62104304 A JP S62104304A
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- current
- transistor
- circuit
- terminal
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、構成を簡単化した天絡保護回路に関する。
天絡とは端子例えば出力端子が電源に誤って接続される
ことをい＼、天絡が生じると該端子に接続される回路素
子に大電流が流れて破壊する恐れがある。天絡保護回路
はか−る場合回路素子の破壊を防止するように動作する
。
ことをい＼、天絡が生じると該端子に接続される回路素
子に大電流が流れて破壊する恐れがある。天絡保護回路
はか−る場合回路素子の破壊を防止するように動作する
。
従来の天絡保護回路を第３図に示す。ＯＵＴは出力端子
、Ｖｃｃは電源又はその電圧であり、天絡時には何らか
の手段でＯＵＴがＶｃｃに接続される。
、Ｖｃｃは電源又はその電圧であり、天絡時には何らか
の手段でＯＵＴがＶｃｃに接続される。
第３図ではこのときＯＵＴ、抵抗Ｒ１、トランジスタＱ
２のエミッタ・ベース、ゼナーダイオードＺＤ、基準電
圧ＲＥＦ ＋の経路で電流が流れ、トランジスタＱ２は
オンになる。またトランジスタＱ３はオフになり、トラ
ンジスタＱ４もオフ、従ってダイオードＤ Ｉ 、抵抗
Ｒ４の経路で電流が流れ、トランジスタＱ５はオン、従
ってトランジスタＱ１はオンとなり電流Ｉｄが流れる。
２のエミッタ・ベース、ゼナーダイオードＺＤ、基準電
圧ＲＥＦ ＋の経路で電流が流れ、トランジスタＱ２は
オンになる。またトランジスタＱ３はオフになり、トラ
ンジスタＱ４もオフ、従ってダイオードＤ Ｉ 、抵抗
Ｒ４の経路で電流が流れ、トランジスタＱ５はオン、従
ってトランジスタＱ１はオンとなり電流Ｉｄが流れる。
この天絡保護電流Ｉｄは図示しない保護用トランジスタ
を制御して回路素子の破壊を防止する。第４図にその例
を示す。
を制御して回路素子の破壊を防止する。第４図にその例
を示す。
第４図は天絡保護回路を付けた電力増幅回路を示し、Ｑ
１〜Ｑ５は第３図で述べた前記トランジスタである。天
絡検出電流ＩｄはトランジスタＱ６をオンにし、定電流
源トランジスタＱｌｌが供給する電流を全て該トランジ
スタＱ６が吸収し、出力段トランジスタＱ７．Ｑｅをオ
フにするＱ ９ 。
１〜Ｑ５は第３図で述べた前記トランジスタである。天
絡検出電流ＩｄはトランジスタＱ６をオンにし、定電流
源トランジスタＱｌｌが供給する電流を全て該トランジ
スタＱ６が吸収し、出力段トランジスタＱ７．Ｑｅをオ
フにするＱ ９ 。
ＱＩＯは天絡した時点でオフとなる。この保護回路がな
いと出力段トランジスタＱ？、Ｑ８に大きな電流が流れ
、該トランジスタは破壊する。即ち、出力端子ＯＵＴが
例えば１３．２ Ｖである（車載用アンプの場合電源は
バッテリ）Ｖｃｃになると、差動アンプのトランジスタ
Ｑ１５はオフ、Ｑｌ４がオン、従ってトランジスタＱＩ
６は飽和しコレクタ・エミッタ間電圧は約Ｏ■、したが
ってトランジスタＱ７のペースエミッタ間電圧がＶｃｃ
（＝１３．２Ｖ）となり、これらのトランジスタＱ ７
。
いと出力段トランジスタＱ？、Ｑ８に大きな電流が流れ
、該トランジスタは破壊する。即ち、出力端子ＯＵＴが
例えば１３．２ Ｖである（車載用アンプの場合電源は
バッテリ）Ｖｃｃになると、差動アンプのトランジスタ
Ｑ１５はオフ、Ｑｌ４がオン、従ってトランジスタＱＩ
６は飽和しコレクタ・エミッタ間電圧は約Ｏ■、したが
ってトランジスタＱ７のペースエミッタ間電圧がＶｃｃ
（＝１３．２Ｖ）となり、これらのトランジスタＱ ７
。
Ｑａに流れる電流は大きく、該トランジスタを破壊する
恐れがある。
恐れがある。
なおこのパワーアンプの通常の動作は次の如くである。
即ち入力端子ＩＮに信号電圧が加わり、この信号電圧が
高くなるとトランジスタＱ１４の電流は減り、従ってト
ランジスタＱ＋６のベース電流が減り、電位ＲＥＦ ＋
は上る。これによりダーリントン接続されたブツシュ側
のトランジスタＱＩＯ，Ｑ９は導通度を増し、プル側の
トランジスタＱ？、Ｑｅ （Ｑ７はＩ）ｎｐ＋ Ｑ
ｓはｎｐｎで、同じｎｐｎであるＱＩＯ，Ｑ９とは動作
が逆になる）は導通度を下げ、出力ＯＵＴの電位は高く
なる。
高くなるとトランジスタＱ１４の電流は減り、従ってト
ランジスタＱ＋６のベース電流が減り、電位ＲＥＦ ＋
は上る。これによりダーリントン接続されたブツシュ側
のトランジスタＱＩＯ，Ｑ９は導通度を増し、プル側の
トランジスタＱ？、Ｑｅ （Ｑ７はＩ）ｎｐ＋ Ｑ
ｓはｎｐｎで、同じｎｐｎであるＱＩＯ，Ｑ９とは動作
が逆になる）は導通度を下げ、出力ＯＵＴの電位は高く
なる。
これは抵抗Ｒ１０，Ｒｑで分圧されたのちトランジスタ
ＱＩ５に加わり、上記動作を和らげる即ち負帰還をかけ
る。信号電圧が低くなるときは上記の逆である。
ＱＩ５に加わり、上記動作を和らげる即ち負帰還をかけ
る。信号電圧が低くなるときは上記の逆である。
通常動作時は出力ＯＵＴはトランジスタＱ＋６のコレク
タ電位ＲＥＦ ＋とは一′同じ電位であり、従って抵抗
Ｒ１、トランジスタＱ２のエミッタ・ベース、ゼナーダ
イオードＺＤへ流れる電流はなく、天絡保護電流Ｉｄは
ない。式で示すと、ＶＯＵＴ ＲＥＦ ＋
＜ＶＺＤ＋ＶＢＥ＋Ｒ＋ Ｉ ＋であって、Ｉ＋は
流れず、保護回路は動作しない。
タ電位ＲＥＦ ＋とは一′同じ電位であり、従って抵抗
Ｒ１、トランジスタＱ２のエミッタ・ベース、ゼナーダ
イオードＺＤへ流れる電流はなく、天絡保護電流Ｉｄは
ない。式で示すと、ＶＯＵＴ ＲＥＦ ＋
＜ＶＺＤ＋ＶＢＥ＋Ｒ＋ Ｉ ＋であって、Ｉ＋は
流れず、保護回路は動作しない。
しかし天絡するとＶＯＵＴ＝ＶＣＣになり、トランジス
タＱＩ５はオフ、Ｑｌ４ 、Ｑｌ５はオン、ＲＥＦＩ＃
Ｏｖになって、 ＶＣＪＪＴＲＥＦ Ｉ＃ＶＣＣ＞ＶＺＤ＋ＶＢＥ＋ＲＩ
Ｉ ＋となるため保護回路が動作し、トランジスタＱ
６によりトランジスタＱｌｌからの電流を吸込み、トラ
ンジスタＱ？、Ｑ１１をオフにする。
タＱＩ５はオフ、Ｑｌ４ 、Ｑｌ５はオン、ＲＥＦＩ＃
Ｏｖになって、 ＶＣＪＪＴＲＥＦ Ｉ＃ＶＣＣ＞ＶＺＤ＋ＶＢＥ＋ＲＩ
Ｉ ＋となるため保護回路が動作し、トランジスタＱ
６によりトランジスタＱｌｌからの電流を吸込み、トラ
ンジスタＱ？、Ｑ１１をオフにする。
従来の天絡回路は図示のように複雑である。トランジス
タはＱ１〜Ｑｓの５個を使用し、それにダイオードＤ＋
、ＺＤ、抵抗Ｒ１〜Ｒ４を使用する。なおトランジスタ
Ｑ３．Ｑ４は検出動作に直接関係はしないが、リーク防
止に必要である。即ち天絡が発生しない状態ではトラン
ジスタＱ２にベース電流が流れず、コレクタ電流はない
はずであるが、実際には若干のリーク電流が流れ、これ
がトランジスタＱ５．Ｑｌをオンにして保護電流Ｉｄを
生じる恐れがある。トランジスタＱ３．Ｑ４を設けると
、出力ＯＵＴがＶＣＣより低い限り、０３オン、従って
Ｑ４オンとなり、トランジスタＱ５゜Ｑｌのオンを防ぐ
。
タはＱ１〜Ｑｓの５個を使用し、それにダイオードＤ＋
、ＺＤ、抵抗Ｒ１〜Ｒ４を使用する。なおトランジスタ
Ｑ３．Ｑ４は検出動作に直接関係はしないが、リーク防
止に必要である。即ち天絡が発生しない状態ではトラン
ジスタＱ２にベース電流が流れず、コレクタ電流はない
はずであるが、実際には若干のリーク電流が流れ、これ
がトランジスタＱ５．Ｑｌをオンにして保護電流Ｉｄを
生じる恐れがある。トランジスタＱ３．Ｑ４を設けると
、出力ＯＵＴがＶＣＣより低い限り、０３オン、従って
Ｑ４オンとなり、トランジスタＱ５゜Ｑｌのオンを防ぐ
。
本発明は回路構成等を変更して、簡単−な構造の天絡保
護回路を提供しようとするものである。
護回路を提供しようとするものである。
本発明は、端子が天絡されたとき該端子に接続される回
路素子が損傷するのを防止する保護回路において、Ｍ端
子に接続された抵抗と第１のトランジスタと第２のトラ
ンジスタの直列回路を備え、第１のトランジスタのベー
スには第１の基準電位を与え、第２のトランジスタのベ
ースにはゼナーダイオードを介して第２の基準電位を与
え、該第２のコレクタを保護用トランジスタのベースへ
接続してなることを特徴とするものである。
路素子が損傷するのを防止する保護回路において、Ｍ端
子に接続された抵抗と第１のトランジスタと第２のトラ
ンジスタの直列回路を備え、第１のトランジスタのベー
スには第１の基準電位を与え、第２のトランジスタのベ
ースにはゼナーダイオードを介して第２の基準電位を与
え、該第２のコレクタを保護用トランジスタのベースへ
接続してなることを特徴とするものである。
本発明の天絡保護回路は第１図に示すようにトランジス
タＱ２０．Ｑ２１ の２（１１とゼナーダイオードＺＤ
１個及び抵抗Ｒ＋１個からなる簡単なものであり、これ
で第３図の従来回路と同様な働らきをすることができる
。即ち、第２の基準電圧ＲＥＦ２は定電流源トランジス
タＱ目〜ＱＩ３の共通ベース電位としており、従って出
力端子ＯＵＴがＶｃｃになるまではトランジスタＱ２０
にペース電流は流れず、該トランジスタはオフである。
タＱ２０．Ｑ２１ の２（１１とゼナーダイオードＺＤ
１個及び抵抗Ｒ＋１個からなる簡単なものであり、これ
で第３図の従来回路と同様な働らきをすることができる
。即ち、第２の基準電圧ＲＥＦ２は定電流源トランジス
タＱ目〜ＱＩ３の共通ベース電位としており、従って出
力端子ＯＵＴがＶｃｃになるまではトランジスタＱ２０
にペース電流は流れず、該トランジスタはオフである。
またトランジスタＱ２＋ のベース電流はトランジスタ
Ｑ２０がオンしない限り流れることはなくまたＱ２０が
飽和したとしても、■（１）７ＲＥＦ＋〉ＶＢＥ”Ｖｚ
ｎにならなければ流れず、通常動作ではＲＥＦ ＋はは
＼ＶＯＵ↑なので上記式は成立せず従ってトランジスタ
Ｑ２＋ はオフである。これらにより、トランジスタリ
ーク電流を想定しても通常状態では保護電流Ｉｄは発生
しない。しかし天絡で出力端子ＯＵＴがＶｃｃになると
トランジスタＱ２０はオン、Ｑ２１ もオンになり、保
護電流Ｉｄが生しる。式で示すと、天絡時は負帰還作用
でＲＥＦＩがはソ′０■に下るので ＶｉＴ−ＲＥＦＩ （ｑ Ｖ ｃｃ）≧ＶＺＤ＋ＶＢ
Ｅ＋Ｒ＋ Ｉ ＋かつＱ２０のエミッタ電位がＶＣＣＲ
ＩＩｌ、が成立し、電流■１が流れてこれが保護電流Ｉ
ｄになる。なおトランジスタＱ２１ はマルチコレクタ
型で、コレクタの１つはベースへ接続しているが、これ
は、保護電流Ｉｄは次段保護トランジスタのベース電流
になるだけで大きな値は不要なので、一部をバイパスし
てＩｄを小にするためのものである。
Ｑ２０がオンしない限り流れることはなくまたＱ２０が
飽和したとしても、■（１）７ＲＥＦ＋〉ＶＢＥ”Ｖｚ
ｎにならなければ流れず、通常動作ではＲＥＦ ＋はは
＼ＶＯＵ↑なので上記式は成立せず従ってトランジスタ
Ｑ２＋ はオフである。これらにより、トランジスタリ
ーク電流を想定しても通常状態では保護電流Ｉｄは発生
しない。しかし天絡で出力端子ＯＵＴがＶｃｃになると
トランジスタＱ２０はオン、Ｑ２１ もオンになり、保
護電流Ｉｄが生しる。式で示すと、天絡時は負帰還作用
でＲＥＦＩがはソ′０■に下るので ＶｉＴ−ＲＥＦＩ （ｑ Ｖ ｃｃ）≧ＶＺＤ＋ＶＢ
Ｅ＋Ｒ＋ Ｉ ＋かつＱ２０のエミッタ電位がＶＣＣＲ
ＩＩｌ、が成立し、電流■１が流れてこれが保護電流Ｉ
ｄになる。なおトランジスタＱ２１ はマルチコレクタ
型で、コレクタの１つはベースへ接続しているが、これ
は、保護電流Ｉｄは次段保護トランジスタのベース電流
になるだけで大きな値は不要なので、一部をバイパスし
てＩｄを小にするためのものである。
第２図に実施例を示す。第１図および第４図と同じ部分
には同じ符号が付しである。動作は前述の通りであり、
通常状態では■（１）↑＃ＲＥＦ ＋なので、 Ｖ′ＣＡＪ７−ＲＥＦ ＋ ＜ＶＺＤ＋ＶＢＥ＋ＶＣＥ
＋Ｒ＋ １ ＋であり、１１は流れず、保護回路は動作
しない。
には同じ符号が付しである。動作は前述の通りであり、
通常状態では■（１）↑＃ＲＥＦ ＋なので、 Ｖ′ＣＡＪ７−ＲＥＦ ＋ ＜ＶＺＤ＋ＶＢＥ＋ＶＣＥ
＋Ｒ＋ １ ＋であり、１１は流れず、保護回路は動作
しない。
これに対し天絡が発生するとトランジスタＱ２０がオン
になり、またＲＥＦ＋＃０になるので、上式の不等号は
逆になり、電流１１が流れてその一部が保護電流Ｉｄに
なる。
になり、またＲＥＦ＋＃０になるので、上式の不等号は
逆になり、電流１１が流れてその一部が保護電流Ｉｄに
なる。
保護回路のトランジスタＱ２１ はマルチコレクタ型で
、その一方のコレクタはベースへ接続されてコレクタ電
流を分流し、保護電流１ｄを必要値に抑えているが、こ
の機能はトランジスタＱ２０が定電流トランジスタにｌ
ｔｔ 、Ｑ１２と同じベース電圧を受けて天絡発生時に
流れる電流１１を定電流化することよにり確実にされる
。
、その一方のコレクタはベースへ接続されてコレクタ電
流を分流し、保護電流１ｄを必要値に抑えているが、こ
の機能はトランジスタＱ２０が定電流トランジスタにｌ
ｔｔ 、Ｑ１２と同じベース電圧を受けて天絡発生時に
流れる電流１１を定電流化することよにり確実にされる
。
以上説明したように本発明によれば機能は同じで回路構
成を簡単化でき、消費電流も少ない天絡保護回路を提供
できる。
成を簡単化でき、消費電流も少ない天絡保護回路を提供
できる。
第１図は本発明の保護回路を示す回路図、第２図は第１
図の適用例を示す回路図、第３図は従来の保護回路を示
す回路図、第４図は第３図の適用例を示す回路図である
。 図面でＯＵＴは端子、Ｑ７．Ｑｌｌは該端子に接続され
る回路素子、Ｒ＋は抵抗、Ｑ２０は第１のトランジスタ
、Ｑ２＋ は第２のトランジスタ、ＺＤはゼナーダイオ
ード、ＲＥＦ ２．ＲＥＦ ＋は第１、第２の基準電圧
である。
図の適用例を示す回路図、第３図は従来の保護回路を示
す回路図、第４図は第３図の適用例を示す回路図である
。 図面でＯＵＴは端子、Ｑ７．Ｑｌｌは該端子に接続され
る回路素子、Ｒ＋は抵抗、Ｑ２０は第１のトランジスタ
、Ｑ２＋ は第２のトランジスタ、ＺＤはゼナーダイオ
ード、ＲＥＦ ２．ＲＥＦ ＋は第１、第２の基準電圧
である。
Claims (1)
- 端子が天絡されたとき該端子に接続される回路素子が損
傷するのを防止する保護回路において、該端子に接続さ
れた抵抗と第１のトランジスタと第２のトランジスタの
直列回路を備え、第１のトランジスタのベースには第１
の基準電位を与え、第２のトランジスタのベースにはゼ
ナーダイオードを介して第２の基準電位を与え、該第２
のトランジスタのコレクタから制御電流を出力すること
を特徴とする天絡保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60245088A JPS62104304A (ja) | 1985-10-31 | 1985-10-31 | 保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60245088A JPS62104304A (ja) | 1985-10-31 | 1985-10-31 | 保護回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62104304A true JPS62104304A (ja) | 1987-05-14 |
| JPH025042B2 JPH025042B2 (ja) | 1990-01-31 |
Family
ID=17128427
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60245088A Granted JPS62104304A (ja) | 1985-10-31 | 1985-10-31 | 保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62104304A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0427613U (ja) * | 1990-06-28 | 1992-03-05 |
-
1985
- 1985-10-31 JP JP60245088A patent/JPS62104304A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0427613U (ja) * | 1990-06-28 | 1992-03-05 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH025042B2 (ja) | 1990-01-31 |
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