JPS616868A - Mis型電界効果半導体装置 - Google Patents
Mis型電界効果半導体装置Info
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- JPS616868A JPS616868A JP59126798A JP12679884A JPS616868A JP S616868 A JPS616868 A JP S616868A JP 59126798 A JP59126798 A JP 59126798A JP 12679884 A JP12679884 A JP 12679884A JP S616868 A JPS616868 A JP S616868A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/788—Field effect transistors with field effect produced by an insulated gate with floating gate
- H01L29/7881—Programmable transistors with only two possible levels of programmation
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- Read Only Memory (AREA)
- Semiconductor Memories (AREA)
- Non-Volatile Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明はゲート絶縁膜中に電荷捕獲層を有するMIS型
電界効果半導体装置に関するものである。
電界効果半導体装置に関するものである。
(従来技術)
ゲート絶縁膜中に電荷捕獲l1liを有するMI8(絶
縁ゲート)型電界効果半導体装置(以下、EPROMと
いう。)を形成するMIS型電界効果トランジスタ(以
下、MIS型FETという。)は、第1図の模式的断面
図に示される様な構造を有し、一般にはチャンネル注入
と称される機構によりホットなエレクトロンを基板7内
で生じさせ、電荷捕獲層4にエレクトロン、を注入し書
込みを行う。−刃装置上部から紫外線を照射すると電荷
捕獲層4にあるエレクトロンを励起し基板7又は制御ゲ
ート6に放出し消去を行う。つまシ通常装置内のEFR
OMは上部から紫外線を照射すると一律に消去される。
縁ゲート)型電界効果半導体装置(以下、EPROMと
いう。)を形成するMIS型電界効果トランジスタ(以
下、MIS型FETという。)は、第1図の模式的断面
図に示される様な構造を有し、一般にはチャンネル注入
と称される機構によりホットなエレクトロンを基板7内
で生じさせ、電荷捕獲層4にエレクトロン、を注入し書
込みを行う。−刃装置上部から紫外線を照射すると電荷
捕獲層4にあるエレクトロンを励起し基板7又は制御ゲ
ート6に放出し消去を行う。つまシ通常装置内のEFR
OMは上部から紫外線を照射すると一律に消去される。
なお第1図において1はソース。
2はドレイン、3は第1ゲート絶縁膜、5は第2ゲート
絶縁膜でおる。
絶縁膜でおる。
ところで、EFROMの中に、一部紫外線で消去されな
いFROM(プログラマプルリードオンリーメモリ)と
してのMIa型FETが簡単に作る事ができれば有用で
ある。例えば冗長性ビットへの切換のデータ又はスピー
ドグレード、製造上のデータ等多くの用途が考えられる
。
いFROM(プログラマプルリードオンリーメモリ)と
してのMIa型FETが簡単に作る事ができれば有用で
ある。例えば冗長性ビットへの切換のデータ又はスピー
ドグレード、製造上のデータ等多くの用途が考えられる
。
従来、そのために紫外線で消去されないMIS型FET
の上部を紫外線非透過性被膜(例えばAl、シリコン窒
化膜、ポリシリコン等)によって覆う構造のものが考案
されている。
の上部を紫外線非透過性被膜(例えばAl、シリコン窒
化膜、ポリシリコン等)によって覆う構造のものが考案
されている。
第2図(a)及び(b)はかかる従来+7)MIS型F
ETの構造を示す模式的平面図とそのA人′模式的断面
図である。ここで斜線を施しである8の部分が紫外線非
透過性被膜(以下、単に被膜という。)であシ、10は
ドレイン電極、9はそのコンタクトである。
ETの構造を示す模式的平面図とそのA人′模式的断面
図である。ここで斜線を施しである8の部分が紫外線非
透過性被膜(以下、単に被膜という。)であシ、10は
ドレイン電極、9はそのコンタクトである。
しかし、この従来のMIS型FETでは、被膜8の端部
で紫外線に対する開口aが大きく、基板7と被膜8間の
反射によって減衰していくが、第2図(b)中の破線で
示す様に、ある程度の紫外萄フエ電荷捕獲層4まで到達
し、長時間の紫外線照射では消去されるという欠点がめ
った。
で紫外線に対する開口aが大きく、基板7と被膜8間の
反射によって減衰していくが、第2図(b)中の破線で
示す様に、ある程度の紫外萄フエ電荷捕獲層4まで到達
し、長時間の紫外線照射では消去されるという欠点がめ
った。
この消去される速さを遅くするには、被膜8の端部から
電荷捕獲層4までの距離すを犬きくとるしか従来方法が
なく、紫外線で消去されないMIS型FETからなるF
ROM部分の占有面積が増大するという′欠点があった
。
電荷捕獲層4までの距離すを犬きくとるしか従来方法が
なく、紫外線で消去されないMIS型FETからなるF
ROM部分の占有面積が増大するという′欠点があった
。
例えば、紫外線照射時間が1回30分として、1000
回の書込み・消去サイクルを行ったとすると、紫外線で
消去されないFROMは少くなくとも500時間まで消
去されない事が必要でsb、これを満す距離すの長さは
100μm以上必要であった。
回の書込み・消去サイクルを行ったとすると、紫外線で
消去されないFROMは少くなくとも500時間まで消
去されない事が必要でsb、これを満す距離すの長さは
100μm以上必要であった。
又、前記対策によっても完全に消去を阻止する事は困難
で1)、製品の信頼性の面から問題も多く実用化されて
いないのが現状でらる。
で1)、製品の信頼性の面から問題も多く実用化されて
いないのが現状でらる。
(発明の目的)
本発明の目的は、上記欠点を除去することによシ、小面
積でかつ長時間紫外光照射を受けても消去されない高信
頼性の紫外線でデータ消去が不可能なMIS型電界効果
トランジスタを含む、ゲート絶縁膜中に電荷捕獲層を有
するMIS型電界効果半導体装置を煙供する事にある。
積でかつ長時間紫外光照射を受けても消去されない高信
頼性の紫外線でデータ消去が不可能なMIS型電界効果
トランジスタを含む、ゲート絶縁膜中に電荷捕獲層を有
するMIS型電界効果半導体装置を煙供する事にある。
(発明の構成)
本発明のMIS型電界効果半導体装置は、ゲート絶縁膜
中に電荷捕獲層を有するMIS型電界効果トランジスタ
を複数個有するMIS型電界効果半導体装置において、
前記MIS型電界効果トランジスタの上面及び少くとも
前記ゲート絶縁膜に連なる絶縁膜の側面のtlは全面に
紫外線非透過性被膜を形成し紫外叙によってデータ消去
が不可能な前記MIS型電界効果トランジスタと、紫外
線でデータ消去が可能な前記MIS型電界効果トランジ
スタをそれぞれ少くとも1個づつ同一基板上に形成した
事から構成される。
中に電荷捕獲層を有するMIS型電界効果トランジスタ
を複数個有するMIS型電界効果半導体装置において、
前記MIS型電界効果トランジスタの上面及び少くとも
前記ゲート絶縁膜に連なる絶縁膜の側面のtlは全面に
紫外線非透過性被膜を形成し紫外叙によってデータ消去
が不可能な前記MIS型電界効果トランジスタと、紫外
線でデータ消去が可能な前記MIS型電界効果トランジ
スタをそれぞれ少くとも1個づつ同一基板上に形成した
事から構成される。
(実施例)
以下、本発明の。実施例について図面を参照して説明す
る。
る。
第3図ta)及び(b)は本発明の一実施例に用いられ
る紫外線によってデータ消去が不可能なMIS型FET
の模式的平面図及びそのBB’模式的断面図である。な
お第3図(al 、 (b)は第2図(a) 、 (b
)K示した従来例に対応して示したものである。
る紫外線によってデータ消去が不可能なMIS型FET
の模式的平面図及びそのBB’模式的断面図である。な
お第3図(al 、 (b)は第2図(a) 、 (b
)K示した従来例に対応して示したものである。
本実施例のMIS型FETは、ゲート絶l#膜に連なる
絶縁膜12の側面に基板7の表面まで達するガード開孔
11を設け、従来FETの上面のみを被覆していた被膜
8′を電荷捕獲層4の全側面本覆う様に構成される。な
お、第3図(a)において、6′はゲート電極引き出し
拡散層、13はポリシリ−拡散ノーコンタクトである。
絶縁膜12の側面に基板7の表面まで達するガード開孔
11を設け、従来FETの上面のみを被覆していた被膜
8′を電荷捕獲層4の全側面本覆う様に構成される。な
お、第3図(a)において、6′はゲート電極引き出し
拡散層、13はポリシリ−拡散ノーコンタクトである。
更に、紫外繊非透過被膜8′としてシリコン窒化膜を0
.5〜2μm程度成長させ消去されないMIS型F E
Tを基板とシリコン窒化膜により完全に封止した構造
を有している。又、ゲート電極は紫外線に対する開口を
完全になくす目的から基板上の導電層と接続して外部と
配線するのが良い。仮に、紫外線が第3図(b)で示す
様な角度で照射されたとしても、破線で示す光路で反射
され、MIS型FETの電荷捕獲層4に紫外線U(到達
する事がなく、従ってデータが消去される事は全くない
。又、ガード開孔11と基板7の間に数十nmの間隔が
あっても、紫外線に対する開口が小さくほぼ同等の効果
が期待できる。
.5〜2μm程度成長させ消去されないMIS型F E
Tを基板とシリコン窒化膜により完全に封止した構造
を有している。又、ゲート電極は紫外線に対する開口を
完全になくす目的から基板上の導電層と接続して外部と
配線するのが良い。仮に、紫外線が第3図(b)で示す
様な角度で照射されたとしても、破線で示す光路で反射
され、MIS型FETの電荷捕獲層4に紫外線U(到達
する事がなく、従ってデータが消去される事は全くない
。又、ガード開孔11と基板7の間に数十nmの間隔が
あっても、紫外線に対する開口が小さくほぼ同等の効果
が期待できる。
従って、本実施例のMIS型FETは、第2図に示す従
来のMISmFETと異なり、紫外線の減衰を期待する
必要がないため、平面構造的に最小の間隔で設計する事
ができ高密度な配置が可能であり、第2図(b)に示す
従来の距離すに比較し、173〜115とする事ができ
る。
来のMISmFETと異なり、紫外線の減衰を期待する
必要がないため、平面構造的に最小の間隔で設計する事
ができ高密度な配置が可能であり、第2図(b)に示す
従来の距離すに比較し、173〜115とする事ができ
る。
更に、本実施例の構造を形成するには、従来のEFRO
Mのセルの囲りにガード開孔を形成すれば良く、その製
造フローを大きく変更する必要がなく又、他のプロセス
パラメータに影響を与える事もない。
Mのセルの囲りにガード開孔を形成すれば良く、その製
造フローを大きく変更する必要がなく又、他のプロセス
パラメータに影響を与える事もない。
なお、上記実施例では、紫外線非透過性被膜としてシリ
コン窒化膜を例としてとシ上げたが、例えば、アルミニ
ウム、ポリシリコン等によっても本発明の目的が達せら
れる事は明らかである。
コン窒化膜を例としてとシ上げたが、例えば、アルミニ
ウム、ポリシリコン等によっても本発明の目的が達せら
れる事は明らかである。
(発明の効果)
以上、詳細述べた如く、本発明によれば、上記の構成に
より、従来のEFROMのプロセスにガード開孔の工程
をつけ加えるだけで通常のEFROMとしてのMIB型
FETを有し、更に、この紫外線で消去されないFRO
Mは従来の装置の如く、入射された紫外綿イ;減衰する
距離をとる必要がないため、高密度に配置でき、従って
、高歩留でかつ低コストのものが製造できるところのゲ
ート絶縁膜中に電荷捕獲層を有するMIS型電界効果半
導体装置が得られる。
より、従来のEFROMのプロセスにガード開孔の工程
をつけ加えるだけで通常のEFROMとしてのMIB型
FETを有し、更に、この紫外線で消去されないFRO
Mは従来の装置の如く、入射された紫外綿イ;減衰する
距離をとる必要がないため、高密度に配置でき、従って
、高歩留でかつ低コストのものが製造できるところのゲ
ート絶縁膜中に電荷捕獲層を有するMIS型電界効果半
導体装置が得られる。
従って、本発明のMIS型半導体装置は、測定選別工程
での工数が大幅に低減できると共に、冗長ビットの切換
えを、高密度、高信頼性をもって行う事ができる。
での工数が大幅に低減できると共に、冗長ビットの切換
えを、高密度、高信頼性をもって行う事ができる。
第1図はゲー ト絶縁膜中に電荷捕獲層を有するMIS
型電界効果トランジスタの構成を示す模式的断面図、第
2図(a)及び(b)は従来の紫外線非透過性被膜を有
するMIS型電界効果トランジスタの構成を示す模式的
平面図及び模式的断面図、第3図(a)及び(b)は本
発明の一実施例の紫外線非透過性被膜を有するMIS型
電界効果トランジスタの構成を示す模式的平面図及び模
式的断面図でわる。 1・・・・・・ソース、2・・・・°・ドレイン、3・
・・・・・第1ゲート絶縁膜、4・・・・・・電荷捕獲
層、訃・・・・・第2ゲート絶縁膜、6・・・・・・制
御ゲート、6′・・・・・・ゲート電極引き出し拡散層
、7・・・・・・基板、8.8′・・・・・・紫外線非
透過性被膜、9・・・・・・コンタクト、10・・・・
・・ドレイン電極、11・・・・・・ガード開孔、12
・・・・・・ゲート絶縁膜に連なる絶縁膜、13・・・
・・・ポリシリ−拡散層コンタクト。 代理人 弁理士 内 原 晋、/、、、;ゞゝ−
さ・1、 ”C1 第1図
型電界効果トランジスタの構成を示す模式的断面図、第
2図(a)及び(b)は従来の紫外線非透過性被膜を有
するMIS型電界効果トランジスタの構成を示す模式的
平面図及び模式的断面図、第3図(a)及び(b)は本
発明の一実施例の紫外線非透過性被膜を有するMIS型
電界効果トランジスタの構成を示す模式的平面図及び模
式的断面図でわる。 1・・・・・・ソース、2・・・・°・ドレイン、3・
・・・・・第1ゲート絶縁膜、4・・・・・・電荷捕獲
層、訃・・・・・第2ゲート絶縁膜、6・・・・・・制
御ゲート、6′・・・・・・ゲート電極引き出し拡散層
、7・・・・・・基板、8.8′・・・・・・紫外線非
透過性被膜、9・・・・・・コンタクト、10・・・・
・・ドレイン電極、11・・・・・・ガード開孔、12
・・・・・・ゲート絶縁膜に連なる絶縁膜、13・・・
・・・ポリシリ−拡散層コンタクト。 代理人 弁理士 内 原 晋、/、、、;ゞゝ−
さ・1、 ”C1 第1図
Claims (1)
- ゲート絶縁膜中に電荷捕獲層を有するMIS型電界効果
トランジスタを複数個有するMIS型電界効果半導体装
置において、前記MIS型電界効果トランジスタの上面
及び少くとも前記ゲート絶縁膜に連なる絶縁膜の側面の
ほぼ全面に紫外線非透過性被膜を形成し紫外線によって
データ消去が不可能な前記MIS型電界効果トランジス
タと、紫外線でデータ消去が可能な前記MIS型電界効
果トランジスタをそれぞれ少なくとも1個づつ同一基板
上に形成した事を特徴とするMIS型電界効果半導体装
置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59126798A JPS616868A (ja) | 1984-06-20 | 1984-06-20 | Mis型電界効果半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59126798A JPS616868A (ja) | 1984-06-20 | 1984-06-20 | Mis型電界効果半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS616868A true JPS616868A (ja) | 1986-01-13 |
Family
ID=14944212
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59126798A Pending JPS616868A (ja) | 1984-06-20 | 1984-06-20 | Mis型電界効果半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS616868A (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01251759A (ja) * | 1988-03-31 | 1989-10-06 | Toshiba Corp | 半導体集積回路 |
JPH01276512A (ja) * | 1988-04-28 | 1989-11-07 | Kawaguchiko Seimitsu Kk | 透明導電膜用オフセット印刷インキ組成物 |
JPH0265277A (ja) * | 1988-08-31 | 1990-03-05 | Nec Corp | 不揮発性半導体メモリ装置 |
JPH02295173A (ja) * | 1989-04-10 | 1990-12-06 | Sgs Thomson Microelectron Srl | 自己整合で形成されたソース線及びドレイン線のあるepromメモリセルのテーブルクロス型マトリックスの製造と両立する構造を有するupromメモリセルの製造方法 |
US5070378A (en) * | 1988-09-22 | 1991-12-03 | Nec Corporation | Eprom erasable by uv radiation having redundant circuit |
US5150189A (en) * | 1986-02-28 | 1992-09-22 | Canon Kabushiki Kaisha | Semiconductor apparatus |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58197777A (ja) * | 1982-05-12 | 1983-11-17 | Mitsubishi Electric Corp | 半導体不揮発性記憶装置 |
-
1984
- 1984-06-20 JP JP59126798A patent/JPS616868A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58197777A (ja) * | 1982-05-12 | 1983-11-17 | Mitsubishi Electric Corp | 半導体不揮発性記憶装置 |
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