JPS61184002A - 電流源回路 - Google Patents
電流源回路Info
- Publication number
- JPS61184002A JPS61184002A JP60023306A JP2330685A JPS61184002A JP S61184002 A JPS61184002 A JP S61184002A JP 60023306 A JP60023306 A JP 60023306A JP 2330685 A JP2330685 A JP 2330685A JP S61184002 A JPS61184002 A JP S61184002A
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- JP
- Japan
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- voltage
- differential amplifier
- reference resistor
- resistor
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は電流源回路に関する。
差動アンプの出力に基づいた電流を基準抵抗に流し、こ
の基準抵抗の端子電圧と基準電圧とを上記差動アンプに
与えるようにした電流源回路であって、カレントミラー
回路でもって上記差動アンプの出力電流を基準抵抗に直
接流すように構成することにより、基準抵抗に加わる電
圧の大きさが、トランジスタのＶＩＩＥ等によって制限
されないようにしている。
の基準抵抗の端子電圧と基準電圧とを上記差動アンプに
与えるようにした電流源回路であって、カレントミラー
回路でもって上記差動アンプの出力電流を基準抵抗に直
接流すように構成することにより、基準抵抗に加わる電
圧の大きさが、トランジスタのＶＩＩＥ等によって制限
されないようにしている。
第３図はＩＣ化に適した温度特性を持たない電流源回路
の従来技術を示し、基準電圧Ｖ ＲＥＦを抵抗Ｒ１，Ｒ
２で分圧して得たＡ点の電圧がＩＣ外に接続された基準
抵抗Ｒの一端Ｂに加わるように、Ａ点及びＢ点の電圧を
差動アンプ１ （トランジスタＴｌ、Ｔ２）で比較し、
その比較出力電圧ＶをトランジスタＴ３で電流ｉに変換
し、この電流をカレントミラー構成のトランジスタＴ４
〜Ｔ６及びＴ７を介して上記基準抵抗Ｒの一端Ｂに流し
込んでいる。そして差動アンプ１の両人力がバランスし
た状態で、抵抗Ｒの電流をトランジスタＴ７とカレント
ミラーを成す電流出力トランジスタＴ８を介して電流源
出力■。Ｌｌアとして導出するように成っている。
の従来技術を示し、基準電圧Ｖ ＲＥＦを抵抗Ｒ１，Ｒ
２で分圧して得たＡ点の電圧がＩＣ外に接続された基準
抵抗Ｒの一端Ｂに加わるように、Ａ点及びＢ点の電圧を
差動アンプ１ （トランジスタＴｌ、Ｔ２）で比較し、
その比較出力電圧ＶをトランジスタＴ３で電流ｉに変換
し、この電流をカレントミラー構成のトランジスタＴ４
〜Ｔ６及びＴ７を介して上記基準抵抗Ｒの一端Ｂに流し
込んでいる。そして差動アンプ１の両人力がバランスし
た状態で、抵抗Ｒの電流をトランジスタＴ７とカレント
ミラーを成す電流出力トランジスタＴ８を介して電流源
出力■。Ｌｌアとして導出するように成っている。
差動アンプ１のバランス状態で、
が成立し、
で表される温特のない電流出力が得られる。
出力電流Ｉ。Ｕ７のＩＣ個々のばらつきを少なくするに
は、Ａ点の電圧を下げて、基準抵抗Ｒにかかる電圧を極
力大きくすることが有効である。つまり基準電圧Ｖ□、
の誤差ａ％を考慮すれば、抵抗Ｒにかかる電圧が１■±
ａ％よりも３Ｖ＋ａ％の方法が出力電流の誤差が小さい
。また前記式よＩ Ｒ２／Ｒ１が小さいほど、つまりＡ点の電圧が低いほど
抵抗Ｒ１，Ｒ２（拡散抵抗）のばらつきの影響は小さく
なる。
は、Ａ点の電圧を下げて、基準抵抗Ｒにかかる電圧を極
力大きくすることが有効である。つまり基準電圧Ｖ□、
の誤差ａ％を考慮すれば、抵抗Ｒにかかる電圧が１■±
ａ％よりも３Ｖ＋ａ％の方法が出力電流の誤差が小さい
。また前記式よＩ Ｒ２／Ｒ１が小さいほど、つまりＡ点の電圧が低いほど
抵抗Ｒ１，Ｒ２（拡散抵抗）のばらつきの影響は小さく
なる。
ところが、Ａ点から接地までは、差動アンプ１のトラン
ジスタＴ２のＶＩＩ！及び電流源Ｉを構成するトランジ
スタの■、が介在するから、Ａ点を１．７ｖ以下にする
ことは困難である。
ジスタＴ２のＶＩＩ！及び電流源Ｉを構成するトランジ
スタの■、が介在するから、Ａ点を１．７ｖ以下にする
ことは困難である。
本発明はこの問題を解消して、ばらつきが少なく非常に
精度の高い電流源回路を提供することを目的とする。
精度の高い電流源回路を提供することを目的とする。
本発明の電流源回路は、第１図において、一方の入力に
基準電圧Ｖ ＲＥＦが供給されている差動アンプ１と、
この差動アンプのコレクタ出力電流に応答して所定電流
を基準抵抗（Ｒ）に与えるカレントミラー回路２と、上
記基準抵抗（Ｒ）の端子電圧を上記差動アンプの他方の
入力に帰還する帰還路と、上記基準抵抗に流れる電流に
比例した電流出力を得る出力回路（出力トランジスタＴ
１４）とを備えている。
基準電圧Ｖ ＲＥＦが供給されている差動アンプ１と、
この差動アンプのコレクタ出力電流に応答して所定電流
を基準抵抗（Ｒ）に与えるカレントミラー回路２と、上
記基準抵抗（Ｒ）の端子電圧を上記差動アンプの他方の
入力に帰還する帰還路と、上記基準抵抗に流れる電流に
比例した電流出力を得る出力回路（出力トランジスタＴ
１４）とを備えている。
差動アンプ出力はその構成トランジスタのコレクタ電流
として得られ、このコレクタ電流はカレントミラーを通
じて基準抵抗に与えられるから、基準抵抗は必ず差動ア
ンプのエミッタ側に配置さることになり、電源電圧が限
られていても、基準抵抗に加わる電圧をトランジスタの
ＶＩＥに制限されずに大きくすることができる。
として得られ、このコレクタ電流はカレントミラーを通
じて基準抵抗に与えられるから、基準抵抗は必ず差動ア
ンプのエミッタ側に配置さることになり、電源電圧が限
られていても、基準抵抗に加わる電圧をトランジスタの
ＶＩＥに制限されずに大きくすることができる。
第１図は本発明の電流源回路の実施例を示し、差動゛ア
ンプ１をＰＮＰ ）ランジスタＴＩＯ，Ｔｌｌで構成し
、その両人力に、第３図と同様に基準電圧Ｖ□、を抵抗
Ｒ１，Ｒ２で分圧した電圧及び外部基準抵抗Ｒの一端Ｂ
に生じる電圧を与えている。
ンプ１をＰＮＰ ）ランジスタＴＩＯ，Ｔｌｌで構成し
、その両人力に、第３図と同様に基準電圧Ｖ□、を抵抗
Ｒ１，Ｒ２で分圧した電圧及び外部基準抵抗Ｒの一端Ｂ
に生じる電圧を与えている。
差動アンプ１の負荷トランジスタＴ１２に流れる電流は
このトランジスタと共にカレントミラー回路２を構成す
る電流源トランジスタＴ１３を経て基準抵抗Ｒに流され
、差動アンプ１のバランス状態で、 の電流が抵抗Ｒを流れて、これに対応した出力電流が７
１３とカレントミラーを成す出力トランジスタＴ１４か
ら導出される。
このトランジスタと共にカレントミラー回路２を構成す
る電流源トランジスタＴ１３を経て基準抵抗Ｒに流され
、差動アンプ１のバランス状態で、 の電流が抵抗Ｒを流れて、これに対応した出力電流が７
１３とカレントミラーを成す出力トランジスタＴ１４か
ら導出される。
この構成によれば、抵抗Ｒ２が差動アンプ１を構成する
トランジスタＴ１０．Ｔ１１のコレクタ側に入り、また
基準抵抗Ｒ２がエミッタ側に入るから、Ｒ２を小さくし
てＡ点の電圧を例えば０．９Ｖ程度まで下げることがで
きる。従って基準抵抗Ｒの印加電圧は相対的に上昇し、
出力電流のばらつきは小さくなる。
トランジスタＴ１０．Ｔ１１のコレクタ側に入り、また
基準抵抗Ｒ２がエミッタ側に入るから、Ｒ２を小さくし
てＡ点の電圧を例えば０．９Ｖ程度まで下げることがで
きる。従って基準抵抗Ｒの印加電圧は相対的に上昇し、
出力電流のばらつきは小さくなる。
Ｒ１
持つが、Ｒ２が小さければ、抵抗Ｒ１，Ｒ２のばらつき
による出力電流値への影響は小さくなる。
による出力電流値への影響は小さくなる。
なお第１図において、差動アンプ１のトランジスタ１１
のコレクタにも、バランスの為にＴＩＯと同様なトラン
ジスタ負荷を挿入してもよい。また外部の基準抵抗Ｒは
、ＩＣ内に形成された抵抗（通常は拡散抵抗）で形成し
てもよい。また差動アンプ１の電流源抵抗Ｒ３は能動素
子電流源であってもよい。
のコレクタにも、バランスの為にＴＩＯと同様なトラン
ジスタ負荷を挿入してもよい。また外部の基準抵抗Ｒは
、ＩＣ内に形成された抵抗（通常は拡散抵抗）で形成し
てもよい。また差動アンプ１の電流源抵抗Ｒ３は能動素
子電流源であってもよい。
次に第２図は第１図の変形例を示し、差動をアンプｌが
ＮＰＮ ）ランジスタＴ１５．Ｔ１６で構成され、負荷
トランジスタＴ１７、電流源トランジスタＴ１８．出力
トランジスタＴ１９は夫々ＮＰＮ）ランジスタで構成さ
れている。第１図とは電源の極性が逆で、同様な動作を
行い、基準抵抗が差動アンプ１のトランジスタＴ１５の
ベースと接地（つまりＴ１５のエミッタ電源側）との間
に位置するから、分圧抵抗Ｒ１，Ｒ２によるＡ点の電圧
を十電源側に高くして、抵抗Ｒに加わる電圧を大きくし
、これによって出力電流のばらつきを小さくすることが
できる。
ＮＰＮ ）ランジスタＴ１５．Ｔ１６で構成され、負荷
トランジスタＴ１７、電流源トランジスタＴ１８．出力
トランジスタＴ１９は夫々ＮＰＮ）ランジスタで構成さ
れている。第１図とは電源の極性が逆で、同様な動作を
行い、基準抵抗が差動アンプ１のトランジスタＴ１５の
ベースと接地（つまりＴ１５のエミッタ電源側）との間
に位置するから、分圧抵抗Ｒ１，Ｒ２によるＡ点の電圧
を十電源側に高くして、抵抗Ｒに加わる電圧を大きくし
、これによって出力電流のばらつきを小さくすることが
できる。
なお上述の第１図、第２図の実施例では、差動アンプ１
の一方の入力に与える基準電圧を分圧抵抗Ｒ１，Ｒ２で
もって作っているが、他の基準電圧源に置換えることが
できる。この場合でも、第１図又は第２図の構成により
、基準抵抗Ｒに与える電圧を極力大きくして、出力電流
の精度を高めることができる。また実施例の電流回路は
、同一の精度（誤差）を得るのであれば、電源電圧は第
３図の従来回路よりも低くてよいという特徴を有する。
の一方の入力に与える基準電圧を分圧抵抗Ｒ１，Ｒ２で
もって作っているが、他の基準電圧源に置換えることが
できる。この場合でも、第１図又は第２図の構成により
、基準抵抗Ｒに与える電圧を極力大きくして、出力電流
の精度を高めることができる。また実施例の電流回路は
、同一の精度（誤差）を得るのであれば、電源電圧は第
３図の従来回路よりも低くてよいという特徴を有する。
本発明は上述の如く、基準抵抗に与えられる電圧がトラ
ンジスタの■１によって規制されないような構成を採用
したから、基準抵抗に加わる電圧を大きくして、基準電
圧のばらつき又は基準抵抗のばらつきによる出力電流の
誤差を少なくすることが可能になり、高精度の電流源回
路が得られる。
ンジスタの■１によって規制されないような構成を採用
したから、基準抵抗に加わる電圧を大きくして、基準電
圧のばらつき又は基準抵抗のばらつきによる出力電流の
誤差を少なくすることが可能になり、高精度の電流源回
路が得られる。
第１図は本発明の電流源回路の一実施例を示す回路図、
第２図は素子及び電源の極性を逆にした第１図の変形例
を示す回路図、第３図は従来回路である。 なお図面に用いられた符号において、 １〜・−−一−−−−・−−−−一−−−差動アンプ２
−・・−・・・−−−−−−ｍ−カレントミラー回路Ｒ
−−−−−−−−−−・・−・基準抵抗Ｖ 、１２ Ｆ
−−−−−−−−・−基準電圧Ｉ ０ＵＴ−−−一出
力電流 である。
第２図は素子及び電源の極性を逆にした第１図の変形例
を示す回路図、第３図は従来回路である。 なお図面に用いられた符号において、 １〜・−−一−−−−・−−−−一−−−差動アンプ２
−・・−・・・−−−−−−ｍ−カレントミラー回路Ｒ
−−−−−−−−−−・・−・基準抵抗Ｖ 、１２ Ｆ
−−−−−−−−・−基準電圧Ｉ ０ＵＴ−−−一出
力電流 である。
Claims (1)
- 一方の入力に基準電圧が供給されている差動アンプと、
この差動アンプのコレクタ出力電流に応答して所定電流
を基準抵抗に与えるカレントミラー回路と、上記基準抵
抗の端子電圧を上記差動アンプの他方の入力に帰還する
帰還路と、上記基準抵抗に流れる電流に比例した電流出
力を得る出力回路とを備える電流源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60023306A JPS61184002A (ja) | 1985-02-08 | 1985-02-08 | 電流源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60023306A JPS61184002A (ja) | 1985-02-08 | 1985-02-08 | 電流源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61184002A true JPS61184002A (ja) | 1986-08-16 |
Family
ID=12106915
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60023306A Pending JPS61184002A (ja) | 1985-02-08 | 1985-02-08 | 電流源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61184002A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04290006A (ja) * | 1990-10-29 | 1992-10-14 | Internatl Business Mach Corp <Ibm> | ヒステリシス回路 |
| JP2004258643A (ja) * | 2003-02-06 | 2004-09-16 | Nec Electronics Corp | 表示パネルの電流駆動回路及び電流駆動装置 |
-
1985
- 1985-02-08 JP JP60023306A patent/JPS61184002A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04290006A (ja) * | 1990-10-29 | 1992-10-14 | Internatl Business Mach Corp <Ibm> | ヒステリシス回路 |
| JP2004258643A (ja) * | 2003-02-06 | 2004-09-16 | Nec Electronics Corp | 表示パネルの電流駆動回路及び電流駆動装置 |
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