JPS6112144U - プログラムテスト装置 - Google Patents

プログラムテスト装置

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JPS6112144U
JPS6112144U JP9711384U JP9711384U JPS6112144U JP S6112144 U JPS6112144 U JP S6112144U JP 9711384 U JP9711384 U JP 9711384U JP 9711384 U JP9711384 U JP 9711384U JP S6112144 U JPS6112144 U JP S6112144U
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JP
Japan
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memory
contents
setting circuit
limit values
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Pending
Application number
JP9711384U
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Inventor
一志 岩橋
Original Assignee
三菱電機株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は、本考案にかかるプログラムテスト装置の一実施例
を示すブ冶ツク図であり、図中、１は計算機、２は計算
機内のプログラムヵウンタ、３ａ，３ｂ，・・・３ｎは
計算機内のデータレジスタ、４は計算機内のアドレスレ
ジスタ、５はアドレス設定回路、６は比較データ範囲設
定回路、７は第１のレジスタ回路、８は第２のレジスタ
回路、９は比較回路、１０は表示回路、ｌｌａ，ｌｌｂ
ｑ”・１１ｎはレジスタ、１ ２ａ， １ ２ｂ，
・・・１ ２ｎはレジスタ、１３ａ，１３ｂ，・・・１
３ｎはレジスタ、１４は制御信号である。

Claims (1)

    【実用新案登録請求の範囲】
  1. 計算機内のメモリ内の内容を取り出すべくアドレスを設
    定するためのアドレス設定回路と、前記アドレス設定回
    路で設定した計算機内のメモリの内容及び計算機内のプ
    ログラムカウンタをメモリへの書込み命令毎に読取りそ
    の内容を格納する手段と、上記メモリから読取った内容
    をチェックするための何組かの許容上限値及び許容下限
    値を設定する比較データ範囲設定回路と、読取ったメモ
    リの内容が前記設定による何組かの許容上限値及び許容
    下限値の範囲を満足するかを比較する比較回路とを備え
    たことを特徴とプログラムテスト装置。
JP9711384U 1984-06-28 1984-06-28 プログラムテスト装置 Pending JPS6112144U (ja)

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JP9711384U JPS6112144U (ja) 1984-06-28 1984-06-28 プログラムテスト装置

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JP9711384U JPS6112144U (ja) 1984-06-28 1984-06-28 プログラムテスト装置

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Publication Number Publication Date
JPS6112144U true JPS6112144U (ja) 1986-01-24

Family

ID=30656640

Family Applications (1)

Application Number Title Priority Date Filing Date
JP9711384U Pending JPS6112144U (ja) 1984-06-28 1984-06-28 プログラムテスト装置

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JP (1) JPS6112144U (ja)

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