JPS5974630A - ドライエツチング装置 - Google Patents

ドライエツチング装置

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Publication number
JPS5974630A
JPS5974630A JP18457082A JP18457082A JPS5974630A JP S5974630 A JPS5974630 A JP S5974630A JP 18457082 A JP18457082 A JP 18457082A JP 18457082 A JP18457082 A JP 18457082A JP S5974630 A JPS5974630 A JP S5974630A
Authority
JP
Japan
Prior art keywords
wafer
etching
mask
peripheral section
electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18457082A
Other languages
English (en)
Inventor
Atsushi Fujisawa
藤沢 厚
Hiroshi Maejima
前島 央
Seiichi Kato
誠一 加藤
Keizo Nomura
敬三 野村
Tsutomu Okabe
勉 岡部
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP18457082A priority Critical patent/JPS5974630A/ja
Publication of JPS5974630A publication Critical patent/JPS5974630A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting

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  • Drying Of Semiconductors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、半導体装置の製造過程等で使用されるドライ
エツチング装置に関する。
高密度に集積化された半導体装置の製造プロセスにおい
て、微細パターン形成のため、従来のウェットエツチン
グ技術−代って高い精度を持つドライエツチング技術が
開発され、特に、エツチング機構が気体電気化学反応を
利用する反応性ドライエツチング技術は、エツチング速
度1選抗性が共に優れているため、広く用いられてきた
従来のこの種のドライエツチング装置として、例えば第
1図に示すようなものがある。
第1図において、エツチング反応室1内には一対の平行
平板電極2.3が設けられ、上部電極2には高周波発生
器4が接続されている。下部電極3はその上面にエツチ
ング対象物としてのウエノ・5を支持し得るように構成
されてサセプタとしての役目を兼用するようになってい
る。反応室1にはエツチング反応ガス(例えば、CF4
 、 Cc−134゜Bc、63+02等)を導入する
だめの導入口6と、室内排気のための排気ロアとが設け
られている。
前記構成にかかるドライエツチング装置によりウェハ5
についてのエツチング処理を実施する場合、サセプタと
しての電極3上に電極保護用マスク8を被着した後、マ
スク8の中央孔内にウエノ・5を入れて電極3に載置す
る。その後、平行平板電極2.3間に高周波電流をかけ
ながら、反応ガスの導入と排気とを行なうと、ドライエ
ツチング加工が実施される。
しかしながら、従来のドライエツチング装置にあっては
、電界による物理的エツチング反応がウェハの周縁(エ
ツジ)に集中する傾向があるため、第2図に示すように
、ウエノ・の周辺部において工ソチング速度が速くなシ
、ウエノ・全面におけるエツチング量の不均一の原因に
なるという欠点があった。
本発明の目的は、前記従来技術の欠点を解消し、エツチ
ング速度を均一化できるドライエツチング装置を提供す
るにある。
以下、本発明を図面に示す実施例にしだがって説明する
第3図は本発明の一実施例を示′す縦断面図であシ、第
1図に示す構成要素と同一のものには同一符号が付しで
ある。
本実施例において、電極保護用マスク8の中央孔上には
エツチング抑制用マスク9が載置固定されており、この
マスク9はサセプタ電極3上に載置されたウェハ5の周
辺部の一定幅をウェハ上面から若干離間して被覆するよ
うにウェハ5の外形とほぼ相似形をなすリング形状に形
成されている。
次に作用を説明する。
平行平板電極2,3に高周波電流をかけながら、反応ガ
スの導入と排気とを行なうと、エツチング反応が起こる
。この場合、プラズマ反応による気体電気化学的エツチ
ングと、電極2,3間の電界によるイオンの加速を利用
した物理的な異方性エツチングの両方の反応が並行して
起こる。
ところが、電界はエツジ(尖端)に集中する傾向がある
ため、ウェハの周縁においてイオンの加速による物理的
な異方性エツチング反応が集中的に起シ、従来は第2図
に示すように、ウェハの周辺部においてエツチング速度
が極めて早くなってしまう現象が発生していた。
しかし、本実施例では、ウェハ5の周辺部はエツチング
抑制用マスク9によって被覆されているため、ウェハ5
の周縁(エツジ)に電界が集中する傾向が緩和され、イ
オンの加速による物理的な異方性エツチング反応はウェ
ハ5の中央部とほぼ等しい速度で進行することになる。
また、ウェハ5の周辺部はエツチング抑制用マスク9に
密着されて被覆されているのではなく、若干の空間をと
って被覆されているので、気体電気化学的反応を起した
反応成分はウェハ周辺部にも流れ込み、よって、気体電
気化学的エツチングも周辺部と中央部とでほぼ等しい速
度で進行する。
このように、本実施例によれば、物理的エツチングと化
学的エツチングとの両反応がウエノ・の周辺部と中央部
とに渡ってほぼ等しく進行するため、第4図に示すよう
に、ウエノh全面におけるエツチング速度がほぼ等しく
なる。したがって、ウエノ・全面におけるエツチング量
が均一になり、エツチング精度が向上し、ひいては半導
体装置の製造についての歩留シが向上する。
なお、被覆すべきウエノ・周辺部の幅やウエノ・とマス
クとの離間寸法等は、例えば、電界の強さ、反応ガスの
種類、濃度、流速、排気量等々の種々の条件によって異
なるから、条件に応じて適宜選定すればよい。また、エ
ツチング抑制用マスクの材質は、例えばフッ素樹脂(テ
フロン)、石英等の非電導材、アルミニウム等の電導材
、電導材と非電導材とのコーテイング材を使用すること
ができる。エツチング抑制用マスクは電極保護用マスク
と一体的に形成してもよいが、サセプタが電極と別物で
ある場合には電極保護用マスクは省略できる。
また、平行平板電・種型のドライエツチング装置につき
説明したが、本発明は、他の化学的ドライエツチング装
置および物理的ドライエツチング装置(スパッタエツチ
ング装置、イオンビームエツチング装置等)に適用する
ことができ、さらに、エツチング対象物もウェハに限定
されるものではない。
以上説明したように、本発明によれば、エツチング対象
物全面に渡ってエツチング速度を均一化することができ
る。
【図面の簡単な説明】
第1図は従来例を示す縦断面図、 第2図は従来例によるウェハ全面におけるエツチング速
度の分布図、 第3図は本発明の一実施例を示す縦断面図。 第4図は同実施例によるウエノ・全面におけるエツチン
グ速度の分布図である。 1・・・反応室、2・・・電極、3・・・サセプタ電極
、5・・・ウェハ、9・・エノチンク抑制用マスク。 第  3 第  1  図 第  2  図 ウェハtのイ宜1 [′21

Claims (1)

    【特許請求の範囲】
  1. 1、エツチング対象物を支持するサセプタ上にエツチン
    グ対象物の周辺部を近接して被覆するエツチング抑制用
    マスクを設けてなるドライエツチング装置。
JP18457082A 1982-10-22 1982-10-22 ドライエツチング装置 Pending JPS5974630A (ja)

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Application Number Priority Date Filing Date Title
JP18457082A JPS5974630A (ja) 1982-10-22 1982-10-22 ドライエツチング装置

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JP18457082A JPS5974630A (ja) 1982-10-22 1982-10-22 ドライエツチング装置

Publications (1)

Publication Number Publication Date
JPS5974630A true JPS5974630A (ja) 1984-04-27

Family

ID=16155513

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18457082A Pending JPS5974630A (ja) 1982-10-22 1982-10-22 ドライエツチング装置

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JP (1) JPS5974630A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63177520A (ja) * 1987-01-19 1988-07-21 Matsushita Electric Ind Co Ltd ドライエッチング方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63177520A (ja) * 1987-01-19 1988-07-21 Matsushita Electric Ind Co Ltd ドライエッチング方法

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