JPS5859653A - 位相同期回路 - Google Patents
位相同期回路Info
- Publication number
- JPS5859653A JPS5859653A JP57127263A JP12726382A JPS5859653A JP S5859653 A JPS5859653 A JP S5859653A JP 57127263 A JP57127263 A JP 57127263A JP 12726382 A JP12726382 A JP 12726382A JP S5859653 A JPS5859653 A JP S5859653A
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- JP
- Japan
- Prior art keywords
- phase
- signal
- output
- signals
- detectors
- Prior art date
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- Granted
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
- H04L27/18—Phase-modulated carrier systems, i.e. using phase-shift keying
- H04L27/22—Demodulator circuits; Receiver circuits
- H04L27/227—Demodulator circuits; Receiver circuits using coherent demodulation
- H04L27/2271—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals
- H04L27/2273—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals associated with quadrature demodulation, e.g. Costas loop
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は多相デジタル位相変調された入力信・号よ艶搬
送波信号を再生し、前記信号に位相同期した雑音成分の
少ない搬送波信号を得るベースバンド回路にて構成され
九位相同期回路に関するものである。
送波信号を再生し、前記信号に位相同期した雑音成分の
少ない搬送波信号を得るベースバンド回路にて構成され
九位相同期回路に関するものである。
最近ベースバンド回路にて構成された位相同期回路が研
究されてお勤、その研究目標のlっとして構成エエット
を簡単化する点があげられる。
究されてお勤、その研究目標のlっとして構成エエット
を簡単化する点があげられる。
この例として本発明者らが昭和60年12月2日に%許
出顧した「位相同期回路」がある。
出顧した「位相同期回路」がある。
本発明は、この特許よりもさらに構成を簡単化したもの
である。
である。
本発明の目的は、構成がきわめて簡単な位相同期回路を
提供することKある。
提供することKある。
第1図は本発明の8相位相同期回路のh鴨例であや、第
2図は萬1図の回路の各部の波形例である。
2図は萬1図の回路の各部の波形例である。
第1図において、11は低域−波器、12は電圧制御発
振器、18は入力端子、19は纂10位相検波器、2G
は第2の位相検波器、21は第8の位相検波器、22は
第4の位相検波器、移相器、26祉減算器、26′は加
算器、27および27′は減衰器、48.48′、45
および46は全波整流回路、44は減算器、28〜81
ti第1−第4の書間信号出力端子である。
振器、18は入力端子、19は纂10位相検波器、2G
は第2の位相検波器、21は第8の位相検波器、22は
第4の位相検波器、移相器、26祉減算器、26′は加
算器、27および27′は減衰器、48.48′、45
および46は全波整流回路、44は減算器、28〜81
ti第1−第4の書間信号出力端子である。
入力信号周波数の#1ぼ近くで発振している電圧制御発
振器12の出力は4分岐されて第1は介して位相検波数
22へ供給されるe第1−纂4の位相検波器19〜22
に入力信号が同一位相状態で供給されており、第1〜第
4の位相検波器19〜22の出力端子28〜81にはそ
れぞれ第1〜第4の復調信号が得られる。絡lの復調信
号(第6図86)は第2の復調信号(萬6図86)より
72ジアンだけ進んでいる。同様に142の復調信号は
第8の復調信号(1116図87)より1ラジアンだ1
迩んでおり、編8のiラジアンだけ進んでいる。従って
第1の復調信号86は第8の復調信号87よりも!−ジ
シアン進んでいる・この第1および第8復調信号はそれ
ぞれ減衰器i!7′および27に介して減算器!6およ
び加算器26′に供給される。減衰器27は第1の復調
信号と第8の復調信号との振幅比を1.−(1i)とな
るように第8の復調信号を減衰させる。従りて、減算器
26の出力は第6図47のように第1の復調信号よりと
ラジアン進6 んだ信号となる。また、加算器26′の出力は、第6図
48のように第8の復調信号よ1ジシアン進んだ信号と
なる。このように減算器26および減衰器27と、加算
器26′および減衰器27′はそれぞれ復調信号をiラ
ジアン移相する移送器である。
振器12の出力は4分岐されて第1は介して位相検波数
22へ供給されるe第1−纂4の位相検波器19〜22
に入力信号が同一位相状態で供給されており、第1〜第
4の位相検波器19〜22の出力端子28〜81にはそ
れぞれ第1〜第4の復調信号が得られる。絡lの復調信
号(第6図86)は第2の復調信号(萬6図86)より
72ジアンだけ進んでいる。同様に142の復調信号は
第8の復調信号(1116図87)より1ラジアンだ1
迩んでおり、編8のiラジアンだけ進んでいる。従って
第1の復調信号86は第8の復調信号87よりも!−ジ
シアン進んでいる・この第1および第8復調信号はそれ
ぞれ減衰器i!7′および27に介して減算器!6およ
び加算器26′に供給される。減衰器27は第1の復調
信号と第8の復調信号との振幅比を1.−(1i)とな
るように第8の復調信号を減衰させる。従りて、減算器
26の出力は第6図47のように第1の復調信号よりと
ラジアン進6 んだ信号となる。また、加算器26′の出力は、第6図
48のように第8の復調信号よ1ジシアン進んだ信号と
なる。このように減算器26および減衰器27と、加算
器26′および減衰器27′はそれぞれ復調信号をiラ
ジアン移相する移送器である。
次にこの減算器26および加算器26′はそれぞれ全波
整流回路48および48′に供給され、その出力に第6
図の49および6oのような波形を得る。この全波整流
回路48および411’の出力は減算器44で減算され
、第6図の波形61は、各全波整流回路45.46K1
m次供給され、それぞれ第6図の波形62および58と
なる。
整流回路48および48′に供給され、その出力に第6
図の49および6oのような波形を得る。この全波整流
回路48および411’の出力は減算器44で減算され
、第6図の波形61は、各全波整流回路45.46K1
m次供給され、それぞれ第6図の波形62および58と
なる。
こOように、第6図のように、復調信号IS〜88の位
相安定点Cと、位相誤差信qssの位相点定点・とが一
致しているので、位相誤差信号5sを低域−波1W11
を介して電圧制御発振器に2の制御、信号とすれば、第
1図の位相同期回路は正常に動作する。
相安定点Cと、位相誤差信qssの位相点定点・とが一
致しているので、位相誤差信号5sを低域−波1W11
を介して電圧制御発振器に2の制御、信号とすれば、第
1図の位相同期回路は正常に動作する。
なお、第1図における移相回路は、第1および第8の復
調信号t−iラジアン進ませ3例であ(−ト士かの場合
でも本発明による位相同期回路は成立することは位相誤
差信号68を参照すれば明らかである。−11移相回路
は第1図において、減衰器26および加算器26′の代
襲にそれぞれ加算器および減算器を用いることにより構
成できる。又、(hss)移相回路は第!の復調回路と
第4の復調信号とを振幅比1:tals7の一合で加算
あるいは減算する回路で構成できる。
調信号t−iラジアン進ませ3例であ(−ト士かの場合
でも本発明による位相同期回路は成立することは位相誤
差信号68を参照すれば明らかである。−11移相回路
は第1図において、減衰器26および加算器26′の代
襲にそれぞれ加算器および減算器を用いることにより構
成できる。又、(hss)移相回路は第!の復調回路と
第4の復調信号とを振幅比1:tals7の一合で加算
あるいは減算する回路で構成できる。
4w t
は減算する回路で構成できる。(7±r6最相回路は第
2復調信号と第4復調信号どの振幅−m:6 1の割合で加算あるいは減算する回路で構成でる%A社
(T−ts’あるいは(−4”−’−)K選択した場
16 合は、位相誤差信号680位相安定点dが一シフトする
九め、位相誤差信号580安定動作領域の傾斜が逆にな
るため、位相誤差信号68の極性を逆にする必要がある
。
2復調信号と第4復調信号どの振幅−m:6 1の割合で加算あるいは減算する回路で構成でる%A社
(T−ts’あるいは(−4”−’−)K選択した場
16 合は、位相誤差信号680位相安定点dが一シフトする
九め、位相誤差信号580安定動作領域の傾斜が逆にな
るため、位相誤差信号68の極性を逆にする必要がある
。
以上の説明のごとく、従来の位相同期回路に比して構成
を非常に簡単にするこiができる。
を非常に簡単にするこiができる。
第1図は本発明の8相位相回路の実施例、第2図は第1
図における回路の各部波形である。
図における回路の各部波形である。
Claims (1)
- 【特許請求の範囲】 8相位相変調信号を検出する4個の位相検波器と;前記
位相検波器の復調信号のうち互に直交関係にある2個の
復調信号txectilPi比lニー(シで加算および
減算して前記直交関係にある12個の復調信号tそれぞ
れiラジアン移相する2個O移相器と;前記2個の移相
器の出力【それぞれ全波整流する第1および纂2の全波
整流回路と;前記第1と第2の全波整流回路の出力を減
算する減算回路と;前記減算回路の出力に直列に順次接
続された第8および第4の全波整流回路と;前記第4の
全波整流回路の出力に応動し前記位相検波器に信号を送
出する周波数可変発振器とを含む位相同期回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57127263A JPS5859653A (ja) | 1982-07-21 | 1982-07-21 | 位相同期回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57127263A JPS5859653A (ja) | 1982-07-21 | 1982-07-21 | 位相同期回路 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP51009068A Division JPS5926149B2 (ja) | 1975-12-02 | 1976-01-30 | 位相同期回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5859653A true JPS5859653A (ja) | 1983-04-08 |
JPH023581B2 JPH023581B2 (ja) | 1990-01-24 |
Family
ID=14955700
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57127263A Granted JPS5859653A (ja) | 1982-07-21 | 1982-07-21 | 位相同期回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5859653A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6163224A (en) * | 1998-08-24 | 2000-12-19 | Nec Corporation | PLL circuit and method of controlling the same |
JP2007040459A (ja) * | 2005-08-04 | 2007-02-15 | Nissin Kogyo Co Ltd | 車両用ディスクブレーキ |
-
1982
- 1982-07-21 JP JP57127263A patent/JPS5859653A/ja active Granted
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6163224A (en) * | 1998-08-24 | 2000-12-19 | Nec Corporation | PLL circuit and method of controlling the same |
JP2007040459A (ja) * | 2005-08-04 | 2007-02-15 | Nissin Kogyo Co Ltd | 車両用ディスクブレーキ |
Also Published As
Publication number | Publication date |
---|---|
JPH023581B2 (ja) | 1990-01-24 |
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