JPS5821967A - Facsimile signal supplying circuit of electronic facsimile device - Google Patents
Facsimile signal supplying circuit of electronic facsimile deviceInfo
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- JPS5821967A JPS5821967A JP56119269A JP11926981A JPS5821967A JP S5821967 A JPS5821967 A JP S5821967A JP 56119269 A JP56119269 A JP 56119269A JP 11926981 A JP11926981 A JP 11926981A JP S5821967 A JPS5821967 A JP S5821967A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/04—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
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- Signal Processing (AREA)
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Abstract
Description
【発明の詳細な説明】
この発明は、電子模写装置−例えば、ファクシl装置や
プリンタ装置−における模写信号供給回路Kllするも
のである。DETAILED DESCRIPTION OF THE INVENTION The present invention is directed to a reproduction signal supply circuit Kll in an electronic reproduction apparatus such as a facsimile machine or a printer apparatus.
電子模写装置において、そのプリント機構部に杜、例え
ばサーマルヘッド中電荷媒体などが用いられる。ここで
、サーマルヘッドをブロック単位で駆動して記録処理す
る回路を第1図に示す。2. Description of the Related Art In an electronic copying apparatus, a material such as a charge medium in a thermal head is used in its printing mechanism. Here, FIG. 1 shows a circuit for driving the thermal head block by block to perform recording processing.
第1図において、1はサーマルヘッド群を示す。In FIG. 1, 1 indicates a group of thermal heads.
このサーマルヘッド群1は、例えばA4列の用紙用とし
ては、1ブロツクにサーマル素子を128個含むサーマ
ルヘッドブロック11.12.13.−−−。This thermal head group 1 includes, for example, thermal head blocks 11, 12, 13, . ---.
In(ns+527)まで27個有する。It has 27 up to In(ns+527).
これらサーマルへラドブロック11 、12 、13
、−−−@1nt)各々から慮、ブロックセレクト用デ
ータを入力するため信号ライン21,22,23.−−
−。These thermal Radblocks 11, 12, 13
, ---@1nt) respectively, signal lines 21, 22, 23 . ---
−.
2nが導出される。更に1信号ライン21,22.23
゜” −−e 2 ”の先端には夫々ブロックセレクト
用データ入力用の入力端子31.32e33+ −−”
’+3nが設けられる。2n is derived. In addition, one signal line 21, 22, 23
There are input terminals 31,32e33+-- for inputting data for block selection at the tips of ゜"--e2", respectively.
'+3n is provided.
また、サーマルへラドブロック11 、12 、13
、−−−、lfiの各々には、サーマ〃素子64儂に通
じ、画信号データを入力す石丸めの画信号データライン
41,42.4L−−−$4111(fnse64)が
導出される。この画信号データライン41.42,43
゜−−−e4mの先端の夫々には入力端子51 、52
。In addition, Radblock 11, 12, 13 to thermal
, ---, lfi, rounded image signal data lines 41, 42.4L---$4111 (fnse64) are led out to each of the thermistor elements 64 and input image signal data. This image signal data line 41, 42, 43
゜---E4m has input terminals 51 and 52 at each end.
.
閏、−−−5mが設けられる。A leapfrog ---5m is provided.
このように構成されたサーマルヘッド群IKよりて、例
えは印字を行わんとすると自は以下のようにする。即ち
、入力端子51.52.53.−−−。For example, when printing is to be performed using the thermal head group IK configured as described above, the procedure is as follows. That is, input terminals 51, 52, 53. ---.
5mK印字すべ自画信号データの1ライン中最初のサー
マルブロック11が印字すべきデータを与える。The first thermal block 11 in one line of 5mK printing self-portrait signal data provides data to be printed.
そして、サーマルブロック11を選択するため、入力端
子31にアクティブなブロックセレクト用データを与え
る。これによって、サーマルブロック11に対応する印
字が行なわれる。Then, in order to select the thermal block 11, active block selection data is applied to the input terminal 31. As a result, printing corresponding to the thermal block 11 is performed.
更に1サーマルブロック12,13,14.−−−。Furthermore, one thermal block 12, 13, 14. ---.
1mKも、同様に信号を順次送シ、第1ラインの印字を
終了する。そして、印字用紙を1ライン分搬送して、前
述と同様の動作を行い、更にこれを繰シ返えすことKよ
p1ページ全体の印字が行なわれる。Similarly, for 1mK, the signals are sent sequentially and the printing of the first line is completed. Then, the printing paper is conveyed by one line, the same operation as described above is performed, and this is repeated to print the entire page K1.
このような、プ四ツク単位で記―処11を行うための1
従来の模写信号供給回路は、第2図の様である。つt夛
、ブロックセレクト用デコーダ2と、画信号データラッ
チ囲路3とからなる回路である。1 for recording 11 in blocks like this.
A conventional reproduction signal supply circuit is shown in FIG. The circuit consists of a block selection decoder 2 and an image signal data latch circuit 3.
ブーツクセレクト用デコーダ2にはブロックセレクト用
のデータが通過するデータバス4が接続されている。そ
して、例えば、5ビツトのコードがデータバス4を介し
て、ブロックセレクト用デコーダ2に与えられると、2
7ビツトの出力信号にデコードし出力する。A data bus 4 through which block select data passes is connected to the boot select decoder 2. For example, when a 5-bit code is given to the block select decoder 2 via the data bus 4, 2
It is decoded into a 7-bit output signal and output.
一方、画信号データラッチ回路3には、画信号データが
通過する出力パス4が接続されている。On the other hand, the image signal data latch circuit 3 is connected to an output path 4 through which image signal data passes.
そして、例えば、8ビツトずつ64ビツトになるまで画
信号データが、画信号データラッチ回路3に出力バスを
介して蓄えられると、画信号は出力される。Then, for example, when the image signal data is stored in the image signal data latch circuit 3 via the output bus in 8-bit increments until the image signal data reaches 64 bits, the image signal is output.
そして、ブロックセレクト用デコーダ2からは、例えば
27本のラインが蔦び、画信号データラッチ囲路3から
は64本のラインが延びる。これらのラインは、夫々第
1図の入力端子31 、32 、33 。For example, 27 lines extend from the block select decoder 2, and 64 lines extend from the image signal data latch circuit 3. These lines are input terminals 31, 32, 33 of FIG. 1, respectively.
−−+、3nと入力端子51.52,53.−−−.5
mとく接続される。即ち、ブロックセレクト用デコーダ
2と画信号データラッチ回路3とは、例えばサーマルヘ
ッド等の記録iトリクス6に*続される。--+, 3n and input terminals 51, 52, 53. ---. 5
It is connected to m. That is, the block selection decoder 2 and the image signal data latch circuit 3 are connected to a recording i-trix 6 such as a thermal head.
従来は、このように構成することKよって、印字が可能
とまった。しかし、第2図に示されるような模写信号供
給−路では、パスがスペースを必要とすること及びデコ
ーダが必要なことからノー−ドウエアの構成が複雑とな
る欠点が存在した。Conventionally, this configuration has made printing possible. However, the replicated signal supply path as shown in FIG. 2 has the drawback that the path requires space and a decoder is required, resulting in a complicated nodeware configuration.
本発明は、このような欠点に鑑みなされたものである。The present invention has been made in view of these drawbacks.
そして、本発明の目的は、ノ1−ド構成を簡素化した模
写信号供給装置を提供することである。Another object of the present invention is to provide a copying signal supply device with a simplified node configuration.
以下、本発明の実施例を図面を参照して詳しく説明する
。第3図は、本発明の実施例を示すブロック図である。Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. FIG. 3 is a block diagram showing an embodiment of the invention.
図において、7,8はシフトレジスタを示す、シフトレ
ジスタ7は、ブロックセレクト用データを格納するため
のもので、例えば、第1図のようなサーマルヘッドに対
しては、その出力端子71e 71m 7@* −−−
* 7ztは27個64)、サーマルヘッドなどの配碌
マトリクス6と接続される。In the figure, 7 and 8 indicate shift registers. The shift register 7 is for storing data for block selection. For example, for a thermal head as shown in FIG. 1, its output terminals 71e 71m 7 @* ---
*27 7zt 64) are connected to the arrangement matrix 6 such as a thermal head.
シフトレジスタ8は、−信号データを格納しておく丸め
のものであり、例えば、#!1図のようなサーマルヘッ
ドに対しては、その出力端子8□、8.。The shift register 8 is a round type that stores - signal data, for example, #! For a thermal head as shown in Figure 1, its output terminals 8□, 8. .
8m+−−−s8gaは64個あり、サーマルヘッドな
どの記録マトリクス6と接続される。There are 64 8m+---s8ga, which are connected to a recording matrix 6 such as a thermal head.
以上説明したシフトレジスタ7とシフトレジスタ8とは
、データがシリアルに流れるようK11l絖される。そ
して、シフトレジスタ7にはデータ入力端子9が設けら
れ、シリアルに作られた画信号データ及びブロックセレ
クト用データが入力される。The shift register 7 and shift register 8 described above are wired so that data flows serially. The shift register 7 is provided with a data input terminal 9 to which serially generated image signal data and block selection data are input.
例えば、第3図に示した模写信号供給回路が第1図のよ
うなサーマルヘッド1を駆動する場合には、シフトレジ
スタ7の出力端子71は第1図の入力端子31と接続さ
れ、シフトレジスタフの出力端子7諺は第1図の入力端
千羽と接続され、以下同様に順次接続され、シフトレジ
スタ7の出力端子7z7は第1図の入力端子3nと接続
される。更に、シフトレジスタ8の出力端子8□は第1
図の入力端子51と接続され、シフトレジスタ8の出力
端子82は第1図の入力端子部と接続され、以下同様に
順次接続され、シフトレジスタ8の出力端子864は第
1図の入力端子5mと接続される。For example, when the replication signal supply circuit shown in FIG. 3 drives the thermal head 1 shown in FIG. 1, the output terminal 71 of the shift register 7 is connected to the input terminal 31 shown in FIG. The output terminal 7 of the shift register 7 is connected to the input terminal 7 in FIG. 1, and so on, and the output terminal 7z7 of the shift register 7 is connected to the input terminal 3n in FIG. Furthermore, the output terminal 8□ of the shift register 8 is the first
The output terminal 82 of the shift register 8 is connected to the input terminal 51 of FIG. 1, and the output terminal 864 of the shift register 8 is connected to the input terminal 5m of FIG. connected to.
このように構成しておき、シフトレジスタ70データ入
力端子9に、両信号データ及びブロックセレクト用デー
タをシリアルに入力する。ここで、データ入力端子9に
入ゐデータ社、例えに印字すべきデータの1ライン分中
、第1図のサーマルブロックIIKよって印字される画
信号データを入力端子51側から層成入力端子5mまで
シリアルに配列し大ものの後に、第1図のサーマルブロ
ック11をアクティブとするブロックセレクト用データ
をシリアルに並べたものである。従って、64ビツト分
の画信号データを順次データ入力端−F9から、図示せ
ぬクロックによりてシフトして送シ、次にサーマルブロ
ック11をアクティブとするブロックセレクト用データ
を1ビット送ル1次に26ビツトのアクティブでないデ
ータを送る。With this configuration, both signal data and block selection data are serially input to the data input terminal 9 of the shift register 70. For example, image signal data to be printed by the thermal block IIK in FIG. The block selection data for activating the thermal block 11 in FIG. 1 is serially arranged after the large one. Therefore, 64 bits of image signal data are sequentially shifted and transmitted from the data input terminal -F9 using a clock (not shown), and then 1 bit of block selection data for activating the thermal block 11 is transmitted to the primary terminal. Sends 26 bits of inactive data to
このようKして、シフトレジスタ7及びシフトレジスタ
8にデータが満たされたと1!に、シフトレジスタ7、
シフトレジスタ8にデータ出力信号を送〕、データを並
列出力させることによって。In this way, when shift register 7 and shift register 8 are filled with data, 1! , shift register 7,
By sending a data output signal to the shift register 8] and outputting the data in parallel.
サーマルヘッド11が駆動される。The thermal head 11 is driven.
以下、サーマルブロック12.13.14.−−−。Below, thermal block 12.13.14. ---.
−タ入力端子9から入力する。ただ、ブロックを順次指
定するのであるから、シフトレジスタ7には、指定する
ブロックに対応したブロックセレクト用データを格納す
ることは言うまでもない。- input from data input terminal 9. However, since the blocks are sequentially designated, it goes without saying that the shift register 7 stores block selection data corresponding to the designated blocks.
このようにして、1ラインが印字されると記録紙を1ラ
イン分搬蓬して上述と同様の動作を行う。In this way, when one line is printed, the recording paper is transported by one line and the same operation as described above is performed.
このように本発明によれば、シフトレジスタを用いた結
果、バスが無用とな多構成が簡素化される。更に、シフ
トレジスタ管用いて、デコーダを用いないため、画像信
号転送用のシフトレジスタを流用でき、ハード構成が極
めて部品となる。As described above, according to the present invention, as a result of using a shift register, a bus is unnecessary and a multi-configuration is simplified. Furthermore, since a shift register tube is used and no decoder is used, the shift register for image signal transfer can be used, and the hardware configuration can be made up of very few parts.
尚、実施例においては、シフトレジスタの配置を、ブロ
ックを指定する備を後置したが画信号データを格納する
情を後置してもよい、また、シフトレジスタは2個のよ
うに描いたが、必要なデータを格納する個数必要である
。In the embodiment, the shift registers are arranged so that the information for specifying the block is placed at the end, but the information for storing the image signal data may also be placed at the end. However, it is necessary to store the necessary data.
第1図はサーマルヘッドのブロック図、絡2図状従来例
のブロック図、第3図伏木発明の実施例のブロック図で
ある。
6・・・記録マトリクス、7.8・・・シフトレジスタ
特許出願人 東京芝浦電気株式会社FIG. 1 is a block diagram of a thermal head, a block diagram of a conventional example of a two-wire diagram, and FIG. 3 is a block diagram of an embodiment of the invention of Fushiki. 6... Recording matrix, 7.8... Shift register Patent applicant Tokyo Shibaura Electric Co., Ltd.
Claims (1)
画信号データ及びブロックセレクト用データが1ブロツ
ク分ずつ順次シリアルに供給されるシフトレジスタを設
け、咳シフトレジスタの各段出力信号を模写信号として
出力する電子模写装置における模写信号供給回路。In an electronic reproduction device that performs recording processing in block units,
A copying signal supply circuit in an electronic copying apparatus includes a shift register to which image signal data and block selection data are serially supplied one block at a time, and outputs the output signal of each stage of the cough shift register as a copying signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56119269A JPS5821967A (en) | 1981-07-31 | 1981-07-31 | Facsimile signal supplying circuit of electronic facsimile device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56119269A JPS5821967A (en) | 1981-07-31 | 1981-07-31 | Facsimile signal supplying circuit of electronic facsimile device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5821967A true JPS5821967A (en) | 1983-02-09 |
Family
ID=14757168
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56119269A Pending JPS5821967A (en) | 1981-07-31 | 1981-07-31 | Facsimile signal supplying circuit of electronic facsimile device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5821967A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63167542A (en) * | 1986-12-22 | 1988-07-11 | アメリカン テレフォン アンド テレグラフ カムパニー | Phase locking loop |
US9112957B2 (en) | 2002-12-16 | 2015-08-18 | Access Business Group International Llc | Adapting portable electrical devices to receive power wirelessly |
-
1981
- 1981-07-31 JP JP56119269A patent/JPS5821967A/en active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63167542A (en) * | 1986-12-22 | 1988-07-11 | アメリカン テレフォン アンド テレグラフ カムパニー | Phase locking loop |
US9112957B2 (en) | 2002-12-16 | 2015-08-18 | Access Business Group International Llc | Adapting portable electrical devices to receive power wirelessly |
US10007297B2 (en) | 2002-12-16 | 2018-06-26 | Philips Ip Ventures B.V. | Adapting portable electrical devices to receive power wirelessly |
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