JPS58108967A - Switching regulator - Google Patents
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- JPS58108967A JPS58108967A JP57224049A JP22404982A JPS58108967A JP S58108967 A JPS58108967 A JP S58108967A JP 57224049 A JP57224049 A JP 57224049A JP 22404982 A JP22404982 A JP 22404982A JP S58108967 A JPS58108967 A JP S58108967A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
仁の発明はスイッチングレギュレータに係り、特に、そ
の過電流に対する保蟲回路に関する。DETAILED DESCRIPTION OF THE INVENTION Jin's invention relates to a switching regulator, and particularly to a protection circuit against overcurrent.
従来、電源装置の日常点検、保守に際して、その出力が
接地端に短絡されてしまう場合がある・このことは−8
witehing and Linear Power
Supply D@sign (by th@Hayd
@n Book Company+1977 、PP1
83〜185)にも記載されている。Conventionally, during daily inspection and maintenance of power supply equipment, the output may be shorted to the ground terminal.
Witehing and Linear Power
Supply D@sign (by th@Hayd
@n Book Company+1977, PP1
83-185).
負荷回路のブレークダウン時や誤動作時に、過負荷電流
が生じることがある。はとんどの過負荷電流は一時的な
ものであるが、これによって電源が影響を受けないこと
が好ましい。この境内により、過電流保護回路が使われ
ているが、ある程度の効果が得られている。Overload current may occur during load circuit breakdown or malfunction. Although most overload currents are temporary, it is preferable that the power supply is not affected by them. Due to this precinct, an overcurrent protection circuit is used, and it has been somewhat effective.
従来の過電流保護回路は出力端が接地端に短絡されると
きに、リニアモード直列回路素子の電力消費を保護する
ことを第1の目的とする。The primary purpose of conventional overcurrent protection circuits is to protect the power consumption of linear mode series circuit elements when the output terminal is shorted to ground.
このように従来の保腰回路は電源の出力端の短絡を防ぐ
ことを主目的としているが、この回路は、定格最大負荷
電流以上のわずかな過電流に対しても有効である。As described above, the main purpose of the conventional safety circuit is to prevent short circuits at the output end of the power supply, but this circuit is also effective against slight overcurrents exceeding the rated maximum load current.
前述の文献による保護回路は2つの動作モード、すなわ
ち、定電流モードと電流ホールドバックモードを有する
。定電流保護モードでは、出力電流が定格最大負荷電流
以上になると、出力電流は一定に保たれる。電流ホール
ドバックモードでは、所定の電流値までは出力電圧は定
格以下の一定値に保たれる。電流値がこの所定値以上に
なると、出力電圧と出力電流はホールドパックラインに
沿って折り返えされ始める。The protection circuit according to the aforementioned document has two operating modes: constant current mode and current holdback mode. In constant current protection mode, when the output current exceeds the rated maximum load current, the output current remains constant. In current holdback mode, the output voltage is kept at a constant value below the rated value until a predetermined current value. When the current value exceeds this predetermined value, the output voltage and output current begin to fold back along the hold pack line.
リニアシリーズレギュレータについては、電流ホールド
パ、クモードの方が定電流モードより好ましい、しかし
ながら、両モードともスイ、テングレイ。レータには直
接は適用できない。For linear series regulators, current hold mode is preferable to constant current mode; It cannot be applied directly to the controller.
スイッチングレギュレータについての従来の過電流保護
回路はりニアレギュレータについての保−回路の変形例
であり、スイ・ツチングインダク−のコアのリセットに
基づいている。これは、高価であるとともに実現が困−
である。The conventional overcurrent protection circuit for switching regulators is a modification of the protection circuit for linear regulators, and is based on resetting the core of the switching inductor. This is both expensive and difficult to achieve.
It is.
さらに、従来の過電流保護回路を有するヒステリシスタ
イツのスイッチングレギーレータ(非クロック同期)の
スイッチング周波数は過負荷抵抗の値に応じている。ス
イッチング周波数は臨界過負荷抵抗に対しては最も高く
、短絡されたときは最も低い、ここでは、臨界過負荷抵
抗は、過電流保護回路のしきい値を設定する負荷抵抗値
よりも少し低い抵抗値として定義される・
この臨界過負荷抵抗とのとき得られる高いスイッチング
周波数は、通常、トランジスタスイッチとフライバック
ダイオードの両者のスイッチング周波数よりも高い、そ
のため、短絡時と同様臨界負荷抵抗時も含む全ての過負
荷抵抗値に対して最も高く、かつ、一定の安全なスイ。Furthermore, the switching frequency of a switching regulator (non-clock synchronous) of a hysteresis tight with a conventional overcurrent protection circuit is dependent on the value of the overload resistor. The switching frequency is highest for the critical overload resistor and lowest when shorted, here the critical overload resistor is a resistance slightly lower than the load resistance value that sets the threshold of the overcurrent protection circuit. The high switching frequency obtained with this critical overload resistor is typically higher than the switching frequency of both the transistor switch and the flyback diode, and therefore includes the critical load resistor as well as the short circuit. Highest and constant safe switch for all overload resistance values.
テング周波数の電源が望まれている。A power source with a proboscis frequency is desired.
さらに、ソフトスタートとソフトターンオフ特性を持っ
た電源が望ましい。ソフトスタートは負荷が非常に高い
過渡的なスタート電流を必要とする場合に、特に必要で
ある。このような過渡的な高スタート電流が要求される
負荷としては、キャ/IPシタ、モータや白熱電球があ
る。Additionally, a power supply with soft start and soft turn-off characteristics is desirable. Soft-start is especially necessary when the load requires very high transient starting currents. Loads that require such a transient high starting current include capacitors/IP capacitors, motors, and incandescent light bulbs.
ソフトターンオフは安定化されていない電源がオフされ
る場合に、特に要求される。スイッチングレギュレータ
は電圧降下を検出して、これを補償するためにスイッチ
ングトランジスタへより多くの電流を流す。ここで、安
定化されていない電源は入力フィルタのキャノ9シタの
ゆっくりした放電により低下される。その結果、スイッ
チングトランジスタにはオンされるには充分であるが飽
和されないようなノ4イアスが印加される。このとき、
能動領域にあるスイッチングトランジスタには、非常に
高電流が流れる。Soft turn-off is particularly required when unregulated power supplies are turned off. A switching regulator senses the voltage drop and forces more current into the switching transistor to compensate for this. Here, the unregulated power supply is reduced by the slow discharge of the input filter capacitor. As a result, a voltage sufficient to turn on the switching transistor but not to saturate it is applied to the switching transistor. At this time,
Very high currents flow through switching transistors in the active region.
その几め、ソフトターンオフ特性がないと、スイッチン
グトランジスタにノーデートが生じる。If there is no soft turn-off characteristic, no-date will occur in the switching transistor.
この発明は上述した事情に対処すべくなされたもので、
その目的はソフトスタートとソフトターンオフ機能を有
するスイッチングレキ、レ−タの過電流保護回路を提供
することである。This invention was made to deal with the above-mentioned circumstances,
The purpose is to provide an overcurrent protection circuit for switching levers and regulators with soft start and soft turn-off functions.
この発明によれば、スイッチングレギーレータのスイッ
チングトランジスタを流れる電流を検出する第1の回路
と、スイッチングトランジスタを流れる電流が所定値以
上のときはスイッチングトランジスタをオフする回路に
制御信号を供給する第2の回路とが設けられる。According to this invention, the first circuit detects the current flowing through the switching transistor of the switching regulator, and the second circuit supplies a control signal to the circuit that turns off the switching transistor when the current flowing through the switching transistor is equal to or higher than a predetermined value. A circuit is provided.
この発明の一実施例によれば、過負荷電流を検出できる
ようにバイアスされたトランジスタを有する電流発生器
により過負荷電流が検出される。この検出手段は抵抗を
有していて、この抵抗の両端間の電圧が過負荷電流検出
器に入力される。過負荷電流検出トランジスタから発生
された電流は接地レベルが基準レベルとされているRC
積分回路に電圧を発生させる。この電圧が振幅比較器に
より基準電圧と比較されるO振幅比較器の出力信号はス
イッチングレギュレータのスイッチングトランジスタの
ペース駆動回路に供給される。According to one embodiment of the invention, overload current is detected by a current generator having a transistor biased to detect overload current. This detection means has a resistor, and the voltage across this resistor is input to the overload current detector. The current generated from the overload current detection transistor is an RC whose reference level is the ground level.
Generate voltage in the integrating circuit. This voltage is compared with a reference voltage by an amplitude comparator. The output signal of the amplitude comparator is supplied to the pace drive circuit of the switching transistor of the switching regulator.
以下、図面を参照してこの発明によるスイッチングレギ
ュレータの一実施例を説明する。第1図は第1実施例の
回路図である。過電流保護回路10を破線のブロックで
示す。スイッチングトランジスタQllにペース駆動回
路14が接続される。スイッチングトランジスタQll
は抵抗R12を介して安定化されていない入力電源ML
に接続され、インダクタLllを介して出力端vOに接
続される。出力端vOは負荷に接続される。7ライパ、
クダイオードCEtllがスイッチングトランジスタQ
llとインダクILI Jの接続点と接地端の間に接続
される。Hereinafter, one embodiment of a switching regulator according to the present invention will be described with reference to the drawings. FIG. 1 is a circuit diagram of the first embodiment. The overcurrent protection circuit 10 is shown by a broken line block. A pace drive circuit 14 is connected to the switching transistor Qll. switching transistor Qll
is the unregulated input power supply ML via resistor R12.
and is connected to the output terminal vO via an inductor Lll. Output end vO is connected to a load. 7 Leipa,
The switching transistor Q
ll and the inductor ILI is connected between the connection point of J and the ground terminal.
電圧センス回路16が出力端vOに接続され、出力電圧
がモニタされる。電圧センス回路16の出力がベース駆
動回路14を駆動するヒステリシス置電圧比較器18に
供給される。A voltage sense circuit 16 is connected to the output terminal vO to monitor the output voltage. The output of voltage sense circuit 16 is provided to a hysteretic voltage comparator 18 that drives base drive circuit 14.
ペース駆動回路14、電圧センス回路16と電圧比較器
18はスイ、チングレギ、レータの一般的な構成要素で
あることを強調するためにfcIツク図として示す。こ
れらの詳細はこの発明を理解する上で不必要であるので
省略する。The pace drive circuit 14, voltage sense circuit 16, and voltage comparator 18 are shown as fcI diagrams to emphasize that they are common components of switches, chinglegs, and regulators. These details are omitted as they are unnecessary for understanding the invention.
これらの部分の公知例としては、米国特許第3.294
,981号(Bog@ )、同第3,772,588号
(K@11y @t al )、同3,931,567
号(Kost@ek)、同第4,034,280号(C
ronin et al )、前述の著書のPi’ 2
35〜321等が今、る。Known examples of these parts include U.S. Pat.
, No. 981 (Bog@), No. 3,772,588 (K@11y @tal), No. 3,931,567
No. (Kost@ek), No. 4,034,280 (C
Ronin et al), Pi' 2 of the above-mentioned book
35-321 mag is now available.
過電流保護回路10において、入力電源VLとスイッチ
ングトランジスタQllのエミ、りの間に、抵抗812
が接続される。振幅比較トランジスタQ1は接地レベル
よシ浮いている。In the overcurrent protection circuit 10, a resistor 812 is connected between the input power supply VL and the emitter of the switching transistor Qll.
is connected. Amplitude comparison transistor Q1 is floating above ground level.
トランジスタQlのベースはローパスフィルタ81 *
C1を介してスイッチングトランジスタQJJのニオ
ツタに接続される。抵抗812の両端間の電圧はローパ
スフィルタRJ 、CJt−介してトランジスタQ1に
入力されているので、抵抗R12は電流検出抵抗として
働く。The base of the transistor Ql is a low-pass filter 81 *
It is connected to the output terminal of the switching transistor QJJ via C1. Since the voltage across the resistor 812 is input to the transistor Q1 via the low-pass filters RJ and CJt-, the resistor R12 functions as a current detection resistor.
スイッチングトランジスタQllのエミ、りとトランジ
スタQ1のベースの間に抵抗R1が接続され、トランジ
スタQ1のベース・エミッタ間にキャパシタC1が接続
される。このようK、m抗RJとキャノ臂シタC1dロ
ーノ母スフィルタヲ構成する。ローパスフィルタはトラ
ンジスタQ1のベースから大振幅の信号を取り除く。A resistor R1 is connected between the emitter of the switching transistor Qll and the base of the transistor Q1, and a capacitor C1 is connected between the base and emitter of the transistor Q1. In this way, K, m resistor RJ and canopy arm C1d rotor mother filter are constructed. A low pass filter removes large amplitude signals from the base of transistor Q1.
スイッチングトランジスタQllがオンするとき、ダイ
オードCRJ1を介して接地へ流れる電流によって瞬時
(ナノセカンド単位)の電圧スノヤイクスが抵抗R12
の両端間に発生する。ダイオードCBIIは7アストリ
カノ守りダイオードであるが、非常に短かい回復時間を
要する・この回復時間内は、ダイオードCRZZはスイ
ッチングトランジスタQllを介して接地へ電流を流す
導通モードである。ダイオードCR11の回復期間中あ
たかも短絡しているかの如くダイオードCEL11f電
流が流れる。ローノ譬スフィルタC1,B1はこれらの
ダイオードの回復電流スノ譬イクスが過電流振幅検出器
(電流発生器)Qlを誤まってトリガすることを防ぐ、
後に示す表の素子を用いると、ローノ譬スフィルタの8
0時定数は約1μmになる。このように、ローノスフイ
ル−は過電流保護回路10の固有の応答時間をほとんど
遅らせない。When the switching transistor Qll is turned on, the current flowing to ground through the diode CRJ1 causes an instantaneous (nanosecond unit) voltage to be applied to the resistor R12.
Occurs between the two ends of . Diode CBII is a 7-star guard diode, but requires a very short recovery time. During this recovery time, diode CRZZ is in conduction mode, conducting current to ground via switching transistor Qll. During the recovery period of the diode CR11, the diode CEL11f current flows as if it were short-circuited. The error filter C1, B1 prevents the recovery current error of these diodes from falsely triggering the overcurrent amplitude detector (current generator) Ql.
Using the elements in the table shown below, the 8
The zero time constant will be approximately 1 μm. In this way, the Ronosfil does not significantly delay the inherent response time of the overcurrent protection circuit 10.
トランジスタQ1が線形動作のときの寄生発振を抑制す
るために、トランジスタQ1のコレクタに抵抗R2が接
続される。トランジスタQ1は70−ティング過電流検
出器であるとともに、電流発生器である。トランジスタ
Q1は過負荷電流がないときはオフであり、過負荷電流
がスイッチングトランジスタQllを流れるときはリニ
アモードである。過電流が検出されると、トランジスタ
Q1のベース電圧は線形的に上昇し、トランジスタQ1
が能動領域になる。その結果、トランジスタQ1のコレ
クタ電流も同様に線形的に増加する。詳しく言うと、ト
ランジスタQ1を流れるコレクタ電流はコレクタがカッ
トオフ領域以外では非線形である。しかしながら、実用
上はトランジスタQ1のコレクタ電流は疑似線形増加関
数とみなせる。In order to suppress parasitic oscillation when transistor Q1 operates linearly, a resistor R2 is connected to the collector of transistor Q1. Transistor Q1 is a 70-ting overcurrent detector as well as a current generator. Transistor Q1 is off when there is no overload current and is in linear mode when overload current flows through switching transistor Qll. When an overcurrent is detected, the base voltage of transistor Q1 increases linearly, and transistor Q1
becomes the active region. As a result, the collector current of transistor Q1 also increases linearly. Specifically, the collector current flowing through the transistor Q1 is nonlinear outside the collector's cutoff region. However, in practice, the collector current of transistor Q1 can be regarded as a pseudo-linear increasing function.
キャパシタC2がトランジスタQ1のコレクタに接続さ
れ、トランジスタQ1からの電流を接地電位と比較して
検出する。キャノ4シタC2の両端間の電圧降下はコン
・譬レータUll、抵抗R13,FCl4.FCl2.
R16,R17゜B18、キャノ4シタC1lからなる
比較回路の一方入力端に供給される。抵抗RJ5とRJ
7は比較回路のしきい値を設定する。キャノ臂シタC1
1はコンノ譬レータu11の2つノ基準レベル差(ヒス
テリシス)Kよる影響を最小にするためのローパスフィ
ルタとなる。抵抗Et14はコンノにレータυ11のヒ
ステリシス、f、tt)−b上側しきい値UTと下側し
きい値LTを決定する・抵抗RJjはコンノ譬レータU
llの出力端と電圧比較回路180入力端の間のWir
@d−ORf−)のためのプルアップ抵抗である。Capacitor C2 is connected to the collector of transistor Q1, and detects the current from transistor Q1 by comparing it to ground potential. The voltage drop across the capacitor C2 is caused by the converter Ull, resistor R13, FCl4. FCl2.
It is supplied to one input end of a comparator circuit consisting of R16, R17°B18, and a four-capacitor C1l. Resistors RJ5 and RJ
7 sets the threshold value of the comparison circuit. Cano armpit C1
1 is a low-pass filter for minimizing the influence of the two reference level differences (hysteresis) K of the converter u11. The resistor Et14 determines the hysteresis of the resistor υ11, f, tt)-b upper threshold UT and lower threshold LT.Resistor RJj is the resistor RJj
Wir between the output terminal of ll and the input terminal of voltage comparison circuit 180
This is a pull-up resistor for @d-ORf-).
キャノタシタC2の電圧降下は抵抗R16゜Rlgから
なる分圧器を介してコン・臂レータU11に人力される
。抵抗R16,RIBはキャ/4シタC2の放電路でも
ある。その結果、キャノタシタC2の電圧低下の際の時
定数は、抵抗R16,Rlgの並列抵抗値とキャノ臂シ
タC2の容量との積である。キャノ母シタC2はトラン
ジスfQ1からのラング電流を積分することにより迅速
に充電され、抵抗R16,R18を介してゆっくシ放電
される。The voltage drop across the capacitor C2 is applied to the converter U11 via a voltage divider consisting of a resistor R16°Rlg. The resistors R16 and RIB also serve as a discharge path for the capacitor C2. As a result, the time constant when the voltage of the canopy capacitor C2 decreases is the product of the parallel resistance value of the resistors R16 and Rlg and the capacitance of the capacitor C2. The capacitor C2 is rapidly charged by integrating the rung current from the transistor fQ1, and is slowly discharged via the resistors R16 and R18.
キャノ臂シタC2はトランジスタQ1からの線形コレク
タランデ電流を積分する。コンパレータUllはキャi
4シタC・セの電圧降下が定常値を越えコンノ4レータ
Ullの上側しきい値UTに達すると出力が反転する。Canon arm C2 integrates the linear collector runde current from transistor Q1. Comparator Ull is
When the voltage drop across the 4-stage C·S exceeds a steady-state value and reaches the upper threshold UT of the 4-stage regulator Ull, the output is inverted.
コンパレータU11が反転すると、Wir@d −OR
f −)を介してベース駆動回路14に制御信号が供給
され、スイッチングトランジスタQllはオフされる。When comparator U11 is inverted, Wir@d −OR
A control signal is supplied to the base drive circuit 14 via the base drive circuit 14, and the switching transistor Qll is turned off.
この後、キャノ臂シタC1が0.2〜0.4v位放電さ
れると、すぐに、トランジスタQ1がオフされる。Thereafter, as soon as the canister C1 is discharged by about 0.2 to 0.4V, the transistor Q1 is turned off.
この間は約lμsである。トランジスタQllとQlは
キャノfシタC2の電圧が0゜5v(この値は後に示す
表の素子におけるコンパレータUllのヒステリシスで
ある)に低下するまでオフされ続ける。キャパシタC2
の充放電とコン・9レータUllのヒステリシスはどん
な過負荷状態においてもスイッチングレギュレータの周
波数とデユーティサイクルを設定するための緩和発振器
を構成する。This period is approximately lμs. Transistors Qll and Ql remain turned off until the voltage across capacitor C2 drops to 0°5V (this value is the hysteresis of comparator Ull in the elements in the table below). Capacitor C2
The charging and discharging of Ull and the hysteresis of the converter Ull constitute a relaxation oscillator to set the frequency and duty cycle of the switching regulator under any overload condition.
継続的な過負荷状態においてキャノ4シタC2に生じる
波形を第4図に示す、この波形も後に示す表の素子を用
い九場合である− 第4 a図はキャ・臂シタC2の端
子電圧、第4b図はコンパレータUllの出力電圧を示
す、キャノヤシタC2の端子電圧はコンノ4レータUl
lの上側しきい値UT(3,35V)から下降し始め、
コンパレータ
低下する。第4b図から明らかなように、コンパレータ
駆動回路14はスイッチングトランジスタQllをオフ
に保つ、しかしながら、キャノ母シタC2の端子電圧が
下側しきい値LTになると、コンノ譬レータIJ11の
出力は高レベルニナリ、ベース駆動回路14の出力は低
レベルとなりスイッチングトランジスタQllはオンと
なる。ここで、トランジスタQJJがオンになるとき、
出力端vOに過負荷回路や短絡回路が接続されていると
、抵抗RJjを流れる電流がトランジスタQ1を再びオ
ンにする。これにより、キャノ4シタ02が充電され、
キャノ臂シタC2の端子電圧が第4a図に示すように上
側しきい値UTtで瞬時に上昇する。これにより、コン
パレータUJJがオフしベース駆動回路14の出力が高
レベルになり、スイッチングトランジスタQJJがオフ
する。The waveform that occurs in the capacitor C2 under continuous overload conditions is shown in FIG. Figure 4b shows the output voltage of the comparator Ull.
l starts to fall from the upper threshold UT (3,35V),
Comparator drops. As is clear from FIG. 4b, the comparator drive circuit 14 keeps the switching transistor Qll off. However, when the terminal voltage of the capacitor C2 reaches the lower threshold LT, the output of the capacitor IJ11 becomes a high level signal. , the output of the base drive circuit 14 becomes low level, and the switching transistor Qll is turned on. Here, when transistor QJJ turns on,
If an overload circuit or a short circuit is connected to the output terminal vO, the current flowing through the resistor RJj turns on the transistor Q1 again. As a result, Cano 4 Shita 02 is charged,
The terminal voltage of the canopy arm C2 rises instantaneously at the upper threshold UTt, as shown in FIG. 4a. As a result, comparator UJJ is turned off, the output of base drive circuit 14 becomes high level, and switching transistor QJJ is turned off.
第41図にキク14シタC2の端子電圧の低下傾向を破
線で示す。上側しきい値UTと下側しきい値LTとの間
の距離りがコンパレータUJJのヒステリシスである。In FIG. 41, the decreasing tendency of the terminal voltage of the terminal C2 of the 14th axis is shown by a broken line. The distance between the upper threshold UT and the lower threshold LT is the hysteresis of the comparator UJJ.
第4b図のノ母ルスの繰シ返し周波数は後に示す表の素
子を用いた場合、1 kHzである。第4a図、第4b
図において園じタイミングを縦の一点鎖線で示す。The repetition frequency of the pulse of FIG. 4b is 1 kHz when using the elements shown in the table below. Figures 4a and 4b
In the figure, the starting timing is indicated by a vertical dashed line.
@4b図に示すノ9ルスの14ルス幅Δtは過負荷の抵
抗の絶対値に応じる。短絡回路の場合は、インダクタL
llのリセット電圧が最小であるので、Δtは最小であ
る。Δtの代表値は5〜50(μm)である、ΔtはL
J I X 11/(Vl−VO)と表わされる。ここ
で、LllはインダクタLllのインダクタンス、11
はトランジスタQ1のオは出力電圧、vlは安定化され
ていない入力電圧である* 1/1000 Hz )
50μmなので、1 kHzのノ母ルス繰り返し周波数
は過負荷の抵抗の絶対値に対してほとんど独立している
。@4b The width Δt of No. 9 and No. 14 Lus shown in figure 4b corresponds to the absolute value of the overload resistance. In case of short circuit, inductor L
Since the reset voltage of ll is the minimum, Δt is the minimum. The typical value of Δt is 5 to 50 (μm), Δt is L
It is expressed as J I X 11/(Vl-VO). Here, Lll is the inductance of the inductor Lll, 11
is the output voltage of transistor Q1, and vl is the unregulated input voltage * 1/1000 Hz)
50 μm, the 1 kHz nominal pulse repetition frequency is almost independent of the absolute value of the overload resistance.
過電流検出コンツヤレータの発振周波数はキャノ豐シI
C2の容量値を変えることにより容易に調整可能である
0局波数は可能な限り高く、しかも、トランジスタQl
lとダイオードCRIIの最大スイッチング周波数以内
に設定されるべきである。過電流制限モードでは、スイ
ッチングトランジスタQllのオンデユーテイサイクル
は第4b図に示すように非常に長い。トランジスタQl
lとダイオードCa1lのスイッチング速度を有限な一
定値以下にするために、スイッチングトランジスタQ1
1へのオンノ臂ルスの繰9返し周波数は1000 Hz
位の低い周波数に設定される。The oscillation frequency of the overcurrent detection consolidator is
The zero frequency number, which can be easily adjusted by changing the capacitance value of C2, is as high as possible, and moreover, the transistor Ql
should be set within the maximum switching frequency of the diode CRII and the maximum switching frequency of the diode CRII. In overcurrent limit mode, the on-duty cycle of switching transistor Qll is very long as shown in Figure 4b. Transistor Ql
In order to keep the switching speed of the switching transistor Q1 and the diode Ca1l below a certain finite value, the switching transistor Q1
The repetition frequency of the ono-no-rusu to 1 is 1000 Hz.
set to the lowest frequency.
トランジスタQllとダイオードCRJ1の代表的なス
イッチング速度の限界値はトランジスタQllの過電流
時のオンノ4ルスの繰り返し周波数を100OHs程度
に設定する。この繰り返し周波数はキャノ譬シタC2の
時定数により決定される。最小の過電流の折;返しは白
熱電球、キャノ4シタやモータを駆動するための電源の
オン特性を向上する。The typical switching speed limit value of the transistor Qll and the diode CRJ1 is such that the repetition frequency of the on/off pulse during overcurrent of the transistor Qll is set to about 100 OHs. This repetition frequency is determined by the time constant of the capacitor C2. Minimal overcurrent reversal improves the turn-on characteristics of power supplies for driving incandescent light bulbs, canopies, and motors.
一般に、過電流しきい値(IThrs )は次のように
表わされる。Generally, the overcurrent threshold (IThrs) is expressed as:
VBg(QJoN) 0.6
I?kt・=□キー
FCl2 1L12
過電流しきい値は電源の全負荷電流の約2倍に設定され
るのが好ましい、これは、オン時のトランジスタQ1の
ペース・エミッタ電圧VBE(QJO)l)における抵
抗耐量の変化を補償し、過電流保護回路10の誤トリガ
を防ぐためである。VBg (QJoN) 0.6 I? kt・=□Key FCl2 1L12 The overcurrent threshold is preferably set to approximately twice the full load current of the power supply, which is due to the pace emitter voltage VBE(QJO)l) of transistor Q1 when on This is to compensate for changes in resistance tolerance and to prevent false triggering of the overcurrent protection circuit 10.
トランジスタQllを流れる電流はインダクタLllが
線形である限り、線形に変化する。The current flowing through transistor Qll varies linearly as long as inductor Lll is linear.
トランジスタQllを流れる電流は過電流検出コンツヤ
レータUllが過負荷電流を検出した後も変化し続ける
。一般的に、トランジスタQllはコンノ4レータUl
lが反転してから数μm後−にオフする・この惰性電流
はスイッチングトランジスタQllとペース駆動回路1
4のスイッチング速度が速いほど小さい。The current flowing through transistor Qll continues to change even after overcurrent detection consolidator Ull detects an overload current. In general, the transistor Qll is the transistor Ul
It turns off several μm after l is reversed. This inertial current flows through the switching transistor Qll and the pace drive circuit 1.
4, the faster the switching speed, the smaller it is.
第2図に示した第2実施例は並列に接続され九2つのノ
譬ワースイ、チングトランジスタQllとQIJの電流
保−回路の回路図である。第1実施例と異なる点は、第
1図の抵抗R1の代わりにそれぞれがR1の約2倍の抵
抗R1、RJが設けられている点である。これによシ、
RC時定数を抵抗RJ # RJとキャノfシタC3に
よシ決まる値に保ったtま、トランジスタQ1への入力
を2径路とすることができる。同一のスイッチング入力
電流に対してトランジスタQ1は並列的に動作するので
、定常オン時の電圧降下を約2分の1にすることができ
る。The second embodiment shown in FIG. 2 is a circuit diagram of a current holding circuit including 92 switching transistors Qll and QIJ connected in parallel. The difference from the first embodiment is that in place of the resistor R1 in FIG. 1, resistors R1 and RJ, each of which is about twice as large as R1, are provided. For this,
While the RC time constant is kept at a value determined by the resistor RJ #RJ and the capacitor C3, the input to the transistor Q1 can be made into two paths. Since the transistors Q1 operate in parallel for the same switching input current, the voltage drop during steady-on operation can be reduced to about half.
821!施flKおI/nて、抵抗R12とR20は2
つの機能がある。1番目の機能は負荷電流を検出するこ
とで、2番目の機能線トランジスタQllとQIJの間
の定常負荷電流を平衡させることである。過渡的な低電
流はトランジスタQllとQJJのうちいずれか一方が
速くスイ、チングするので、抵抗R12とR20で平衡
させることはできない、これは、トランジスタQJJ、
QJJがオンになるとき、スイッチング速度の速いトラ
ンジスタにオン電流か−・100チ流れるからである。821! When applying flK I/n, resistors R12 and R20 are 2
There are two functions. The first function is to balance the steady load current between the second function line transistors Qll and QIJ by sensing the load current. Transient low currents cannot be balanced by resistors R12 and R20 because one of transistors Qll and QJJ will switch quickly.
This is because when QJJ turns on, an on-state current of -100 flows through a transistor with a high switching speed.
逆に、スイッチング速度の遅いトランジスタにオフ電流
が100%流れるからである。トランジスタQ11.Q
12のスイッチング速度が非常に速ければ、いずれか一
方が1001導通するとき(理論上は100−過負荷の
とき)は非常に短かいので、充分なペース駆動電流が供
給されていれば、トランジスタの接合部(ホ、トスポ、
ト)での損害は避けられる。On the contrary, 100% of the off-state current flows through the transistor having a slow switching speed. Transistor Q11. Q
If the switching speed of 12 is very fast, the time when either one conducts 1001 (theoretically 100 - overload) is very short, so if enough pace drive current is supplied, the transistor Joint (e, tospo,
damage caused by (g) can be avoided.
第3図は第3実施例を示す、この実施例は単一の電圧安
定化コンノ譬し−−U12を用いている。コン・臂レー
タを1つ減らすことは直流電力”を節約し全体の部品数
を減らす効果がある。すなわち、第3実施例はスタンバ
イ電力が少なくて済む、これは、電力保存に単純性と信
頼性が要求される宇宙関係機器への応用に際して有効で
ある。FIG. 3 shows a third embodiment, which uses a single voltage stabilizing controller--U12. Reducing the number of controllers by one has the effect of saving "DC power" and reducing the overall number of components. In other words, the third embodiment requires less standby power, which provides simplicity and reliability in power conservation. This is effective when applied to space-related equipment that requires high performance.
第1%第2実施例の説明は第3実施例の抵抗RJ t
Rj、キャノ臂シタC1、トランジスタQ1についても
適用される。キャノヤシタClO2と直列なキャノ譬シ
タC101が第1図、第2図の実施例中のキャノ豐シタ
02に対応する。ダイオードCRJは0R)f−トとし
て働くので、電圧センス回路16と過電流保護回路10
のいずれか一方がコンノ譬レータUJjを制御する。1% The explanation of the second embodiment is the resistance RJ t of the third embodiment.
This also applies to Rj, canopy C1, and transistor Q1. The canopy starter C101 in series with the canopy starter ClO2 corresponds to the canopy starter 02 in the embodiments of FIGS. 1 and 2. Since the diode CRJ works as a 0R) gate, the voltage sense circuit 16 and the overcurrent protection circuit 10
Either one of them controls the converter UJj.
過負荷状態でない通常の動作期間中、ダイオードCRJ
は逆バイアスされているので、過電流は抵抗R102、
RJ)Jからなる電圧センス用分圧器に供給されない1
分圧器RJ 02 、810Bからの信号がコン/ル−
タUJ、?に入力され、$1%第2実施例と同様に抵抗
R13〜RJFによシ得られた基準信号と比較される。During normal operation without overload conditions, diode CRJ
is reverse biased, so the overcurrent is passed through the resistor R102,
1 not supplied to the voltage sensing voltage divider consisting of RJ) J
The signal from the voltage divider RJ 02, 810B is
TaUJ,? The $1% signal is input to the reference signal obtained by the resistors R13 to RJF as in the second embodiment.
コン・々レータUJJの出力がベース枢動回路14に供
給されスイッチングトランジスタQ11ft制御4する
。The output of the converter UJJ is supplied to the base pivot circuit 14 to control the switching transistor Q11ft.
過負荷状態のときは、ダイオードCRJは分圧器R10
2,R10Bからの信号を通過させずに、トランジスタ
Q1からの線形ランf信号をキャノ々シーCIDI 、
CIO:lに供給する。これによ蜆コンノ9レータU1
2は反転し、スイッチングトランジスタQllがオフさ
れる。トランジスタQllのオフにより、トランジスタ
Q1もオフされる。During overload condition, diode CRJ connects to voltage divider R10
2, without passing the signal from R10B, the linear run f signal from transistor Q1 can be passed through canocy CIDI,
Supply to CIO:l. In this, Kagami Konno 9rator U1
2 is inverted, and the switching transistor Qll is turned off. When transistor Qll is turned off, transistor Q1 is also turned off.
ダイオードCRJを流れる電流により・キク/4シタC
101aC102に充電される電圧はコン/ル−タ11
12のヒステリシスと等しくされるe過電圧と過電流が
同時にしきい値を越えるときは、ダイオードCRJを流
れる電流はキャノ譬シタCl0I 、ClO2をもはや
充電しない番しかしながら、半周期(約25μs)後に
電圧センス回路16はスイッチングトランジスタQll
を再びオンにする。ダイオードCRJはキャノ譬シタC
l0I 、ClO2を迅速に充電しコン/ル−タU12
を反転させ、トランジスタQllをオフ状態に戻す。す
なわち、ダイオードCRJはキャパシタC101、、C
lO2をコン/ル−タU12のヒステリシスまで指数関
数的に充電し、トランジスタQllを数μS以内にオフ
させる。トランジスタQllはキャノ9シタCJOJ
、CIO:IIに迅速に充電される微少な電圧が低下す
るまでオフ状態に保たれる。この電圧の低下は抵抗R1
02とR103の並列回路を介している゛のでゆっくり
行なわれる。キャノ9シタCl01.ClO2への迅速
な充電、ゆり〈夛な放電は緩和発振器を構成する。緩和
発振の機能は第1実施例と同様である。緩和発揚の周波
数はキャノ臂シタCl0I 。Due to the current flowing through the diode CRJ,
The voltage charged to 101aC102 is from the converter/router 11.
When the overvoltage and overcurrent simultaneously exceed the threshold, the current flowing through the diode CRJ no longer charges the capacitors Cl0I and ClO2, however, after half a cycle (approximately 25 μs) the voltage sense The circuit 16 is a switching transistor Qll
Turn it back on. Diode CRJ is a capacitor C
10I, ClO2 is quickly charged and the controller/router U12
is inverted, and the transistor Qll is returned to the off state. That is, diode CRJ is connected to capacitor C101, , C
1O2 is charged exponentially to the hysteresis of the converter/router U12, turning off the transistor Qll within a few μS. Transistor Qll is cano 9sita CJOJ
, CIO:II is kept off until the small voltage that quickly charges it drops. This voltage drop is caused by the resistance R1
Since the signal is passed through the parallel circuit of 02 and R103, it is performed slowly. Cano 9 Shita Cl01. The rapid charging and rapid discharging of ClO2 constitutes a relaxation oscillator. The function of relaxation oscillation is the same as in the first embodiment. The frequency of relaxation excitation is Cano Shita Cl0I.
ClO2のキャノ9シタンス、抵抗R102,R103
の並列抵抗値とコンノ譬レータU12のヒステリシスに
より決定される。上述の実施例と同様に、この周波数は
1 kHz位が適当である。ClO2 capacitance, resistance R102, R103
is determined by the parallel resistance value of and the hysteresis of the converter U12. Similar to the above embodiment, this frequency is suitably around 1 kHz.
電流保護回路10と電圧センス回路16はキャノ臂シタ
C101,ClO2のキャノ譬シタンスにある限度を与
える。しかしながら、電流保護回路10と電圧センス回
路16がともにうまく働くような妥協点がある。Current protection circuit 10 and voltage sense circuit 16 provide a certain limit on the capacitance of canister C101, ClO2. However, there are compromises where current protection circuit 10 and voltage sense circuit 16 work together well.
抵抗 Ω
R1100
RJ 100Rj
220R410
k
R120,05
RJJ 1.74k
RJ4− 115k
B15 20.5kR
Jf 28kRJF
20.5k
RIB 17.4k
RJ9 220820
0.05RIOI
1kRJO264,9
k
B103 22.1にキ
ャノ譬シタ F
CJ O,01μ07
0.1μ
CJ01 1μ
Cl01 1μ
C1l 100pie。Resistance Ω R1100 RJ 100Rj
220R410
k R120,05 RJJ 1.74k RJ4- 115k B15 20.5kR
Jf 28kRJF
20.5k RIB 17.4k RJ9 220820
0.05RIOI
1kRJO264,9
k B103 22.1 Canonomashita F CJ O, 01μ07
0.1μ CJ01 1μ Cl01 1μ C1l 100pie.
インダクタLll ダイオードCRJ
lN4150CELII
lN3891トランジスタ
QJ 2N5680Qll
2N6287Qllt
2N6287コンノ臂レータ
UJJ LM139 −′U12
LM139上述の説明は特定の
実施例につ′いて行なったが、この発明はこれらの実施
例に限定されず、種々変更可能である。友とえば、ヒス
テリシス型コンノ臂レータの代ワりに、クロックドコン
ノ臂レータを用いてもよい。Inductor Lll Diode CRJ
lN4150CELII
lN3891 transistor QJ 2N5680Qll
2N6287Qllt
2N6287 Conno Arm Lator UJJ LM139 -'U12
LM139 Although the above description has been made with reference to specific embodiments, the present invention is not limited to these embodiments and can be modified in various ways. For example, a clocked controller may be used instead of a hysteresis controller.
第1図はこの発明によるスイッチングレギ。
レータの一実施例の回路図1、@2図、第3図はその第
2、@3実施例の回路図、#44a図、第4b図はコン
ノ9レータ1111.U12の入出力波形を示す波形図
である。
10・・・電流保護回路、14・・・ペース駆動回路、
16・・・電圧検出回路、18・・・コンノ4レータ、
Qll・・・パワースイッチングトランジスタ。
出願人代理人 弁理士 鈴 江 武 彦Fig2゜
Fig、 4a。
Fig、 4b。
IIf聞Figure 1 shows a switching leg according to the invention. The circuit diagrams 1, 2, and 3 of one embodiment of the controller are the circuit diagrams of the 2nd and 3rd embodiments, and the circuit diagrams #44a and 4b are the circuit diagrams of the controller 1111. FIG. 3 is a waveform diagram showing input and output waveforms of U12. 10... Current protection circuit, 14... Pace drive circuit,
16...Voltage detection circuit, 18...Conno 4 regulator,
Qll...Power switching transistor. Applicant's agent Patent attorney Takehiko SuzueFig2゜Fig, 4a. Fig. 4b. IIf
Claims (1)
トランジスタと、所定の入力信号に応じて前記スイッチ
ングトランジスタをオン、オフ制御する制御回路と、前
記スイッチングトランジスタを流れる電流を検出するW
41回路と検出器の出力に応じて前記スイッチングトラ
ンジスタを流れる電流が所定の値以上のと色は前記制御
回路に信号を供給する第2回路とを有し負荷が過負荷状
態のとき前記スイッチングトランジスタを流れる電流を
制限する過電流保護回路とを真備するスイッチングレギ
ュレータA switching transistor that supplies power to a load connected to an output terminal, a control circuit that controls on and off the switching transistor according to a predetermined input signal, and W that detects the current flowing through the switching transistor.
41 circuit and a second circuit that supplies a signal to the control circuit when the current flowing through the switching transistor is equal to or greater than a predetermined value according to the output of the detector, and when the load is in an overload state, the switching transistor A switching regulator equipped with an overcurrent protection circuit that limits the current flowing through the
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