JPH11136152A - デジタルテレビジョン信号受信チューナ - Google Patents
デジタルテレビジョン信号受信チューナInfo
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- JPH11136152A JPH11136152A JP30045297A JP30045297A JPH11136152A JP H11136152 A JPH11136152 A JP H11136152A JP 30045297 A JP30045297 A JP 30045297A JP 30045297 A JP30045297 A JP 30045297A JP H11136152 A JPH11136152 A JP H11136152A
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- intermediate frequency
- clock
- tuner
- digital
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/16—Multiple-frequency-changing
- H03D7/161—Multiple-frequency-changing all the frequency changers being connected in cascade
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Noise Elimination (AREA)
- Circuits Of Receivers In General (AREA)
- Superheterodyne Receivers (AREA)
- Structure Of Receivers (AREA)
Abstract
(57)【要約】
【課題】 マザーボードへの搭載・配置が単純化できる
と共に、クロック回路部から送出されるクロック信号の
高調波信号による妨害を受けないデジタルテレビジョン
信号受信チューナを提供する。 【解決手段】 テレビジョン信号をテレビジョンの中間
周波信号である第一の中間周波信号に周波数変換する信
号受信部2と、該信号受信部から出力される第一の中間
周波信号を該第一の中間周波信号よりも周波数の低い第
二の中間周波信号に周波数変換する中間周波回路部3
と、該中間周波回路部から出力される第二の中間周波信
号をデジタル信号に変換するためのアナログ/デジタル
変換回路部4とを備えたチューナ1に前記アナログ/デ
ジタル変換回路部にて、第二の中間周波信号をサンプリ
ングするためのクロック信号を発生させるクロック回路
部5を内蔵させたこと。
と共に、クロック回路部から送出されるクロック信号の
高調波信号による妨害を受けないデジタルテレビジョン
信号受信チューナを提供する。 【解決手段】 テレビジョン信号をテレビジョンの中間
周波信号である第一の中間周波信号に周波数変換する信
号受信部2と、該信号受信部から出力される第一の中間
周波信号を該第一の中間周波信号よりも周波数の低い第
二の中間周波信号に周波数変換する中間周波回路部3
と、該中間周波回路部から出力される第二の中間周波信
号をデジタル信号に変換するためのアナログ/デジタル
変換回路部4とを備えたチューナ1に前記アナログ/デ
ジタル変換回路部にて、第二の中間周波信号をサンプリ
ングするためのクロック信号を発生させるクロック回路
部5を内蔵させたこと。
Description
【0001】
【発明の属する技術分野】本発明は、デジタルテレビジ
ョン信号受信チューナに係わり、特に、クロック回路を
一体化したデジタルテレビジョン信号受信チューナに関
する。
ョン信号受信チューナに係わり、特に、クロック回路を
一体化したデジタルテレビジョン信号受信チューナに関
する。
【0002】
【従来の技術】デジタルTV(テレビジョン)放送は、
衛星放送やCATV(ケーブルテレビジョン)では、既
に実用化されているが、最近、いわゆる地上波を用いた
デジタルTV放送が計画されつつある。このデジタルT
V放送を受信するデジタルTV受像機は、チューナから
送出される中間周波信号を、サンプリングするためのA
/D(アナログ/デジタル)変換器と、該A/D変換器
にサンプリング用のクロック信号を入力するクロック発
振器と、A/D変換器からのパラレル8ビットのデジタ
ル信号を処理するベースバンド処理回路部等とを備えて
いる。
衛星放送やCATV(ケーブルテレビジョン)では、既
に実用化されているが、最近、いわゆる地上波を用いた
デジタルTV放送が計画されつつある。このデジタルT
V放送を受信するデジタルTV受像機は、チューナから
送出される中間周波信号を、サンプリングするためのA
/D(アナログ/デジタル)変換器と、該A/D変換器
にサンプリング用のクロック信号を入力するクロック発
振器と、A/D変換器からのパラレル8ビットのデジタ
ル信号を処理するベースバンド処理回路部等とを備えて
いる。
【0003】ここで、図4は、従来のマザーボード上に
配置したチューナとA/D(アナログ/デジタル)変換
器とクロック発振器とベースバンド処理回路部とを示す
ブロック構成図である。図4に示すように、デジタルT
V受像器のマザーボードB上には、チューナ50と、該
チューナ50とは別の構成としてのA/D変換器54
と、前記チューナ50とは別の構成としてのクロック発
振器55と、ベースバンド処理回路部56とを備えてい
る。また、チューナ50は、信号受信部51と中間周波
回路部52とを備えている。
配置したチューナとA/D(アナログ/デジタル)変換
器とクロック発振器とベースバンド処理回路部とを示す
ブロック構成図である。図4に示すように、デジタルT
V受像器のマザーボードB上には、チューナ50と、該
チューナ50とは別の構成としてのA/D変換器54
と、前記チューナ50とは別の構成としてのクロック発
振器55と、ベースバンド処理回路部56とを備えてい
る。また、チューナ50は、信号受信部51と中間周波
回路部52とを備えている。
【0004】そして、チューナ50は、アンテナ53で
受信されたテレビジョン信号を受け入れるためのチュー
ナ入力端50aと、中間周波信号を送出するためのチュ
ーナ出力端50bを有して、テレビジョン信号を周波数
変換して第一の中間周波信号を出力する信号受信部51
と、該信号受信部51から送出された第一の中間周波信
号の増幅、周波数変換などの信号処理を行い、第二の中
間周波信号に周波数変換して出力する中間周波回路部5
2とがひとつの筺体内に構成されている。
受信されたテレビジョン信号を受け入れるためのチュー
ナ入力端50aと、中間周波信号を送出するためのチュ
ーナ出力端50bを有して、テレビジョン信号を周波数
変換して第一の中間周波信号を出力する信号受信部51
と、該信号受信部51から送出された第一の中間周波信
号の増幅、周波数変換などの信号処理を行い、第二の中
間周波信号に周波数変換して出力する中間周波回路部5
2とがひとつの筺体内に構成されている。
【0005】そして、チューナ50のチューナ出力端5
0bから送出される第二の中間周波信号をパラレル8ビ
ットのベースバンド信号に変換するA/D変換器54
と、該A/D変換器54にて、第二の中間周波信号をサ
ンプリングするためのほぼ18Mzのクロック信号を送
出するクロック発振器55とは、それぞれが例えばシー
ルドケース内に収納されてマザーボード上に、それぞれ
の回路(ユニット)が個別に構成されたものと成ってい
る。また、クロック発振器55からは、ほぼ18Mzの
クロック信号の他にほぼ36Mzのクロック信号が送出
されている。また、A/D変換器54から送出されるパ
ラレル8ビットのベースバンド信号は、例えば個別にシ
ールドケース内に収納されたベースバンド処理回路部5
6に入力されてベースバンド処理回路部56で復調など
の信号処理がされて、映像信号および音声信号が取り出
される。このベースバンド処理回路部56には、クロッ
ク発振器55から送出されるほぼ18Mzと36Mzと
のクロック信号が入力されており、このことからA/D
変換器54とベースバンド処理回路部56とは同期が取
れている。
0bから送出される第二の中間周波信号をパラレル8ビ
ットのベースバンド信号に変換するA/D変換器54
と、該A/D変換器54にて、第二の中間周波信号をサ
ンプリングするためのほぼ18Mzのクロック信号を送
出するクロック発振器55とは、それぞれが例えばシー
ルドケース内に収納されてマザーボード上に、それぞれ
の回路(ユニット)が個別に構成されたものと成ってい
る。また、クロック発振器55からは、ほぼ18Mzの
クロック信号の他にほぼ36Mzのクロック信号が送出
されている。また、A/D変換器54から送出されるパ
ラレル8ビットのベースバンド信号は、例えば個別にシ
ールドケース内に収納されたベースバンド処理回路部5
6に入力されてベースバンド処理回路部56で復調など
の信号処理がされて、映像信号および音声信号が取り出
される。このベースバンド処理回路部56には、クロッ
ク発振器55から送出されるほぼ18Mzと36Mzと
のクロック信号が入力されており、このことからA/D
変換器54とベースバンド処理回路部56とは同期が取
れている。
【0006】
【発明が解決しようとする課題】しかしながら、従来の
デジタルTV受像機は、マザーボードB上に、チューナ
50と、A/D変換器54と、クロック発振器55と、
ベースバンド処理回路部56とがそれぞれ個別に配置さ
れる構成であるために、予め個別のユニットとして完成
させておかなければならず、そのため組立工数が増加す
るとともに、各ユニットの配置が複雑になり、マザーボ
ードBの設計工数がかかりコスト高に成るという問題が
生じる。また、マザーボードB上のチューナ50とは別
に外部に配置された前記クロック発振器55は、前述の
如くほぼ18Mzのクロック信号とほぼ36Mzのクロ
ック信号とを送出しているのだが、このクロック信号
は、信号レベルがほぼ5Vと信号レベルが高く、また、
このクロック信号の立ち上がり波形と立ち下がり波形の
近傍に、チューナ50の受信周波数や第一の中間周波数
と一致する周波数信号など多くの高調波信号を含んでい
る。これらの高調波信号は、5Vと信号レベルが高いこ
とから、マザーボードB上に配置されたクロック発振器
55から例えばクロック信号を送出する信号ラインから
飛び出してチューナ50のチューナ入力端50aに周り
込みチューナ50に妨害を与えるという問題が生じる。
デジタルTV受像機は、マザーボードB上に、チューナ
50と、A/D変換器54と、クロック発振器55と、
ベースバンド処理回路部56とがそれぞれ個別に配置さ
れる構成であるために、予め個別のユニットとして完成
させておかなければならず、そのため組立工数が増加す
るとともに、各ユニットの配置が複雑になり、マザーボ
ードBの設計工数がかかりコスト高に成るという問題が
生じる。また、マザーボードB上のチューナ50とは別
に外部に配置された前記クロック発振器55は、前述の
如くほぼ18Mzのクロック信号とほぼ36Mzのクロ
ック信号とを送出しているのだが、このクロック信号
は、信号レベルがほぼ5Vと信号レベルが高く、また、
このクロック信号の立ち上がり波形と立ち下がり波形の
近傍に、チューナ50の受信周波数や第一の中間周波数
と一致する周波数信号など多くの高調波信号を含んでい
る。これらの高調波信号は、5Vと信号レベルが高いこ
とから、マザーボードB上に配置されたクロック発振器
55から例えばクロック信号を送出する信号ラインから
飛び出してチューナ50のチューナ入力端50aに周り
込みチューナ50に妨害を与えるという問題が生じる。
【0007】そこで、本発明においては、上記の問題点
に解決を与えるもので、その目的は、デジタルTV受像
機の組立が簡単であるとともに、マザーボードBへの各
回路ユニットの配置が単純化され、マザーボードBの設
計工数が少なくて済み、且つ、A/D変換器において第
二の中間周波信号をサンプリングするためのクロック発
振器からのクロック信号に含まれている高調波信号によ
る妨害を受けることのないデジタルテレビジョン信号受
信チューナを提供することである。
に解決を与えるもので、その目的は、デジタルTV受像
機の組立が簡単であるとともに、マザーボードBへの各
回路ユニットの配置が単純化され、マザーボードBの設
計工数が少なくて済み、且つ、A/D変換器において第
二の中間周波信号をサンプリングするためのクロック発
振器からのクロック信号に含まれている高調波信号によ
る妨害を受けることのないデジタルテレビジョン信号受
信チューナを提供することである。
【0008】
【課題を解決するための手段】上記の課題を解決するた
め、デジタルテレビジョン信号受信チューナは、テレビ
ジョン信号をテレビジョンの中間周波信号である第一の
中間周波信号に周波数変換する信号受信部と、該信号受
信部から出力される前記第一の中間周波信号を該第一の
中間周波信号よりも周波数の低い第二の中間周波信号に
周波数変換する中間周波回路部と、該中間周波回路部か
ら出力される第二の中間周波信号をデジタル信号に変換
するためのアナログ/デジタル変換回路部とを備えたチ
ューナに前記アナログ/デジタル変換回路部にて第二の
中間周波信号をサンプリングするためのクロック信号を
発生させるクロック回路部を内蔵したことである。
め、デジタルテレビジョン信号受信チューナは、テレビ
ジョン信号をテレビジョンの中間周波信号である第一の
中間周波信号に周波数変換する信号受信部と、該信号受
信部から出力される前記第一の中間周波信号を該第一の
中間周波信号よりも周波数の低い第二の中間周波信号に
周波数変換する中間周波回路部と、該中間周波回路部か
ら出力される第二の中間周波信号をデジタル信号に変換
するためのアナログ/デジタル変換回路部とを備えたチ
ューナに前記アナログ/デジタル変換回路部にて第二の
中間周波信号をサンプリングするためのクロック信号を
発生させるクロック回路部を内蔵したことである。
【0009】また、デジタルテレビジョン信号受信チュ
ーナは、テレビジョン信号が入力される入力端子を有す
るとともに、テレビジョン信号をテレビジョンの中間周
波信号である第一の中間周波信号に周波数変換する信号
受信部と、該信号受信部から出力される前記第一の中間
周波信号を該第一の中間周波信号よりも周波数の低い第
二の中間周波信号に周波数変換する中間周波回路部と、
該中間周波回路部から出力される第二の中間周波信号を
デジタル信号に変換するためのアナログ/デジタル変換
回路部と、該アナログ/デジタル変換回路部にて第二の
中間周波信号をサンプリングするためのクロック信号を
発生させるクロック回路部とを備えたチューナを金属板
からなり、複数個の区画室を備えた筺体内に配置し、前
記クロック回路部を入力端子から最も離れた位置に設け
た区画室に配置したことである。
ーナは、テレビジョン信号が入力される入力端子を有す
るとともに、テレビジョン信号をテレビジョンの中間周
波信号である第一の中間周波信号に周波数変換する信号
受信部と、該信号受信部から出力される前記第一の中間
周波信号を該第一の中間周波信号よりも周波数の低い第
二の中間周波信号に周波数変換する中間周波回路部と、
該中間周波回路部から出力される第二の中間周波信号を
デジタル信号に変換するためのアナログ/デジタル変換
回路部と、該アナログ/デジタル変換回路部にて第二の
中間周波信号をサンプリングするためのクロック信号を
発生させるクロック回路部とを備えたチューナを金属板
からなり、複数個の区画室を備えた筺体内に配置し、前
記クロック回路部を入力端子から最も離れた位置に設け
た区画室に配置したことである。
【0010】また、デジタルテレビジョン信号受信チュ
ーナは、クロック回路部から送出されるクロック信号の
送出ラインにクロック信号を通過させるフィルタを備え
たことである。
ーナは、クロック回路部から送出されるクロック信号の
送出ラインにクロック信号を通過させるフィルタを備え
たことである。
【0011】また、デジタルテレビジョン信号受信チュ
ーナは、クロック回路部に二重のシールドが形成されて
いることである。
ーナは、クロック回路部に二重のシールドが形成されて
いることである。
【0012】また、デジタルテレビジョン信号受信チュ
ーナは、筺体内に配置された前記クロック回路部から送
出されるクロック信号を前記筺体から送出するためのク
ロック信号出力端子を備えていることである。
ーナは、筺体内に配置された前記クロック回路部から送
出されるクロック信号を前記筺体から送出するためのク
ロック信号出力端子を備えていることである。
【0013】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を用いて詳細に説明する。図1は、本発明に係わ
るデジタルテレビジョン信号受信チューナ(以下チュー
ナと称する)を用いてTV受像機のマザーボードにチュ
ーナとベースバンド処理回路部とを組込んだ状態を説明
するためのブロック構成図である。図1に示すように、
マザーボードAは、チューナ1とベースバンド処理回路
部9とを有している。このチューナ1とベースバンド処
理回路部9とは、それぞれ個別の筺体内に収納されてい
る。
て図面を用いて詳細に説明する。図1は、本発明に係わ
るデジタルテレビジョン信号受信チューナ(以下チュー
ナと称する)を用いてTV受像機のマザーボードにチュ
ーナとベースバンド処理回路部とを組込んだ状態を説明
するためのブロック構成図である。図1に示すように、
マザーボードAは、チューナ1とベースバンド処理回路
部9とを有している。このチューナ1とベースバンド処
理回路部9とは、それぞれ個別の筺体内に収納されてい
る。
【0014】そして、チューナ1は、ひとつの筺体内に
配置された一枚の印刷配線基板上に後述する各回路ユニ
ットをそれぞれシールドするように収納して構成されて
いる。従って、チューナ1を構成する各回路ユニットが
一度の組立作業で完成できるようになっている。そし
て、このチューナ1は、アンテナ8で受信され、チュー
ナ入力端1aに入力されたTV(テレビジョン)信号を
選局してTVの中間周波信号である第一の中間周波信号
に周波数変換する信号受信部2と、該信号受信部2から
送出された第一の中間周波信号の増幅、周波数変換など
の信号処理を行い、第一の中間周波信号を該第一の中間
周波信号よりも周波数の低い第二の中間周波信号に変換
して出力する中間周波回路部3と、該中間周波回路部3
から送出される中心周波数がほぼ4Mzの第二の中間周
波信号をパラレル8ビットのベースバンド信号に変換す
るA/D(アナログ/デジタル)変換回路部4と、該A
/D変換回路部4にて、第二の中間周波信号をサンプリ
ングするためのほぼ18Mzの第一のクロック信号を送
出するクロック回路部5と、A/D変換回路部4から送
出されるパラレル8ビットのベースバンド信号をチュー
ナ1の外部に出力するためのチューナ出力端1bとを備
えている。上述の如く、チューナ1には、A/D変換回
路部4とクロック回路部5とが一体化され、内蔵されて
いる。
配置された一枚の印刷配線基板上に後述する各回路ユニ
ットをそれぞれシールドするように収納して構成されて
いる。従って、チューナ1を構成する各回路ユニットが
一度の組立作業で完成できるようになっている。そし
て、このチューナ1は、アンテナ8で受信され、チュー
ナ入力端1aに入力されたTV(テレビジョン)信号を
選局してTVの中間周波信号である第一の中間周波信号
に周波数変換する信号受信部2と、該信号受信部2から
送出された第一の中間周波信号の増幅、周波数変換など
の信号処理を行い、第一の中間周波信号を該第一の中間
周波信号よりも周波数の低い第二の中間周波信号に変換
して出力する中間周波回路部3と、該中間周波回路部3
から送出される中心周波数がほぼ4Mzの第二の中間周
波信号をパラレル8ビットのベースバンド信号に変換す
るA/D(アナログ/デジタル)変換回路部4と、該A
/D変換回路部4にて、第二の中間周波信号をサンプリ
ングするためのほぼ18Mzの第一のクロック信号を送
出するクロック回路部5と、A/D変換回路部4から送
出されるパラレル8ビットのベースバンド信号をチュー
ナ1の外部に出力するためのチューナ出力端1bとを備
えている。上述の如く、チューナ1には、A/D変換回
路部4とクロック回路部5とが一体化され、内蔵されて
いる。
【0015】また、クロック回路部5からは、前記ほぼ
18Mzの第一のクロック信号の他にほぼ36Mzの第
二のクロック信号が送出されている。そして、第一のク
ロック信号を送出する送出ラインには、例えば18Mz
以下の周波数信号のみを通過させる入力端6aを備えた
第一のLPF(ローパスフィルタ)6が配置されてお
り、この第一のLPF6を介してA/D変換回路部4に
て、第二の中間周波信号をサンプリングするために第一
のクロック信号が、A/D変換回路部4に入力されると
ともに、クロック信号出力端1cからチューナ1の外部
に出力されている。また、第二のクロック信号は、同様
に例えば36Mz以下の周波数信号のみを通過させる入
力端7aを備えた第二のLPF(ローパスフィルタ)7
を介してクロック信号出力端1dからチューナ1の外部
に出力されている。この第一、第二のLPF6、7によ
って、第一、第二のクロック信号に含まれる高調波信号
をカットすることができる。また、前記第一のクロック
信号は、第一のLPF6を介することなく、クロック回
路部5から直接A/D変換回路部4に入力しても良い。
このとき第一のLPF6は、A/D変換回路部4への接
続点を介さず、直接クロック信号出力端1cに接続され
ている。なお、前記フィルタは、LPFに限定されず、
前記クロック信号のみを通過させるバンドパスフィルタ
であっても良い。
18Mzの第一のクロック信号の他にほぼ36Mzの第
二のクロック信号が送出されている。そして、第一のク
ロック信号を送出する送出ラインには、例えば18Mz
以下の周波数信号のみを通過させる入力端6aを備えた
第一のLPF(ローパスフィルタ)6が配置されてお
り、この第一のLPF6を介してA/D変換回路部4に
て、第二の中間周波信号をサンプリングするために第一
のクロック信号が、A/D変換回路部4に入力されると
ともに、クロック信号出力端1cからチューナ1の外部
に出力されている。また、第二のクロック信号は、同様
に例えば36Mz以下の周波数信号のみを通過させる入
力端7aを備えた第二のLPF(ローパスフィルタ)7
を介してクロック信号出力端1dからチューナ1の外部
に出力されている。この第一、第二のLPF6、7によ
って、第一、第二のクロック信号に含まれる高調波信号
をカットすることができる。また、前記第一のクロック
信号は、第一のLPF6を介することなく、クロック回
路部5から直接A/D変換回路部4に入力しても良い。
このとき第一のLPF6は、A/D変換回路部4への接
続点を介さず、直接クロック信号出力端1cに接続され
ている。なお、前記フィルタは、LPFに限定されず、
前記クロック信号のみを通過させるバンドパスフィルタ
であっても良い。
【0016】また、A/D変換回路部4から送出される
パラレル8ビットのベースバンド信号は、チューナ出力
端1bを介してチューナ1の外部に配置されたひとつの
筺体(シールドケース)に収納されたベースバンド処理
回路部9に入力され、該ベースバンド処理回路部9でQ
PSK復調などの信号処理されて、映像信号及び音声信
号が取り出される。また、ベースバンド処理回路部9で
のQPSK復調などのために、クロック回路部5から
は、前述の如くほぼ18Mzの第一のクロック信号とほ
ぼ36Mzの第二のクロック信号とが送出されており、
この各第一、第二のクロック信号は、クロック信号出力
端1c、1dからチューナ1の外部に送出されて、ベー
スバンド処理回路部9に入力される。そして、この第一
のクロック信号は、上述の如くA/D変換回路部4とベ
ースバンド処理回路部9とにそれぞれ入力されて、この
第一のクロック信号が双方の回路部に用いられることか
ら、A/D変換回路部4とベースバンド処理回路部9と
は同期している。
パラレル8ビットのベースバンド信号は、チューナ出力
端1bを介してチューナ1の外部に配置されたひとつの
筺体(シールドケース)に収納されたベースバンド処理
回路部9に入力され、該ベースバンド処理回路部9でQ
PSK復調などの信号処理されて、映像信号及び音声信
号が取り出される。また、ベースバンド処理回路部9で
のQPSK復調などのために、クロック回路部5から
は、前述の如くほぼ18Mzの第一のクロック信号とほ
ぼ36Mzの第二のクロック信号とが送出されており、
この各第一、第二のクロック信号は、クロック信号出力
端1c、1dからチューナ1の外部に送出されて、ベー
スバンド処理回路部9に入力される。そして、この第一
のクロック信号は、上述の如くA/D変換回路部4とベ
ースバンド処理回路部9とにそれぞれ入力されて、この
第一のクロック信号が双方の回路部に用いられることか
ら、A/D変換回路部4とベースバンド処理回路部9と
は同期している。
【0017】ここで、本発明の実施の形態のデジタルテ
レビジョン信号受信チューナが配置された筺体につい
て、図2を参照して説明する。図2は、本発明の実施の
形態のデジタルテレビジョン信号受信チューナが配置さ
れた筺体から上・下カバーを外した状態の筺体を示す平
面図である。
レビジョン信号受信チューナが配置された筺体につい
て、図2を参照して説明する。図2は、本発明の実施の
形態のデジタルテレビジョン信号受信チューナが配置さ
れた筺体から上・下カバーを外した状態の筺体を示す平
面図である。
【0018】図2に示すように、平板状の金属材料から
成り、箱形に折り曲げ形成された枠体10は、少なくと
も四方を囲む側壁11と、該側壁11によって形成され
た上方の開放部10aと下方の開放部(図示せず)と、
該側壁11によって形成される空間部分を複数個であっ
て、例えば5個の第一〜第五の区画室12a、12b、
12c、12d、12eに区分けするための複数枚(例
えば4枚)の金属板から成る仕切壁10b、10b、・
・とを備えている。この側壁11と仕切壁10bとによ
って、それぞれの第一〜第五の区画室12a、12b、
12c、12d、12eはそれぞれシールド(遮蔽)さ
れた構成である。なお、本発明の実施の形態では、区画
室を5個形成したが、これに限定されず、7個でも10
個でも、所望の個数の区画室を形成しても良い。
成り、箱形に折り曲げ形成された枠体10は、少なくと
も四方を囲む側壁11と、該側壁11によって形成され
た上方の開放部10aと下方の開放部(図示せず)と、
該側壁11によって形成される空間部分を複数個であっ
て、例えば5個の第一〜第五の区画室12a、12b、
12c、12d、12eに区分けするための複数枚(例
えば4枚)の金属板から成る仕切壁10b、10b、・
・とを備えている。この側壁11と仕切壁10bとによ
って、それぞれの第一〜第五の区画室12a、12b、
12c、12d、12eはそれぞれシールド(遮蔽)さ
れた構成である。なお、本発明の実施の形態では、区画
室を5個形成したが、これに限定されず、7個でも10
個でも、所望の個数の区画室を形成しても良い。
【0019】入力端子13は、中心導体14を有し、ア
ンテナ(図示せず)からのTV信号を前記チューナ1
(図1参照)に入力するために設けられ、短手方向の側
壁11の上方に配置され、中心導体14の端部は、最初
の段を構成する第一の区画室12a内に配置されてい
る。この入力端子13は、前記チューナ入力端1a(図
1参照)に該当する。
ンテナ(図示せず)からのTV信号を前記チューナ1
(図1参照)に入力するために設けられ、短手方向の側
壁11の上方に配置され、中心導体14の端部は、最初
の段を構成する第一の区画室12a内に配置されてい
る。この入力端子13は、前記チューナ入力端1a(図
1参照)に該当する。
【0020】一枚の絶縁材料からなる平板状の印刷配線
基板15は、矩形であって、図示していないが例えば一
方の表面にコイルや集積回路などの電気部品が搭載さ
れ、他方の表面に所定の回路パターンが形成されてい
る。また、この印刷配線基板15は、枠体10の下方の
開放部(図示せず)から、枠体10内の上方に向かって
挿入・配置されている。また、印刷配線基板15の一端
部には、金属材料からなる平板状の複数本の端子16、
16、・・が取付接続されている。この複数本の端子1
6は、例えば電源回路(図示せず)からの電力を供給す
るための電源用端子や、前記クロック回路部5(図1参
照)から出力されるクロック信号を送出するためのクロ
ック信号出力端1c、1dや、前記A/D変換回路部4
から出力されるベースバンド信号を送出するチューナ出
力端1bなどを構成している。そして、これらの端子1
6は、印刷配線基板15の各回路パターンと電気的に接
続されている。
基板15は、矩形であって、図示していないが例えば一
方の表面にコイルや集積回路などの電気部品が搭載さ
れ、他方の表面に所定の回路パターンが形成されてい
る。また、この印刷配線基板15は、枠体10の下方の
開放部(図示せず)から、枠体10内の上方に向かって
挿入・配置されている。また、印刷配線基板15の一端
部には、金属材料からなる平板状の複数本の端子16、
16、・・が取付接続されている。この複数本の端子1
6は、例えば電源回路(図示せず)からの電力を供給す
るための電源用端子や、前記クロック回路部5(図1参
照)から出力されるクロック信号を送出するためのクロ
ック信号出力端1c、1dや、前記A/D変換回路部4
から出力されるベースバンド信号を送出するチューナ出
力端1bなどを構成している。そして、これらの端子1
6は、印刷配線基板15の各回路パターンと電気的に接
続されている。
【0021】また、図示していないが、枠体10の上方
の開放部10aと下方の開放部(図示せず)とを覆う金
属材料から成る平板状の上カバーと下カバーとを備えて
いる。この上カバーと下カバーと枠体10の側壁11と
によって筺体は、全体がシールドされた構成であるとと
もに、側壁11によって形成された空間を区分けする仕
切壁10bによって形成される第一〜第五の区画室12
a、12b、12c、12d、12eは、それぞれ個別
にシールドされた構成となっている。また、前記第五の
区画室12e内に配置された印刷配線基板15の上に
は、金属板を折り曲げ加工した、四方を囲む側壁17
と、該側壁17によって形成された上方の開放部を覆う
上カバー(図示せず)とが配置されている。この側壁1
7によって第六の区画室12fが構成され、よって、第
六の区画室12fは、側壁17と上カバーとによって、
第一のシールドがなされ、さらに側壁17の外側に配置
された側壁11と仕切壁10bと上・下カバー(図示せ
ず)とによって第二のシールドがなされて、二重のシー
ルド構造を備えている。
の開放部10aと下方の開放部(図示せず)とを覆う金
属材料から成る平板状の上カバーと下カバーとを備えて
いる。この上カバーと下カバーと枠体10の側壁11と
によって筺体は、全体がシールドされた構成であるとと
もに、側壁11によって形成された空間を区分けする仕
切壁10bによって形成される第一〜第五の区画室12
a、12b、12c、12d、12eは、それぞれ個別
にシールドされた構成となっている。また、前記第五の
区画室12e内に配置された印刷配線基板15の上に
は、金属板を折り曲げ加工した、四方を囲む側壁17
と、該側壁17によって形成された上方の開放部を覆う
上カバー(図示せず)とが配置されている。この側壁1
7によって第六の区画室12fが構成され、よって、第
六の区画室12fは、側壁17と上カバーとによって、
第一のシールドがなされ、さらに側壁17の外側に配置
された側壁11と仕切壁10bと上・下カバー(図示せ
ず)とによって第二のシールドがなされて、二重のシー
ルド構造を備えている。
【0022】上述の如き構成の筺体の第一〜第五の区画
室12a、12b、12c、12d、12eには、図1
で示したチューナ1の各回路部(ユニット)が配置され
ている。ここで、第一〜第五の区画室12a、12b、
12c、12d、12eにそれぞれ配置されたチューナ
1(図1参照)の各ブロック構成図との関係について説
明する。まず、筺体の入力端子13側から見て最初の段
である第一の区画室12aと、次段の第二の区画室12
bとには、前記信号受信部2を構成する図示していない
電気部品や回路パターンが印刷配線基板15上に配置さ
れ、同様に次の段である第三の区画室12cには、前記
中間周波回路部3が、また同様に次の段である第四の区
画室12dには、前記A/D変換回路部4が、さらにま
た同様に入力端子13側から見て最終の段である第五の
区画室12eには、前記クロック回路部5と各LPF
(ローパスフィルタ)6、7とを構成する図示していな
い電気部品や回路パターンが印刷配線基板15上に配置
されている。
室12a、12b、12c、12d、12eには、図1
で示したチューナ1の各回路部(ユニット)が配置され
ている。ここで、第一〜第五の区画室12a、12b、
12c、12d、12eにそれぞれ配置されたチューナ
1(図1参照)の各ブロック構成図との関係について説
明する。まず、筺体の入力端子13側から見て最初の段
である第一の区画室12aと、次段の第二の区画室12
bとには、前記信号受信部2を構成する図示していない
電気部品や回路パターンが印刷配線基板15上に配置さ
れ、同様に次の段である第三の区画室12cには、前記
中間周波回路部3が、また同様に次の段である第四の区
画室12dには、前記A/D変換回路部4が、さらにま
た同様に入力端子13側から見て最終の段である第五の
区画室12eには、前記クロック回路部5と各LPF
(ローパスフィルタ)6、7とを構成する図示していな
い電気部品や回路パターンが印刷配線基板15上に配置
されている。
【0023】そして、クロック回路部5は、側壁17に
よって形成され、二重シールドされた、第六の区画室1
2f内に配置されている。この第六の区画室12fは、
前記入力端子13からは、最も離れた位置に配置されて
いる。そして、上述の如く配置された各ブロック構成図
に示す各回路部は、それぞれシールドされた区画室内に
配置されて、各回路部に流れる信号の相互の影響を防止
している。
よって形成され、二重シールドされた、第六の区画室1
2f内に配置されている。この第六の区画室12fは、
前記入力端子13からは、最も離れた位置に配置されて
いる。そして、上述の如く配置された各ブロック構成図
に示す各回路部は、それぞれシールドされた区画室内に
配置されて、各回路部に流れる信号の相互の影響を防止
している。
【0024】次にここで、前記ローパスフィルタ6を出
力端1cに直接接続した場合(LPF7も同様)の具体
的な構成の一実施例について詳述する。図3に示すよう
に、ローパスフィルタ6は、入力端6aと、該入力端6
aに接続されたコイル6bと、該コイル6bの一端に接
続されたコンデンサ6cと、該コイル6bに直列接続さ
れた金属棒から成る出力端子20とから構成されてい
る。また、出力端子20は、金属板から成る筺体の側壁
11に設けられた孔21から、側壁11の内側から外側
にまで延びて配置されている。そして、コンデンサ6c
は、一端がコイル6bと、他端が側壁11とに接続して
配置されている。このコンデンサ6cと、コイル6bと
によって、ローパスフィルタ6は、構成されている。
力端1cに直接接続した場合(LPF7も同様)の具体
的な構成の一実施例について詳述する。図3に示すよう
に、ローパスフィルタ6は、入力端6aと、該入力端6
aに接続されたコイル6bと、該コイル6bの一端に接
続されたコンデンサ6cと、該コイル6bに直列接続さ
れた金属棒から成る出力端子20とから構成されてい
る。また、出力端子20は、金属板から成る筺体の側壁
11に設けられた孔21から、側壁11の内側から外側
にまで延びて配置されている。そして、コンデンサ6c
は、一端がコイル6bと、他端が側壁11とに接続して
配置されている。このコンデンサ6cと、コイル6bと
によって、ローパスフィルタ6は、構成されている。
【0025】上述の如く、A/D変換回路部4にて、第
二の中間周波信号をサンプリングするためのクロック信
号を送出するクロック回路部5は、チューナ1に一体化
(内蔵)されて、全体でひとつの筺体内に構成されてい
ることから、マザーボードA上には、チューナ1とベー
スバンド処理回路部9とのふたつの回路(筺体)のみが
搭載・配置されているので、マザーボードA上の各回路
の配置が簡単になる。また、クロック回路部5は、入力
端子13側から見て最も離れた位置である最後の区画室
に配置されていることによって、クロック信号の高調波
信号がチューナ1内の各回路を通って、入力端1aに入
力されないのでクロック信号の高調波信号によるチュー
ナ1への妨害は生じない。
二の中間周波信号をサンプリングするためのクロック信
号を送出するクロック回路部5は、チューナ1に一体化
(内蔵)されて、全体でひとつの筺体内に構成されてい
ることから、マザーボードA上には、チューナ1とベー
スバンド処理回路部9とのふたつの回路(筺体)のみが
搭載・配置されているので、マザーボードA上の各回路
の配置が簡単になる。また、クロック回路部5は、入力
端子13側から見て最も離れた位置である最後の区画室
に配置されていることによって、クロック信号の高調波
信号がチューナ1内の各回路を通って、入力端1aに入
力されないのでクロック信号の高調波信号によるチュー
ナ1への妨害は生じない。
【0026】
【発明の効果】以上のように、本発明のデジタルテレビ
ジョン信号受信チューナは、テレビジョン信号をテレビ
ジョンの中間周波信号である第一の中間周波信号に周波
数変換する信号受信部と、該信号受信部から出力される
第一の中間周波信号を該第一の中間周波信号よりも周波
数の低い第二の中間周波信号に周波数変換する中間周波
回路部と、該中間周波回路部から出力される第二の中間
周波信号をデジタル信号に変換するためのアナログ/デ
ジタル変換回路部とを備えたチューナにアナログ/デジ
タル変換回路部にて、第二の中間周波信号をサンプリン
グするためのクロック信号を発生させるクロック回路部
を内蔵させたことによって、クロック回路部はチューナ
と一体化されて、ひとつの回路構成に集約されている。
このことから、クロック回路部を一体化したチューナ
は、一度の組立によって完成され、組立工数が削減出来
るという効果を奏す。そして、TV受像機のマザーボー
ドに、このデジタルテレビジョン信号受信チューナとベ
ースバンド処理回路部とのふたつの回路構成のみを配置
するだけで、マザーボードを組み立てることが出来ると
ともに、ふたつの回路構成のみから成るので配置が単純
化され、マザーボードの設計及び組立コストが安価に成
るという効果を奏する。
ジョン信号受信チューナは、テレビジョン信号をテレビ
ジョンの中間周波信号である第一の中間周波信号に周波
数変換する信号受信部と、該信号受信部から出力される
第一の中間周波信号を該第一の中間周波信号よりも周波
数の低い第二の中間周波信号に周波数変換する中間周波
回路部と、該中間周波回路部から出力される第二の中間
周波信号をデジタル信号に変換するためのアナログ/デ
ジタル変換回路部とを備えたチューナにアナログ/デジ
タル変換回路部にて、第二の中間周波信号をサンプリン
グするためのクロック信号を発生させるクロック回路部
を内蔵させたことによって、クロック回路部はチューナ
と一体化されて、ひとつの回路構成に集約されている。
このことから、クロック回路部を一体化したチューナ
は、一度の組立によって完成され、組立工数が削減出来
るという効果を奏す。そして、TV受像機のマザーボー
ドに、このデジタルテレビジョン信号受信チューナとベ
ースバンド処理回路部とのふたつの回路構成のみを配置
するだけで、マザーボードを組み立てることが出来ると
ともに、ふたつの回路構成のみから成るので配置が単純
化され、マザーボードの設計及び組立コストが安価に成
るという効果を奏する。
【0027】また、本発明のデジタルテレビジョン信号
受信チューナは、テレビジョン信号が入力される入力端
子を有するとともに、テレビジョン信号をテレビジョン
の中間周波信号である第一の中間周波信号に周波数変換
する信号受信部と、該信号受信部から出力される第一の
中間周波信号を該第一の中間周波信号よりも周波数の低
い第二の中間周波信号に周波数変換する中間周波回路部
と、該中間周波回路部から出力される第二の中間周波信
号をデジタル信号に変換するためのアナログ/デジタル
変換回路部と、該アナログ/デジタル変換回路部にて、
第二の中間周波信号をサンプリングするためのクロック
信号を発生させるクロック回路部とを備えたチューナを
金属板からなり、複数個の区画室を備えた筺体内に配置
し、クロック回路部を入力端子から最も離れた位置に設
けた区画室に配置したことから、クロック回路部からの
クロック信号の高調波信号が入力端子から入力されるこ
とは少なくなり、クロック信号の高調波信号による妨害
発生が少なくなる。
受信チューナは、テレビジョン信号が入力される入力端
子を有するとともに、テレビジョン信号をテレビジョン
の中間周波信号である第一の中間周波信号に周波数変換
する信号受信部と、該信号受信部から出力される第一の
中間周波信号を該第一の中間周波信号よりも周波数の低
い第二の中間周波信号に周波数変換する中間周波回路部
と、該中間周波回路部から出力される第二の中間周波信
号をデジタル信号に変換するためのアナログ/デジタル
変換回路部と、該アナログ/デジタル変換回路部にて、
第二の中間周波信号をサンプリングするためのクロック
信号を発生させるクロック回路部とを備えたチューナを
金属板からなり、複数個の区画室を備えた筺体内に配置
し、クロック回路部を入力端子から最も離れた位置に設
けた区画室に配置したことから、クロック回路部からの
クロック信号の高調波信号が入力端子から入力されるこ
とは少なくなり、クロック信号の高調波信号による妨害
発生が少なくなる。
【0028】また、本発明のデジタルテレビジョン信号
受信チューナは、クロック回路部から送出されるクロッ
ク信号の送出ラインにクロック信号を通過させるフィル
タを備えたことから、クロック信号に含まれている高調
波信号をフィルタによって減衰させて、所望のクロック
信号のみを通過させるのでクロック信号の高調波信号に
よる妨害発生が少なくなる。
受信チューナは、クロック回路部から送出されるクロッ
ク信号の送出ラインにクロック信号を通過させるフィル
タを備えたことから、クロック信号に含まれている高調
波信号をフィルタによって減衰させて、所望のクロック
信号のみを通過させるのでクロック信号の高調波信号に
よる妨害発生が少なくなる。
【0029】また、本発明のデジタルテレビジョン信号
受信チューナは、クロック回路部に二重のシールドが形
成されていることから、クロック回路部から放出される
クロック信号の高調波信号が二重のシールドによってク
ロック回路部の外に出ることがないことからクロック信
号の高調波信号による妨害発生が少なくなる。
受信チューナは、クロック回路部に二重のシールドが形
成されていることから、クロック回路部から放出される
クロック信号の高調波信号が二重のシールドによってク
ロック回路部の外に出ることがないことからクロック信
号の高調波信号による妨害発生が少なくなる。
【0030】また、本発明のデジタルテレビジョン信号
受信チューナは、筺体内に配置された前記クロック回路
部から送出されるクロック信号を前記筺体から送出する
ためのクロック信号出力端子を前記筺体に備えたことに
よって、このクロック信号出力端子から送出されるクロ
ック信号を、チューナの後段に接続されるベースバンド
処理回路部に入力することによって、ベースバンド処理
回路部では、アナログ/デジタル変換回路部と同期した
クロック信号を用いることが出来る。
受信チューナは、筺体内に配置された前記クロック回路
部から送出されるクロック信号を前記筺体から送出する
ためのクロック信号出力端子を前記筺体に備えたことに
よって、このクロック信号出力端子から送出されるクロ
ック信号を、チューナの後段に接続されるベースバンド
処理回路部に入力することによって、ベースバンド処理
回路部では、アナログ/デジタル変換回路部と同期した
クロック信号を用いることが出来る。
【図1】本発明の実施の形態のに係わるデジタルテレビ
ジョン信号受信チューナを用いてTV受像機のマザーボ
ードにチューナとベースバンド処理回路部とを組込んだ
状態を説明するためのブロック構成図である。
ジョン信号受信チューナを用いてTV受像機のマザーボ
ードにチューナとベースバンド処理回路部とを組込んだ
状態を説明するためのブロック構成図である。
【図2】本発明の実施の形態のデジタルテレビジョン信
号受信チューナが配置された筺体から上・下カバーを外
した状態の筺体を示す平面図である。
号受信チューナが配置された筺体から上・下カバーを外
した状態の筺体を示す平面図である。
【図3】本発明の実施の形態のデジタルテレビジョン信
号受信チューナに配置されるローパスフィルタを説明す
るための説明図である。
号受信チューナに配置されるローパスフィルタを説明す
るための説明図である。
【図4】従来のマザーボードにチューナとA/D変換器
とクロック発振器とベースバンド処理回路部とを組込ん
だ状態を示すブロック構成図である。
とクロック発振器とベースバンド処理回路部とを組込ん
だ状態を示すブロック構成図である。
1 チューナ 1a チューナ入力端 1b チューナ出力端(端子) 1c、1d クロック信号出力端(端子) 2 信号受信部 3 中間周波回路部 4 A/D(アナログ/デジタル)変換回路部 5 クロック回路部 6、7 LPF(ローパスフィルタ) 8 アンテナ 9 ベースバンド処理回路部 10 枠体 11、17 側壁 12a 第一の区画室 12b 第二の区画室 12e 第五の区画室 12f 第六の区画室 13 入力端子(チューナ入力端) 14 中心導体 15 印刷配線基板 16 端子
Claims (5)
- 【請求項1】 テレビジョン信号をテレビジョンの中間
周波信号である第一の中間周波信号に周波数変換する信
号受信部と、該信号受信部から出力される前記第一の中
間周波信号を該第一の中間周波信号よりも周波数の低い
第二の中間周波信号に周波数変換する中間周波回路部
と、該中間周波回路部から出力される第二の中間周波信
号をデジタル信号に変換するためのアナログ/デジタル
変換回路部とを備えたチューナに、前記アナログ/デジ
タル変換回路部にて第二の中間周波信号をサンプリング
するためのクロック信号を発生させるクロック回路部を
内蔵したことを特徴とするデジタルテレビジョン信号受
信チューナ。 - 【請求項2】 テレビジョン信号が入力される入力端子
を有するとともに、テレビジョン信号をテレビジョンの
中間周波信号である第一の中間周波信号に周波数変換す
る信号受信部と、該信号受信部から出力される前記第一
の中間周波信号を該第一の中間周波信号よりも周波数の
低い第二の中間周波信号に周波数変換する中間周波回路
部と、該中間周波回路部から出力される第二の中間周波
信号をデジタル信号に変換するためのアナログ/デジタ
ル変換回路部と、該アナログ/デジタル変換回路部にて
第二の中間周波信号をサンプリングするためのクロック
信号を発生させるクロック回路部とを備えたチューナを
金属板からなり、複数個の区画室を備えた筺体内に配置
し、前記クロック回路部を前記入力端子から最も離れた
位置に設けた区画室に配置したことを特徴とするデジタ
ルテレビジョン信号受信チューナ。 - 【請求項3】 前記クロック回路部から送出されるクロ
ック信号の送出ラインに前記クロック信号を通過させる
フィルタを備えたことを特徴とする請求項1又は2記載
のデジタルテレビジョン信号受信チューナ。 - 【請求項4】 前記クロック回路部に二重のシールドが
形成されていることを特徴とする請求項1、2又は3記
載のデジタルテレビジョン信号受信チューナ。 - 【請求項5】 前記筺体内に配置された前記クロック回
路部から送出されるクロック信号を前記筺体から送出す
るためのクロック信号出力端子を備えていることを特徴
とする請求項1、2、3又は4記載のデジタルテレビジ
ョン信号受信チューナ。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30045297A JPH11136152A (ja) | 1997-10-31 | 1997-10-31 | デジタルテレビジョン信号受信チューナ |
DE1998615249 DE69815249T2 (de) | 1997-10-31 | 1998-10-16 | Tuner für den Empfang von digitalen Fernsehsignalen |
EP19980308483 EP0913924B1 (en) | 1997-10-31 | 1998-10-16 | Tuner for receiving digital television signals |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30045297A JPH11136152A (ja) | 1997-10-31 | 1997-10-31 | デジタルテレビジョン信号受信チューナ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH11136152A true JPH11136152A (ja) | 1999-05-21 |
Family
ID=17884979
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30045297A Pending JPH11136152A (ja) | 1997-10-31 | 1997-10-31 | デジタルテレビジョン信号受信チューナ |
Country Status (3)
Country | Link |
---|---|
EP (1) | EP0913924B1 (ja) |
JP (1) | JPH11136152A (ja) |
DE (1) | DE69815249T2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101867846B1 (ko) * | 2011-11-01 | 2018-06-19 | 삼성전자주식회사 | 텔레비전 튜너 모듈 및 이를 구비한 방송수신장치 |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6999132B1 (en) * | 2002-02-19 | 2006-02-14 | Lsi Logic Corporation | RF/IF digital demodulation of video and audio |
JP4170862B2 (ja) * | 2003-09-05 | 2008-10-22 | アルプス電気株式会社 | 電子回路ユニット |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61150410A (ja) * | 1984-12-24 | 1986-07-09 | Sony Corp | チユ−ナ装置 |
US4686570A (en) * | 1985-12-24 | 1987-08-11 | Rca Corporation | Analog-to-digital converter as for an adaptive television deghosting system |
US4717990A (en) * | 1986-05-30 | 1988-01-05 | Motorola, Inc. | Double-shielded housing for RF circuitry |
-
1997
- 1997-10-31 JP JP30045297A patent/JPH11136152A/ja active Pending
-
1998
- 1998-10-16 EP EP19980308483 patent/EP0913924B1/en not_active Expired - Lifetime
- 1998-10-16 DE DE1998615249 patent/DE69815249T2/de not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101867846B1 (ko) * | 2011-11-01 | 2018-06-19 | 삼성전자주식회사 | 텔레비전 튜너 모듈 및 이를 구비한 방송수신장치 |
Also Published As
Publication number | Publication date |
---|---|
DE69815249D1 (de) | 2003-07-10 |
EP0913924B1 (en) | 2003-06-04 |
EP0913924A1 (en) | 1999-05-06 |
DE69815249T2 (de) | 2003-12-04 |
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