JPH11133919A - Liquid crystal display - Google Patents

Liquid crystal display

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JPH11133919A
JPH11133919A JP29395797A JP29395797A JPH11133919A JP H11133919 A JPH11133919 A JP H11133919A JP 29395797 A JP29395797 A JP 29395797A JP 29395797 A JP29395797 A JP 29395797A JP H11133919 A JPH11133919 A JP H11133919A
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JP
Japan
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electrode
voltage
switching element
circuit
liquid crystal
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JP29395797A
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Japanese (ja)
Inventor
Katsumasa Iwami
勝政 岩見
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Advanced Display Inc
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Abstract

PROBLEM TO BE SOLVED: To provide a liquid crystal display which eliminates any in-plane distribution of flicker and improves the picture quality. SOLUTION: A liquid crystal display is provided with a DC potential automatic adjusting circuit 21 which adjusts a reference voltage Vref outputted by a Vref generation circuit 1 at each source driver IC3 according to the difference between the voltage applied to a drain electrode of TFT(Thin Film Transistor) constituting a pixel and a voltage applied to the opposite electrode, which is arranged opposite to a display electrode connected to the drain electrode across the liquid crystal, so as to feed it to a source driver IC3. In this case, effects of parasitic capacity between the gate and drain electrodes of the TFT on the source drive voltage is eliminated so as to eliminate any dispersion of the flicker in the display part.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】この発明は、薄膜トランジス
タ(以下TFTという)を用いたアクティブマトリクス
型液晶表示装置に関し、特にその駆動回路に関するもの
である。
[0001] 1. Field of the Invention [0002] The present invention relates to an active matrix type liquid crystal display device using a thin film transistor (hereinafter, referred to as a TFT), and more particularly to a driving circuit thereof.

【0002】[0002]

【従来の技術】図3は、従来の液晶表示装置を示す概略
構成図である。図3において、1は基準電圧Vrefを
生成するVref生成回路、2はソースTCP(テープ
キャリアパッケージの略)、3はソースTCP2に搭載
されたソースドライバICである。Vref生成回路1
で生成されたN個の基準電圧(通常Nは7〜11程度)
は、各ソースドライバIC3に並列に供給される。4は
ゲート線とソース線の交点にTFTを有する液晶パネル
で、ソースドライバIC3が基準電圧にもとづきソース
線に階調電圧であるソース駆動電圧を供給する。
2. Description of the Related Art FIG. 3 is a schematic diagram showing a conventional liquid crystal display device. In FIG. 3, reference numeral 1 denotes a Vref generating circuit that generates a reference voltage Vref, 2 denotes a source TCP (abbreviation of a tape carrier package), and 3 denotes a source driver IC mounted on the source TCP2. Vref generation circuit 1
N reference voltages generated in (N is usually 7 to 11)
Are supplied in parallel to each source driver IC3. Reference numeral 4 denotes a liquid crystal panel having a TFT at an intersection of a gate line and a source line. A source driver IC 3 supplies a source drive voltage, which is a gray scale voltage, to the source line based on a reference voltage.

【0003】図4は、従来のアクティブマトリクス型液
晶表示装置の一画素分の等価回路を示す図である。図4
において、8はゲート線、9はソース線、10はTF
T、11はTFT10のゲート・ドレイン間の寄生容量
Cgd、12はTFT10によって、電圧が印加される
液晶の容量Clcで、液晶はTFT10のドレイン電極
に接続された表示電極と、この表示電極に対向して配置
された対向電極の間に挟持されている。13はゲート駆
動電圧のオフ時にゲート・ドレイン間寄生容量Cgd1
1によるフィールドスルー電圧△Vgdを低減するため
の付加容量Cstである。Vgはゲート駆動電圧、Vs
はソース駆動電圧、VdはTFT10のドレイン電極に
印加されるドレイン電圧、Vcomは対向電極に印加さ
れるコモン電圧である。
FIG. 4 is a diagram showing an equivalent circuit for one pixel of a conventional active matrix type liquid crystal display device. FIG.
, 8 is a gate line, 9 is a source line, and 10 is TF
T and 11 are a parasitic capacitance Cgd between the gate and the drain of the TFT 10, and 12 is a capacitance Clc of a liquid crystal to which a voltage is applied by the TFT 10. The liquid crystal is opposed to a display electrode connected to the drain electrode of the TFT 10 and faces the display electrode. Are sandwiched between the counter electrodes which are arranged in the same manner. 13 is a gate-drain parasitic capacitance Cgd1 when the gate drive voltage is off.
1 is an additional capacitance Cst for reducing the field through voltage ΔVgd. Vg is the gate drive voltage, Vs
Is a source drive voltage, Vd is a drain voltage applied to the drain electrode of the TFT 10, and Vcom is a common voltage applied to the counter electrode.

【0004】図5は、従来の液晶表示装置の液晶セルに
かかる各部の電圧波形を示す図である。図5において、
14はソース駆動電圧の平均電圧Vso、15はソース
駆動電圧の振幅Vsa、16はゲート駆動電圧Vg、1
7はゲート駆動電圧Vg16のオフ時にゲート・ドレイ
ン間寄生容量Cgdによるフィールドスルー電圧△Vg
dである。図6は、従来の液晶表示装置の液晶パネルの
左側と右側のゲート駆動電圧波形の歪みを示す図であ
る。図6において、4は図3と同じ液晶パネル、18は
ゲートTCPで、液晶パネル4のゲート線に、TFT1
0のゲートを水平周期でオン、オフするための信号であ
るゲート駆動電圧Vgを送出するゲートドライバICを
搭載している。19はゲート基板で、複数のゲートTC
P18に搭載されたゲートドライバICに必要な信号及
び電圧をパラレルに供給するための信号及び電圧線がバ
ス状に配置されている。
FIG. 5 is a diagram showing voltage waveforms at various portions of a liquid crystal cell of a conventional liquid crystal display device. In FIG.
14 is the average voltage Vso of the source drive voltage, 15 is the amplitude Vsa of the source drive voltage, 16 is the gate drive voltage Vg, 1
7 is a field-through voltage ΔVg due to the gate-drain parasitic capacitance Cgd when the gate drive voltage Vg16 is off.
d. FIG. 6 is a diagram showing distortion of gate drive voltage waveforms on the left and right sides of a liquid crystal panel of a conventional liquid crystal display device. 6, reference numeral 4 denotes the same liquid crystal panel as in FIG. 3, and reference numeral 18 denotes a gate TCP.
A gate driver IC for transmitting a gate drive voltage Vg, which is a signal for turning on and off the gate of 0 in a horizontal cycle, is mounted. 19 is a gate substrate, which has a plurality of gate TCs
Signal and voltage lines for supplying necessary signals and voltages to the gate driver IC mounted on P18 in parallel are arranged in a bus shape.

【0005】このように構成された従来の液晶表示装置
においては、図4のTFT10はゲート線8に入力する
ゲート駆動電圧によりオンオフされ、オン時にソース線
9より階調電圧であるソース駆動電圧を液晶容量Clc
12及び付加容量Cst13に書き込む。しかし、TF
T10のゲート電極とドレイン電極の間にはゲート・ド
レイン間寄生容量Cgd11が存在するため、図5に示
すようにゲート駆動電圧Vg16の立下がり時にフィー
ルドスルー電圧△Vgd17の分だけ電圧シフトを起こ
す。このフィールドスルー電圧△Vgd17は、(1)
式のように表される。 △Vgd=Cgd・Vg/(Cgd+Clc+Cst)・・・(1) したがって、ソース線に加えられる電圧と、実際にドレ
イン側すなわち液晶に印加される電圧との間には、この
フィールドスルー電圧△Vgd17分の電位差があるた
め、対向電極の電位であるコモン電圧に対し、ソース駆
動電圧はあらかじめフィールドスルー電圧△Vgd17
電圧を上げておく必要がある。
In the conventional liquid crystal display device thus configured, the TFT 10 shown in FIG. 4 is turned on and off by a gate drive voltage inputted to the gate line 8, and when the TFT 10 is turned on, a source drive voltage which is a gray scale voltage is applied from the source line 9. Liquid crystal capacitance Clc
12 and the additional capacity Cst13. However, TF
Since the gate-drain parasitic capacitance Cgd11 exists between the gate electrode and the drain electrode of T10, a voltage shift occurs by the field-through voltage ΔVgd17 when the gate drive voltage Vg16 falls, as shown in FIG. This field-through voltage ΔVgd17 is expressed by (1)
It is expressed like a formula. ΔVgd = Cgd · Vg / (Cgd + Clc + Cst) (1) Therefore, between the voltage applied to the source line and the voltage actually applied to the drain side, that is, the liquid crystal, this field-through voltage ΔVgd17 minutes Of the common voltage, which is the potential of the common electrode, the source drive voltage is previously set to the field through voltage ΔVgd17
The voltage needs to be increased.

【0006】このフィールドスルー電圧△Vgd17
は、(1)式からもわかるようにゲート・ドレイン間寄
生容量Cgd11により変化する。そして、ゲート・ド
レイン間寄生容量Cgd11は、ゲート駆動電圧の立ち
上がり/立ち下がり時間により変化する値である。ゲー
ト駆動電圧の立ち上がり/立ち下がり時間が短い場合
は、ゲート・ドレイン間寄生容量Cgd11は大きく、
従ってフィールドスルー電圧△Vgd17も大きくなる
が、ゲート駆動電圧の立ち上がり/立ち下がり時間が長
い場合は、ゲート・ドレイン間寄生容量Cgd11は小
さく、従ってフィールドスルー電圧△Vgd17も小さ
くなる。通常ゲート駆動電圧は画面の左端より入力され
るため、図6に示すように、左端のゲート駆動電圧の立
ち上がり/立ち下がり時間が短く、右端のゲート駆動電
圧の立ち上がり/立ち下がり時間が長くなる。したがっ
て、画面の左側のエリアと右側のエリアで、フィールド
スルー電圧△Vgd17が違ってくるため、フリッカを
見えなくするための最適コモン電圧値も1画面内の左側
と右側では違ってくる。これが通常フリッカの面内分布
と呼ばれているものである。この面内分布は、液晶表示
画面が大きくなればなるほど、顕在化してくる。
The field through voltage ΔVgd17
Varies with the gate-drain parasitic capacitance Cgd11 as can be seen from the equation (1). The gate-drain parasitic capacitance Cgd11 is a value that changes according to the rise / fall time of the gate drive voltage. When the rise / fall time of the gate drive voltage is short, the gate-drain parasitic capacitance Cgd11 is large,
Therefore, the field through voltage ΔVgd17 increases, but when the rise / fall time of the gate drive voltage is long, the gate-drain parasitic capacitance Cgd11 is small, and the field through voltage ΔVgd17 is also small. Since the normal gate drive voltage is input from the left end of the screen, as shown in FIG. 6, the rise / fall time of the left end gate drive voltage is short and the rise / fall time of the right end gate drive voltage is long. Therefore, since the field through voltage ΔVgd17 differs between the left area and the right area of the screen, the optimum common voltage value for making the flicker invisible differs between the left and right areas in one screen. This is what is usually called the in-plane distribution of flicker. This in-plane distribution becomes more apparent as the size of the liquid crystal display screen increases.

【0007】[0007]

【発明が解決しようとする課題】従来のアクティブマト
リクス型液晶表示装置は、以上のように構成されている
ため、最適コモン電圧が画面の左側と右側でずれてお
り、コモン電圧だけの調整でフリッカを完全に見えなく
することが困難であった。
Since the conventional active matrix type liquid crystal display device is configured as described above, the optimum common voltage is shifted between the left and right sides of the screen, and the flicker is caused by adjusting only the common voltage. Was difficult to completely hide.

【0008】この発明は上記のような課題を解決するた
めになされたもので、フリッカの面内分布をなくし、画
質を向上させることのできる液晶表示装置を得ることを
目的とする。
SUMMARY OF THE INVENTION The present invention has been made to solve the above-described problems, and has as its object to provide a liquid crystal display device capable of eliminating flicker in-plane distribution and improving image quality.

【0009】[0009]

【課題を解決するための手段】この発明に係わる液晶表
示装置においては、複数の走査線と複数の信号線との交
点にマトリクス状に配置され、第一の電極が走査線に第
二の電極が信号線に第三の電極が表示電極にそれぞれ接
続されたスイッチング素子を有する表示部と、走査線に
接続され、スイッチング素子に第一の電圧を供給する第
一の駆動回路と、複数の基準電圧を出力する基準電圧発
生回路と、信号線に接続され、スイッチング素子に第二
の電圧を供給する複数の第二の駆動回路と、この第二の
駆動回路毎に設けられ、スイッチング素子の第一の電極
と第三の電極との間の寄生容量が第三の電極に印加され
る電圧に及ぼす影響に応じて基準電圧発生回路の出力す
る基準電圧を調整して第二の駆動回路に供給する調整回
路を備え、第二の駆動回路は、調整された基準電圧に基
づき第二の電圧をスイッチング素子に供給するものであ
る。
In a liquid crystal display device according to the present invention, a plurality of scanning lines and a plurality of signal lines are arranged in a matrix at intersections, and a first electrode is connected to a scanning electrode by a second electrode. A display unit having a switching element in which a third electrode is connected to a display electrode to a signal line, a first drive circuit connected to a scanning line and supplying a first voltage to the switching element, A reference voltage generation circuit that outputs a voltage, a plurality of second drive circuits that are connected to the signal line and supply a second voltage to the switching elements, and are provided for each of the second drive circuits, Adjust the reference voltage output from the reference voltage generation circuit according to the effect of the parasitic capacitance between one electrode and the third electrode on the voltage applied to the third electrode, and supply it to the second drive circuit A second adjustment circuit. Dynamic circuit, a second voltage based on the adjusted reference voltage and supplies to the switching element.

【0010】また、複数の走査線と複数の信号線との交
点に配置され、第一の電極が走査線に第二の電極が信号
線にそれぞれ接続されたスイッチング素子と、このスイ
ッチング素子の第三の電極に接続された表示電極と、こ
の表示電極と液晶を挾み対向するように配置された対向
電極とを有する画素がマトリクス状に配置された表示部
と、走査線に接続され、スイッチング素子に第一の電圧
を供給する第一の駆動回路と、複数の基準電圧を出力す
る基準電圧発生回路と、信号線に接続され、スイッチン
グ素子に第二の電圧を供給する複数の第二の駆動回路
と、この第二の駆動回路毎に設けられ、画素のスイッチ
ング素子の第三の電極に印加される電圧と対向電極に印
加される電圧とに応じて基準電圧発生回路の出力する基
準電圧を調整して第二の駆動回路に供給する調整回路を
備え、第二の駆動回路は、調整された基準電圧に基づき
第二の電圧をスイッチング素子に供給するものである。
A switching element is disposed at the intersection of a plurality of scanning lines and a plurality of signal lines, a first electrode being connected to the scanning line and a second electrode being connected to the signal line, respectively, A display section in which pixels each having a display electrode connected to the three electrodes and a counter electrode disposed so as to face the display electrode and sandwich the liquid crystal are connected to a matrix, and a switching section is connected to a scanning line. A first driving circuit that supplies a first voltage to the element, a reference voltage generating circuit that outputs a plurality of reference voltages, and a plurality of second voltages that are connected to the signal line and supply a second voltage to the switching element. A drive circuit, and a reference voltage provided for each of the second drive circuits and output by a reference voltage generation circuit in accordance with a voltage applied to a third electrode of the pixel switching element and a voltage applied to the counter electrode. Adjust the An adjustment circuit for supplying the drive circuit, the second driving circuit, a second voltage based on the adjusted reference voltage and supplies to the switching element.

【0011】また、調整回路は、画素のスイッチング素
子の第三の電極に印加される電圧と対向電極に印加され
る電圧との差に応じて基準電圧を調整するものである。
さらに、調整回路は、画素のスイッチング素子の第三の
電極に印加される電圧と対向電極に印加される電圧との
差を検出する第一の回路と、この第一の回路の出力を基
準電圧に重畳する第二の回路を有するものである。ま
た、画素のスイッチング素子の第三の電極に印加される
電圧の平均と対向電極に印加される電圧の平均が同じに
なるように基準電圧が調整されるものである。
The adjustment circuit adjusts the reference voltage according to the difference between the voltage applied to the third electrode of the switching element of the pixel and the voltage applied to the counter electrode.
Further, the adjustment circuit includes a first circuit for detecting a difference between a voltage applied to the third electrode of the switching element of the pixel and a voltage applied to the counter electrode, and an output of the first circuit as a reference voltage. And a second circuit for superimposing the second circuit. Further, the reference voltage is adjusted so that the average of the voltage applied to the third electrode of the switching element of the pixel is equal to the average of the voltage applied to the counter electrode.

【0012】[0012]

【発明の実施の形態】以下、この発明の実施の形態を図
1と図2を用いて説明する。図1は、この発明の実施の
形態による液晶表示装置を示す概略構成図である。図1
において、1〜4は図3における従来装置と同一のもの
であり、その説明を省略する。21はVref生成回路
1の出力する基準電圧Vrefの電位を自動調整するD
C電位自動調整回路で、各ソースドライバIC3毎に設
けられ、調整ずみの基準電圧Vrefをソースドライバ
IC3に出力する。図2は、この発明の実施の形態によ
る液晶表示装置のDC電位自動調整回路を示す詳細図で
ある。図2において、22はコモン電圧Vcomとドレ
イン電圧Vdの電位差を検出する誤差アンプ、23は誤
差アンプ22の出力を基準電圧Vrefに重畳させるD
C電圧重畳回路である。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the present invention will be described below with reference to FIGS. FIG. 1 is a schematic configuration diagram showing a liquid crystal display device according to an embodiment of the present invention. FIG.
, 1 to 4 are the same as those of the conventional apparatus in FIG. 3, and the description thereof is omitted. Reference numeral 21 denotes D for automatically adjusting the potential of the reference voltage Vref output from the Vref generation circuit 1.
The C potential automatic adjustment circuit is provided for each source driver IC3 and outputs the adjusted reference voltage Vref to the source driver IC3. FIG. 2 is a detailed diagram showing a DC potential automatic adjustment circuit of the liquid crystal display device according to the embodiment of the present invention. In FIG. 2, reference numeral 22 denotes an error amplifier for detecting a potential difference between the common voltage Vcom and the drain voltage Vd, and reference numeral 23 denotes D for superimposing the output of the error amplifier 22 on the reference voltage Vref.
This is a C voltage superposition circuit.

【0013】このように構成された液晶表示装置におい
ては、Vref生成回路1で生成されたN個の基準電圧
Vrefは、図1に示すように、各ソースドライバIC
3毎に設けられたDC電位自動調整回路21にそれぞれ
パラレルに供給される。また、このDC電位自動調整回
路21には、コモン電圧Vcomと、このDC電位自動
調整回路21の出力が供給されるソースTCP2のソー
ス駆動電圧の供給範囲にある任意のTFC10のドレイ
ン電圧Vdが、ソースTCP2を通して供給される。D
C電位自動調整回路21では、コモン電圧Vcomを基
準としてドレイン電圧Vdとの電圧差を誤差アンプ22
で検出し、その出力をDC電圧重畳回路23に入れて基
準電圧Vrefに重畳させ出力している。
In the liquid crystal display device configured as described above, the N reference voltages Vref generated by the Vref generation circuit 1 are applied to each source driver IC as shown in FIG.
The signals are supplied in parallel to the DC potential automatic adjustment circuits 21 provided for each of the three circuits. In addition, the DC potential automatic adjustment circuit 21 receives a common voltage Vcom and a drain voltage Vd of an arbitrary TFC 10 within a source drive voltage supply range of the source TCP2 to which the output of the DC potential automatic adjustment circuit 21 is supplied. Supplied through source TCP2. D
In the C potential automatic adjustment circuit 21, the voltage difference between the common voltage Vcom and the drain voltage Vd is referred to as an error amplifier 22.
, And the output is input to the DC voltage superimposing circuit 23 and superimposed on the reference voltage Vref for output.

【0014】それぞれのDC電位自動調整回路21より
出力された基準電圧Vrefは、各々のソースドライバ
IC3に入力され、ソースドライバIC3の内部にて6
4階調等に分割され、液晶パネル4に出力される。した
がって、液晶を挟んで対向電極側(コモン電極)のDC
電位を基準として、信号入力電極側(ドレイン電極)の
DC電位が常に対向電極側(コモン電極)のDC電位と
同じになるように調整される。また、ソースTCP2の
領域で画面が分割されて、各々の領域で最適DC電位に
調整される。
The reference voltage Vref output from each DC potential automatic adjustment circuit 21 is input to each source driver IC 3, and is internally stored in the source driver IC 3.
The image is divided into four gradations and the like and output to the liquid crystal panel 4. Therefore, the DC on the counter electrode side (common electrode) across the liquid crystal
The DC potential on the signal input electrode side (drain electrode) is adjusted to be always the same as the DC potential on the counter electrode side (common electrode) based on the potential. In addition, the screen is divided in the area of the source TCP2, and adjusted to the optimum DC potential in each area.

【0015】[0015]

【発明の効果】この発明は、以上説明したように構成さ
れているので、以下に示すような効果を奏する。スイッ
チング素子の走査線に接続された第一の電極と表示電極
に接続された第三の電極との間の寄生容量が、第三の電
極に印加される電圧に及ぼす影響に応じて、基準電圧発
生回路の出力する基準電圧を第二の駆動回路毎に調整し
て第二の駆動回路に供給する調整回路を備えたので、第
二の駆動回路は、調整された第二の電圧をスイッチング
素子に供給することができ、第一の電極と第三の電極と
の間の寄生容量の影響のない表示が得られ、表示部内で
のフリッカのバラツキをなくすことができる。
Since the present invention is configured as described above, it has the following effects. The reference voltage is set according to the effect of the parasitic capacitance between the first electrode connected to the scanning line of the switching element and the third electrode connected to the display electrode on the voltage applied to the third electrode. Since the adjusting circuit for adjusting the reference voltage output from the generating circuit for each second driving circuit and supplying the adjusted voltage to the second driving circuit is provided, the second driving circuit switches the adjusted second voltage to the switching element. And a display free from the influence of the parasitic capacitance between the first electrode and the third electrode can be obtained, and variations in flicker in the display unit can be eliminated.

【0016】また、画素のスイッチング素子の第三の電
極に印加される電圧と対向電極に印加される電圧とに応
じて、基準電圧発生回路の出力する基準電圧を第二の駆
動回路毎に調整して第二の駆動回路に供給する調整回路
を備え、スイッチング素子の第一の電極と第三の電極と
の間の寄生容量が第三の電極に印加される電圧に及ぼす
影響をなくし、表示部内でのフリッカのバラツキをなく
すことができる。また、調整回路は、画素のスイッチン
グ素子の第三の電極に印加される電圧と対向電極に印加
される電圧との差に応じて基準電圧を調整するので、確
実に基準電圧を調整することができる。
The reference voltage output from the reference voltage generation circuit is adjusted for each second drive circuit according to the voltage applied to the third electrode of the switching element of the pixel and the voltage applied to the counter electrode. And an adjustment circuit for supplying to the second drive circuit, eliminating the influence of the parasitic capacitance between the first electrode and the third electrode of the switching element on the voltage applied to the third electrode, and displaying It is possible to eliminate flicker variation in the department. Further, the adjustment circuit adjusts the reference voltage according to the difference between the voltage applied to the third electrode of the switching element of the pixel and the voltage applied to the counter electrode, so that the reference voltage can be surely adjusted. it can.

【0017】さらに、調整回路は、画素のスイッチング
素子の第三の電極に印加される電圧と対向電極に印加さ
れる電圧との差を検出する第一の回路と、この第一の回
路の出力を基準電圧に重畳する第二の回路を有するの
で、確実に調整された基準電圧を得ることができる。ま
た、画素のスイッチング素子の第三の電極に印加される
電圧の平均と対向電極に印加される電圧の平均が同じに
なるように基準電圧が調整されるので、最適な基準電圧
に調整できる。
Further, the adjustment circuit includes a first circuit for detecting a difference between a voltage applied to the third electrode of the switching element of the pixel and a voltage applied to the counter electrode, and an output of the first circuit. Is superimposed on the reference voltage, so that the adjusted reference voltage can be reliably obtained. Further, since the reference voltage is adjusted such that the average of the voltage applied to the third electrode of the switching element of the pixel is equal to the average of the voltage applied to the counter electrode, the reference voltage can be adjusted to an optimum value.

【図面の簡単な説明】[Brief description of the drawings]

【図1】 この発明の実施の形態による液晶表示装置を
示す概略構成図である。
FIG. 1 is a schematic configuration diagram showing a liquid crystal display device according to an embodiment of the present invention.

【図2】 この発明の実施の形態による液晶表示装置の
DC電位自動調整回路を示す詳細図である。
FIG. 2 is a detailed diagram showing a DC potential automatic adjustment circuit of the liquid crystal display device according to the embodiment of the present invention.

【図3】 従来の液晶表示装置を示す概略構成図であ
る。
FIG. 3 is a schematic configuration diagram showing a conventional liquid crystal display device.

【図4】 従来の液晶表示装置の一画素分の等価回路を
示す図である。
FIG. 4 is a diagram showing an equivalent circuit for one pixel of a conventional liquid crystal display device.

【図5】 従来の液晶表示装置の液晶セルにかかる各部
の電圧波形を示す図である。
FIG. 5 is a diagram showing voltage waveforms at various portions of a liquid crystal cell of a conventional liquid crystal display device.

【図6】 従来の液晶表示装置の液晶パネルの左側と右
側のゲート駆動電圧波形の歪みを示す図である。
FIG. 6 is a diagram showing distortion of gate drive voltage waveforms on the left and right sides of a liquid crystal panel of a conventional liquid crystal display device.

【符号の説明】[Explanation of symbols]

1 Vref生成回路、 2 ソースTCP、 3 ソ
ースドライバIC、4 液晶パネル、 8 ゲート線、
9 ソース線、 10 TFT、11 ゲート・ドレ
イン間の寄生容量Cgd、 12 液晶の容量Clc、
18 ゲートTCP、 21 DC電位自動調整回路、
22 誤差アンプ、23 DC電圧重畳回路。
1 Vref generation circuit, 2 source TCP, 3 source driver IC, 4 liquid crystal panel, 8 gate lines,
9 source line, 10 TFT, 11 gate-drain parasitic capacitance Cgd, 12 liquid crystal capacitance Clc,
18 gate TCP, 21 DC potential automatic adjustment circuit,
22 error amplifier, 23 DC voltage superposition circuit.

Claims (5)

【特許請求の範囲】[Claims] 【請求項1】 複数の走査線と複数の信号線との交点に
マトリクス状に配置され、第一の電極が上記走査線に第
二の電極が上記信号線に第三の電極が表示電極にそれぞ
れ接続されたスイッチング素子を有する表示部、上記走
査線に接続され、上記スイッチング素子に第一の電圧を
供給する第一の駆動回路、複数の基準電圧を出力する基
準電圧発生回路、上記信号線に接続され、上記スイッチ
ング素子に第二の電圧を供給する複数の第二の駆動回
路、この第二の駆動回路毎に設けられ、上記スイッチン
グ素子の第一の電極と第三の電極との間の寄生容量が第
三の電極に印加される電圧に及ぼす影響に応じて上記基
準電圧発生回路の出力する基準電圧を調整して第二の駆
動回路に供給する調整回路を備え、上記第二の駆動回路
は、調整された基準電圧に基づき第二の電圧をスイッチ
ング素子に供給することを特徴とする液晶表示装置。
1. A plurality of scanning lines and a plurality of signal lines are arranged in a matrix at intersections, with a first electrode serving as the scanning line, a second electrode serving as the signal line, and a third electrode serving as a display electrode. A display unit having a switching element connected thereto, a first drive circuit connected to the scanning line and supplying a first voltage to the switching element, a reference voltage generating circuit outputting a plurality of reference voltages, and the signal line A plurality of second drive circuits connected to and supplying a second voltage to the switching element, provided for each of the second drive circuits, between the first electrode and the third electrode of the switching element. An adjustment circuit that adjusts a reference voltage output from the reference voltage generation circuit in accordance with an influence of a parasitic capacitance on a voltage applied to a third electrode and supplies the reference voltage to a second drive circuit, and The drive circuit is A liquid crystal display device, wherein a second voltage is supplied to a switching element based on a pressure.
【請求項2】 複数の走査線と複数の信号線との交点に
配置され、第一の電極が上記走査線に第二の電極が上記
信号線にそれぞれ接続されたスイッチング素子と、この
スイッチング素子の第三の電極に接続された表示電極
と、この表示電極と液晶を挾み対向するように配置され
た対向電極とを有する画素がマトリクス状に配置された
表示部、上記走査線に接続され、上記スイッチング素子
に第一の電圧を供給する第一の駆動回路、複数の基準電
圧を出力する基準電圧発生回路、上記信号線に接続さ
れ、上記スイッチング素子に第二の電圧を供給する複数
の第二の駆動回路、この第二の駆動回路毎に設けられ、
上記画素のスイッチング素子の第三の電極に印加される
電圧と対向電極に印加される電圧とに応じて上記基準電
圧発生回路の出力する基準電圧を調整して上記第二の駆
動回路に供給する調整回路を備え、上記第二の駆動回路
は、調整された基準電圧に基づき第二の電圧を上記スイ
ッチング素子に供給することを特徴とする液晶表示装
置。
A switching element having a first electrode connected to the scanning line and a second electrode connected to the signal line, wherein the switching element is disposed at an intersection of the plurality of scanning lines and the plurality of signal lines; A display section in which pixels each having a display electrode connected to the third electrode and a counter electrode disposed so as to oppose the display electrode with the liquid crystal interposed therebetween is connected to the scanning line and is connected to the scanning line. A first drive circuit that supplies a first voltage to the switching element, a reference voltage generation circuit that outputs a plurality of reference voltages, and a plurality of supply circuits that are connected to the signal line and supply a second voltage to the switching element. A second drive circuit, provided for each second drive circuit,
The reference voltage output from the reference voltage generation circuit is adjusted according to the voltage applied to the third electrode of the switching element of the pixel and the voltage applied to the counter electrode and supplied to the second drive circuit. A liquid crystal display device comprising an adjustment circuit, wherein the second drive circuit supplies a second voltage to the switching element based on the adjusted reference voltage.
【請求項3】 調整回路は、画素のスイッチング素子の
第三の電極に印加される電圧と対向電極に印加される電
圧との差に応じて基準電圧を調整することを特徴とする
請求項2記載の液晶表示装置。
3. The adjustment circuit according to claim 2, wherein the adjustment circuit adjusts the reference voltage according to a difference between a voltage applied to the third electrode of the switching element of the pixel and a voltage applied to the counter electrode. The liquid crystal display device as described in the above.
【請求項4】 調整回路は、画素のスイッチング素子の
第三の電極に印加される電圧と対向電極に印加される電
圧との差を検出する第一の回路と、この第一の回路の出
力を基準電圧に重畳する第二の回路を有することを特徴
とする請求項2または請求項3記載の液晶表示装置。
4. An adjustment circuit comprising: a first circuit for detecting a difference between a voltage applied to a third electrode of a switching element of a pixel and a voltage applied to a counter electrode; and an output of the first circuit. 4. The liquid crystal display device according to claim 2, further comprising a second circuit that superimposes a reference voltage on the reference voltage.
【請求項5】 画素のスイッチング素子の第三の電極に
印加される電圧の平均と対向電極に印加される電圧の平
均が同じになるように基準電圧が調整されることを特徴
とする請求項2〜請求項4のいずれか一項記載の液晶表
示装置。
5. The reference voltage is adjusted such that the average of the voltage applied to the third electrode of the switching element of the pixel is equal to the average of the voltage applied to the counter electrode. The liquid crystal display device according to claim 2.
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