JPH09114541A - 割り込み発生時刻確認回路、処理装置 - Google Patents
割り込み発生時刻確認回路、処理装置Info
- Publication number
- JPH09114541A JPH09114541A JP7268671A JP26867195A JPH09114541A JP H09114541 A JPH09114541 A JP H09114541A JP 7268671 A JP7268671 A JP 7268671A JP 26867195 A JP26867195 A JP 26867195A JP H09114541 A JPH09114541 A JP H09114541A
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- JP
- Japan
- Prior art keywords
- time
- interrupt
- generation time
- interruption
- cpu
- Prior art date
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Abstract
(57)【要約】
【課題】 割り込み発生時刻をＣＰＵで正確に認識す
る。 【解決手段】 割り込み発生時に割り込み制御回路２１
から検知信号２２が出力され、この信号２２の出力時点
からカウンタ２４は基準クロックの計数を開始する。Ｃ
ＰＵ２３は、この計数値と基準クロックの周期とから、
割り込み発生時刻よりの経過時間を算出し、これとＣＰ
Ｕ２３の内部時計から割り込み発生時刻を算出する。
る。 【解決手段】 割り込み発生時に割り込み制御回路２１
から検知信号２２が出力され、この信号２２の出力時点
からカウンタ２４は基準クロックの計数を開始する。Ｃ
ＰＵ２３は、この計数値と基準クロックの周期とから、
割り込み発生時刻よりの経過時間を算出し、これとＣＰ
Ｕ２３の内部時計から割り込み発生時刻を算出する。
Description
【０００１】
【発明の属する技術分野】本発明は、割り込み発生時刻
確認回路とその回路を備えた処理装置に関わり、特にマ
イクロコンピュータなどを用いて外部割り込みの時刻を
正確に計測して処理を行うのに好適な割り込み発生時刻
確認回路とその回路を備えた処理装置に関する。
確認回路とその回路を備えた処理装置に関わり、特にマ
イクロコンピュータなどを用いて外部割り込みの時刻を
正確に計測して処理を行うのに好適な割り込み発生時刻
確認回路とその回路を備えた処理装置に関する。
【０００２】
【従来の技術】図２は、割り込み処理機能を備えた処理
装置の構成を示したブロック図で、外部からの割り込み
要因が発生すると、割り込み制御回路２１はこれを検知
し、検知信号２２を出力する。ＣＰＵ２３はこの信号２
２を受けると、今まで実行していた処理と割り込み処理
の優先度を比べ、もし今まで実行中の処理の優先度が高
いときは、それが終わるまで割り込み処理を待たせる。
また割り込み処理の方が優先度が高い場合には、今まで
の処理をいったん中断して割り込み処理を開始する。
装置の構成を示したブロック図で、外部からの割り込み
要因が発生すると、割り込み制御回路２１はこれを検知
し、検知信号２２を出力する。ＣＰＵ２３はこの信号２
２を受けると、今まで実行していた処理と割り込み処理
の優先度を比べ、もし今まで実行中の処理の優先度が高
いときは、それが終わるまで割り込み処理を待たせる。
また割り込み処理の方が優先度が高い場合には、今まで
の処理をいったん中断して割り込み処理を開始する。
【０００３】
【発明が解決しようとする課題】外部割り込み処理に
は、その割り込みが発生した時刻が処理の際に用いられ
る場合がある。たとえば、何らかの制御あるいは計測対
象システムからの割り込みの場合、その対象システムの
制御量の時間変化の統計を取ったり、変量の変化速度を
計測する、あるいは何らかの事象の時間インターバルを
計測したりする場合である。このような場合には、割り
込みの発生時刻をＣＰＵは知る必要があるが、前記のよ
うにもしその割り込みの優先度が実行中処理のそれより
も低いと、処理待ちが生じて、ＣＰＵは正しい割り込み
発生時刻を知ることができないという問題があった。
は、その割り込みが発生した時刻が処理の際に用いられ
る場合がある。たとえば、何らかの制御あるいは計測対
象システムからの割り込みの場合、その対象システムの
制御量の時間変化の統計を取ったり、変量の変化速度を
計測する、あるいは何らかの事象の時間インターバルを
計測したりする場合である。このような場合には、割り
込みの発生時刻をＣＰＵは知る必要があるが、前記のよ
うにもしその割り込みの優先度が実行中処理のそれより
も低いと、処理待ちが生じて、ＣＰＵは正しい割り込み
発生時刻を知ることができないという問題があった。
【０００４】本発明の目的は、外部割り込み処理発生時
に、その発生時刻を取り込む必要のある処理を正確に行
うための、割り込み発生時刻確認回路と、その回路を備
えた処理装置を提供するにある。
に、その発生時刻を取り込む必要のある処理を正確に行
うための、割り込み発生時刻確認回路と、その回路を備
えた処理装置を提供するにある。
【０００５】
【課題を解決するための手段】本発明は、割り込み発生
時刻より既知の周期を有した基準クロックの計数を開始
し、その計数値を、前記割り込み発生時刻からの経過時
間を表す情報として出力することを特徴とする割り込み
発生時刻確認回路を開示する。
時刻より既知の周期を有した基準クロックの計数を開始
し、その計数値を、前記割り込み発生時刻からの経過時
間を表す情報として出力することを特徴とする割り込み
発生時刻確認回路を開示する。
【０００６】また、本発明は、前記割り込み発生時刻確
認回路を備え、該割り込み発生時刻確認回路から出力さ
れた計数値と前記基準クロックの周期とから前記経過時
間を算出し、内蔵している時計の時刻と前記算出した経
過時間とから前記割り込み発生の時刻を算出するように
構成されたことを特徴とする処理装置を開示する。
認回路を備え、該割り込み発生時刻確認回路から出力さ
れた計数値と前記基準クロックの周期とから前記経過時
間を算出し、内蔵している時計の時刻と前記算出した経
過時間とから前記割り込み発生の時刻を算出するように
構成されたことを特徴とする処理装置を開示する。
【０００７】
【発明の実施の形態】以下、本発明の実施の形態を説明
する。図１は、本発明になる割り込み発生時刻確認回路
を備えた処理装置の実施の形態の一例を示すブロック図
である。同図において、図２と同一の回路には同一の符
号が付されており、さらに新たに、割り込み時間を確実
に計測するための確認回路、すなわちカウンタ回路２４
が設けられている。
する。図１は、本発明になる割り込み発生時刻確認回路
を備えた処理装置の実施の形態の一例を示すブロック図
である。同図において、図２と同一の回路には同一の符
号が付されており、さらに新たに、割り込み時間を確実
に計測するための確認回路、すなわちカウンタ回路２４
が設けられている。
【０００８】カウンタ２４には既知の周期を有した基準
クロックＣＬと、割り込み制御回路からの割り込み発生
を知らせる検知信号２２とが入力されている。カウンタ
２４は、前記の検知信号２２が入力されると、前記基準
クロックの計数を開始し、その計数値を常にＣＰＵ２３
の入出力ポートへ送っている。ＣＰＵ２３は、割り込み
の検知信号２２を受け取り、その処理を開始する時点に
なると、入出力ポートから前記カウンタ２４の計数値を
読み込む。このとき、この読み込みが終了した時点のＣ
ＰＵの内部時計は、当該割り込みの発生時刻ｔ０から、
カウンタ２４の計数値に該当する時間Ｔ１と、ＣＰＵが
入出力ポートからその計数値を読み込むのに要した時間
Ｔ２とが経過した時刻ｔを示しているはずである。すな
わち
クロックＣＬと、割り込み制御回路からの割り込み発生
を知らせる検知信号２２とが入力されている。カウンタ
２４は、前記の検知信号２２が入力されると、前記基準
クロックの計数を開始し、その計数値を常にＣＰＵ２３
の入出力ポートへ送っている。ＣＰＵ２３は、割り込み
の検知信号２２を受け取り、その処理を開始する時点に
なると、入出力ポートから前記カウンタ２４の計数値を
読み込む。このとき、この読み込みが終了した時点のＣ
ＰＵの内部時計は、当該割り込みの発生時刻ｔ０から、
カウンタ２４の計数値に該当する時間Ｔ１と、ＣＰＵが
入出力ポートからその計数値を読み込むのに要した時間
Ｔ２とが経過した時刻ｔを示しているはずである。すな
わち
【数１】ｔ＝ｔ０＋Ｔ１＋Ｔ２
【０００９】ここで、カウンタ２４の計数値に該当する
時間Ｔ１は、その計数値と基準クロックの積から求めら
れ、また計数値の読み込み時間Ｔ２は、読み込みプログ
ラムのステップ数からあらかじめわかっている。従っ
て、この（数１）から割り込み発生時刻ｔ０は
時間Ｔ１は、その計数値と基準クロックの積から求めら
れ、また計数値の読み込み時間Ｔ２は、読み込みプログ
ラムのステップ数からあらかじめわかっている。従っ
て、この（数１）から割り込み発生時刻ｔ０は
【数２】ｔ０＝ｔ−Ｔ１−Ｔ２ により正確に求められる。しかもこの方法によると、当
該割り込み発生時に、より高い優先度を有した他の処理
が走っていて当該割り込みに対する処理が待たされたと
きでも、正確に割り込み発生時刻を示している。
該割り込み発生時に、より高い優先度を有した他の処理
が走っていて当該割り込みに対する処理が待たされたと
きでも、正確に割り込み発生時刻を示している。
【００１０】なお、基準クロックＣＬは、図１ではＣＰ
Ｕとは別のところから得ているように図示しているが、
これはＣＰＵの内部クロックを用いた計測であってもよ
いことはいうまでもない。
Ｕとは別のところから得ているように図示しているが、
これはＣＰＵの内部クロックを用いた計測であってもよ
いことはいうまでもない。
【００１１】
【発明の効果】本発明によれば、割り込み時により優先
度の高い処理が走っていて、当該割り込みの処理が遅れ
た場合でも、ＣＰＵは割り込み発生時刻を正確に取得で
き、その発生時刻に基づく処理を確実に実行できる効果
がある。
度の高い処理が走っていて、当該割り込みの処理が遅れ
た場合でも、ＣＰＵは割り込み発生時刻を正確に取得で
き、その発生時刻に基づく処理を確実に実行できる効果
がある。
【図面の簡単な説明】
【図１】本発明になる割り込み確認回路を備えた処理装
置の例を示すブロック図である。
置の例を示すブロック図である。
【図２】割り込み処理機能を備えた従来の処理装置のブ
ロック図である。
ロック図である。
【符号の説明】 ２１ 割り込み制御回路 ２２ 割り込み検知信号 ２３ ＣＰＵ ２４ カウンタ回路
Claims (2)
- 【請求項１】 割り込み発生時刻より既知の周期を有し
た基準クロックの計数を開始し、その計数値を、前記割
り込み発生時刻からの経過時間を表す情報として出力す
ることを特徴とする割り込み発生時刻確認回路。 - 【請求項２】 請求項１に記載の割り込み発生時刻確認
回路を備え、該割り込み発生時刻確認回路から出力され
た計数値と前記基準クロックの周期とから前記経過時間
を算出し、内蔵している時計の時刻と前記算出した経過
時間とから前記割り込み発生の時刻を算出するように構
成されたことを特徴とする処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7268671A JPH09114541A (ja) | 1995-10-17 | 1995-10-17 | 割り込み発生時刻確認回路、処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7268671A JPH09114541A (ja) | 1995-10-17 | 1995-10-17 | 割り込み発生時刻確認回路、処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09114541A true JPH09114541A (ja) | 1997-05-02 |
Family
ID=17461783
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7268671A Pending JPH09114541A (ja) | 1995-10-17 | 1995-10-17 | 割り込み発生時刻確認回路、処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09114541A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1333529C (zh) * | 2004-02-10 | 2007-08-22 | 大唐移动通信设备有限公司 | 一种电子设备中时钟信号检测方法和装置 |
| WO2016086031A1 (en) * | 2014-11-26 | 2016-06-02 | Qualcomm Incorporated | In-band interrupt time stamp |
| EP3045987A4 (en) * | 2013-10-15 | 2016-11-16 | Omron Tateisi Electronics Co | CONTROL DEVICE AND CONTROL METHOD |
| WO2018144163A1 (en) * | 2017-02-06 | 2018-08-09 | Qualcomm Incorporated | Apparatus and method for asynchronous event timestamping |
-
1995
- 1995-10-17 JP JP7268671A patent/JPH09114541A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1333529C (zh) * | 2004-02-10 | 2007-08-22 | 大唐移动通信设备有限公司 | 一种电子设备中时钟信号检测方法和装置 |
| EP3045987A4 (en) * | 2013-10-15 | 2016-11-16 | Omron Tateisi Electronics Co | CONTROL DEVICE AND CONTROL METHOD |
| WO2016086031A1 (en) * | 2014-11-26 | 2016-06-02 | Qualcomm Incorporated | In-band interrupt time stamp |
| CN107003958A (zh) * | 2014-11-26 | 2017-08-01 | 高通股份有限公司 | 带内中断时间戳 |
| US9904637B2 (en) | 2014-11-26 | 2018-02-27 | Qualcomm Incorporated | In-band interrupt time stamp |
| WO2018144163A1 (en) * | 2017-02-06 | 2018-08-09 | Qualcomm Incorporated | Apparatus and method for asynchronous event timestamping |
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